本申请要求于2016年10月18日在美国专利和商标局提交的第15/296,197号美国专利申请的权益，该美国专利申请的公开内容通过引用全部包含于此。
发明构思涉及一种存储器装置，更具体地，涉及一种存储器装置及其边缘字线管理方法。
背景技术：
存储器装置用于存储数据并且被分类为易失性存储器装置和非易失性存储器装置。在易失性存储器装置中，存储的数据在断电的情况下被擦除。然而，非易失性存储器装置在断电的情况下保持所存储的数据。作为一种非易失性存储器装置，闪存装置可以应用于便携式电话、数码相机、个人数字助理(pda)和/或计算装置等。
技术实现要素：
根据发明构思的示例性实施例，提供了一种存储器装置的边缘字线管理方法，所述方法包括：响应于擦除命令对存储器装置执行擦除操作，随机确定虚设样式的数据，通过在虚设存储器单元中写入虚设样式的数据来执行后编程操作，其中，所述虚设存储器单元与已经执行了擦除操作的存储器块中包括的单元串的主存储器单元相邻。
根据发明构思的示例性实施例，虚设存储器单元设置在单元串的主存储器单元与地选择晶体管之间。
根据发明构思的示例性实施例，当在存储器块中包括的单元串的地选择晶体管与主存储器单元之间设置有多个虚设存储器单元时，虚设样式的数据被写入最靠近主存储器单元的虚设存储器单元。
根据发明构思的示例性实施例，随机确定虚设样式的数据包括：将虚设样式的数据确定为在擦除操作之前从存储器块的初始设定字线读取并备份的数据。
根据发明构思的示例性实施例，随机确定虚设样式的数据包括：将虚设样式的数据确定为通过对在擦除操作之前从存储器块的初始设定字线读取的一些数据进行反转而得到的数据。
根据发明构思的示例性实施例，随机确定虚设样式的数据包括：通过使用在擦除操作的验证过程中产生的信息，将虚设样式的数据确定为从两个或更多个候选数据样式中选择的一个数据样式。
根据发明构思的示例性实施例，随机确定虚设样式的数据包括：设定至少两个候选数据样式；基于在存储器装置中使用的一个或更多个时钟信号的某一时刻处检测到的相位，将虚设样式的数据确定为从所述至少两个候选数据样式中选择的一个数据样式。
根据发明构思的示例性实施例，随机确定虚设样式的数据包括：通过使用位线和页缓冲器的连接结构，基于在存储器装置中使用的一个或更多个时钟信号的某一时刻处检测到的相位，将虚设样式的数据确定为随机设定的偶数位线样式或者奇数位线样式。
根据发明构思的示例性实施例，所述方法还包括：检查后编程模式的设定状态，其中，当启用后编程模式时，执行后编程操作，当禁用后编程模式时，不执行后编程操作。
根据发明构思的示例性实施例，所述方法还包括：当用于多个存储器块中的每个的编程循环计数或擦除循环计数大于初始设定的阈值时，将对应的存储器块设定为后编程模式使能状态。
根据发明构思的示例性实施例，提供了一种存储器装置的边缘字线管理方法，所述方法包括：响应于对存储器装置的空闲存储器块执行第一编程操作的编程命令随机确定虚设样式的数据，通过在虚设存储器单元中写入虚设样式的数据来执行预编程操作，其中，虚设存储器单元与包括在空闲存储器块中的单元串的主存储器单元相邻，并且在执行预编程操作之后，响应于对所述主存储器单元的所述编程命令执行编程操作。
根据发明构思的示例性实施例，虚设存储器单元设置在空闲存储器块中包括的单元串的主存储器单元与地选择晶体管之间。
根据发明构思的示例性实施例，随机确定虚设样式的数据包括：基于在一个或更多个时钟信号的某一时刻处检测的相位，将虚设样式的数据确定为从至少两个候选数据样式中选择的一个数据样式。
根据发明构思的示例性实施例，所述方法还包括：检查预编程模式的设定状态，其中，当启用预编程模式时，执行预编程操作，当禁用预编程模式时，不执行预编程操作。
根据发明构思的示例性实施例，所述方法还包括：当用于多个存储器块中的每个的编程循环计数或擦除循环计数大于初始设定的阈值时，将相应的存储器块设定为预编程模式使能状态。
根据发明构思的示例性实施例，提供了一种操作存储器装置的方法，所述方法包括：对存储器装置的单元串执行擦除操作，其中，所述单元串包括虚设存储器单元和主存储器单元；在第一虚设存储器单元中编程虚设样式的数据，其中，第一虚设存储器单元与第一主存储器单元相邻；在编程第一虚设存储器单元之后编程第一主存储器单元。
根据发明构思的示例性实施例，编程管理电路确定虚设样式的数据，其中，编程管理电路包括在存储器装置或存储器控制器中。
根据发明构思的示例性实施例，虚设样式的数据是随机数据。
根据发明构思的示例性实施例，第一虚设存储器单元设置在单元串的第一主存储器单元与地选择晶体管之间。
根据发明构思的示例性实施例，虚设存储器单元与主存储单元垂直地在单元串中彼此堆叠。
附图说明
通过参照附图详细描述发明构思的示例性实施例，将更加清楚地理解发明构思的上述和其它特征，其中：
图1是示出根据发明构思的示例性实施例的存储器系统的框图；
图2是示出根据发明构思的示例性实施例的存储器系统的框图；
图3是示出根据发明构思的示例性实施例的存储器系统的框图；
图4是示出根据发明构思的示例性实施例的存储器系统的框图；
图5是示出根据发明构思的示例性实施例包括在图1的存储器系统中的存储器装置的框图；
图6是示出根据发明构思的示例性实施例的包括在图2或图4的存储器系统中的存储器装置的框图；
图7是示出根据发明构思的示例性实施例的包括在图3的存储器系统中的存储器装置的框图；
图8示出了根据发明构思的示例性实施例的在图5至图7中示出的存储器单元阵列；
图9是根据发明构思的示例性实施例的包括在图8中示出的存储器单元阵列中的存储器块的电路图；
图10是根据发明构思的示例性实施例的包括在图8中示出的存储器单元阵列中的存储器块的电路图；
图11是根据发明构思的示例性实施例包括在图9或图10中示出的存储器块中的存储器单元的剖视图；
图12示出了根据发明构思的示例性实施例的在图1或图3中示出的存储器控制器的块配置；
图13示出了根据发明构思的示例性实施例的在图2中示出的存储器控制器的块配置；
图14示出了根据发明构思的示例性实施例的在图4中示出的存储器控制器的块配置；
图15示出了在根据发明构思的示例性实施例禁用后编程模式或预编程模式的情况下，包括在图9或图10中示出的存储器块中的一个单元串中的初始编程状态；
图16示出了在根据发明构思的示例性实施例禁用后编程模式或预编程模式的情况下，存储器块中的基于字线的存储器单元在编程运行基础上的阈值电压变化；
图17a-图17c示出了在根据发明构思的示例性实施例启用后编程模式或预编程模式的情况下，针对包括在图9或图10示出的存储器块中的一个单元串进行擦除操作之后的编程处理；
图18示出了在根据发明构思的示例性实施例启用后编程模式或预编程模式的情况下，存储器块中的基于字线的存储器单元在编程运行基础上的阈值电压变化；
图19是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作或预编程操作的虚设样式的数据的方法的图；
图20是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作的虚设样式的数据的方法的图；
图21是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作或预编程操作的虚设样式的数据的方法的图；
图22a-图22c是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作的虚设样式的数据的方法的图；
图23示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图；
图24示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图；
图25示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图；
图26示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图；
图27是示出被应用于存储器卡系统的根据发明构思的示例性实施例的存储器系统的框图；
图28是示出包括根据发明构思的示例性实施例的存储器系统的计算系统的框图；
图29是示出被应用于固态盘(ssd)系统的根据发明构思的示例性实施例的存储器系统的框图。
具体实施方式
在下文中，将参照附图详细描述发明构思的示例性实施例。然而，发明构思可以以不同的形式实施并且不应被解释为受限于这里阐述的实施例。相同的附图标记在整个说明书中可以指代相同的元件。在附图中，为了清楚起见，可以夸大或缩小每个结构的尺寸。附图中示出的所有元件可以由电路组成。除非相反，否则单数形式的术语可以包括复数形式。
图1是示出根据发明构思的示例性实施例的存储器系统100a的框图。
如图1所示，存储器系统100a可以包括存储器装置10a和存储器控制器20a。存储器装置10a可以包括存储器单元阵列11和后编程管理器12-1a。
存储器单元阵列11可以包括分别设置在多条字线与多条位线相交的多个区域中的多个存储器单元。在发明构思的示例性实施例中，多个存储器单元可以是闪存单元。例如，存储器单元阵列11可以是nand闪存单元阵列或nor闪存单元阵列。在下文中，将对多个存储器单元为闪存单元的情况进行描述。
存储器单元阵列11可以具有多个存储器单元彼此串联连接的串结构。例如，在多个单元串中的每个单元串中，地选择晶体管、一个或更多个虚设存储器单元、多个主存储器单元以及串选择晶体管可以串联连接在公共源极线csl与位线bl之间。一个或更多个虚设存储器单元可以设置在地选择晶体管与多个主存储器单元之间，从而减小公共源极线csl对主存储器单元的耦合影响。换言之，可以将虚设存储器单元设置在主存储器单元的边缘中。
作为另一示例，在每个单元串中，地选择晶体管、一个或更多个虚设存储器单元、多个主存储器单元、一个或更多个虚设存储器单元以及串选择晶体管可以串联连接在公共源极线csl与位线bl之间。
此外，在每个单元串中，可以按照从最靠近与全局源极线gsl连接的地选择晶体管的存储器单元到距离该地选择晶体管更远的存储器单元的次序对多个存储器单元编程，从而使后样式依赖性(backpatterndependency)最小化。在下文中，可以将全局源极线gsl称为地选择线。
例如，存储器单元阵列11可以具有二维(2d)平面nand闪存单元结构。作为另一个示例，存储器单元阵列11可以具有三维(3d)垂直nand(vnand)闪存单元结构。
在本实施例中，具有3d结构的存储器单元阵列11可以单片地形成在存储器单元的阵列的一个或更多个物理级中，存储器单元具有设置在硅基底上的有源区和与每个存储器单元的操作相关联的电路。相关联的电路可以设置在基底上或基底中。术语“单片地”可以表示存储器单元阵列11的每个级的层直接沉积在存储器单元阵列11的每个下级的层上。
在发明构思的示例性实施例中，具有3d结构的存储器单元阵列11可以包括按照使至少一个存储器单元设置在另一存储器单元上的次序布置在垂直方向上的多个nand串。所述至少一个存储器单元可以包括电荷捕获层。第7,679,133号、第8,553,466号，第8,654,587号和第8,559,235号美国专利以及第2011/0233648号美国专利申请公开了一种3d存储器阵列的元件，其包括多个级，并且多个级之间共享字线和/或位线。上述专利文献的全部内容通过引用包含于此。
后编程管理器12-1a可以包括用于执行图23或图24中示出的存储器装置10a的边缘字线管理方法的硬件或软件。
后编程管理器12-1a可以基于从存储器控制器20a接收到的擦除命令来终止擦除操作，然后可以执行在与已执行擦除操作的存储器块的主存储器单元相邻的虚设存储器单元中写入随机虚设样式的数据的后编程操作。例如，后编程管理器12-1a可以执行擦除操作，然后可以执行在与已执行擦除操作的存储器块中包括的单元串的主存储器单元相邻的虚设存储器单元中写入虚设样式的数据的后编程操作。
例如，通过后编程操作写入虚设样式的数据的虚设存储器单元可以设置在单元串的主存储器单元与地选择晶体管之间。例如，如果在包括在存储器块中的单元串的主存储器单元与地选择晶体管之间设置有多个虚设存储器单元，则后编程管理器12-1a可以在与主存储器单元最邻近的虚设存储器单元中执行写入虚设样式的数据的操作。
后编程管理器12-1a可以随机地确定用于后编程的虚设样式的数据。例如，当在连接到虚设字线的所有虚设存储器单元中编程0时，主存储器单元可以编程n(其中n是等于或大于1的整数)次，在这种情况下，每个虚设存储器单元可以编程2n次。当这种情况发生时，每个虚设存储器单元可能变成最差存储器单元，从而对相邻的主存储器单元施加负面影响。然而，当随机地确定虚设样式的数据时，可以限制虚设存储器单元的负面影响。
例如，后编程管理器12-1a可以将在擦除操作之前通过将要被擦除的存储器块的初始设定字线而读取并备份的数据确定为虚设样式的数据。作为另一示例，后编程管理器12-1a可以将在擦除操作之前通过随机确定的存储器块的初始设定字线而读取的数据确定为虚设样式的数据。作为另一实施例，后编程管理器12-1a可以将在擦除操作之前通过随机确定的存储器块的初始设定字线而读取的数据中的一些数据进行反转而获得的数据确定为虚设样式的数据。作为另一示例，后编程管理器12-1a可以通过使用在擦除操作的验证处理操作中产生的信息，将从两个或更多个候选数据样式中选择的一个数据样式确定为虚设样式的数据。作为另一示例，后编程管理器12-1a可以设定至少两个候选数据样式，并且可以基于在存储器装置10a中使用的一个或更多个时钟信号的某一时刻处检测到的相位，将从至少两个候选数据样式中选择的一个数据样式确定为虚设样式的数据。
如上所述，存储器装置10a的后编程管理器12-1a可以产生虚设样式的数据，因此，可以不从存储器控制器20a提供用于后编程操作的虚设样式的数据。
当启用后编程模式时，后编程管理器12-1a可以执行后编程操作。当禁用后编程模式时，后编程管理器12-1a可以控制存储器装置10a的后编程操作使得不执行后编程操作。例如，如果每个存储器块的编程/擦除循环计数大于初始设定的阈值，则后编程管理器12-1a可以将对应的存储器块设定为后编程模式使能状态。
存储器控制器20a可以对存储器装置10a执行控制操作。例如，存储器控制器20a可以产生用于控制存储器装置10a的地址addr、命令cmd和控制信号ctrl。此外，存储器控制器20a可以将地址addr、命令cmd和控制信号ctrl提供到存储器装置10a以控制对存储器装置10a进行的编程(或写入)操作、读取操作和擦除操作。此外，可以在存储器控制器20a与存储器装置10a之间发送或接收用于编程操作的数据data和读取的数据data。
图2是示出根据发明构思的示例性实施例的存储器系统100b的框图。
如图2所示，存储器系统100b可以包括存储器装置10b和存储器控制器20b。存储器装置10b可以包括存储器单元阵列11，存储器控制器20b可以包括后编程管理器21。
以上已经参照图1描述了存储器装置10b的存储器单元阵列11，因此不提供它的重复说明。
在图1的实施例中，后编程管理器12-1a设置在存储器装置10a中，但是在图2的实施例中，后编程管理器21设置在存储器控制器20b中。
存储器控制器20b可以对存储器装置10b执行控制操作。例如，存储器控制器20b可以产生用于控制存储器装置10b的地址addr、命令cmd和控制信号ctrl。此外，存储器控制器20b可以将地址addr、命令cmd和控制信号ctrl提供到存储器装置10b以控制对存储器装置10b进行的编程(或写入)操作、读取操作和擦除操作。此外，可以在存储器控制器20b与存储器装置10b之间发送或接收用于编程操作的数据data和读取的数据data。
后编程管理器21可以包括用于执行图23或图24中示出的存储器装置10b的边缘字线管理方法的硬件或软件。
后编程管理器21可以终止对存储器装置10b的擦除操作，然后可以向存储器装置10b发送用于执行在与已执行擦除操作的存储器块的主存储器单元相邻的虚设存储器单元中写入随机虚设样式的数据的后编程操作的编程命令、地址和随机虚设样式的数据。
例如，后编程管理器21可以执行擦除操作，并且选择连接到与包括在已执行擦除操作的存储器块中的单元串的主存储器单元相邻的虚设存储器单元的虚设字线。后编程管理器21可以向存储器装置10b发送用于在与被选择的虚设字线连接的虚设存储器单元中编程随机虚设样式的数据的编程命令、地址和数据。
例如，后编程管理器21可以选择与设置在单元串的地选择晶体管与主存储器单元之间的虚设存储器单元相连接的虚设字线。后编程管理器21可以向存储器装置10b发送用于在与被选择的虚设字线连接的虚设存储器单元中编程随机虚设样式的数据的编程命令、地址和数据。
例如，如果在单元串的地选择晶体管与主存储器单元之间设置有多个虚设存储器单元，则后编程管理器21可以选择与最邻近于主存储器单元的虚设存储器单元相连接的虚设字线。后编程管理器21可以向存储器装置10b发送用于在与被选择的虚设字线连接的虚设存储器单元中编程随机虚设样式的数据的编程命令、地址和数据。
后编程管理器21可以随机确定用于后编程的虚设样式的数据并且可以将随机确定的虚设样式的数据发送到存储器装置10b。例如，后编程管理器21可以将在擦除操作之前通过将要被擦除的存储器块的初始设定字线而读取的数据确定为虚设样式的数据。作为另一示例，后编程管理器21可以将在擦除操作之前通过随机确定的存储器块的初始设定字线而读取的数据确定为虚设样式的数据。作为另一示例，后编程管理器21可以将在擦除操作之前通过随机确定的存储器块的初始设定字线而读取的数据中的一些数据进行反转获得的数据确定为虚设样式的数据。作为另一示例，后编程管理器21可以通过使用在擦除操作的验证处理操作中产生的信息，将从两个或更多个候选数据样式中选择的一个数据样式确定为虚设样式的数据。作为另一示例，后编程管理器21可以设定至少两个候选数据样式，并且可以基于在存储器装置10b中使用的一个或更多个时钟信号的某一时刻处检测到的相位，将从至少两个候选数据样式中选择的一个数据样式确定为虚设样式的数据。
当启用后编程模式时，后编程管理器21可以执行后编程操作。当禁用后编程模式时，后编程管理器21可以控制存储器装置10b的后编程操作使得后编程操作不执行。例如，如果用于每个存储器块的编程/擦除循环计数大于初始设定的阈值，则后编程管理器21可以将对应的存储器块设定为后编程模式使能状态。
图3是示意性地示出了根据发明构思的示例性实施例的存储器系统100c的框图。
如图3所示，存储器系统100c可以包括存储器装置10c和存储器控制器20c。存储器装置10c可以包括存储器单元阵列11和预编程管理器12-1c。
上面已经参照图1描述了存储器装置10c的存储器单元阵列11，因此不提供它的重复说明。此外，存储器控制器20c可以执行与图1的存储器控制器20a基本相同的操作，因此，不提供它的重复说明。
预编程管理器12-1c可以包括用于执行图25或图26中示出的存储器装置10c的边缘字线管理方法的硬件或软件。
当从存储器控制器20c接收到用于对存储器装置10c的空闲存储器块执行第一编程操作的编程命令时，预编程管理器12-1c可以控制存储器装置10c以执行在与所述空闲存储器块中包括的单元串的主存储器单元相邻的虚设存储器单元中写入随机虚设样式的数据的预编程操作，然后再运行所述编程命令。这里，空闲存储器块表示在执行了擦除操作之后还没有被写入的空的存储器块。
换言之，预编程管理器12-1c可以在针对空闲存储器块执行第一编程操作之前，执行在与所述空闲存储器块中包括的单元串的主存储器单元相邻的虚设存储器单元中写入随机虚设样式的数据的预编程操作。
例如，通过预编程操作写入虚设样式的数据的虚设存储器单元可以设置在地选择晶体管与主存储器单元之间。例如，如果包括在存储器块中的单元串的地选择晶体管与主存储器单元之间设置有多个虚设存储器单元，则预编程管理器12-1c可以在与主存储器单元最相邻的虚设存储器单元中执行写入虚设样式的数据的操作。
预编程管理器12-1c可以随机地确定用于预编程的虚设样式的数据。例如，预编程管理器12-1c可以设定至少两个候选数据样式，并且可以基于在存储器装置10c中使用的一个或更多个时钟信号的某一时刻处检测到的相位，将从至少两个候选数据样式中选择的一个数据样式确定为虚设样式的数据。
如上所述，存储器装置10c的预编程管理器12-1c可以产生虚设样式的数据，因此，可以不从存储器控制器20c提供用于预编程操作的虚设样式的数据。
当启用预编程模式时，预编程管理器12-1c可以执行预编程操作。当禁用预编程模式时，预编程管理器12-1c可以控制存储器装置10c的预编程操作从而不执行预编程操作。例如，如果每个存储器块的编程/擦除循环计数大于初始设定的阈值，则预编程管理器12-1c可以将对应的存储器块设定为预编程模式使能状态。
图4是示出根据发明构思的示例性实施例的存储器系统100d的框图。
如图4所示，存储器系统100d可以包括存储器装置10d和存储器控制器20d。存储器装置10d可以包括存储器单元阵列11，存储器控制器20d可以包括预编程管理器22。
上面已经参照图1描述了存储器装置10d的存储器单元阵列11，因此不提供它的重复说明。
在图3的实施例中，预编程管理器12-1c设置在存储器装置10c中，但是在图4的实施例中，预编程管理器22设置在存储器控制器20d中。
存储器控制器20d可以对存储器装置10d执行控制操作。例如，存储器控制器20d可以产生用于控制存储器装置10d的地址addr、命令cmd和控制信号ctrl。此外，存储器控制器20d可以将地址addr、命令cmd和控制信号ctrl提供到存储器装置10d以控制对存储器装置10d进行的编程(或写入)操作、读取操作和擦除操作。此外，可以在存储器控制器20d与存储器装置10d之间发送或接收用于编程操作的数据data和读取的数据data。
预编程管理器22可以包括用于执行图25或图26中示出的存储器装置10d的边缘字线管理方法的硬件或软件。
预编程管理器22可以在针对空闲存储器块执行第一预编程操作之前，向存储器装置10d发送用于执行在与所述空闲存储器块中包括的单元串的主存储器单元相邻的虚设存储器单元中写入随机虚设样式的数据的预编程操作的编程命令、地址和随机虚设样式的数据。
例如，预编程管理器22可以选择连接到设置在单元串的地选择晶体管与主存储器单元之间的虚设存储器单元的虚设字线。预编程管理器22可以向存储器装置10d发送用于在连接到所选择的虚设字线的虚设存储器单元中编程随机虚设样式的数据的编程命令、地址和数据。
例如，如果在单元串的地选择晶体管与主存储器单元之间设置有多个虚设存储器单元，则预编程管理器22可以选择与最邻近于主存储器单元的虚设存储器单元相连接的虚设字线。预编程管理器22可以向存储器装置10d发送用于在连接到所选择的虚设字线的虚设存储器单元中编程随机虚设样式的数据的编程命令、地址和数据。
预编程管理器22可以随机确定用于预编程的虚设样式的数据。例如，预编程管理器22可以设定至少两个候选数据样式，并且可以基于在存储器装置10d中使用的一个或更多个时钟信号的某一时刻处检测到的相位，将从至少两个候选数据样式中选择的一个数据样式确定为虚设样式的数据。
当启用预编程模式时，预编程管理器22可以执行预编程操作。当禁用预编程模式时，预编程管理器22可以控制存储器装置10d的预编程操作，从而不执行预编程操作。例如，如果每个存储器块的编程/擦除循环计数大于初始设定的阈值，则预编程管理器22可以将对应的存储器块设定为预编程模式使能状态。
图5是示出根据发明构思的示例性实施例的包括在图1的存储器系统100a中的存储器装置10a的框图。
参照图5，存储器装置10a可以包括存储器单元阵列11、控制逻辑12a、电压发生器13、行解码器14和页缓冲器15。存储器装置10a可以可选地使用只读存储器(rom)16a。例如，将被用作虚设样式的多段候选数据可以在制造过程中存储在rom16a中。作为另一示例，可以使用从存储器单元阵列11读取并存储在页缓冲器15中的数据而不使用rom16a来确定虚设样式的数据。作为另一示例，可以通过使用位线和页缓冲器15的连接结构将在偶数/奇数位线中被生成为不同逻辑值的数据样式确定为虚设样式的数据。在下文中，将详细描述包括在存储器装置10a中的元件。
存储器单元阵列11可以连接到一条或更多条串选择线ssl、多条字线wl和一条或更多条地选择线gsl，并且还可以连接到多条位线bl。存储器单元阵列11可以包括分别设置在多条字线wl与多条位线bl相交的多个区域中的多个存储器单元。多条字线wl可以包括多条主字线mwl和一条或更多条虚设字线dwl。一条或更多条虚设字线dwl可以增强主字线mwl的数据可靠性。
当向存储器单元阵列11施加擦除电压时，多个存储器单元mc可以处于擦除状态。当向存储器单元阵列11施加编程电压时，多个存储器单元mc可以处于编程状态。在这种情况下，每个存储器单元mc可以具有基于阈值电压划分的第一编程状态p1至第n编程状态pn和擦除状态中的一个状态。
这里，n可以是等于或大于2的自然数。例如，如果每个存储器单元mc是两位级单元，则n可以是3。作为另一示例，如果每个存储器单元mc是三位级单元，则n可以是7。作为另一示例，如果每个存储器单元mc是四位级单元，则n可以是15。如上所述，多个存储器单元mc可以包括多级单元。然而，发明构思不限于此。在发明构思的示例性实施例中，多个存储器单元mc可以包括单级单元。
控制逻辑12a可以基于从存储器控制器20a接收的命令cmd、地址addr和控制信号ctrl而输出用于在存储器单元阵列11中写入数据、从存储器单元阵列11读取数据或者擦除存储器单元阵列11的各种控制信号。因此，控制逻辑12a可以控制存储器装置10a的各种操作。
控制逻辑12a可以包括后编程管理器12-1a。后编程管理器12-1a可以基于擦除命令终止擦除操作，然后可以输出用于执行在与已执行擦除操作的存储器块的主存储器单元相邻的虚设存储器单元中写入虚设样式的数据的后编程操作的各种控制信号。
从控制逻辑12a输出的各种控制信号可以被提供至电压发生器13、行解码器14和页缓冲器15。例如，控制逻辑12a可以将电压控制信号ctrl_vol提供至电压发生器13，将行地址x_addr提供至行解码器14并且将列地址y_addr提供至页缓冲器15。
电压发生器13可以基于电压控制信号ctrl_vol产生用于对存储器单元阵列11执行编程操作、读取操作和擦除操作的各种电压。例如，电压发生器13可以产生用于驱动多条字线wl的第一驱动电压vwl、用于驱动多条串选择线ssl的第二驱动电压vssl以及用于驱动多条地选择线gsl的第三驱动电压vgsl。
在这种情况下，第一驱动电压vwl可以是编程电压(或写入电压)、读取电压、擦除电压、通过电压或编程验证电压。此外，第二驱动电压vssl可以是串选择电压，例如，导通电压或截止电压。此外，第三驱动电压vgsl可以是地选择电压，例如，导通电压或截止电压。
行解码器14可以通过多条字线wl连接到存储器单元阵列11并且可以响应于从控制逻辑12a接收的行地址x_addr而激活多条字线wl中的一些字线wl。例如，在读取操作中，行解码器14可以将读取电压施加到所选择的字线并且可以将通过电压施加到未选择的字线。
在编程操作中，行解码器14可以将编程电压施加到所选择的字线，并且可以将通过电压施加到未选择的字线。
此外，在擦除操作中，行解码器14可将擦除电压(例如，0v)施加到字线wl并且可以使串选择线ssl和地选择线gsl浮置。
页缓冲器15可以通过多条位线bl连接到存储器单元阵列11。例如，在读取操作中，页缓冲器15可以用作读出放大器来输出存储在存储器单元阵列11中的数据data。此外，在编程操作中，页缓冲器15可以作为写入驱动器来操作以把将要被存储在存储器单元阵列11中的数据data输入至存储器单元阵列11。
图6是示出根据发明构思的示例性实施例的包括在图2或图4的存储器系统100b或100d中的存储器装置10b或10d的框图。
参照图6，存储器装置10b或10d可以包括存储器单元阵列11、控制逻辑12、电压发生器13、行解码器14和页缓冲器15。已经在上面参照图6描述了存储器单元阵列11、电压发生器13、行解码器14和页缓冲器15，因此不提供它们的重复说明。
此外，控制逻辑12可以具有省略了图5中示出的控制逻辑12a的后编程管理器12-1a的配置。控制逻辑12可以基于从存储器控制器20b(或20d)接收的命令cmd、地址addr和控制信号ctrl而输出用于在存储器单元阵列11中写入数据、从存储器单元阵列11读取数据或者擦除存储器单元阵列11的各种控制信号。因此，控制逻辑12可以控制存储器装置10b或10d的各种操作。
图7是示出根据发明构思的示例性实施例的包括在图3的存储器系统100c中的存储器装置10c的框图。
参照图7，存储器装置10c可以包括存储器单元阵列11、控制逻辑12c、电压发生器13、行解码器14和页缓冲器15。存储器装置10c可以可选地使用rom16c。例如，将被用作虚设样式的多段候选数据可以在制造过程中存储在rom16c中。作为另一示例，可以使用从存储器单元阵列11读取并存储在页缓冲器15中的数据而不使用rom16c来确定虚设样式的数据。作为另一示例，可以通过使用位线和页缓冲器15的连接结构将在偶数位线/奇数位线中被生成为不同逻辑值的数据样式确定为虚设样式的数据。已经在上面参考图5描述了存储器单元阵列11、电压发生器13、行解码器14和页缓冲器15，因此不提供它们的重复描述。
控制逻辑12c可以基于从存储器控制器20c接收的命令cmd、地址addr和控制信号ctrl而输出用于在存储器单元阵列11中写入数据、从存储器单元阵列11读取数据或者擦除存储器单元阵列11的各种控制信号。因此，控制逻辑12c可以控制存储器装置10c的各种操作。
控制逻辑12c可以包括预编程管理器12-1c。预编程管理器12-1c可以基于擦除命令终止擦除操作，然后可以输出用于执行在与已执行擦除操作的存储器块的主存储器单元相邻的虚设存储器单元中写入随机虚设样式的数据的后编程操作的各种控制信号。
图8示出了根据发明构思的示例性实施例的在图5至图7中示出的存储器单元阵列11。
参照图8，存储器单元阵列11可以是闪存单元阵列。在这种情况下，存储器单元阵列11可以包括a个(其中a是等于或大于2的整数)存储器块blk1至blka。存储器块blk1至blka中的每个可以包括b个(其中b是等于或大于2的整数)页page1至pageb。页page1至pageb中的每个可以包括c个(其中c是等于或大于2的整数)扇区sec1至secc。在图8中，为了便于说明，仅将存储器块blk1示出为包括页page1至pageb和扇区sec1至secc。然而，其他存储器块blk2至blka可以各自具有与存储器块blk1的结构相同的结构。
图9是示出根据发明构思的示例性实施例的包括在图8中示出的存储器单元阵列中的存储器块blk1的电路图。
参照图9，第一存储器块blk1可以是具有垂直结构的nand闪速存储器，并且图8中示出的存储器块blk1至blka中的每个可以如图9中所示来实施。例如，第一存储器块blk1可以包括八个存储器单元彼此串联的d个(其中d是等于或大于2的整数)单元串str。每个单元串str可以包括分别连接到彼此串联连接的存储器单元的两端的串选择晶体管sst和地选择晶体管gst。这里，可以把一个单元串中包括的八个存储器单元当中的与地选择晶体管gst相邻的一个或更多个的存储器单元均设定为虚设存储器单元。地选择晶体管gst可以连接到地选择线gsl，串选择晶体管sst可以连接到串选择线ssl。
在图9的实施例中，与地选择晶体管gst相邻的两个存储器单元均可以被设定为虚设存储器单元。因此，一个单元串中包括的八个存储器单元中的六个可以被设定为主存储器单元mmc。作为另一示例，可以在串选择晶体管sst与主存储器单元mmc之间添加一个或更多个虚设存储器单元dmc。
此外，虚设字线dwl可以连接到虚设存储器单元dmc，主字线mwl可以连接到主存储器单元mmc。如上所述，虚设存储器单元dmc1和dmc2可以设置在地选择晶体管gst与多个主存储器单元mmc1至mmc6之间以减小公共源极线csl对主存储器单元mmc的耦合影响。换言之，可以在主存储器单元mmc的边缘中设置一个或更多个虚设存储器单元dmc。
这里，可以根据发明构思的示例性实施例来不同地改变单元串str的数量、虚设字线dwl(例如dwl1和dwl2)的数量、主字线mwl(例如wl1至wl6)的数量以及位线bl(例如bl1至bld)的数量。
具有如图9所示的结构的nand闪速存储器可以以一个存储器块为单位来擦除并可以由与每条字线对应的页为单位来编程。例如，如果存储器单元是单级单元，则一个页可以对应于每条字线。作为另一示例，如果存储器单元是多级单元或三级单元，则多个页可以对应于每条字线。
图10是示出根据发明构思的示例性实施例的包括在图8中示出的存储器单元阵列中的存储器块的电路图。
图10是示出包括在图8中示出的存储器单元阵列中的存储器块的另一示例blk1'的电路图。
参照图10，第一存储器块blk1'可以是具有垂直结构的nand闪速存储器，并且图8中示出的存储器块blk1至blka中的每个可以如图10所示来实施。例如，第一存储器块blk1'可以包括多个单元串str11至str33、多条字线dwl1、dwl2和wl1至wl6、多条位线bl1至bl3、地选择线gsl、多条串选择线ssl1至ssl3以及公共源极线csl。这里，可以根据发明构思的示例性实施例来不同地改变单元串的数量、字线的数量、位线的数量、地选择线的数量和串选择线的数量。
单元串str11至str33可以连接在位线bl1至bl3与公共源极线csl之间。每个单元串(例如，str11)可以包括彼此串联连接的串选择晶体管sst、多个存储器单元dmc(例如，dmc1和dmc2)和mmc(例如，mmc1至mmc6)以及地选择晶体管gst。
在图10的实施例中，每个单元串中与地选择晶体管gst相邻的两个存储器单元可以均被设定为虚设存储器单元dmc。因此，包括在一个单元串中的八个存储器单元中的六个可以均被设定为主存储器单元mmc。作为另一示例，可以在串选择晶体管sst与主存储器单元mmc之间添加一个或更多个虚设存储器单元dmc。
串选择晶体管sst可以连接到串选择线ssl1至ssl3。多个存储器单元mmc和dmc可以分别连接到与其对应的多条字线wl和dwl。地选择晶体管gst可以连接到地选择线gsl。串选择晶体管sst可以连接到与其相对应的位线，地选择晶体管gst可以连接到公共源极线csl。
相同高度的字线(例如，wl1)可以共同连接，串选择线ssl1至ssl3可以彼此间隔开。当对连接到字线wl1并包括在多个单元串ns11至ns13中的多个存储器单元编程时，可以选择字线wl1和串选择线ssl1。
图11是示出包括在图9或图10中示出的存储器块中的存储器单元的剖视图。这里，存储器单元可以是虚设存储器单元dmc或主存储器单元mmc。
参照图11，存储器单元可以包括沟道区域1、电荷存储层2以及控制栅极(cg)3。例如，可以利用作为导体的浮置栅极来实施电荷存储层2，具有这种结构的存储器单元可以被称为浮置栅极结构单元。作为另一示例，可以利用非导体(例如，sin)来实施电荷存储层2，具有这种结构的存储器单元可以被称为电荷捕获闪存(ctf)单元。
为了对存储器单元执行编程操作，可以向控制栅极3施加相对高的编程电压，并且可以向沟道区域1施加相对低的电压(例如，0v)。基于这样的偏置条件，可以在从控制栅极3到沟道区域1的方向上产生电场。因此，电荷(例如，电子)可以沿箭头p方向(从沟道区域1的方向到电荷存储层2)移动，因此存储器单元可以被编程。
此外，为了对存储器单元执行擦除操作，可以向控制栅极3施加相对低的电压(例如，0v)，并且可以向沟道区域1施加相对高的编程电压。基于这样的偏置条件，可以在从沟道区域1到控制栅极3的方向上产生电场。因此，电荷(例如，电子)可以沿箭头e方向(从电荷存储层2到沟道区域1的方向)移动，因此存储器单元可以被擦除。
图12示出了根据发明构思的示例性实施例的在图1或图3中示出的存储器控制器20a或20c的块配置。
如图12所示，存储器控制器20a或20c可以包括处理器210a、随机存取存储器(ram)220a、主机接口230，存储器接口240和总线250。
存储器控制器20的元件可以通过总线250彼此电连接。
处理器210a可以通过使用存储在ram220a中的编程代码和数据来控制存储器系统100a或100c的操作。例如，处理器210a可以用微处理器或中央处理单元(cpu)来实施。在初始化存储器系统100a或100c时，处理器210a可以从存储器装置10a或10c读取用于控制由存储器系统100a或100c执行的操作的编程代码和数据，并且可以将所述编程代码和数据加载到ram220a中。
处理器210a可以在读取操作中向存储器装置10a或10c提供读取命令和地址，在编程操作中向存储器装置10a或10c提供编程命令、地址和数据并且在擦除操作中向存储器装置10a或10c提供擦除命令和地址。此外，处理器210a可以通过使用存储在ram220a中的系统数据将从主机接收的逻辑地址转换为物理地址。
主机接口230可以包括用于与连接到存储器系统100a或100c的主机交换数据的数据交换协议并且可以将存储器系统100a或100c连接到主机。可以用高级技术附件(ata)接口、串行ata(sata)接口、并行ata(pata)接口、通用串行总线(usb)、串行连接的小型计算机系统(sas)接口、小型计算机系统接口(scsi)、嵌入式多媒体卡(emmc)接口或者通用闪速存储(ufs)接口来实施主机接口230。然而，本实施例不限于此。主机接口230可以从主机接收命令、地址和数据，或者可以根据处理器210a的控制将数据发送到主机。
存储器接口240可以电连接到存储器装置10a或10c。存储器接口240可以向存储器装置10a或10c发送命令、地址和数据，或者可以根据处理器210a的控制从存储器装置10a或10c接收数据。存储器接口240可以被配置为支持nand闪速存储器或nor闪速存储器。存储器接口240可以被配置为通过多个通道执行软件或硬件交错操作。
图13示出了根据发明构思的示例性实施例的在图2中示出的存储器控制器20b的块配置。
如图13所示，存储器控制器20b可包括处理器210b、ram220b、主机接口230、存储器接口240和总线250。
用于控制由存储器系统100b执行的操作的编程代码和数据可以存储在ram220b中。例如，在初始化存储器系统100b时，处理器210b可以从存储器装置10b读取用于控制由存储器系统100b执行的操作的编程代码和数据，并且可以将编程代码和数据加载到ram220b中。特别地，ram220b可以存储用于执行后编程管理操作的编程代码(pc1)220-1。
处理器210b可以通过使用存储在ram220b中的编程代码和数据来控制存储器系统100b的操作。例如，处理器210b可以通过使用存储在ram220b中的编程代码(pc1)220-1来执行图2的后编程管理器21的操作。例如，处理器210b可以通过使用存储在ram220b中的编程代码(pc1)220-1来执行图23或图24中示出的存储器装置的边缘字线管理方法。
已经在上面参照图12描述了主机接口230、存储器接口240以及总线250，因此不提供它们的重复描述。
图14示出了根据发明构思的示例性实施例的在图4中示出的存储器控制器20d的块配置。
如图14所示，存储器控制器20d可包括处理器210d、ram220d、主机接口230、存储器接口240和总线250。
用于控制由存储器系统100d执行的操作的编程代码和数据可以存储在ram220d中。例如，在初始化存储器系统100d时，处理器210d可以从存储器装置10d读取用于控制由存储器系统100d执行的操作的编程代码和数据，并且可以将编程代码和数据加载到ram220d中。特别地，ram220d可以存储用于执行预编程管理操作的编程代码(pc2)220-2。
处理器210d可以通过使用存储在ram220d中的编程代码和数据来控制存储器系统100d的操作。例如，处理器210d可以通过使用存储在ram220d中的编程代码(pc2)220-2来执行图4的预编程管理器22的操作。例如，处理器210d可以通过使用存储在ram220d中的编程代码(pc2)220-2来执行图25或图26中示出的存储器装置的边缘字线管理方法。
已经在上面参照图12描述了主机接口230、存储器接口240以及总线250，因此不提供它们的重复描述。
图15示出了根据发明构思的示例性实施例的在禁用后编程模式或预编程模式的情况下，包括在图9或图10示出的存储器块中的一个单元串中的初始编程状态。
参照图15，单元串可以具有多个存储器单元彼此串联连接的串结构。例如，两个虚设存储器单元dmc1和dmc2可以设置在地选择晶体管gst与主存储器单元mmc1之间，从而减小公共源极线csl对主存储器单元mmc的影响。此外，可以按照从最靠近地选择线gsl的存储器单元到距离地选择线gsl更远的存储器单元的次序对多个存储器单元编程。在图15中，虚设存储器单元dmc1和dmc2可以分别连接到虚设字线dwl1和dwl2。
因此，可以在禁用后编程模式或预编程模式的情况下执行擦除操作，然后可以对最靠近于地选择线gsl的主存储器单元mmc1执行初始编程操作。换言之，可以对在擦除操作之后首先连接到字线wl1的主存储器单元mmc1进行编程(p_1pgm)。
根据发明构思的示例性实施例，图16中示出了在禁用后编程模式或预编程模式的情况下，基于字线的存储器单元在编程运行基础上的阈值电压变化。
参照图16，可以看出，与连接到主字线wl2至wln(其中n是等于或大于3的整数)的存储器单元的编程状态p1的阈值电压变化相比，连接到主字线wl1的存储器单元的编程状态p1的阈值电压变化朝向擦除状态e0的阈值电压偏移。由于主字线wl1在相邻的页全部被擦除的状态下编程，所以大多数被捕获的电荷会被用于在擦除操作之后首先对主字线wl1的页进行编程。依此原因，如图16所示，连接到主字线wl1的存储器单元的可靠性在单元串中是最低的。
图17a至图17c示出了根据发明构思的示例性实施例的在启用后编程模式或预编程模式的情况下，针对包括在图9或图10示出的存储器块中的一个单元串进行擦除操作之后的编程处理。
图17a示出了已执行擦除操作的存储器块中包括的单元串中包含的虚设存储器单元dmc和主存储器单元mmc中的每一个的状态。换言之，执行擦除操作之后的主字线wl1至wln的主存储器单元mmc1至mmcn以及连接到虚设字线dwl1和dwl2的虚设存储器单元dmc1和dmc2都可以具有擦除状态e0的阈值电压。
图17b示出了当在擦除操作之后执行后编程模式或预编程模式时，在与单元串的主存储器单元相邻的虚设存储器单元dmc2中编程虚设样式的数据的状态。换言之，在执行了擦除操作之后，对主字线wl1至wln执行编程操作之前，可以在连接到与主字线wl1相邻的虚设字线dwl2的虚设存储器单元dmc2中编程虚设样式的数据(p_1')。
图17c示出了在执行后编程模式或预编程模式之后，将单元串的第一主存储器单元mmc1编程到状态p_1pgm。换言之，图17c示出了下列状态：在执行擦除操作之后，通过后编程操作或预编程操作对连接到与主字线wl1相邻的虚设字线dwl2的虚设存储器单元dmc2编程，并且随后对连接到主字线wl1的主存储器单元mmc1编程。
根据发明构思的示例性实施例，在图18中示出了在启用后编程模式或预编程模式的情况下，存储器块中的基于字线的存储器单元在编程运行基础上的阈值电压变化。
参照图18，可以看出，与连接到主字线wl1～wln(其中n为等于或大于3的整数)的存储器单元的编程状态p1的阈值电压变化相比，连接到已通过后编程操作或预编程操作而编程的虚设字线dwl2的存储器单元的编程状态p1的阈值电压变化朝向擦除状态e0的阈值电压偏移。由于虚设字线dwl2在相邻的页全部被擦除的状态下编程，所以大多数被捕获的电荷会被用于在擦除操作之后首先对虚设字线dwl2的页进行编程。依此原因，如图18所示，连接到虚设字线dwl2的存储器单元的可靠性在单元串中最低，但是连接到第一主字线wl1的存储器单元的可靠性增强。
换言之，通过在擦除操作之后经由后编程操作或预编程操作对连接到虚设字线dwl2的存储器单元执行编程操作来增强连接到主字线wl1至wln的存储器单元的可靠性。
作为参考，可以使将要被编程的输入数据随机化，然后可以将该输入数据编程到与主字线连接的存储器单元中。例如，如果在虚设字线dwl2中编程的虚设样式的数据在所有位中全部为0，则在主存储器单元正在被编程n次的期间内经过2n次编程操作而连接到虚设字线dwl2的每个虚设存储器单元可能变成最差存储器单元。因此，可以随机确定将要在虚设字线中编程的虚设样式的数据。
图19是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作或预编程操作的虚设样式的数据的方法的图。
参照图19，可以基于通过使用两个时钟信号而检测到的相位来将两个候选数据样式中的一个数据样式确定为虚设样式的数据。例如，可以将两个候选数据样式设定为第一候选数据样式“0101010101....01”和第二候选数据样式“10101010....10”。可以将这两个候选数据样式设定为相互反转的数据。例如，候选数据样式可以存储在图5的rom16a中或图7的rom16c中。例如，两个时钟信号可以包括主时钟信号和泵时钟信号。这里，泵时钟信号表示用于升高电压电平的时钟信号。
例如，当在随机时刻或者某一时刻处的第一时钟信号的上升沿中检测到的第二时钟信号的相位为高时，可以将第一候选数据样式确定为虚设样式的数据。此外，当在随机时刻或者某一时刻处的第一时钟信号的上升沿中检测到的第二时钟信号的相位为低时，可以将第二候选数据样式确定为虚设样式的数据。
图20是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作的虚设样式的数据的方法的图。
参照图20，可以基于在擦除操作的验证过程中产生的信息将从两个或更多个候选数据样式中选择的一个数据样式确定为虚设样式的数据。例如，当在擦除验证过程中检测到的故障位(failbit)的数量小于作为参考值的数值m时，可以作为擦除通过来执行处理，在这种情况下，可以基于在擦除通过中检测到的故障位的数量来确定虚设样式的数据。作为详细示例，在设定两个候选数据样式的状态下，当在擦除通过中检测到的故障位数为奇数时，可以将第一候选数据样式确定为虚设样式的数据，当故障位数是偶数时，可以将第二候选数据样式确定为虚设样式的数据。
图21是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作或预编程操作的虚设样式的数据的方法的图。
参照图21，可以通过使用位线与页缓冲器15的连接结构而不使用存储将要用作虚设样式的数据的多个候选数据样式的rom(例如，图5的16a或图7的16c)来随机产生偶数/奇数样式。例如，如图19所示，当通过使用两个时钟信号检测到的相位为高时，可以控制页缓冲器15通过使用controlodd信号将奇数位线blo设定为0并通过使用controleven信号将偶数位线ble设定为1(如图21所示)。以这种方式，当通过使用两个时钟信号检测到的相位为低时，可以控制页缓冲器15通过使用controlodd信号将奇数位线设定为1并通过使用controleven信号将偶数位线设置为0。作为另一示例，可以基于在擦除操作的验证过程中产生的信息来随机确定奇数位线的值和偶数位线的值。例如，当在擦除通过中检测到的故障位的数量是奇数时，可以控制页缓冲器15将奇数位线设定为1并将偶数位线设定为0。以这种方式，当在擦除通过中检测到的故障位的数量是偶数时，可以控制页缓冲器15将奇数位线blo设定为0并将偶数位线ble设定为1(如图21所示)。
图22a至图22c是根据发明构思的示例性实施例的用于描述随机确定用于后编程操作的虚设样式的数据的方法的图。
参照图22a，在擦除操作之前，可以读取任意字线wlx的数据并且可以将其备份到页缓冲器15或存储器控制器的ram(例如，图13的220b或图14的220d)。在备份操作之后，如图22b所示，可以对与包括将要被擦除的存储器块的虚设字线在内的所有字线相连接的存储器单元进行擦除。
随后，可以如图22c所示利用备份的数据样式对虚设字线dwl2进行编程。因此，在擦除操作之前存储在任意字线wlx中的数据data’可以被编程到虚设字线dwl2中。
作为另一示例，为了增加虚设数据的随机性，可以在擦除操作之前读取和备份任意字线wlx的数据，然后可以将通过使被备份的数据样式中的一些进行反转而获得的数据用作虚设数据样式。
在下文中，将参照图23至图26的流程图描述由图1或图2所示的后编程管理器12-1a或21或者由图3或图4所示的预编程管理器12-1c或22执行的存储器装置的边缘字线管理操作。
首先，将参照图23和图24的流程图描述由图1或图2所示的后编程管理器12-1a或21执行的存储器装置的边缘字线管理操作。为了便于说明，下面的描述将侧重于图1。
图23示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图。
在操作s110中，后编程管理器12-1a可以确定存储器装置10a是否接收到擦除命令。
当接收到擦除命令时，在操作s120中，存储器装置10a可以对由与擦除命令一起接收的地址所指示的存储器块执行擦除操作。
随后，在操作s130中，后编程管理器12-1a可以确定虚设样式的数据。这里，可以随机确定虚设样式的数据。例如，后编程管理器12-1a可以基于在存储器装置10a中使用的一个或更多个时钟的某一时刻处检测到的相位，把从候选数据样式中选择的一个数据样式确定为虚设样式的数据。作为另一示例，可以将在擦除操作之前从存储器块的初始设定字线读取的数据确定为虚设样式的数据。作为另一示例，可以将通过在擦除操作之前从存储器块的初始设定字线读取的数据中的一些数据反转得到的数据确定为虚设样式的数据。作为另一示例，可以基于在擦除操作的验证过程中产生的信息，将从两个或更多个候选数据样式中选择的一个数据样式确定为虚设样式的数据。
随后，在操作s140中，后编程管理器12-1a可以执行在与已执行擦除操作的存储器块的主存储器单元相邻的虚设存储器单元中写入在操作s130中确定的虚设样式的数据的后编程操作。例如，后编程管理器12-1a可以执行如下编程操作：将在操作s130中确定的虚设样式的数据，编程到被设置在图9或图10的存储器块中的地选择线gsl与主字线mwl之间的虚设字线dwl之中的，最邻近于主存储器单元的虚设字线dwl2所连接的虚设存储器单元中。
图24示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图。
在操作s210中，后编程管理器12-1a可以确定存储器装置10a是否接收到擦除命令。
当接收到擦除命令时，在操作s220中，存储器装置10a可以对由与擦除命令一起接收的地址所指示的存储器块执行擦除操作。
随后，在操作s230中，后编程管理器12-1a可以确定是否启用后编程模式。例如，当每个存储器块的编程/擦除循环计数大于初始设定的阈值时，后编程管理器12-1a可以将对应的存储器块设定为后编程模式使能状态。作为另一示例，可以在测试过程或用户环境中将后编程模式设定为使能状态。
当在操作s230中确定启用后编程模式时，后编程管理器12-1a可以在操作s240中确定虚设样式的数据。可以以上面图23的操作s140中描述的各种方法随机确定虚设样式的数据。
随后，在操作s250中，后编程管理器12-1a可以执行在与已执行擦除操作的存储器块的主存储器单元相邻的虚设存储器单元中写入在操作s240中确定的虚设样式的数据的后编程操作。例如，后编程管理器12-1a可以执行如下编程操作：将在操作s240中确定的虚设样式的数据，编程到被设置在图9或图10的存储器块中的地选择线gsl与主字线mwl之间的虚设字线dwl之中的，最邻近于主存储器单元的虚设字线dwl2所连接的虚设存储器单元中。
接下来，将参照图25和图26的流程图描述由图3或图4所示的预编程管理器12-1c或22执行的存储器装置的边缘字线管理操作。为了便于说明，下面的描述将侧重于图3。
图25示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图。
在操作s310中，预编程管理器12-1c可以确定存储器装置10c是否接收到编程命令。
当在操作s310中确定接收到编程命令时，预编程管理器12-1c可以在操作s320中确定所接收的编程命令是否是空闲存储器块的第一编程命令。这里，空闲存储器块表示在执行了擦除操作之后还没有写入数据的空的存储器块。例如，当接收到与图9或图10的存储器块中的字线wl1对应的地址的编程命令时，可以将所接收的编程命令确定为空闲存储器块的第一编程命令。这是因为编程是按照从闪速存储器的单元串中最靠近公共源极线csl的字线到距离公共源极线csl更远的字线的次序来执行的。换言之，可以在除了虚设字线之外的字线之中最靠近公共源极线csl的主字线wl1中执行空闲存储器块的第一编程。
当在操作s320中确定接收到的编程命令是空闲存储器块的第一编程命令时，预编程管理器12-1c可以在操作s330中随机确定虚设样式的数据。这里，可以随机确定虚设样式的数据。例如，预编程管理器12-1c可以设定至少两个候选数据样式，并且可以基于在一个或更多个时钟信号的某一时刻检测到的相位，将从至少两个候选数据样式中选择的一个数据样式确定为虚设样式的数据。
随后，在操作s340中，预编程管理器12-1c可以执行在与空闲存储器块的主存储器单元相邻的虚设存储器单元中写入在操作s330中确定的虚设样式的数据的预编程操作。对于这种情况，假设将要运行在操作s310中接收的编程命令的空闲存储器块如图9或图10中所示。因此，例如，预编程管理器12-1c可以执行如下编程操作：将虚设样式的数据编程到被设置在地选择线gsl与主字线mwl之间的虚设字线dwl之中的最邻近于主存储器单元的虚设字线dwl2所连接的虚设存储器单元中。
当在操作s320中确定接收到的编程命令是空闲存储器块的第一编程命令时，在操作s340中执行预编程操作之后，存储器装置10c可以在操作s350中运行所接收的编程命令。例如，预编程管理器12-1c可以执行在图9或图10的存储器块中的虚设字线dwl2所连接的虚设存储器单元中预编程虚设样式的数据的操作，然后可以连同编程命令一起执行在连接到字线wl1的存储器单元中编程数据的操作。
图26示出了根据发明构思的示例性实施例的存储器装置的边缘字线管理方法的流程图。
在操作s410中，预编程管理器12-1c可以确定存储器装置10c是否接收到编程命令。
当在操作s410中确定接收到编程命令时，预编程管理器12-1c可以在操作s420中确定是否启用预编程模式。例如，当每个存储器块的编程/擦除循环计数大于初始设定的阈值时，预编程管理器12-1c可以将对应的存储器块设定为预编程模式使能状态。作为另一示例，可以在测试过程或用户环境中将预编程模式设定为使能状态。
当在操作s420中确定启用预编程模式时，预编程管理器12-1c可以在操作s430中确定在操作s410中接收到的编程命令是否是空闲存储器块的第一编程命令。
当在操作s430中确定接收到的编程命令是空闲存储器块的第一编程命令时，预编程管理器12-1c可以在操作s440中确定虚设样式的数据。例如，预编程管理器12-1c可以以上面的操作s330中描述的方法随机确定虚设样式的数据。
随后，在操作s450中，预编程管理器12-1c可以执行在与空闲存储器块的主存储器单元相邻的虚设存储器单元中写入在操作s440中确定的虚设样式的数据的预编程操作。例如，如果将要运行在操作s410中接收的编程命令的空闲存储器块如图9或图10中所示，则预编程管理器12-1c可以执行在连接到虚设字线dwl2的虚设存储器单元中编程虚设样式的数据的编程操作。
当按照操作s420的确定结果禁用预编程模式或者按照操作s430的确定结果所接收的编程命令不是空闲存储器块的第一编程命令时，或者在操作s450中执行了预编程操作之后，存储器装置10c可以在操作s460中执行所接收的编程命令。例如，预编程管理器12-1c可以执行在图9或图10的存储器块中的虚设字线dwl2所连接的虚设存储器单元中预编程虚设样式的数据的操作，然后可以连同编程命令一起执行在连接到字线wl1的存储器单元中编程数据的操作。
图27是示出被应用于存储器卡系统1000的根据发明构思的示例性实施例的存储器系统的框图。
参照图27，存储器卡系统1000可以包括主机1100和存储器卡1200。主机1100可以包括主机控制器1110和主机连接器1120。存储器卡1200可以包括卡连接器1210、存储器控制器1220和存储器装置1230。存储器控制器1220和存储器装置1230可以分别使用图1至图4中示出的存储器控制器20a至20d和存储器装置10a至10d。
主机1100可以在存储器卡1200中写入数据或者可以读取存储在存储器卡1200中的数据。主机控制器1110可以通过主机连接器1120向存储器卡1200发送命令cmd、由包括在主机1100中的时钟发生器产生的时钟信号clk以及数据data。
响应于通过卡连接器1210接收的命令，存储器控制器1220可以与包括在存储器控制器1220中的时钟发生器产生的时钟信号同步地将数据存储在存储器装置1230中。存储器装置1230可以存储从主机1100发送的数据。
存储器卡1200可以使用下列装置来实现，紧凑型闪存卡(cfc)、微驱动器、智能媒体卡(smc)、多媒体卡(mmc)、安全数字卡(sdc)、记忆棒和/或通用串行总线(usb)闪存驱动器等。
图28是示出包括根据发明构思的示例性实施例的存储器系统的计算系统2000的框图。
参照图28，计算系统2000可以包括存储器系统2100、处理器2200、ram2300、输入/输出(i/o)装置2400和电源2500。
存储器系统2100可以包括存储器装置2110和存储器控制器2120。存储器控制器2120和存储器装置2110可以分别使用图1至4中示出的存储器控制器20a至20d以及存储器装置10a至10d。
计算系统2000还可以包括与视频卡、声卡、存储器卡和usb设备通信或与其他电子装置通信的多个端口。计算系统2000可以用个人计算机(pc)来实施或者可以用诸如笔记本电脑、便携式电话、个人数字助理(pda)或照相机等的便携式电子装置来实施。
处理器2200可以执行某些计算或者任务。根据发明构思的示例性实施例，处理器2200可以是微处理器或者cpu。处理器2200可以通过诸如地址总线、控制总线或数据总线等的总线2600与ram2300、i/o装置2400和存储器系统2100通信。根据发明构思的示例性实施例，处理器2200可以连接到诸如外围组件互连(pci)总线的扩展总线。
ram2300可以存储用于计算系统2000的操作的数据。例如，ram2300可以利用动态ram(dram)、移动dram、静态ram(sram)、相变ram(pram)、铁电ram(fram)、电阻式ram(rram)和/或磁阻式ram(mram)来实施。
i/o装置2400可以包括诸如键盘、小键盘、鼠标等的输入单元以及诸如显示器等的输出单元。电源2500可以提供操作电压以用于计算系统2000的操作。
图29是示出被应用于固态盘(ssd)系统3000的根据发明构思的示例性实施例的存储器系统的框图。
参照图29，ssd系统3000可以包括主机3100和ssd3200。ssd3200可以通过信号连接器将信号sgl发送至主机3100或者从主机3100接收信号sgl并且可以通过电源连接器接收电力pwr。ssd3200可以包括存储器控制器3210、辅助电源3220和多个存储器装置3230、3240和3250。存储器控制器3210和多个存储器装置3230、3240和3250可以分别使用图1至图4中示出的存储器控制器20a至20d以及存储器装置10a至10d。存储器控制器3210和多个存储器装置3230、3240和3250可以经由多个通道ch1至chn连接。
发明构思的示例性实施例可以实施为方法、装置、系统等。当发明构思的示例性实施例被实施为软件时，根据本实施例的元件可以是执行操作的代码段。程序或代码段可以存储在处理器可读介质中。处理器可读介质可以包括用于存储信息的所有介质。处理器可读介质的示例可以包括电子电路、半导体存储器装置、rom、闪速存储器、可擦除rom(erom)、软盘、光盘和/或硬盘等。
发明构思的示例性实施例提供了例如使存储器装置中的页的位错误率均衡化的一种存储器装置及其边缘字线管理方法。
尽管已经参照发明构思的示例性实施例具体示出和描述了发明构思，但是应当理解的是，在不脱离如权利要求所限定的发明构思的精神和范围的情况下，可以在这里对其进行形式和细节上的各种改变。