专利名称：三层光罩沟槽mos器件及制造方法
技术领域：
本发明涉及一种大功率M0S器件及其制造方法，特别涉及只要三层光罩便可制作 的沟槽M0S器件及制造方法。
背景技术：
沟槽M0SFET器件广泛应用于功率类电路中，作为开关器件连接电源与负载。制作 沟槽M0FET器件的硅片通常由高掺杂的衬底和较低掺杂的外延生长层构成。M0SFET漏极位 于硅片底面高掺杂部分，源极位于硅片表面较低掺杂的外延层部分，栅极则由垂直于硅片 表面的沟槽构成。沟槽M0SFET芯片所能承受的最大反向偏置电压由外延层的厚度和掺杂 浓度决定，而导通电流的大小则由导电沟道的宽度，即沟槽的总边长决定。在有限面积下， 沟槽纵向和横向交叉排列以期获得最大的有效边长。沟槽M0SFET器件中包含有沟槽、源极的最小重复单元称为单胞，每个单胞即为一 个完整的M0SFET单元，这些单胞阵列布置在有源区上并且并联在一起构成M0SFET芯片。 更高的单胞密度意味着更大的导电沟道有效宽度，这样在器件导通状态下可以减小功率损 失。同时，在同样导通电流能力要求下，更高的单胞密度意味着较小的芯片面积即可满足要 求。芯片面积减小可以在相同尺寸的晶圆上生产出更多数目的芯片，从而降低成本。传统的N型导电沟道沟槽M0SFET制造方法于图1A至图1E所示，其中各图表示的 制作工艺如下图1A 在N型高掺杂衬底3上外延生长N型低掺杂的N-外延层4 ；然后在N_外延 层4上生长二氧化硅层，接着使用第一块光罩定义出P型离子注入区域，然后进行P型离子 注入并通过热处理完成P型阱11区域在N-外延层4中的制作。图1B 在硅片上表面生长二氧化硅层作为硬掩膜，使用第二块光罩定义出沟槽的 图形；干法刻蚀后，在N-外延层4中形成一系列沟槽，沟槽的深度大于P型阱11的深度，图 中有较小开口尺寸的栅极沟槽6用于制作M0SFET的栅极并构成阵列排列的单胞，而图中较 大开口尺寸的栅极接触沟槽5位于M0SFET芯片的边缘区域，并包围单胞阵列，用于制作栅 极接触孔，连接栅极金属电极。图1C 将硬掩膜去除后生长栅氧化层7，然后沉积N型导电多晶硅层8，通过干法 刻蚀形成M0SFET栅极结构；接着使用第三块光罩进行N型离子注入，在P型阱11中形成N+ 源极区域10。图1D 沉积氧化层到整个结构表面，使用第四块光罩定义出接触孔图形，经过对 氧化层和单晶硅的干法刻蚀，制作出底部低于N+源极区域10的栅极接触孔9和源极接触 孔12结构，随后进行P型离子注入，使P型阱11底部有更高的离子掺杂浓度形成P+接触 区域15。图1E 沉积金属钛粘结层13和氮化钛阻挡层到整个结构表面，随后沉积钨层，进 行钨的干法刻蚀形成填充钨的接触孔；沉积上金属层2到整个结构表面，使用第五块光罩 定义出源极金属电极区域和栅极金属电极区域，并进行相应刻蚀形成源极金属电极和栅极金属电极，最后在N型高掺杂衬底的底面上沉积下金属层形成漏极金属电极(图1E中未画 出)。从以上制作工艺中可以看出，传统N型沟槽M0SFET制作共需要五块光罩，这五 块光罩分别用于制作P型阱、沟槽、N+源极、接触孔和上金属层。一般而言，每增加一次 光罩约增加15%左右的成本，因此光罩次数越多器件的生产成本越高。另外，美国专利 US6204533、US6211018、US7592650和US7078296给出了获取较高单胞密度的不同解决方 案。但是，他们都需要与传统沟槽M0SFET制造方法类似的光罩数目或者更为复杂的制程。
发明内容
本发明提供一种三层光罩沟槽M0S器件及制造方法，第一目的是要减少光罩数 目，降低制造成本；第二目的是要提高沟槽M0S器件芯片中的单胞密度，从而提高器件性 能、节约晶圆面积、降低成本。为达到上述目的，本发明沟槽M0S器件采用的技术方案是一种三层光罩沟槽N 型M0S器件，在俯视平面上，该器件的中央为并联的单胞阵列区域，单胞阵列区域的顶面沉 积有上金属层，单胞阵列区域的底部自下而上依次为下金属层、N+单晶硅衬底以及N-外延 层；单胞阵列区域外围的N-外延层中开设有栅极接触沟槽；单胞阵列区域内的N-外延层 中，纵向和横向均平行开设有若干条栅极沟槽，纵向平行开设的若干条栅极沟槽和横向平 行开设的若干条栅极沟槽处于同一水平面内且相互交叉；栅极沟槽与栅极接触沟槽相通， 而且每条沟槽的内表面均生长有栅氧化层，沟槽中沉积有N型高掺杂的导电多晶硅，其中， 栅极沟槽中的导电多晶硅顶部覆盖有介质层，栅极接触沟槽中的导电多晶硅与单胞阵列区 域外围的上金属层连接，单胞阵列区域外围的上金属层形成M0S管的栅极金属电极，其创 新在于栅极沟槽的槽宽小于栅极接触沟槽的槽宽，在栅极接触沟槽位置上从上金属层的 下表面开始垂直向下开设有栅极接触孔；在单胞阵列区域内，两个相邻纵向平行开设的栅 极沟槽和两个相邻横向平行开设的栅极沟槽均围成一区域，该区域所对应的N-外延层内 自上而下设有N+源极区域和P型阱，同时，该区域垂直向下开设有源极接触孔。在通过源极接触孔的横向截面上，栅极沟槽中的导电多晶硅顶面低于N-外延层 顶面，且单胞阵列区域的上金属层底面与导电多晶硅顶面之间的距离等于导电多晶硅顶面 低于N-外延层顶面的距离；源极接触孔从上金属层的下表面一直延伸到P型阱区域内，源 极接触孔为锥台形，上端开口直径大于底部直径，底部内角大于90度，源极接触孔内表面 依次沉积有金属钛粘结层和氮化钛阻挡层，金属钛粘结层和氮化钛阻挡层在源极接触孔侧 壁与N+源极区域形成N+源极欧姆接触，在源极接触孔侧壁和底部通过P+接触区域与P型 阱形成P型阱的欧姆接触，源极接触孔中填充有金属与单胞阵列区域的上金属层连接，单 胞阵列区域的上金属层形成M0S管源极金属电极，所述下金属层形成M0S管漏极金属电极。为达到上述目的，本发明沟槽M0S器件制造方法采用的第一技术方案是一种三 层光罩沟槽N型M0S器件的制造方法，包括下列工艺步骤第一步.在N型高掺杂浓度的N+单晶硅衬底上，生长N型低掺杂浓度的N-外延 层；第二步.在N-外延层上表面生长第一介质层，该第一介质层为二氧化硅层，或者氮化硅层，或者二氧化硅层和氮化硅层的复合层；第三步.对第一介质层实施光刻，定义出沟槽图形；第四步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第一介质层，曝露出 沟槽图形对应的N-外延层，而去除光刻胶后保留下来的第一介质层作为第一硬掩膜使用；第五步.以第一硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀曝露出N-外延层 区域的单晶硅，在N-外延层中形成沟槽，其中，位于单胞阵列区域的沟槽为栅极沟槽，而位 于单胞阵列区域外围的沟槽为栅极接触沟槽，而且栅极沟槽的槽宽小于栅极接触沟槽的槽 宽；第六步.采用湿法腐蚀方法，选择性去除第一硬掩膜；第七步.在第六步后整个结构的上表面均勻生长二氧化硅层，作为栅氧化层；第八步.在第七步后整个结构的上表面沉积N型高掺杂导电多晶硅层，N型高掺 杂导电多晶硅填满表面具有二氧化硅层的沟槽；第九步.对沉积的N型高掺杂导电多晶硅层实施干法刻蚀，去除整个结构上表面 的N型高掺杂导电多晶硅，直到沟槽中被填充的N型高掺杂导电多晶硅的顶面低于N-外延 层顶面为止，使沟槽的槽口形成凹陷，从而构成栅极导电多晶硅；第十步.在第九步后整个结构的上表面均勻沉积第二介质层，该第二介质层为二 氧化硅层，或者氮化硅层，或者二氧化硅层和氮化硅层的复合层，由于沟槽的槽宽不同，具 有小槽宽的栅极沟槽的顶部凹陷中填满了第二介质层，而具有大槽宽的栅极接触沟槽的顶 部凹陷中的底部和侧壁覆盖有第二介质层，沟槽槽口仍然保持凹陷状态；第十一步.对第二介质层实施光刻，光刻胶掩膜覆盖栅极沟槽与栅极接触沟槽之 间的第二介质层，曝露出单胞阵列区域和栅极接触沟槽区域；第十二步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第二介质层，即栅 极沟槽之间的N-外延层顶部的第二介质层，以及栅极接触沟槽内导电多晶硅顶部的第二 介质层被除去，而栅极沟槽内的第二介质层得以保留，去除光刻胶后保留下来的第二介质 层作为第二硬掩膜使用；第十三步.以第二硬掩膜作为保护，对单胞阵列区域进行P型杂质离子注入，P型 杂质离子注入到没有第二硬掩膜覆盖的N-外延层内，然后通过热处理在N-外延层内形成 P型阱区域；第十四步.以第二硬掩膜作为保护，对单胞阵列区域进行N型杂质离子注入，然后 通过热处理在N-外延层顶部形成N+源极区域；第十五步.以第二硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀栅极接触沟槽 顶部曝露的导电多晶硅以及栅极沟槽之间曝露的N-外延层中的单晶硅，在栅极接触沟槽 中形成自对准的栅极接触孔，同时在栅极沟槽之间形成自对准的源极接触孔，栅极接触孔 和源极接触孔均为锥台形，上端开口直径大于底部直径，底部内角大于90度，源极接触孔 的底部伸入P型阱区域；第十六步.以第二硬掩膜作为保护，对单胞阵列区域进行P型杂质离子注入在源 极接触孔底部形成P+接触区域，使源极接触孔底部与P型阱的交界区具有更高的离子掺杂 浓度；第十七步.在第十六步后整个结构的上表面依次沉积金属钛粘结层和氮化钛阻挡层，然后通过热处理使金属钛粘结层和氮化钛阻挡层在源极接触孔侧壁与N+源极区域 形成N+源极欧姆接触，在源极接触孔侧壁和底部与P+接触区域形成P型阱的欧姆接触，在 栅极接触孔的侧壁和底部与栅极接触沟槽中的导电多晶硅形成欧姆接触；第十八步.在第十七步后整个结构的上表面沉积上金属层；第十九步.对上金属层实施光刻，用光刻胶保护单胞阵列区域的源极金属电极区 域和单胞阵列区域外围的栅极金属电极区域，即定义源极金属电极区域和栅极金属电极区 域图形；第二十步.采用干法刻蚀方法，选择性去除未被光刻胶保护的上金属层，曝露出 第二介质层，去除光刻胶后，留下的位于单胞阵列区域的上金属层形成M0S管源极金属电 极，留下的位于单胞阵列区域外围的上金属层形成M0S管栅极金属电极；第二十一步.在N+单晶硅衬底的底面沉积下金属层，该下金属层形成M0S管漏极 金属电极。为达到上述目的，本发明沟槽M0S器件制造方法采用的第二技术方案是一种三 层光罩沟槽N型M0S器件的制造方法，该方法与上述第一技术方案相比存在以下两点不 同第一点是省略第一技术方案第十三步中记载的P型阱制作工艺。第二点是将第一技术方案第十六步中记载的内容修改为“以第二硬掩膜作为保 护，对单胞阵列区域进行第一次P型杂质离子注入，然后通过热处理在N+源极区域下方的 N-外延层中形成P型阱区域，接着对单胞阵列区域进行第二次P型杂质离子注入在源极接 触孔底部形成P+接触区域，使源极接触孔底部与P型阱的交界区具有更高的离子掺杂浓 度”。也就是在自对准刻蚀栅极接触孔和源极接触孔完成之后，利用随后的P型离子注入分 别形成与P型阱功能相同的区域。其余内容相同，这里不再重复。为达到上述目的，本发明沟槽M0S器件制造方法采用的第三技术方案是一种三 层光罩沟槽N型M0S器件的制造方法，该方法与上述第一技术方案相比存在一点不同即将 第一技术方案第十三步中记载的P型阱制作工艺改在沟槽制作之前。具体是在第一技术方 案第一步之后，以及第二步之前加入以下步聚对N-外延层进行P型杂质离子注入，P型杂 质离子注入到N-外延层内，然后通过热处理在N-外延层内形成P型阱区域。也就是在沟 槽制程步骤之前，无光刻掩膜的情况下，直接对N-外延层进行P型离子注入及热处理形成 P型阱区域。其余内容相同，这里不再重复。由于上述技术方案的运用，本发明的特点和效果是1.在沟槽以及导电多晶硅制作完成后，在整个结构的上表面沉积一定厚度的、具 有良好台阶覆盖能力的介质层，使不同开口尺寸的沟槽具有完全不同的表面形貌，即位于 单胞阵列区域且具有小槽宽的栅极沟槽的顶部凹陷中填满了介质层，而位于单胞阵列区域 外围且具有大槽宽的栅极接触沟槽的顶部凹陷中的底部和侧壁覆盖有介质层，沟槽槽口仍 然保持凹陷状态。经过干法刻蚀制程之后，栅极接触沟槽顶部凹陷中的底部介质膜被除去， 曝露出导电多晶硅，凹陷中的侧壁介质层保留；而栅极沟槽顶部依然有留存的介质层覆盖。 再辅助以一定的光刻制程，可以实现在需要的区域保留介质层。
2.经过以上处理存留下来的介质层可以取代光刻胶掩膜，用作N+源极离子注入 的掩膜，或者P型阱离子注入的掩膜。3.利用上述存留下来的介质层，可以制作自对准的源极接触孔和自对准的栅极接 触孔。使用孔刻蚀工艺，可以实现源极接触孔底部内角大于90度。所谓自对准，即是省略 接触孔光罩和光刻制程，利用存留下来的介质膜作为接触孔刻蚀过程中的掩膜版，简化了 制程，节省了成本。同时自对准工艺方案也消除了由光刻引入的接触孔相对栅极沟槽对准 偏离的限制，可以实现更高单胞密度MOSFET器件的制造。总之，基于本发 明方案，仅需三层光罩就可以制造出沟槽MOSFET器件。在制造工 艺简单，成本低的同时，可以实现更高的单胞密度，即更好的性能。
附图IA 图IE为传统的N型导电沟道沟槽MOSFET器件制作工艺流程示意图。附图2为本发明实施例1三层光罩沟槽N型MOS器件剖面图。附图3A 3E为本发明实施例1三层光罩沟槽N型MOS器件制作工艺流程示意图。附图4为本发明实施例2三层光罩沟槽N型MOS器件剖面图。附图5为本发明实施例3三层光罩沟槽N型MOS器件剖面图。附图6为本发明实施例4三层光罩沟槽N型MOS器件剖面图。附图7为本发明实施例5三层光罩沟槽N型MOS器件剖面图。以是附图中1、单胞阵列区域；2、上金属层；3、N+单晶硅衬底；4、N-外延层；5、 栅极接触沟槽；6、栅极沟槽；7、栅氧化层；8、导电多晶硅；9、栅极接触孔；10、N+源极区域； 11、P型阱；12、源极接触孔；13、金属钛粘结层；14、氮化钛阻挡层；15、P+接触区域；16、第 二介质层；17、栅氧化层；18、导电多晶硅遮挡层。
具体实施例方式下面结合附图及实施例对本发明作进一步描述实施例1 如图2所示，本发明三层光罩沟槽N型MOS器件结构是在俯视平面上，该器件的 中央为并联的单胞阵列区域1，单胞阵列区域1的顶面沉积有上金属层2，单胞阵列区域1 的底部自下而上依次为下金属层(图中未画出)、N+单晶硅衬底3以及N-外延层4。单胞 阵列区域外围的N-外延层4中开设有栅极接触沟槽5。单胞阵列区域1内的N-外延层4 中，纵向和横向均平行开设有若干条栅极沟槽6，纵向平行开设的若干条栅极沟槽6和横向 平行开设的若干条栅极沟槽6处于同一水平面内且相互交叉。栅极沟槽6与栅极接触沟槽 5相通，而且每条沟槽的内表面均生长有栅氧化层7，沟槽中沉积有N型高掺杂的导电多晶 硅8，其中，栅极沟槽6中的导电多晶硅8顶部覆盖有第二介质层16，栅极接触沟槽5中的 导电多晶硅8与单胞阵列区域1外围的上金属层2连接，单胞阵列区域1外围的上金属层 2形成MOS管的栅极金属电极。栅极沟槽6的槽宽小于栅极接触沟槽5的槽宽，在栅极接触沟槽5位置上从上金 属层2的下表面开始垂直向下开设有栅极接触孔9。在单胞阵列区域1内，两个相邻纵向平 行开设的栅极沟槽6和两个相邻横向平行开设的栅极沟槽6均围成一区域，该区域所对应的N-外延层4内自上而下设有N+源极区域10和P型阱11，同时，该区域垂直向下开设有 源极接触孔12。在通过源极接触孔12的横向截面上，栅极沟槽6中的导电多晶硅8顶面低于N-外 延层4顶面，且单胞阵列区域1内的上金属层2底面与导电多晶硅8顶面之间的距离等于 导电多晶硅8顶面低于N-外延层4顶面的距离。源极接触孔12从上金属层2的下表面一 直延伸到P型阱11区域内，源极接触孔12为锥台形，上端开口直径大于底部直径，底部内 角大于90度。源极接触孔12内表面依次沉积有金属钛粘结层13和氮化钛阻挡层14，金属 钛粘结层13和氮化钛阻挡层14在源极接触孔12侧壁与N+源极区域10形成N+源极欧姆 接触，在源极接触孔12侧壁和底部通过P+接触区域15与P型阱11形成P型阱的欧姆接 触，源极接触孔12中填充有金属与单胞阵列区域1的上金属层2连接，单胞阵列区域1的 上金属层2形成MOS管源极金属电极，所述下金属层形成MOS管漏极金属电极。基于上述沟槽N型MOS器件结构，本发明制造方法包括下列工艺步骤 参见图3A 第一步.在N型高掺杂浓度的N+单晶硅衬底3上，生长N型低掺杂浓度的N-外 延层4。第二步.在N-外延层4上表面生长第一介质层(图中未画出，因在图3A状态下 第一介质层已被去除)，该第一介质层为二氧化硅层，或者氮化硅层，或者二氧化硅层和氮 化硅层的复合层。第三步.对第一介质层实施光刻，定义出沟槽图形。第四步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第一介质层，曝露出 沟槽图形对应的N-外延层4，而去除光刻胶后保留下来的第一介质层作为第一硬掩膜使用。第五步.以第一硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀曝露出N-外延层 4区域的单晶硅，在N-外延层4中形成沟槽，其中，位于单胞阵列区域1的沟槽为栅极沟槽 6，而位于单胞阵列区域1外围的沟槽为栅极接触沟槽5，而且栅极沟槽6的槽宽小于栅极接 触沟槽5的槽宽。第六步.采用湿法腐蚀方法，选择性去除第一硬掩膜。第七步.在第六步后整个结构的上表面均勻生长二氧化硅层，作为栅氧化层7。第八步.在第七步后整个结构的上表面沉积N型高掺杂导电多晶硅层，N型高掺 杂导电多晶硅填满表面具有二氧化硅层的沟槽(栅极沟槽6和栅极接触沟槽5)。第九步.对沉积的N型高掺杂导电多晶硅层实施干法刻蚀，去除整个结构上表面 的N型高掺杂导电多晶硅，直到沟槽中被填充的N型高掺杂导电多晶硅的顶面低于N-外延 层顶面为止，使沟槽的槽口形成凹陷，从而构成栅极导电多晶硅8。参见图3B 第十步.在第九步后整个结构的上表面均勻沉积第二介质层16，该第二介质层16 为二氧化硅层，或者氮化硅层，或者二氧化硅层和氮化硅层的复合层。由于沟槽的槽宽不 同，具有小槽宽的栅极沟槽6的顶部凹陷中填满了第二介质层16 (见图3B)，而具有大槽宽 的栅极接触沟槽5的顶部凹陷中的底部和侧壁覆盖有第二介质层16，沟槽槽口仍然保持凹 陷状态(见图3B)。
参见图3C 第十一步.对第二介质层16实施光刻，光刻胶掩膜覆盖栅极沟槽6与栅极接触沟 槽5之间的第二介质层16，曝露出单胞阵列区域1和栅极接触沟槽5区域。 第十二步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第二介质层16，即 栅极沟槽6之间的N-外延层4顶部的第二介质层16，以及栅极接触沟槽5内导电多晶硅8 顶部的第二介质层16被除去，而栅极沟槽6内的第二介质层16得以保留，去除光刻胶后保 留下来的第二介质层16作为第二硬掩膜使用。第十三步.以第二硬掩膜作为保护，对单胞阵列区域1进行P型杂质离子注入，P 型杂质离子注入到没有第二硬掩膜覆盖的N-外延层4内，然后通过热处理在N-外延层4 内形成P型阱11区域。第十四步.以第二硬掩膜作为保护，对单胞阵列区域1进行N型杂质离子注入，然 后通过热处理在N-外延层4顶部形成N+源极区域10。参见图3D 第十五步.以第二硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀栅极接触沟槽 5顶部曝露的导电多晶硅8以及栅极沟槽6之间曝露的N-外延层4中的单晶硅，在栅极接 触沟槽5中形成自对准的栅极接触孔9，同时在栅极沟槽6之间形成自对准的源极接触孔 12，栅极接触孔9和源极接触孔12均为锥台形，上端开口直径大于底部直径，底部内角大于 90度，源极接触孔12的底部伸入P型阱11区域。第十六步.以第二硬掩膜作为保护，对单胞阵列区域1进行P型杂质离子注入在 源极接触孔12底部形成P+接触区域15，使源极接触孔12底部与P型阱11的交界区具有 更高的离子掺杂浓度。参见图3F 第十七步.在第十六步后整个结构的上表面依次沉积金属钛粘结层13和氮化钛 阻挡层14，然后通过热处理使金属钛粘结层13和氮化钛阻挡层14在源极接触孔12侧壁与 N+源极区域10形成N+源极欧姆接触，在源极接触孔12侧壁和底部与P+接触区域15形成 P型阱U的欧姆接触，在栅极接触孔9的侧壁和底部与栅极接触沟槽5中的导电多晶硅8 形成欧姆接触。第十八步.在第十七步后整个结构的上表面沉积上金属层2。如果接触孔(指源 极接触孔12和栅极接触孔9)直径较小，先在整个结构的上表面沉积金属钨，金属钨填满接 触孔，然后采用干法刻蚀方法，选择性除去金属钨，使第二介质层顶部曝露出来，而接触孔 中依然填满钨，接着在整个结构上表面沉积铝层，或者掺杂有铜的铝层，或者掺杂有铜和硅 的铝层。如果接触孔直径足够大，可以直接在整个结构的上表面沉积铝层，或者掺杂有铜的 铝层，或者掺杂有铜和硅的铝层，并填满接触孔。第十九步.对上金属层2实施光刻，用光刻胶保护单胞阵列区域1的源极金属电 极区域和单胞阵列区域1外围的栅极金属电极区域，即定义源极金属电极区域和栅极金属 电极区域图形。第二十步.采用干法刻蚀方法，选择性去除未被光刻胶保护的上金属层2，曝露出 第二介质层，去除光刻胶后，留下的位于单胞阵列区域1的上金属2层形成MOS管源极金属 电极，留下的位于单胞阵列区域1外围的上金属层2形成MOS管栅极金属电极。
第二十一步.在N+单晶硅衬底3的底面沉积下金属层(图中未画出)，该下金属 层形成MOS管漏极金属电极。实施例2 本实施例通过源极接触孔12的横向剖面见图4。图4与实施例1中的图2相比结 构基本相同。区别在于省略了实施例1制造方法中的P型阱制作工艺，在自对准刻蚀栅极 接触孔和源极接触孔完成之后，利用随后的P型离子注入分别形成与P型阱功能相同的区 域。具体是第一，省略了实施例1制造方法第十三步中记载的P型阱制作工艺。第二，将实施例1制造方法第十六步中记载的内容改为“以第二硬掩膜作为保护，对单胞阵列区域1进行第一次P型杂质离子注入，然后通过热处理在N+源极区域10下 方的N-外延层4中形成P型阱11区域，接着对单胞阵列区域1进行第二次P型杂质离子 注入在源极接触孔12底部形成P+接触区域15，使源极接触孔12底部与P型阱11的交界 区具有更高的离子掺杂浓度”。其余制造方法内容与实施例1相同，这里不再重复。实施例3 本实施例通过源极接触孔12的横向剖面见图5。图5与实施例1中的图2相比 结构基本相同。区别在于改变了 P型阱的制程步骤，在沟槽制程步骤之前，无光刻掩膜的情 况下，直接对N-外延层4进行P型离子注入及热处理形成P型阱11区域。具体是将实施 例1制造方法第十三步中记载的P型阱制作工艺改在沟槽制作之前，即实施例1制造方法 第一步之后，以及第二步之前加入以下步聚对N-外延层4进行P型杂质离子注入，P型杂 质离子注入到N-外延层4内，然后通过热处理在N-外延层4内形成P型阱11区域。其余制造方法内容与实施例1相同，这里不再重复。实施例4 本实施例通过源极接触孔12的横向剖面见图6。图6与实施例1中的图2相比区 别在于栅极沟槽6和栅极接触沟槽5底部的栅氧化层17厚度均大于沟槽侧壁的栅氧化层 7厚度。其他结构基本相同，这里不再重复描述。沟槽底部栅氧化层17加厚可以带来两点 好处一是栅极与漏极之间的寄生电容变小。可以减小MOSFET器件动态开、关过程中的开 关功率损耗。二是当MOSFET沟道关断时，由于漏极存在很大的偏置电压，在沟槽底部区域 会存在强电场，更厚的栅氧化层17可以提高器件抵御强电场的能力，避免发生因漏极到栅 极击穿而导致的器件失效。为了使栅极沟槽6和栅极接触沟槽5底部的栅氧化层17加厚，制造方法是在选 择性去除第一硬掩膜之后，以及生长二氧化硅层作为栅氧化层12之前加入以下步骤在整个结构的上表面均勻生长用于增加沟槽底部栅氧化层厚度的辅助二氧化硅 层；然后在整个结构的上表面涂布光刻胶实施光刻；接着采用干法刻蚀方法选择性刻蚀光 刻胶，在沟槽底部留存光刻胶；接着采用湿法腐蚀方法除去表面的辅助二氧化硅层，由于沟 槽底部留存光刻胶的阻挡，使沟槽底部依然保留有辅助二氧化硅层；最后去除光刻胶形成 沟槽底部用于加厚的辅助二氧化硅层。实施例5:本实施例通过源极接触孔12的横向剖面见图7。图7与实施例1中的图2相比区别在于栅极沟槽6和栅极接触沟槽5底部均设有导电多晶硅遮挡层18，该导电多晶硅遮 挡层18位于沟槽中导电多晶硅8的下方。其他结构基本相同，这里不再重复描述。在沟槽 底部增加多晶硅遮挡层18的好处主要为减小栅极与漏极之间的寄生电容。该结构可以减 小MOSFET器件动态开、关过程中的开关功率损耗。
为了在栅极沟槽6和栅极接触沟槽5底部设有导电多晶硅遮挡层18，制造方法是 在选择性去除第一硬掩膜之后，以及生长二氧化硅层作为栅氧化层之前加入以下步骤在整个结构的上表面均勻生长用于制作沟槽底部导电多晶硅遮挡层18的辅助二 氧化硅层；然后在整个结构的上表面沉积用于遮挡的导电多晶硅层，该导电多晶硅填满沟 槽；接着采用干法刻蚀方法选择性刻蚀导电多晶硅，只在沟槽底部保留导电多晶硅层；接 着采用湿法腐蚀方法除去整个结构表面的辅助二氧化硅层，由于保留导电多晶硅层的阻 挡，沟槽底部依然保留有辅助二氧化硅层，而保留导电多晶硅层作为沟槽底部增加的导电 多晶硅遮挡层18。上述实施例只为说明本发明的技术构思及特点，其目的在于让熟悉此项技术的人 士能够了解本发明的内容并据以实施，并不能以此限制本发明的保护范围。凡根据本发明 精神实质所作的等效变化或修饰，都应涵盖在本发明的保护范围之内。
权利要求
一种三层光罩沟槽N型MOS器件，在俯视平面上，该器件的中央为并联的单胞阵列区域，单胞阵列区域的顶面沉积有上金属层，单胞阵列区域的底部自下而上依次为下金属层、N+单晶硅衬底以及N-外延层；单胞阵列区域外围的N-外延层中开设有栅极接触沟槽；单胞阵列区域内的N-外延层中，纵向和横向均平行开设有若干条栅极沟槽，纵向平行开设的若干条栅极沟槽和横向平行开设的若干条栅极沟槽处于同一水平面内且相互交叉；栅极沟槽与栅极接触沟槽相通，而且每条沟槽的内表面均生长有栅氧化层，沟槽中沉积有N型高掺杂的导电多晶硅，其中，栅极沟槽中的导电多晶硅顶部覆盖有介质层，栅极接触沟槽中的导电多晶硅与单胞阵列区域外围的上金属层连接，单胞阵列区域外围的上金属层形成MOS管的栅极金属电极，其特征在于栅极沟槽的槽宽小于栅极接触沟槽的槽宽，在栅极接触沟槽位置上从上金属层的下表面开始垂直向下开设有栅极接触孔；在单胞阵列区域内，两个相邻纵向平行开设的栅极沟槽和两个相邻横向平行开设的栅极沟槽均围成一区域，该区域所对应的N-外延层内自上而下设有N+源极区域和P型阱，同时，该区域垂直向下开设有源极接触孔；在通过源极接触孔的横向截面上，栅极沟槽中的导电多晶硅顶面低于N-外延层顶面，且单胞阵列区域的上金属层底面与导电多晶硅顶面之间的距离等于导电多晶硅顶面低于N-外延层顶面的距离；源极接触孔从上金属层的下表面一直延伸到P型阱区域内，源极接触孔为锥台形，上端开口直径大于底部直径，底部内角大于90度，源极接触孔内表面依次沉积有金属钛粘结层和氮化钛阻挡层，金属钛粘结层和氮化钛阻挡层在源极接触孔侧壁与N+源极区域形成N+源极欧姆接触，在源极接触孔侧壁和底部通过P+接触区域与P型阱形成P型阱的欧姆接触，源极接触孔中填充有金属与单胞阵列区域的上金属层连接，单胞阵列区域的上金属层形成MOS管源极金属电极，所述下金属层形成MOS管漏极金属电极。
2.根据权利要求1所述的沟槽N型MOS器件，其特征在于所述栅极沟槽和栅极接触 沟槽底部的栅氧化层厚度均大于沟槽侧壁的栅氧化层厚度。
3.根据权利要求1所述的沟槽N型MOS器件，其特征在于所述栅极沟槽和栅极接触 沟槽底部均设有导电多晶硅遮挡层，该导电多晶硅遮挡层位于沟槽中导电多晶硅的下方。
4.一种根据权利要求1所述三层光罩沟槽N型MOS器件的制造方法，其特征在于包括 下列工艺步骤第一步.在N型高掺杂浓度的N+单晶硅衬底上，生长N型低掺杂浓度的N-外延层； 第二步.在N-外延层上表面生长第一介质层，该第一介质层为二氧化硅层，或者氮化 硅层，或者二氧化硅层和氮化硅层的复合层；第三步.对第一介质层实施光刻，定义出沟槽图形；第四步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第一介质层，曝露出沟槽 图形对应的N-外延层，而去除光刻胶后保留下来的第一介质层作为第一硬掩膜使用；第五步.以第一硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀曝露出N-外延层区域 的单晶硅，在N-外延层中形成沟槽，其中，位于单胞阵列区域的沟槽为栅极沟槽，而位于单 胞阵列区域外围的沟槽为栅极接触沟槽，而且栅极沟槽的槽宽小于栅极接触沟槽的槽宽； 第六步.采用湿法腐蚀方法，选择性去除第一硬掩膜； 第七步.在第六步后整个结构的上表面均勻生长二氧化硅层，作为栅氧化层； 第八步.在第七步后整个结构的上表面沉积N型高掺杂导电多晶硅层，N型高掺杂导电多晶硅填满表面具有二氧化硅层的沟槽； 第九步.对沉积的N型高掺杂导电多晶硅层实施干法刻蚀，去除整个结构上表面的N 型高掺杂导电多晶硅，直到沟槽中被填充的N型高掺杂导电多晶硅的顶面低于N-外延层顶 面为止，使沟槽的槽口形成凹陷，从而构成栅极导电多晶硅；第十步.在第九步后整个结构的上表面均勻沉积第二介质层，该第二介质层为二氧化 硅层，或者氮化硅层，或者二氧化硅层和氮化硅层的复合层，由于沟槽的槽宽不同，具有小 槽宽的栅极沟槽的顶部凹陷中填满了第二介质层，而具有大槽宽的栅极接触沟槽的顶部凹 陷中的底部和侧壁覆盖有第二介质层，沟槽槽口仍然保持凹陷状态；第十一步.对第二介质层实施光刻，光刻胶掩膜覆盖栅极沟槽与栅极接触沟槽之间的 第二介质层，曝露出单胞阵列区域和栅极接触沟槽区域；第十二步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第二介质层，即栅极沟 槽之间的N-外延层顶部的第二介质层，以及栅极接触沟槽内导电多晶硅顶部的第二介质 层被除去，而栅极沟槽内的第二介质层得以保留，去除光刻胶后保留下来的第二介质层作 为第二硬掩膜使用；第十三步.以第二硬掩膜作为保护，对单胞阵列区域进行P型杂质离子注入，P型杂质 离子注入到没有第二硬掩膜覆盖的N-外延层内，然后通过热处理在N-外延层内形成P型 阱区域；第十四步.以第二硬掩膜作为保护，对单胞阵列区域进行N型杂质离子注入，然后通过 热处理在N-外延层顶部形成N+源极区域；第十五步.以第二硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀栅极接触沟槽顶部 曝露的导电多晶硅以及栅极沟槽之间曝露的N-外延层中的单晶硅，在栅极接触沟槽中形 成自对准的栅极接触孔，同时在栅极沟槽之间形成自对准的源极接触孔，栅极接触孔和源 极接触孔均为锥台形，上端开口直径大于底部直径，底部内角大于90度，源极接触孔的底 部伸入P型阱区域；第十六步.以第二硬掩膜作为保护，对单胞阵列区域进行P型杂质离子注入在源极接 触孔底部形成P+接触区域，使源极接触孔底部与P型阱的交界区具有更高的离子掺杂浓 度；第十七步.在第十六步后整个结构的上表面依次沉积金属钛粘结层和氮化钛阻挡层， 然后通过热处理使金属钛粘结层和氮化钛阻挡层在源极接触孔侧壁与N+源极区域形成N+ 源极欧姆接触，在源极接触孔侧壁和底部与P+接触区域形成P型阱的欧姆接触，在栅极接 触孔的侧壁和底部与栅极接触沟槽中的导电多晶硅形成欧姆接触； 第十八步.在第十七步后整个结构的上表面沉积上金属层；第十九步.对上金属层实施光刻，用光刻胶保护单胞阵列区域的源极金属电极区域和 单胞阵列区域外围的栅极金属电极区域，即定义源极金属电极区域和栅极金属电极区域图 形；第二十步.采用干法刻蚀方法，选择性去除未被光刻胶保护的上金属层，曝露出第二 介质层，去除光刻胶后，留下的位于单胞阵列区域的上金属层形成MOS管源极金属电极，留 下的位于单胞阵列区域外围的上金属层形成MOS管栅极金属电极；第二十一步.在N+单晶硅衬底的底面沉积下金属层，该下金属层形成MOS管漏极金属电极。
5. 一种根据权利要求1所述三层光罩沟槽N型MOS器件的制造方法，其特征在于包括 下列工艺步骤第一步.在N型高掺杂浓度的N+单晶硅衬底上，生长N型低掺杂浓度的N-外延层； 第二步.在N-外延层上表面生长第一介质层，该第一介质层为二氧化硅层，或者氮化 硅层，或者二氧化硅层和氮化硅层的复合层；第三步.对第一介质层实施光刻，定义出沟槽图形；第四步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第一介质层，曝露出沟槽 图形对应的N-外延层，而去除光刻胶后保留下来的第一介质层作为第一硬掩膜使用；第五步.以第一硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀曝露出N-外延层区域 的单晶硅，在N-外延层中形成沟槽，其中，位于单胞阵列区域的沟槽为栅极沟槽，而位于单 胞阵列区域外围的沟槽为栅极接触沟槽，而且栅极沟槽的槽宽小于栅极接触沟槽的槽宽； 第六步.采用湿法腐蚀方法，选择性去除第一硬掩膜； 第七步.在第六步后整个结构的上表面均勻生长二氧化硅层，作为栅氧化层； 第八步.在第七步后整个结构的上表面沉积N型高掺杂导电多晶硅层，N型高掺杂导 电多晶硅填满表面具有二氧化硅层的沟槽；第九步.对沉积的N型高掺杂导电多晶硅层实施干法刻蚀，去除整个结构上表面的N 型高掺杂导电多晶硅，直到沟槽中被填充的N型高掺杂导电多晶硅的顶面低于N-外延层顶 面为止，使沟槽的槽口形成凹陷，从而构成栅极导电多晶硅；第十步.在第九步后整个结构的上表面均勻沉积第二介质层，该第二介质层为二氧化 硅层，或者氮化硅层，或者二氧化硅层和氮化硅层的复合层，由于沟槽的槽宽不同，具有小 槽宽的栅极沟槽的顶部凹陷中填满了第二介质层，而具有大槽宽的栅极接触沟槽的顶部凹 陷中的底部和侧壁覆盖有第二介质层，沟槽槽口仍然保持凹陷状态；第十一步.对第二介质层实施光刻，光刻胶掩膜覆盖栅极沟槽与栅极接触沟槽之间的 第二介质层，曝露出单胞阵列区域和栅极接触沟槽区域；第十二步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第二介质层，即栅极沟 槽之间的N-外延层顶部的第二介质层，以及栅极接触沟槽内导电多晶硅顶部的第二介质 层被除去，而栅极沟槽内的第二介质层得以保留，去除光刻胶后保留下来的第二介质层作 为第二硬掩膜使用；第十三步.以第二硬掩膜作为保护，对单胞阵列区域进行N型杂质离子注入，然后通过 热处理在N-外延层顶部形成N+源极区域；第十四步.以第二硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀栅极接触沟槽顶部 曝露的导电多晶硅以及栅极沟槽之间曝露的N-外延层中的单晶硅，在栅极接触沟槽中形 成自对准的栅极接触孔，同时在栅极沟槽之间形成自对准的源极接触孔，栅极接触孔和源 极接触孔均为锥台形，上端开口直径大于底部直径，底部内角大于90度，源极接触孔的底 部伸入N+源极区域下方的N-外延层；第十五步.以第二硬掩膜作为保护，对单胞阵列区域进行第一次P型杂质离子注入，然 后通过热处理在N+源极区域下方的N-外延层中形成P型阱区域，接着对单胞阵列区域进 行第二次P型杂质离子注入在源极接触孔底部形成P+接触区域，使源极接触孔底部与P型阱的交界区具有更高的离子掺杂浓度； 第十六步.在第十五步后整个结构的上表面依次沉积金属钛粘结层和氮化钛阻挡层， 然后通过热处理使金属钛粘结层和氮化钛阻挡层在源极接触孔侧壁与N+源极区域形成N+ 源极欧姆接触，在源极接触孔侧壁和底部与P+接触区域形成P型阱的欧姆接触，在栅极接 触孔的侧壁和底部与栅极接触沟槽中的导电多晶硅形成欧姆接触； 第十七步.在第十六步后整个结构的上表面沉积上金属层；第十八步.对上金属层实施光刻，用光刻胶保护单胞阵列区域的源极金属电极区域和 单胞阵列区域外围的栅极金属电极区域，即定义源极金属电极区域和栅极金属电极区域图 形；第十九步.采用干法刻蚀方法，选择性去除未被光刻胶保护的上金属层，曝露出第二 介质层，去除光刻胶后，留下的位于单胞阵列区域的上金属层形成MOS管源极金属电极，留 下的位于单胞阵列区域外围的上金属层形成MOS管栅极金属电极；第二十步.在N+单晶硅衬底的底面沉积下金属层，该下金属层形成MOS管漏极金属电极。
6. 一种根据权利要求1所述三层光罩沟槽N型MOS器件的制造方法，其特征在于包括 下列工艺步骤第一步.在N型高掺杂浓度的N+单晶硅衬底上，生长N型低掺杂浓度的N-外延层； 第二步.对N-外延层进行P型杂质离子注入，P型杂质离子注入到N-外延层内，然后 通过热处理在N-外延层内形成P型阱区域；第三步.在N-外延层上表面生长第一介质层，该第一介质层为二氧化硅层，或者氮化 硅层，或者二氧化硅层和氮化硅层的复合层；第四步.对第一介质层实施光刻，定义出沟槽图形；第五步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第一介质层，曝露出沟槽 图形对应的N-外延层，而去除光刻胶后保留下来的第一介质层作为第一硬掩膜使用；第六步.以第一硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀曝露出N-外延层区域 的单晶硅，在N-外延层中形成沟槽，其中，位于单胞阵列区域的沟槽为栅极沟槽，而位于单 胞阵列区域外围的沟槽为栅极接触沟槽，而且栅极沟槽的槽宽小于栅极接触沟槽的槽宽； 第七步.采用湿法腐蚀方法，选择性去除第一硬掩膜； 第八步.在第七步后整个结构的上表面均勻生长二氧化硅层，作为栅氧化层； 第九步.在第八步后整个结构的上表面沉积N型高掺杂导电多晶硅层，N型高掺杂导 电多晶硅填满表面具有二氧化硅层的沟槽；第十步.对沉积的N型高掺杂导电多晶硅层实施干法刻蚀，去除整个结构上表面的N 型高掺杂导电多晶硅，直到沟槽中被填充的N型高掺杂导电多晶硅的顶面低于N-外延层顶 面为止，使沟槽的槽口形成凹陷，从而构成栅极导电多晶硅；第十一步.在第十步后整个结构的上表面均勻沉积第二介质层，该第二介质层为二氧 化硅层，或者氮化硅层，或者二氧化硅层和氮化硅层的复合层，由于沟槽的槽宽不同，具有 小槽宽的栅极沟槽的顶部凹陷中填满了第二介质层，而具有大槽宽的栅极接触沟槽的顶部 凹陷中的底部和侧壁覆盖有第二介质层，沟槽槽口仍然保持凹陷状态；第十二步.对第二介质层实施光刻，光刻胶掩膜覆盖栅极沟槽与栅极接触沟槽之间的第二介质层，曝露出单胞阵列区域和栅极接触沟槽区域；第十三步.采用干法刻蚀方法，选择性除去未被光刻胶保护的第二介质层，即栅极沟 槽之间的N-外延层顶部的第二介质层，以及栅极接触沟槽内导电多晶硅顶部的第二介质 层被除去，而栅极沟槽内的第二介质层得以保留，去除光刻胶后保留下来的第二介质层作 为第二硬掩膜使用；第十四步.以第二硬掩膜作为保护，对单胞阵列区域进行N型杂质离子注入，然后通过 热处理在N-外延层顶部形成N+源极区域；第十五步.以第二硬掩膜作为保护，采用干法刻蚀方法选择性刻蚀栅极接触沟槽顶部 曝露的导电多晶硅以及栅极沟槽之间曝露的N-外延层中的单晶硅，在栅极接触沟槽中形 成自对准的栅极接触孔，同时在栅极沟槽之间形成自对准的源极接触孔，栅极接触孔和源 极接触孔均为锥台形，上端开口直径大于底部直径，底部内角大于90度，源极接触孔的底 部伸入P型阱区域； 第十六步.以第二硬掩膜作为保护，对单胞阵列区域进行P型杂质离子注入在源极接 触孔底部形成P+接触区域，使源极接触孔底部与P型阱的交界区具有更高的离子掺杂浓 度；第十七步.在第十六步后整个结构的上表面依次沉积金属钛粘结层和氮化钛阻挡层， 然后通过热处理使金属钛粘结层和氮化钛阻挡层在源极接触孔侧壁与N+源极区域形成N+ 源极欧姆接触，在源极接触孔侧壁和底部与P+接触区域形成P型阱的欧姆接触，在栅极接 触孔的侧壁和底部与栅极接触沟槽中的导电多晶硅形成欧姆接触；第十八步.在第十七步后整个结构的上表面沉积上金属层；第十九步.对上金属层实施光刻，用光刻胶保护单胞阵列区域的源极金属电极区域和 单胞阵列区域外围的栅极金属电极区域，即定义源极金属电极区域和栅极金属电极区域图 形；第二十步.采用干法刻蚀方法，选择性去除未被光刻胶保护的上金属层，曝露出第二 介质层，去除光刻胶后，留下的位于单胞阵列区域的上金属层形成MOS管源极金属电极，留 下的位于单胞阵列区域外围的上金属层形成MOS管栅极金属电极；第二十一步.在N+单晶硅衬底的底面沉积下金属层，该下金属层形成MOS管漏极金属 电极。
7.根据权利要求4或5或6所述的制造方法，其特征在于所述上表面沉积上金属层 是先在整个结构的上表面沉积金属钨，金属钨填满栅极接触孔和源极接触孔，然后采用干 法刻蚀方法，选择性除去金属钨，使第二介质层顶部曝露出来，而栅极接触孔和源极接触孔 中依然填满钨，接着在整个结构上表面沉积铝层，或者掺杂有铜的铝层，或者掺杂有铜和硅 的铝层。
8.根据权利要求4或5或6所述的制造方法，其特征在于所述上表面沉积上金属层 是在整个结构的上表面沉积铝层，或者掺杂有铜的铝层，或者掺杂有铜和硅的铝层，并填 满栅极接触孔和源极接触孔。
9.根据权利要求4或5或6所述的制造方法，其特征在于在所述选择性去除第一硬 掩膜之后，以及生长二氧化硅层作为栅氧化层之前加入以下步骤在整个结构的上表面均勻生长用于增加沟槽底部栅氧化层厚度的辅助二氧化硅层；然后在整个结构的上表面涂布光刻胶实施光刻；接着采用干法刻蚀方法选择性刻蚀光刻胶， 在沟槽底部留存光刻胶；接着采用湿法腐蚀方法除去表面的辅助二氧化硅层，由于沟槽底 部留存光刻胶的阻挡，使沟槽底部依然保留有辅助二氧化硅层；最后去除光刻胶形成沟槽 底部用于加厚的辅助二氧化硅层。
10.根据权利要求4或5或6所述的制造方法，其特征在于在所述选择性去除第一硬 掩膜之后，以及生长二氧化硅层作为栅氧化层之前加入以下步骤在整个结构的上表面均勻生长用于制作沟槽底部导电多晶硅遮挡层的辅助二氧化硅 层；然后在整个结构的上表面沉积用于遮挡的导电多晶硅层，该导电多晶硅填满沟槽；接 着采用干法刻蚀方法选择性刻蚀导电多晶硅，只在沟槽底部保留导电多晶硅层；接着采用 湿法腐蚀方法除去整个结构表面的辅助二氧化硅层，由于保留导电多晶硅层的阻挡，沟槽 底部依然保留有辅助二氧化硅层，而保留导电多晶硅层作为沟槽底部增加的导电多晶硅遮 挡层。
全文摘要
一种三层光罩沟槽N型MOS器件及制造方法，在沟槽以及导电多晶硅制作完成后，本发明利用栅极沟槽与栅极接触沟槽之间的不同开口尺寸，通过沉积具有良好台阶覆盖能力的介质层，使栅极沟槽槽口和栅极接触沟槽槽口出现不同形貌，然后经过干法刻蚀制程，再辅助以光刻制程，可以实现在需要的区域保留介质层。该存留下来的介质层可以取代光刻胶掩膜，用作N+源极离子注入的掩膜以及P型阱离子注入的掩膜，还可以用来自对准的源极接触孔和自对准的栅极接触孔。本发明仅需三层光罩就可以制造出沟槽MOSFET器件。在制造工艺简单，成本低的同时，可以实现更高的单胞密度，即更好的性能。
文档编号H01L21/8234GK101866923SQ20101017509
公开日2010年10月20日 申请日期2010年5月18日 优先权日2010年5月18日
发明者刘伟, 王凡, 程义川 申请人:苏州硅能半导体科技股份有限公司