用于在软件无线电系统中使用的涡式译码器架构的制作方法

文档序号:7540013阅读:173来源:国知局
专利名称:用于在软件无线电系统中使用的涡式译码器架构的制作方法
用于在软件无线电系统中使用的涡式译码器架构
背景技术
Turbo (涡式)编码是一种功能强大的前向纠错(FEC)算法,其实现接 近于Shannon极限的编码增益。已经采用turbo编码器和turbo译码器,用于 在包括WCDMA、 CDMA2000、正EE-802.16e (即,WiBro )及其它的多个无 线标准的物理层中使用。这些标准以不同数据率运行,并且实现优化来用于 仅仅一个或两个特定标准的turbo编码器和turbo译码器。此外,大多数常规 的turbo编码器Af码器以相对低的数据率运行。
软件无线电(SDR)设备使用可重配置的硬件,该可重配置的硬件可被 无线编程以运行在不同的无线标准下。例如,无线膝上型计算机或PDA中的 SDR收发器可通过不同软件负载来配置,以运行在正EE-802.1 lx无线网络、 CDMA2000无线网络、OFDM/OFDMA无线网络、GSM无线网络或其他类型 的网络中。这些无线标准中的很多需要使用turbo译码器。
然而,常规的turbo译码器关于SDR应用具有明显的缺陷。如上所述, 常规的turbo译码器已经被优化用于在仅仅一个或两个特定标准下译码。如果 需要SDR设备支持许多无线标准,则必须在SDR设备中实现多于一个的turbo 译码器。这导致复杂的收发器设计,其低效率地利用芯片空间并且具有高功 耗。此外, 一些更新的无线标准以相对高的数据率运行(例如,WiBro、 HSPDA 等)。为低数据率标准在速度和功耗方面优化的turbo译码器不可能为高数据 率标准在速度和功耗方面优化,反之亦然。因此,常规的turbo译码器设计不 适合用于SDR应用。
因此,本领域需要一种用于在软件无线电(SDR)系统中使用的改进的 可重配置turbo译码器。

发明内容
提供了 一种可重配置turbo译码器。该可重配置turbo译码器包括N个处 理单元,其中N个处理单元的每个接收软输入数据采样,并且对接收的软输 入数据采样进行译码。该N个处理单元独立地运行,使得N个处理单元的第
一个可被选择来^^码接收的软输入数据采样,同时N个处理单元的第二个可
以被禁用。被选择来译码接收的软输入数据采样的N个处理单元的数量由接
收的软输入数据采样的数据率确定。
在一个实施例中,可重配置turbo译码器还包括存储接收的软输入数据 采样的N个输入数据存储器。N个处理单元的每个能够从N个输入数据存储 器的每一个读取数据并且将数据写入到N个输入数据存储器的每一个。
在另一实施例中,可重配置turbo译码器还包括存储由N个处理单元产 生的外部信息的N个外部信息存储器。N个处理单元的每个能够从N个外部 信息存储器的每一个读取外部信息,并且将外部信息写入到N个外部信息存 储器的每一个。
在开始下面的具体实施方式
之前,提出遍及该专利文献使用的某些词和 短语的定义可能是有利的术语"包括"和"包含"以及其派生,意味着包 含而没有限制;术语"或者"是包含性的,意味着和/或;短语"与……关联" 和"与其关联"以及其派生,可以意味着包括,被包括在内,互连,包含,
被包含在内,连接至或与其连接、耦接至或与其耦接、与其可通信、与其可 协作、交织、并列、近似于、限于、具有、具有……性质等;并且术语"控 制器,,意味控制至少一个操作的任何设备、系统或其部分,该设备可以以硬 件、固件或软件、或至少其两个的某些组合来实现。应注意,与任何特定的 控制器相关联的功能可以是集中式的或分布式的,本地地或是远程地。遍及 该专利文献提供某些词和短语的定义,本领域普通技术人员应当理解,在许 多(如果不是大多数)实例中,这样的定义应用到现有技术、以及这样定义 的词和短语将来的应用。


为了更完全地理解本公开内容及其优点,现在结合附图参考下面的描述, 附图中同样的参考标号表示同样的部件
图1是可以用于实现可重配置turbo译码器的CRISP设备的高层级框图; 图2是可重配置处理系统的高层级框图3是使用至少一个CRISP设备实现可重配置turbo译码器的多标准软 件无线电(SDR)系统的高层级框图4是根据本公开内容的原理、在CRISP中实现的可重配置turbo译码
器的框图5是图示根据本公开内容的原理、在可重配置turbo译码器CRISP中 的电源管理搡作的状态图。
具体实施例方式
在此专利文献中,下面讨论的图1到图5以及用于描述本公开内容的原 理的各种实施例仅是作为示例,并且不应以任何方式解释为限制本公开内容 的范围。本领域技术人员将理解,本公开内容的原理可以在任何合适安排的 处理系统中实现。
这里公开的可重配置turbo译码器提供了高度的并行化以支持高数据率 标准。WiBro的目标下行链^各速率是12 Mbps并且HSDPA实现达14.4 Mbps 的峰值数据率。此外,turbo译码器必须执行多次迭代(iteration)以实现最优 性能。公开的turbo译码器架构使用并行化来以高数据率实现必要的吞吐量。
可重配置turbo译码器支持多模式运行,用于在不同通信标准(包括 WCDMA、 CDMA2000、 IEEE-802.16e (即,WiBro)等)中进行译码。公开 的turbo译码器还提供可适配性以支持不同数据率。WiBro和WCDMA/HSDPA 以许多不同的数据率运行。公开的turbo译码器架构不仅为最大数据率优化, 而且为不同数据率范围优化。
可重配置turbo译码器还对不同标准和数据率最小化功耗,这是因为 turbo译码器可在手持设备中实现。最后,根据本公开内容的原理的可重配置 turbo译码器为终端用户提供灵活性。尽管设计旨在turbo译码,但是该架构 不需要严格的参数限制。因此,该设计提供了通用最大后验(MAP)译码器 平台,其允许终端用户基于终端用户需求选择参数和算法。
在本公开内容的一实施例中,这里描述的可重配置turbo "^奪码器可以利 用基于环境(context)的操作可重配置指令集处理器(CRISP)设备来实现。 CRISP设备在美国专利申请序列号11/123,313中详细描述,该申请通过上面 的引用并入。
图1是基于环境的操作可重配置指令集处理器(CRISP) 100的高层级框 图,其可用于实现turbo译码器。CRISP 100包括存储器110、可编程数据 路径电路120、可编程有限状态机130、以及可选程序存储器140。环境是一 组与特定功能或应用相关的数据处理器的指令,如turbo译码指令。如美国专利申请序列号11/123,313中描述的,CRISP 100以最优方式仅实现环境相关 的指令的子集合。
基于环境的操作可重配置指令集处理器(CRISP) 100定义了通常包括更 高层的硬件处理器块的通用硬件块。CRISP 100的主要优点在于CRISP 100 将需要的应用划分成两个主要的域,控制域和数据路径域,并且分别优化每 个域。通过执行CRISP 100中的turbo译码,公开的turbo译码器减少了与影 响常规的turbo译码器的灵活性和功耗相关的问题。
控制域通过可编程有限状态机130实现,其可包括DSP、 MCU或另一 现有技术设备。通过从外部控制器(未示出)接收的重配置位来配置可编程 FSM 130。可编程FSM 130可执行存储在相关联的可选程序存储器140中的 程序。该程序可经由来自外部控制器(未示出)的数据线存储在程序存储器 140中。存储器110用于存储由数据路径电路120使用的应用数据。
可编程数据路径120被划分成执行特定功能的若干组构造块(例如,寄 存器、多路复用器、乘法器等)。每个构造块是可重配置并且可编程的,从而 允许最大的灵活性。将可编程数据路径电路120划分成各功能块取决于对于 特定应用需要的可重配置性和可编程性的级别。
由于不同环境由独立于其他CRISP设备工作的分别的CRISP设备实现, 所以使用一个或多个CRISP设备实现turbo译码器提供了有效的电源管理方 案,其能够在不需要CRISP时关闭CRISP。这确保了在给定时间仅仅需要的 CRISP是活动的,而其他空闲的CRISP不消耗显著的功率。
图2是根据本公开内容一实施例的可重配置处理系统200的高层级框图。 可重配置处理系统200包括N个基于环境的操作可重配置指令集处理器 (CRISP ),包括示例性CRISP 100a、 100b以及100c,其任意标记为CRISP 1、 CRISP 2以及CRISP N。可重配置处理系统200还包括实时序列发生器210、 序列程序存储器220、可编程互连构造230、以及緩沖器240和245.
各可重配置位可从控制线经由实时序列发生器210和緩冲器240加载到 CRISP 100a、 100b以及100c中。控制程序还可从控制线经由緩冲器240加载 到序列程序存储器220中。实时序列发生器210通过从程序存储器220取出 程序指令并且将各可重配置位发送到CRISP lOOa-c,将要由CRISP lOOa-c的 每个执行的环境排序。在示例性实施例中,实时序列发生器210可包括堆栈 处理器,该堆栈处理器由于其低延迟和简单适于作为实时调度器运行。
可重配置互连构造230经由双向緩冲器245,提供CRISP lOOa-c的每一 个和外部数据总线之间的连接性。在本公开内容的示例性实施例中,CRISP lOOa-c的每一个可以运行为可重配置互连构造230的主机(master)并且可发 起地址访问。可重配置互连构造230的总线辨别器(arbiter)可以在实时序列 发生器210的内部。
在示例性实施例中,可重配置处理系统200可以是例如蜂窝电话或类似 的无线设备、或者是用于膝上型计算机中使用的数据处理器。在基于软件无 线电(SDR)架构的无线设备实施例中,CRISP lOOa-c的每一个负责执行与 特定可重配置功能相关联的环境相关的指令的子集。例如,CRISP 100a可以 被配置来执行环境相关的指令,其处理CDMA基带信号或OFDMA基带信号。 CRISP 100b可以被配置为执行环境相关的指令,其运行为存储器控制器。 CRISP 100c可以被配置为执行环境相关的指令,其执行turbo译码或Viterbi 译码。
由于CRISP设备很大程度上是独立的并且可以同时运行,所以使用 一个 或更多CRISP设备实现的turbo译码器具有并行化的性能优点,而不导致与 运行的并行操作相关联的完全的功率损失。CRISP设备之间的松散耦合和独 立性允许它们被配置用于可分别关闭的不同系统和功能。
图3是多标准软件无线电(SDR)系统300的高层级框图,其使用CRISP 设备实现可重配置turbo译码器。SDR系统300可包括访问无线网络的无线 终端(或移动站、订户站等),如例如GSM或CDMA蜂窝电话、具有WCDMA、 IEEE-802.11x、 OFDM/OFDMA功能的PDA等。
多标准SDR系统300包括基带子系统301、应用子系统302、存储器 接口 (IF)以及外围子系统365、主控制单元(MCU) 370、存储器375、以 及互连380。 MCU 370可以包括例如常规的微控制器或微处理器(例如,x86、 ARM、 RISC、 DSP等)。存储器IF和外围子系统365可将SDR系统300连 接到外部存储器(未示出)和外部外围设备(未示出)。存储器375存储来自 SDR系统300中其他组件以及来自外部设备(未示出)的数据。例如,存储 器375可存储与下变频信号相关联的进入的数据采样流,该下转换信号由与 SDR系统300相关联的射频(RF )收发器398和天线399产生。互连380运 行为提供子系统301和302、存储器IF和外围子系统365、 MCU 370以及存 储器375之间的数据传输的系统总线。
基带子系统301包括实时(RT)序列发生器305、存储器310、基带 DSP子系统315、互连325、以及多个专用基于环境的操作指令集处理器 (CRISP ),包括变换CRISP 100d、芯片率CRISP 100e、 CRISP 100f中的turbo 译码器、以及位处理单元(BMU) CRISP 100g。作为实例,变换CRISP 100d 可实现快速傅立叶变换(FFT)功能、芯片率CRISP 100e可实现CDMA信号 的相关功能,并且CRISP 100f中的turbo译码器可实现turbo译码器功能或 Viterbi译码器功能。在这样的示例性实施例中,变换CRISP 100d可接收存储 在存储器375中的中频(IF)信号的采样,并且执行以基带率产生芯片采样 序列的FFT功能。接下来,芯片率CRISP 100e从变换CRISP 100d接收芯片 采样,并且执行产生数据码元序列的相关功能。接下来,CRISP 100f中的turbo 译码器从芯片率CRISP 100e接收码元数据,并且执行turbo译码或Viterbi译 码以恢复基带用户数据。基带用户数据接着可由应用子系统302使用。
在本公开内容的示例性实施例中,CRISP 100f中的turbo i奪码器可包括 并行运行的两个或更多个CRISP。此外,作为实例,BMU CRISP 100g可实 现如可变长度编码、循环冗余校验(CRC)、巻积编码等功能。互连325运行 为提供RT序列发生器305、存储器310、基带DSP子系统315以及CRISP 100d-100g之间的数据传输的系统总线。
应用子系统302包括实时(RT)序列发生器330、存储器335、多媒 体DSP子系统340、互连345以及多媒体宏CRISP 350。多媒体宏CRISP350 包括多个专用基于环境的操作指令集处理器,包括MPEG-4/H.264 CRISP 100h、变换CRISP 100i、以及BMU CRISP 100j。在本公开内容的示例性实施 例中,MPEG-4/H.264 CRISP 100h执行运动估计功能,并且变换CRISP 100d 执行离散余弦变换(DCT)功能。互连380提供RT序列发生器330、存储器 335、多媒体DSP子系统340、以及多媒体宏CRISP350之间的数据传输。
在图3的实施例中,CRISP设备的使用使得多标准SDR系统300的应用 子系统302能够重配置来支持具有多简档和大小的多个视频标准。此外, CRISP设备的使用使得多标准SDR系统300的基带子系统301能够重配置来 支持多个空中接口标准。因此,SDR系统300能够运行在不同类型的无线网 络(例如CDMA、 GSM、 802.11x等)中,并且能够执行不同类型的视频和 音频格式。然而,使用根据本公开内容的原理的CRISP使得SDR系统300 能够用比具有可比较功能的常规无线设备低得多的功耗来执行这些功能。
图4是根据本公开内容原理的CRISP ]OOf中的turbo译码器中实现的可 重配置turbo译码器的框图。turbo译码器CRISP 100f包括程序存储器405、 配置寄存器文件410、地址产生器415、通信开关420、处理单元430a-430d、 输入数据存^渚器440a-440d、外部信息存储器445a-445d、以及内部总线490。 处理单元430a-430d的每一个包括控制状态机(SM )、最大后验概率(MAP ) 数据路径、高速緩沖存储器、以及控制寄存器文件。作为实例,处理单元430 包括控制状态机431a、 MAP数据路径432a、高速缓冲存储器433a、以及 控制寄存器文件434a。尽管在图4中示出了四个处理单元430,但是这只是 作为实例。turbo译码器CRISP 100f的其他实施例可以实现少于四个处理单元 430或多于四个处理单元430。
通用MAP turbo译码器架构通常包括两个主要功能块i)软输入、软输 出(SISO)级,其实现后验概率(APP)算法;以及ii)交织器/解交织器, 其根据交织规则加扰数据,其后面是发送设备中的编码器。译码器的实现需 要其他块,如RAM (随机存取存储器),用于存储来自译码器的每次迭代的 数据。
turbo译码器CRISP 100f包括常规MAP turbo译码器的所有构造块。在 示例性实施例中,MAP数据路径432a-432d实现滑动窗口 MAP算法。然而, turbo译码器CRISP 100f的替代实施例可实现非滑动窗口 MAP算法。
众所周知,常规的turbo编码器使用两个构成的编码器。第一编码器接 收原始比特流并且产生第一奇偶比特流。第二编码器接收原始比特流的交织 副本并且产生第二奇偶比特流。由turbo编码器发送的数据包括原始比特流、 来自第 一编码器的第 一奇偶位、以及来自第二编码器的第二奇偶位。
常规的turbo译码器包括两个以迭代方式运行的译码器块。第一译码器 块从对应于原始数据位解调器的解调器接收数据采样(软值),并且从第一编 码器接收第 一奇偶位。第一译码器块使用原始数据位和第 一奇偶位来估计每 个原始数据位的值为为1或0的概率。第二译码器块从对应于交织的原始数 据位解调器接收数据采样(软值),从第二编码器接收第二奇偶位,并且从第 一译码器块接收概率估计值解调器。由两个译码器块译码的过程包括turbo 译码器的一次迭代。常规的turbo译码器可执行固定数量的迭代,或者可执行
(BER)为止。然后对最后的软输出进行硬判决,以确定原始数据位。
众所周知,MAP算法是类似于Viterbi算法的网格译码算法。两个译码 器块中的MAP算法对软输入(即,解调器输出和概率估计)操作并且产生软 输出。由一个译码器块为一次迭代执行的MAP算法的计算可以总结如下。在 第一步骤中,常规的MAP算法对网格的所有分支计算并存储被称为gamma (或Y )值的分支测量值。该分支测量值等于硬编码器值与来自解调器的软接 收值之间的距离的相反数的指数函数除以信道噪声变量再乘以来自先前译码 器的概率估计值。
在第二步骤中,常规的MAP算法对网格执行前向递归。前向递归对网 格中的每个节点计算alpha (或a)值。a值是下面的和i)先前的a值乘以 沿来自先前节点的一条分支的分支测量值;以及ii)先前的a值乘以沿来自 先前节点的另一条分支的分支测量值。在第三步骤中,常规的MAP算法对网 格执行后向递归。后向递归对网格中的每个节点计算beta (或卩)值。卩值以 类似于a值的方式计算,除非后向递归在网格的结束开始并且以相反的方向 进展。
在第四步骤中,常规的MAP算法对每个时刻t计算对数似然比率(LLR 或X)值。该值是在与编码器中的l值相关联的时刻t每个分支a、卩与X值 的乘积的和除以在与编码器中的0值相关联的时刻t每个分支a、卩与X值的 乘积的和。最后,常规的MAP算法计算要在迭代序列中发送到下一译码器的 外部信息。外部信息是LLR值减去输入概率估计值。
上述的计算由两个译码器块的每个在每次迭代中重复。在计算所有迭代 后,译码的信息位可以通过检查LLR值的符号位来检测。如果LLR值是正 的,则数据位为1。如果LLR值是负的,则数据位为0。作为替代,LLR值 可以被输出到对每个数据位进行判断的外部设备。
在turbo译码器CRISP 100f中,上述的计算由MAP数据路径432a、432b、 432c以及432d执行。a、 (3和人的值暂时存储在高速緩冲存储器433a、 433b、 433c、以及433d中。来自每个译码块的每次迭代的外部信息经由通信开关420 存储在外部信息存储器445a、 445b、 445c和445d中。
在示例性实施例中,MCU 370将配置程序和配置数据经由外部系统总线 (即,互连325 )加载到turbo译码器CRISP 100f中。配置程序被存储在程序 存储器405中。MCU 370将配置数据加载到配置寄存器文件410和控制寄存 器文件434a-434d中,以便初始化寄存器文件。配置寄存器文件410和控制
寄存器文件434a-434d被用于控制在应用中使用处理单元430a-430d、输入数 据存储器440a-440d、以及外部信息存储器445a-445d中的哪个。配置寄存器 文件410将使能(EN)信号提供给控制处理单元430、输入数据存储器440、 以及外部信息存储器445。turbo译码器CRISP 100f经由系统总线(即互连325 ) 读取输入数据采样并且写入译码的输出数据。
为了实现高译码率,turbo译码器CRISP 100f实现N个并行处理单元 430a-430d。在该实例中,N=4。处理单元430a-430d是独立的并且彼此相同。 处理单元430a-430d的每一个能够经由通信开关420,连接到输入数据存储器 440a-440d的每一个以及外部信息存储器445a-445d。对于较高的凄t据率标准, 所有处理单元430a-430d可以同时并且并行运行。对于较低的凄t据率标准, 一个或多个处理单元430a-430d可以被设置为休眠模式(即去激活或禁用) 以便减少功耗。
如上所述,处理单元430a-430d的每一个包括控制状态机431、 MAP 数据路径432、高速緩冲存储器433以及控制寄存器文件434。在turbo译码 器CRISP 100f的示例性实施例中,每个处理单元430 —次处理两个软输入凄t 据采样。两个软输入数据采样对应两个数据码元。在示例性实施例中,每个 软输入数据采样可包括8位。
MAP数据路径432对网格执行前向和后向递归两者。在前向递归中,必 须访问输入码元和外部信息两者以计算分支测量值y。为了减少存储器访问功 耗,可将y值计算并存储在每个处理单元430中的高速緩冲存储器433中。 如果a、 p和X的值没有被同时计算,则a值还可以被存储在高速緩沖存储器 430中以减少数据移动和功耗。
MAP数据路径432可并行或以相继(或顺序)的顺序计算a、 (3和X。 并行执行较快,但是需要更多管芯(die)空间和功耗。相继执行导致较长的 延迟,但是需要较少的管芯空间和较少的功耗。在示例性实施例中,MAP 数据路径430a-430d的每个顺序计算a、 (3和X。
控制状态机431对来自经由内部总线4卯接收的程序存储器的指令进行 译码,并且控制处理单元430的整体操作和配置。由于turbo译码器CRISP 100f 可以计算大指令循环,所以控制状态机431可使用硬件循环以减少开销和功 耗。
turbo译码器CRISP 100f中存在八个存储器块四个输入数据存储器440,
其保持输入数据(或码元)采样;以及四个外部信息存储器445,其保持在 turbo译码器的每次迭代中产生的外部信息。将八个存储器块划分为四组。每 个存储器组包括一个输入数据存储器440和一个外部信息存储器445。作为 实例,输入数据存储器440a和外部信息存储器445a形成第一存储器组,输 入数据存储器440b和外部信息存储器445b形成第二存储器组,等等。
处理单元430a-430d的每一个一次读写到 一个存储器组。处理单元 430a-430d的每一个能够写入到存储器组的每一个。因此,没有存储器组被专 用于特定的处理单元430。例如,处理单元430a可在一个存储器循环期间通 过通信开关420连接到第一存储器组(例如,存储器440a和445a),并且可 在另一个存储器循环期间从另一个存储器组(例如,存储器440c和445c )读 取数据并且将数据写入该另 一个存储器组。
通信开关420动态地控制处理单元430a-430d以及由存储器440a-440d 和存储器445a-445d组成的存储器组之间的连接。连接顺序或模式通过地址 产生器415的操作确定。在本公开内容的一个实施例中,地址产生器415可 以由存储器实现。在这样的实施例中,外部控制DSP/MCU (如MCU 370 ) 离线预计算turbo译码器的交织器模式,并且在初始化阶段期间将交织器模式 写入到地址产生器415的存储器。在本公开内容的另一个实施例中,地址产 生器415可被指定来实时产生交织器模式。
图5描述状态图500,其图示根据本公开内容的原理的turbo译码器 CRISP 100f中的电源管理操作。在示例性实施例中,turbo译码器CRISP 100f 在MCU370的控制下在多个电源管理模式下运行,即关闭模式510、唤醒模 式520、空闲模式530、休眠模式540和活动模式550。在替代实施例中,turbo 译码器CRISP 100f可以在基带DSP子系统315的控制下在不同电源管理模式 下运行。
在关闭才莫式510中,turbo "^奪码器CRISP 100f完全关闭并且所有时钟关 闭。在唤醒模式520中,加载程序存储器405并且配置配置寄存器文件410 和控制寄存器文件434。然而,时钟信号仅连接到程序存储器405、寄存器文 件410和434、以及相关电路。在空闲模式530中,将时钟信号提供到处理 单元430a-430d,并且开启一些存储器组使得存储器组可接收输入数据采样。 在休眠模式550中,选通提供给处理单元430a-430d、地址产生器415以及一 些存储器组的时钟信号。在活动模式550中,turbo译码器CRISP 100f正常运行。在活动模式550中,使用的唯一的电源管理技术是运行时钟频率的缩放。 在系统重置时,turbo译码器CRISP 100f处于关闭模式510中。一旦MCU 370将配置程序和数据加载到程序存储器405、配置寄存器文件410、和/或控 制寄存器文件434a-434d中,turbo译码器CRISP 100f的状态就改变为唤醒模 式520,在该点仅仅激活程序存储器405、配置寄存器文件410、和/或控制寄 存器文件434a-434d以及相关电路。
一旦turbo译码器CRISP 100f结束一帧数据的处理,就将其设置为空闲 模式530。在空闲模式530中,turbo译码器CRISP 100f可以从外部总线(即, 互连325 )接收输入数据采样。 一旦输入数据完全加载到输入数据存储器 440a-440d中,turbo译码器CRISP 100f就重新进入活动冲莫式550并且继续处 理。
如果处理单元430、输入数据存储器440a-440d以及外部信息存储器 445a-445d中的一些不使用,则那些组件的时钟信号可以被关闭以将那些组件 置于休眠模式540中。使用中的处理单元430、输入数据存储器440a-440d、 以及外部信息存储器445a-445d仍然处于活动模式550中。该方案降低了功 率。如果处理单元在使用中,但是一段时间没有指令执行,则可以将NOP指 令手动或自动地插入。NOP指令仅激活最小量的硬件。这也减少了当处理单 元处于活动模式550中时的功耗。
尽管已经用示例性实施例描述了本公开内容,但是对本领域技术人员可 以建议各种变化和修改。本发明意图包括落入权利要求书的范围中的变化和 更改。
权利要求
1.一种可重配置turbo译码器,包括N个处理单元,该N个处理单元的每个能够接收软输入数据采样并且对接收的软输入数据采样进行译码,其中该N个处理单元独立地运行,使得N个处理单元的第一个可以被选择来对接收的软输入数据采样进行译码,同时N个处理单元的第二个可以被禁用。
2. 如权利要求1所述的可重配置turbo译码器,其中被选择来对接收的 软输入数据采样进行译码的N个处理单元的数量由接收的软输入数据采样的 数据率确定。
3. 如权利要求1所述的可重配置turbo译码器,还包括N个输入数据存 储器,其能够存储接收的软输入数据采样,其中该N个处理单元的每个能够 从N个输入数据存储器的每个读取数据,并且将数据写入到N个输入数据存 储器的每个。
4. 如权利要求3所述的可重配置turbo译码器,其中该N个输入数据存 储器独立地运行,使得该N个输入数据存储器的第一个可以被选择来存储至 少一些接收的软输入数据采样,同时N个输入数据存储器的第二个可以被禁 用。
5. 如权利要求4所述的可重配置turbo译码器,其中被选择来存储至少 一些接收的软输入数据采样的N个输入数据存储器的数量,由接收的软输入 数据采样的数据率确定。
6. 如权利要求3所述的可重配置turbo译码器,还包括N个外部信息存 储器,其能够存储由N个处理单元产生的外部信息,其中该N个处理单元的 每个能够从N个外部信息存储器的每个读取外部信息,并且将外部信息写入 到N个外部信息存储器的每个。
7. 如权利要求6所述的可重配置turbo译码器,其中该N个外部信息存 储器独立地运行,使得N个外部信息存储器的第一个可以被选择来存储由N 个处理单元产生的至少一些外部信息,同时N个外部信息存储器的第二个可 以被禁用。
8. 如权利要求7所述的可重配置turbo译码器,其中被选择来存储由N 个处理单元产生的至少一些外部信息的N个外部信息存储器的数量,由接收 的软输入数据釆样的数据率来确定。
9. 如权利要求6所述的可重配置turbo译码器,其中N个处理单元通过 通信开关耦接到N个输入数据存储器和N个外部信息存储器。
10. —种软件无线电SDR系统,其能够在多个无线通信标准下运行,该 SDR系统包括射频RF收发器,其能够接收进入的RF信号并产生下变频的信号;以及 可重配置turbo译码器,其能够接收与下变频的信号相关联的软输入数据釆样,该可重配置turbo译码器包括-.N个处理单元,该N个处理单元的每个能够接收软输入数据采样并且对接收的软输入数据采样进行译码,其中该N个处理单元独立地运行,使得N个处理单元的第 一个可以被选择来对接收的软输入数据采样进行译码,同时N个处理单元的第二个可以被禁用。
11. 如权利要求10所述的软件无线电SDR系统,其中被选择来对接收 的软输入数据采样进行译码的N个处理单元的数量由接收的软输入数据采样 的数据率确定。
12. 如权利要求10所述的软件无线电SDR系统,其中该可重配置turbo 译码器还包括N个输入数据存储器,其能够存储接收的软输入数据采样,其 中该N个处理单元的每个能够从N个输入数据存储器的每个读取数据,并且 将数据写入到N个输入数据存储器的每个。
13. 如权利要求12所述的软件无线电SDR系统,其中该N个输入数据 存储器独立地运行,使得N个输入数据存储器的第一个可以被选择来存储至 少一些接收的软输入数据采样,同时N个输入数据存储器的第二个可以被禁 用。
14. 如权利要求13所述的软件无线电SDR系统,其中被选择来存储至 少一些接收的软输入数据采样的N个输入数据存储器的数量由接收的软输入 数据采样的数据率确定。
15. 如权利要求12所述的软件无线电SDR系统,其中可重配置turbo 译码器还包括N个外部信息存储器,其能够存储由N个处理单元产生的外部 信息,其中该N个处理单元的每个能够从N个外部信息存储器的每个读取外 部信息,并且将外部信息写入到N个外部信息存储器的每个。
16. 如权利要求15所述的软件无线电SDR系统,其中该N个外部信息存储器独立地运行,使得该N个外部信息存储器的第一个可以被选择来存储由N个处理单元产生的至少一些外部信息,同时N个外部信息存储器的第二 个可以被禁用。
17. 如权利要求16所述的软件无线电SDR系统,其中被选择来存储由 N个处理单元产生的至少一些外部信息的N个外部信息存储器的数量由接收 的软输入数据采样的数据率确定。
18. 如^l利要求17所述的软件无线电SDR系统,其中该N个处理单元 通过通信开关耦接到N个输入数据存储器和N个外部信息存储器。
19. 一种运行可重配置turbo译码器的方法,该可重配置turbo译码器包 括能够对接收的软输入数据采样进行译码的N个独立的处理单元,该方法包 括下列步骤选择N个输入单元的至少一个来接收软输入数据采样; 在选择的至少一个处理单元中,译码至少一些接收的软输入数据采样;以及禁用该N个处理单元的至少一个,同时被选择的至少一个处理单元对接 收的软输入数据采样进行译码。
20. 如权利要求19所述的运行可重配置turbo译码器的方法,其中被选 择来对接收的软输入数据采样进行译码的N个处理单元的数量由接收的软输 入数据采样的数据率确定。
21. 如权利要求19所述的运行可重配置turbo译码器的方法,还包括将 接收的软输入数据采样存储在N个输入数据存储器中的步骤,其中N个处理 单元的每个能够从N个输入数据存储器的每个读取数据,并且将数据写入到 N个输入数据存储器的每个。
22. 如权利要求21所述的运行可重配置turbo译码器的方法,该N个输 入数据存储器独立地运行,使得N个输入数据存储器的第一个可以被选择来 存储至少一些接收的软输入数据采样,同时N个输入数据存储器的第二个可 以被禁用。
23. 如权利要求22所述的运行可重配置turbo译码器的方法,其中被选 择来存储至少一些接收的软输入数据采样的N个输入数据存储器的数量由接 收的软输入数据采样的数据率来确定。
24. 如权利要求21所述的运行可重配置turbo译码器的方法,还包括将 由N个处理单元产生的外部信息存储在N个外部信息存储器中的步骤,其中 该N个处理单元的每个能够从N个外部信息存储器读取外部信息,并且将外 部信息写入到N个外部信息存储器的每个。
25. 如权利要求24所述的运行可重配置turbo译码器的方法,其中该N 个外部信息存储器独立地运行,使得N个外部信息存储器的第一个可以被选 择来存储由N个处理单元产生的至少一些外部信息,同时N个外部信息存储 器的第二个可以被禁用。
26. 如权利要求25所述的运行可重配置turbo译码器的方法,其中被选 择来存储由N个处理单元产生的至少一些外部信息的N个外部信息存储器的 数量由接收的软输入数据采样的数据率确定。
27. 如权利要求24所述的运行可重配置turbo译码器的方法,其中该N 个处理单元通过通信开关被耦接到N个输入数据存储器和N个外部信息存储 器。
全文摘要
一种包括N个处理单元的可重配置turbo译码器。该N个处理单元的每个接收软输入数据采样,并且对接收的软输入数据采样进行译码。该N个处理单元独立地运行,使得第一处理单元可以被选择来对接收的软输入数据采样进行译码,同时第二处理单元可以被禁用。被选择来对软输入数据采样进行译码的处理单元的数量由接收的软输入数据采样的数据率确定。可重配置turbo译码器还包括N个输入数据存储器,其存储接收的软输入数据采样;以及N个外部信息存储器,其存储由N个处理单元产生的外部信息。该N个处理单元的每个能够从N个输入数据存储器的每个和N个外部信息存储器的每个读取并向N个输入数据存储器的每个和N个外部信息存储器的每个写入。
文档编号H03M13/37GK101180800SQ200680017383
公开日2008年5月14日 申请日期2006年5月18日 优先权日2005年5月18日
发明者伊兰·皮塞克, 彦 王, 贾斯明·奥兹 申请人:三星电子株式会社
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