专利名称：信号输入电路及具有该电路的半导体装置的制作方法
技术领域：
本发明涉及半导体装置中包括的信号输入电路。
技术背景
与装置的输入单元相连的信号输入电路可以根据需求以差分输入电路或单端输 入电路来实现。单端输入电路是指仅通过电子电路中一对端口的一端来施加输入信号或输 出输出信号的电路结构。差分输入电路的电路结构为通过一对端口的两端来施加输入信号 或输出输出信号。差分输入电路可以被设计为具有放大并输出两个互补信号之间的电压差 的方案，或者具有放大并输出输入信号与参考信号之差的方案。
根据用于传输数据信号的电路的传输方案，应当以差分输入信号和单端输入电路 之一来配置信号输入电路。如果信号输入电路被设计为接收差分信号和单一信号，那么信 号输入电路的应用范围可以变得更大。发明内容
本公开提供了一种信号输入电路，该信号输入电路具有简单的电路配置，并能够 接收差分信号和单一信号。
根据一个方面，本发明针对一种信号输入电路，包括输入单元，接收第一输入信 号，以向输出节点输出输出信号；第一补偿电路，连接至输出节点，响应于第二输入信号而 对输出节点放电；第二补偿电路，连接至输出节点，响应于第二输入信号而向输出节点提供 电流；以及使能电路，响应于至少一个工作模式选择信号来使能输入单元以及第一和第二 补偿电路。
在一些实施例中，输入单元可以包括PM0S晶体管，连接在电源电压端子与输出 节点之间，并由第一输入信号控制；以及NMOS晶体管，连接在输出节点与使能电路之间，并 由第一输入信号控制。
在一些实施例中，第一补偿电路可以包括PM0S晶体管，连接在电源电压端子与 第一节点之间，并由第二输入信号控制；第一 NMOS晶体管，连接在第一节点与使能电路之 间，并由第一节点的信号控制；以及第二 NMOS晶体管，连接在输出节点与使能电路之间，并 由第一节点的信号控制。
在一些实施例中，第二补偿电路可以包括第一 PMOS晶体管，连接在电源电压端 子与输出节点之间，并由第二节点的信号控制；第二 PMOS晶体管，连接在电源电压端子与 第二节点之间，并由第二节点的信号控制；以及NMOS晶体管，连接在第二节点与使能电路 之间，并由第二输入信号控制。
在一些实施例中，第一和第二输入信号可以彼此反相。
在一些实施例中，使能电路可以接收第一和第二工作模式选择信号，响应于第一 工作模式选择信号而使能第一和第二补偿电路，以及响应于第二工作模式选择信号而使能 输入单元。
根据另一方面，本发明针对一种信号输入电路，包括输入单元，接收第一输入信 号，以向输出节点输出输出信号；第一补偿电路，连接至输出节点，响应于第二输入信号而 对输出节点放电；第二补偿电路，连接至输出节点，响应于第二输入信号而向输出节点提供 电流；以及开关电路，分别通过第一至第三连接节点连接至输入单元、第一补偿电路和第二 补偿电路，响应于至少一个工作模式选择信号将第一至第三连接节点连接至地电压端子。
在一些实施例中，输入单元包括PM0S晶体管，连接在电源电压端子与输出节点 之间，并由第一输入信号控制；以及NMOS晶体管，连接在输出节点和开关电路之间，并由第 一输入信号控制。
在一些实施例中，第一补偿电路包括PM0S晶体管，连接在电源电压端子与第一 节点之间，并由第二输入信号控制；第一 NMOS晶体管，连接在第一节点与开关电路的第一 连接节点之间，并由第一节点的信号控制；以及第二 NMOS晶体管，连接在输出节点与开关 电路的第一连接节点之间，并由第一节点的信号控制。
在一些实施例中，第二补偿电路包括第一 PMOS晶体管，连接在电源电压端子与 输出节点之间，并由第二节点的信号控制；第二 PMOS晶体管，连接在电源电压端子与第二 节点之间，并由第二节点的信号控制；以及NMOS晶体管，连接在第二节点与开关电路的第 二连接节点之间，并由第二输入信号控制。
在一些实施例中，第一和第二输入信号彼此反相。
在一些实施例中，开关电路接收第一和第二工作模式选择信号，响应于第二工作 模式选择信号将分别与第一和第二补偿电路相连的第二和第三连接节点连接至地电压端 子，并将与输入单元相连的第一连接节点连接至地电压端子。
在一些实施例中，开关电路包括第一 NMOS晶体管，连接在地电压端子与连接至 输入单元的第一连接节点之间，并由第一工作模式选择信号控制；第二 NMOS晶体管，连接 在地电压端子与连接至第一补偿电路的第二连接节点之间，并由第二工作模式选择信号控 制；以及第三NMOS晶体管，连接在地电压端子与连接至第二补偿电路的第三连接节点之 间，并由第二工作模式选择信号控制。
根据另一方面，本发明针对一种信号输入电路，包括PM0S晶体管，连接在电源 电压端子与输出节点之间，并由第一输入信号控制；NMOS晶体管，连接在输出节点与开关 电路之间，并由第一输入信号控制；第一补偿电路，连接至输出节点，响应于第二输入信号 补偿PMOS晶体管的工作延迟；第二补偿电路，连接至输出节点，响应于第二输入信号补偿 NMOS晶体管的工作延迟；以及使能电路，响应于至少一个工作模式选择信号，使能PMOS晶 体管、NMOS晶体管以及第一和第二补偿电路。
在一些实施例中，第一和第二输入信号可以彼此反相。
在一些实施例中，在第二输入信号具有第一电平时第一补偿电路对输出节点放 电，在第二输入信号具有第二电平时第二补偿电路向输出节点提供电流。
根据另一方面，本发明针对一种半导体装置，包括第一电路；和第二电路，接收来自第一电路的数据信号，并包括用于接收来自第一电路的数据信号的信号输入电路，其 中，信号输入电路包括输入单元，接收第一输入信号，以向输出节点输出输出信号；第一 补偿电路，连接至输出节点，响应于第二输入信号而对输出节点放电；第二补偿电路，连接 至输出节点，响应于第二输入信号而向输出节点提供电流；以及使能电路，响应于至少一个 工作模式选择信号来使能输入单元以及第一和第二补偿电路。
在一些实施例中，第一和第二输入信号彼此反相，以及使能电路接收第一和第二 工作模式选择信号，响应于第一工作模式选择信号而使能第一和第二补偿电路，响应于第 二工作模式选择信号而使能输入单元。
在一些实施例中，第一补偿电路包括PM0S晶体管，连接在电源电压端子与第一 节点之间，并由第二输入信号控制；第一 NMOS晶体管，连接在第一节点与开关电路的第一 连接节点之间，并由第一节点的信号控制；以及第二 NMOS晶体管，连接在输出节点与开关 电路的第一连接节点之间，并由第一节点的信号控制。第二补偿电路包括第一 PMOS晶体 管，连接在电源电压端子与输出节点之间，并由第二节点的信号控制；第二 PMOS晶体管，连 接在电源电压端子与第二节点之间，并由第二节点的信号控制；以及NMOS晶体管，连接在 第二节点与开关电路的第二连接节点之间，并由第二输入信号控制。
附图旨在提供对本发明的进一步理解，并且结合在本说明书中构成本说明书的一 部分。附示了本发明的示例性实施例，并且与说明书一起用来描述本发明。
图1是示出了根据本发明实施例的信号传输系统的图。
图2是示出了根据本发明实施例的存储器系统的方框图。
图3是示出了根据本发明实施例、可以包括在图1的接收装置以及图2的控制器 中的信号输入装置的配置的图。
图4A和4B是输入到图3的信号输入电路中的第一和第二输入信号的图。
图5是示出了根据本发明另一实施例的信号输入电路的图。
图6A和6B是示出了当由于半导体制造工艺中的误差而使得图5中输入单元的 PMOS晶体管和NMOS晶体管的响应时间彼此不同时，输出信号根据输入信号而改变的图。
图7A和7B是示出了当由于周围环境而使得图5中输入单元的PMOS晶体管和NMOS 晶体管的响应时间彼此不同时，输出信号根据输入信号而改变的图。
具体实施方式
以下将参照附图更为详细地描述本发明的示例性实施例。但是，本发明可以按照 不同形式来实施，并且不应解释为受限于在此所述的实施例。事实上，提供这些实施例来使 得本说明书变得充分和完整，并向本领域技术人员充分传达本发明的思想。
后文，将参照附图详细描述本发明的示例性实施例。
图1是示出了根据本发明实施例的信号传输系统的图。
参照图1，根据本发明实施例的信号传输系统100包括发送装置110和接收装置 120。从发送装置110发送至接收装置120的信号可以是差分信号或者单一或单端信号。当 从发送装置110发送至接收装置120的信号为差分信号时，接收装置120接收从发送装置6110发送的一对发送信号，读出这对发送信号之间的电压差，并工作于伪差分输入模式或差 分输入模式以恢复接收的信号。当从发送装置110发送至接收装置120的信号为单一信号 时，接收装置120工作于单一输入模式，以将从发送装置110发送的发送信号恢复为接收信 号。这样，接收装置120包括信号输入电路122，该信号输入电路122接收差分信号和单一 信号以将接收到的信号恢复为接收信号。
接收装置120的工作模式根据与接收装置120相连的发送装置110的信号发送模 式来确定。例如，如果发送装置110工作于单一发送模式如移动双倍数据速率同步动态随 机存取存储器(mDDR)或CMOS接口，则接收装置120被设置为单一输入模式。如果发送装 置110工作于伪差分发送模式如双倍数据速率三同步DRAM(DDR3)，则接收装置120被设置 为差分模式，并因此工作于伪差分模式。如果发送装置110工作于差分发送模式如低功率 双倍数据速率同步DRAM(LPDDR2)、低压差分信令(LVDQ或串行高级技术附件(S-ATA)，则 接收装置120被设置为差分模式。
图2是示出了根据本发明实施例的存储器系统的方框图。
参照图2，根据本发明实施例的存储器系统200包括存储器210和控制器220。控 制器220连接至主机(未示出)和存储器210。控制器220响应于主机的请求而访问存储 器210。例如，控制器220控制存储器210的读取、写入和擦除操作。控制器220提供存储 器210与主机之间的接口。控制器220驱动用于控制存储器210的固件。控制器220包 括用于执行主机与控制器220之间的数据交换的协议。例如，控制器220根据各种接口协 议如通用串行总线(USB)协议、多媒体卡(MMC)协议、外围组件互连(PCI)协议、PCI-高速 (PCI-E)协议、高级技术附件(ATA)协议、串行-ATA协议、并行-ATA协议、小计算机小接口 (SCSI)协议、增强小盘接口(ESDI)和集成驱动电子(IDE)协议中至少之一，与外部(例如， 主机)进行通信。控制器220与存储器210相接口连接。控制器220包括信号输入电路 222用于接收从存储器210发送的信号。根据本发明实施例的存储器系统200示出并描述 了控制器220仅包括信号输入电路222来接收从存储器210发送的信号，但是控制器220 也可以包括用于接收从主机发送的信号的信号输入电路。与图1中的信号输入电路122相 同，信号输入电路222根据发送装置110的发送模式，工作于单一输入模式、差分输入模式 和伪差分输入模式。将参照图3更为详细地描述根据本发明实施例的信号输入电路222。
存储器210包括存储数据的存储单元阵列、用于向存储单元阵列写入数据以及从 存储单元阵列读取数据的读取和写入电路、解码外部地址以将解码地址传送至读取和写入 电路的地址解码器、以及控制存储器210整体操作的控制逻辑(可以是非易失性存储器)。
图3是示出了根据本发明实施例、可以包括在图1的接收装置以及图2的控制器 中的信号输入装置的配置的图。
参照图3，根据本发明实施例的信号输入电路300包括差分放大器310、反相器320 和复用器330。差分放大器310接收第一输入信号A和第二输入信号AB以输出第一输出信 号0UT1。反相器320接收第一输入信号A以输出第二输出信号0UT2。复用器330响应于 模式选择信号C，输出来自差分放大器310的第一输出信号OUTl以及来自反相器320的第 二输出信号0UT2之一，作为输出信号Y。
差分放大器310包括PMOS晶体管MPl和MP2、NMOS晶体管MNl至MN3、和偏置电 路211。PMOS晶体管MPl具有与电源电压VDDH端子相连的源极，漏极以及栅极。该PMOS7晶体管的漏极和栅极彼此连接。NMOS晶体管MNl具有与PMOS晶体管MPl的漏极相连的漏 极，源极，以及接收第一输入信号A的栅极。PMOS晶体管MP2具有与电源电压VDDH端子相 连的源极，漏极，以及与PMOS晶体管MPl的漏极相连的栅极。NMOS晶体管丽2具有与PMOS 晶体管MP2的漏极相连的漏极，源极，以及接收第二输入信号AB的栅极。NMOS晶体管丽3 具有与NMOS晶体管丽1和丽2的源极共同相连的漏极，与地电压端子相连的源极，以及与 偏置电路211相连的栅极。偏置电路211输出用于控制流经NMOS晶体管丽3的电流的信 号。具有上述配置的差分放大器310放大第一输入信号A与第二输入信号AB之差，以输出 第一输出信号OUTl。
反相器320包括依次串联连接在电源电压VDDH端子和地电压端子之间的PMOS晶 体管MP3和NMOS晶体管MN4。PMOS晶体管MP3的栅极以及NMOS晶体管MN4的栅极接收第 一输入信号A。反相器320将第一输入信号A反相，以输出第二输出信号0UT2。
复用器330在模式选择信号C具有第一电平时输出来自差分放大器310的第一输 出信号0UT1，作为输出信号Y，且在模式选择信号C具有第二电平时输出来自反相器320的 第二输出信号0UT2，作为输出信号Y。
图4A和4B是输入到图3的信号输入电路中的第一和第二输入信号的图。
参照图4A，在差分模式下，第一和第二输入信号A和AB在彼此之间反转，即，它们 是彼此的反相版本。差分放大器310放大第一和第二输入信号A和AB之差，以输出第一输 出信号0UT1。
参照图4B，在伪差分模式下，第二输入信号AB是参考信号的电平。差分放大器310 放大第一和第二输入信号A和AB之差，以输出第二输出信号0UT2。
因此，当模式选择信号C具有第一电平时，图3的信号输入电路300作为伪差分输 入电路或差分输入电路来工作，其放大第一和第二输入信号A和AB之差，以输出输出信号 Y。当模式选择信号C具有第二电平时，信号输入电路300可以作为单一输入电路来工作， 其仅将第一输入信号A反相，以输出反相信号。
然而，根据图3的信号输入电路300，由于复用器330而使得工作速度变得较慢，且 电路面积增加。此外，功耗增加，因为差分放大器310和反相器320总是处于各自的工作状 态，而无论工作模式如何。
图5是示出了根据本发明另一实施例的信号输入电路的图。
参照图5，根据本发明另一实施例的信号输入电路500包括输入单元510、第一补 偿电路520、第二补偿电路530和使能电路M0。输入单元510包括PMOS晶体管MPll和 匪OS晶体管MNl2。PMOS晶体管MP11和匪OS晶体管MNl2依次串联连接在电源电压VDDH端 子和第一连接节点CNl之间。第一连接节点CNl是用于连接输入单元510和使能电路540 的节点。PMOS晶体管MPll的栅极和NMOS晶体管丽12的栅极接收第一输入信号A。输出 节点N3的信号被输出作为输出信号Y，其中输出节点N3是PMOS晶体管MPll和NMOS晶体 管丽12之间的连接节点。
第一补偿电路520包括PMOS晶体管MP21以及匪OS晶体管MN21和MN22。PMOS 晶体管MP21和NMOS晶体管丽21依次串联连接在电源电压VDDH端子和第二连接节点CN2 之间。第二连接节点CN2是用于连接第一补偿电路520和使能电路MO的节点。PMOS晶 体管MP21的栅极接收第二输入信号AB，NM0S晶体管丽21的栅极连接至第一节点Ni，其中第一节点附是PMOS晶体管MP21和匪OS晶体管丽21之间的连接节点。匪OS晶体管丽22 连接在输出节点N3和第二连接节点CN2之间，其栅极连接至第一节点W。
第二补偿电路530包括PMOS晶体管MP31和MP32以及匪OS晶体管MN31。PMOS 晶体管MP31和NMOS晶体管丽31依次串联连接在电源电压VDDH端子和第三连接节点CN3 之间。第三连接节点CN3是用于连接第二补偿电路530和使能电路MO的节点。PMOS晶体 管MP31的栅极连接至第二节点N2，其中第二节点N2是PMOS晶体管MP31与NMOS晶体管 丽31之间的连接节点。NMOS晶体管丽31的栅极接收第二输入信号AB。PMOS晶体管MP32 连接在电源电压VDDH端子和输出节点N3之间，其栅极连接至第二节点N2。
使能电路540包括NMOS晶体管MN41至MN43。NMOS晶体管MN41连接在第一连接 节点CNl和地电压端子之间，且由第二模式选择信号D来控制。NMOS晶体管MN42连接在 第二连接节点CN2和地电压端子之间，且由第一模式选择信号C来控制。NMOS晶体管MN43 连接在第三连接节点CN3和地电压端子之间，且由第一模式选择信号C来控制。
具有上述配置的信号输入电路500的工作如下所述。
当第二模式选择信号D具有高电平时，NMOS晶体管MN41导通。当NMOS晶体管 MN41处于导通状态时，输入单元510接收第一输入信号A，以输出输出信号Y。此时，输出信 号Y是第一输入信号A的反相信号。当第一模式选择信号具有低电平而第二模式选择信号 D具有高电平时，信号输入电路500工作于单一输入模式。
当第一和第二模式选择信号C和D均具有高电平时，使能电路540的所有NMOS晶 体管MN41至MN43均导通，因此输入单元510以及第一和第二补偿电路520和530处于各 自的工作状态。
当第一输入信号A的电压电平低于第二输入信号AB的电压电平时，输入单元510 的PMOS晶体管MPll导通，而匪OS晶体管丽12截止。此时，流经匪OS晶体管丽31和匪OS 晶体管丽22的电流量根据第二输入信号AB的电压电平来确定。因此，信号输入电路500 输出与第一输入信号A和第二输入信号AB之间的电压差相对应的输出信号Y。即，当第一 和第二模式选择信号C和D都具有高电平时，信号输入电路500根据第一和第二输入信号 A和AB，工作于差分模式和伪差分模式之一。
由于晶体管制造工艺，沟道的长度和宽度可能出现误差。晶体管的响应时间根据 沟道的长度和宽度来确定。此外，晶体管的响应时间根据周围环境而改变。当PMOS晶体管 MPll的特性和NMOS晶体管丽12的特性同等改变时，即，当PMOS晶体管MPll的响应时间 和NMOS晶体管MN12的响应时间都变慢或变快时，这不会很大的影响信号输入电路500的 工作特性。然而，当PMOS晶体管MPll和NMOS晶体管丽12之一的响应时间变慢而其中另 一个的响应时间变快时，从信号输入电路500输出的输出信号Y将具有迟滞特性。根据本 发明另一实施例的信号输入电路500包括第一补偿电路520和第二补偿电路530，其中当由 于诸如工艺和周围环境等因素导致PMOS晶体管MPll的响应时间不同于NMOS晶体管MN12 的响应时间时，第一补偿电路520和第二补偿电路530能够补偿不同的响应时间。
下文将针对第一输入信号A和第二输入信号AB具有互补电压电平，S卩，处于差分 模式的情况，来描述信号输入电路500的工作。当第一输入信号A从低电平改变为高电平 时，PMOS晶体管MPll截止，而匪OS晶体管丽12导通。此时，当PMOS晶体管MPll的响应 时间慢而NMOS晶体管丽12的响应时间快时，输出信号Y从高电平改变为低电平的速度被延迟。第一补偿电路520的PMOS晶体管MP21响应于已经从高电平改变为低电平的第二输 入信号AB而导通，且节点附的电压电平变高。因此，各自栅极连接至节点附的所有NMOS 晶体管丽21和丽22都导通。输出节点N3的电流通过NMOS晶体管丽22和使能电路540 的NMOS晶体管MN42释放到地电压端子。由第一补偿电路520通过输出节点N3输出的输 出信号Y迅速从高电平改变到低电平。因此，第一补偿电路520能够补偿输入单元510中 PMOS晶体管MPll的响应时间。由于在第二输入信号AB具有低电平时第二补偿电路530的 NMOS晶体管丽31截止，所以第二补偿电路530不工作。
另一方面，当第一输入信号A从高电平改变为低电平时，PMOS晶体管MPll导通， 而NMOS晶体管MN12截止。此时，当PMOS晶体管MPll的响应时间快而NMOS晶体管MN12 的响应时间慢时，输出信号Y从低电平改变为高电平的速度被延迟。第二补偿电路530的 PMOS晶体管MP31响应于已经从低电平改变为高电平的第二输入信号AB而导通。因此，节 点N2的电流通过NMOS晶体管丽31和使能电路MO的NMOS晶体管MN43释放到地电压端 子。PMOS晶体管MP31和MP32都导通。由于电流通过PMOS晶体管MP31提供给输出节点 N3，所以通过输出节点N3输出的输出信号Y迅速从低电平改变为高电平。因此，第二补偿 电路530能够补偿输入单元510中NMOS晶体管MN12的响应时间。由于在第二输入信号AB 具有高电平时第一补偿电路520的PMOS晶体管MP21截止，所以第一补偿电路520不工作。
图5的信号输入电路500中使能电路MO的匪OS晶体管丽42和丽43响应于第 一选择信号C而导通。因此，当信号输入电路500工作于单一输入模式时，可以避免第一和 第二补偿电路520和530的不必要的功耗。
同图3的信号输入电路300不同，由于图5的信号输入电路500不需要偏置电路， 因此信号输入电路500的功耗相对于图3的信号输入电路300减小。在不包括偏置电路的 信号输入电路500中，差分输入模式与单一输入模式之间以及伪差分输入模式与单一输入 模式之间的偏移(skew)被最小化，并且信号输入电路500可以工作于宽电压范围。同图3 的信号输入电路300不同，由于图5的信号输入电路500不包括复用器，信号输入电路500 的工作速度增加。
图6A和6B是示出了当由于半导体制造工艺中的误差或变化而使得图5中输入单 元的PMOS晶体管和NMOS晶体管的响应时间彼此不同时，输出信号根据输入信号而改变的 图。
图6A是示出了图3的信号输入电路300中输出信号Y根据输入信号A而改变的 图。图6B是示出了图5的信号输入电路500中输出信号Y根据输入信号A而改变的图。通 过比较图6A和6B可以看出，图3中信号输入电路300的改变电压差最大达176mV，而图5 中信号输入电路500的改变电压差最大为40. 6mV。信号输入电路500中第一和第二补偿电 路520和530能够补偿由于工艺导致的PMOS晶体管MPll和NMOS晶体管丽12之间的响应 时间差异。即，当输入信号A从低电平改变为高电平时输出信号Y的改变时间与当输入信 号A从高电平改变为低电平时输出信号Y的改变时间之间的差在图5的信号输入电路500 中较小。
图7A和7B是示出了当由于周围环境差异而使得图5中输入单元的PMOS晶体管 和NMOS晶体管的响应时间彼此不同时，输出信号根据输入信号而改变的图。在125°C的周 围环境和-50°C的周围环境下，图3中信号输入电路300的改变电压差最大达62mV，而图5中信号输入电路500的改变电压差最大为18mV。信号输入电路500中第一和第二补偿电路 520和530能够补偿由于周围环境导致的PMOS晶体管MPll和NMOS晶体管MN12之间的响 应时间差异。
根据本发明的实施例，实现了一种具有简单电路配置并能够接收差分信号和单一 信号的信号输入电路。另外，可以防止信号输入电路的性能由于工艺或周围环境而退化。
上述主题应被视为说明性的而非限制性的，所附权利要求旨在覆盖落在本发明的 真正精神和范围内的所有修改、改进和其他实施例。因此，在法律所允许的最大程度内，本 发明的范围由所附权利要求及其等同物的所允许的最宽解释来确定，并不应受到之前详细 描述的限制或局限。
权利要求
1. 一种信号输入电路，包括输入单元，接收第一输入信号，以向输出节点输出输出信号； 第一补偿电路，连接至输出节点，响应于第二输入信号而对输出节点放电； 第二补偿电路，连接至输出节点，响应于第二输入信号而向输出节点提供电流；以及 使能电路，响应于至少一个工作模式选择信号来使能输入单元以及第一和第二补偿电
2.根据权利要求1所述的信号输入电路，其中，输入单元包括PMOS晶体管，连接在电源电压端子与输出节点之间，并由第一输入信号控制；以及 NMOS晶体管，连接在输出节点与使能电路之间，并由第一输入信号控制。
3.根据权利要求1所述的信号输入电路，其中，第一补偿电路包括PMOS晶体管，连接在电源电压端子与第一节点之间，并由第二输入信号控制； 第一 NMOS晶体管，连接在第一节点与使能电路之间，并由第一节点的信号控制；以及 第二 NMOS晶体管，连接在输出节点与使能电路之间，并由第一节点的信号控制。
4.根据权利要求1所述的信号输入电路，其中，第二补偿电路包括第一 PMOS晶体管，连接在电源电压端子与输出节点之间，并由第二节点的信号控制； 第二 PMOS晶体管，连接在电源电压端子与第二节点之间，并由第二节点的信号控制；以及NMOS晶体管，连接在第二节点与使能电路之间，并由第二输入信号控制。
5.根据权利要求1所述的信号输入电路，其中，第一和第二输入信号反相。
6.根据权利要求1所述的信号输入电路，其中， 使能电路接收第一和第二工作模式选择信号，使能电路响应于第一工作模式选择信号而使能第一和第二补偿电路，以及 使能电路响应于第二工作模式选择信号而使能输入单元。
7.一种信号输入电路，包括输入单元，接收第一输入信号，以向输出节点输出输出信号； 第一补偿电路，连接至输出节点，响应于第二输入信号而对输出节点放电； 第二补偿电路，连接至输出节点，响应于第二输入信号而向输出节点提供电流；以及 开关电路，分别通过第一至第三连接节点连接至输入单元、第一补偿电路和第二补偿 电路，响应于至少一个工作模式选择信号将第一至第三连接节点连接至地电压端子。
8.根据权利要求7所述的信号输入电路，其中，输入单元包括PMOS晶体管，连接在电源电压端子与输出节点之间，并由第一输入信号控制；以及 NMOS晶体管，连接在输出节点和开关电路之间，并由第一输入信号控制。
9.一种半导体装置，包括 第一电路；和第二电路，接收来自第一电路的数据信号，并包括用于接收来自第一电路的数据信号 的信号输入电路，其中，信号输入电路包括输入单元，接收第一输入信号，以向输出节点输出输出信号； 第一补偿电路，连接至输出节点，响应于第二输入信号而对输出节点放电；第二补偿电路，连接至输出节点，响应于第二输入信号而向输出节点提供电流；以及 使能电路，响应于至少一个工作模式选择信号来使能输入单元以及第一和第二补偿电路。
10.根据权利要求9所述的半导体装置，其中 第一和第二输入信号反相，以及使能电路接收第一和第二工作模式选择信号，响应于第一工作模式选择信号而使能第 一和第二补偿电路，响应于第二工作模式选择信号而使能输入单元。
全文摘要
一种信号输入电路包括输入单元、第一补偿电路、第二补偿电路和使能电路。输入单元接收第一输入信号，以向输出节点输出输出信号。第一补偿电路连接至输出节点，响应于第二输入信号而对输出节点放电。第二补偿电路连接至输出节点，响应于第二输入信号而向输出节点提供电流。使能电路响应于至少一个工作模式选择信号来使能输入单元以及第一和第二补偿电路。
文档编号H03K19/00GK102035526SQ201010294410
公开日2011年4月27日 申请日期2010年9月21日 优先权日2009年9月28日
发明者具京会 申请人:三星电子株式会社