用于奇数比并行数据总线的串行化器和解串器的制作方法

文档序号:12289614阅读:来源:国知局
技术总结
公开了用于奇数比并行数据总线的串行化器和解串器。在一个实施例中,以奇数个并行数据比特操作的串行化器和解串器在半速率时钟下工作来以全时钟速率提供串行数据流。通过提供半速率时钟,在纳入该串行化器的集成电路上节省了功率和面积。另外,通过提供7:1串行化器,总线现在与MIPI C‑PHY标准兼容。

技术研发人员:张乐;W·苏;C·李
受保护的技术使用者:高通股份有限公司
文档号码:201480078980
技术研发日:2014.05.21
技术公布日:2017.02.22

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