倍频器的制作方法

相关申请的交叉引用

本申请要求2016年6月16日提交的美国申请no.15/184,342和2015年6月17日提交的美国临时申请no.62/180,728的权益。以上引用的申请的全部公开内容通过引用并入本文。

本申请有关于2012年4月18日提交的美国专利申请no.13/449,468(现为2014年9月16日授权的美国专利no.8,838,053)，后者要求2011年4月29日提交的美国临时专利申请no.61/480,947和2011年5月9日提交的美国临时专利申请no.61/484,110的权益。上述申请和专利的全部公开内容通过引用并入本文。

本公开一般涉及电子电路，并且更具体地涉及倍频器电路。

背景技术：

这里提供的背景技术描述是为了总体上呈现本公开的上下文。当前所称的发明人的工作在本背景技术章节中描述该工作的程度上，以及在提交时可能不会被另外认定为现有技术的本描述的各方面，既不明确地也不隐含地被承认是相对于本公开的现有技术。

通常，本地振荡器(lo)产生被称为时钟的周期性信号，该周期性信号在包括无线收发器、数据转换器、有线和光学串行数据通信链路、处理器和存储器电路的许多电子电路中使用。经常使用通过锁相环(pll)锁定到参考时钟的压控振荡器(vco)来产生片上时钟。然而，在一些电路中，vco输出不能直接用作时钟，因为一些功率可能从功率放大器泄漏到vco，并且如果vco和功率放大器以相似的频率工作，vco频率可能会从其中心频率被拉向功率放大器的频率。此外，可能需要不同频率的时钟来支持单个通信设备中的不同通信标准。因此，传统的时钟产生方案不足以在某些所需的不同频率上产生时钟。

技术实现要素：

一种系统包括信号发生器和信号组合器。信号发生器被配置为输出具有第一频率的第一信号并且输出具有第一频率且具有相对于第一信号偏移预定量的相位的一个或多个信号。信号组合器被配置为组合第一信号和该一个或多个信号以输出具有第二频率的经倍频的第二信号。第二频率大于第一频率。

在其它特征中，所述一个或多个信号包括第三信号和第四信号。所述第三信号具有相对于所述第一信号偏移120度的相位。所述第四信号具有相对于所述第一信号偏移240度的相位。所述第二频率是所述第一频率的三倍。

在其它特征中，当n表示包括所述第一信号和所述一个或多个信号的信号的总数时，所述信号组合器被配置为：抵消所述第一信号和所述一个或多个信号的第一频率；将所述第一信号的n次谐波和所述一个或多个信号的n次谐波同相相加以输出所述第二信号；以及输出具有等于所述第一频率的n倍的第二频率的第二信号。

在其它特征中，所述信号发生器包括移相器，所述移相器包括彼此串联连接的(n-1)个延迟电路。所述(n-1)个延迟电路中的第一延迟电路接收所述第一信号。所述(n-1)个延迟电路分别输出所述一个或多个信号。所述(n-1)个延迟电路中的每个延迟电路将相应的输入信号的相位偏移(360/n)度。

在其它特征中，所述信号发生器包括n级环形振荡器。所述n级环形振荡器的第一级输出所述第一信号。所述n级环形振荡器的剩余(n-1)级分别输出所述一个或多个信号。

在其它特征中，所述系统进一步包括耦合到所述信号组合器的分频器，所述分频器被配置为将所述第二信号的第二频率除以2。

在其它特征中，所述系统进一步包括连接到所述信号组合器的谐振电路。所述谐振电路被配置成从所述第二信号中滤除残余的第一频率。

在其它特征中，所述系统进一步包括分频器和谐振电路。所述分频器连接到所述信号组合器以将所述第二信号的第二频率除以2。所述谐振电路连接到所述分频器以从所述分频器的输出滤除残余的第一频率。

分频器、第一谐振电路、分频器和第二谐振电路。所述第一谐振电路耦合到所述信号组合器。所述第一谐振电路被配置为对所述第二信号进行滤波并且输出经滤波的第二信号。所述分频器耦合到所述信号组合器。所述分频器被配置为将所述第二信号的所述第二频率除以2。所述第二谐振电路耦合到所述分频器。所述第二谐振电路被配置为对所述分频器的输出进行滤波。

在又一些特征中，一种方法，包括：使用信号发生器产生具有第一频率的第一信号以及具有所述第一频率并具有相对于所述第一信号偏移预定量的相位的一个或多个信号。所述方法还包括使用信号组合器将所述第一信号和所述一个或多个信号组合以输出具有第二频率的经倍频的第二信号。所述第二频率大于所述第一频率。

在其它特征中，所述一个或多个信号包括第三信号和第四信号。所述第三信号具有相对于所述第一信号偏移120度的相位。所述第四信号具有相对于所述第一信号偏移240度的相位。所述第二频率是所述第一频率的三倍。

在其它特征中，当n表示包括所述第一信号和所述一个或多个信号的信号的总数时，组合所述第一信号和所述一个或多个信号包括：使用所述信号组合器，抵消所述第一信号和所述一个或多个信号的第一频率；使用所述信号组合器将所述第一信号的n次谐波和所述一个或多个信号中的n次谐波同相相加以输出所述第二信号；以及使用所述信号组合器输出具有等于所述第一频率的n倍的第二频率的第二信号。

在其它特征中，所述方法还包括使用分频器将所述第二信号的第二频率除以2。

在其它特征中，所述方法还包括使用谐振电路从所述第二信号中滤除残余的第一频率。

在其它特征中，所述方法还包括：使用分频器将所述第二信号的第二频率除以2以输出经分频的第二信号；以及使用谐振电路从经分频的第二信号中滤除残余的第一频率。

在其它特征中，所述方法还包括：使用第一谐振电路对所述第二信号进行滤波以输出经滤波的第二信号；使用分频器将所述第二信号的第二频率除以2以输出经分频的第二信号；以及使用第二谐振电路对所述经分频的第二信号进行滤波。

在又一些特征中，一种系统包括环形振荡器和信号组合器。所述环形振荡器包括多个级并被配置为输出多个信号。所述多个信号中的每个信号具有第一频率。由所述多个级中的第一级输出的所述多个信号中的第一信号具有第一相位。由所述多个级的剩余级分别输出的所述多个信号的剩余信号具有相对于所述第一相位偏移预定量的相位。信号组合器被配置为组合所述多个信号以输出具有第二频率的经倍频的第二信号。所述第二频率大于所述第一频率。

在又一些特征中，当n表示所述多个信号的总数时，所述信号组合器被配置为：抵消多个信号的第一频率；将所述多个信号的n次谐波同相相加以输出所述第二信号；以及输出具有等于所述第一频率的n倍的第二频率的第二信号。

在又一些特征中，所述系统还包括耦合到所述信号组合器的分频器，所述分频器被配置为将所述第二信号的所述第二频率除以2。

在又一些特征中，所述系统还包括耦合到所述信号组合器的谐振电路，所述谐振电路被配置为对所述第二信号进行滤波。

在其它特征中，所述系统还包括分频器和谐振电路。所述分频器耦合到所述信号组合器。所述分频器被配置为将所述第二信号的第二频率除以2。所述谐振电路耦合到所述分频器。所述谐振电路被配置为对所述分频器的输出进行滤波。

在其它特征中，所述系统还包括第一谐振电路、分频器和第二谐振电路。所述第一谐振电路耦合到所述信号组合器。所述第一谐振电路被配置为对所述第二信号进行滤波并且输出经滤波的第二信号。所述分频器耦合到所述信号组合器。所述分频器被配置为将所述第二信号的第二频率除以2。所述第二谐振电路耦合到所述分频器。所述第二谐振电路被配置为对所述分频器的输出进行滤波。

根据具体实施方式、权利要求和附图，本公开的应用的其它方面将变得显而易见。具体实施方式和具体实例仅旨在用于说明的目的，而不旨在限制本公开的范围。

附图说明

图1是根据本公开实施例的倍频器电路的示例的示意图。

图2a是根据本公开的实施例的图1的倍频器电路的示例实现的功能框图。

图2b是根据本公开的实施例的图1的倍频器电路的示例实现的功能框图。

图3示出根据本公开实施例的图1的倍频器电路和谐振电路的布置。

图4示出根据本公开实施例的图1的倍频器电路、分频器和谐振电路的布置。

图5示出根据本公开实施例的图1的倍频器电路、分频器和多个谐振电路的布置。

图6示出根据本公开的实施例的使用图1的倍频器电路来对输入信号进行倍频的方法的流程图。

图7是根据本公开的实施例的、利用阻性负载的图1的倍频器电路的差分实施的示例的功能框图。

图8是根据本公开的实施例的、利用谐振电路作为负载的图1的倍频器电路的差分实施的示例的功能框图。

在附图中，可以重复使用附图标记来标识相似和/或相同的元件。

具体实施方式

通过锁相环(pll)锁定到参考时钟的压控振荡器(vco)被用于在芯片上产生时钟。一些功率可能从芯片上的功率放大器泄漏到vco，并且如果vco和功率放大器以相似的频率操作，则vco频率可能会从其中心频率被拉向功率放大器的频率，这被称为功率放大器拉移(poweramplifierpulling)。由于功率放大器拉移，锁相环(pll)使用混频和分频。因此，需要有效的方式来改变压控振荡器(vco)时钟频率以支持需要不同频率的时钟的电路(例如兼容不同通信标准的设备)。通常使用2分频电路和3倍频电路来达到此目的。

本公开提出了使用三个时钟信号的实施例，所述三个时钟信号具有相同的预定频率，但是具有彼此偏移120度的相位以生成频率为预定输入频率的三倍的强三次谐波。

在所提出的实施例和技术中，通过组合具有预定相位和基本输入频率的信号(例如，具有相同的预定频率但相位相互偏移120度的三个时钟信号)，在最终输出处产生具有最小水平的不希望的频率的高次同相谐波。例如，为了生成具有输入信号的基本频率的三倍的频率的三次谐波，组合三个均具有基本频率并且分别0度、120度和240度相位的时钟信号。三个时钟信号的基本频率彼此抵消，并且三个时钟信号中的每一个的三次谐波被同相组合以提供具有基本频率的三倍的信号。这种技术也可扩展到其他谐波。例如，该技术可适用于五次谐波、七次谐波等其他谐波，以获得不同的倍增因子。

上述本发明的技术可以概括如下。通常，为了产生具有输入信号的基本频率的n倍的输出信号，如下组合n个信号，其中n是大于1的整数。所述n个信号中的第一信号是具有基本频率的输入信号本身。第二至第n信号均具有与输入信号相同的基本频率，但是每一个都具有被偏移360度除以n的相位。当n个信号被组合时，n个信号的基本频率抵消，并且同相相加的n个信号的n次谐波提供具有基本频率的n倍的信号。

而且，在本发明的各个实施例中，其他电路被堆叠在所提出的倍频器电路的顶部上。尽管没有示出，但是这样的电路的示例包括用于噪声抑制的lc谐振电路和用于实现分数倍频的2分频电路(例如，在n＝3的情况下，3/2＝倍数为1.5；在n＝5的情况下，5/2＝倍数为2.5；依此类推)。

贯穿本公开，三倍频仅作为示例来描述。本公开的教导适用于将基本频率乘以任何乘数。此外，贯穿本公开，由于方波时钟通常具有比偶次谐波更强的奇次谐波，所以使用奇数倍频(例如，3×、5×、7×等)。理想情况下，没有偶次谐波。因此，虽然本公开的教导是参照奇数倍频来讨论的，但是如果例如由于一些非线性，由信号发生器(例如vco)产生的主时钟具有偶次谐波，则该教导对于偶数倍频(例如2×、4×、6×等)也是有用的。

图1示意性地示出了根据本公开的三倍倍频器200的示例。三倍倍频器200包括信号组合器202，其组合由缓冲器206-1、206-2和206-3分别缓冲的三个信号204-1、204-2和204-3。三个信号中的每一个具有相同的基本频率fo。三个信号分别具有0度、120度和240度的相位。当信号组合器202组合三个信号时，三个信号的基本频率抵消，并且三个信号的三次谐波被同相相加在一起以提供具有基本频率的三倍的输出信号。相应地，信号组合器202产生具有频率fout＝3*fo的输出信号。

图2a示出根据本公开的三倍倍频器300的示例的功能框图。三倍倍频器300包括信号发生器302、移相器304和信号组合器306，在一个实施例中它们如图2a所示耦合在一起。信号发生器302产生具有基本频率fo和相位为0°的第一信号。例如，虽然不是必需的，但是信号发生器302可以包括vco。移相器304包括延迟电路304-1和延迟电路304-2。延迟电路304-1将第一信号的相位延迟120°，并输出具有基本频率fo和120°相位的第二信号。因此，第二信号的相位相对于第一信号的相位偏移120°。延迟电路304-2将第二信号的相位延迟附加的120°，并输出具有基本频率fo和240°相位的第三信号。相应地，第三信号的相位相对于第二信号的相位偏移120°，并且相对于第一信号的相位偏移240°。

每个延迟电路仅输出一个信号，该信号具有与其输入信号相同的基本频率并具有相对于其输入信号的相位偏移120°的相位。当信号组合器306将由信号发生器302和两个延迟电路304-1和304-2输出的三个信号组合在一起时，三个信号的基本频率彼此抵消，并且三个信号的三次谐波被同相加在一起以提供具有基本频率的三倍的输出信号。相应地，信号组合器306将由信号发生器302和两个延迟电路304-1和304-2输出的第一信号、第二信号和第三信号组合并产生具有频率fout＝3*fo的输出信号，其中第一信号、第二信号和第三信号具有相同的基本频率并且第二信号和第三信号的相位分别相对于第一信号的相位偏移120°和240°。

上述本发明的技术可以概括如下。通常，n倍频电路包括(n-1)个延迟电路(例如，如上所述的3倍频电路将包括2个延迟电路)，每个延迟电路将其输入延迟360/n度，其中n是大于或等于3的整数。(n-1)个延迟电路中的第一延迟电路将信号发生器302的输出延迟360/n度。(n-1)个延迟电路中的第二延迟电路将第一延迟电路的输出延迟360/n度。(n-1)个延迟电路中的第三延迟电路将第二延迟电路的输出延迟360/n度，依此类推。

每个延迟电路仅输出一个信号，该信号具有与其输入信号相同的基本频率并具有相对于其输入信号的相位偏移360/n度的相位。当信号组合器306组合信号发生器302的输出信号和(n-1)个延迟电路的输出信号时，信号发生器302的输出信号和(n-1)个延迟电路的输出信号的基本频率彼此抵消，并且信号发生器302的输出信号的n次谐波和(n-1)个延迟电路的输出信号被同相相加在一起，以提供具有基本频率的n倍的输出信号。换句话说，信号组合器306组合信号发生器302的输出信号和(n-1)个延迟电路的输出信号，并产生具有频率fout＝n*fo的输出信号。

注意，每个延迟电路304-1、304-2将相应的输入信号的相位偏移相同的量。因此，使用级联的同样的延迟电路304-1、304-2，如图2a所示。备选地，如果延迟电路并联连接，每个延迟电路接收相同的输入信号，并且每个延迟电路能够提供不同的相移量(例如，在上面的示例中为120度和240度)，则将延迟电路的输出与具有零度相移的输入信号组合，以获得与参考图2a所示和所述相同的结果。可以类似于上面关于级联延迟电路提到的概括，来概括涉及并联延迟电路的本发明实施例。

在一些实施方式中，通过使用多级环形振荡器作为信号发生器来消除移相器，其中多级环形振荡器的每级添加延迟，并且因此多级环形振荡器的每一级的输出相对于相邻的级被相移。

图2b示出根据本公开的使用环形振荡器303而不是信号发生器302和移相器304的三倍倍频器301的示例的功能框图。三倍倍频器301包括环形振荡器303和信号组合器306。在图示的示例中，环形振荡器303是三级环形振荡器。环形振荡器303包括三级或三个反相器303-1、303-2和303-3。虽然未示出，但是环形振荡器303可以使用其它合适的逻辑门、组合和/或时序逻辑电路、诸如晶体管的分立组件或其任何组合来实现。

第一级或第一反相器303-1产生具有基本频率fo和相位为0°的第一信号。第二级或第二反相器303-2将第一信号的相位延迟120°，并输出具有基本频率fo和相位为120°的第二信号。第三级或反相器门303-3将第二信号的相位延迟120°，并输出具有基本频率fo和相位为240°的第三信号。

当信号组合器306组合由环形振荡器303的三个级输出的三个信号(每个信号具有与由环形振荡器303的第一级产生的信号的基本频率相同的频率)时，三个信号的基本频率相互抵消，并且三个信号的三次谐波被同相相加在一起以提供具有基本频率的三倍的输出信号。相应地，信号组合器306组合由三个级输出的第一信号、第二信号和第三信号，并产生具有频率fout＝3*fo的输出信号。

使用环形振荡器的上述本发明的技术可以概括如下。通常，n倍频电路包括n级环形振荡器，其中n是大于或等于3的整数。当信号组合器306将n级环形振荡器的每级的输出信号(每个输出信号都具有与由n级环形振荡器的第一级输出的信号相同的基本频率)进行组合时，n级的输出信号的基本频率彼此抵消，并且n级的输出信号的n次谐波被同相相加在一起以提供具有基本频率的n倍的输出信号。换句话说，信号组合器306组合n级环形振荡器的n级的输出信号，并产生具有频率fout＝n*fo的输出信号。

在这里公开的本发明的电路中，如果组合的信号的相位不是规定的(例如在三倍倍频器的情况下为0度、120度和240度)，即如果存在任何相位误差/不匹配时，组合器的输出将包括在此被称为杂波的残余的基本频率。

图3至图5示出了根据本公开实施例的堆叠在所提出的倍频器电路(例如，三倍倍频器300、301)顶部上的附加电路的示例。例如，图3示出了倍频器400和谐振电路402，用于抑制倍频器400的输出中的任何杂波。例如，倍频器400包括三倍倍频器300、三倍倍频器301或n倍频电路，其中例如n＝5、7等。谐振电路402堆叠在倍频器400的顶部上以用于杂波抑制。

例如，图4示出了分频器404和可选的谐振电路402堆叠在倍频器400的顶部上。分频器404对倍频器400的输出信号的频率进行分频。例如，如果倍频器400包括三倍倍频器300，则分频器404产生频率为1.5*fo的输出信号；如果倍频器400包括五倍频电路，则分频器404生成频率为2.5*fo的输出信号；以此类推。谐振电路402被堆叠用于从分频器404的输出信号中的附加杂波抑制。

例如，图5示出了分频器404和两个谐振电路402、406堆叠在倍频器400的顶部上。分频器404对倍频器400的输出信号的频率进行分频。谐振电路402被堆叠用于从分频器404的输出信号的杂波抑制。谐振电路406被堆叠用于从倍频器400的输出信号的杂波抑制。

图6是示出根据本公开的用于倍增输入信号的频率的方法500的流程图。在502处，控制生成具有基本频率fo和相位为0°的信号。在504处，控制产生具有基本频率fo并具有相移了360/n度的相位的(n-1)个信号，其中n是大于或等于3的整数。在506处，控制组合具有基本频率fo和相位为0°的信号以及具有基本频率fo并且具有相移了360/n度的(n-1)个信号。所述信号和(n-1)信号的基本频率抵消，所述信号和(n-1)个信号的n次谐波被同相相加，并且控制产生具有基本频率fo的n倍的频率的输出信号(即n*fo)。

图7和图8示出了根据本公开的差分倍频器600-1和600-2的示例。在这些实现中，两个vco输出(例如，采用vco的信号发生器602的两个输出602-1、602-2)被使用，并分别被两组不同的延迟电路延迟用于差分实现。尽管示出了两组延迟电路，但是在一些差分实现中可以仅使用一组延迟电路。

示出差分倍频器600-1和600-2具有不同的负载。图7所示的差分倍频器600-1具有阻性负载610-1。图8所示的差分倍频器600-2具有作为负载的谐振电路610-2。例如，谐振电路610-2提供针对由于电路失配和工艺变化而可能出现的频率分量的抑制。除了不同的负载之外，差分倍频器600-1和600-2在结构上是相似的。因此，除非另有说明，以下讨论适用于差分倍频器600-1和600-2二者。

在图7和图8中，信号发生器602的第一vco输出602-1被第一组延迟电路604延迟，并且信号发生器602的第二vco输出602-1被第二组延迟电路606延迟。第一组延迟电路604和第二组延迟电路606的输出信号由信号组合器608组合，以产生频率等于vco频率的倍数(例如，3*fvco)的差分输出信号。

仅通过示例的方式，差分倍频器600-1和600-2被示为差分三倍倍频器。其他的倍频器(例如，5倍、7倍等)也是可以想到的。此外，使用分频器来对差分倍频器600-1和600-2的每个差分输出进行分频。例如，每个分频器包括二分频电路来实现分数倍频(例如，如果倍频器电路是三倍频电路，则乘以1.5；如果倍频器电路是七倍频电路，则乘以2.5等)。而且，在图3至图5中，倍频器400包括差分倍频器600-1和600-2中的一个。

在图7和图8所示的差分三倍倍频器600-1和600-2的示例中，第一组延迟电路604和第二组延迟电路606中的每一个包括四个延迟电路。第一组延迟电路604包括延迟电路604-1、604-2、604-3和604-4。第二组延迟电路606包括延迟电路606-1、606-2、606-3和606-4。

在第一组延迟电路604中，第一延迟电路604-1接收第一vco信号602-1。第二延迟电路604-2接收第一延迟电路604-1的输出。第三延迟电路604-3接收第二延迟电路604-2的输出。第四延迟电路604-4接收第三延迟电路604-3的输出。

在第二组延迟电路606中，第一延迟电路606-1接收第二vco信号602-2。第二延迟电路606-2接收第一延迟电路606-1的输出。第三延迟电路606-3接收第二延迟电路606-2的输出。第四延迟电路606-4接收第三延迟电路606-3的输出。

在第一组延迟电路604和第二组延迟电路606中的每一个中，除了第一延迟电路和最后延迟电路以外，每个延迟电路将相应输入信号的相位偏移相同的量(360/n)。例如，在第一组延迟电路604中，延迟电路604-2、604-3将相应的输入信号的相位偏移相同的量(例如，在这个示例中为120度)；并且在第二组延迟电路606中，延迟电路606-2、606-3将相应输入信号的相位偏移相同的量(例如，在这个示例中为120度)。第一组延迟电路604和第二组延迟电路606中的第一延迟电路604-1、606-1和最后延迟电路604-4、606-4不偏移它们相应的输入信号的相位。

差分三倍倍频器600-1、600-2中的每一个的信号组合器608包括三个信号组合器电路608-1、608-2和608-3。信号组合器电路608-1组合延迟电路604-1和606-1的输出。信号组合器电路608-2组合延迟电路604-2和606-2的输出。信号组合器电路608-3组合延迟电路604-3和606-3的输出。

三个信号组合器608-1、608-2和608-3中的每一个分别输出具有第一极性和第二极性(示为-和+)的相应的差分输出信号(第一输出和第二输出)。信号组合器电路608-1、608-2和608-3的具有第一极性(例如示为-)的第一输出被输出到负载的第一输入(示出为图7中的阻性负载610-1和图8中的谐振电路610-2)，并且信号组合器电路608-1、608-2和608-3的具有第二极性(例如示为+)的第二输出被输出到负载的第二输入。负载两端的差分输出信号具有等于vco频率的倍数的频率(例如，3*fvco)。

在一些实现中，虽然未示出，但是图7和图8中示出的信号发生器602和延迟电路604、606可以由差分环形振荡器代替。

前面的描述本质上仅仅是说明性的，决不意图限制本公开、其应用或使用。本公开的广泛教导可以以各种形式来实现。因此，尽管本公开包括特定示例，但是本公开的真实范围不应该被限制如此，因为在研究附图、说明书和以下权利要求时，其他修改将变得显而易见。

权利要求书(按照条约第19条的修改)

1.一种系统，包括：

信号发生器，被配置为输出具有第一频率的第一信号并且输出具有所述第一频率且具有相对于所述第一信号偏移预定量的相位的一个或多个信号；和

信号组合器，被配置为组合所述第一信号和所述一个或多个信号以输出具有第二频率的经倍频的第二信号，其中所述第二频率大于所述第一频率，

其中当n表示包括所述第一信号和所述一个或多个信号的信号的总数时，所述信号组合器被配置为：

抵消所述第一信号和所述一个或多个信号的所述第一频率；

将所述第一信号的n次谐波和所述一个或多个信号的n次谐波同相相加以输出所述第二信号；和

输出具有等于所述第一频率的n倍的所述第二频率的所述第二信号。

2.根据权利要求1所述的系统，其中：

所述一个或多个信号包括第三信号和第四信号；

所述第三信号具有相对于所述第一信号偏移120度的相位；

所述第四信号具有相对于所述第一信号偏移240度的相位；和

所述第二频率是所述第一频率的三倍。

3.根据权利要求1所述的系统，其中所述信号发生器包括移相器，所述移相器包括彼此串联连接的(n-1)个延迟电路，其中：

所述(n-1)个延迟电路中的第一延迟电路接收所述第一信号；

所述(n-1)个延迟电路分别输出所述一个或多个信号；和

所述(n-1)个延迟电路中的每个延迟电路将相应的输入信号的相位偏移(360/n)度。

4.根据权利要求1所述的系统，其中所述信号发生器包括n级环形振荡器，其中：

所述n级环形振荡器的第一级输出所述第一信号；和

所述n级环形振荡器的剩余(n-1)级分别输出所述一个或多个信号。

5.根据权利要求1所述的系统，还包括耦合到所述信号组合器的分频器，所述分频器被配置为将所述第二信号的所述第二频率除以2。

6.根据权利要求1所述的系统，还包括连接到所述信号组合器的谐振电路，所述谐振电路被配置成从所述第二信号中滤除残余的第一频率。

7.根据权利要求1所述的系统，还包括：

连接到所述信号组合器的分频器，用于将所述第二信号的所述第二频率除以2；和

连接到所述分频器的谐振电路，用于从所述分频器的输出中滤除残余的第一频率。

8.根据权利要求1所述的系统，还包括：

耦合到所述信号组合器的第一谐振电路，所述第一谐振电路被配置为对所述第二信号进行滤波并且输出经滤波的第二信号；

耦合到所述信号组合器的分频器，所述分频器被配置为将所述第二信号的所述第二频率除以2；和

耦合到所述分频器的第二谐振电路，所述第二谐振电路被配置为对所述分频器的输出进行滤波。

9.一种方法，包括：

使用信号发生器产生具有第一频率的第一信号；

使用所述信号发生器产生具有所述第一频率并具有相对于所述第一信号偏移预定量的相位的一个或多个信号；和

使用信号组合器将所述第一信号和所述一个或多个信号组合以输出具有第二频率的经倍频的第二信号，其中所述第二频率大于所述第一频率，

其中当n表示包括所述第一信号和所述一个或多个信号的信号的总数时，将所述第一信号和所述一个或多个信号组合包括：

使用所述信号组合器，抵消所述第一信号和所述一个或多个信号的所述第一频率；

使用所述信号组合器将所述第一信号的n次谐波和所述一个或多个信号中的n次谐波同相相加以输出所述第二信号；和

使用所述信号组合器输出具有等于所述第一频率的n倍的所述第二频率的所述第二信号。

10.根据权利要求9所述的方法，其中：

所述一个或多个信号包括第三信号和第四信号；

所述第三信号具有相对于所述第一信号偏移120度的相位；

所述第四信号具有相对于所述第一信号偏移240度的相位；和

所述第二频率是所述第一频率的三倍。

11.根据权利要求9所述的方法，还包括使用分频器将所述第二信号的所述第二频率除以2。

12.根据权利要求9所述的方法，还包括使用谐振电路从所述第二信号中滤除残余的第一频率。

13.根据权利要求9所述的方法，还包括：

使用分频器将所述第二信号的所述第二频率除以2以输出经分频的第二信号；和

使用谐振电路从所述经分频的第二信号中滤除残余的第一频率。

14.根据权利要求9所述的方法，还包括：

使用第一谐振电路对所述第二信号进行滤波以输出经滤波的第二信号；

使用分频器将所述第二信号的所述第二频率除以2以输出经分频的第二信号；和

使用第二谐振电路对所述经分频的第二信号进行滤波。

15.一种系统，包括：

环形振荡器，所述环形振荡器包括多个级并被配置为输出多个信号，其中所述多个信号中的每个信号具有第一频率，由所述多个级中的第一级输出的、所述多个信号中的第一信号具有第一相位，并且其中由所述多个级中的剩余级分别输出的、所述多个信号中的剩余信号具有相对于所述第一相位偏移预定量的相位；和

信号组合器，所述信号组合器被配置为组合所述多个信号以输出具有第二频率的经倍频的第二信号，其中所述第二频率大于所述第一频率，

其中当n表示所述多个信号的总数时，所述信号组合器被配置为：

抵消所述多个信号的所述第一频率；

将所述多个信号的n次谐波同相相加以输出所述第二信号；和

输出具有等于所述第一频率的n倍的所述第二频率的所述第二信号。

16.根据权利要求15所述的系统，还包括耦合到所述信号组合器的分频器，所述分频器被配置为将所述第二信号的所述第二频率除以2。

17.根据权利要求15所述的系统，还包括耦合到所述信号组合器的谐振电路，所述谐振电路被配置为对所述第二信号进行滤波。

18.根据权利要求15所述的系统，还包括：

耦合到所述信号组合器的分频器，所述分频器被配置为将所述第二信号的所述第二频率除以2；和

耦合到所述分频器的谐振电路，所述谐振电路被配置为对所述分频器的输出进行滤波。

19.根据权利要求15所述的系统，还包括：

耦合到所述信号组合器的第一谐振电路，所述第一谐振电路被配置为对所述第二信号进行滤波并且输出经滤波的第二信号；

耦合到所述信号组合器的分频器，所述分频器被配置为将所述第二信号的所述第二频率除以2；和

耦合到所述分频器的第二谐振电路，所述第二谐振电路被配置为对所述分频器的输出进行滤波。