一种多路内插时域交织电流源开关的数模转换器的制作方法

本发明属于电子电路技术领域，具体涉及一种多路内插时域交织电流源开关的数模转换器。

背景技术：

数模转换器(digitaltoanalogconverter，英文缩写：dac)是一种将数字信号转换为模拟信号(以电流、电压或电荷的形式)的装置。作为重要的接口电路，dac被广泛应用在音频和图像信号处理、通信系统与工业控制等众多领域。随着微电子技术飞速发展和5g通讯技术商用落地，对数据传输的效率与性能有了更高的要求。因此，设计超高速宽频带高性能的dac具有重大的现实意义和研究价值。

传统dac一般采用两种方法来提高数据的传输速率。其一是采用多路复用mux模块实现多路输入(mux-dac)来提高数据传输速率；其二是选用多通道数据内插电路将多路差分信号进行内插以提高数据总体传输速率。

但是，两种方法都需要为多路采样时钟提供精准的高速时钟同步和相位匹配，这样就限制了dac最高转换速率与输出带宽。

技术实现要素：

为了解决现有技术中存在的上述问题，本发明提供了一种多路内插时域交织电流源开关的数模转换器。本发明要解决的技术问题通过以下技术方案实现：

一种多路内插时域交织电流源开关的数模转换器(dac)，包括：

电流源模块(1)，用于向数模转换器提供电流；

多级多通道内插开关模块(2)，电连接所述电流源模块(1)，用于接收并处理多路开关码信号得到待输出信号；

输出模块(3)，电连接所述多级多通道内插开关模块(2)，用于接收并处理所述待输出信号得到dac输出信号。

在本发明的一个实施例中，还包括预编码模块(4)，电连接所述多级多通道内插开关模块(2)，用于接收dac多通道输入信号并与特定时钟信号进行“与”运算得到所述开关码信号。

在本发明的一个实施例中，所述多级多通道内插开关模块(2)包括串联设置的至少两级开关单元，所述至少两级开关单元的输入端连接所述预编码模块，所述至少两级开关单元输出端连接输出模块。

在本发明的一个实施例中，所述多级多通道内插开关模块(2)的每级开关均包括多组差分对管。

在本发明的一个实施例中，还包括电连接于所述差分对管漏端的支路电流。

在本发明的一个实施例中，所述输出模块(3)的晶体管均采用具有厚栅氧工艺的mos管。

在本发明的一个实施例中，所述输出模块(3)采用交叉结构进行输出。

本发明的有益效果：

1、本发明在dac电流源开关单元中嵌入多通道内插结构，无需额外的mux模块和专用电路，结构精简，设计新颖；

2、本发明以多路较低输入速率和在较低时钟频率的情况下实现了超高速电流舵dac，得到宽频带输出；

3、本发明采用多路内插时域交织技术能够减小开关切换过程引起的非线性，提高开关动态性能；

4、本发明有普通/混合这两种工作模式，能够合成第一奈奎斯特区或第二奈奎斯特区内的高质量宽带信号，应用更加灵活，适合多种应用场景和不同传输需要。

以下将结合附图及实施例对本发明做进一步详细说明。

附图说明

图1是本发明实施例提供的一种新型多路内插时域交织电流源开关dac的分模块结构示意图；

图2是本发明实施例提供的一种新型多路内插时域交织电流源开关dac的总体结构示意图；

图3是本发明实施例提供的新型多路内插时域交织电流源开关dac的电路实例图；

图4是本发明实施例提供的输入信号与时钟信号预编码示意图；

图5是本发明实施例提供的新型多路内插时域交织电流源开关dac的优化电路图；

图6是本发明实施例提供的普通模式下的控制信号时序图；

图7是本发明实施例提供的混合模式下的控制信号时序图；

图8是本发明实施例提供的正弦输出普通模式和混合模式dac的输出波形对比图；

图9是本发明实施例提供的正弦输出普通模式和混合模式dac的滚降特性对比图。

具体实施方式

下面结合具体实施例对本发明做进一步详细的描述，但本发明的实施方式不限于此。

实施例一

请参见图1，图1是本发明实施例提供的一种新型多路内插时域交织电流源开关dac分模块结构示意图；

本发明所提供的多路内插时域交织电流源开关的数模转换器(dac)，包括：

电流源模块(1)，用于向数模转换器提供电流；

多级多通道内插开关模块(2)，电连接所述电流源模块(1)，用于接收并处理开关码信号得到待输出信号；

输出模块(3)，电连接所述多级多通道内插开关模块(2)，用于接收并处理所述待输出信号得到dac输出信号。

在本实施例中，多路内插时域交织电流源开关的数模转换器还包括预编码模块(4)，用于接收dac多通道输入信号并与特定时钟信号进行“与”运算得到所述开关码信号。请参见图2，图2是本发明实施例提供的一种新型多路内插时域交织电流源开关dac的总体结构示意图；

下面以四通道输入信号和两级开关为例来对本发明进行详细说明。

请参见图3，图3是本发明实施例提供的新型多路内插时域交织电流源开关dac的电路实例图。

在本实施例中，预编码模块(4)包括四通道输入信号和两个特定时钟信号。其中，ch1、ch2、ch3、ch4为四通道输入信号，clk5g_1和clk5g_2为特定时钟信号。请参见图4，图4为本发明实施例提供的输入信号与时钟信号预编码示意图。四通道输入信号ch1、ch2、ch3、ch4及其反相信号与时钟信号clk5g_1、clk5g_2及其反相信号进行“与”门运算，产生8路开关码信号，din1、din2、din3、din4及其互补信号这8路开关码信号作为输入连接多级多通道内插开关模块(20)。

在本实施例中，电流源模块(1)包括两个电流源(is)，均连接多级多通道内插开关模块(2)。电流源(is)可采用共源共栅电流源，为提高电流源精度，也可采用校准电流源dac或其他电流源结构。

在本实施例中，多级多通道内插开关模块(2)包括两级开关单元。

第一级开关单元为两组四开关(quad-switching，qs)单元(21)，每组四开关单元由两个差分对管组成，每个差分对管由两个性能参数相同的n型mos晶体管组成。

预编码模块产生的8路开关码信号作为第一级开关单元8个晶体管的栅极输入信号，并控制这8个晶体管的导通或关断。晶体管的源极接电流源(is)，漏极作为输出接口连接第二级开关单元。

在同一时刻，两组四开关单元中，均只有一个开关导通，其余三个开关关断，电流源电流从导通晶体管的支路通过。

第二级开关单元为两组归零(return-to-zero，rz)开关单元(22)，接在第一级开关单元与输出模块之间，由性能参数相同的nm1和nm2、nm3和nm4、nm5和nm6、nm7和nm8这四组n型mos差分对管组成。特定时钟信号clk10g及其互补信号控制归零开关模块8个晶体管的导通或关断,表现为clk10g作为nm1、nm4、nm6和nm7的栅极输入信号，作为nm2、nm3、nm5和nm8的栅极输入信号。在clk10g为高电平、为低电平时，nm1导通并开启电流到out+输出端的支路，nm4导通并开启电流到out-输出端的支路，nm6和nm7由于源极与电源相连虽然也导通但不影响电流输出，nm2、nm3、nm5和nm8截止；在clk10g为低电平、为高电平时，nm5导通并开启电流到out+输出端的支路，nm8导通并开启电流到out-输出端的支路，nm2和nm3由于源极与电源相连虽然也导通但不影响电流输出，nm1、nm4、nm6和nm7截止。

在本实施例中，多路内插时域交织电流源开关的数模转换器还包括电连接于差分对管漏端的8个支路电流(ibleed)。请参见图5，图5是本发明实施例提供的新型多路内插时域交织电流源开关dac优化电路图。8个支路电流(ibleed)对称连接在各mos差分对管的漏极，保证了mos差分对管漏端电压在开关高频切换时几乎不变，并且可以有效抑制晶体管寄生电容充放电效应，进一步提升dac性能。

在本实施例中，输出模块(3)对接收到的待输出信号进行去噪处理，然后利用交叉结构进行dac输出。输出模块(3)作为两级开关的后级，由四个具有厚栅氧工艺的mos管q1～q4组成，四个mos管的栅极连接栅极电压vb3，四个mos管的漏极交叉连接构成双端差分输出out+与out-，其中q1和q3的漏极连接out+输出，q2和q4的漏极连接out-输出。

在本实施例中，输出模块采用交叉输出的结构，这种交叉输出结构配合前面的多级多通道内插开关实现了多路内插时域交织，能够减小开关切换过程引起的非线性，提高开关动态性能，从而提高了数据的传输速率。此外，输出模块晶体管采用厚栅氧工艺，可以隔离噪声，具有提升dac的输出阻抗和改善频率特性的作用。

请参见图6，图6是本发明实施例提供的普通模式下的控制信号时序图。在普通模式下，预编码模块的时钟信号clk5g_2相比时钟信号clk5g_1延迟1/4时钟周期；输入信号ch2、ch3、ch4分别相对输入信号ch1延后1/4时钟周期、1/2时钟周期、3/4时钟周期。

输入信号与时钟信号进行“与”运算产生的8路开关码为din1、din2、din3、din4、这8路开关码控制2个四开关模块的各个晶体管导通与关断，对应的8组逻辑表达式如下：

din1＝ch1·clk5g_1；din2＝ch2·clk5g_2；

时钟信号clk10g与控制2个归零开关模块的各个晶体管导通与关断，其时钟周期是预编码模块时钟周期的一半，即归零开关模块时钟频率为预编码模块时钟频率的2倍。四路输入信号ch1、ch2、ch3、ch4以4倍输入速率依次紧凑在out+端传输；四路输入信号的反相信号以4倍输入速率依次紧凑在out-端传输。四路并行输入转换为串行内插输出，dac输出信号为四路并行输入信号的4倍内插紧凑传输形式。

在本实施例中，时钟信号clk5g_1可选为5ghz方波信号，clk5g_2由clk5g_1延时50ps(也就是1/4时钟周期)得到。4路输入信号ch1、ch2、ch3、ch4的传输速率为5gsps。时钟信号clk10g与为10ghz方波信号。那么输出信号out+与out-的传输速率则为20gsps，是输入速率的4倍。

由此可见，本发明以多路较低输入速率和在较低时钟频率的情况下实现了超高速输出。

需要说明的是，输入信号和时钟信号的频率不限于这一情况，选用其他频率同样可以实现本发明设计方案。

请参见图7，图7是本发明实施例提供的混合模式下的控制信号时序图。与普通模式不同的是，四通道输入信号ch1、ch2、ch3、ch4中的ch2、ch4变为其反相形式。输入信号与时钟信号进行预编码“与”运算产生的8路开关码为din1、din2、din3、din4、混合模式下这8路开关码对应的逻辑表达式如下：

输入信号ch1、反相输入信号输入信号ch3、反相输入信号以4倍输入速率依次紧凑在out+端传输，反相输入信号输入信号ch2、反相输入信号输入信号ch4以4倍输入速率依次紧凑在out-端传输。dac的输出信号为并行输入信号的异相内插紧凑传输，输出信号波形变为混频形式。

在本实施例中，以正弦输出为例进行普通模式和混合模式对比说明。

请参见图8和图9，图8是本发明实施例提供的正弦输出普通模式和混合模式dac的输出波形对比图，图9是本发明实施例提供的正弦输出普通模式和混合模式dac的滚降特性对比图。由图可见，普通模式下，dac能够合成第一奈奎斯特区内的高质量宽带信号，输出有效带宽相比混合模式有显著展宽；混合模式下dac能够合成第二奈奎斯特区内的高质量宽带信号，输出有效带宽相比普通模式有显著展宽。在实际应用时，可用二选一的触发方式在普通/混合两种模式间自由切换。

本发明提供的多路内插时域交织电流源开关dac结构精简，应用灵活，通过多级多通道内插开关模块和交叉输出结构完成多路内插结构，实现了较低输入速率和较低时钟频率情况下的超高速宽频带输出。

以上内容是结合具体的优选实施方式对本发明所作的进一步详细说明，不能认定本发明的具体实施只局限于这些说明。对于本发明所属技术领域的普通技术人员来说，在不脱离本发明构思的前提下，还可以做出若干简单推演或替换，都应当视为属于本发明的保护范围。