时间控制装置、时间控制方法和程序的制作方法
【专利摘要】本发明涉及一种时间控制装置、时间控制方法和程序，利用其可以高度精确地使时间信息与网络上的主机设备同步。所公开的时间控制装置包括：计算单元，其基于在所述时间控制装置和所述主机设备之间传送和接收的消息的传送时间和接收时间，计算在所述时间控制装置和所述主机设备之间的时间差以及表示经由所述网络传递所述消息所需的时间的网络延迟；PID处理单元，其基于所计算的时间差，生成反馈控制值(f1)用于对所述从机设备的时间信息执行反馈控制；f0生成单元，其基于所生成的反馈控制值(f1)，生成反馈控制值f0；以及调整单元，其根据基于所计算的网络延迟选择的所述反馈控制值(f1)或所述反馈控制值(f0)调整所述从机设备的时间信息。
【专利说明】时间控制装置、时间控制方法和程序
【技术领域】
[0001]本发明涉及一种时间控制装置、时间控制方法和程序，并且更具体地，涉及一种适用于以高精确度使时间信息与网络中的主机装置同步的时间控制装置、时间控制方法和程序。
【背景技术】
[0002]存在用于在经由网络彼此连接的装置之间使时间信息同步的机制，并且这种机制的已知示例之一是IEEE1588PTP (精确时间协议)(例如，参见专利文件I)。
[0003]根据IEEE1588PTP，在经由网络彼此连接的主机装置(在下文中称为PTP主机)和从机装置(在下文中称为PTP从机)之间交换PTP消息，使得关于PTP从机的时间信息T2可以在亚微秒级上以高精确度与关于PTP主机的时间信息Tl同步。具体地，PTP从机中的振荡频率F2可以与PTP主机中的振荡频率Fl同步，并且此后，时间信息T2可以与时间信息Tl同步。
[0004]图1示出使用IEEE1588PTP的传统高精确度时间同步过程的概况。 [0005]PTP主机被设计为通过网络以基于振荡频率Fl的预定间隔Am传送包含指示传送时间Tli的时间戳的作为PTP消息的Sync消息。同时，PTP从机被设计为接收从PTP主机传送的Sync消息，提取其中包含的指示传送时间Tli的时间戳，并且获取其接收时间T2it)即，PTP从机每次接收到Sync分组时获得传送时间Tli和接收时间T2it)
[0006]PTP从机还被设计为经由网络向PTP主机传送作为PTP消息的Delay_req，并且存储其传送时间T2X。在接收到Delay_req之后，PTP主机向PTP从机返回包含指示接收时间Tlx的时间戳的作为PTP消息的Delay_res。即，PTP从机通过传送Delay_req和接收响应于Delay_req从PTP主机返回的Delay_res而获得Delay_req的传送时间T2X和接收时间Tlx。
[0007]在此,假设经由网络传递诸如Sync消息、Delay_req或Delay_res的PTP消息所需的时间(在下文中称为网络延迟)不变化而是常数。
[0008]在该情况下，如果PTP从机的振荡频率F2与PTP主机的振荡频率Fl的完全同步，则PTP主机中的Sync消息传送间隔Am=Tl2-Tl1与PTP从机中的Sync消息接收间隔Δ 8=122-12!相同。换句话说，在Λ m和Λ s之间的差Λ m- Λ s不为O的情况下，PTP从机的振荡频率F2与PTP主机的振荡频率Fl不同，并且未建立同步。
[0009]因此，为了建立频率同步，应调整PTP从机的振荡频率F2，使得Am和As之间的差Am-As将变为O。在下文中，Am和As之间的差Δ m_ Δ s将被称为频率差。根据下列等式(I)计算频率差。
[0010]频率差ΛIH-As= (Tl2-Tl1)-O^2-TS1) = (TS1-Tl1)-O^2-Tl2)......(I)
[0011]为了建立时间同步，如上所述PTP从机在建立频率同步之后传送Delay_req，并且接收作为响应的Delay_reS，以获得Delay_req的传送时间T23和接收时间Tl3。
[0012]在关于PTP主机的时间信息Tl和关于PTP从机的时间信息Τ2之间的差是时间差的情况下，满足下面示出的等式(2)和(3)，并且根据等式(2)和(3)确定也在下面示出的等式⑷。
[0013]接收时间T22-传送时间Tl2=网络延迟+时间差……(2)
[0014]接收时间Tl3-传送时间T23=网络延迟-时间差……(3)
[0015]时间差={(Τ22-Τ13)-(Τ12-Τ23)}/2……(4)
[0016]在PTP从机中，应调整时间信息T2，使得由等式(4)表示的时间差将为O。[0017]图2示出在PTP从机中用于建立时间同步的时间控制装置的示例结构。
[0018]该时间控制装置10包括减法单元11、12和13、除法单元14、平均值计算单元15、PID (比例积分微分)处理单元16和时间调整单元17。
[0019]减法单元11如在上面的等式(2)中所示计算接收时间T22-传送时间Tl2，并向减法单元13输出结果。减法单元12如在上面的等式(3)中所示计算接收时间T23-传送时间Tl3，并且向减法单元13输出结果。减法单元13和除法单元14计算由上面的等式(4)表示的时间差，并向平均值计算单元15输出结果。
[0020]平均值计算单元15依序存储从前一级中的除法单元14输入的预定数目的时间差。每次从除法单元14输入时间差时，计算输入的时间差和预定数目的存储的时间差间的平均值并将其输出到PID处理单元16。
[0021]PID处理单元16从平均值计算单元15接收平均时间差的输入，计算反馈控制值Π用于对后一级中的时间调整单元17执行PID控制，并且向时间调整单元17输出计算结果。时间调整单元17基于反馈控制值fl调整时间信息T2。
[0022]引用列表
[0023]专利文件
[0024]专利文件1:日本专利申请公开N0.2010-190635
【发明内容】
[0025]本发明待解决的问题
[0026]当诸如视频信号的高容量分组在PTP主机和PTP从机连接的网络中流动时，网络中发生拥塞，并且上面描述的PTP消息的网络延迟可能临时变长。
[0027]在这种情况下，不满足上面描述的假设“PTP消息的网络延迟不变化而是常数”。因此，不能通过上面描述的方法准确地建立频率同步和时间同步。
[0028]本公开鉴于那些情况做出，并且旨在以高精确度使时间信息与网络中的主机装置同步。
[0029]问题的解决方法
[0030]作为本公开的一方面的时间控制装置是这样的时间控制装置，其安装在从机装置中，并且使时间信息与所述从机装置经由网络连接到的主机装置同步。所述时间控制装置包括:计算单元，其基于与所述主机装置交换的消息的传送时间和接收时间计算与所述主机装置的时间差和网络延迟，所述网络延迟指示经由所述网络传递所述消息所需的时间段；PID处理单元，其基于所计算的时间差生成反馈控制值f I，所述反馈控制值f I用于对关于所述从机装置的时间信息执行反馈控制；f0生成单元，其基于所生成的反馈控制值Π生成反馈控制值fO ;以及调整单元，其根据基于所计算的网络延迟选择的所述反馈控制值Π或反馈控制值fO调整关于所述从机装置的时间信息。
[0031]所述调整单元当所计算的网络延迟在从所述最小网络延迟值的预定范围内时，可以根据所述反馈控制值fl调整关于所述从机装置的时间信息，并且当所计算的网络延迟在从所述最小网络延迟值的预定范围外时，可以根据所述反馈控制值fO调整关于所述从机装置的时间信息。
[0032]所述fO生成单元可以通过计算当满足预定条件时生成的反馈控制值f I的平均值而生成所述反馈控制值fO。
[0033]所述fO生成单元可以通过计算当所计算的时间差为O时生成的反馈控制值f I的平均值而生成所述反馈控制值fO。
[0034]所述fO生成单元可以通过计算当所计算的时间差小于预定阈值时生成的反馈控制值Π的平均值而生成所述反馈控制值fO。
[0035]所述fO生成单元可以通过计算当所计算的网络延迟小于预定阈值时生成的反馈控制值Π的平均值而生成所述反馈控制值fO。
[0036]在预定操作开始时段期间，所述fO生成单元可以通过计算当所计算的时间差小于预定阈值时生成的反馈控制值Π的平均值而生成所述反馈控制值f0，并且在所述预定操作开始时段之后，所述fO生成单元可以通过计算当所计算的时间差为O时生成的反馈控制值Π的平均值而生成所述反馈控制值fO。
[0037]在预定操作开始时段期间，所述fO生成单元可以通过计算当所计算的时间差小于第一阈值时生成的反馈控制值Π的平均值而生成所述反馈控制值f0，并且在所述预定操作开始时段之后，所述fO生成单元可以通过计算当所计算的时间差小于比所述第一阈值小的第二阈值时生成的反馈控制值Π的平均值而生成所述反馈控制值fO。
[0038]在预定操作开始时段期间，所述fO生成单元可以通过计算当所计算的网络延迟小于第一阈值时生成的反馈控制值Π的平均值而生成所述反馈控制值f0，并且在所述预定操作开始时段之后，所述fO生成单元可以通过计算当所计算的网络延迟小于比所述第一阈值小的第二阈值时生成的反馈控制值fl的平均值而生成所述反馈控制值fO。
[0039]作为本公开的一方面的时间控制方法是这样的时间控制方法，其在安装在从机装置中的时间控制装置中实现，并且使时间信息与所述从机装置经由网络连接到的主机装置同步。所述时间控制方法包括:计算步骤，基于与所述主机装置交换的消息的传送时间和接收时间计算与所述主机装置的时间差和网络延迟，所述网络延迟指示经由所述网络传递所述消息所需的时间段；PID处理步骤，基于所计算的时间差生成反馈控制值Π，所述反馈控制值Π用于对关于所述从机装置的时间信息执行反馈控制；f0生成步骤，基于所生成的反馈控制值fl生成反馈控制值fO ;以及调整步骤，根据基于所计算的网络延迟选择的所述反馈控制值fl或反馈控制值fO调整关于所述从机装置的时间信息，所述步骤由所述时间控制装置实现。
[0040]作为本公开的一方面的程序是这样的程序，其由安装在从机装置中的计算机执行，并且使时间信息与所述从机装置经由网络连接到的主机装置同步。所述程序使得所述计算机用作:计算单元，其基于与所述主机装置交换的消息的传送时间和接收时间计算从所述主机装置的时间差和网络延迟，所述网络延迟指示经由所述网络传递所述消息所需的时间段；PID处理单元，其基于所计算的时间差生成反馈控制值fl，所述反馈控制值fl用于对关于所述从机装置的时间信息执行反馈控制；f0生成单元，其基于所生成的反馈控制值Π生成反馈控制值fO ;以及调整单元，其根据基于所计算的网络延迟选择的所述反馈控制值fl或反馈控制值fO调整关于所述从机装置的时间信息。
[0041]在本公开的一方面中，基于与所述主机装置交换的消息的传送时间和接收时间计算从所述主机装置的时间差和指示经由网络传递消息所需的时间段的网络延迟。基于所计算的时间差生成反馈控制值fl用于对关于所述从机装置的时间信息执行反馈控制。基于所生成的反馈控制值Π生成反馈控制值fO。根据基于所计算的网络延迟选择的所述反馈控制值Π或反馈控制值fO调整关于所述从机装置的时间信息。
[0042]本发明的效果
[0043]根据本公开的一方面，可以以高精确度使时间信息与网络中的主机装置同步。
【专利附图】
【附图说明】
[0044]图1是示出使用IEEE1588PTP的传统高精确度时间同步过程的概况的图。
[0045]图2是示出传统时间控制装置的示例结构的框图。
[0046]图3是示出应用本公开的时间控制装置的示例结构的框图。
[0047]图4是示出图3中示出的fO生成单元的第一示例结构的框图。
[0048]图5是用于解释图3中示出的时间控制装置的操作的流程图。
[0049]图6是示出图3中示出的fO生成单元的第二示例结构的框图。
[0050]图7是示出计算机的示例结构的框图。
【具体实施方式】
[0051]下文是参考附图的用于实现本公开(在下文中称为实施例)的最佳模式的详细描述。
[0052]在与网络中的PTP主机(主机装置)交换PTP消息以使得时间信息与PTP主机同步的PTP从机(从机装置)中包括作为本公开的实施例的时间控制装置。假设在使时间信息与PTP主机同步之前，PTP从机的振荡频率F2已经以高精确度与PTP主机的振荡频率Fl同
止/J/ O
[0053][时间控制装置的示例结构]
[0054]图3示出作为实施例的时间控制装置的示例结构。该时间控制装置30包括网络延迟/时间差计算单元31、开关37、最小值检测单元38、比较单元39、PID处理单元40、fO生成单元41、选择器42和时间调整单元43。
[0055]网络延迟/时间差计算单元31包括减法单元32到34、除法单元35和加法单元36。
[0056]减法单元32如上面的等式(2)中所示计算接收时间T22-传送时间Tl2，并向减法单元34和加法单元36输出结果。减法单元33如上面的等式(3)中所示计算接收时间T23-传送时间Tl3，并向减法单元34和加法单元36输出结果。减法单元34和除法单元35根据上面的等式(4)计算时间差，并向开关37输出时间差。加法单元36通过将上面的等式(2)与上面的等式(3)相加而计算网络延迟X2，并向最小值检测单元38和比较单元39输出结果。[0057]开关37在比较单元39的控制下接通和断开，并向PID处理单元40和fO生成单元41输出从网络延迟/时间差计算单元31的除法单元35输入的时间差。
[0058]最小值检测单元38不断监视从网络延迟/时间差计算单元31的加法单元36输入的网络延迟X2。如果输入值小于存储的最小值，则存储的最小值更新为输入值。最小值检测单元38还向比较单元39通知存储的最小值。
[0059]比较单元39基于在最小值检测单元38中存储的最小值确定从加法单元36输入的网络延迟X 2是否等于或小于预定阈值，并且随后基于确定结果控制开关37和选择器42。具体地，如果确定结果为肯定的，则开关37接通，并且选择器42接通至输入端42a。另一方面，如果确定结果为否定的，则开关37断开，并且选择器42接通至输入端42b。
[0060]PID处理单元40经由开关37从网络延迟/时间差计算单元31接收时间差的输入，计算用于对后一级中的时间调整单元43执行PID控制的反馈控制值Π，并且向选择器42的输入端42a和fO生成单元41输出反馈控制值H。
[0061]在从PID处理单元40依序输入的反馈控制值fl中，fO生成单元41存储当经由开关37从网络延迟/时间差计算单元31输入的时间差满足预定条件时输入的反馈控制值fl。fO生成单元41还通过获得存储的反馈控制值fI的平均值而计算反馈控制值fO,并且向选择器42的输入端42b输出反馈控制值fO。
[0062]在比较单元39的控制下，选择器42向时间调整单元43输出输入到输入端42a的反馈控制值Π或输入到输入端42b的反馈控制值fO。时间调整单元43调整基于反馈控制值fO或反馈控制值fl调整关于内部时钟的时间信息T2。
[0063][fO生成单元41的第一示例结构]
[0064]图4示出fO生成单元41的第一示例结构。
[0065]fO生成单元41的第一示例结构包括时序生成单元50、锁存器51、延迟单元52_1到52-N以及平均值计算单元53。
[0066]时序生成单元50监视经由开关37从网络延迟/时间差计算单元31输入的时间差，并且当时间差为O时向锁存器51输出控制信号。
[0067]在从PID处理单元40依序输入的反馈控制值f I中，锁存器51向延迟单元52_1和平均值计算单元53输出当从时序生成单元50输入控制信号时输入的反馈控制值fl。
[0068]当从锁存器51输入反馈控制值f I时，延迟单元52-1向后一级中的延迟单元52_2和平均值计算单元53输出目前在其中存储的反馈控制值fl，并且存储从锁存器51输入的反馈控制值fl。同样，当从前一级输入反馈控制值fl时，延迟单元52-1到52-N中的每一个向后一级输出目前在其中存储的反馈控制值Π，并且存储从前一级输入的反馈控制值fl。
[0069]平均值计算单元53计算从锁存器51和延迟单元52-1到52-N输入的(N+1)个反馈控制值fl的平均值，并向选择器42的输入端42b输出平均值。
[0070]当时间差为O时时序生成单元50可以不向锁存器51输出控制信号，而当时间差小于预定阈值时向锁存器51输出控制信号。可替换地，由加法单元36计算的网络延迟可以输入到时序生成单元50，并且当网络延迟小于预定阈值时可以向锁存器51输出控制信号。
[0071][操作的描述]
[0072]然后，描述时间控制装置30的操作。图5是用于解释由时间控制装置30执行的时间控制过程的流程图。
[0073]该时间控制过程以规则的间隔执行。步骤SI中，网络延迟/时间差计算单元31的减法单元32如上面的等式(2)中所示计算接收时间T22-传送时间Tl2，并向减法单元34和加法单元36输出结果。步骤S2中，减法单元33如上面的等式(3)中所示计算接收时间T23-传送时间Tl3，并向减法单元34和加法单元36输出结果。
[0074]步骤S3中，减法单元34和除法单元35根据上面的等式(4)计算时间差，并向开关37输出结果。加法单元36通过将上面的等式(2)与上面的等式(3)相加而计算网络延迟X 2，并向最小值检测单元38和比较单元39输出结果。
[0075]步骤S4中，比较单元39基于在最小值检测单元38中存储的最小值确定从加法单元36输入的网络延迟X2是否等于或小于预定阈值。如果此时确定结果为肯定的，则过程前进到步骤S5。
[0076]步骤S5中，开关37在比较单元39的控制下接通。基于经由开关37从网络延迟/时间差计算单元31输入的时间差，PID处理单元40计算用于对时间调整单元43执行PID控制的反馈控制值Π，并且向选择器42的输入端42a和fO生成单元41输出反馈控制值
flo
[0077]步骤S6中，fO生成单元41还基于从PID处理单元40依序输入的反馈控制值Π计算反馈控制值f0，并向选择器42的输入端42b输出反馈控制值fO。
[0078]步骤S7中，选择器42在比较单元39的控制下接通至输入端42a，并向时间调整单元43输出反馈控制值fl。步骤S8中，时间调整单元43基于反馈控制值fl调整关于内部时钟的时间信息T2。
[0079]如果步骤S4中的确定结果否定的，则过程前进到步骤S9。步骤S9中，开关37在比较单元39的控制下断开。此外，选择器42在比较单元39的控制下接通至输入端42b，并向时间调整单元43输出步骤S6中生成的反馈控制值fO。时间控制过程随后结束。
[0080]如上所述，在由时间控制装置30执行的时间控制过程中，即使在网络延迟较长的情况下(或在网络延迟X 2等于或大于预定阈值的情况下)，时间调整单元43基于当时间差为O时获得的作为反馈控制值fl的平均值的反馈控制值fO来调整时间信息T2。因此，可以使得来自关于主机装置的时间信息Tl的差小于其中当网络延迟较长时不执行时间调整(或其中网络延迟X 2等于或大于预定阈值)的传统情况。
[0081][fO生成单元41的第二示例结构]
[0082]图6示出fO生成单元41的第二示例结构。
[0083]fO生成单元41的第二示例结构包括计数器61、比较单元62、第一时序生成单元63、第二时序生成单元64、锁存器51、延迟单元52-1到52-N以及平均值计算单元53。
[0084]计数器61在时间控制装置30的操作开始时复位为O。此后，每次从PID处理单元40输入反馈控制值f I时，计数器61将其计数器值递增I，并向比较单元62通知计数值。比较单元62将计数器61的计数值与预定固定值相比较，并使得第一时序生成单元63或第二时序生成单元64根据比较结果而操作。具体地，在计数值超过预定固定值之前使得第一时序生成单元63操作，而在计数值超过预定固定值之后使得第二时序生成单元64操作。
[0085]第一时序生成单元63监视经由开关37从网络延迟/时间差计算单元31输入的时间差，并且当时间差小于预定阈值(正值)时向锁存器51输出控制信号。[0086]第二时序生成单元64监视经由开关37从网络延迟/时间差计算单元31输入的时间差，并且当时间差为O时向锁存器51输出控制信号。
[0087]锁存器51、延迟单元52-1到52_N以及平均值计算单元53与图4中示出的fO生成单元41的第一示例结构相同，并且因此，在此不重复其解释。
[0088]在fO生成单元41的第二示例结构中，在时间控制装置30的操作开始时在初始级中生成用于锁存器51的控制信号的频率高于图4中示出的fO生成单元41的第一示例结构。因此，可以更快地生成反馈控制值fO。此时生成的反馈控制值fO并非基于关于时间差O的反馈控制值Π，并且每个反馈控制值f I包括误差(正/负随机分布)。然而，反馈控制值fO是反馈控制值fl的平均值，并且因此，可以预计误差彼此消除和减小。
[0089]鉴于此，在网络延迟X 2大于基于在最小值检测单元38中存储的最小值的预定阈值，并且反馈控制值fO输入到时间调整单元43的情况下，可以在比第一示例结构中时间调整短的时间段中执行时间调整。
[0090]此外，在网络延迟X 2等于或小于基于在最小值检测单元38中存储的最小值的预定阈值，并且反馈控制值fl输入到时间调整单元43的情况下，可以以与第一示例结构相同的精确度执行时间调整。
[0091]在上面描述的示例中，第一时序生成单元63确定时间差是否小于预定阈值，并且第二时序生成单元64确定时间差是否为O。然而，第一时序生成单元63可以确定时间差是否小于预定第一阈值，并且第二时序生成单元64可以确定时间差是否小于比第一阈值小的第二阈值。
[0092]可替换地，第一时序生成单元63可以确定网络延迟是否小于预定第一阈值，并且第二时序生成单元64可以确定网络延迟是否小于比第一阈值小的第二阈值。
[0093]可以利用硬件或软件执行时间控制装置30的上面描述的一系列处理。在利用软件执行一系列处理的情况下，将形成软件的程序安装到计算机中。在此，计算机可以是并入专用硬件的计算机，或可以是当在其中安装了各种类型的程序时可以执行各种类型的功能的通用计算机。
[0094]图7是示出根据程序执行上面描述的一系列处理的计算机硬件示例结构的框图。
[0095]在计算机中，CPU (中央处理单元)10UR0M (只读存储器)102和RAM (随机访问存储器)103通过总线104彼此连接。
[0096]输入/输出接口 105进一步连接到总线104。输入单元106、输出单元107、存储单元108、通信单元109和驱动器110连接到输入/输出接口 105。
[0097]输入单元106由键盘、鼠标和麦克风等形成。输出单元107由显示器和扬声器等形成。存储单元108由硬盘或非易失性存储器等形成。通信单元109由网络接口等形成。驱动器110驱动诸如磁盘、光盘、磁光盘或半导体存储器的可移除介质。
[0098]在具有上面描述的结构的计算机中，CPU101经由输入/输出接口 105和总线104将在存储单元108中存储的程序加载到RAM103中，并且执行所述程序，使得执行上面描述的一系列处理。
[0099]例如，由计算机(CPU101)执行的程序可以记录在作为要提供的封装介质的可移除介质111上。可替换地，可以经由诸如局域网、因特网或数字卫星广播的有线或无线传送介质提供所述程序。[0100]在计算机中，当将可移除介质111装载在驱动器110上时，所述程序可以经由输入/输出接口 105安装到存储单元108中。所述程序还可以经由有线或无线传送介质由通信单元109接收，并且安装到存储单元108中。此外，所述程序可以预先安装到R0M102或存储单元108中。
[0101]由计算机执行的程序可以是用于根据在此说明书中描述的序列按时间顺序执行处理的程序，或者可以是用于并行执行处理或必要时(诸如当存在调用时)执行处理的程序。
[0102]本公开的实施例不限于上面描述的实施例，并且可以做出各种改变，而不背离本公开的范围。
[0103]参考标号列表
[0104]30时间控制装置
[0105]31网络延迟/时间差计算单元
[0106]32-34减法单元
[0107]35除法单元
[0108]36加法单元
[0109]37 开关
[0110]38最小值检测单元
[0111]39比较单元
[0112]40 PID处理单元
[0113]41 fO生成单元
[0114]42选择器
[0115]43时间调整单元
[0116]50时序生成单元
[0117]51锁存器
[0118]52延迟单元
[0119]53平均值计算单元
[0120]61计数器
[0121]62比较单元
[0122]63第一时序生成单元
[0123]64第二时序生成单元
【权利要求】
1.一种时间控制装置，其安装在从机装置中，并且使时间信息与所述从机装置经由网络连接到的主机装置同步， 所述时间控制装置包括: 计算单元，其被配置为基于与所述主机装置交换的消息的传送时间和接收时间计算网络延迟以及与所述主机装置的时间差，所述网络延迟指示经由所述网络传递所述消息所需的时间段； PID处理单元，其被配置为基于所计算的时间差生成反馈控制值Π，所述反馈控制值fl用于对关于所述从机装置的时间信息执行反馈控制； fO生成单元，其被配置为基于所生成的反馈控制值Π生成反馈控制值fO ;以及调整单元，其被配置为根据基于所计算的网络延迟选择的所述反馈控制值Π或反馈控制值fO调整关于所述从机装置的时间信息。
2.如权利要求1所述的时间控制装置，其中， 当所计算 的网络延迟在从最小网络延迟值起的预定范围内时，所述调整单元根据所述反馈控制值Π调整关于所述从机装置的时间信息，以及， 当所计算的网络延迟在从所述最小网络延迟值起的预定范围外时，所述调整单元根据所述反馈控制值fO调整关于所述从机装置的时间信息。
3.如权利要求2所述的时间控制装置，其中，所述fO生成单元通过计算当满足预定条件时生成的多个反馈控制值Π的平均值而生成所述反馈控制值fO。
4.如权利要求3所述的时间控制装置，其中，所述fO生成单元通过计算当所计算的时间差为O时生成的多个反馈控制值Π的平均值而生成所述反馈控制值fO。
5.如权利要求3所述的时间控制装置，其中，所述fO生成单元通过计算当所计算的时间差小于预定阈值时生成的多个反馈控制值fl的平均值而生成所述反馈控制值fO。
6.如权利要求3所述的时间控制装置，其中，所述fO生成单元通过计算当所计算的网络延迟小于预定阈值时生成的多个反馈控制值Π的平均值而生成所述反馈控制值fO。
7.如权利要求3所述的时间控制装置，其中， 在预定操作开始时段期间，所述fO生成单元通过计算当所计算的时间差小于预定阈值时生成的多个反馈控制值Π的平均值而生成所述反馈控制值f0，以及， 在所述预定操作开始时段之后，所述fO生成单元通过计算当所计算的时间差为O时生成的多个反馈控制值fl的平均值而生成所述反馈控制值fO。
8.如权利要求3所述的时间控制装置，其中， 在预定操作开始时段期间，所述fO生成单元通过计算当所计算的时间差小于第一阈值时生成的多个反馈控制值Π的平均值而生成所述反馈控制值fO，以及， 在所述预定操作开始时段之后，所述fO生成单元通过计算当所计算的时间差小于比所述第一阈值小的第二阈值时生成的多个反馈控制值fl的平均值而生成所述反馈控制值fOo
9.如权利要求3所述的时间控制装置，其中， 在预定操作开始时段期间，所述fO生成单元通过计算当所计算的网络延迟小于第一阈值时生成的多个反馈控制值fl的平均值而生成所述反馈控制值f0，以及， 在所述预定操作开始时段之后，所述fO生成单元通过计算当所计算的网络延迟小于比所述第一阈值小的第二阈值时生成的多个反馈控制值fl的平均值而生成所述反馈控制值fO。
10.一种时间控制方法，其在时间控制装置中实现，所述时间控制装置安装在从机装置中并且使时间信息与所述从机装置经由网络连接到的主机装置同步， 所述时间控制方法包括: 计算步骤，基于与所述主机装置交换的消息的传送时间和接收时间计算网络延迟以及与所述主机装置的时间差，所述网络延迟指示经由所述网络传递所述消息所需的时间段；PID处理步骤，基于所计算的时间差生成反馈控制值Π，所述反馈控制值Π用于对关于所述从机装置的时间信息执行反馈控制； fO生成步骤，基于所生成的反馈控制值fl生成反馈控制值fO ;以及调整步骤，根据基于所计算的网络延迟选择的所述反馈控制值fl或反馈控制值fO调整关于所述从机装置的时间信息， 所述步骤由所述时间控制装置实现。
11.一种程序，其由计算机执行，所述程序安装在从机装置中并且使时间信息与所述从机装置经由网络连接到的主机装置同步， 所述程序使得所述计算机用作: 计算单元，其被配置为基于与所述主机装置交换的消息的传送时间和接收时间计算网络延迟以及与所述主机装置的时间差，所述网络延迟表示经由所述网络传递所述消息所需的时间段； PID处理单元，其被配置为基于所计算的时间差生成反馈控制值Π，所述反馈控制值fl用于对关于所述从机装置的时间信息执行反馈控制； fO生成单元，其被配置为基于所生成的反馈控制值π生成反馈控制值fO ;以及调整单元，其被配置 为根据基于所计算的网络延迟选择的所述反馈控制值Π或反馈控制值fO调整关于所述从机装置的时间信息。
【文档编号】H04L7/00GK103842917SQ201280047854
【公开日】2014年6月4日 申请日期:2012年9月27日 优先权日:2011年10月6日
【发明者】浜松俊彦, 染谷郁男, 儿岛俊明 申请人:索尼公司