专利名称：被屏蔽的电子电路单元及其制造方法
技术领域：
本发明涉及适合使用于电压控制器等的被屏蔽的电子电路单元及其制造方法。
背景技术：
图36是现有的电子电路单元的主要部分截面图，图37是表示现有的电子电路单元的制造方法的主要部分截面图，接着，基于图36说明现有的电子电路单元的结构，在多层基板51设置有具有信号用图案52与接地用图案53的配线图案P1，该配线图案P1的信号用图案52被设置在多层基板51的上表面与积层间(积层内)，且具有设置在多层基板51的侧面的下方部的端子部52a，并且，接地用图案53被设置在多层基板51的上表面与下表面。
由芯片部件构成的电子部件54具有设置在两端部的第一、第二电极54a、54b，该电子部件54被载置于多层基板51的上表面，第一电极54a被锡焊于信号用图案52，并且第二电极54b被锡焊于接地用图案53，从而电子部件54被搭载于多层基板51的上表面。
由绝缘材料构成的封固树脂部55，在埋设有电子部件54的状态下，被设置在多层基板51的上表面，并且在该封固树脂部55设置有从上表面部至接地用的第二电极54b的盲状孔55a。
而且，进行电屏蔽的金属膜56被设置于封固树脂部55的上表面部、盲状孔55a的壁面、以及位于盲状孔55a的底部的第二电极54b，从而形成现有的电子电路单元。
在此虽然没有图示出，不过具有这样的结构的现有的电子电路单元，其多层基板51的下表面被载置于母基板，设置在多层基板51的侧面的端子部52a被锡焊于设置在母基板上的导电图案，从而现有的电子电路单元被面安装于母基板。
但是，因为现有的电子电路单元是进行电屏蔽的金属膜56只被设置在封固树脂部55的上表面部的结构，所以利用金属膜56来进行的电屏蔽不充分，而且因为金属膜56被设置在盲状孔55a内，所以特别是在金属膜56利用电镀来形成时，在盲状孔55a内的电镀液的循环不充分，从而金属膜56对第二电极54b的附着变得不可靠。
接着，基于图37说明现有的电子电路单元的制造方法，首先，准备用于形成多个多层基板51的集合基板57，在该集合基板57上对应于各个多层基板51来搭载电子部件54。
接着，在集合基板57的上表面埋设电子部件54，在第二电极54b的位置设置具有盲状孔55a的封固树脂部55，之后，设置形成在封固树脂部55的上表面部与盲状孔55a内的、且连接于第二电极54b的金属膜56，然后在相互紧邻的多层基板51间的位置，集合基板57与封固树脂部55在切断线S3的位置被切断，电子电路单元被各个地断开，从而完成现有的电子电路单元的制造。
但是，因为现有的电子电路单元的制造方法，进行电屏蔽的金属膜56只被设置在封固树脂部55的上表面部，所以利用金属膜56来进行的电屏蔽不充分，而且因为金属膜56被设置在盲状孔55a内，所以特别是在金属膜56利用电镀来形成时，在盲状孔55a内的电镀液的循环不充分，从而金属膜56对第二电极54b的附着变得不可靠。
因为现有的电子电路单元及其制造方法是进行电屏蔽的金属膜56只被设置在封固树脂部55的上表面部的结构，所以有如下问题利用金属膜56来进行的电屏蔽不充分，而且因为金属膜56被设置在盲状孔55a内，所以特别是在金属膜56利用电镀来形成时，在盲状孔55a内的电镀液的循环不充分，从而金属膜56对第二电极54b的附着变得不可靠。
发明内容
因而，本发明的目的在于提供一种电屏蔽良好、金属膜与接地用图案的连接状态可靠的电子电路单元及其制造方法。
为了解决上述问题，本发明第一方面提供一种被屏蔽的电子电路单元，其结构如下具有设置有配线图案的多层基板、被搭载于该多层基板的上表面的电子部件、以及在埋设有该电子部件的状态下设置于所述多层基板的上表面的由绝缘材料构成的封固树脂部，所述多层基板具有相互相对的两对侧面，并且所述配线图案具有设置在所述多层基板的上表面或者/以及积层间的接地用图案，所述封固树脂部具有上表面部与相互相对的两对侧面部，在所述封固树脂部的所述上表面部与相互相对的所述侧面部设置有金属膜，并且所述金属膜设置在所述多层基板的相互相对的所述侧面，且在所述侧面的位置连接于所述接地用图案。
并且，本发明第二方面提供一种被屏蔽的电子电路单元，其结构如下所述金属膜被设置在所述封固树脂部的所述上表面部与相互相对的所述侧面部的整个面，并且与设置在所述多层基板的积层间的所述接地用图案相连接的所述金属膜，被设置在位于从所述多层基板的上表面至所述接地用图案之间的相互相对的所述侧面的整个面上。
并且，本发明第三方面提供一种被屏蔽的电子电路单元，其结构如下所述配线图案具有所述接地用图案与信号用图案，所述信号用图案被设置在比所述接地用图案更位于上方的所述多层基板的积层间。
并且，本发明第四方面提供一种被屏蔽的电子电路单元，其结构如下在所述多层基板具有连接导体，所述连接导体被设置为贯穿在从所述上表面到所述侧面的所述接地用图案所在的空间、且在所述侧面的位置连接于所述接地用图案，在该连接导体连接有所述金属膜。
并且，本发明第五方面提供一种被屏蔽的电子电路单元，其结构如下在所述多层基板具有侧电极，所述侧电极被设置在从所述上表面至所述多层基板的下表面的凹状的所述侧面、且在所述凹状的侧面的位置连接于所述接地用图案，在该侧电极连接有所述金属膜。
并且，本发明第六方面提供一种被屏蔽的电子电路单元，其结构如下在所述多层基板的下表面设置有连接于所述电子部件的端子部与所述接地用图案。
并且，本发明第七方面提供一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法准备本发明第二或者第三方面所述的电子电路单元与用于形成多个所述多层基板的集合基板，在所述集合基板设置了对应于各个所述多层基板而被搭载的所述电子部件与埋入设置有该电子部件的所述封固树脂部，之后，在相互紧邻的所述多层基板间的位置，在所述集合基板与所述封固树脂部上，在利用位于所述集合基板的下部侧的连结部来连结多个所述多层基板的状态下，从所述封固树脂部的上表面部至露出位于所述积层间的所述接地用图案的位置设置狭缝部，在所述封固树脂部利用所述狭缝部来形成相互相对的所述侧面部，并且，在所述多层基板利用所述狭缝部来形成相互相对的所述侧面的一部分，然后，在包括有所述狭缝部内的所述封固树脂部与所述集合基板设置连接于位于所述积层间的所述接地用图案的所述金属膜，其后，在所述集合基板、或者所述集合基板与所述封固树脂部，在相互紧邻的所述多层基板间的位置设置切断部，从而所述电子电路单元被各个地断开。
并且，本发明第八方面提供一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法准备本发明第四方面所述的电子电路单元与用于形成多个所述多层基板的集合基板，在所述集合基板设置了对应于各个所述多层基板而被搭载的所述电子部件；被设置在相互紧邻的所述多层基板间、且用于使位于所述积层间的所述接地用图案露出的切割条槽；连接于所述接地用图案、且用于形成被填充于所述切割条槽内的所述连接导体的导体部；以及包括有该导体部上地埋入设置有所述电子部件的所述封固树脂部，之后，在相互紧邻的所述多层基板间的位置，在所述集合基板与所述封固树脂部上，在利用位于所述集合基板的下部侧的连结部来连结多个所述多层基板的状态下，从所述封固树脂部的上表面部至位于所述积层间的所述接地用图案的位置设置狭缝部，在所述封固树脂部利用所述狭缝部来形成相互相对的所述侧面部，并且，在所述多层基板利用所述狭缝部来形成相互相对的所述侧面的一部分，并且所述导体部被所述狭缝部分割，在所述狭缝部内形成有连接于所述接地用图案的所述连接导体，然后，在包括有所述狭缝部内的所述封固树脂部与所述集合基板设置连接于所述连接导体与位于所述积层间的所述接地用图案的所述金属膜，其后，在所述集合基板、或者所述集合基板与所述封固树脂部，在相互紧邻的所述多层基板间的位置设置切断部，从而所述电子电路单元被各个地断开。
并且，本发明第九方面提供一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法准备本发明第五方面所述的电子电路单元与用于形成多个所述多层基板的集合基板，在所述集合基板设置了对应于各个所述多层基板而被搭载的所述电子部件；被设置于相互紧邻的所述多层基板间、且用于使位于所述积层间的所述接地用图案露出的、并用于形成所述凹状的侧面的贯通孔；连接于所述接地用图案、且用于形成在所述贯通孔内的壁面形成的所述侧电极的导电体；以及包括有所述贯通孔上地埋入设置有所述电子部件的所述封固树脂部，之后，在相互紧邻的所述多层基板间的位置，在所述集合基板与所述封固树脂部上，在利用位于所述集合基板的下部侧的连结部来连结多个所述多层基板的状态下，从所述封固树脂部的上表面至位于所述积层间的所述接地用图案所露出的位置设置狭缝部，在所述封固树脂部利用所述狭缝部来形成相互相对的所述侧面部，并且，在所述多层基板利用所述狭缝部来形成相互相对的所述侧面的一部分，并且所述贯通孔与所述导电体的一部分被所述狭缝部分割，在位于被分割的所述贯通孔内的所述凹状的侧面形成有连接于所述接地用图案的所述侧电极的一部分，然后，在包括有所述凹状的侧面与所述狭缝部内的所述封固树脂部与所述集合基板，设置连接于所述侧电极的一部分与位于所述积层间的所述接地用图案的所述金属膜，其后，在所述集合基板、或者所述集合基板与所述封固树脂部，在相互紧邻的所述多层基板间的位置设置切断部，从而所述电子电路单元被各个地断开。
并且，本发明第十方面提供一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法所述切断部以比所述狭缝部的宽度小的宽度尺寸来形成。
并且，本发明第十一方面提供一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法所述狭缝部，在已位于相互紧邻的所述多层基板间的状态下形成为格子状，在对应于所述狭缝部的位置而设置的所述连结部设置有所述切断部，从而所述电子电路单元被各个地断开。
并且，本发明第十二方面提供一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法所属金属膜通过电镀来形成。
发明效果在本发明的电子电路单元中，因为形成了如下结构金属膜被设置在埋入设置有电子部件的封固树脂部的上表面部与相互相对的侧面部、以及多层基板的相互相对的侧面的位置，且连接于设置在多层基板的上表面、或者多层基板的积层间的接地用图案，所以与现有的电子电路单元相比，利用金属膜而进行的电屏蔽良好，并且因为金属膜形成在封固树脂部的侧面部与多层基板的侧面，所以特别是在通过电镀来形成金属膜时，可以不需要现有的盲状孔，电镀液的循环良好，从而能够得到金属膜与接地用图案的连接状态可靠的电子电路单元。
并且，因为金属膜被设置于封固树脂部的上表面部与相互相对的侧面部的整个面，并且与设置在多层基板的积层间的接地用图案相连接的金属膜，被设置在位于从多层基板的上表面至接地用图案之间的相互相对的侧面的整个面上，所以能够得到利用金属膜而进行的电屏蔽进一步良好的电子电路单元。
并且，因为配线图案具有接地用图案与信号用图案，信号用图案被设置于比接地用图案更位于上方的多层基板的积层间，所以设置在比接地用图案更位于上方的多层基板的积层间的信号用图案可以利用金属膜而电屏蔽，从而能够得到屏蔽效果良好的电子电路单元。
并且，因为在多层基板具有连接导体，所述连接导体被设置为贯穿在从上表面到侧面的接地用图案所在的空间、且在侧面的位置连接于接地用图案，在该连接导体连接有金属膜，所以可以利用连接导体可靠地保持多层基板的侧面上的金属膜，并且能够得到金属膜的剥离少的电子电路单元。
并且，因为在多层基板具有侧电极，所述侧电极被设置在从上表面至多层基板的下表面的凹状的侧面、且在凹状的侧面的位置连接于接地用图案，在该侧电极连接有金属膜，所以可以利用侧电极可靠地保持多层基板的侧面上的金属膜，并且能够得到金属膜的剥离少的电子电路单元。
并且，因为在多层基板的下表面设置有连接于电子部件的端子部，所以可以进行电子电路单元的面安装，并且因为在多层基板的下表面设置有接地用图案，所以能够得到电屏蔽效果良好的电子电路单元。
并且，一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法具有电子电路单元与用于形成多个多层基板的集合基板，在集合基板设置了对应于各个多层基板而被搭载的电子部件与埋入设置有该电子部件的封固树脂部，之后，在相互紧邻的多层基板间的位置，在集合基板与封固树脂部上，在利用位于集合基板的下部侧的连结部来连结多个多层基板的状态下，从封固树脂部的上表面部至露出位于积层间的接地用图案的位置设置狭缝部，在封固树脂部利用狭缝部来形成相互相对的侧面部，并且，在多层基板利用狭缝部来形成相互相对的侧面的一部分，然后，在包括有狭缝部内的封固树脂部与集合基板设置连接于位于积层间的接地用图案的金属膜，其后，在集合基板、或者集合基板与封固树脂部，在相互紧邻的多层基板间的位置设置切断部，从而电子电路单元被各个地断开。
即，因为金属膜被设置在封固树脂部的上表面部与相互相对的侧面部的整个面，并且与设置在多层基板的积层间的接地用图案相连接的金属膜，被设置在位于从多层基板的上表面至接地用图案之间的相互相对的侧面的整个面，所以能够得到利用金属膜而进行的电屏蔽良好的电子电路单元，并且因为在封固树脂部与集合基板设置有狭缝部，所以特别是在通过电镀来形成金属膜时，电镀液的循环良好，从而能够得到金属膜与接地用图案的连接状态可靠的电子电路单元。
并且，一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法具有电子电路单元与用于形成多个多层基板的集合基板，在集合基板设置了对应于各个多层基板而被搭载的电子部件；被设置在相互紧邻的多层基板间、且用于使位于积层间的接地用图案露出的切割条槽；连接于接地用图案、且用于形成被填充于切割条槽内的连接导体的导体部；以及包括有该导体部上地埋入设置有电子部件的封固树脂部，之后，在相互紧邻的多层基板间的位置，在集合基板与封固树脂部上，在利用位于集合基板的下部侧的连结部来连结多个多层基板的状态下，从封固树脂部的上表面部至位于积层间的接地用图案的位置设置狭缝部，在封固树脂部利用狭缝部来形成相互相对的侧面部，并且，在多层基板利用狭缝部来形成相互相对的侧面的一部分，并且导体部被狭缝部分割，在狭缝部内形成有连接于接地用图案的连接导体，然后，在包括有狭缝部内的封固树脂部与集合基板设置连接于连接导体与位于积层间的接地用图案的金属膜，其后，在集合基板、或者集合基板与封固树脂部，在相互紧邻的多层基板间的位置设置切断部，从而电子电路单元被各个地断开。
即，因为金属膜被设置在封固树脂部的上表面部与相互相对的侧面部的整个面，并且与设置在多层基板的积层间的接地用图案相连接的金属膜，被设置在位于从多层基板的上表面至接地用图案之间的相互相对的侧面的整个面，所以能够得到利用金属膜而进行的电屏蔽良好的电子电路单元，并且因为在封固树脂部与集合基板设置有狭缝部，所以特别是在通过电镀来形成金属膜时，电镀液的循环良好，从而能够得到金属膜与接地用图案的连接状态可靠的电子电路单元，并且，因为金属膜连接于连接导体，所以可以可靠地保持多层基板的侧面上的金属膜，并且能够得到金属膜的剥离少的电子电路单元。
并且，一种被屏蔽的电子电路单元的制造方法，其是如下的制造方法具有电子电路单元与用于形成多个多层基板的集合基板，在集合基板设置了对应于各个多层基板而被搭载的电子部件；被设置于相互紧邻的多层基板间、且用于使位于积层间的接地用图案露出的、并用于形成凹状的侧面的贯通孔；连接于接地用图案、且用于形成在贯通孔内的壁面形成的侧电极的导电体；以及包括有贯通孔上地埋入设置有电子部件的封固树脂部，之后，在相互紧邻的多层基板间的位置，在集合基板与所述封固树脂部上，在利用位于集合基板的下部侧的连结部来连结多个多层基板的状态下，从封固树脂部的上表面至位于积层间的接地用图案所露出的位置设置狭缝部，在封固树脂部利用狭缝部来形成相互相对的侧面部，并且，在多层基板利用狭缝部来形成相互相对的侧面的一部分，并且贯通孔与导电体的一部分被狭缝部分割，在位于被分割的贯通孔内的凹状的侧面形成有连接于接地用图案的侧电极的一部分，然后，在包括有凹状的侧面与狭缝部内的封固树脂部与集合基板，设置连接于侧电极的一部分与位于积层间的接地用图案的金属膜，其后，在集合基板、或者集合基板与封固树脂部，在相互紧邻的多层基板间的位置设置切断部，从而电子电路单元被各个地断开。
即，因为金属膜被设置在封固树脂部的上表面部与相互相对的侧面部的整个面，并且与设置在多层基板的积层间的接地用图案相连接的金属膜，被设置在位于从多层基板的上表面至接地用图案之间的相互相对的侧面的整个面，所以能够得到利用金属膜而进行的电屏蔽良好的电子电路单元，并且因为在封固树脂部与集合基板设置有狭缝部，所以特别是在通过电镀来形成金属膜时，电镀液的循环良好，从而能够得到金属膜与接地用图案的连接状态可靠的电子电路单元，并且，因为金属膜连接于侧电极，所以可以可靠地保持多层基板的侧面上的金属膜，并且能够得到金属膜的剥离少的电子电路单元。
并且，因为切断部以比狭缝部的宽度小的宽度尺寸形成，所以能够得到在切断集合基板时，设置在狭缝部的侧壁面的金属膜不剥离的电子电路单元。
并且，因为狭缝部在已位于相互紧邻的多层基板间的状态下形成为格子状，在对应于狭缝部的位置而设置的连结部设置切断部，从而电子电路单元被各个地断开，所以在断开电子电路单元时的集合基板的切断只在连结部进行即可，从而能够得到生产率高的电子电路单元。
并且，因为金属膜通过电镀来形成，所以容易形成金属膜，从而能够得到生产率高的电子电路单元。
图1是本发明的电子电路单元的第一实施例的俯视图；图2是图1的2-2线的截面图；图3是表示本发明的电子电路单元的第一实施例的制造方法的第一工序的俯视图；图4是表示本发明的电子电路单元的第一实施例的制造方法的第一工序的截面图；图5是表示本发明的电子电路单元的第一实施例的制造方法的第二工序的截面图；图6是表示本发明的电子电路单元的第一实施例的制造方法的第三工序的俯视图；图7是表示本发明的电子电路单元的第一实施例的制造方法的第三工序的截面图；图8是表示本发明的电子电路单元的第一实施例的制造方法的第四工序的截面图；图9是表示本发明的电子电路单元的第一实施例的制造方法的第五工序的截面图；图10是本发明的电子电路单元的第二实施例的俯视图；图11是图10的11-11线的截面图；图12是图10的12-12线的截面图；图13是表示本发明的电子电路单元的第二实施例的制造方法的第三工序的俯视图；图14是本发明的电子电路单元的第三实施例的俯视图；图15是图14的15-15线的截面图；图16是表示本发明的电子电路单元的第三实施例的制造方法的第一工序的俯视图；图17是表示本发明的电子电路单元的第三实施例的制造方法的第一工序的截面图；图18是表示本发明的电子电路单元的第三实施例的制造方法的第二工序的俯视图；图19是表示本发明的电子电路单元的第三实施例的制造方法的第二工序的截面图；图20是表示本发明的电子电路单元的第三实施例的制造方法的第三工序的截面图；图21是表示本发明的电子电路单元的第三实施例的制造方法的第四工序的俯视图；图22是表示本发明的电子电路单元的第三实施例的制造方法的第四工序的截面图；图23是表示本发明的电子电路单元的第三实施例的制造方法的第五工序的截面图；图24是表示本发明的电子电路单元的第三实施例的制造方法的第六工序的截面图；图25是本发明的电子电路单元的第四实施例的俯视图；图26是图25的26-26线的截面图；
图27是表示本发明的电子电路单元的第四实施例的制造方法的第一工序的俯视图；图28是表示本发明的电子电路单元的第四实施例的制造方法的第一工序的截面图；图29是表示本发明的电子电路单元的第四实施例的制造方法的第二工序的俯视图；图30是表示本发明的电子电路单元的第四实施例的制造方法的第二工序的截面图；图31是表示本发明的电子电路单元的第四实施例的制造方法的第三工序的截面图；图32是表示本发明的电子电路单元的第四实施例的制造方法的第四工序的俯视图；图33是表示本发明的电子电路单元的第四实施例的制造方法的第四工序的截面图；图34是表示本发明的电子电路单元的第四实施例的制造方法的第五工序的截面图；图35是表示本发明的电子电路单元的第四实施例的制造方法的第六工序的截面图；图36是现有的电子电路单元的主要部分截面图；图37是表示现有的电子电路单元的制造方法的主要部分截面图。
符号说明1多层基板P配线图案2信号用图案2a端子部3接地用图案3a端子部4电子部件5封固树脂部
6金属膜7连接导体8侧电极11集合基板11a连结部11b切割条槽11c贯通孔12狭缝部13切断部14导体部15导电体S1、S2切断线具体实施方式
说明本发明的电子电路单元及其制造方法的附图，图1是本发明的电子电路单元的第一实施例的俯视图，图2是图1的2-2线的截面图，图3是表示本发明的电子电路单元的第一实施例的制造方法的第一工序的俯视图，图4是表示本发明的电子电路单元的第一实施例的制造方法的第一工序的截面图，图5是表示本发明的电子电路单元的第一实施例的制造方法的第二工序的截面图，图6是表示本发明的电子电路单元的第一实施例的制造方法的第三工序的俯视图，图7是表示本发明的电子电路单元的第一实施例的制造方法的第三工序的截面图，图8是表示本发明的电子电路单元的第一实施例的制造方法的第四工序的截面图，图9是表示本发明的电子电路单元的第一实施例的制造方法的第五工序的截面图。
并且，图10是本发明的电子电路单元的第二实施例的俯视图，图11是图10的11-11线的截面图，图12是图10的12-12线的截面图，图13是表示本发明的电子电路单元的第二实施例的制造方法的第三工序的俯视图。
并且，图14是本发明的电子电路单元的第三实施例的俯视图，图15是图14的15-15线的截面图，图16是表示本发明的电子电路单元的第三实施例的制造方法的第一工序的俯视图，图17是表示本发明的电子电路单元的第三实施例的制造方法的第一工序的截面图，图18是表示本发明的电子电路单元的第三实施例的制造方法的第二工序的俯视图，图19是表示本发明的电子电路单元的第三实施例的制造方法的第二工序的截面图，图20是表示本发明的电子电路单元的第三实施例的制造方法的第三工序的截面图，图21是表示本发明的电子电路单元的第三实施例的制造方法的第四工序的俯视图，图22是表示本发明的电子电路单元的第三实施例的制造方法的第四工序的截面图，图23是表示本发明的电子电路单元的第三实施例的制造方法的第五工序的截面图，图24是表示本发明的电子电路单元的第三实施例的制造方法的第六工序的截面图。
并且，图25是本发明的电子电路单元的第四实施例的俯视图，图26是图25的26-26线的截面图，图27是表示本发明的电子电路单元的第四实施例的制造方法的第一工序的俯视图，图28是表示本发明的电子电路单元的第四实施例的制造方法的第一工序的截面图，图29是表示本发明的电子电路单元的第四实施例的制造方法的第二工序的俯视图，图30是表示本发明的电子电路单元的第四实施例的制造方法的第二工序的截面图，图31是表示本发明的电子电路单元的第四实施例的制造方法的第三工序的截面图，图32是表示本发明的电子电路单元的第四实施例的制造方法的第四工序的俯视图，图33是表示本发明的电子电路单元的第四实施例的制造方法的第四工序的截面图，图34是表示本发明的电子电路单元的第四实施例的制造方法的第五工序的截面图，图35是表示本发明的电子电路单元的第四实施例的制造方法的第六工序的截面图。
接着，基于图1、图2说明本发明的电子电路单元的结构，由陶瓷材料等绝缘材料构成的多层基板1以四方形的积层基板形成，在此省略了符号，不过是具有上表面、下表面、相互相对的两对侧面、以及积层间(积层内)的结构。
配线图案P具有信号用图案2与接地用图案3，该配线图案P的信号用图案2被设置在多层基板1的上表面与积层间(积层内)，且具有设置在多层基板1的下表面的多个端子部2a，并且，接地用图案3被设置在多层基板1的积层间(积层内)与下表面，且具有设置在多层基板1的下表面的端子部3a，并且位于积层间的接地用图案3成为在多层基板1的相互相对的侧面露出的状态。
而且，在此虽未图示，但是信号用图案2的端子部2a利用通孔等连接体而连接于设置在上表面或者积层间的信号用图案2，并且，在此虽未图示，但是接地用图案3的端子部3a利用通孔或者侧(side)电极等连接体而连接于设置在积层间的接地用图案3。
另外，在图2中，信号用图案2与接地用图案3被设置在积层间，但是该信号用图案2与接地用图案3也可以在几层的积层间，并且，也可以不在积层间设置信号用图案2与接地用图案3，而是在上表面与下表面的两层具有信号用图案2与接地用图案3的两面基板。
由芯片部件等构成的电子部件4在被载置于多层基板1的上表面的状态下，被锡焊于信号用图案2，并被搭载于多层基板1的上表面，以此形成希望的电路。
由绝缘材料构成的封固树脂部5覆盖电子部件4的整体，在埋设有该电子部件4的状态下，被设置于多层基板1的上表面整体，该封固树脂部5形成四棱柱状，在此省略了符号，形成为具有上表面部与相互相对的两对侧面部的结构，且封固树脂部5的侧面部与多层基板1的侧面形成为同一平面状态。
通过电镀等形成的金属膜6被设置在封固树脂部5的上表面部的整面、封固树脂部5的相互相对的一对侧面部的整个面、以及位于从多层基板1的上表面至积层间的接地用图案3之间的多层基板1的相互相对的一对侧面的整面。
而且，金属膜6在多层基板1的侧面的位置，成为连接于接地用图案3的状态，成为进行位于多层基板1的上表面的电子部件4或者信号用图案2的电屏蔽的结构，从而形成本发明的电子电路单元。
在此虽未图示，但是具有这样的结构的本发明的电子电路单元，多层基板1的下表面被载置于母基板，设置在多层基板1的下表面的端子部2a、3a被锡焊于设置在母基板上的导电图案，从而本发明的电子电路单元被面安装于母基板。
另外，在上述实施例中，说明了金属膜6连接于设置在积层间的接地用图案3的电子电路单元，不过也可以将接地用图案3设置在多层基板1的上表面，该接地用图案3在多层基板1的侧面的位置连接于金属膜6。
并且，在上述实施例中，说明了位于积层间的信号用图案2比位于积层间的接地用图案3位于更为下方(下表面侧)的电子电路单元，不过也可以是位于积层间的信号用图案2比位于积层间的接地用图案3位于更为上方(上表面侧)，位于积层间的信号用图案2也被金属膜6电屏蔽。
接着，基于图3～图9说明本发明的电子电路单元的第一实施例的制造方法，首先，如图3、图4所示，准备用于形成多个多层基板1的集合基板11，接着，在如图3、图4所示的第一工序中，电子部件4对应于各个多层基板1而被搭载(安装)于集合基板11。
接着，在图5所示的第二工序中，在集合基板11的上表面的整个面设置封固树脂部5来埋入设置电子部件4，之后，在图6、图7的第三工序中，在相互紧邻的多层基板1间(切断线S1)的位置，在集合基板11与封固树脂部5上，在利用位于集合基板11的下部侧的连结部11a来连结多个多层基板1的状态下，从封固树脂部5的上表面部至露出位于积层间的接地用图案3的位置设置狭缝部12，在封固树脂部5利用狭缝部12来形成相互相对的一对侧面部，并且，在多层基板1利用狭缝部12来形成相互相对的一对侧面的一部分。
在该第三工序中，多个狭缝部12形成为并列状态。
接着，在图8的第四工序中，在包括有狭缝部12内的封固树脂部5与集合基板11上通过电镀形成与位于积层间的接地用图案3连接的金属膜6。
在该第四工序中的金属膜6被形成在狭缝部12内的整面(封固树脂部5的侧面部与多层基板1的一部分的侧面、以及狭缝部12的底面)与封固树脂部5的上表面部。
接着，在图9的第五工序中，在相互紧邻的多层基板1间(参照图6的切断线S1、S2)的位置设置切断部13，从而电子电路单元被各个地断开。
该第五工序中的切断部13，以比狭缝部12的宽度小的宽度尺寸形成，在狭缝部12的底面的位置被切断，并且在切断线S1的位置切断连结部11a，并且，在切断线S2的位置切断封固树脂部5与集合基板11(没有狭缝部12的连结部11a)，从而完成本发明的电子电路单元的制造。
并且，图10～图12表示本发明的电子电路单元的第二实施例，说明该第二实施例，金属膜6被设置在封固树脂部5的上表面部的整个面、封固树脂部5的相互相对的两对侧面部的整个面、以及位于从多层基板1的上表面至积层间的接地用图案3之间的多层基板1的相互相对的两对侧面的整个面。
即，金属膜6形成了如下结构被设置在封固树脂部5的已露出的外表面的整个面、和从多层基板1的上表面至接地用图案3之间的侧面的整个面，利用金属膜6来进行多层基板1的上表面或者积层间的信号用图案2的电屏蔽。
其它的结构具有与上述第一实施例相同的结构，对相同的部件标注相同的附图标记，在此省略其说明。
另外，在上述第二实施例，说明了接地用图案3从多层基板1的两对侧面分别露出的电子电路单元，不过接地用图案3也可以从多层基板1的一个侧面、或者相互相对的一对侧面露出。
接着，基于图13、以及作为第一实施例的图3～图9来说明本发明的电子电路单元的第二实施例的制造方法，首先，如图3、图4所示，准备用于形成多个多层基板1的集合基板11，接着，在如图3、图4所示的第一工序中，电子部件4对应于各个多层基板1而被搭载(安装)于集合基板11，接着，在如图5所示的第二工序中，在集合基板11的上表面的整个面设置封固树脂部5来埋入设置电子部件4。
即，在第一、第二工序中，与第一实施例相同。
接着，在第三工序的图13中，在相互紧邻的多层基板1间(切断线S1、S2)的位置，在集合基板11与封固树脂部5上，在利用位于集合基板11的下部侧的连结部11a来连结多个多层基板1的状态下，从封固树脂部5的上表面部至露出位于积层间的接地用图案3的位置设置狭缝部12，在封固树脂部5利用狭缝部12来形成相互相对的两对侧面部，并且，在多层基板1利用狭缝部12来形成相互相对的两对侧面的一部分。
在该第二实施例的第三工序中，狭缝部12形成为格子状。
接着，在图8的第四工序中，在包括有狭缝部12内的封固树脂部5与集合基板11上通过电镀形成与位于积层间的接地用图案3连接的金属膜6。
在该第四工序中的金属膜6被形成在狭缝部12内的整个面(封固树脂部5的侧面部与多层基板1的一部分的侧面、以及狭缝部12的底面)与封固树脂部5的上表面部。
即，该第四工序与第一实施例相同。
接着，在第五工序的图9中，在相互紧邻的多层基板1间(参照图13的切断线S1、S2)的位置设置切断部13，从而电子电路单元被各个地断开。
该第五工序中的切断部13，以比狭缝部12的宽度小的宽度尺寸形成，在狭缝部12的底面的位置被切断，并且切断线S1、S2的位置的连结部11a被切断，从而完成本发明的电子电路单元的制造。
并且，图14、图15表示本发明的电子电路单元的第三实施例，说明该第三实施例，在多层基板1具有连接导体7，所述连接导体7被设置为贯穿在从多层基板1的上表面到侧面的接地用图案3所在的空间、且在侧面的位置连接于接地用图案3，在该连接导体7连接有金属膜6。
其它结构具有与上述第一实施例相同的结构，对相同部件标注相同的附图标记，在此省略其说明。
另外，在该第三实施例中，说明了金属膜6设置在封固树脂部5的上表面部与一对侧面部、以及多层基板1的一对侧面的电子电路单元，但是如图10～图12的第二实施例所示，金属膜6也可以被设置在封固树脂部5的已露出的外表面的整个面、与从多层基板1的上表面至接地用图案3之间的侧面的整个面。
接着，基于图16～图24说明本发明的电子电路单元的第三实施例的制造方法，首先，如图16、图17所示，准备用于形成多个多层基板1的集合基板11，其为了露出位于积层间的接地用图案3而具有设置在相互紧邻的多层基板1间(切断线S1)的切割条槽11b，接着，在如图16、图17所示的第一工序中，电子部件4对应于各个多层基板1而被搭载(安装)于集合基板11。
接着，在如图18、图19所示的第二工序中，由导电材料构成的导体部14被填充在切割条槽11b内，该导体部14连接于接地用图案3。
该导体部14形成为并列状态，并且用于形成后述的连接导体7。
接着，在图20的第三工序中，在集合基板11的上表面的整个面与导体部14的上表面设置封固树脂部5来埋入设置电子部件4。
接着，在图21、图22的第四工序中，在相互紧邻的多层基板1间(切断线S1)的位置，在集合基板11与封固树脂部5、以及导体部14上，在利用位于集合基板11的下部侧的连结部11a来连结多个多层基板1的状态下，从封固树脂部5的上表面部至露出位于积层间的接地用图案3的位置设置狭缝部12。
在该第四工序中，导体部14被狭缝部12分割，在狭缝部12内形成连接于接地用图案3的连接导体7，并且在封固树脂部5利用狭缝部12来形成相互相对的一对侧面部，并且，在多层基板1利用狭缝部12来形成相互相对的一对侧面的一部分。
接着，在图23的第五工序中，在包括有狭缝部12内的封固树脂部5与集合基板11上通过电镀形成连接于位于积层间的接地用图案3的金属膜6。
在该第五工序中的金属膜6附着于连接导体7的表面，并且被形成在狭缝部12内的整个面(封固树脂部5的侧面部与多层基板1的一部分的侧面、以及狭缝部12的底面)与封固树脂部5的上表面部。
接着，在第六工序的图24中，在相互紧邻的多层基板1间(参照图21的切断线S1、S2)的位置设置切断部13，从而电子电路单元被各个地断开。
该第六工序中的切断部13，以比狭缝部12的宽度小的宽度尺寸形成，在狭缝部12的底面的位置被切断，并且在切断线S1的位置切断连结部11a，并且在切断线S2的位置切断封固树脂部5与集合基板11(没有狭缝部12的连结部11a)，从而完成本发明的电子电路单元的制造。
另外，该第三实施例也可以如图13的第二实施例所述，狭缝部12形成为格子状。
并且，图25、图26表示本发明的电子电路单元的第四实施例，说明该第四实施例，在多层基板1具有侧(side)电极8，所述侧电极8被设置于从多层基板1的上表面至多层基板1的下表面的凹状的侧面、且在凹状的侧面的位置与接地用图案3相连接，在该侧电极8上连接有金属膜6。
其它结构具有与上述第一实施例相同的结构，对相同部件标注相同的附图标记，在此省略其说明。
另外，在该第四实施例中，说明了金属膜6设置在封固树脂部5的上表面部与一对侧面部、以及多层基板1的一对侧面的电子电路单元，不过如图10～图12的第二实施例所示，金属膜6也可以被设置在封固树脂部5的已露出的外表面的整个面、与从多层基板1的上表面至接地用图案3之间的侧面的整个面。
接着，基于图27～图35说明本发明的电子电路单元的第四实施例的制造方法，首先，如图27、图28所示，准备用于形成多个多层基板1的集合基板11，所述集合基板11为了露出位于积层间的接地用图案3而具有设置在相互紧邻的多层基板1间(切断线S1)的贯通孔11c，接着，在如图27、图28所示的第一工序中，电子部件4对应于各个多层基板1而被搭载(安装)于集合基板11。
接着，在如图29、图30所示的第二工序中，导电体15被设置在贯通孔11c的壁面，该导电体15连接于接地用图案3。
该导电体15被设置在设置于相互紧邻的多层基板1间的贯通孔11c的壁面，且用于形成后述的侧电极8。
接着，在图31的第三工序中，在集合基板11的上表面的整个面与贯通孔11c的上表面设置封固树脂部5来埋入设置电子部件4。
在该第三工序中，在贯通孔11c内插入夹具(没有图式)，在贯通孔11c被堵塞的状态下来形成封固树脂部5。
接着，在图32、图33的第四工序中，在相互紧邻的多层基板1间(切断线S1)的位置，在集合基板11与封固树脂部5、以及导电体15上，在利用位于集合基板11的下部侧的连结部11a来连结多个多层基板1的状态下，从封固树脂部5的上表面部至露出位于积层间的接地用图案3的位置设置(至位于积层间的接地用图案3的位置)设置狭缝部12。
在该第四工序中，狭缝部12的宽度是比贯通孔11c的直径小的宽度尺寸，导电体15的上部的一部分被狭缝部12分割，在狭缝部12内形成连接于接地用图案3的侧电极8，并且在封固树脂部5利用狭缝部12来形成相互相对的一对侧面部，并且，在多层基板1利用狭缝部12来形成相互相对的一对侧面的一部分。
接着，在图34的第五工序中，在包括有狭缝部12内以及贯通孔11c内的封固树脂部5与集合基板11上通过电镀形成与位于积层间的接地用图案3连接的金属膜6。
在该第五工序中的金属膜6附着于侧电极8的表面，并且被形成在狭缝部12内的整个面(封固树脂部5的侧面部与多层基板1的一部分的侧面、以及狭缝部12的底面)与封固树脂部5的上表面部。
接着，在第六工序的图35中，在相互紧邻的多层基板1间(参照图32的切断线S1、S2)的位置设置切断部13，从而电子电路单元被各个地断开。
该第六工序中的切断部13，以比狭缝部12的宽度小的宽度尺寸形成，在狭缝部12的底面的位置被切断，并且在切断线S1的位置切断连结部11a，并且在切断线S2的位置切断封固树脂部5与集合基板11(没有狭缝部12的连结部11a)，从而完成本发明的电子电路单元的制造。
另外，该第四实施例也可以如图13的第二实施例所述，狭缝部12形成为格子状。
权利要求
1.一种被屏蔽的电子电路单元，其特征在于，包括设置有配线图案的多层基板、被搭载于该多层基板的上表面的电子部件、以及在埋设有该电子部件的状态下设置于所述多层基板的上表面的由绝缘材料构成的封固树脂部，所述多层基板具有相互相对的两对侧面，并且所述配线图案具有设置在所述多层基板的上表面或者/以及积层间的接地用图案，所述封固树脂部具有上表面部与相互相对的两对侧面部，在所述封固树脂部的所述上表面部与相互相对的所述侧面部设置有金属膜，并且所述金属膜设置在所述多层基板的相互相对的所述侧面，且在所述侧面的位置连接于所述接地用图案。
2.如权利要求1所述的被屏蔽的电子电路单元，其特征在于，所述金属膜被设置在所述封固树脂部的所述上表面部与相互相对的所述侧面部的整个面，并且与设置在所述多层基板的积层间的所述接地用图案相连接的所述金属膜，被设置在位于从所述多层基板的上表面至所述接地用图案之间的相互相对的所述侧面的整个面上。
3.如权利要求2所述的被屏蔽的电子电路单元，其特征在于，所述配线图案具有所述接地用图案与信号用图案，所述信号用图案被设置在比所述接地用图案更位于上方的所述多层基板的积层间。
4.如权利要求2所述的被屏蔽的电子电路单元，其特征在于，在所述多层基板具有连接导体，所述连接导体被设置为贯穿在从所述上表面到所述侧面的所述接地用图案所在的空间、且在所述侧面的位置连接于所述接地用图案，在该连接导体连接有所述金属膜。
5.如权利要求2所述的被屏蔽的电子电路单元，其特征在于，在所述多层基板具有侧电极，所述侧电极被设置在从所述上表面至所述多层基板的下表面的凹状的所述侧面、且在所述凹状的侧面的位置连接于所述接地用图案，在该侧电极连接有所述金属膜。
6.如权利要求1所述的被屏蔽的电子电路单元，其特征在于，在所述多层基板的下表面设置有连接于所述电子部件的端子部与所述接地用图案。
7.一种被屏蔽的电子电路单元的制造方法，是用于制造权利要求2所述的电子电路单元的制造方法，其特征在于，准备用于形成多个所述多层基板的集合基板，在所述集合基板设置了对应于各个所述多层基板而被搭载的所述电子部件与埋入设置有该电子部件的所述封固树脂部，之后，在相互紧邻的所述多层基板间的位置，在所述集合基板与所述封固树脂部上，在利用位于所述集合基板的下部侧的连结部来连结多个所述多层基板的状态下，从所述封固树脂部的上表面部至露出位于所述积层间的所述接地用图案的位置设置狭缝部，在所述封固树脂部利用所述狭缝部来形成相互相对的所述侧面部，并且，在所述多层基板利用所述狭缝部来形成相互相对的所述侧面的一部分，然后，在包括有所述狭缝部内的所述封固树脂部与所述集合基板设置连接于位于所述积层间的所述接地用图案的所述金属膜，其后，在所述集合基板、或者所述集合基板与所述封固树脂部，在相互紧邻的所述多层基板间的位置设置切断部，从而所述电子电路单元被各个地断开。
8.一种被屏蔽的电子电路单元的制造方法，是用于制造权利要求4所述的电子电路单元的制造方法，其特征在于，准备用于形成多个所述多层基板的集合基板，在所述集合基板设置了对应于各个所述多层基板而被搭载的所述电子部件；被设置在相互紧邻的所述多层基板间、且用于使位于所述积层间的所述接地用图案露出的切割条槽；连接于所述接地用图案、且用于形成被填充于所述切割条槽内的所述连接导体的导体部；以及包括有该导体部上地埋入设置有所述电子部件的所述封固树脂部，之后，在相互紧邻的所述多层基板间的位置，在所述集合基板与所述封固树脂部上，在利用位于所述集合基板的下部侧的连结部来连结多个所述多层基板的状态下，从所述封固树脂部的上表面部至位于所述积层间的所述接地用图案的位置设置狭缝部，在所述封固树脂部利用所述狭缝部来形成相互相对的所述侧面部，并且，在所述多层基板利用所述狭缝部来形成相互相对的所述侧面的一部分，并且所述导体部被所述狭缝部分割，在所述狭缝部内形成有连接于所述接地用图案的所述连接导体，然后，在包括有所述狭缝部内的所述封固树脂部与所述集合基板设置连接于所述连接导体与位于所述积层间的所述接地用图案的所述金属膜，其后，在所述集合基板、或者所述集合基板与所述封固树脂部，在相互紧邻的所述多层基板间的位置设置切断部，从而所述电子电路单元被各个地断开。
9.一种被屏蔽的电子电路单元的制造方法，是用于制造权利要求5所述的电子电路单元的制造方法，其特征在于，准备用于形成多个所述多层基板的集合基板，在所述集合基板设置了对应于各个所述多层基板而被搭载的所述电子部件；被设置于相互紧邻的所述多层基板间、且用于使位于所述积层间的所述接地用图案露出的、并用于形成所述凹状的侧面的贯通孔；连接于所述接地用图案、且用于形成在所述贯通孔内的壁面形成的所述侧电极的导电体；以及包括有所述贯通孔上地埋入设置有所述电子部件的所述封固树脂部，之后，在相互紧邻的所述多层基板间的位置，在所述集合基板与所述封固树脂部上，在利用位于所述集合基板的下部侧的连结部来连结多个所述多层基板的状态下，从所述封固树脂部的上表面至位于所述积层间的所述接地用图案所露出的位置设置狭缝部，在所述封固树脂部利用所述狭缝部来形成相互相对的所述侧面部，并且，在所述多层基板利用所述狭缝部来形成相互相对的所述侧面的一部分，并且所述贯通孔与所述导电体的一部分被所述狭缝部分割，在位于被分割的所述贯通孔内的所述凹状的侧面形成有连接于所述接地用图案的所述侧电极的一部分，然后，在包括有所述凹状的侧面与所述狭缝部内的所述封固树脂部与所述集合基板，设置连接于所述侧电极的一部分与位于所述积层间的所述接地用图案的所述金属膜，其后，在所述集合基板、或者所述集合基板与所述封固树脂部，在相互紧邻的所述多层基板间的位置设置切断部，从而所述电子电路单元被各个地断开。
10.如权利要求7所述的被屏蔽的电子电路单元的制造方法，其特征在于，所述切断部以比所述狭缝部的宽度小的宽度尺寸来形成。
11.如权利要求7所述的被屏蔽的电子电路单元的制造方法，其特征在于，所述狭缝部，在已位于相互紧邻的所述多层基板间的状态下形成为格子状，在对应于所述狭缝部的位置而设置的所述连结部设置有所述切断部，从而所述电子电路单元被各个地断开。
12.如权利要求7所述的被屏蔽的电子电路单元的制造方法，其特征在于，所属金属膜通过电镀来形成。
全文摘要
为了使电子电路单元的电屏蔽良好，使金属膜与接地用图案的连接可靠，提供一种被屏蔽的电子电路单元及其制造方法。为此，在本发明的电子电路单元中，金属膜(6)的结构如下被设置在埋入设置有电子部件(4)的封固树脂部(5)的上表面部与相互相对的侧面部、以及多层基板(1)的相互相对的侧面的位置，连接于设置在多层基板的上表面、或多层基板的积层间的接地用图案(3)。根据该结构，与现有技术相比，利用金属膜进行的电屏蔽良好，且因为金属膜形成在封固树脂部的侧面部与多层基板的侧面，所以特别在通过电镀形成金属膜时，可不需要现有的盲状孔，电镀液的循环良好，从而能够得到金属膜与接地用图案的连接状态可靠的电子电路单元。
文档编号H05K3/46GK1870857SQ20061008504
公开日2006年11月29日 申请日期2006年5月22日 优先权日2005年5月25日
发明者古贺一正 申请人:阿尔卑斯电气株式会社