在衬底的同一平面上集成多方阻薄膜电阻的工艺技术的制作方法

文档序号:9472839阅读:886来源:国知局
在衬底的同一平面上集成多方阻薄膜电阻的工艺技术的制作方法
【专利说明】在衬底的同一平面上集成多方阻薄膜电阻的工艺技术 所属技术领域:
[0001] 本发明涉及一种薄膜电阻集成的工艺技术。尤其是能够在衬底的同一平面上实现 集成多方阻薄膜电阻的工艺技术。
【背景技术】:
[0002] 当前,电子系统向小型化,高性能化,多功能化,低成本高可靠性方向发展,系统集 成(SiP)应运而生。
[0003] 在各种电子系统中,所有无源元件(对有源元件的)数量的比例典型值为10 : 1, 某些无线电通讯系统中比例高达50 : 1甚至100 : 1.其安装成本更是占到了所有成本的 70%左右【1】,因此无源元件集成在系统集成中举足轻重!
[0004] 在适应电子整机与系统的不断升级方面,无论是减少整个产品的尺寸和重量,还 是在目前现有的体积内增加系统的功能,无源元件的集成都能发挥很大的作用。
[0005] 无源元件集成的技术途径有薄膜集成,厚膜集成和LTCC技术,这三种技术的优缺 点见如下表1
[0006] 表1薄,厚膜无源元件性能对比【2】
[0009]【1】无源元件集成技术的研究现状杨邦朝第17届全国混合集成电路学术会议 论文集2011. 9
[0010] 【2】无源元件内埋置的技术趋势杨邦朝混合微电子技术2008V01. 19. N〇2
[0011] 由上表对比情况可以看出,采用薄膜集成无源元件可实现性能和集成的最优组 合。基于微电子工艺的薄膜集成技术,因其高频性能好,元件精度高,可靠性高,集成密度 高,特别能很好的与半导体芯片兼容等特点,已成为无源集成技术发展的主流方向之一。
[0012] 当前,无论是厚膜集成还是薄膜集成,主要集成的无源元件是电阻。
[0013] 厚膜集成技术可采用不同方阻的电子浆料,通过多次丝网印刷和高温烧结工艺, 可以在厚膜衬底同一平面上实现多个方阻厚膜电阻的集成。
[0014] 薄膜集成技术是采用真空蒸发工艺或溅射工艺,在衬底上淀积电阻薄膜,实现薄 膜电阻的集成,目前薄膜混合集成电路中常用的典型电阻材料主要有三种,其材料特性见 下表
[0017] *TCR:电阻温度系数,它是衡量电阻稳定性和精度的主要技术参数。TCR值越小电 阻性能越好。
[0018] 目前薄膜混合集成的工艺技术只能在衬底的同一平面上集成一个方阻的薄膜电 阻,这种在衬底的同一平面上集成电阻方阻的单一性,给薄膜混合集成的应用带来下列局 限性:
[0019] (1)薄膜混合集成电路中,特别是电路复杂,电路中电阻元件多且阻值跨度大、分 散的产品中。采用单一方阻的电阻材料不能实现电路中全部电阻元件的集成化。在这种情 况下,设计者只能根据电路中阻值情况选用一种方阻材料来集成电路中一部分电阻,而其 余电阻则采用片式电阻来外贴,从而增加了产品的体积和重量,产品可靠性也受到影响。
[0020] (2)还有另一种情况,就是为了提高产品性能和进一步缩小体积,需要对电路中不 同功能的电阻集成不同方阻的电阻材料,充分发挥不同电阻材料的优点,使薄膜集成化电 路整体特性得到充分提高。
[0021 ] 以上两种情况说明,薄膜混合集成电路与厚膜混合集成电路相比,因其在衬底同 一平面上只能集成单一方阻薄膜电阻,其方阻的单一性影响了其更广泛的应用。
[0022] 为了克服现有在薄膜混合集成电路中,衬底的同一平面上只能集成单一方阻的薄 膜电阻的技术缺陷,为了进一步提高薄膜电阻的集成度,本发明专利提供一种新型的可行 的技术方案。该技术方案可以实现在衬底的同一平面上集成多方阻薄膜电阻及互联导带。
[0023] 本发明专利解决其技术问题所采用的技术方案是:在衬底上淀积合适的金属薄 膜,通过光刻工艺,在衬底上制作隐性掩模进行保护或隔离,实现在衬底的同一平面集成多 方阻的薄膜电阻。
[0024] 技术方案包括以下过程:
[0025] 1、根据待要薄膜集成化的电子线路产品性能要求,选定若干个不同方阻的薄膜电 阻材料来实现产品的电阻集成,在衬底同一平面上进行布局,并设计产品的平面化版图;
[0026] 2、根据设计的产品平面化版图,设计并制作不同方阻薄膜电阻的光刻版和相应的 不同方阻薄膜电阻的隐性掩模光刻版;
[0027] 3、选用合适的金属材料作为隐性掩模材料,淀积在衬底上成膜,通过光刻工艺,在 衬底上形成不同方阻的隐性掩模,对要淀积的不同方阻的电阻薄膜进行保护或隔离,在衬 底的同一平面上不同位置制作不同方阻的薄膜电阻;
[0028] 4、在衬底上淀积金属导带薄膜;
[0029] 5、光刻互联导带,实现在衬底同一平面上不同位置集成多方阻薄膜电阻及互联。
[0030] 本发明专利的有益效果是:
[0031] 1由于在衬底的同一平面上集成了多方阻的薄膜电阻,因而进一步提高了薄膜电 阻的集成度,可进一步缩小产品体积。
[0032] 2由于在衬底的同一平面上能集成多方阻薄膜电阻,给薄膜混合集成电路的平面 化版图设计,尤其是针对电路复杂,电路中电阻元件多,阻值分散的产品的集成化版图设计 可以更为灵活方便,优化版图,使产品性能进一步提高,体积进一步减小。
[0033] 3由于提高了薄膜电阻的集成度,可使产品不必采用外贴片式电阻,或外贴片式电 阻大量减少,因而产品内部联线减少,焊点减少,从而使产品可靠性大幅提高。
【附图说明】:
[0034] 下面结合附图和实施例对本发明进一步说明:
[0035] 本发明可以在衬底同一平面的任意位置集成不同方阻的薄膜电阻,示意图如图1。
[0036] 图1 :同一平面上集成不同方阻薄膜电阻示意图
[0037] 图 1 中:
[0038] 1--方阻1电阻薄膜
[0039] 2--方阻2电阻薄膜
[0040] 3--电阻3电阻薄膜
[0041] 4--衬底(基片)
[0042] 本发明采用在衬底上淀积金属薄膜,通过光刻工艺制作隐性掩模的方法,来实现 在衬底同一平面上集成多方阻薄膜电阻。隐性掩模可以做成保护型也可以做成隔离型,两 种方案分述如下:
[0043] ①保护型隐性掩模法技术方案
[0044] 设产品需采用三个方阻的薄膜电阻来实现电路中全部电阻的集成,设产品的平面 化版图上三种不同方阻的薄膜电阻布局和互联如图2所示。
[0045] 图2 :在衬底的同一平面上集成三个方阻薄膜电阻及其互联布局示意图
[0046] 根据布局和互连图制备六个光刻版,示意图如下图3所示。
[0047] 图3 :光刻版示意图
[0048] 图 2 中:
[0049] 1-方阻1薄膜电阻Rl
[0050] 2-方阻2薄膜电阻R2
[0051] 3-方阻3薄膜电阻R3
[0052] 4--衬底(基片)
[0053] 5--导带
[0054] 工艺流程如下所述:其过程示意图如图4所示。
[0055] 图4 :保护型隐性掩模法过程示意图
[0056] 在衬底上淀积方阻1电阻薄膜,采用1#光刻版、正性光刻胶、方阻1材料腐蚀液光 亥丨J,在衬底上留下方阻1的电阻薄膜R1。(图4A)
[0057] 淀积掩模金属薄膜,使用1#光刻版、正性光刻胶、掩模金属膜腐蚀液光刻,在衬底 的方阻1电阻薄膜Rl上,留下掩模金属膜,对方阻1薄膜电阻Rl进行保护。(图4B)
[0058] 淀积方阻2的电阻薄膜,采用2#光刻版、正性光刻胶、方阻2电阻材料腐蚀液,光 刻出方阻2的电阻薄膜R2,并留下有掩模金属保护膜的方阻薄膜电阻R1。(图4C)
[0059] 淀积掩模金属膜,采用3#光刻版、正性光刻胶、掩模金属腐蚀液光刻,使Rl、R2表 面上覆盖掩模金属膜进行保护。(图4D)
[0060] 淀积方阻3电阻薄膜,采用4#光刻版,正性光刻胶、方阻3电阻材料腐蚀液进行光 亥IJ,光刻出方阻3薄膜电阻R3,衬底上留下方阻3电阻薄膜R3及有掩模金属膜保护的R1、 R2。(图 4E)
[0061] 采用3#光刻版、负性光刻胶、掩模金属腐蚀液进行光刻,将R1、R2上的保护性掩模 金属膜去掉,衬底上留下无掩模金属保护的R1、R2、R3。(图4F)
[0062] 淀积导带薄膜,采用5#光刻版、正性光刻胶、导带材料腐蚀液进行光刻,衬底上留 下导带图形和有导带覆盖的R1、R2、R3。(图4G)
[0063] 采用6#光刻版、负性光刻胶、导带材料腐蚀液进行光刻。去掉R1、R2、R3薄膜电阻 上的导带膜,最后得到如设计布局要求的三个方阻薄膜电阻并且互连,这样实现了在衬底 的同一平面集成了三个方阻的薄膜电阻。(图4H)其膜层剖面图如图5所示。
[0064] 图5 :衬底同一平面上集成三个方阻薄膜电阻及互联膜层结构剖面图
[0065] 图 4 中:
[0066] 1-方阻1薄膜电阻Rl
[0067] 2-方阻2薄膜电阻R2
[0068] 3-方阻3薄膜电阻R3
[0069] 4--衬底(基片)
[0070] 5--互联导带
[0071] 6--掩模金属膜保护的Rl
[0072] 7--掩模
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