专利名称：一种在嵌入式系统中实现乘法运算的方法和装置的制作方法
技术领域：
本发明涉及密码学领域，尤其涉及一种在嵌入式系统中实现乘法运算的方法和装置。
背景技术：
许多已知的计算机算法都需要进行乘法运算，如公钥加密等算法。现有技术中可以通过中央处理器(Central Processing Unit,CPU)实现乘法运算。但是当乘法运算中的数据为大数时，CPU执行乘法运算时的运算速度比较低。发明内容
本发明的实施例提供一种在嵌入式系统中实现乘法运算的方法和装置，能够提高乘法运算的运算速度。
一方面，提供一种在嵌入式系统中实现乘法运算的方法，包括
(1).接收到乘法运算指令时，获取所述乘法运算指令中第一待处理数据和第二待处理数据；
(2).判断所述第一待处理数据的比特位位数与所述第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数；
如果是，返回错误信息；如果否，执行(3)；
(3).对所述第一待处理数据进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第三待处理数据，对所述第二待处理数据的进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第四待处理数据；
(4).根据所述运算装置支持的比特位位数生成第一参数；
(5).将所述第三待处理数据的最低位、所述第四待处理数据的最低位分别与所述第一参数的最低位对齐；
(6).将所述第三待处理数据按预设位长由最低位到最高位进行划分；
(J).根据所述预设位长对应的比特位位数生成第二参数，并根据所述第一参数和所述第二参数生成第三参数；
(8).将当前偏移单元中的数据和所述第四待处理数据的乘积与当前迭代数据相加，得到第一数据；
偏移单元的初始单元为对所述第三待处理数据进行划分得到的第一个单元，迭代数据的初始值为0 ；
(9).将所述第二参数作为模数，对所述第一数据与所述第三参数进行模乘运算， 得到第二数据；
(10).将所述第一参数和所述第二数据的乘积与所述第一数据进行加法运算，得到第三数据；
(11).将所述第三数据右移所述预设位长，并将移位后得到的数据替换当前迭代5数据；
(12).判断当前偏移单元是否为最后一个单元；
如果是，执行(14)；如果否，执行(13)；
(13).将偏移单元指向当前偏移单元的下一个单元，返回(8)；
(14).判断当前迭代数据是否小于所述第一参数；
如果是，执行(16)；如果否，执行(15)；
(15).将当前迭代数据自减所述第一参数；
(16).存储或输出指示所述第一待处理数据与所述第二待处理数据乘积的当前迭代数据。
其中，所述对所述第一待处理数据进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第三待处理数据，对所述第二待处理数据的进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第四待处理数据，包括
在所述第一待处理数据的最高位前补零生成第三待处理数据，在所述第二待处理数据的最高位前补零生成第四待处理数据，所述第三待处理数据与所述第四待处理数据的比特位位数与所述运算装置支持的比特位位数相同。
其中，所述根据所述运算装置支持的比特位位数生成第一参数，包括
生成各个比特位均置1的第一参数，所述第一参数的比特位位数与所述运算装置支持的比特位位数相同。
其中，所述预设位长对应的比特位位数，具体为
能整除所述运算装置支持的比特位位数的整数。
其中，所述根据所述预设位长对应的比特位位数生成第二参数，包括
以2为底数，以所述预设位长对应的比特位位数为幂数生成所述第二参数。
其中，所述根据所述第一参数和所述第二参数生成第三参数，包括
生成所述第二参数的值减去所述第一参数关于所述第二参数的乘法逆元的差值；
生成值与所述差值相同的第三参数。另一方面，提供一种在嵌入式系统中实现乘法运算的装置，包括
待处理数据获取模块，用于接收到乘法运算指令时，获取所述乘法运算指令中第一待处理数据和第二待处理数据；
第一判断模块，用于判断所述第一待处理数据的比特位位数与所述第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数；
所述补位模块，用于在所述第一判断模块判断结果为是时对所述第一待处理数据进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第三待处理数据，对所述第二待处理数据的进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第四待处理数据；
第一参数生成模块，用于根据所述运算装置支持的比特位位数生成第一参数；
对齐模块，用于将所述第三待处理数据的最低位、所述第四待处理数据的最低位分别与所述第一参数的最低位对齐；
划分模块，用于将所述第三待处理数据按预设位长由最低位到最高位进行划分；6
第二参数生成模块，用于根据所述预设位长对应的比特位位数生成第二参数，并根据所述第一参数和所述第二参数生成第三参数；
第一数据生成模块，用于将当前偏移单元中的数据和所述第四待处理数据的乘积与当前迭代数据相加，得到第一数据；
所述偏移单元的初始单元为所述第一单元，所述迭代数据的初始值为0 ；
第二数据生成模块，用于将所述第二参数作为模数，对所述第一数据与所述第三参数进行模乘运算，得到第二数据；
第三数据处理模块，用于将所述第一参数和所述第二数据的乘积与所述第一数据进行加法运算，得到第三数据；
数据替换模块，用于将所述第三数据右移所述预设位长后得到的数据替换当前迭代数据；
第二判断模块，用于判断当前偏移单元是否为最后一个单元；
所述移位模块，用于在所述第二判断模块判断结果为否时将偏移单元指向当前偏移单元的下一个单元，返回第一数据生成模块；
所述第三判断模块，用于在所述第二判断模块判断结果为是时判断当前迭代数据是否小于所述第一参数；
所述自减模块，用于在所述第三判断模块判断结果为否时将当前迭代数据自减所述第一参数；
所述输出模块，用于在所述第三判断模块判断结果为是时存储或输出指示所述第一待处理数据与所述第二待处理数据乘积的当前迭代数据。
其中，所述补位模块，包括
补位子模块，用于在所述第一待处理数据的最高位前补零生成第三待处理数据， 在所述第二待处理数据的最高位前补零生成第四待处理数据，所述第三待处理数据与所述第四待处理数据的比特位位数与所述运算装置支持的比特位位数相同。
其中，所述第一参数生成模块，包括
第一生成子模块，用于生成各个比特位均置1的第一参数，所述第一参数的比特位位数与所述运算装置支持的比特位位数相同。
其中，所述预设位长对应的比特位位数，具体为
能整除所述运算装置支持的比特位位数的整数。
其中，所述第二参数生成模块，包括
第二生成子模块，以2为底数，以所述预设位长对应的比特位位数为幂数生成第二参数的值。
其中，所述第二参数生成模块，包括
第三生成子模块，用于生成所述第二参数的值减去所述第一参数关于所述第二参数的乘法逆元的差值；
第四生成子模块，用于生成值与所述差值相同的第三参数。
本发明实施例提供的在嵌入式系统中实现乘法运算的方法和装置，在乘法运算指令中第一待处理数据比特位位数和第二待处理数据的比特位位数之和小于运算装置支持的比特位位数时，可以首先将该第一待处理数据和第二待处理数据进行补位，得到第三待处理数据和第四待处理数据；然后在第三待处理数据的最低位、第四待处理数据的最低位分别与第一参数的最低位对齐时，将第三待处理数据按预设位长进行划分，并分别生成第一参数、第二参数和第三参数；最后通过该第一参数、第二参数和第三参数对当前偏移单元中的数据和第四待处理数据进行处理，直到当前偏移单元为最后一个单元时，根据当前迭代数据与第一参数的大小关系，对当前迭代数据进行处理，得到指示第一待处理数据和第二待处理数据乘积的当前迭代数据。本发明实施例提供的技术方案，由于通过模乘算法实现相乘的运算，使得乘法运算的速度得到提高，解决了现有技术中CPU执行乘法运算时的运算速度比较低的问题。
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例一提供的一种在嵌入式系统中实现乘法运算的方法的流程图2为本发明实施例二提供的另一种在嵌入式系统中实现乘法运算的方法的流程图3为本发明实施例三提供的在一种嵌入式系统中实现乘法运算的装置的结构示意图4为图3所示的在嵌入式系统中实现乘法运算的装置中补位模块的结构示意图5为图3所示的在嵌入式系统中实现乘法运算的装置中第一参数生成模块的结构示意图6为图3所示的在嵌入式系统中实现乘法运算的装置中第二参数生成模块的结构示意图一；
图7为图3所示的在嵌入式系统中实现乘法运算的装置中第二参数生成模块的结构示意图二。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
为了解决现有技术执行乘法运算的运算速度比较低的问题，本发明实施例提供了一种在嵌入式系统中实现乘法运算的方法和装置。
如图1所示，本发明实施例一提供的一种在嵌入式系统中实现乘法运算的方法， 包括
步骤101，接收到乘法运算指令时，获取该乘法运算指令中第一待处理数据和第二待处理数据。
在本实施例中，步骤101中乘法运算指令可以为计算该第一待处理数据和第二待处理数据乘积的指令。具体的，该第一待处理数据和第二待处理数据可以均为大数，可以为其他数据，在此不作限制。
步骤102，判断该第一待处理数据的比特位位数和第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数，是则执行步骤103，否则执行步骤104。
在本实施例中，由于运算装置的配置决定其允许支持的比特位位数；而当第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可能产生运算错误；因此在进行乘法运算之前，需要首先通过步骤102判断第一待处理数据的比特位位数和第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数。
在本实施例中，当通过步骤102确定第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可以通过步骤103返回错误信息；当通过步骤102确定第一待处理数据的比特位位数和第二待处理数据的比特位位数之和不大于运算装置支持的比特位位数时，可以通过步骤104对第一待处理数据和第二待处理数据分别进行补位。
步骤103，返回错误信息。
在本实施例中，由于当第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，对第一待处理数据和第二待处理数据进行乘法运算的过程中可能产生运算错误，因此当第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可以通过步骤103返回错误信肩、ο
步骤104，对第一待处理数据进行补位，生成比特位位数与运算装置支持的比特位位数相同的第三待处理数据，对第二待处理数据进行补位，生成比特位位数与运算装置支持的比特位位数相同的第四待处理数据。
在本实施例中，步骤104中对第一待处理数据进行补位可以为在该第一待处理数据的最高位前补零生成第三待处理数据；也可以为通过其他方式对第一待处理数据进行补位，在此不再一一赘述。其中，第三待处理数据的比特位位数和运算装置支持的比特位位数相同。
在本实施例中，步骤104中对第二代处理数据进行补位可以为在该第二待处理数据的最高位前补零生成第四待处理数据；也可以为通过其他方式对第二待处理数据进行补位，在此不再一一赘述。其中，第四待处理数据的比特位位数与运算装置支持的比特位位数相同。
步骤105，根据运算装置支持的比特位位数生成第一参数。
在本实施例中，步骤105中根据运算装置支持的比特位位数生成第一参数可以为生成各个比特位均置1的第一参数，该第一参数的比特位位数与运算装置支持的比特位位数相同；也可以通过其他方式根据运算装置支持的比特位位数生成第一参数，在此不再一一赘述。
步骤106，将第三待处理数据的最低位、第四待处理数据的最低位分别与第一参数的最低位对齐。
步骤107，由最低位到最高位，将第三待处理数据按预设位长进行划分，依次得到第一单元、第二单元.......
在本实施例中，步骤107中预设位长对应的比特位位数可以为能整除运算装置支持的比特位位数的整数；也可以为其他整数，在此不再一一赘述。
步骤108，根据该预设位长对应的比特位位数生成第二参数，并根据第一参数和第二参数生成第三参数。
在本实施例中，通过步骤108根据该预设位长对应的比特位位数生成的第二参数可以为以2为底数，以预设位长对应的比特位位数为幂数生成第二参数的值；也可以通过其他方式根据预设位长对应的比特位位数生成第二参数，在此不再一一赘述。
在本实施例中，通过步骤108根据第一参数和第二参数生成第三参数，可以包括 首先生成第二参数的值减去第一参数关于第二参数的乘法逆元的差值；然后生成值与该差值相同的第三参数。也可以通过其他方式根据第一参数和第二参数生成第三参数，在此不再一一赘述。
步骤109，将当前偏移单元中的数据和第四待处理数据的乘积与当前迭代数据相加，得到第一数据。
在本实施例中，偏移单元的初始单元为第一单元，迭代数据的初始值为0。
步骤110，将第二参数作为模数，对第一数据与第三参数进行模乘运算，得到第二数据。
步骤111，将第一参数和第二数据的乘积与第一数据进行加法运算，得到第三数据。
步骤112，将第三数据右移预设位长，并用移位后得到的数据替换当前迭代数据。
步骤113，判断当前偏移单元是否为最后一个单元，是则实行步骤115，否则执行步骤114。
在本实施例中，通过步骤113确定当前偏移单元不为最后一个单元时，可以通过步骤114将偏移单元指向当前偏移单元的下一个单元；通过步骤113确定当前偏移单元为最后一个单元时，可以通过步骤115判断当前迭代数据是否小于第一参数。
步骤114，将偏移单元指向当前偏移单元的下一个单元，返回步骤109。
步骤115，判断当前迭代数据是否小于第一参数，是则执行步骤117，否则执行步骤 116。
在本实施例中，在本实施例中，通过步骤115确定当前迭代数据小于第一参数时， 可以通过步骤117直接存储或输出当前迭代数据；通过步骤115确定当前迭代数据不小于第一参数时，可以通过步骤116对当前迭代数据进行处理。
步骤116，将当前迭代数据自减第一参数，顺序执行步骤117。
步骤117，存储或输出指示第一待处理数据与第二待处理数据乘积的当前迭代数据。
本发明实施例提供的在嵌入式系统中实现乘法运算的方法，在乘法运算指令中第一待处理数据比特位位数和第二待处理数据的比特位位数之和小于运算装置支持的比特位位数时，可以首先将该第一待处理数据和第二待处理数据进行补位，得到第三待处理数据和第四待处理数据；然后在第三待处理数据的最低位、第四待处理数据的最低位分别与第一参数的最低位对齐时，将第三待处理数据按预设位长进行划分，并分别生成第一参数、 第二参数和第三参数；最后通过该第一参数、第二参数和第三参数对当前偏移单元中的数据和第四待处理数据进行处理，直到当前偏移单元为最后一个单元时，根据当前迭代数据与第一参数的大小关系，对当前迭代数据进行处理，得到指示第一待处理数据和第二待处理数据乘积的当前迭代数据。本发明实施例提供的技术方案，由于通过模乘算法实现相乘的运算，使得乘法运算的速度得到提高，解决了现有技术中CPU执行乘法运算时的运算速度比较低的问题。
如图2所示，本发明实施例二提供的另一种在嵌入式系统中实现乘法运算的方法，包括
步骤201，接收到乘法运算指令时，获取该乘法运算指令中第一待处理数据和第二待处理数据。
在本实施例中，步骤201中乘法运算指令可以为计算该第一待处理数据和第二待处理数据乘积的指令。具体的，该第一待处理数据和第二待处理数据可以均为大数，可以为其他数据，在此不作限制。
在本实施例中，以下以第一待处理数据为十六进制数B4050A850C04B3ABF5413256 5044B0B7D7BFD8BA270B39432;355FFB4，第二待处理数据为十六进制数 B70E0CBD6BB4BF7F32 1390B94A03C1D356C21122343280D6115C1D21 为例进行说明。
步骤202，判断该第一待处理数据的比特位位数和第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数，是则执行步骤203，否则执行步骤204。
在本实施例中，由于运算装置的配置决定其允许支持的比特位位数；而当第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可能产生运算错误；因此在进行乘法运算之前，需要首先通过步骤202判断第一待处理数据的比特位位数和第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数。
在本实施例中，当通过步骤202确定第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可以通过步骤203返回错误信息；当通过步骤202确定第一待处理数据的比特位位数和第二待处理数据的比特位位数之和不大于运算装置支持的比特位位数时，可以通过步骤204对第一待处理数据和第二待处理数据分别进行补位。
在本实施例中，以运算装置支持的比特位位数为512为例。通过步骤101可知，第一待处理数据和第二待处理数据均为224比特，因此第一待处理数据的比特位位数和第二待处理数据的比特位位数之和为448，小于运算装置支持的比特位位数。
步骤203，返回错误信息。
在本实施例中，由于当第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，对第一待处理数据和第二待处理数据进行乘法运算的过程中可能产生运算错误，因此当第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可以通过步骤203返回错误信肩、ο
步骤204，在该第一待处理数据的最高位前补零生成第三待处理数据，在该第二待处理数据的最高位前补零生成第四待处理数据。
在本实施例中，第三待处理数据与第四待处理数据的比特位位数与运算装置支持的比特位位数相同。
相应地，在本实施例中，通过步骤204在第一待处理数据的最高位前补零生成的第三待处理数据为十六进制数 000000000000000000000000000000000000000000000000000000000000000000000000B4050 A850C04B3ABF54132565044B0B7D7BFD8BA270B39432355FFB4o
在本实施例中，通过步骤204在第二待处理数据的最高位前补零生成的第四待处理数据为十六进制数 000000000000000000000000000000000000000000000000000000000000000000000000B70E0 CBD6BB4BF7F321390B94A03C1D356C21122343280D6115C1D21。
步骤205，生成各个比特位均置1的第一参数。
在本实施例中，步骤205中第一参数的比特位位数与运算装置支持的比特位位数相同。
在本实施例中，运算装置支持的比特位位数为512时，步骤205中第一参数为十六进制数 FFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFF FFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFFo
步骤206，将第三待处理数据的最低位、第四待处理数据的最低位分别与第一参数的最低位对齐。
步骤207，由最低位到最高位，将第三待处理数据按预设位长进行划分，依次得到第一单元、第二单元.......
在本实施例中，步骤207中预设位长对应的比特位位数可以为能整除运算装置支持的比特位位数的整数；也可以为其他整数，在此不再一一赘述。
在本实施例中，步骤207中预设位长对应的比特位位数以32为例进行说明。通过步骤207将第三代处理数据按预设位长进行划分，得到16个单元，每个单元中包含的数据为一个，得到的各个单元中的数据分别为00000000、00000000、00000000、00000000、 00000000、00000000、00000000、00000000、00000000、B4050A85、0C04B3AB、F5413256、 5044B0B7, D7BFD8BA,270B3943,2355FFB4 其中，2!355FFB4 为第一单元包含的中的数据。
步骤208，根据该预设位长对应的比特位位数生成第二参数，并根据第一参数和第二参数生成第三参数。
在本实施例中，通过步骤208根据该预设位长对应的比特位位数生成的第二参数可以为以2为底数，以预设位长对应的比特位位数为幂数生成第二参数的值；也可以通过其他方式根据预设位长对应的比特位位数生成第二参数，在此不再一一赘述。在本实施例中，相应地，第二参数的值为2的32次幂，即为十六进制数100000000。
在本实施例中，通过步骤208根据第一参数和第二参数生成第三参数，可以包括 首先生成第二参数的值减去第一参数关于第二参数的乘法逆元得到的差值；然后生成值与该差值相同的第三参数。也可以通过其他方式根据第一参数和第二参数生成第三参数，在此不再一一赘述。相应地，在本实施例中，第三参数的值为1。
步骤209，将当前偏移单元中的数据和第四待处理数据的乘积与当前迭代数据相加，得到第一数据。
在本实施例中，步骤209中当前偏移单元中的数据为当前偏移单元包含的数据， 其中，偏移单元的初始单元为第一单元，迭代数据的初始值为0。
步骤210，将第二参数作为模数，对第一数据与第三参数进行模乘运算，得到第二数据。
步骤211，将第一参数和当前第二数据的乘积与第一数据进行加法运算，得到第三数据。
步骤212，用第三数据右移预设位长，并用第三数据右移预设位长得到的数据替换当前迭代数据。
步骤213，判断当前偏移单元是否为最后一个单元，是则执行步骤214，否则执行步骤214。
在本实施例中，通过步骤213确定当前偏移单元不为最后一个单元时，可以通过步骤214将偏移单元指向当前偏移单元的下一个单元；通过步骤213确定当前偏移单元为最后一个单元时，可以通过步骤215判断当前迭代数据是否小于第一参数。
在本实施例中，具体的，步骤213中最后一个单元为第十六单元。
步骤214，将偏移单元指向当前偏移单元的下一个单元，返回步骤209。
步骤215，判断当前迭代数据是否小于第一参数，是则执行步骤217，否则执行步骤 216。
在本实施例中，在本实施例中，通过步骤215确定当前迭代数据小于第一参数时， 可以通过步骤217直接存储或输出当前迭代数据；通过步骤215确定当前迭代数据不小于第一参数时，可以通过步骤216对当前迭代数据进行处理。
步骤216，将当前迭代数据自减第一参数，顺序执行步骤217。
步骤217，存储或输出指示第一待处理数据与第二待处理数据乘积的当前迭代数据。
在本实施例中，通过上述计算过程，存储或输出的指示第一待处理数据与第二待处理数据乘积的当前迭代数据具体为80B97BC11ED23B160DC05E92^392D7C97ABAF222EF0 D0A74E131B6C1FF0DD2A5EB8FCD20EC90DB9211A392082E285B0624E260324BD5A34。
本发明实施例提供的在嵌入式系统中实现乘法运算的方法，在乘法运算指令中第一待处理数据比特位位数和第二待处理数据的比特位位数之和小于运算装置支持的比特位位数时，可以首先将该第一待处理数据和第二待处理数据进行补位，得到第三待处理数据和第四待处理数据；然后在第三待处理数据的最低位、第四待处理数据的最低位分别与第一参数的最低位对齐时，将第三待处理数据按预设位长进行划分，并分别生成第一参数、 第二参数和第三参数；最后通过该第一参数、第二参数和第三参数对当前偏移单元中的数据和第四待处理数据进行处理，直到当前偏移单元为最后一个单元时，根据当前迭代数据与第一参数的大小关系，对当前迭代数据进行处理，得到指示第一待处理数据和第二待处理数据乘积的当前迭代数据。本发明实施例提供的技术方案，由于通过模乘算法实现相乘的运算，使得乘法运算的速度得到提高，解决了现有技术中CPU执行乘法运算时的运算速度比较低的问题。
如图3所示，本发明实施例三提供的一种在嵌入式系统中实现乘法运算的装置， 包括
待处理数据获取模块301，用于接收到乘法运算指令时，获取乘法运算指令中第一待处理数据和第二待处理数据。
在本实施例中，待处理数据获取模块301中乘法运算指令可以为计算该第一待处理数据和第二待处理数据乘积的指令。具体的，该第一待处理数据和第二待处理数据可以均为大数，可以为其他数据，在此不作限制。
第一判断模块302，用于判断第一待处理数据的比特位位数与第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数。
在本实施例中，由于运算装置的配置决定其允许支持的比特位位数；而当第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可能产生运算错误；因此在进行乘法运算之前，需要首先通过第一判断模块302判断第一待处理数据的比特位位数和第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数。
在本实施例中，当通过第一判断模块302确定第一待处理数据的比特位位数和第二待处理数据的比特位位数之和大于运算装置支持的比特位位数时，可以返回错误信息； 当通过第一判断模块302确定第一待处理数据的比特位位数和第二待处理数据的比特位位数之和不大于运算装置支持的比特位位数时，可以通过补位模块303对第一待处理数据和第二待处理数据分别进行补位。
补位模块303，用于对第一待处理数据进行补位，生成比特位位数与运算装置支持的比特位位数相同的第三待处理数据，对第二待处理数据的进行补位，生成比特位位数与运算装置支持的比特位位数相同的第四待处理数据。
在本实施例中，补位模块303中对第一待处理数据进行补位可以为在该第一待处理数据的最高位前补零生成第三待处理数据；也可以为通过其他方式对第一待处理数据进行补位，在此不再一一赘述。其中，第三待处理数据的比特位位数和运算装置支持的比特位位数相同。
在本实施例中，补位模块303中对第二代处理数据进行补位可以为在该第二待处理数据的最高位前补零生成第四待处理数据；也可以为通过其他方式对第二待处理数据进行补位，在此不再一一赘述。其中，第四待处理数据的比特位位数与运算装置支持的比特位位数相同。
第一参数生成模块304，用于根据运算装置支持的比特位位数生成第一参数。
在本实施例中，第一参数生成模块304中根据运算装置支持的比特位位数生成第一参数可以为生成各个比特位均置1的第一参数，该第一参数的比特位位数与运算装置支持的比特位位数相同；也可以通过其他方式根据运算装置支持的比特位位数生成第一参数，在此不再一一赘述。
对齐模块305，用于将第三待处理数据的最低位、第四待处理数据的最低位分别与第一参数的最低位对齐。
划分模块306，用于由最低位到最高位，将第三待处理数据按预设位长进行划分， 依次得到第一单元、第二单元.......14
在本实施例中，划分模块306中预设位长对应的比特位位数可以为能整除运算装置支持的比特位位数的整数；也可以为其他整数，在此不再一一赘述。
第二参数生成模块307，用于根据预设位长对应的比特位位数生成第二参数，并根据第一参数和第二参数生成第三参数。
在本实施例中，通过第二参数生成模块307根据该预设位长对应的比特位位数生成的第二参数可以为以2为底数，以预设位长对应的比特位位数为幂数生成第二参数的值；也可以通过其他方式根据预设位长对应的比特位位数生成第二参数，在此不再一一赘述。
在本实施例中，通过第二参数生成模块307根据第一参数和第二参数生成第三参数，包括用第二参数的值减去第一参数关于第二参数的乘法逆元得到的差值；该差值为第三参数的值。也可以通过其他方式根据第一参数和第二参数生成第三参数，在此不再一一赘述。
第一数据生成模块308，用于将当前偏移单元中的数据和第四待处理数据的乘积与当前迭代数据相加，得到第一数据。
在本实施例中，第一数据生成模块308中偏移单元的初始单元为第一单元，迭代数据的初始值为0。
第二数据生成模块309，用于将第二参数作为模数，对所述第一数据与第三参数进行模乘运算，得到第二数据。
第三数据处理模块310，用于将第一参数和当前第二数据的乘积与第一数据进行加法运算，得到第三数据。
数据替换模块311，用于用第三数据右移预设位长后得到的数据替换当前迭代数据。
第二判断模块312，用于判断当前偏移单元是否为最后一个单元。
在本实施例中，通过第二判断模块312确定当前偏移单元不为最后一个单元时， 可以通过移位模块313将偏移单元指向当前偏移单元的下一个单元；通过第二判断模块 312确定当前偏移单元为最后一个单元时，可以通过第三判断模块314判断当前迭代数据是否小于第一参数。
移位模块313，用于将偏移单元指向当前偏移单元的下一个单元，返回第一数据生成模块308。
第三判断模块314，用于判断当前迭代数据是否小于第一参数。
在本实施例中，在本实施例中，通过第三判断模块314确定当前迭代数据小于第一参数时，可以通过输出模块316直接存储或输出当前迭代数据；通过第三判断模块314确定当前迭代数据不小于第一参数时，可以通过自减模块315对当前迭代数据进行处理。
自减模块315，用于将当前迭代数据自减第一参数。
输出模块316，用于存储或输出指示第一待处理数据与第二待处理数据乘积的当前迭代数据。
进一步的，如图4所示，本实施例中补位模块303，包括
补位子模块3031，用于在第一待处理数据的最高位前补零生成第三待处理数据， 在第二待处理数据的最高位前补零生成第四待处理数据，第三待处理数据与第四待处理数据的比特位位数与运算装置支持的比特位位数相同。
进一步的，如图5所示，本实施例中，第一参数生成模块304，包括
第一生成子模块3041，用于生成各个比特位均置1的第一参数，第一参数的比特位位数与运算装置支持的比特位位数相同。
进一步的，如图6所示，在本实施例中，第二参数生成模块307，包括
第二生成子模块3071，用于用以2为底数，以预设位长对应的比特位位数为幂数的生成第二参数的值。
如图7所示，该第二参数生成模块307，还可以包括
第三生成子模块3072，用于生成第二参数的值减去第一参数关于第二参数的乘法逆元的差值；
第四生成子模块3073，用于生成值与差值相同的第三参数。
本发明实施例提供的在嵌入式系统中实现乘法运算的装置，在乘法运算指令中第一待处理数据比特位位数和第二待处理数据的比特位位数之和小于运算装置支持的比特位位数时，可以首先将该第一待处理数据和第二待处理数据进行补位，得到第三待处理数据和第四待处理数据；然后在第三待处理数据的最低位、第四待处理数据的最低位分别与第一参数的最低位对齐时，将第三待处理数据按预设位长进行划分，并分别生成第一参数、 第二参数和第三参数；最后通过该第一参数、第二参数和第三参数对当前偏移单元中的数据和第四待处理数据进行处理，直到当前偏移单元为最后一个单元时，根据当前迭代数据与第一参数的大小关系，对当前迭代数据进行处理，得到指示第一待处理数据和第二待处理数据乘积的当前迭代数据。本发明实施例提供的技术方案，由于通过模乘算法实现相乘的运算，使得乘法运算的速度得到提高，解决了现有技术中CPU执行乘法运算时的运算速度比较低的问题。
本发明实施例提供的在嵌入式系统中实现乘法运算的方法和装置，可以应用在嵌入式系统中。
结合本文中所公开的实施例描述的方法或算法的步骤可以直接用硬件、处理器执行的软件模块，或者二者的结合来实施。软件模块可以置于随机存储器(RAM)、内存、只读存储器(ROM)、电可编程ROM、电可擦除可编程ROM、寄存器、硬盘、可移动磁盘、CD-ROM、或技术领域内所公知的任意其它形式的存储介质中。
以上所述，仅为本发明的具体实施方式
，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应所述以权利要求的保护范围为准。
权利要求
1.一种在嵌入式系统中实现乘法运算的方法，其特征在于，包括(1).接收到乘法运算指令时，获取所述乘法运算指令中第一待处理数据和第二待处理数据；(2).判断所述第一待处理数据的比特位位数与所述第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数；如果是，返回错误信息；如果否，执行(3)；(3).对所述第一待处理数据进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第三待处理数据，对所述第二待处理数据的进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第四待处理数据；(4).根据所述运算装置支持的比特位位数生成第一参数；(5).将所述第三待处理数据的最低位、所述第四待处理数据的最低位分别与所述第一参数的最低位对齐；(6).将所述第三待处理数据按预设位长由最低位到最高位进行划分；(J).根据所述预设位长对应的比特位位数生成第二参数，并根据所述第一参数和所述第二参数生成第三参数；(8).将当前偏移单元中的数据和所述第四待处理数据的乘积与当前迭代数据相加，得到第一数据；偏移单元的初始单元为对所述第三待处理数据进行划分得到的第一个单元，迭代数据的初始值为0 ；(9).将所述第二参数作为模数，对所述第一数据与所述第三参数进行模乘运算，得到第二数据；(10).将所述第一参数和所述第二数据的乘积与所述第一数据进行加法运算，得到第三数据；(11).将所述第三数据右移所述预设位长，并将移位后得到的数据替换当前迭代数据；(12).判断当前偏移单元是否为最后一个单元； 如果是，执行(14)；如果否，执行(13)；(13).将偏移单元指向当前偏移单元的下一个单元，返回(8)；(14).判断当前迭代数据是否小于所述第一参数； 如果是，执行(16)；如果否，执行(15)；(15).将当前迭代数据自减所述第一参数；(16).存储或输出指示所述第一待处理数据与所述第二待处理数据乘积的当前迭代数据。
2.根据权利要求1所述的在嵌入式系统中实现乘法运算的方法，其特征在于，所述对所述第一待处理数据进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第三待处理数据，对所述第二待处理数据的进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第四待处理数据，包括在所述第一待处理数据的最高位前补零生成第三待处理数据，在所述第二待处理数据的最高位前补零生成第四待处理数据，所述第三待处理数据与所述第四待处理数据的比特位位数与所述运算装置支持的比特位位数相同。
3.根据权利要求1所述的在嵌入式系统中实现乘法运算的方法，其特征在于，所述根据所述运算装置支持的比特位位数生成第一参数，包括生成各个比特位均置1的第一参数，所述第一参数的比特位位数与所述运算装置支持的比特位位数相同。
4.根据权利要求1所述的在嵌入式系统中实现乘法运算的方法，其特征在于，所述预设位长对应的比特位位数，具体为能整除所述运算装置支持的比特位位数的整数。
5.根据权利要求1所述的在嵌入式系统中实现乘法运算的方法，其特征在于，所述根据所述预设位长对应的比特位位数生成第二参数，包括以2为底数，以所述预设位长对应的比特位位数为幂数生成所述第二参数。
6.根据权利要求1所述的在嵌入式系统中实现乘法运算的方法，其特征在于，所述根据所述第一参数和所述第二参数生成第三参数，包括生成所述第二参数的值减去所述第一参数关于所述第二参数的乘法逆元的差值； 生成值与所述差值相同的第三参数。
7.—种在嵌入式系统中实现乘法运算的装置，其特征在于，包括待处理数据获取模块，用于接收到乘法运算指令时，获取所述乘法运算指令中第一待处理数据和第二待处理数据；第一判断模块，用于判断所述第一待处理数据的比特位位数与所述第二待处理数据的比特位位数之和是否大于运算装置支持的比特位位数；所述补位模块，用于在所述第一判断模块判断结果为是时对所述第一待处理数据进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第三待处理数据，对所述第二待处理数据的进行补位，生成比特位位数与所述运算装置支持的比特位位数相同的第四待处理数据；第一参数生成模块，用于根据所述运算装置支持的比特位位数生成第一参数； 对齐模块，用于将所述第三待处理数据的最低位、所述第四待处理数据的最低位分别与所述第一参数的最低位对齐；划分模块，用于将所述第三待处理数据按预设位长由最低位到最高位进行划分； 第二参数生成模块，用于根据所述预设位长对应的比特位位数生成第二参数，并根据所述第一参数和所述第二参数生成第三参数；第一数据生成模块，用于将当前偏移单元中的数据和所述第四待处理数据的乘积与当前迭代数据相加，得到第一数据；所述偏移单元的初始单元为所述第一单元，所述迭代数据的初始值为0 ； 第二数据生成模块，用于将所述第二参数作为模数，对所述第一数据与所述第三参数进行模乘运算，得到第二数据；第三数据处理模块，用于将所述第一参数和所述第二数据的乘积与所述第一数据进行加法运算，得到第三数据；数据替换模块，用于将所述第三数据右移所述预设位长后得到的数据替换当前迭代数据；第二判断模块，用于判断当前偏移单元是否为最后一个单元；所述移位模块，用于在所述第二判断模块判断结果为否时将偏移单元指向当前偏移单元的下一个单元，返回第一数据生成模块；所述第三判断模块，用于在所述第二判断模块判断结果为是时判断当前迭代数据是否小于所述第一参数；所述自减模块，用于在所述第三判断模块判断结果为否时将当前迭代数据自减所述第一参数；所述输出模块，用于在所述第三判断模块判断结果为是时存储或输出指示所述第一待处理数据与所述第二待处理数据乘积的当前迭代数据。
8.根据权利要求7所述的实现乘法运算的装置，其特征在于，所述补位模块，包括补位子模块，用于在所述第一待处理数据的最高位前补零生成第三待处理数据，在所述第二待处理数据的最高位前补零生成第四待处理数据，所述第三待处理数据与所述第四待处理数据的比特位位数与所述运算装置支持的比特位位数相同。
9.根据权利要求7所述的实现乘法运算的装置，其特征在于，所述第一参数生成模块， 包括第一生成子模块，用于生成各个比特位均置1的第一参数，所述第一参数的比特位位数与所述运算装置支持的比特位位数相同。
10.根据权利要求7所述的实现乘法运算的装置，其特征在于，所述预设位长对应的比特位位数，具体为能整除所述运算装置支持的比特位位数的整数。
11.根据权利要求7所述的实现乘法运算的装置，其特征在于，所述第二参数生成模块，包括第二生成子模块，以2为底数，以所述预设位长对应的比特位位数为幂数生成第二参数的值。
12.根据权利要求7所述的实现乘法运算的装置，其特征在于，所述第二参数生成模块，包括第三生成子模块，用于生成所述第二参数的值减去所述第一参数关于所述第二参数的乘法逆元的差值；第四生成子模块，用于生成值与所述差值相同的第三参数。
全文摘要
本发明公开了一种在嵌入式系统中实现乘法运算的方法和装置，涉及密码学领域。解决了现有技术执行乘法运算的运算速度比较低的问题。所述方法包括(1)获取第一待处理数据和第二待处理数据；(2)判断比特位位数之和是否大于运算装置支持的比特位位数；(3)生成第三待处理数据，生成第四待处理数据；(4)生成第一参数；(5)将最低位对齐；(6)将第三待处理数据进行划分；(7)生成第二参数，并生成第三参数；(8)得到第一数据；(9)得到第二数据；(10)得到第三数据；(11)替换当前迭代数据；(12)判断当前偏移单元是否为最后一个单元；(13)将偏移单元指向下一个单元，返回(8)；(14)判断当前迭代数据是否小于第一参数；(15)将当前迭代数据自减第一参数；(16)存储或输出当前迭代数据。
文档编号G06F7/53GK102508632SQ20111030202
公开日2012年6月20日 申请日期2011年9月30日 优先权日2011年9月30日
发明者于华章, 陆舟 申请人:飞天诚信科技股份有限公司