削角电路、具有该电路的液晶显示装置及驱动方法

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削角电路、具有该电路的液晶显示装置及驱动方法
【技术领域】
[0001]本发明涉及显示技术领域,特别是涉及一种削角电路、具有该电路的液晶显示装置及驱动方法。
【背景技术】
[0002]目前在薄膜晶体管液晶显示装置(Thin Film Transistor-Liquid CrystalDisplay,TFT-LCD)中,扫描线用于传输扫描信号到薄膜晶体管中,以打开薄膜晶体管,数据线用于在薄膜晶体管打开时传输数据信号到像素单元,以向像素单元充电,从而控制像素单元的显示。其中,像素单元分别显示颜色R(红色,Red)、G(绿色,Green)以及B(蓝色,Blue)ο
[0003]请参阅图1,是现有技术中输入同一面板两侧与中间位置的扫描信号的波形图。图2及图3是现有技术中的液晶显示装置的结构示意图及扫描信号时序控制波形图,其通过第一时钟信号的上升沿触发扫描信号的上升沿,通过第二时钟信号的上升沿触发扫描信号的下降沿。如图1所示,现有技术的液晶显示装置中,扫描信号由于电阻和电容的影响,原本正常的扫描信号会发生变形,导致面板两侧的扫描信号波形(如波形A)与中间位置的扫描信号波形(如波形B)差异明显,这样会导致每一行的所有薄膜晶体管导通的时间存在较大差异,出现面板显不差异,严重影响TFT-1XD的显不品质。

【发明内容】

[0004]本发明主要解决的技术问题是提供一种削角电路、具有该电路的液晶显示装置及驱动方法,能够降低面板两侧与中间位置的扫描信号的波形差异,从而提高液晶显示装置的显不品质。
[0005]为解决上述技术问题,本发明采用的一个技术方案是:提供一种液晶显示装置,包括:像素单元;数据线,用于传输数据信号至像素单元;时钟信号产生芯片,用于产生第一及第二时钟信号;削角电路,与时钟信号产生芯片连接,用于接收所述第一及第二时钟信号,并根据所述第一及第二时钟信号输出上升沿削角的扫描信号;扫描线,用于将削角后的扫描信号传输至像素单元。
[0006]其中,像素单元包括薄膜晶体管和像素电极,薄膜晶体管包括栅极、源极和漏极,像素电极连接漏极,扫描线连接栅极,以将削角后的扫描信号传输至栅极,进而控制薄膜晶体管导通,数据线连接源极,以在薄膜晶体管导通时经源极传输数据信号至像素电极。
[0007]其中,削角后的扫描信号的上升沿倾斜成一倾斜部。
[0008]其中,所述倾斜部从所述扫描信号的低电平倾斜上升至所述扫描信号的高电平。
[0009]其中,削角电路包括一电位转移芯片、一电阻及一电容,所述电位转移芯片的第一输入引脚用于接收所述第一时钟信号,所述电位转移芯片的第二输入引脚用于接收所述第二时钟信号,所述电位转移芯片的扫描信号输出引脚用于输出扫描信号给所述扫描线,所述电位转移芯片的延迟引脚依次经所述电阻及所述电容接地。
[0010]其中,所述电位转移芯片包括第一上升沿侦测电路、下降沿侦测电路、第二上升沿侦测电路、第一至第三N型MOS管、一第一电压发生器及一第二电压发生器,所述第一电压发生器的输出电压大于所述第二电压发生器的输出电压,所述第一上升沿侦测电路的输入端连接所述第一输入引脚,所述第一上升沿侦测电路的输出端连接所述第一 N型MOS管的栅极,第一 N型MOS管的漏极连接所述电位转移芯片的延迟引脚,第一 N型MOS管的源极连接所述电位转移芯片的扫描信号输出引脚,所述下降沿侦测电路的输入端连接所述第一输入引脚,所述下降沿侦测电路的输出端连接所述第二 N型MOS管的栅极,所述第二 N型MOS管的漏极连接所述第一电压发生器,所述第二 N型MOS管的源极连接所述第一 N型MOS管的源极及所述电位转移芯片的扫描信号输出引脚,所述第二上升沿侦测电路的输入端连接所述第二输入引脚,所述第二上升沿侦测电路的输出端连接所述第三N型MOS管的栅极,所述第三N型MOS管的漏极连接所述第二电压发生器,所述第三N型MOS管的源极连接所述第一 N型MOS管的源极、所述第二 N型MOS管的源极及所述电位转移芯片的扫描信号输出引脚,所述第一上升沿侦测电路与所述下降沿侦测电路连接,所述下降沿侦测电路与所述第二上升沿侦测电路连接。
[0011]其中,通过调节所述第一时钟信号的上升沿到下降沿的时间,来控制输出的扫描信号的前削角倾斜度。
[0012]为解决上述技术问题,本发明采用的另一个技术方案是:提供一种削角电路,包括一电位转移芯片、一电阻及一电容,所述电位转移芯片的第一输入引脚用于接收一第一时钟信号,所述电位转移芯片的第二输入引脚用于接收一第二时钟信号,所述电位转移芯片的扫描信号输出引脚分别用于输出扫描信号,所述电位转移芯片的延迟引脚依次经所述电阻及所述电容接地。
[0013]其中,所述电位转移芯片包括第一上升沿侦测电路、下降沿侦测电路、第二上升沿侦测电路、第一至第三N型MOS管、一第一电压发生器及一第二电压发生器,所述第一电压发生器的输出电压大于所述第二电压发生器的输出电压,所述第一上升沿侦测电路的输入端连接所述第一输入引脚,所述第一上升沿侦测电路的输出端连接所述第一 N型MOS管的栅极,第一 N型MOS管的漏极连接所述电位转移芯片的延迟引脚,第一 N型MOS管的源极连接所述电位转移芯片的扫描信号输出引脚,所述下降沿侦测电路的输入端连接所述第一输入引脚,所述下降沿侦测电路的输出端连接所述第二 N型MOS管的栅极,所述第二 N型MOS管的漏极连接所述第一电压发生器,所述第二 N型MOS管的源极连接所述第一 N型MOS管的源极及所述电位转移芯片的扫描信号输出引脚,所述第二上升沿侦测电路的输入端连接所述第二输入引脚,所述第二上升沿侦测电路的输出端连接所述第三N型MOS管的栅极,所述第三N型MOS管的漏极连接所述第二电压发生器,所述第三N型MOS管的源极连接所述第一 N型MOS管的源极、所述第二 N型MOS管的源极及所述电位转移芯片的扫描信号输出引脚,所述第一上升沿侦测电路与所述下降沿侦测电路连接,所述下降沿侦测电路与所述第二上升沿侦测电路连接。
[0014]为解决上述技术问题,本发明采用的另一个技术方案是:提供一种液晶显示装置的驱动方法,包括:提供扫描信号;对扫描信号的上升沿进行削角;将削角后的扫描信号传输至扫描线。
[0015]本发明的有益效果是:区别于现有技术的情况,本发明的液晶显示装置通过用削角电路对扫描信号的上升沿进行削角,然后利用扫描线将削角后的扫描信号传输至像素单元,使得面板两侧与中间位置的扫描信号的波形差异减小,以此来提高显示装置的显示品质。
【附图说明】
[0016]图1是现有技术中输入同一面板两侧与中间位置扫描信号的波形图;
[0017]图2是现有技术中液晶显示装置的结构示意图;
[0018]图3是现有技术中扫描信号时序控制波形图;
[0019]图4是本发明的液晶显示装置的结构示意图;
[0020]图5是本发明的削角电路的电路图;
[0021]图6是本发明的削角后的扫描信号的波形图;
[0022]图7是本发明的液晶显示装置的驱动方法的流程图。
【具体实施方式】
[0023]请参阅图4,是本发明的液晶显示装置的结构示意图。如图4所示,本发明的液晶显示装置20包括多个像素单元21、时钟信号产生芯片22、削角电路23、数据驱动器24、多条扫描线A以及多条数据线C。其中,数据驱动器24用于产生数据信号。数据线C与数据驱动器24连接,用于传输该数据信号至像素单元21。时钟信号产生芯片22用于产生第一时钟信号及第二时钟信号。削角电路23与时钟信号产生芯片22连接,用于接收第一及第二时钟信号并根据所述第一及第二时钟信号对扫描信号的上升沿进行削角。扫描线A连接削角电路23,用于将削角后的扫描信号传输至像素单元21。
[0024]像素单元21包括薄膜晶体管T和像素电极P,薄膜晶体管T包括栅极G0、源极SO和漏极D0。其中,像素电极P连接漏极D0,扫描线A连接栅极G0,以将削角后的扫描信号传输至栅极G0,进而控制薄膜晶体管T导通,数据线C连接源极S0,以在薄膜晶体管T导通时经源极SO传输数据信号至像素电极P。
[0025]本实施例中,同一条扫描线A驱动多个像素单元21,并且该多个像素单元21分别显示如图2所示的颜色G、R以及B。在扫描线A传输扫描信号时,同一条扫描线A驱动的多个像素单元21的薄膜晶体管T都打开,此时,多条数据线C同时传输数据信号到相应的像素单元21中的像素电极P,以向显示不同颜色的像素单元21进行充电。本实施例中,由于液晶显示装置20中的电阻和电容的影响,使得产生的扫描信号由低电位变化到高电位时产生延迟现象。因此本实施例采用削角电路23对扫描信号进行削角,具体的削角电路23如图5所示。
[0026]请参阅图5,所述削角电路23包括一电位转移芯片30、一电阻R及一电容C。所述电位转移芯片30的第一输入引脚I用于接收所述第一时钟信号,所述电位转移芯片30的第二输入引脚2用于接收所述第二时钟信号,所述电位转移芯片30的扫描信号输出引脚4用于输出扫描信号CKl给所述扫描线A,所述电位转移芯片30的延迟引脚3依次经所述电阻R及所述电容C接地。在本实施例中,所述削角电路23输出若干扫描信号,如CK1-CK4,在此仅以扫描信号CKl为例进行说明。
[0027]所述电位转移芯片30包括第一上升沿侦测电路31、下降沿侦测电路32、第二上升沿侦测电路33、第一至第三N型MOS管Q1-Q3、第一电压发生器35及第二电压发生器36。其中所述第一电压发生器35的输出电压大于所述第二电压发生器36的输出电压。所述第一上升沿侦测电路31的输入端连接所述第一输入引脚1,所述第一上升沿侦测电路31的输出端连接所述N型MOS管Ql的栅极,所述N型MOS管Ql的漏极连接所述电位转移芯片30的延迟引脚3,N型MOS管Ql的源极连接所述电位转移芯片30的扫描信号输出引脚4,所述下降沿侦测电路32的输入端连接所述第一输入引脚1,所述下降沿侦测电路32的输出端连接所述N型MOS管Q2的栅极,所述N型MOS管Q2的漏
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