专利名称：多模式功率节制机制的制作方法
技术领域：
本发明涉及微处理器，具体地说，本发明涉及微处理器中用于控制功耗的机制。
背景技术：
现代的处理器包括大量的执行资源以支持多个指令的同时处理。处理器常常包括一个或者多个整数、浮点、分支以及存储器执行单元，以分别完成整数、浮点、分支和加载/存储指令。还提供了寄存器文件和片上高速缓存，以给执行资源提供操作数。当这些资源被执行中的程序完全占用时，它们可能产生明显的功率耗散问题。
如下这样的指令代码序列是相对稀少的，即包括足够的恰当类型的指令的指令代码序列，这些指令在有效时间中完全占用处理器的执行资源。智能编译器和乱序执行从大多数代码中仅仅可以提取这种程度的指令级并行(ILP)。为了节省功率，处理器可以利用时钟门控机制，以切断被输送给没有被执行中的代码序列使用的执行资源或者它们的部件的时钟信号。当执行具有更一般的ILP水平的代码序列时，这样的处理器可以按照需要占用大量的资源，例如来支持具有高ILP的代码序列，而不用耗散大量的功率。
对于具有高ILP的代码序列，即使有的话也是很少的资源可以被门控关断，与其运行具有更一般的ILP的代码相比，处理器可能耗散明显更大的功率。为了适用高功耗代码，通过例如限制其工作频率，可以在低于其最高性能水平的水平上运行处理器。以这样的方式抑制处理器为那些导致处理器耗散大量功率的代码序列留下了热裕度。
被称为功率节制的另一种策略允许处理器缺省时在其最高性能水平下工作，并且如果处理器的功耗变得太大的话，则减小(节制)性能水平。功率节制可以通过许多机制来实现。这些机制包括改变每周期被处理的指令的数量(指令吞吐量)或者改变处理器工作的电压和/或频率(工作点)。这些以及其他的功率控制机制具有它们特定的优点和缺点。
功率耗散与处理器电压的二次方成比例，使得电压电平的调整成为控制处理器功率的有效手段。功率耗散与处理器的时钟频率成线性比例关系。然而，频率和电压常常被一起调整，因为最大频率受限于在晶体管栅极处可用的电压驱动。此外，用于工作点调整的等待时间明显大于处理器的功耗可能改变的时间标度，使得其成为用于管理这些变化的相对粗糙的机制。功率耗散与指令吞吐量成线性比例关系。与工作点改变相比，可以用更低的等待时间来实施对指令吞吐量的调整，但是它们可能不足以抵消功耗的变化。
本发明针对与监视和控制处理器和其他可编程设备的功耗相关联的这些和其他的问题。
参考附图可以理解本发明，其中类似的标号指示类似的元件。这些图形被提供来举例说明本发明的所选的实施例，并且不意于限定本发明的范围。
图1是在其上可以实现本发明的计算机系统的一个实施例的框图。
图2是根据本发明实现了数字功率节制装置的处理器的一个实施例的框图。
图3是由图2的处理器所实现的数字功率节制装置的一个实施例的框图。
图4A是图3的数字功率节制装置的监视电路的一个实施例的框图。
图4B是图4A的监视电路的另一个实施例的框图。
图5是图3中示出的数字节制装置的模式单元的一个实施例的框图。
图6是表示根据本发明的使用不同功率控制机制的方法的一个实施例的流程图。
图7是用于在图3中示出的数字节制装置的监视电路的另一个实施例的框图。
图8是表示根据本发明的使用不同功率控制机制的方法的另一个实施例的流程图。
具体实施例方式
在下面的讨论阐述了很多具体细节，以提供对本发明的充分理解。但是，在受益于本公开之后，本领域的普通技术人员将理解，不用这些具体细节也可以实施本发明。此外，没有对各种公知的方法、过程、部件和电路进行详细的描述，以便使注意力集中在本发明的特征上。
本发明提供了利用多种功率控制模式控制处理器功率耗散的机制。计算机系统包括具有数字节制装置的处理器。数字节制装置监视处理器的活动，以估计处理器的功率状态。如果通过估计出的功率状态被准许，则数字节制装置触发多种功率控制模式中的一种。对于本发明的一个实施例，如果所估计的功率状态达到第一阈值，则触发第一功率模式。取决于处理器对第一功率控制模式的响应，可以触发第二功率控制模式。
根据其控制功率耗散所用等待时间，可以使用各种功率控制模式。例如，诸如空操作注入和单指令发射之类的指令吞吐量控制机制有效地调整了每时钟周期被处理的指令数量。这些机制可以被实现在检测功率状态问题的若干时钟周期之中。它们可以被用于对功率状态进行小的调整，并且其相对短的等待时间允许其处理与快速电流变化相关联的问题，例如与大的di/dt相关的电压下降。
频率控制机制，例如如果功率耗散超过一个阈值则降低时钟频率，可以对功率耗散产生更大的影响。因为驱动时钟的锁相环需要被重新调整，所以与吞吐量控制相比，频率控制的实施花费更多的时间。相结合的电压和频率机制对功率耗散有更大的影响，但是具有最长的实施等待时间。本发明依据处理器的功率状态，允许使用一个或者多个功率控制机制。
图1是在其中可以实现本发明的计算机系统100的一个实施例的框图。计算机系统100包括一个或者多个处理器110、主存储器140、非易失性存储器150、各种外围设备160和系统逻辑170。系统逻辑170控制(一个或者多个)处理器110、主存储器140、非易失性存储器150和外围设备160之间的数据传输。还示出了功率输送单元180。计算机系统100被提供来举例说明本发明的各种特征。所示出的特定结构对于实现本发明不是必需的。
处理器110包括多个单元124，所述多个单元124形成指令执行流水线120。指令从主存储器140和非易失性存储器150被提供给处理器110。数字节制装置130监视响应于被处理的指令的各种单元124中的功耗，并且相应地调整处理器110的运行。
当指令沿着流水线120进行时，其引导各种单元124运行一个或者多个操作，所述一个或者多个操作合起来实现了所述指令。例如，浮点乘法累加指令(FMAC)可以导致在指定的资源中发生下面的操作浮点寄存器文件读出三个操作数；FMAC执行单元将操作数中的两个相乘，并将乘积与第三操作数相加；异常单元检查乘积以及总和的错误；以及如果没有检测到错误，则退休单元将结果写入浮点寄存器文件。取决于具体的处理器实施方式，这些资源或者它们的部件可以被分组成一个或者多个单元，当指令被沿着流水线进行时，所述单元被打开和关毕。每一个单元当被指令激活时，消耗一定量的电流。
对于本发明的一个实施例，单元124所消耗的电流或者功率通过相关联的权重或者多个权重来表示。当单元被指令激活时，数字节制装置130检测到其活动状态，并且将第一权重包括在表示给定时钟周期中处理器的活动性(例如电流或者功耗)的总和中。如果该单元没有被激活，则数字节制装置130可以将第二权重加到总和上。第二权重可以是零，或者是表示处于非活动状态中的单元的电流或功耗的值。对于一个实施例，所得到的加权的总和被换算，以反映处理器当前的工作点。对于另一个实施例，单个的权重自身可以被换算。数字节制装置130在选定的间隔内实施这些操作，生成表示处理器的估计的功率状态的值，并且如果该值超过了规定的阈值水平，则调整处理器的运行。
图2更具体地表示了处理器110的一个实施例。对于处理器110的所公开实施例，流水线120被分别表示为取指(FET)阶段、展开(EXP)阶段、寄存器(REG)阶段、执行(EXE)阶段、检测(DET)阶段和退休(RET)阶段，并且指定了对应于每一个阶段的执行资源。本发明不要求将处理器110分成特定的一组流水线阶段。例如，所公开的阶段可以被再分成两个或者更多的阶段，以处理时序问题或者促进更高的处理器时钟速度。或者，两个或者更多的阶段可以被合并成一个阶段。其他的实施例可以包括用于乱序处理指令的硬件。所公开的流水线仅仅提供了在实现本发明的处理器中如何分解操作的一个示例。
流水线120的前端包括取指单元210和发射单元220，其将指令提供给流水线120后端中的执行单元用于执行。取指单元210通过本地高速缓存(没有示出)或者直接地从存储器140获取指令，并将取到的指令提供给发射单元220。发射单元220对指令进行译码，并将它们发射到流水线120后端中的执行资源。
在整个讨论中，术语“指令”被用于泛指指令、宏指令、指令束或者用于编码处理器操作的许多其他机制的任何一种。例如，译码操作可以将宏指令转换成一个或者多个微操作(μop)，将指令束分解成一个或者多个指令节，或者获取与指令相关联的微代码序列。
流水线120的后端包括寄存器单元230、执行单元250、异常单元260和退休单元270。寄存器单元230包括寄存器重命名单元和各种寄存器文件(没有示出)，分别用于识别指令中所指定的寄存器和从所识别的寄存器中存取数据。执行单元250包括一个或者多个分支执行单元(BRU)252、整数执行单元(IEU)254、加载/存储单元(LSU)256和浮点执行单元(FPU)258，以分别处理分支、整数、加载/存储和浮点指令。异常单元260检查由执行单元250生成的结果，并且如果遇到异常条件的话，调整控制流。如果没有检测到异常条件，退休单元270利用结果来更新处理器110的体系结构状态。
被不同指令激活的单元对应于被指定给流水线120的执行资源的各种组合和子集。例如，一个单元可以包括浮点寄存器(在寄存器单元230中)，而FPU 258可以具有位于两个或者更多单元中的多个部件。总之，一个单元包括一同被激活或者去激活的各种执行资源(寄存器文件、执行单元、跟踪逻辑)。本发明不依赖于图2中示出的单元和执行资源之间的具体的对应关系。
图3是表示数字节制装置130和其与流水线120的单元124之间相互作用的一个实施例的框图。数字节制装置130的所公开的实施例包括门控单元310(1)～310(n) (总称门控单元130)、监视电路320、节制单元360和模式单元390。每一个门控单元310与流水线120中的单元124相关联，并能够指明其相关联的单元的活动性状态。例如，门控单元310可以是这样的时钟门控电路，即，根据单元124的服务对于完成当前在流水阶段中的指令是否是必需的，该门控电路将时钟信号向单元124耦合或者去耦合，其中所述单元在该流水线中运行。
对于数字节制装置130的所公开的实施例，每个门控单元310向监视电路320提供信号，以指明其相关联的单元的活动性状态。如果信号被断言，则监视电路320将第一权重加到表示处理器110每个时钟活动性的估计值上。第一权重表示单元124在被激活时所吸取的电流或者功率。如果该信号没有被断言，则监视电路320将第二权重加到估计值中。第二权重表示单元124在被去激活时所吸取的电流或者功率。第二权重可以是零或者表示被去激活的单元124中的漏电流的值。一般的处理器可以包括10～20个门控单元310，以控制到10～20个单元124的功率输送。
监视电路320收集来自门控单元130的信号，从所收集的信号评价当前功率状态，并且基于所评价的功率状态确定是否调用一种功率控制机制。如果功率控制被准许，则监视电路320向节制单元360发信号，以实施若干功率控制机制中的一种。模式单元390监视所实施的功率控制机制的效果，并且确定是否调用另外的功率控制机制。模式单元390可以通过监视电路320、节制单元360或者某些其他资源，接收当前功率控制机制的功效的指示。
对于数字节制装置130的所公开的实施例，监视电路320包括活动性监视器(AM)330和阈值单元(TU)350。AM 330基于被监视单元124的活动性状态，跟踪处理器的活动性，并且向TU 350提供活动性的指示，用于与阈值相比较。TU 350确定所指示的活动性是否已经达到了阈值，并且如果达到了阈值的话，则向节制单元360发信号以触发功率控制模式。
对于数字节制装置130的一个实施例，阈值指示高功耗状态，而节制单元360触发处理器，以启动第一功率控制模式。第一功率模式例如可以通过降低指令吞吐量或者降低处理器的工作频率来提供功率减小的线性控制。模式单元3监视第一功率控制模式的效果，并且如果被准许的话，激活第二功率模式。
图4A是监视电路320的一个实施例的框图。AM 330的所公开的实施例包括权重单元432(1)～432(n)(总称权重单元432)、加法器434、存储单元(SU)444和累加器446。每一个权重单元432通过相应的门控单元310与单元124中一个相关联。如果来自其门控单元310的活动性状态信号被断言，则权重单元432将第一权重提供给加法器434，并且如果活动性状态信号没有被断言，则提供第二权重。SU 444中的值例如可以表示额定的功率或者电流水平。阈值被求反，并被提供至加法器434的另一个输入端。
加法器434确定阈值与权重单元134所指示的权重的和之间的差。该差表示相对于例如额定功率水平的活动性水平(相对活动性水平或者RAL)。其被加到累加器446中的值上，所述累加器446保存相对活动性水平的流水帐。对于AM 330的一个实施例，在每个时钟周期向累加器446提供相对活动性水平，累加器446有效地累计了相对于阈值的每周期的活动性。例如，可以换算所述权重以表示单元124每周期的功耗的估计，而第一阈值可以是指定的平均功率。在这种情况下，累加器446中的值表示相对于与平均功率状态相关联的温度的热超出和热不足。
AM 330的其他实施例可以包括用于以规定的取样频率将累加器446中的值转发到阈值单元350的电路。取样周期允许数字节制装置130缓和功耗尖峰的影响。
对于监视电路320的所公开的实施例，由累加器446所跟踪的值(例如，累加的功率或者电流消耗)被提供给TU 350，用于以与阈值相比较。TU 350的所公开的实施例包括储存装置454和比较器458。如上面所提到的，累加器446中的值可以在每个时钟周期被提供，或者在规定的取样周期后被提供。储存装置454存储表示阈值水平的值，其中，累加器446中的值与该值进行比较。对于上面所描述的示例，阈值可以表示上限温度阈值和下限温度阈值，其中，如果达到了上限和下限阈值的话，其将分别触发功率减小和功率增大机制。
如果累加的电流消耗达到由储存装置454表示的阈值，则TU 350向节制单元360提供信号，该信号触发功率控制机制。如上面所提到的，这可以通过下列策略来实现每时钟周期发射更少(更多)的指令、减小(增大)处理器运行的时钟频率、减小(增大)处理器运行的电压或者这些策略的某种组合或其他功率减小(增大)策略。
处理器单元所消耗的功率取决于处理器的工作点。例如，在较低的频率和/或电压下，给定的单元在其激活状态中消耗较少的功率。因此，AM330的一个实施例包括换算单元，用于调整其活动性估计，以反映运行状态的变化。对于数字节制装置130的其他实施例，AM 330还可以包括换算单元，用于调整其计算，以反映处理器运行状态的变化。如果功率控制模式调整处理器110的工作点以处理超范围的功率状态，则换算单元允许AM 330调整其对处理器活动性的估计，以反映新的工作点。
图4B示出了监视电路320的另一个实施例，其被改进以基于处理器110的被监视的活动性解决工作点的变化。AM 330的所公开的实施例包括位于加法器434的输出端的第一换算单元436。转换单元(CU)340包括第二加法器442、SU 444和位于SU 444的输出端的可选的第二换算单元448。
加法器434对权重单元134所指示的权重进行求和，并且换算单元436调整所述和，以反映处理器的当前的工作点。信号OP1将当前的工作点指示给换算单元426。例如，换算单元436可以存储适合于不同工作点的换算因子，并且响应于OP1应用适合于当前工作点的换算因子。
然后，换算出的活动性水平通过加法器442与来自SU 444的水平值结合。如果存在的话，换算单元(SU)448响应于由OP2所指示的处理器工作点的变化，允许对储存单元444中的值进行类似的换算。如上面所提到的，可以通过下列的策略来实现功率控制每时钟周期发射更少(更多)的指令、减小(增大)处理器运行的时钟频率、减小(增大)处理器运行的电压或者这些策略的某种组合或其他功率减小(增大)策略。在到达这样的程度的情况下，即任何这些改变影响了适合于被监视单元124的加权或者TSU 444中的阈值，则可以选择(一个或者多个)新的换算因子以供数字节制装置130使用。
图5是适于在不同功率控制机制之间进行切换的模式单元380的一个实施例的框图。模式单元380的所公开的实施例包括饱和单元510和模式选择器550。饱和单元(SU)510监视当前有效的功率控制模式的效果，模式选择器550基于来自TU 250和SU 510的输入，选择哪一种(如果有的话)功率控制模式是有效的。
SU 510的所公开的实施例包括加法器514、重设单元518、累加器520、比较器530(a)、530(b)和阈值储存装置534(a)、534(b)。加法器514和重设单元518监视TU 530的输出，以确定是否使用第一功率控制模式。累加器520根据是否使用第一功率控制模式，递增或者递减被存储的值。所存储的值指明使用第一功率控制机制的频度。如果该值达到第一阈值，例如储存装置534(a)中的值，则第一控制模式被过分频繁地激活，并且第二控制模式被准许。如果该值达到第二阈值，例如储存装置534(b)中的值，则第二控制模式不再是必需的。第一和第二比较器530(a)和530(b)向模式选择器550断言它们的信号，该模式选择器550相应地调整控制模式。
对于数字节制装置的一个实施例，第一控制模式调整指令吞吐量(ITP)，而第二控制模式调整处理器的工作点(OP)。用于调整指令吞吐量的一种机制是将空操作(NOP)注入处理器的执行流水线。美国专利申请No.________(题目未知)描述了用于注入NOP的机制。
对于利用指令吞吐量速率和工作点来控制功耗的多模式数字节制装置，模式选择器550可以实现表1中所总结的动作。这里，AL是指由AM330所跟踪的(经换算的)活动性水平，TC是指由模式单元380所跟踪的节制计数。
表1
图6是表示根据本发明用于控制处理器中的功耗的方法600的一个实施例的流程图。方法600基于处理器的部件单元的活动/非活动状态，监视610处理器的活动性。可以根据处理器的当前的工作点对所估计的活动性进行换算，以提供处理器的功率状态的指示。活动性水平被与活动性水平的允许范围相比较620。如果该比较620表明处理器运行在该范围之外，则指令吞吐量被节制630，并且节制计数被调整640。
检查650节制计数，以确定指令节制是否是有效的。例如，如果指令节制被反复地调用，并且活动性水平保持在规定范围之外，则其没有有效控制处理器的功率状态，并且降低660处理器的工作点。如果支持权重换算，则被用于换算所监视的活动性水平的权重也被调整670，并且继续监视610。
如果处理器的活动性水平在规定范围之内620，则检查670处理器的工作点。如果工作点先前已经被降低了，则检查680计时器。计时器强制限制工作点切换之间的基本间隔，以避免过于频繁地切换工作点。如果间隔已经过去了680，则提高690工作点，并调整670被用于确定活动性水平的权重，并且继续监视。如果所述间隔还没有过去680，则在这一次中不进行工作点的调整。
方法600已经被示出用于这种情况，即其中第一控制机制是指令节制，而第二控制机制调整处理器的工作点，例如其电压和/或频率。处理器设计领域的技术人员在受益于本公开之后，将认识到还可以使用其他的功率控制机制。此外，不同的机制可以分别具有不同的操作水平。例如，依赖于处理器的功率状态，处理器的工作点可以对于许多不同的频率/电压组合是可调的。类似地，依赖于相对活动性水平停留在阈值之上的时间长度，可以在更长或者较短的期间中对指令进行节制。例如，可以每隔n个有效指令向指令流中引入一个空操作(NOP)，n取一定范围的值。
图7是数字节制装置130的另一个实施例的框图。数字节制装置的所公开的实施例包含多个CU 340(1)...340(n)(总称CU 340)和相关联的TU 350(1)...350(n)(总称TU 350)。每一对CU/TU可以被用于监视不同功率/时序状态的处理器功率状态。例如，第二对CU/TU 340(1)/350(1)可以将不同的相对活动性水平(RAL)与阈值相比较，其中所述阈值指示基于频率(或者电压/频率)的功率控制机制被准许(OP1阈值)。
模式控制单元380也被示出，用于监视功率控制机制，并基于(一个或者多个)活动功率控制模式的行为，例如饱和，在功率控制模式之间进行切换。例如，如果ITP功率控制模式被反复地使用(饱和)，则模式控制单元380可以使用基于频率的功率控制模式。在使用频率控制模式的情况下，模式控制单元380响应于ITP的连续的、反复的使用，可以使用基于电压或者电压/频率的控制模式。
图8是表示用于激活不同功率控制机制的方法800的另一个实施例的流程图。方法800测试与其各自的阈值相对照的相对活动性水平(RAL1、RAL2)820，并且使用所指示的例如ITP或者基于频率的功率控制机制。在两个模式中，都检查834、846 ITP的饱和征兆。在ITP模式中，如果检测到834饱和，则可以使用频率调整。如果使用频率模式，则若检测到饱和，可以使用电压或者电压/频率模式。对于处理器的工作点(频率和/或电压)的调整可以通过对用于监视处理器的活动性水平的权重的相应调整来实现。若没有RAL阈值被越过820，如果处理器的工作点先前已经通过840、860被降低的话，则方法800可以提高856处理器的工作点。
在不同的控制控制模式之中的功率控制模式和水平的所得到的组合允许以减小功率节制对处理器的性能的影响的方式，对处理器的功率状态进行精细调整。
如此提供了一种数字节制装置，其监视处理器的活动性，并根据处理功率状态问题的需要，选择两种或者更多种功率控制机制中的一种。所公开的实施例已经被提供来举例说明本发明的各种特征。处理器设计领域的技术人员在受益于本公开之后，将会认识到所公开实施例的变化和修改，它们依然落入所附权利要求的精神或范围之中。
权利要求
1.一种系统，包括执行流水线；数字节制装置，所述数字节制装置响应于所述执行流水线的活动性，估计功率状态，并且响应于所述估计的功率状态达到第一阈值，触发多个功率控制机制中的一个。
2.如权利要求1所述的系统，其中，所述功率控制机制包括调整执行流水线的指令吞吐量以及调整所述执行流水线的工作点。
3.如权利要求1所述的系统，其中，所述数字节制装置包括活动性监视器，用于响应于所述执行流水线的单元的活动性状态提供活动性水平；转换单元，用于根据所述活动性水平估计所述功率状态；和阈值单元，用于响应于所述功率状态达到所述第一阈值，触发第一功率控制机制。
4.如权利要求3所述的系统，其中，所述数字节制装置响应于第二功率控制机制被准许的指示，触发所述第二功率控制机制。
5.如权利要求3所述的系统，其中，所述数字节制装置包括模式单元，用于监视所述阈值单元的输出，以及响应于所述输出达到第二阈值，触发第二功率控制机制。
6.如权利要求5所述的系统，其中，所述第一功率控制机制调整所述执行流水线的指令吞吐量，以及所述第二功率控制机制调整所述执行流水线的工作点。
7.如权利要求1所述的系统，还包括模式单元，用于响应于第一功率控制模式达到饱和条件，从所述第一功率控制模式切换到第二功率控制模式。
8.一种方法，包括监视处理器的活动性水平，以确定功率状态；如果所述功率状态满足第一阈值，则激活第一功率控制机制；监视与所述第一功率控制机制相关联的状态；以及响应于所述被监视的状态，激活第二功率控制机制。
9.如权利要求8所述的方法，其中，所述状态是指示由所述第一功率控制机制所提供的功率控制水平的计数，并且所述激活包括响应于所述计数达到阈值而激活所述第二功率控制机制。
10.如权利要求9所述的方法，其中，所述计数跟踪所述第一功率控制机制被激活的次数或者所述第一功率控制机制被激活的持续时间。
11.如权利要求8所述的方法，其中，所述激活所述第一功率控制机制包括响应于所述功率状态达到所述第一阈值，调整所述处理器的指令吞吐量。
12.如权利要求11所述的方法，其中，所述激活所述第二功率控制机制包括响应于所述被监视的状态，调整所述处理器的工作点。
13.一种装置，包括执行流水线，包括用于执行指令的一个或者多个单元；活动性监视器，用于响应于所述一个或者多个单元的活动性状态，估计所述处理器的活动性水平；节制电路，用于响应于根据所述估计的活动性水平达到第一阈值而确定的功率状态，触发第一功率模式；和模式电路，用于跟踪与所述第一功率模式相关联的状态，以及响应于所述状态达到第二阈值，触发第二功率模式。
14.如权利要求13所述的装置，其中，所述状态是计数值，所述计数值跟踪所述第一功率模式的使用，以及如果所述使用达到所述第二阈值，则所述模式电路触发所述第二功率模式。
15.如权利要求14所述的装置，其中，所述计数跟踪所述第一功率模式被触发的次数或者所述第一功率模式处于活动的时间间隔。
16.如权利要求13所述的装置，其中，所述第一功率模式调整执行流水线的指令吞吐量，以及所述第二功率模式调整所述执行流水线的工作点。
17.如权利要求16所述的装置，其中，所述第二功率模式指定所述执行流水线可能运行于其下的电压和频率的多个组合中的一个。
18.如权利要求17所述的装置，其中，所述模式单元在所述多个组合的第一个处启动所述第二功率模式，并且响应于运行在所述第一组合下的所述执行流水线的估计的功率状态，选择新的组合。
19.如权利要求17所述的装置，其中，所述模式单元响应于运行在当前组合下的所述执行流水线的所述功率状态达到第四阈值，去激活所述第二功率模式。
全文摘要
处理器(110)包括数字节制装置(130)，用于监视处理器的指令执行流水线(120)的各种单元(124)的活动性，并根据所监视的活动性确定处理器(110)的功率状态。响应于处理器(110)的功率状态达到一个阈值，使用两种或者更多种功率控制机制中的一种。
文档编号G06F9/318GK1608240SQ02826267
公开日2005年4月20日 申请日期2002年12月12日 优先权日2001年12月28日
发明者詹姆斯·伯恩斯, 戴维·艾尔斯, 玛莎·恩格, 爱德华·格罗霍夫斯基, 斯特凡·鲁苏, 维韦克·蒂瓦里 申请人:英特尔公司