专利名称：改进的抖动产生的制作方法
背景技术：
本发明涉及对抖动产生的改进，更具体地说，涉及产生用于被测器件(DUT)的激励信号中的抖动。
集成电路(IC)需要被测试来确保正确工作。这在IC开发和制造期间尤其需要。在后一情形中，IC通常在最终应用之前被测试。在测试期间，作为被测器件(DUT)的IC被暴露给各种类型的激励信号，并且其响应被测量、处理，并且通常被与良好器件的预期响应进行比较。自动测试设备(ATE)通常根据器件专用测试程序执行这些任务。ATE的示例有Agilent technologies的Agilent 83000和93000半导体测试系统家族，在http//www.ate.agilent.com/ste/products/intelligent_test/SOC_test/SOC_Tech_Oview.shtml处公开了这些测试系统家族。在例如EP-A-859318、EP-A-864977、EP-A-886214、EP-A-882991、EP-A-1092983、US-A-5,499,248和US-A-5,453,995中也公开了这些家族的细节。
EP 1 162 739 A公开了一种添加抖动和电平噪声到数字数据信号的滤波器。根据该滤波器的特性，所产生的抖动取决于数字数据信号。
发明内容
本发明的一个目的是提供改进的抖动产生，具体而言，提供作为用于被测器件(DUT)的激励信号的数字数据信号中改进的抖动产生。
该目的由独立权利要求限定的技术方案实现。优选实施例由从属权利要求限定。
根据本发明，相位或频率调制时钟信号被用于通过将调制时钟信号用于时钟化(clocking)数据图样，来产生数字数据信号中的期望的抖动，例如，产生用于DUT的激励信号中的期望抖动。利用本发明，可以对DUT的高速数据输入进行测试。具体而言，本发明提供了时钟数据恢复电路追踪低速抖动和高速抖动的可测试性，所述低速抖动被称作带内抖动，其是时钟数据恢复电路的锁相环应当追踪的对象，高速抖动被称作带外抖动，时钟数据恢复电路的锁相环必须能容许这种抖动。
根据本发明产生的抖动可以独立于数字数据信号而被调节，即，可以产生随机抖动和确定抖动。抖动幅度和抖动频谱完全是可编程的，因此可以针对特定应用容易地调节。用于抖动产生的电子电路可以利用CMOS半导体技术集成。可以针对被测DUT的每个管脚独立地产生抖动。
本发明还涉及软件程序和产品，所述软件程序和产品当在诸如计算机之类的数据处理系统上运行时执行用于同步数字时钟信号的方法。优选地，该程序或产品被存储在数据载体上。
此外，本发明还涉及用于根据本发明产生数字数据信号中的抖动的系统。
结合附图参考下面的详细描述，将更容易意识到并且能更好地理解本发明的其他目的和许多随之而来的优点。基本相同或相似或者功能相同或相似的特征将由相同的标号标识。
图1示出了第一实施例的框图，图2示出了第二实施例的框图，图3示出了第三实施例的框图，图4示出了实现时钟源的第一可能方式的框图，图5示出了用于提供序列N(k)的两个可能实施例，图6示出了实现时钟源的第二可能方式的框图，以及图7示出了实现时钟源的第三可能方式的框图。
具体实施例方式
图1示出了本发明的第一实施例的框图。图1中示出的系统可以位于在输出线路2上提供数字数据信号的自动测试设备(ATE)中，其中数字数据信号被用作用于被测器件(DUT，未示出)的激励信号。数字数据信号具有预定数据图样，在第一实施例中，该预定数据图样是由位于ATE内的数字图样源4提供的。数字图样尤其适用于对DUT的功能进行测试，其中DUT的响应由ATE评估。
数据图样按照第一时钟10经由数据图样线路6被输入到存储器8中，第一时钟10经由第一时钟线路12被分发到数据图样源4以用于读出数据图样，还被分发到存储器8以用于读入数据图样。存储器8具有先入先出(FIFO)体系结构。存储器8中存储的数据根据时钟源14在时钟线路18上提供给所述存储器8的时钟信号经由驱动器单元16被输出到输出线路2。
时钟源14提供的时钟信号根据存储在时钟控制数据源20中的时钟控制数据被调制，时钟控制数据源20可能包括相应的时钟控制图样存储器、查找表、计数器等。时钟控制数据经由时钟控制数据线路22被分发到所述时钟源14。所述时钟控制数据代表被从所述存储器8读出并且经由输出线路2被提供给DUT的所述数字数据信号中的抖动。时钟控制数据提供对时钟线路18上的时钟的完全相位和/或频率控制。因此，从存储器8读出数据图样所根据的时钟是根据数据源10的时钟控制数据进行了相位或频率调制的。
时钟控制数据可以是完全编程的，所以可以容易地使抖动产生适用于特定的应用或者对DUT的特定测试。要产生的抖动量仅由存储器8的存储容量限制。仅根据时钟控制数据就可以产生任何抖动分辨率。
图2示出了本发明第二实施例的框图。在第二实施例中，定义用于DUT的激励的数据图样由DUT自身提供，这代表所谓的回送测试(loop-back test)。从DUT提供的信号可以包括依赖于DUT或者依赖于线路的抖动，并且因此通过DUT图样线路128经由驱动器单元124被输入到包括锁相环的时钟数据恢复单元126。时钟数据恢复单元126在数据图样线路106上恢复数据图样，并且在第一时钟线路112上恢复第一时钟，根据第一时钟，数据图样被输入到存储器108中。
从所述存储器108将所述数字数据信号经由驱动器单元116读出到输出线路112上与对第一实施例的描述相同，即，使用时钟源114的根据时钟控制数据源120的时钟控制数据调制的时钟信号。
图3示出了本发明第三实施例的框图。与第二实施例的类似，在第三实施例中，数据图样由DUT经由DUT图样线路228提供。与第二实施例不同的是，在第三实施例中，数据图样被输入到数据恢复单元230中，数据恢复单元230不包括锁相环，并且经由第一时钟线路212从外部接收第一时钟。因此，数据恢复单元230仅需恢复从DUT接收到的信号中的数据图样，并且经由数据图样线路206将所述数据图样输入到存储器208。
第三实施例的其余部分与第一和第二实施例的对应部分相同，即，利用由时钟源214提供的时钟信号，数字数据从存储器208经由驱动器单元216被读出到输出线路202，所述时钟信号是根据时钟控制数据源220的时钟控制数据被调制的。
在第二和第三实施例中，输出线路102、202上的数字数据信号中产生的抖动独立于从DUT接收到的信号包括的抖动，因为在第二实施例中时间被时钟数据恢复单元126恢复，或者在第三实施例中由在第一时钟线路212上提供的外部时钟信号恢复，其中所述外部时钟信号可由ATE提供。因此，所产生的抖动独立于在DUT输出处的抖动量。
图4示出了实现时钟源14、114、214的第一可能方式的框图，所述时钟源包括小数N分频(fractional-N)锁相环(PLL)，或者delta-sigma调制(DSM)小数N分频PLL。代表参考频率72的输入频率fin利用除法器52被除以M，得到fM＝fin/M，其被输入到相位检测器54。相位检测器54的输出信号被输入到低通滤波器56，低通滤波器56的输出信号控制压控振荡器(VCO)58，VCO 58具有输出频率fout。
VCO的输出信号经由除法器60被反馈回相位检测器54，除法器60具有可调节的除数Navg，Navg被定义为Navg＝值N的序列N(k)的平均。因此，除法器60具有频率fN＝fout/Navg的输出信号，该信号被输入到相位检测器54中。因此，商fout/fin可调节为Navg/M，其中该商可以被非常精细地调节，并且可以根据序列N(k)的值被调节为N的分数。此外，输出频率fout的相位可以根据序列N(k)的值而被调节，从而VCO在时钟线路18上的输出信号可以是根据序列N(k)相位调制的。由于对fout的调制代表用于读出存储器8的时钟信号，所以存储器8在输出线路2上的输出位流包括根据对输出频率fout的调制并且从而根据序列N(k)的抖动，所述时钟序列N(k)代表时钟控制数据并且从时钟控制数据源20经由时钟控制数据线路22被提供。
图5示出了提供用于除法器60的值N的序列N(k)的两个可能实施例。序列N1(k)可由数据序列发生器62直接提供，数据序列发生器62接收来自图样存储器64的数据并且由控制线路66控制。可替换地，序列N2(k)可由专用硬件提供，例如，delta-sigma调制器(DSM)68，其可以实现在硬件或软件中。
图6示出了实现包括直接数字合成(DDS)单元70的时钟源14、114、214的第二种可能实现方式。参考频率72或者参考时钟被提供给相位累积器74、查找表76和数模转换器(DAC)78。DDS单元70由时钟控制数据源20经由时钟控制数据线路22馈送。时钟控制数据的相位被累积，并且被输入到查找表76，在查找表76中存储有理想正弦波形的数字采样值。DAC 78将数字采样值转换成对应的模拟信号，该模拟信号随后被低通滤波器80滤波，低通滤波器80也可以位于DDS单元70的外部。低通滤波器80的输出最终由位于DDS单元72外的比较器82整形，然后所产生的信号被输出到时钟线路18上作为根据时钟控制数据调制的时钟。可以有无限的相位变化，并且调制速度仅由DAC 78和低通滤波器80限制。
图7示出了实现包括环形振荡器90的时钟源14、114、214的第三可能实现方式。乘法器92由时钟控制数据源20经由时钟控制数据线路22控制。时钟线路18上的调制时钟的相位取决于乘法器92选择来用于根据时钟控制数据切换到时钟线路18的抽头94和96。调制速度非常高。在相邻抽头94和96之间进行内插以获得精细分辨率是可能的。在乘法器92通过循环旋转多次时可以实现多个周期的相位偏移。
权利要求
1.一种用于产生数字数据信号中的抖动的方法，所述数字数据信号具有存储在存储器(4；104；204)中的预定数据图样，所述方法包括以下步骤利用由时钟源(14；114；214)提供的时钟信号从所述存储器(4；104；204)读出所述数字数据信号，根据时钟控制数据对由所述时钟源(14；114；214)提供的所述时钟信号进行调制，其中，所述时钟控制数据代表要在从所述存储器(4；104；204)读出的所述数字数据信号中产生的所述抖动。
2.如权利要求1所述的方法，其特征在于所述对所述时钟信号进行调制的步骤包括相位调制。
3.如权利要求1或2所述的方法，其特征在于所述时钟控制数据是可编程的。
4.如权利要求1或上述权利要求中任一个所述的方法，其特征在于具有所述预定数据图样的所述数字数据信号根据第一时钟被输入到所述存储器中(4；104；204)，所述第一时钟与用于从所述存储器(4；104；204)读出所述数字数据信号的所述时钟信号不同。
5.如权利要求4所述的方法，其特征在于所述第一时钟是从也包括所述数字数据信号的所述预定数据图样的位流恢复的。
6.如权利要求1或上述权利要求中的任一个所述的方法，其特征在于所述存储器(4；104；204)具有先进先出(FIFO)体系结构。
7.如权利要求1或上述权利要求中的任一个所述的方法，其特征在于所述对所述时钟信号进行调制的步骤包括参考时钟(72)的N/M锁相环调制，并且/或者包括参考时钟(72)的小数N分频锁相环调制，其中，N和M是整数。
8.如权利要求1或上述权利要求中的任一个所述的方法，其特征在于所述对所述时钟信号进行调制的步骤包括直接数字合成(DSS)调制。
9.如权利要求1或上述权利要求中的任一个所述的方法，其特征在于所述对所述时钟信号进行调制的步骤包括环形振荡器调制。
10.如权利要求1或上述权利要求中的任一个所述的方法，其特征在于所述数字数据信号是用于被测器件(DUT)的激励信号，并且所述被测器件(DUT)对所述激励信号的响应信号被返回到自动测试设备(ATE)以供评估。
11.如权利要求10所述的方法，其特征在于所述数据图样由所述自动测试设备(ATE)提供。
12.如权利要求10所述的方法，其特征在于所述数据图样由所述被测器件(DUT)提供。
13.一种软件或产品，优选存储在数据载体中，用于当在诸如计算机之类的数据处理系统上运行时执行如权利要求1或者上述权利要求中的任一个所述的方法。
14.一种用于产生数字数据信号中的抖动的系统，所述数字数据信号具有存储在存储器(4；104；204)中的预定数据图样，所述系统包括时钟源(14；114；214)，其提供用于从所述存储器(4；104；204)读出所述数字数据信号的时钟信号，用于根据时钟控制数据对由所述时钟源(14；114；214)提供的所述时钟信号进行调制的装置，其中，所述时钟控制数据代表要在从所述存储器(4；104；204)读出的所述数字数据信号中产生的所述抖动。
全文摘要
本发明涉及用于产生数字数据信号中的抖动的方法，所述数字数据信号具有存储在存储器(4；104；204)中的预定数据图样，所述方法包括以下步骤利用由时钟源(14；114；214)提供的时钟信号从所述存储器(4；104；204)读出所述数字数据信号，根据时钟控制数据对由所述时钟源(14；114；214)提供的所述时钟信号进行调制，其中所述时钟控制数据代表要在从所述存储器(4、104、204)读出的所述数字数据信号中产生的所述抖动。
文档编号G06F1/08GK1977178SQ200480043444
公开日2007年6月6日 申请日期2004年8月6日 优先权日2004年6月24日
发明者约亨·里瓦尔 申请人:安捷伦科技有限公司