专利名称：一种高级数据链路控制通道带宽动态调整中的方法及装置的制作方法
技术领域：
本发明涉及通信领域，特别是指一种高级数据链路控制通道带宽动态调整中的方法及装置。
背景技术：
高级数据链路控制(High level Data Link Control，HDLC)协议应用于开放系统互联(Open Systems Interconnection，OSI)七层网络参考模型的数据链路层，其数据帧结构和处理过程均由国际标准规定。
承载于E1/T1线路上时，每个HDLC通道可以承载在E1/T1线路上固定的一个或多个连续的时隙或子时隙中。实际应用中，经常会在一个E1/T1线路中配置多个HDLC通道，不同的HDLC通道分别占用不同的时隙或子时隙，各HDLC通道之间互不干扰，不同的HDLC通道上可以承载相同或不同应用类型的数据流。
图1为现有HDLC帧结构示意图，如图1所示，HDLC数据帧以16进制数0x7E作为帧标识，作为HDLC数据帧的起始标志和结束标志，在HDLC数据帧结束之前还包括帧校验字段。HDLC数据帧之间使用0x7E或0xFF填充，两个连续的HDLC数据帧可以共享一个0x7E作为前一个HDLC数据帧的结束标志和后一个HDLC数据帧的起始标志，另外，如果发现一个HDLC数据帧出现错误，可以通过HDLC数据帧中止标识0xFF表明该HDLC数据帧有错误。如果HDLC处理单元在接收的HDLC数据帧中发现连续7个以上的1就确定该HDLC数据帧中存在帧中止标识，表明该HDLC数据帧有错误。为了避免将HDLC数据帧中有效的0x7E被误认为是帧中止标识，因此，发送HDLC数据帧的HDLC处理单元需要使用0插入功能，即如果在HDLC数据帧中除帧标识外的字段中发现连续5个1，就在这5个连续1后面插入一个0；相应地，接收HDLC数据帧的HDLC处理单元需要使用0删除功能，即如果在HDLC数据帧中除帧标识外的字段中发现连续5个1，并且这5个连续1后面紧跟一个0，就将这个0去除。
图2为现有HDLC协议处理装置结构示意图，如图2所示，HDLC协议处理装置包括物理层接口单元、共享内存、业务处理单元、HDLC配置管理单元和HDLC处理单元。其中，物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。共享内存用于缓存待发送或接收的数据帧。业务处理单元用于将待发送的数据帧缓存于共享内存，并获取共享内存中缓存的接收的数据帧；进一步地，业务处理单元可以用于向电信网元中的其他单元提供接收的数据帧，以由其他单元进行数据处理。HDLC配置管理单元用于配置HDLC通道、及HDLC通道与物理层时隙或子时隙之间的映射关系，并向HDLC处理单元提供相应通道配置信息和时隙通道映射配置信息。通道配置信息是指当前配置的HDLC通道的相关信息，如当前配置的HDLC通道的数量等。
HDLC处理单元，发送方向上用于从共享内存中读取待发送的数据帧，对相应数据帧进行HDLC协议处理，例如，生成HDLC数据帧的起始标志、结束标志、帧中止标识等帧标识、完成数据帧之间的填充、产生帧校验、完成0插入、进行字节内高低比特位交换和端口数据取反等处理，生成HDLC通道上的待发送的HDLC数据帧，根据时隙通道映射配置信息将HDLC通道上的HDLC数据帧中的比特流映射至相应时隙或子时隙，并通过物理层接口单元发送至相应时隙或子时隙的E1/T1端口；接收方向上用于根据配置信息将来自物理层接口单元的时隙或子时隙上的比特流映射至相应HDLC通道，对比特流进行HDLC协议处理，例如，检测HDLC数据帧的起始标志、结束标志、帧中止标识等帧标识、检测HDLC数据帧之间的填充、进行帧校验、完成0删除、进行字节内高低比特位交换和端口数据取反等处理，确定接收的比特流已经能够组成一个完整的HDLC数据帧时，将经过HDLC协议处理的数据帧缓存于共享内存。
多种情况下，可能需要对一个HDLC通道所对应的时隙或子时隙进行调整，例如，为某个HDLC通道配置的时隙或子时隙数量不足，造成该HDLC通道无法满足带宽的应用要求，而同一E1/T1线路上的另一个HDLC通道过于空闲，造成了带宽资源的浪费，此时，就可以对这两条HDLC通道所对应的时隙或子时隙进行调整，使这两条HDLC通道在能够满足各自带宽应用要求的前提下，又避免了对带宽资源的浪费。
目前，对HDLC通道进行带宽调整时，通常针对HDLC通信的两端设备分别进行带宽的手动配置修改，配置修改操作可以是先删除原有的HDLC通道，然后重新配置HDLC通道；也可以是直接对HDLC通道与时隙或子时隙之间的映射关系进行修改。由于无法保证针对HDLC通信的两端设备分别进行的配置修改操作同时进行，从HDLC通信的一端设备开始修改到两端设备均完成带宽调整的时间跨度无法得到有效保障，因此，在对HDLC通道进行带宽调整的过程中，数据流的传送通常会出现错误或被打断，从而影响业务的正常处理。
为了避免手动配置修改带来的问题，HDLC通信的两端设备约定在E1/T1线路上划分出一个或连续多个的时隙或子时隙作为专用控制链路。对HDLC通道进行带宽调整时，由HDLC通信的一端设备发起，发起端通过设置的专用控制链路向对端发送控制命令，该控制命令具有双方预先约定的格式，通过该控制命令包含的内容描述需要对HDLC通道进行修改的信息，如修改时间、修改后HDLC通道与时隙或子时隙之间的映射关系等信息，接收端根据接收的控制命令的内容进行相应修改，这样，在很大程度上降低了HDLC通道的带宽调整对数据流传送的影响。但是，由于该HDLC通道的带宽调整方案中，专用控制链路总是需要占用一定数量的时隙或子时隙，特别是在HDLC通道的带宽调整不频繁的情况下，设置的专用控制链路本身的利用率非常低，造成时隙或子时隙资源的浪费。下面举例对该方案的缺点进行更为直观的描述。
图3为现有实现HDLC通道带宽动态调整的原理示意图，如图3所示，3个通信设备通过1个E1线路连接至传输时隙交换设备，该传输时隙交换设备将E1-1线路的部分时隙映射至E1-2线路的时隙上，同时将E1-1线路的部分时隙映射至E1-3线路的时隙上。这样，通信设备1与通信设备2之间可以配置若干HDLC通道，以下简称为HDLC通道组A，通信设备1与通信设备3之间也可以配置若干HDLC通道，以下简称为HDLC通道组B。为了支持HDLC通道组A及HDLC通道组B中各HDLC通道的带宽调整，E1-2线路和E1-3线路上需要分别设置一个专用控制链路，E1-1线路上必须设置两个专用控制链路，才能分别完成对HDLC通道组A及HDLC通道组B中各HDLC通道的带宽调整。如果存在更多的通信设备通过传输时隙交换设备相互连接，则E1线路上需要设置更多的专用控制链路，对时隙或子时隙资源的浪费将更加严重。
发明内容
有鉴于此，本发明实施例提供一种高级数据链路控制通道带宽动态调整中的方法及装置，避免对时隙或子时隙资源的浪费，并且不影响业务的正常处理。
本发明实施例提供的高级数据链路控制通道带宽动态调整中的装置，通信两端分别包括HDLC配置管理单元、HDLC处理单元、共享内存和物理层接口单元，其中，发起端侧的所述HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，将待发送的通道调整通知写入共享内存，根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；响应端侧的所述HDLC配置管理单元用于根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，将待发送的通道调整响应写入共享内存；发起端侧的所述HDLC处理单元用于根据接收方向的时隙通道映射配置信息接收HDLC帧，发送共享内存中的通道调整通知，将接收到的通道调整响应写入共享内存，根据发送方向的时隙通道映射配置信息发送HDLC帧；响应端侧的所述HDLC处理单元用于将接收到的通道调整通知写入共享内存，根据收发双向的时隙通道映射配置信息接收和发送HDLC帧，发送共享内存中的通道调整响应；所述共享内存用于缓存待发送和/或接收的数据流；所述物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
本发明实施例提供的高级数据链路控制通道带宽动态调整中的装置包括HDLC配置管理单元、HDLC处理单元、共享内存和物理层接口单元，其中，发起端侧的所述HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，将待发送的通道调整通知写入共享内存，根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；发起端侧的所述HDLC处理单元用于根据接收方向的时隙通道映射配置信息接收HDLC帧，发送共享内存中的通道调整通知，将接收到的通道调整响应写入共享内存，根据发送方向的时隙通道映射配置信息发送HDLC帧；所述共享内存用于缓存待发送和/或接收的数据流；所述物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
本发明实施例提供的高级数据链路控制通道带宽动态调整中的装置包括HDLC配置管理单元、HDLC处理单元、共享内存和物理层接口单元，其中，响应端侧的所述HDLC配置管理单元用于根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，将待发送的通道调整响应写入共享内存；响应端侧的所述HDLC处理单元用于将接收到的通道调整通知写入共享内存，根据收发双向的时隙通道映射配置信息接收和发送HDLC帧，发送共享内存中的通道调整响应；所述共享内存用于缓存待发送和/或接收的数据流；所述物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
本发明实施例提供的高级数据链路控制通道带宽动态调整中的方法包括发起端侧的HDLC处理单元根据接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据收发方向的时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据发送方向的时隙通道映射配置信息发送HDLC帧。
本发明实施例提供的高级数据链路控制通道带宽动态调整中的方法包括发起端侧的HDLC处理单元根据接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据发送方向的时隙通道映射配置信息发送HDLC帧。
本发明实施例提供的高级数据链路控制通道带宽动态调整中的方法包括响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据收发方向的时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应。
本发明实施例提供的方案中，发起端侧的HDLC处理单元根据修改后的接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据修改后的收发方向的时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据修改后的发送方向的时隙通道映射配置信息发送HDLC帧，使得需要对HDLC通道带宽进行调整时，由一端发起，通过控制帧的交互完成两端对HDLC通道带宽调整的协商，无需设置占用时隙或子时隙资源的专用控制链路，这部分时隙或子时隙资源能够应用在数据流的传输上，提高了时隙或子时隙资源的利用率；并且由于HDLC通道带宽调整的处理过程是通过两端的协商完成的，不会发生数据流的传送出现错误或被打断的情况，保证了业务的正常处理不受影响。
图1为现有HDLC帧结构示意图；图2为现有HDLC协议处理装置结构示意图；图3为现有实现HDLC通道带宽动态调整的原理示意图；图4为本发明实施例一中实现HDLC通道带宽动态调整的装置的结构示意图；图5为本发明实施例二中实现HDLC通道带宽动态调整的装置的结构示意图；图6为本发明实施例三中实现HDLC通道带宽动态调整流程图；图7为本发明实施例四中实现HDLC通道带宽动态调整的装置的结构示意图；图8为本发明实施例五中实现HDLC通道带宽动态调整的装置的结构示意图；图9为本发明实施例六中实现HDLC通道带宽动态调整的装置的结构示意图；图10为本发明实施例七中实现HDLC通道带宽动态调整流程图。
具体实施例方式
本发明提供的实施例中，在HDLC通道带宽动态调整过程中，对等的通信两端均包括HDLC配置管理单元和HDLC处理单元，任何一端均可作为HDLC通道带宽调整的发起端或HDLC通道带宽调整的响应端，这样，发起端侧至少包括HDLC配置管理单元和HDLC处理单元，相应地，响应端侧也至少包括HDLC配置管理单元和HDLC处理单元。发起端侧的HDLC处理单元根据修改后的接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据修改后的收发方向的时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据修改后的发送方向的时隙通道映射配置信息发送HDLC帧。
实现HDLC通道带宽动态调整的装置包括HDLC配置管理单元、HDLC处理单元、共享内存和物理层接口单元。其中，发起端侧的HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，向共享内存发送通道调整通知，根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；响应端侧的HDLC配置管理单元用于根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，向共享内存发送通道调整响应。发起端侧的HDLC处理单元用于根据修改后的接收方向的时隙通道映射配置信息接收HDLC帧，发送共享内存中的通道调整通知，接收通道调整响应，根据修改后的发送方向的时隙通道映射配置信息发送HDLC帧；响应端侧的HDLC处理单元用于向共享内存发送接收的通道调整通知，根据修改后的收发双向的时隙通道映射配置信息接收和发送HDLC帧，发送共享内存中的通道调整响应。物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
图4为本发明实施例一中实现HDLC通道带宽动态调整的装置的结构示意图，如图4所示，本实施例中实现HDLC通道带宽动态调整的装置包括HDLC配置管理单元、共享内存和HDLC处理单元。其中，发起端侧的HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，将通道调整发起控制帧直接写入共享内存，根据从共享内存中读取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；响应端侧的HDLC配置管理单元用于根据从共享内存中读取的通道调整发起控制帧，对本端收发双向的时隙通道映射配置信息进行修改，将通道调整响应直接写入共享内存。HDLC配置管理单元还用于配置HDLC通道、及HDLC通道与物理层时隙或子时隙之间的映射关系，并向HDLC处理单元提供相应通道配置信息和时隙通道映射配置信息。发起端侧的HDLC处理单元用于根据修改后的接收方向的时隙通道映射配置信息接收HDLC帧，发送共享内存中的通道调整发起控制帧，接收通道调整响应，根据修改后的发送方向的时隙通道映射配置信息发送HDLC帧；响应端侧的HDLC处理单元用于将接收的通道调整发起控制帧写入共享内存，根据修改后的收发双向的时隙通道映射配置信息接收和发送HDLC帧，发送共享内存中的通道调整响应。
发起端侧的HDLC配置管理单元进一步用于将通道调整完成控制帧直接写入共享内存；响应端侧的HDLC配置管理单元进一步用于从共享内存中读取通道调整完成控制帧。发起端侧的HDLC处理单元进一步用于发送共享内存中的通道调整完成控制帧；响应端侧的HDLC处理单元进一步用于将接收的通道调整完成控制帧直接写入共享内存。
该装置还包括物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。该装置可进一步包括业务处理单元，用于将待发送的数据帧写入共享内存，并读取共享内存中缓存的接收的数据帧；进一步地，业务处理单元可以用于向电信网元中的其他单元提供接收的数据帧，以由其他单元进行数据处理。
图5为本发明实施例二中实现HDLC通道带宽动态调整的装置的结构示意图，如图5所示，本实施例中将共享内存划分为数据帧发送区、数据帧接收区、控制帧发送区和控制帧接收区，数据帧发送区用于存储待发送的数据帧，数据帧接收区用于缓存接收的数据帧，控制帧发送区用于存储待发送的控制帧，控制帧接收区用于存储接收的控制帧。发起端侧的HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，将通道调整发起控制帧直接写入共享内存的控制帧发送区，直接从共享内存的控制帧接收区读取通道调整响应，根据该通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；响应端侧的HDLC配置管理单元用于直接从共享内存的控制帧接收区读取通道调整发起控制帧，根据该通道调整发起控制帧对本端收发双向的时隙通道映射配置信息进行修改，将通道调整响应直接写入共享内存的控制帧接收区。通道调整发起控制帧和通道调整响应均为控制帧。HDLC处理单元用于将接收的控制帧写入共享内存的控制帧接收区。
HDLC处理单元包括存储器、先入先出(First In First Out，FIFO)缓存器、FIFO缓存控制单元、HDLC协议处理单元和时隙通道映射处理单元。
存储器用于存储发送方向时隙通道映射配置表、接收方向时隙通道映射配置表和HDLC通道配置表。存储器中存储的发送方向时隙通道映射配置表、接收方向时隙通道映射配置表和HDLC通道配置表由HDLC配置管理单元进行配置。发送方向时隙通道映射配置表和接收方向时隙通道映射配置表组成所述时隙通道映射配置信息。
将FIFO缓存器划分为发送区和接收区两个区域，发送区用于缓存待发送的帧(数据帧和/或控制帧)，接收区用于缓存接收的帧(数据帧和/或控制帧)。FIFO缓存控制单元用于在发送方向上根据存储器中存储的HDLC通道配置表控制FIFO缓存器的发送区接收来自共享内存的待发送的帧(来自共享内存数据帧发送区的数据帧和/或来自共享内存控制帧发送区的控制帧)，即将共享内存中的待发送的帧写入FIFO缓存器的发送区，所述帧为控制帧、或数据帧、或控制帧和数据帧，确定FIFO缓存器的发送区中缓存的数据流已经能够形成完整的帧(数据帧和/或控制帧)时，向HDLC协议处理单元提供组成完整帧的数据流；在接收方向上确定FIFO缓存器的接收区中缓存的数据流已经能够形成完整的控制帧时，根据存储器中存储的HDLC通道配置表控制FIFO缓存器的接收区向共享内存的控制帧接收区输出控制帧，即将FIFO缓存器的接收区中的控制帧写入共享内存的控制帧接收区，确定FIFO缓存器的接收区中缓存的数据流已经能够形成完整的数据帧时，根据存储器中存储的HDLC通道配置表控制FIFO缓存器的接收区向共享内存的数据帧接收区输出数据帧，即将将FIFO缓存器的接收区中的数据帧写入共享内存的数据帧接收区。FIFO缓存控制单元可通过帧中包含的控制字区分出控制帧和数据帧。由于不同应用类型的数据流在不同的HDLC通道上传输，因此，需要针对各HDLC通道上传输的数据流进行分别处理，所以，FIFO缓存控制单元控制FIFO缓存器输入、输出时，需要根据HDLC通道配置表来进行。
共享内存将待发送的帧(数据帧或控制帧)输出至FIFO缓存器时，具体处理可包括共享内存的数据帧发送区将待发送的数据帧输出至FIFO缓存器的发送区，共享内存的控制帧发送区将待发送的控制帧输出至FIFO缓存器的发送区。
HDLC协议处理单元用于对待发送的帧进行发送方向上的HDLC协议处理，例如，生成HDLC帧的起始标志、结束标志、帧中止标识等帧标识、完成帧之间的填充、产生帧校验、完成0插入、进行字节内高低比特位交换和端口数据取反等处理，根据存储器中存储的HDLC通道配置表生成HDLC通道上的待发送的HDLC帧，向时隙通道映射处理单元发送HDLC帧，以及对接收的来自时隙通道映射处理单元的比特流进行接收方向上的HDLC协议处理，例如，检测HDLC数据帧的起始标志、结束标志、帧中止标识等帧标识、检测HDLC数据帧之间的填充、进行帧校验、完成0删除、进行字节内高低比特位交换和端口数据取反等处理。
发起端侧的HDLC配置管理单元进一步用于将通道调整完成控制帧直接写入共享内存的控制帧发送区；响应端侧的HDLC配置管理单元进一步用于直接从共享内存的控制帧接收区读取通道调整完成控制帧。
时隙通道映射处理单元用于根据存储器中存储的发送方向时隙通道映射配置表将HDLC通道上的HDLC帧中的比特流映射至相应时隙或子时隙，并通过物理层接口单元发送至相应时隙或子时隙的E1/T1端口，根据存储器中存储的接收方向时隙通道映射配置表将来自物理层接口单元的时隙或子时隙上的比特流映射至相应HDLC通道，向HDLC协议处理单元发送各HDLC通道的比特流。物理层接口单元用于在E1/T1端口与时隙通道映射处理单元之间进行比特流的转发。
图6为本发明实施例三中实现HDLC通道带宽动态调整流程图，如图6所示，本实施例中，实现HDLC通道带宽动态调整的处理过程包括以下步骤步骤601发起端侧的HDLC配置管理单元确定需要进行HDLC通道带宽调整时，对本端的接收方向时隙通道映射配置表进行修改，并将通道调整发起控制帧直接写入共享内存的控制帧发送区。
步骤602发起端侧的HDLC处理单元根据修改后的接收方向时隙通道映射配置表接收HDLC帧，并根据原发送方向时隙通道映射配置表发送HDLC帧，从共享内存的控制帧发送区读取通道调整发起控制帧，对该通道调整发起控制帧进行HDLC协议处理，然后向响应端侧的HDLC处理单元发送经过HDLC协议处理的通道调整发起控制帧。
步骤603响应端侧的HDLC处理单元对接收的通道调整发起控制帧进行HDLC协议处理，确定接收的数据流已经能够形成完整的控制帧、即通道调整发起控制帧时，将通道调整发起控制帧直接写入共享内存的控制帧接收区。
另外，发起端侧的HDLC处理单元、响应端侧的HDLC处理单元从共享内存的数据帧发送区读取待发送的数据帧，对待发送的数据帧进行HDLC协议处理后发送出去；并且对接收的数据帧进行HDLC协议处理，确定接收的数据流已经能够形成完整的数据帧时，将数据帧写入共享内存的数据帧接收区。
步骤604响应端侧的HDLC配置管理单元直接从共享内存的控制帧接收区读取通道调整发起控制帧，根据该通道调整发起控制帧对本端收发双向的时隙通道映射配置表进行修改，然后将通道调整响应直接写入共享内存的控制帧发送区。
步骤605响应端侧的HDLC处理单元根据修改后的收发双向的时隙通道映射配置表接收和发送HDLC帧，从共享内存的控制帧发送区读取通道调整响应，对该通道调整响应进行HDLC协议处理，然后向发起端侧的HDLC处理单元发送经过HDLC协议处理的通道调整响应。
步骤606发起端侧的HDLC处理单元对接收的通道调整响应进行HDLC协议处理，确定接收的数据流已经能够形成完整的控制帧、即通道调整响应时，将通道调整响应直接写入共享内存的控制帧接收区。
步骤607发起端侧的HDLC配置管理单元直接从共享内存的控制帧接收区读取通道调整响应，根据该通道调整响应对本端接收方向时隙通道映射配置表进行修改，然后将通道调整完成控制帧直接写入共享内存的控制帧发送区。
步骤608发起端侧的HDLC处理单元根据修改后的收发双向的时隙通道映射配置表接收和发送HDLC帧，从共享内存的控制帧发送区读取通道调整完成控制帧，对该通道调整完成控制帧进行HDLC协议处理，然后响应端侧的向HDLC处理单元发送经过HDLC协议处理的通道调整完成控制帧。
步骤609响应端侧的HDLC处理单元对接收的通道调整完成控制帧进行HDLC协议处理，确定接收的数据流已经能够形成完整的控制帧、即通道调整完成控制帧时，将通道调整完成控制帧直接写入共享内存的控制帧接收区。
步骤610响应端侧的HDLC配置管理单元直接从共享内存的控制帧接收区读取通道调整完成控制帧，至此，发起端和响应端协同完成了HDLC通道带宽的动态调整。
图5所示的实施例中是将控制帧和数据帧缓存于共享内存的不同区域，由HDLC处理单元将识别出的控制帧或数据帧写入共享内存的相应区域。HDLC配置管理单元将控制帧直接写入共享内存的控制帧发送区，或从共享内存的控制帧接收区读取控制帧。另外，也可以将共享内存划分为数据发送区和数据接收区，不再针对数据帧和控制帧区分不同的存储区域，只是将待发送的数据帧和控制帧统一缓存于数据发送区，将接收的数据帧和控制帧统一缓存于数据接收区，如图7所示，由HDLC配置管理单元对数据帧和控制帧进行区分，对在共享内存的数据接收区中检测到的控制帧进行读取，并根据相应控制帧进行后续操作。HDLC配置管理单元将待发送的控制帧直接写入共享内存的数据发送区。
基于图7所示装置的HDLC通道带宽动态调整的处理流程与图6的描述基本相同，只是共享内存不再划分数据帧发送区、数据帧接收区、控制帧发送区和控制帧接收区四个存储区域，而只是划分为数据发送区和数据接收区两个存储区域，HDLC配置管理单元将相应控制帧直接写入共享内存的控制帧发送区，从共享内存的控制帧接收区读取相应控制帧。
图8为本发明实施例五中实现HDLC通道带宽动态调整的装置的结构示意图，如图8所示，本实施例中实现HDLC通道带宽动态调整的装置包括HDLC配置管理单元、业务处理单元、共享内存和HDLC处理单元。其中，发起端侧的HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，向业务处理单元发送通道调整发起控制帧，根据接收的来自业务处理单元的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；响应端侧的HDLC配置管理单元用于根据接收的来自业务处理单元的通道调整发起控制帧对本端收发双向的时隙通道映射配置信息进行修改，向业务处理单元发送通道调整响应。HDLC配置管理单元还用于配置HDLC通道、及HDLC通道与物理层时隙或子时隙之间的映射关系，并向HDLC处理单元提供相应通道配置信息和时隙通道映射配置信息。业务处理单元用于将接收的来自于HDLC配置管理单元的控制帧写入共享内存，向HDLC配置管理单元发送接收的来自于共享内存的控制帧。控制帧包括通道调整发起控制帧和通道调整响应。本实施例中，业务处理单元对数据帧和控制帧进行区分，可以通过帧中包含的控制字区分出控制帧和数据帧，业务处理单元将识别出的控制帧发送给HDLC配置管理单元。业务处理单元还用于将待发送的数据帧写入共享内存，并读取共享内存中缓存的接收的数据帧；进一步地，业务处理单元可以用于向电信网元中的其他单元提供接收的数据帧，以由其他单元进行数据处理。发起端侧的HDLC处理单元用于根据修改后的接收方向的时隙通道映射配置信息接收HDLC数据帧，发送共享内存中的通道调整发起控制帧，接收通道调整响应，根据修改后的发送方向的时隙通道映射配置信息发送HDLC数据帧；响应端侧的HDLC处理单元用于将接收的通道调整发起控制帧写入共享内存，根据修改后的收发双向的时隙通道映射配置信息接收和发送HDLC数据帧，发送共享内存中的通道调整响应。
发起端侧的HDLC配置管理单元进一步用于向业务处理单元发送通道调整完成控制帧；响应端侧的HDLC配置管理单元进一步用于接收来自于业务处理单元的通道调整完成控制帧。发起端侧的HDLC处理单元进一步用于发送共享内存中的通道调整完成控制帧；响应端侧的HDLC处理单元进一步用于将接收的通道调整完成控制帧写入共享内存。
该装置还包括物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
图9为本发明实施例六中实现HDLC通道带宽动态调整的装置的结构示意图，如图9所示，本实施例中将共享内存划分为数据发送区和数据接收区，不再针对数据帧和控制帧区分不同的存储区域，只是将待发送的数据帧和控制帧统一缓存于数据发送区，将接收的数据帧和控制帧统一缓存于数据接收区。发起端侧的HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，向业务处理单元发送通道调整发起控制帧，根据接收的来自业务处理单元的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；响应端侧的HDLC配置管理单元用于根据接收的来自业务处理单元的通道调整发起控制帧对本端收发双向的时隙通道映射配置信息进行修改，向业务处理单元发送通道调整响应。业务处理单元用于将接收的来自于HDLC配置管理单元的控制帧写入共享内存的数据发送区，读取共享内存的数据接收区的控制帧并向HDLC配置管理单元发送。
HDLC处理单元包括存储器、FIFO缓存控制单元、FIFO缓存器、HDLC协议处理单元和时隙通道映射处理单元。
将FIFO缓存器划分为发送区和接收区两个区域，发送区用于缓存待发送的帧，接收区用于缓存接收的帧。FIFO缓存控制单元用于在发送方向上根据存储器中存储的HDLC通道配置表控制FIFO缓存器的发送区接收来自共享内存数据发送区的待发送的帧，确定FIFO缓存器的发送区中缓存的数据流已经能够形成完整的帧时，向HDLC协议处理单元提供组成完整帧的数据流；在接收方向上确定FIFO缓存器的接收区中缓存的数据流已经能够形成完整的帧时，根据存储器中存储的HDLC通道配置表控制FIFO缓存器的接收区向共享内存的数据接收区输出帧。所述的帧可以包括数据帧、或控制帧、或数据帧和控制帧。此时，FIFO缓存控制单元不再对数据帧和控制帧进行区分，而是由业务处理单元对数据帧和控制帧进行区分，业务处理单元将识别出的控制帧发送给HDLC配置管理单元。由于不同应用类型的数据流在不同的HDLC通道上传输，因此，需要针对各HDLC通道上传输的数据流进行分别处理，所以，FIFO缓存控制单元控制FIFO缓存器输入、输出时，需要根据HDLC通道配置表来进行。
存储器、HDLC协议处理单元和时隙通道映射处理单元的作用与图5中描述的基本相同，在此不再赘述。
图10为本发明实施例七中实现HDLC通道带宽动态调整流程图，如图10所示，本实施例中，实现HDLC通道带宽动态调整的处理过程包括以下步骤步骤A01发起端侧的HDLC配置管理单元确定需要进行HDLC通道带宽调整时，对本端的接收方向时隙通道映射配置表进行修改，并向业务处理单元发送通道调整发起控制帧，业务处理单元将接收的通道调整发起控制帧写入共享内存的数据发送区。
步骤A02发起端侧的HDLC处理单元根据修改后的接收方向时隙通道映射配置表接收HDLC帧，并根据原发送方向时隙通道映射配置表发送HDLC帧，从共享内存的数据发送区读取通道调整发起控制帧，对该通道调整发起控制帧进行HDLC协议处理，然后向响应端侧的HDLC处理单元发送经过HDLC协议处理的通道调整发起控制帧。
步骤A03响应端侧的HDLC处理单元对接收的通道调整发起控制帧进行HDLC协议处理，确定接收的数据流已经能够形成完整的帧、即通道调整发起控制帧时，将通道调整发起控制帧写入共享内存的数据接收区。
另外，发起端侧的HDLC处理单元、响应端侧的HDLC处理单元从共享内存的数据发送区读取待发送的数据帧，对待发送的数据帧进行HDLC协议处理后发送出去；并且对接收的数据帧进行HDLC协议处理，确定接收的数据流已经能够形成完整的数据帧时，将数据帧写入共享内存的数据接收区。
步骤A04业务处理单元从共享内存的数据接收区读取通道调整发起控制帧，确定读取到的帧为控制帧，向响应端侧的HDLC配置管理单元发送通道调整发起控制帧，响应端侧的HDLC配置管理单元根据接收的通道调整发起控制帧对本端收发双向的时隙通道映射配置表进行修改，然后向业务处理单元发送通道调整响应，业务处理单元将接收的通道调整响应写入共享内存的数据发送区。
步骤A05响应端侧的HDLC处理单元根据修改后的收发双向的时隙通道映射配置表接收和发送HDLC帧，从共享内存的数据发送区读取通道调整响应，对该通道调整响应进行HDLC协议处理，然后向发起端侧的HDLC处理单元发送经过HDLC协议处理的通道调整响应。
步骤A06发起端侧的HDLC处理单元对接收的通道调整响应进行HDLC协议处理，确定接收的数据流已经能够形成完整的帧、即通道调整响应时，将通道调整响应写入共享内存的数据接收区。
步骤A07业务处理单元从共享内存的数据接收区读取通道调整响应，确定读取到的帧为控制帧，向发起端侧的HDLC配置管理单元发送通道调整响应，发起端侧的HDLC配置管理单元根据接收的通道调整响应对本端接收方向时隙通道映射配置表进行修改，然后向业务处理单元发送通道调整完成控制帧，业务处理单元将接收的通道调整完成控制帧写入共享内存的控制帧发送区。
步骤A08发起端侧的HDLC处理单元根据修改后的收发双向的时隙通道映射配置表接收和发送HDLC帧，从共享内存的数据发送区读取通道调整完成控制帧，对该通道调整完成控制帧进行HDLC协议处理，然后向响应端侧的HDLC处理单元发送经过HDLC协议处理的通道调整完成控制帧。
步骤A09响应端侧的HDLC处理单元对接收的通道调整完成控制帧进行HDLC协议处理，确定接收的数据流已经能够形成完整的帧、即通道调整完成控制帧时，将通道调整完成控制帧写入共享内存的数据接收区。
步骤A10业务处理单元从共享内存的数据接收区读取通道调整完成控制帧，确定读取到的帧为控制帧，向响应端侧的HDLC配置管理单元发送通道调整完成控制帧，响应端侧的HDLC配置管理单元接收通道调整完成控制帧，至此，发起端和响应端协同完成了HDLC通道带宽的动态调整。
以上所述的通信两端不仅支持基本的HDLC协议，还支持多种基于HDLC协议衍生而成的协议，例如，D信道上的链路接入协议(Link Access Protocol(Dchannel)，LAPD)、帧中继(Frame Relay，FR)协议、7号信令中层2消息传输部分(Message Transfer Part Level 2 of SS7，MTP2)协议、点到点协议(Point-to-Point Protocol，PPP)等。
通信两端支持LAPD时，LAPD的帧格式和处理过程与基本的HDLC协议基本相同。LAPD可以看作是一种特殊的HDLC协议，LAPD与基本的HDLC协议的主要区别在于LAPD将其帧格式中的地址信息字段长度设置为16个比特，而基本的HDLC协议帧格式中的地址信息字段长度为8个比特，并且LAPD对其帧格式中的地址信息字段中的各个比特的用途进行了专门的规定。这样，LAPD作为一种特殊的HDLC协议，其与基本的HDLC协议之间的这些细微区别并不影响将本发明各实施例中提供的方法和装置应用于LAPD时的具体实现。
通信两端支持FR协议时，FR协议的帧格式和处理过程与基本的HDLC协议基本相同。FR协议可以看作是一种特殊的HDLC协议，FR协议与基本的HDLC协议的主要区别在于FR协议在其帧格式中用一个长度为16比特的字段描述地址信息和控制信息，而基本的HDLC协议帧格式中的地址信息和控制信息分别用一个长度为8比特的字段来描述，并且FR协议对其帧格式中的地址与控制信息字段中的各个比特的用途进行了专门的规定。这样，FR协议作为一种特殊的HDLC协议，其与基本的HDLC协议之间的这些细微区别并不影响将本发明各实施例中提供的方法和装置应用于FR协议时的具体实现。
通信两端支持PPP时，PPP的帧格式和处理过程与基本的HDLC协议基本相同。PPP可以看作是一种特殊的HDLC协议，PPP与基本的HDLC协议的主要区别在于PPP帧格式中的地址信息字段固定填充为十六进制数“FF”、控制信息字段固定填充为十六进制数“03”，并且PPP帧格式中还规定了一个协议信息字段，用来表示该帧所承载的上层协议类型，而该协议信息字段在基本的HDLC协议中是没有的。这样，PPP作为一种特殊的HDLC协议，其与基本的HDLC协议之间的这些细微区别并不影响将本发明各实施例中提供的方法和装置应用于PPP时的具体实现。
根据以上描述可见，本发明各实施例中提供的方案不仅适用于基本的HDLC协议，还适用于多种基于HDLC协议衍生而成的其它协议。
本发明实施例提供的方案中，发起端侧的HDLC处理单元根据修改后的接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据修改后的收发方向的时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据修改后的发送方向的时隙通道映射配置信息发送HDLC帧，使得需要对HDLC通道带宽进行调整时，由一端发起，通过控制帧的交互完成两端对HDLC通道带宽调整的协商，无需设置占用时隙或子时隙资源的专用控制链路，这部分时隙或子时隙资源能够应用在数据流的传输上，提高了时隙或子时隙资源的利用率；并且由于HDLC通道带宽调整的处理过程是通过两端的协商完成的，不会发生数据流的传送出现错误或被打断的情况，保证了业务的正常处理不受影响。
另外，本发明实施例中提供了多种实现方式，可以根据实际应用进行灵活选取。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。
权利要求
1.一种高级数据链路控制HDLC通道带宽动态调整中的装置，其特征在于，通信两端分别包括HDLC配置管理单元、HDLC处理单元、共享内存和物理层接口单元，其中，发起端侧的所述HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，将待发送的通道调整通知写入共享内存，根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；响应端侧的所述HDLC配置管理单元用于根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，将待发送的通道调整响应写入共享内存；发起端侧的所述HDLC处理单元用于根据接收方向的时隙通道映射配置信息接收HDLC帧，发送共享内存中的通道调整通知，将接收到的通道调整响应写入共享内存，根据发送方向的时隙通道映射配置信息发送HDLC帧；响应端侧的所述HDLC处理单元用于将接收到的通道调整通知写入共享内存，根据收发双向的时隙通道映射配置信息接收和发送HDLC帧，发送共享内存中的通道调整响应；所述共享内存用于缓存待发送和/或接收的数据流；所述物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
2.根据权利要求1所述的装置，其特征在于，通信两端通过控制帧的形式实现所述通道调整通知和通道调整响应，所述HDLC配置管理单元将待发送的控制帧直接写入共享内存；所述HDLC配置管理单元直接读取共享内存的存储内容获取接收到的控制帧。
3.根据权利要求2所述的装置，其特征在于，所述共享内存至少包括控制帧发送区和控制帧接收区，所述HDLC配置管理单元用于将待发送的控制帧直接写入共享内存的控制帧发送区；所述HDLC配置管理单元用于直接从共享内存的控制帧接收区读取接收到的控制帧。
4.根据权利要求3所述的装置，其特征在于，所述HDLC处理单元进一步用于将接收到的控制帧写入共享内存的控制帧接收区。
5.根据权利要求3所述的装置，其特征在于，所述HDLC处理单元包括存储器、先入先出FIFO缓存器、FIFO缓存控制单元、协议处理单元和时隙通道映射处理单元，其中，所述存储器用于存储发送方向时隙通道映射配置表、接收方向时隙通道映射配置表和HDLC通道配置表；所述FIFO缓存器包括发送区和接收区，所述发送区用于缓存待发送的帧，所述接收区用于缓存接收的帧；所述FIFO缓存控制单元用于在发送方向上根据所述HDLC通道配置表将共享内存中的待发送的帧写入FIFO缓存器的发送区，在接收方向上确定FIFO缓存器的接收区中缓存的数据流已经能够形成完整的控制帧时，根据所述HDLC通道配置表将FIFO缓存器的接收区中的控制帧写入共享内存的控制帧接收区，确定FIFO缓存器的接收区中缓存的数据流已经能够形成完整的数据帧时，根据所述HDLC通道配置表将FIFO缓存器的接收区中的数据帧写入共享内存的数据帧接收区；所述协议处理单元用于根据所述HDLC通道配置表对待发送的帧进行发送方向上的协议处理，向时隙通道映射处理单元发送HDLC帧，以及根据所述HDLC通道配置表对接收的来自时隙通道映射处理单元的比特流进行接收方向上的协议处理；所述时隙通道映射处理单元用于根据所述发送方向时隙通道映射配置表将HDLC通道上的HDLC帧中的比特流映射至相应时隙或子时隙，根据所述接收方向时隙通道映射配置表将来自物理层接口单元的时隙或子时隙上的比特流映射至相应HDLC通道，向协议处理单元发送各HDLC通道的比特流。
6.根据权利要求2所述的装置，其特征在于，接收方向上的所述HDLC配置管理单元进一步用于检测共享内存中是否存储有控制帧。
7.根据权利要求1所述的装置，其特征在于，通信两端通过控制帧的形式实现所述通道调整通知和通道调整响应，该装置进一步包括业务处理单元，用于在接收方向上向HDLC配置管理单元发送在共享内存中检测到的控制帧，并将来自于HDLC配置管理单元的待发送的控制帧写入共享内存。
8.根据权利要求1至7任一所述的装置，其特征在于，发起端侧的所述HDLC配置管理单元进一步用于将待发送的通道调整完成通知写入共享内存；发起端侧的所述HDLC处理单元进一步用于发送共享内存中的通道调整完成通知；响应端侧的所述HDLC处理单元进一步用于将接收到的通道调整完成通知写入共享内存；响应端侧的所述HDLC配置管理单元进一步用于从共享内存中获取接收到的通道调整完成通知。
9.一种高级数据链路控制通道带宽动态调整中的装置，其特征在于，该装置包括HDLC配置管理单元、HDLC处理单元、共享内存和物理层接口单元，其中，发起端侧的所述HDLC配置管理单元用于对接收方向的时隙通道映射配置信息进行修改，将待发送的通道调整通知写入共享内存，根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改；发起端侧的所述HDLC处理单元用于根据接收方向的时隙通道映射配置信息接收HDLC帧，发送共享内存中的通道调整通知，将接收到的通道调整响应写入共享内存，根据发送方向的时隙通道映射配置信息发送HDLC帧；所述共享内存用于缓存待发送和/或接收的数据流；所述物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
10.根据权利要求9所述的装置，其特征在于，以控制帧的形式实现所述通道调整通知和通道调整响应，所述共享内存至少包括控制帧发送区和控制帧接收区，所述HDLC配置管理单元用于将待发送的控制帧直接写入共享内存的控制帧发送区；所述HDLC配置管理单元用于直接从共享内存的控制帧接收区读取接收到的控制帧。
11.根据权利要求10所述的装置，其特征在于，接收方向上的所述HDLC处理单元进一步用于将接收到的控制帧写入共享内存的控制帧接收区。
12.根据权利要求9所述的装置，其特征在于，以控制帧的形式实现所述通道调整通知和通道调整响应，该装置进一步包括业务处理单元，用于在接收方向上向HDLC配置管理单元发送在共享内存中检测到的控制帧，并将来自于HDLC配置管理单元的待发送的控制帧写入共享内存。
13.根据权利要求9至12任一所述的装置，其特征在于，发起端侧的所述HDLC配置管理单元进一步用于将待发送的通道调整完成通知写入共享内存；发起端侧的所述HDLC处理单元进一步用于发送共享内存中的通道调整完成通知。
14.一种高级数据链路控制通道带宽动态调整中的装置，其特征在于，该装置包括HDLC配置管理单元、HDLC处理单元、共享内存和物理层接口单元，其中，响应端侧的所述HDLC配置管理单元用于根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，将待发送的通道调整响应写入共享内存；响应端侧的所述HDLC处理单元用于将接收到的通道调整通知写入共享内存，根据收发双向的时隙通道映射配置信息接收和发送HDLC帧，发送共享内存中的通道调整响应；所述共享内存用于缓存待发送和/或接收的数据流；所述物理层接口单元用于在E1/T1端口与HDLC处理单元之间进行比特流的转发。
15.根据权利要求14所述的装置，其特征在于，以控制帧的形式实现所述通道调整通知和通道调整响应，所述共享内存至少包括控制帧发送区和控制帧接收区，所述HDLC配置管理单元用于直接从共享内存的控制帧接收区读取接收到的控制帧；所述HDLC配置管理单元用于将待发送的控制帧直接写入共享内存的控制帧发送区。
16.根据权利要求15所述的装置，其特征在于，所述HDLC处理单元进一步用于将接收到的控制帧写入共享内存的控制帧接收区。
17.根据权利要求14至16任一所述的装置，其特征在于，以控制帧的形式实现所述通道调整通知和通道调整响应，该装置进一步包括业务处理单元，用于向HDLC配置管理单元发送在共享内存中检测到的控制帧，并将来自于HDLC配置管理单元的待发送的控制帧写入共享内存。
18.一种高级数据链路控制通道带宽动态调整中的方法，其特征在于，该方法包含发起端侧的HDLC处理单元根据接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据收发方向的时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据发送方向的时隙通道映射配置信息发送HDLC帧。
19.根据权利要求18所述的方法，其特征在于，所述接收方向的时隙通道映射配置信息的修改由发起端侧的HDLC配置管理单元完成。
20.根据权利要求18所述的方法，其特征在于，通信两端通过控制帧的形式实现所述通道调整通知和通道调整响应，待发送的和/或接收的所述控制帧缓存于共享内存，所述发送控制帧，包括HDLC配置管理单元将待发送的控制帧直接写入共享内存；所述获取控制帧，包括HDLC配置管理单元直接从共享内存读取接收到的控制帧。
21.根据权利要求20所述的方法，其特征在于，所述共享内存至少包括控制帧发送区和控制帧接收区，所述直接写入共享内存，包括直接写入共享内存的控制帧发送区；所述直接读取共享内存的存储内容获取接收到的控制帧，包括直接从共享内存的控制帧接收区读取控制帧。
22.根据权利要求21所述的方法，其特征在于，所述HDLC配置管理单元获取的控制帧来自于HDLC处理单元，所述HDLC处理单元接收到帧之后，进一步包括HDLC处理单元确定接收到的帧为控制帧，将所述控制帧写入共享内存的控制帧接收区。
23.根据权利要求20所述的方法，其特征在于，所述HDLC配置管理单元获取接收到的控制帧，包括HDLC配置管理单元确定共享内存中存储有接收到的控制帧，读取所述控制帧。
24.根据权利要求18所述的方法，其特征在于，所述响应端侧的HDLC配置管理单元获取通道调整通知，包括业务处理单元通过响应端侧的HDLC处理单元接收通道调整通知，向响应端侧的HDLC配置管理单元发送该通道调整通知；或者，所述发起端侧的HDLC配置管理单元获取通道调整响应，包括业务处理单元通过发起端侧的HDLC处理单元接收通道调整响应，向发起端侧的HDLC配置管理单元发送该通道调整响应。
25.根据权利要求18至24任一所述的方法，其特征在于，该方法进一步包括发起端侧的HDLC配置管理单元通过发起端侧的HDLC处理单元发送通道调整完成通知，响应端侧的HDLC处理单元接收通道调整完成通知，响应端侧的HDLC配置管理单元获取接收到的通道调整完成通知。
26.一种高级数据链路控制通道带宽动态调整中的方法，其特征在于，该方法包含发起端侧的HDLC处理单元根据接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据发送方向的时隙通道映射配置信息发送HDLC帧。
27.根据权利要求26所述的方法，其特征在于，以控制帧的形式实现所述通道调整通知和通道调整响应，待发送的和/或接收的所述控制帧缓存于共享内存，所述共享内存至少包括控制帧发送区和控制帧接收区，所述发送控制帧，包括HDLC配置管理单元将待发送的控制帧直接写入共享内存的控制帧发送区；所述获取控制帧，包括HDLC配置管理单元直接从共享内存的控制帧接收区读取接收到的控制帧。
28.根据权利要求27所述的方法，其特征在于，所述HDLC配置管理单元获取的接收到的控制帧来自于HDLC处理单元，所述HDLC处理单元接收到帧之后，进一步包括HDLC处理单元确定接收的帧为控制帧，将所述控制帧写入共享内存的控制帧接收区。
29.根据权利要求26所述的方法，其特征在于，所述发起端侧的HDLC配置管理单元获取通道调整响应，包括业务处理单元通过发起端侧的HDLC处理单元接收通道调整响应，向发起端侧的HDLC配置管理单元发送该通道调整响应。
30.根据权利要求26至29任一所述的方法，其特征在于，该方法进一步包括发起端侧的HDLC配置管理单元通过发起端侧的HDLC处理单元发送通道调整完成通知。
31.一种高级数据链路控制通道带宽动态调整中的方法，其特征在于，该方法包含响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应。
32.根据权利要求31所述的方法，其特征在于，以控制帧的形式实现所述通道调整通知和通道调整响应，待发送的和/或接收的所述控制帧缓存于共享内存，所述共享内存至少包括控制帧发送区和控制帧接收区，所述获取控制帧，包括HDLC配置管理单元直接从共享内存的控制帧接收区读取接收到的控制帧；所述发送控制帧，包括HDLC配置管理单元将待发送的控制帧直接写入共享内存的控制帧发送区。
33.根据权利要求32所述的方法，其特征在于，所述HDLC配置管理单元获取的控制帧来自于HDLC处理单元，所述HDLC处理单元接收到帧之后，进一步包括HDLC处理单元确定接收到的帧为控制帧，将所述控制帧写入共享内存的控制帧接收区。
34.根据权利要求31至33任一所述的方法，其特征在于，所述响应端侧的HDLC配置管理单元获取通道调整通知，包括业务处理单元通过响应端侧的HDLC处理单元接收通道调整通知，向响应端侧的HDLC配置管理单元发送该通道调整响应。
全文摘要
本发明公开了一种高级数据链路控制(HDLC)通道带宽动态调整中的方法及装置。发起端侧的HDLC处理单元根据接收方向的时隙通道映射配置信息接收HDLC帧，并发送通道调整通知；响应端侧的HDLC配置管理单元根据获取的通道调整通知对本端收发双向的时隙通道映射配置信息进行修改，响应端侧的HDLC处理单元根据收发方向的时隙通道映射配置信息接收和发送HDLC帧，并发送通道调整响应；发起端侧的HDLC配置管理单元根据获取的通道调整响应对本端发送方向的时隙通道映射配置信息进行修改，发起端侧的HDLC处理单元根据发送方向的时隙通道映射配置信息发送HDLC帧，通过控制帧的交互完成两端对HDLC通道带宽调整的协商。
文档编号H04L12/54GK101039333SQ200710095888
公开日2007年9月19日 申请日期2007年4月12日 优先权日2007年4月12日
发明者陈宇 申请人:华为技术有限公司