余数系统的缩放装置的制作方法技术资料下载

技术编号:6555021

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本发明涉及信号处理领域,具体地说,涉及用于通信及信号处理中的基于余数系统(RNS)的数值缩放电路的实现结构。背景技术在数值运算过程中,大量的乘加运算将导致数据动态范围的扩大,从而导致溢出的发生。数值缩放是解决运算溢出最常用的方法之一。在二进制补码系统中,通常利用截位操作进行2"缩放,在VLSI实现时不需要任何额外的资源。类似地,在余数系统的应用中, 对于那些乘加密集型的数字信号处理系统,也难免会发生溢出的情况。因此,也同样可以利用缩放操作抑制运算的溢出,使...
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