一种像素电路及其驱动方法及显示装置及其驱动方法与流程

本发明涉及显示技术领域，尤其涉及一种像素电路及其驱动方法及显示装置及其驱动方法。

背景技术：

目前，随着自发光技术的不断进步，自发光显示装置如oled(organiclight-emittingdiode，有机发光二极管)显示装置、迷你发光二极管显示装置、微发光二极管显示装置等的技术越来越成熟，随之而来的可应用于可穿戴设备的柔性显示装置，以及汽车仪表上的异形显示装置等越来越受到关注。

技术实现要素：

本发明的实施例提供一种像素电路及其驱动方法及显示装置及其驱动方法。用于减少驱动ic(integratedcircuit，集成电路)的数量。

为达到上述目的，本发明的实施例采用如下技术方案：

一方面，本发明实施例提供一种像素电路，包括第一控制子电路、第二控制子电路、写入子电路、驱动子电路和发光器件。

所述第一控制子电路连接第一初始信号端、第二初始信号端、第一控制端、第二控制端、第一节点和第二节点；所述第一控制子电路用于在初始化阶段，在所述第一控制端的控制下，将第一初始信号端的信号输出至所述第一节点；以及在所述第二控制端的控制下，将所述第二初始信号端的信号输出至所述第二节点，以对所述第一节点和所述第二节点的电位进行初始化；以及在补偿阶段，在第一控制端的控制下，继续将第一初始信号端的信号输出至所述第一节点，对所述第一节点的电位进行保持。

所述第二控制子电路连接第一电压端、第三控制端和第三节点；所述第二控制子电路用于在补偿阶段和发光阶段，在所述第三控制端的控制下，将所述第一电压端的信号输出至所述第三节点；在数据写入阶段，停止将所述第一电压端的信号输出至所述第三节点。

所述写入子电路连接数据信号端、第四控制端和所述第一节点；所述写入子电路用于在数据写入阶段，在所述第四控制端的控制下，将所述数据信号端的信号输出至所述第一节点；以及在发光阶段，停止将所述数据信号端的信号输出至所述第一节点。

所述驱动子电路连接所述第一节点、所述第二节点和所述第三节点，所述发光器件连接所述第二节点和第二电压端；所述驱动子电路用于在补偿阶段，将第三节点和所述第二节点导通，并根据所述第三节点和第一节点的电位对所述第二节点进行电压补偿；以及在发光阶段，将所述第三节点和所述第二节点导通，使所述发光器件根据所述第二节点的电位和所述第二电压端的电位进行发光。

可选的，所述驱动子电路包括驱动晶体管和存储电容。

所述驱动晶体管的栅极连接所述第一节点，第一极连接所述第三节点，第二极连接所述第二节点。

所述存储电容的第一极连接所述第一节点，第二极连接所述第二节点。

可选的，所述第一控制子电路包括第一子控制电路和第二子控制电路。

所述第一子控制电路连接第一初始信号端、第一控制端和第一节点；所述第一子控制电路用于在所述初始化阶段，在所述第一控制端的控制下，将所述第一初始信号端的信号输出至所述第一节点，对所述第一节点的电位进行初始化；以及在补偿阶段，在所述第一控制端的控制下，继续将所述第一初始信号端的信号输出至所述第一节点，对所述第一节点的电位进行保持。

所述第二子控制电路连接所述第二初始信号端、第二控制端和第二节点；所述第二子控制电路用于在所述初始化阶段，在所述第二控制端的控制下，将所述第二初始信号端的信号输出至所述第二节点，对所述第二节点的电位进行初始化。

可选的，所述第一子控制电路包括第一晶体管，所述第二子控制电路包括第二晶体管。

所述第一晶体管的栅极与所述第一控制端连接，第一极与所述第一初始信号端连接，第二极与所述第一节点连接。

所述第二晶体管的栅极与所述第二控制端连接，第一极与所述第二初始信号端连接，第二极与所述第二节点连接。

可选的，所述第二控制子电路包括第三晶体管。

所述第三晶体管的栅极连接所述第三控制端，第一极连接所述第一电压端，第二极连接所述第三节点。

可选的，所述写入子电路包括第四晶体管，所述第四晶体管的栅极连接所述第四控制端，第一极连接所述数据信号端，第二极连接所述第一节点。

可选的，所述像素电路还包括第三控制子电路，所述第三控制子电路连接所述第二节点、第五控制端和发光器件；用于在补偿阶段，控制所述第五控制端的信号开启或关闭；以及在所述发光阶段，在所述第五控制端的控制下，将所述第二节点和所述第二电压端导通，使所述发光器件根据所述第二节点和第二电压端的信号发光。

可选的，所述第三控制子电路包括第五晶体管。

所述第五晶体管的栅极连接第五控制端，第一极连接所述第二节点，第二极连接所述发光器件。

另一方面，本发明实施例提供一种显示装置，包括多个亚像素，一个亚像素包括一个如上所述的像素电路。

可选的，每一列所述亚像素连接有一条数据线；还包括多个多路复用子电路，每个多路复用子电路连接一个数据信号输入端以及至少两条数据线，用于在扫描到一行亚像素的情况下，在与所述至少两条数据线连接的亚像素各自的数据写入阶段，向所述至少两条数据线写入数据信号，与所述至少两条数据线连接的亚像素的数据写入阶段之间均无交叠。

可选的，该多路复用子电路包括至少两个第六晶体管，每个所述第六晶体管的栅极连接一个分路控制信号端，第一极连接数据信号输入端，第二极一一对应的与多列所述数据线相连接。

可选的，所述多个亚像素包括重复分布的多个亚像素组，每个亚像素组包括至少三列不同颜色的亚像素；与所述至少两条数据线连接的所述亚像素的发光颜色相同；或者，与所述至少两条数据线连接的所述亚像素为连续分布的至少两列亚像素。

另一方面，本发明实施例提供一种像素电路的驱动方法，应用于如上所述的像素电路，该驱动方法包括：一个帧周期包括初始化阶段、补偿阶段、数据写入阶段和发光阶段。

其中，所述初始化阶段包括：在第一控制端的控制下，将第一初始信号端的信号输出至第一节点，以及在第二控制端的控制下，将所述第二初始信号端的信号输出至所述第二节点，以对所述第一节点和第二节点的电位进行初始化。

所述补偿阶段包括：在第一控制端的控制下，继续将第一初始信号端的信号输出至第一节点，对所述第一节点的电位进行保持，并在所述第三控制端的控制下，将所述第一电压端的信号输出至第三节点，通过所述驱动子电路将所述第三节点和第二节点导通，根据所述第三节点和第一节点的电位对所述第二节点进行电压补偿。

所述数据写入阶段包括：停止将所述第一电压端的信号输出至所述第三节点，并在第四控制端的控制下，将数据信号端的信号输出至第一节点。

所述发光阶段包括：停止将所述数据信号端的信号输出至所述第一节点，并在所述第三控制端的控制下，将所述第一电压端的信号输出至第三节点，通过所述驱动子电路将所述第三节点和第二节点导通，使所述发光器件根据所述第二节点的电位和所述第二电压端的电位进行发光。

可选的，所述像素电路还包括第三控制子电路，所述第三控制子电路连接所述第二节点、第五控制端和发光器件。

所述驱动方法还包括：在所述补偿阶段，控制所述第五控制端的信号开启或关闭；以及在所述发光阶段，在所述第五控制端的控制下，将所述第二节点和所述第二电压端导通，使所述发光器件根据所述第二节点和第二电压端的信号发光。

再一方面，本发明实施例提供一种显示装置的驱动方法，应用于如上所述的显示装置，所述驱动方法包括：依次扫描各行亚像素；在扫描到一行亚像素的情况下，在与所述至少两条数据线连接的亚像素各自的数据写入阶段，向所述至少两条数据线写入数据信号，与所述至少两条数据线连接的亚像素的数据写入阶段之间均无交叠。

本发明实施例提供一种像素电路及其驱动方法及显示装置及其驱动方法。通过设置第二控制子电路，在数据写入阶段，通过将第二控制子电路关断，能够避免第一电压端的信号不断对第二节点充电，使第二节点的电压不断抬升，从而在用于多路复用技术时，不会因为第一列亚像素和第二亚像素的数据写入时间不同，而使得第二节点的电压变化量不同造成亮度差异。

因此，采用该像素电路，可以达到减少驱动ic的数量的目的，而通过减少驱动ic的数量，可以降低显示装置的成本，并能够实现异形产品的窄边框设计，提高异形产品的有效显示面积。

附图说明

为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。

图1为本发明实施例提供的一种显示装置的俯视结构示意图；

图2为本发明实施例提供的一种显示装置上设置多路复用子电路的结构示意图；

图3为本发明实施例提供的一种像素电路的结构示意图；

图4为本发明实施例提供的一种4t1c的等效电路图；

图5为本发明实施例提供的一种图3的具体电路结构图；

图6为本发明实施例提供的另一种图3的具体电路结构图；

图7为本发明实施例提供的一种图6中各个控制端的时序控制图；

图8为本发明实施例提供的另一种像素电路的结构示意图；

图9为本发明实施例提供的一种图8的具体电路结构图；

图10为本发明实施例提供的一种图9中各个控制端的时序控制图；

图11为本发明实施例提供的另一种在显示装置上设置多路复用子电路的结构示意图；

图12为本发明实施例提供的一种图11中像素电路的各个控制端和数据信号端的时序控制图；

图13为本发明实施例提供的一种显示装置的驱动方法的流程示意图。

附图标记：1-显示装置；p-亚像素；100-像素电路；200-多路复用子电路；datain-数据信号输入端；p1-第一列亚像素；p2-第二列亚像素；lgate(n)-栅线；10-第一控制子电路；20-第二控制子电路；30-写入子电路；40-驱动子电路；50-发光器件；vin1-第一初始信号端；vin2-第二初始信号端；s1-第一控制端；s2-第二控制端；n-第一节点；s-第二节点；vdd-第一电压端；s3-第三控制端；m-第三节点；data-数据信号端；s4-第四控制端；vss-第二电压端；dtft-驱动晶体管；cst-存储电容；101-第一子控制电路；102-第二子控制电路；t1-第一晶体管；t2-第二晶体管；t3-第三晶体管；t4-第四晶体管；60-第三控制子电路；s5-第五控制端；t5-第五晶体管；coled-oled的本征电容；t6-第六晶体管；lg1-第一分路控制信号；lg2-第二分路控制信号；ldata1-第一列数据线；ldata2-第二列数据线。

具体实施方式

下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。

本发明实施例提供一种显示装置1，该显示装置1为显示面板，或者，该显示装置1包括显示面板，例如手机、平板电脑、笔记本、个人数字助理(personaldigitalassistant，pda)、车载电脑等。本申请实施例对上述显示装置的具体形式不做特殊限制。

在一些实施例中，如图1所示，该显示装置1包括多个亚像素p。为了方便说明，本实施例中上述多个亚像素p是以矩阵形式排列为例进行的说明。此时，沿水平方向x排列成一排的亚像素p称为同一行亚像素，沿竖直方向y排列成一排的亚像素p称为同一列亚像素。同一行亚像素p可以与一根栅线连接，同一列亚像素p可以与一根数据线连接。

此外，如图2所示，一个亚像素p内设置有一个像素电路100，该像素电路100用于控制亚像素p进行显示。在另一些实施例中，如图2所示，该显示装置还包括多个多路复用子电路200，每个多路复用子电路200连接一个数据信号输入端datain以及至少两条数据线，用于在扫描到一行亚像素p的情况下，在与该至少两条数据线连接的亚像素p各自的数据写入阶段，向该至少两条数据线写入数据信号data，与该至少两条数据线连接的亚像素p各自的数据写入阶段之间均无交叠。

在一些实施例中，多个亚像素p包括重复分布的多个亚像素组，每个亚像素组包括至少三个不同颜色的亚像素p；与至少两条数据线连接的亚像素p的发光颜色相同；或者，与至少两条数据线连接的亚像素p为连续分布的至少两个亚像素p。

示例性的，至少三个不同颜色的亚像素p可以为红色亚像素(r)、绿色亚像素(g)和蓝色亚像素(b)。此时，与至少两条数据线连接的亚像素p的发光颜色相同，是指，一个多路复用子电路200连接至少两列间隔分布且颜色相同的亚像素p。与至少两条数据线连接的亚像素p为连续分布的至少两列亚像素p，是指，若至少两条数据线连接的亚像素p为连续分布的两列亚像素p，则相邻的两列亚像素p，如rg、gb、br分别连接一个多路复用子电路200；若至少两条数据线连接的亚像素p为连续分布的三列亚像素p，则一个亚像素组rgb连接一个多路复用子电路200。

在此，以与至少两条数据线连接的亚像素p为连续分布的两列亚像素p为例，如图2所示，该两列亚像素p分别称为第一列亚像素p1和第二列亚像素p2；在采用多路复用子电路200驱动时，在扫描到一行栅线lgate(n)打开的情况下，在写第一列亚像素p1的数据后，再写第二列亚像素p2的数据，之后二者的栅线lgate(n)才同时关闭，这就造成第一列亚像素p1和第二列亚像素p2的数据写入时间不同。即前者的数据写入时间大于后者的数据写入时间。为确保亚像素p的数据写入的准确性，就需要数据写入阶段亚像素p的工作状态稳定。

基于此，本发明的实施例一提供一种像素电路100，如图3所示，包括第一控制子电路10、第二控制子电路20、写入子电路30、驱动子电路40和发光器件50。

该第一控制子电路10连接第一初始信号端vin1、第二初始信号端vin2、第一控制端s1、第二控制端s2、第一节点n和第二节点s；该第一控制子电路10用于在初始化阶段，在第一控制端s1的控制下，将第一初始信号端vin1的信号输出至第一节点n。以及在第二控制端s2的控制下，将第二初始信号端vin2的信号输出至第二节点s，以对第一节点n和第二节点s的电位进行初始化。以及在补偿阶段，在第一控制端s1的控制下，继续将第一初始信号端vin1的信号输出至第一节点n，对第一节点n的电位进行保持。

第二控制子电路20连接第一电压端vdd、第三控制端s3和第三节点m；该第二控制子电路20用于在补偿阶段和发光阶段，在第三控制端s3的控制下，将第一电压端vdd的信号输出至第三节点m。在数据写入阶段，停止将第一电压端vdd的信号输出至第三节点m。

写入子电路30连接数据信号端data、第四控制端s4和第一节点n；该写入子电路30用于在数据写入阶段，在所述第四控制端s4的控制下，将数据信号端data的信号输出至第一节点n；以及在发光阶段，停止将数据信号端data的信号输出至第一节点n。

驱动子电路40连接第一节点n、第二节点s和第三节点m，发光器件50连接第二节点s和第二电压端vss；该驱动子电路40用于在补偿阶段，将第三节点m和第二节点s导通，并根据第三节点m和第一节点n的电位对第二节点s进行电压补偿；以及在发光阶段，将第三节点m和第二节点s导通，使发光器件50根据第二节点s和第二电压端vss的电位进行发光。

假设该像素电路100在第三节点m和第一电压端vdd之间未设置该第二控制子电路20，如图4所示，为一种4t1c的像素电路的等效电路图，在数据写入阶段，由于驱动晶体管dtft是打开的，第一电压端vdd的信号不断输出至s点，这就使得s点因为第一电压端vdd的电流充电不断抬升，也就是说，在数据写入阶段，依然对驱动晶体管dtft做不均匀性的补偿，驱动晶体管dtft的迁移率越高，s点抬升越大，而发光的时候驱动晶体管dtft的栅漏电压vgs就越小，相反，驱动晶体管dtft的迁移率越小，s点抬升得越小，发光的时候vgs就越大。又由于在采用多路复用电路200对亚像素进行驱动时，第一列亚像素p1和第二列亚像素p2的数据写入时间不同，那么s点的电压变化量也不同，尤其是多列亚像素(三列以上)连接一个多路复用电路200的情况下，使得第一列亚像素的数据写入时间远大于最后一列亚像素的数据写入时间，就会造成在各列亚像素之间的亮度差异。

而在本实施例中，通过设置第二控制子电路20，在数据写入阶段，通过将第二控制子电路20关断，能够避免第一电压端vdd的信号不断对第二节点s充电，使第二节点s的电压不断抬升，从而在用于多路复用技术时，不会因为第一列亚像素p1和第二亚像素p2的数据写入时间不同，而使得第二节点s的电压变化量不同造成亮度差异。

因此，采用该像素电路100，可以达到减少驱动ic的数量的目的，而通过减少驱动ic的数量，可以降低显示装置的成本，并能够实现异形产品的窄边框设计，提高异形产品的有效显示面积。

接下来，将对本发明的实施例一提供的像素电路100所包含的第一控制子电路10、第二控制子电路20、写入子电路30、驱动子电路40的具体电路结构进行示例性的介绍。

如图5和图6所示，该驱动子电路40可以包括驱动晶体管dtft和存储电容cst，该驱动晶体管dtft的栅极与第一节点n连接，第一极与第三节点m连接，第二极与第二节点s连接，该存储电容cst的第一极与第一节点n连接，该存储电容cst的第二极与第二节点s连接。

如图5所示，该第一控制子电路10包括第一子控制电路101，和第二子控制电路102；该第一子控制电路101连接第一初始信号端vin1、第一控制端s1和第一节点n，第一子控制电路用于在初始化阶段，在第一控制端s1的控制下，将第一初始信号端vin1的信号输出至第一节点n，对第一节点n的电位进行初始化；以及在补偿阶段，在第一控制端s1的控制下，继续将第一初始信号端vin1的信号输出至第一节点n，对第一节点n的电位进行保持。

该第二子控制电路102连接第二初始信号端vin2、第二控制端s2和第二节点s，第二子控制电路用于在初始化阶段，在第二控制端s2的控制下，将第二初始信号端vin2的信号输出至第二节点s，对第二节点s的电位进行初始化。

示例性的，如图5和图6所示，该第一子控制电路101包括第一晶体管t1，第二子控制电路102包括第二晶体管t2；第一晶体管t1的栅极与第一控制端s1连接，第一极与第一初始信号端vin1连接，第二极与第一节点n连接；第二晶体管t2的栅极与第二控制端s2连接，第一极与第二初始信号端vin2连接，第二极与第二节点s连接。

如图5和图6所示，该第二控制子电路20包括第三晶体管t3，该第三晶体管t3的栅极连接第三控制端s3，第一极连接第一电压端vdd，第二极连接第三节点m。该第三晶体管t3被配置为在补偿阶段和发光阶段，在第三控制端s3的控制下，将第一电压端vdd的信号输出至第三节点m。以及在数据写入阶段，停止将第一电压端vdd的信号输出至第三节点m。

如图5和图6所示，该写入子电路30包括第四晶体管t4，该第四晶体管t4的栅极连接第四控制端s4，第一极连接数据信号端data，第二极连接第一节点n。该第四晶体管t4被配置为在数据写入阶段，在第四控制端s4的控制下，将数据信号端data的信号输出至第一节点n。

在一些实施例中，上述所述的第一晶体管t1、第二晶体管t2、第三晶体管t3、第四晶体管t4和驱动晶体管dtft均为p型晶体管或均为n型晶体管。

上面已经对本发明的实施例一提供的第一控制子电路10、第二控制子电路20、驱动子电路40和写入子电路30的具体电路结构分别进行了示例性的介绍，如图7所示，本发明的一些实施例所提供的像素电路100包括：第一晶体管t1、第二晶体管t2、第三晶体管t3、第四晶体管t4、驱动晶体管dtft及存储电容cst，各元件的连接方式可参见上面相应部分的介绍。上述各晶体管可均为p型晶体管或n型晶体管。

在一些实施例中，如图5和图6所示，该发光器件50包括至少一个发光二极管。其中，一个该发光二极管的阳极与第二节点s连接，该发光二极管的阴极与第二电压端vss连接，示例性的，在该第一晶体管t1、第二晶体管t2、第三晶体管t3、第四晶体管t4和驱动晶体管dtft均为p型晶体管的情况下，该第二电压端vss可以接地，或者为0v，相应地，第一电压端vdd可以大于0v。

在一些实施例中，上述发光二极管为微型发光二极管(microled)、迷你发光二极管(miniled)或者有机发光二极管，本发明的实施例对此并不设限。

需要说明的是，本发明的实施例提供的电路中所采用的晶体管可以为薄膜晶体管、场效应晶体管或其他特性相同的开关器件，本发明的实施例对此并不设限。

在一些实施例中，像素电路100所采用的各晶体管的第一极为晶体管的源极和漏极中一者，第二极为晶体管的源极和漏极中另一者。由于晶体管的源极、漏极在结构上可以是对称的，所以其源极、漏极在结构上可以是没有区别的，也就是说，本发明的实施例中的晶体管的第一极和第二极在结构上可以是没有区别的。示例性的，在晶体管为p型晶体管的情况下，晶体管的第一极为源极，第二极为漏极；示例性的，在晶体管为n型晶体管的情况下，晶体管的第一极为漏极，第二极为源极。

在以上对实施例一提供的像素电路100所包含的第一控制子电路10、第二控制电路20、写入子电路30和驱动子电路40的具体电路结构进行介绍的基础上，接下来，将对该像素电路100的驱动方法进行介绍。以下的介绍，以图6所示出的像素电路100为例，结合图7所示出的时序图进行描述。该像素电路100包括第一晶体管t1、第二晶体管t2、第三晶体管t3、第四晶体管t4、第五晶体管t5、驱动晶体管dtft及存储电容cst，且上述晶体管均为n型晶体管，发光器件50包括oled。

该驱动方法包括：

一个帧周期包括初始化阶段、补偿阶段、数据写入阶段和发光阶段。

初始化阶段包括：在第一控制端的控制下，将第一初始信号端vin1的信号输出至第一节点n，以及在第二控制端的控制下，将第二初始信号端vin2的信号输出至第二节点s，以对第一节点n和第二节点s的电位进行初始化。

示例的，在第一控制端s1和第二控制端s2输出高电平信号，第一晶体管t1和第二晶体管t2导通，其余晶体管关断，将第一初始电压端vin1的信号输出至第一节点n，将第二初始电压端vin2的信号输出至第二节点s。给驱动晶体管dtft写入一个初始栅漏电压vgs＝vin2＝vin1。

在此阶段，若不关断第二控制子电路20，那么初始化后的第二节点s的电压vs大于vin1，就缩小了驱动晶体管dtft的阈值电压vth的补偿范围。

补偿阶段包括：在第一控制端s1的控制下，继续将第一初始信号端vin1的信号输出至第一节点n，对第一节点n的电位进行保持，第二控制子电路20在第三控制端的控制下，将第一电压端vdd的信号输出至第三节点m，通过驱动子电路40将第三节点m和第二节点s导通，根据第三节点m和第一节点n的电位对第二节点s进行电压补偿。

示例的，第一控制端s1继续输出高电平信号，保持第一晶体管t1打开，第二晶体管t2关闭，第三晶体管t3打开，将第一电压端vdd的信号输出至第二节点s，直至驱动晶体管dtft的vgs＝vth，此时oled的阳极电压vs＝vin2-vin1。

数据写入阶段包括：停止将第一电压端vdd的信号输出至第三节点s，并在第四控制端s4的控制下，将数据信号端data的信号输出至第一节点n。

示例性的，第四晶体管t4打开，其余晶体管关断，此时，驱动晶体管dtft中没有电流，而第二节点s的变化只是电容耦合作用。因此，vn＝vdata，vs＝a(vdata-vin2)+vin2-vth；那么vgs＝(1-a)(vdata-vin2)+vth，其中，a为电容耦合系数，a＝cst/(cst+coled)，coled为并联oled的本征电容。

在此阶段，若不关断第三晶体管t3，由于驱动晶体管dtft是开启的，那么驱动晶体管dtft中有电流，第二节点s的电压抬升很快，这样数据写入后的vgs会非常小，甚至小到接近vth而无法发光。因此，在数据写入阶段，通过关断第三晶体管t3，使得驱动晶体管dtft中没有电流，第二节点s不会因为第一电压端vdd电流充电而变化(第二节点s电容小，所以充电会比较快，导致第二节点s的电压抬升太快)，而只是起到电容耦合作用，能够减少驱动ic的data损失。

发光阶段包括：停止将数据信号端data的信号输出至第一节点n，并在第三控制端s3的控制下，将第一电压端vdd的信号输出至第三节点m，将第三节点m和第二节点s导通，使发光器件50根据第二节点s的电位和所述第二电压端vss的电位进行发光。

示例性的，第三晶体管t3打开，其余晶体管关断，像素发光，ioled＝k[(1-a)(vdata-vin2)]＾2，与阈值电压vth无关，实现内部补偿。

在以上实施例一的基础上，如图8所示，本发明的实施例二提供一种像素电路100，该像素电路100除包括实施例一提供的第一控制子电路10、第二控制子电路20、写入子电路30、驱动子电路40和发光器件50以外，还包括第三控制子电路60，该第三控制子电路60连接第二节点s、第五控制端s5和发光器件50；用于在补偿阶段，控制第五控制端s5的信号开启或关闭。以及在发光阶段，在第五控制端s5的控制下，将第二节点s和第二电压端vss导通，使发光器件50根据第二节点s和第二电压端vss的信号发光。

示例性的，如图9所示，该第三控制子电路60包括第五晶体管t5；该第五晶体管t5的栅极连接第五控制端s5，第一极连接第二节点s，第二极连接发光器件50。该第五晶体管t5被配置为在第五控制端s5的控制下，将第二节点s与第二电压端vss导通，使发光器件50根据第二节点s和第二电压端vss的电压发光。

需要说明的是，该第五晶体管t5与实施例一所述的第一晶体管t1、第二晶体管t2、第三晶体管t3、第四晶体管t4和驱动晶体管dtft为同种类型的晶体管，如均为p型晶体管或均为n型晶体管。

上面已经对本发明的实施例二提供的第一控制子电路10、第二控制子电路20、驱动子电路40、写入子电路30和第三控制子电路60的具体电路结构分别进行了示例性的介绍，接下来，将对实施例二提供的该像素电路100的驱动方法进行介绍。以下的介绍，以图9所示出的像素电路100为例，结合图10所示出的时序图进行描述。该像素电路100包括第一晶体管t1、第二晶体管t2、第三晶体管t3、第四晶体管t4、第五晶体管t5、驱动晶体管dtft及存储电容cst，且上述晶体管均为n型晶体管，发光器件50包括oled。

该驱动方法包括：

一个帧周期包括初始化阶段、补偿阶段、数据写入阶段和发光阶段。

其中，初始化阶段和补偿阶段的驱动方法与实施例一基本相同，在此不再赘述。不同的是：

在补偿阶段，第二节点s连接的电容有存储电容cst以及驱动晶体管dtft、第二晶体管t2和第五晶体管t5的寄生电容，没有与coled这个大电容连接，因此第二节点s的电压抬升比较快，直至vgs＝vth，驱动晶体管dtft关闭，此时vs＝vin2-vth，换言之，vgs达到vth的时间比较短，因此补偿时间比较短。

在数据写入阶段，由于第四晶体管t4打开，第三晶体管t3关断，驱动晶体管dtft中没有电流，因此，第二节点s的变化也只是电容耦合作用，因此vn＝vdata，vs＝a(vdata-vin2)+vin2-vth；那么vgs＝(1-a)(vdata-vin2)+vth，其中，a为电容耦合系数，a＝cst/(cst+c0)，c0为第二节点s点连接的晶体管的寄生电容总和，寄生电容一般非常小。因此，vgs仅仅有电容耦合损失比较小一部分(a接近于1)，与未设置第五晶体管t5相比，能够进一步减少驱动ic的data损失。

在发光阶段，还包括打开第五晶体管t5，将第二节点s和第二电压端vss导通，使发光器件根据第二节点s和第二电压端vss的电压发光。

综上所述，在该实施例二中，与实施例一中第二节点s连接在oled的电容上，oled的本征电容coled比较大，第二节点s的充电的电容包括存储电容cst、晶体管的寄生电容和oled的本征电容coled，前两者远小于oled本征电容coled相比，通过设置第五晶体管t5，能够将oled的电容和驱动晶体管dtft断开，去除oled的本征电容coled，补偿时仅向存储电容cst和晶体管的寄生电容充电，这样达到目标电压所需的时间就会大大缩短。

在以上实施例一和实施例二的基础上，在本发明的实施例三中，对该多路复用子电路200和像素电路100的具体连接关系和具有该多路复用子电路200的显示装置的驱动方法进行详细说明。

在一些实施例中，如图2和图11所示，该多路复用子电路200包括至少两个第六晶体管t6，每个第六晶体管t6的栅极连接一个分路控制信号端，第一极连接数据信号输入端datain，第二极一一对应的与至少两列数据线相连接。

其中，以多路复用子电路200包括两个第六晶体管t6为例，位于左侧的第六晶体管t6连接一个分路控制信号端(在此称为第一分路控制信号端lg1)，位于右侧的第六晶体管t6连接另一个分路控制信号端(在此称为第二分路控制信号端lg2)，此时，相应地，如图2和图11所示，位于左侧的第六晶体管t6连接一列数据线(在此称为第一列数据线ldata1)，位于右侧的第六晶体管t6连接另一列数据线(在此称为第二列数据线ldata2)。

在另一些实施例中，多个多路复用子电路200中位于同一位置处的第六晶体管t6的栅极连接同一个分路控制信号端。

在此，仍然以多路复用子电路200包括两个第六晶体管t6为例，多个多路复用子电路200中位于左侧的第六晶体管t6连接同一个分路控制信号端(即上述所述的第一分路控制信号端lg1)，位于右侧的第六晶体管连接同一个分路控制信号端(即上述所述的第二分路控制信号端lg2)。

以上已经对多路复用子电路200和像素电路100的具体连接关系进行了介绍，接下来，将对该显示装置的驱动方法进行介绍。以下介绍中，以图11所示出的显示装置1为例，结合图12所示出的时序图进行描述。该像素电路100包括第一晶体管t1、第二晶体管t2、第三晶体管t3、第四晶体管t4、驱动晶体管dtft及存储电容cst，发光器件50包括oled，一个多路复用子电路200包括至少两个第六晶体管t6。

如图13所示，该驱动方法包括：

s1)依次扫描各行亚像素p。

示例的，依次扫描各行亚像素p可以为从第1行扫描到第6行，即逐行扫描。也可以是先扫描1、3、5行，再扫描2、4、6行。

s2)在扫描到一行亚像素p的情况下，在与该至少两条数据线连接的亚像素p各自的数据写入阶段，向该至少两条数据线写入数据信号，与该至少两条数据线连接的亚像素p的数据写入阶段之间均无交叠。

在此，以一个多路复用子电路200所连接的两条数据线所对应的亚像素p分别为第一列亚像素p1和第二列亚像素p2，且扫描到第n行的亚像素p为例，对数据写入阶段的驱动方法进行示例性的说明。

在数据写入阶段，将第n行栅线lgate(n)开启，此时位于该行中的第一列和第二列亚像素中的第四晶体管t4开启，同时打开与第一列亚像素p1连接的第六晶体管t6，向与第一列亚像素p1连接的数据线ldata1输入data电压，通过电容耦合，vgs_1＝k[(1-a)(vdata_1-vin2)]＾2，然后关闭与第一列亚像素p1所对应的数据线ldata1连接的第六晶体管t6，开启与第二列亚像素p2连接的第六晶体管t6，向与第二列亚像素p2连接的数据线ldata2输入data电压，电容耦合后，vgs_2＝k[(1-a)(vdata_2-vin2)]＾2，其中，vgs_1为位于该行的第一列亚像素p1中驱动晶体管dtft的vgs，vgs_2为位于该行的第二列亚像素p2中驱动晶体管dtft的vgs，vdata_1为与第一列亚像素p1连接的数据线ldata1输入的data电压值，vdata_2为与第二列亚像素p2连接的数据线ldata2输入的data电压值；a为亚像素p中驱动晶体管dtft的栅漏两端的存储电容cst和oled的本征电容coled的耦合比例，a＝cst/(cst+coled)，coled为并联oled的本征电容。

本发明的实施例三提供的显示装置具有与本发明的实施例一相同的有益技术效果，具体可参照本发明的实施例一的描述，在此不再赘述。

以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。