串行数据处理装置与数据偏移修正方法与流程

本案是关于串行数据处理装置，更明确地说，是关于可修正数据偏移的串行数据处理装置与其修正方法。

背景技术：

串行通讯接口常见于计算机总线或是集成电路与集成电路之间的数据信道。在实际应用(尤其是同步传输应用)中，经由串行通讯接口传输的数据可能会受到传递延迟、信号反射、输入输出电路的驱动能力等等因素的影响，造成接收端装置收到的数据产生偏移。如此，将导致接收端装置接收到错误的数据。

技术实现要素：

在一些实施例中，串行数据处理装置包含偏移侦测电路以及偏移校正电路。偏移侦测电路用以储存多个符记，并从主机装置接收第一数据信号，并根据这些符记侦测接收到的该第一数据信号的偏移以产生修正信号，其中这些符记中每一者都包含至少一默认逻辑值，且这些符记每一者的该至少一默认逻辑值的个数彼此不同。偏移校正电路用以根据该修正信号修正接收到的该第一数据信号，以产生第二数据信号。

在一些实施例中，数据偏移修正方法包含下列操作：从主机装置接收第一数据信号；根据多个符记侦测接收到的该第一数据信号的偏移以产生修正信号，其中这些符记中每一者都包含至少一默认逻辑值，且这些符记中每一者的该至少一默认逻辑值的个数彼此不同；以及根据该修正信号修正该第一数据信号，以产生第二数据信号。

有关本案的特征、实施与效果，将结合附图作详细说明如下。

附图说明

图1为根据本案一些实施例示出一种串行数据处理装置的示意图；

图2a为根据本案一些实施例示出图1的数据信号出现右偏移的波形示意图；

图2b为根据本案一些实施例示出图1的数据信号出现左偏移的波形示意图；

图3为根据本案一些实施例示出图1的数据信号的波形图；

图4为根据本案一些实施例示出一种串行数据处理装置的示意图；

图5a为根据本案一些实施例示出一种串行数据处理装置的示意图；

图5b为根据本案一些实施例示出一种串行数据处理装置的示意图；以及

图6为根据本案一些实施例示出一种数据偏移修正方法的流程图。

具体实施方式

本文所使用的所有词汇具有其通常的含义。上述的词汇在普遍常用字典中的定义，在本案的内容中包含任一于此讨论的词汇的使用例子仅为示例，不应限制到本案的范围与含义。同样地，本案也不仅以在此说明书所示出的各种实施例为限。

关于本文中所使用的“耦接”或“连接”，均可指两个或更多个组件相互直接作实体或电性接触，或是相互间接作实体或电性接触，也可指两个或更多个组件相互操作或动作。如本文所用，用语“电路”可为由至少一个晶体管与/或至少一个主被动组件按一定方式连接以处理信号的装置。

如本文所用，用语“与/或”包含了列出的关联项目中的一个或多个的任何组合。在本文中，使用第一、第二与第三等等之词汇，是用于描述并辨别各个组件。因此，在本文中的第一组件也可被称为第二组件，而不脱离本案的本意。为易于理解，在各附图中的类似组件将被指定为相同标号。

图1为根据本案一些实施例示出一种串行数据处理装置100的示意图。在一些实施例中，串行数据处理装置100从主机(host)装置10接收数据信号sd1与频率信号ck1。在一些实施例中，主机装置10与串行数据处理装置100之间可透过串行传输接口交换频率信号ck1、数据信号sd1与数据信号sdo。串行传输接口可为(但不限于)串行外围接口(serialperipheralinterface)。

主机装置10包含发射器电路12与接收器电路14。串行数据处理装置100包含接收器电路102、发射器电路104、偏移侦测电路110、偏移校正电路120以及处理电路130。发射器电路12传输频率信号ck1至接收器电路102，并根据频率信号ck1传输数据信号sd1至接收器电路102。接收器电路102根据接收到的频率信号ck1(后称为频率信号ck1')取样接收到的数据信号sd1(后称为数据信号sd1')，以输出数据信号sd2。换言之，串行数据处理装置100与主机装置10操作于同步串行传输模式。

在一些实施例中，发射器电路104可根据频率信号ck1'传输数据信号sdo至接收器电路14。偏移侦测电路110根据多个符记(token)to1～ton分析数据信号sd2以判断数据信号sd1'是否出现偏移，并据以输出修正信号sa与数据信号sd2。n可为大于或等于1的正整数。偏移校正电路120还根据修正信号sa修正数据信号sd2，以修正数据信号sd1'的偏移并据以产生数据信号sd3。

处理电路130可从偏移校正电路120接收数据信号sd3，以进行后续数据处理。处理电路130也可经由发射器电路104输出数据信号sdo至主机装置10。在一些实施例中，处理电路130可为(但不限于)中央处理单元、微控制器单元等电路。

图2a为根据本案一些实施例示出图1的数据信号sd1'出现右偏移的波形示意图。接收器电路102从发射器电路12接收频率信号ck1以作为频率信号ck1'，且发射器电路12响应于频率信号ck1的下降沿传输数据信号sd1至接收器电路102。接收器电路102根据频率信号ck1'的上升沿对数据信号sd1'取样以产生数据信号sd2(未绘示)。若线路延迟(例如为电路板引入的延迟)的影响不大(即第一情形)，频率信号ck1'的上升沿可对齐到数据信号sd1'的有效区间(例如为眼图中心)。于此条件下，接收器电路102可产生出正确的数据信号sd2。

或者，若频率信号ck1过快(即第二情形)，频率信号ck1'的上升沿早于数据信号sd1'的有效区间。于此条件下，接收器电路102会产生错误的数据信号sd2，且偏移侦测电路110判断数据信号sd1'具有右偏移。举例来说，若数据信号sd1为00100，数据信号sd2亦应为00100。在第二情形的例子中，由于接收器电路102过早对数据信号sd1'取样，数据信号sd2会误变为00010。相较于数据信号sd1，数据信号sd1'(或数据信号sd2)出现右偏移。

图2b为根据本案一些实施例示出图1的数据信号sd1'出现左偏移的波形示意图。于此例中，发射器电路12响应于频率信号ck1的上升沿传输数据信号sd1至接收器电路102。接收器电路102根据频率信号ck1'的上升沿对数据信号sd1'取样以产生数据信号sd2(未绘示)。若线路延迟的影响不大(即第一情形)，频率信号ck1'的上升沿可对齐到数据信号sd1'的有效区间。在此条件下，接收器电路102可产生出正确的数据信号sd2。

或者，若线路延迟的影响过大(即第二情形)，频率信号ck1'的上升沿晚于数据信号sd1'的有效区间。在此条件下，接收器电路102会产生错误的数据信号sd2，且偏移侦测电路110判断数据信号sd1'具有左偏移。举例来说，由于接收器电路102过晚对数据信号sd1'取样，数据信号sd2会误变为01000。相较于数据信号sd1，数据信号sd1'(或数据信号sd2)出现左偏移。

继续参照图1。在一些实施例中，偏移侦测电路110可包含缓存器(未绘示)，其用以储存这些符记to1～ton。举例来说，多个符记to1～ton可由下表之形式储存于此缓存器：

to100010000

to200011000

to300111000

to400111100

to501111100

to601111110

在此例中，n设置为6，且每一个to1～ton设定为具有8个位，其中最右位为第0个位，且最左位为第7个位。在一些实施例中，每一个符记to1～to6包含至少一默认逻辑值(例如可为逻辑值1)，且每一个符记to1～to6的至少一默认逻辑值的个数彼此不同。在此例中，多个符记to1～to6的逻辑值1的个数依序递增。详细而言，符记to1的第5个位为逻辑值1(即逻辑值1的个数为1)，符记to2的第4～5个位为逻辑值1(即逻辑值1的个数为2)，且符记to3的第4～6个位为逻辑值1(即逻辑值1的个数为3)。依此类推，可推得符记to6的位设定方式。

如图1所示，数据信号sd1可包含符记、有效数据(payload)以及伪(dummy)符记。符记为主机装置10与串行数据处理装置100预先决定好的特定编码，并为数据信号sd1的前置数据。有效数据为主机装置10欲传输的真实数据。伪符记为发生右偏移时的缓冲符记数据。

在联机初始阶段，主机装置10与串行数据处理装置100可事先约定使用多个符记to1～to6中之一者来进行联机，以侦测后续的传输过程中是否会出现偏移。在数据信号sd1的符记中，至少一预定逻辑值的个数为第一个数。在多个符记to1～to6之对应者中，至少一预定逻辑值的个数为第二个数，且第一个数与第二个数相同。

举例来说，主机装置10使用包含符记to1的数据信号sd1来与串行数据处理装置100进行联机。偏移侦测电路110可根据数据信号sd2的前8位数据与多个符记to1～ton中之对应者进行比较，以侦测偏移为左偏移或右偏移。若不存在偏移，数据信号sd2的前8位数据与数据信号sd1的符记to1相同。偏移侦测电路110可根据至少一默认逻辑值(例如为逻辑值1)在多个符记to1～ton之对应者中的位位置以及至少一默认逻辑值在数据信号sd2的前8位数据中的位位置确认偏移为左偏移或右偏移。

例如，若数据信号sd2(即取样到的数据信号sd1')的前8位数据为00001000(即第一个数为1)，偏移侦测电路110可从多个符记to1～ton中选出仅包含1个逻辑值1(即第二个数为1)的符记to1，并将此8位数据00001000与符记to1进行比较。在符记to1中，第5个位为逻辑值1。在8位数据00001000中，第4个位为逻辑值1。在此情形下，偏移侦测电路110可判断数据信号sd1'出现右偏移，且偏移量为1个位。偏移侦测电路110可据此输出具有第一数值的修正信号sa至偏移校正电路120。

或者，若数据信号sd2的前8位数据为00100000，偏移侦测电路110可自多个符记to1～ton中选出仅包含1个逻辑值1的符记to1，并将此8个位数据00100000与符记to1进行比较。在符记to1中，第5个位为逻辑值1。在8位数据00100000中，第6个位为逻辑值1。在此情形下，偏移侦测电路110可判断数据信号sd1'出现左偏移，且偏移量为1个位。偏移侦测电路110可据此输出具有第二数值的修正信号sa至偏移校正电路120。

响应于修正信号sa，偏移校正电路120可修正数据信号sd2的偏移以产生数据信号sd3。举例而言，若侦测到偏移为右偏移且偏移量为1位，偏移校正电路120可将所收到的数据信号sd2的位向左位移1位，并输出为数据信号sd3。如此一来，处理电路130可接收到正确的有效数据。

在一些实施例中，偏移侦测电路110可包含缓存器电路、比较器电路(例如可为异或门电路)、计数器电路与/或其他数字逻辑电路，以实施储存多个符记to1～ton与侦测数据偏移的操作。在一些实施例中，偏移校正电路120可包含移位寄存器电路与/或一或多个数字逻辑电路，以实施校正偏移的操作。在一些实施例中，偏移校正电路120中的数字逻辑电路可设定为(但不限于)执行位(bitwise)运算，以实施位移位的操作。上述关于偏移侦测电路110与偏移校正电路120的实施方式用于示例，且本案并不以此为限。

图3为根据本案一些实施例示出图1的数据信号sdo的波形图。如前所述，若侦测到右偏移，代表频率信号ck1可能过快。如先前图1所示，接收器电路14根据频率信号ck1取样接收到的数据信号sdo(后称数据信号sdo')。如图3所示，若频率信号ck1的频率过高且接收器电路14根据频率信号ck1的上升沿取样数据信号sdo'时(即第一情形)，频率信号ck1的上升沿早于数据信号sdo'的有效区间而取样到错误的数据。

在本案一些实施例中，当偏移侦测电路110侦测到数据信号sd1'出现右偏移时，偏移侦测电路110还用以输出控制信号sc至发射器电路104，以提高发射器电路104的驱动能力(即图3的第二情形)。例如，发射器电路104可根据控制信号sc提升数据信号sdo的电流。如此，频率信号ck1的上升沿可对齐数据信号sdo'的有效区间而取样到正确的数据。在一些实施例中，发射器电路104的偏压设定与/或负载设定可响应于控制信号sc调整，以实施上述调整驱动能力的操作。

图4为根据本案一些实施例示出一种串行数据处理装置100的示意图。相较于图1，如下表所示，多个符记to1～ton每一者对应于一默认指令。换言之，多个符记to1～ton每一者内嵌一组对应于默认指令的运算程序代码(operationcode)。通过上述设置方式，在传送用于侦测偏移的符记时，主机装置10可提供欲由串行数据处理装置100执行的指令。

默认指令

to100010000内存读取

to200011000输入输出读取

to300111000缓存器读取

to400111100内存写入

to501111100输入输出写入

to601111110缓存器写入

在此例中，偏移侦测电路110还根据数据信号sd1的符记所对应的默认指令产生指令信号si1。例如，偏移侦测电路110根据数据信号sd1'的前8个位数据解出前述的运算程序代码为指令信号si1。偏移校正电路120还根据修正信号sa修正指令信号si1以产生指令信号si2。指令信号si2用于通知处理电路130执行默认指令所对应的操作。偏移侦测电路110可根据数据信号sd1'的前8个位数据中至少一默认值的数量而从上表中选出一符记，并根据该符记对应的默认指令产生指令信号si1。举例来说，若数据信号sd1'的前8个位数据包含1个逻辑值1，偏移侦测电路110可选出符记to1，并输出符记to1对应的内存读取指令为指令信号si1。偏移校正电路120可根据修正信号sa来修正指令信号si1，以产生正确的指令信号si2。如此，处理电路130可根据指令信号si2执行内存读取的操作。

在一些应用中，处理电路130的操作为平行运算。在这些应用中，串行数据处理装置100可设定为输出并列数据。图5a为根据本案一些实施例示出串行数据处理装置100的示意图。在此例中，串行数据处理装置100还包含串行转并列(serial-to-parallel)电路510。串行转并列电路510耦接于偏移侦测电路110与偏移校正电路120之间，并用以根据数据信号sd1'产生多个数据信号sd4，并根据指令信号si1产生多个指令信号si3。偏移校正电路120根据修正信号sa修正多个数据信号sd4以产生数据信号sd3，并修正多个指令信号si3以产生指令信号si2。

图5b为根据本案一些实施例示出串行数据处理装置100的示意图。相较于图5a，串行转并列电路510耦接于偏移校正电路120与处理电路130之间。串行转并列电路510根据数据信号sd3产生多个数据信号sd5，并根据指令信号si2产生多个指令信号si4。

图6为根据本案一些实施例示出一种数据偏移修正方法600的流程图。在一些实施例中，数据偏移修正方法600可由(但不限于)串行数据处理装置100执行。

在操作s610，从主机装置接收第一数据信号。

在操作s620，根据多个符记侦测接收到的第一数据信号的偏移以产生修正信号，其中这些符记中每一者都包含至少一默认逻辑值，且这些符记中每一者的该至少一默认逻辑值的个数彼此不同。

在操作s630，根据修正信号修正接收到的第一数据信号，以产生第二数据信号。

上述操作s610、s620以及s630的说明可参照前述各个实施例，故不重复赘述。上述数据偏移修正方法600的多个操作仅为示例，并非限定需依照此示例中的顺序执行。在不违背本案的各实施例的操作方式与范围下，在数据偏移修正方法600下的各种操作当可适当地增加、替换、省略或以不同顺序执行。

上述关于符记的设置方式以及位数量用于示例，且本案各实施例并不以上述例子为限。

综上所述，本案一些实施例所提供的串行数据处理装置与数据偏移修正方法可利用预先设定好的多种符记修正数据偏移。在进一步的实施例中，这些符记还可用于传输默认指令。

虽然本案的实施例如上所述，然而这些实施例并非用来限定本案，本技术领域具有通常知识者可依据本案的明示或隐含的内容对本案的技术特征施以变化，凡此种变化均可能属于本案所寻求的专利保护范畴，换言之，本案的专利保护范围须视本说明书的申请专利范围所界定者为准。

【符号说明】

10:主机装置

12:发射器电路

14:接收器电路

100:串行数据处理装置

102:接收器电路

104:发射器电路

110:偏移侦测电路

120:偏移校正电路

130:处理电路

ck1,ck1':频率信号

sa:修正信号

sc:控制信号

sd1,sd1',sd2,sd3,sd4,sd5,sdo,sdo':数据信号

to1～ton:符记

si1,si2,si3,si4:指令信号

510:串行转并列电路

600:数据偏移修正方法

s610,s620,s630:操作