一种存储设备PCIE链路协商方法、系统、设备及介质与流程

一种存储设备pcie链路协商方法、系统、设备及介质
技术领域
1.本发明属于计算机领域，具体涉及一种存储设备pcie链路协商方法、系统、设备及介质。


背景技术：

2.随着信息科技的发展，存储系统的应用需求越来越大，日益增加的业务量对存储系统的稳定性，可靠性，安全性，传输效率等方面要求越来越高。存储支持的盘由原来的机械盘到sas盘，再到现在的nvme盘，传输效率越来越高。nvme盘是走的pcie链路，一般连接在switch芯片上，支持暴力热插拔，而在热插拔过程，不同的人，不同的操作，难免出现pcie链路协商错误的问题。一般情况下，只能通过复位switch芯片和对盘进行热拔插操作让其进行重新协商链路，识别硬盘。这样就造成了很多的不便，而且复位switch芯片会影响其他正常使用的硬盘，影响业务。在这种情况下能够不拔插硬盘和不对switch芯片进行复位的一种自动修复链路的方法是非常重要的。
3.因此，亟需一种方案能够在这种情况下将switch的状态机恢复的初始状态detect，从而保证nvme盘链路协商在出现故障时，不进行人工干预即可进行重新协商链路。


技术实现要素：

4.为解决以上问题，本发明的第一方面提出了一种存储设备pcie链路协商方法，其包括：
5.实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入；
6.响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电；
7.响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
8.响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
9.在本发明的一些实施方式中，方法由bmc来执行。
10.在本发明的一些实施方式中，实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入，包括：
11.将bmc与所述switch芯片相连，并获取所述switch芯片上各port的状态机的状态，同时通过cpld检测各port对应的硬盘接口上是否存在硬盘。
12.在本发明的一些实施方式中，响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电，包括：
13.若bmc检测到所述port的状态机的状态为非l2状态，且所述port上存在硬盘接入，则bmc控制所述cpld将所述硬盘断电，并向所述switch芯片发送重新绑定指令。
14.在本发明的一些实施方式中，响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路，包括：
15.响应于所述unbind和bind操作完成，bmc控制cpld将所述port上的硬盘上电，并将上电完成信息发送到所述switch芯片。
16.在本发明的一些实施方式中，方法由switch芯片执行，并且包括：
17.switch芯片检测所属的各port的状态机的状态，并通过cpld获取所述各port的上的硬盘是否在位；
18.响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，switch芯片通过cpld将所述port上的硬盘下电；
19.响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
20.响应于所述unbind和bind操作完成，switch芯片通过cpld将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
21.在本发明的一些实施方式中，所述方法能够由bmc和switch芯片执行，并且所述方法还包括：
22.所述bmc和所述switch芯片采用竞争的方式执行所述方法；以及
23.响应于所述switch芯片在预定时间内无法执行上述方法，由bmc执行上述方法。
24.本发明的另一方面还提出了一种存储设备pcie链路协商系统，包括：
25.检测模块，所述检测模块配置用于实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入；
26.第一控制模块，所述第一控制模块配置用于响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电；
27.解绑模块，所述解绑模块配置用于响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
28.第二控制模块，所述第二控制模块配置用于响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
29.本发明的又一方面还提出了一种计算机设备，包括：
30.至少一个处理器；以及
31.存储器，所述存储器存储有可在所述处理器上运行的计算机指令，所述指令由所述处理器执行时实现上述实施方式中任意一项所述方法的步骤。
32.本发明的再一方面还提出了一种计算机可读存储介质，所述计算机可读存储介质存储有计算机程序，所述计算机程序被处理器执行时实现上述实施方式中任意一项所述方法的步骤。通过本发明提出的一种存储设备pcie链路协商方法，通过监控switch芯片上的port的状态机的状态判断其是否正常工作，并在其异常时通过在局部模拟设备重启的方式，将switch芯片上的异常port上的pcie设备重新挂载到switch芯片上，实现switch芯片到pcie链路的重新协商连接。有效解决计算机上因switch芯片上的port异常导致的pcie链路异常。并且可在计算机设备不开机的状态下完成，提高了计算机设备的稳定性与健壮性。
附图说明
33.为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
34.图1为本发明实施例提供的一种存储设备pcie链路协商方法的流程图；
35.图2为本发明实施例提供的一种存储设备pcie链路协商系统的结构图；
36.图3为本发明实施例提供的一种计算机设备的结构示意图；
37.图4为本发明实施例提供的一种计算机可读存储介质的结构示意图。
具体实施方式
38.使本发明的目的、技术方案和优点更加清楚明白，以下结合具体实施例，并参照附图，对本发明实施例进一步详细说明。
39.如图1所示，本发明提出了一种存储设备pcie链路协商方法，其包括：
40.步骤s1、实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入；
41.步骤s2、响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电；
42.步骤s3、响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
43.步骤s4、响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
44.在本发明的实施例中，在步骤s1中，为了准确定位出现问题的pcie链路属于哪一条线路，需要获取到switch芯片中的各个port的状态机的状态，需要说明的是，本发明所述的状态机并不是实物或者某个port的管理器，而是软件层面的一种port的状态表示体。通过switch芯片获取switch芯片上的各个port的状态，并对各个port的状态机进行分析，判断哪一个port的端口出现异常。并且同时获取switch芯片的多个port所连接的多条pcie设备的slot上是否有nvme硬盘接入。
45.在步骤s2中，所谓port的状态机异常是指该port的状态机的状态不是处于特定的状态，在本实施例中是指switch芯片上的port的状态机不是l2状态，也即只要switch芯片上的port的状态机的状态只要不是l2状态，则认为该port的状态机异常。具体地，读取switch芯片上的各个port的状态机的状态，将其与l2状态的值或特征码进行对比，不一致则说明该port异常。常见的状态机的状态包括：detect,polling,configuration,recovery,l0,l0s,l1,l2,hot reset,loopback,disable。在步骤s2中只判断其状态是否为l2状态。若某port的状态机的状态为l2，且该port对应有nvme硬盘接入，则将该nvme硬盘断电。
46.在步骤s3中，在异常的port对应的nvme硬盘断电之后，switch芯片则对异常的port进行unbind操作，即对该port进行解绑；在unbind完成后再进行bind操作，即重新绑定。即将port的原有的链路信息删除重新初始化该port链路。
47.在步骤s4中，在步骤s3中的对nvme硬盘的对应的port的unbind和bind完成之后，控制该port对应的nvme硬盘进行重新上电，switch芯片重新与nvme硬盘建立连接并重新协商链路。
48.在本发明的一些实施方式中，方法可以由bmc来执行。
49.在本实施例中，本发明所提出的上述方法过程可以在bmc中开发完成，并由bmc对switch芯片进行监测及发送相应的指令。
50.在本发明的一些实施方式中，实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入，包括：
51.将bmc与所述switch芯片相连，并获取所述switch芯片上各port的状态机的状态，同时通过cpld检测各port对应的硬盘接口上是否存在硬盘。
52.在本实施例中，为了获取switch芯片的运行状态或运行信息，以及向switch芯片发送相应的控制指令，bmc与switch连接通信，可通过i2c总线的方式相连，也可以其他数据线路的方式连接。为了能够有效控制与switch芯片的各个port相连的nvme硬盘的上下电。bmc则需要与cpld相连，并从cpld上获取对应的nvme硬盘的在位状态及上下电状态，并且在适当的时候通过cpld对nvme硬盘进行上下电。
53.在本实施例中，通过bmc实现实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入，需要bmc分别从switch芯片和cpld上获取port的状态机的状态，以及判断port对应的nvme接口上是否有nvme硬盘接入。
54.在本发明的一些实施方式中，响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电，包括：
55.若bmc检测到所述port的状态机的状态为非l2状态，且所述port上存在硬盘接入，则bmc控制所述cpld将所述硬盘断电，并向所述switch芯片发送重新绑定指令。
56.在本实施例中，如果bmc从switch芯片获取到的switch芯片上某port的状态机的状态非l2，即上述其他状态中的任意一个，且该port对应的nvme硬盘接口有nvme硬盘接入，则为了该switch芯片的port的状态，需要对该port连接的链路进行重新协商。具体地，bmc首先通知switch芯片断开该port与该port对应的nvme硬盘的连接，让该nvme硬盘的写入及其他有影响数据或影响nvme硬盘状态的操作终止。进一步，bmc通过cpld对该nvme硬盘对应的供电电路进行断电。在该nvme硬盘断电之后，bmc再向switch芯片发送重新绑定port的指令。
57.在本发明的实施例中，switch芯片在接收到bmc发送的重新绑定port指令后，对port进行unbind和bind操作。
58.在本发明的一些实施方式中，响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路，包括：
59.响应于所述unbind和bind操作完成，bmc控制cpld将所述port上的硬盘上电，并将上电完成信息发送到所述switch芯片。
60.在本实施例中，当switch芯片完成对异常port的unbind和bind操作之后，将完成信息发送给bmc，或者由bmc实时监测switch芯片的运行状态，在检测到switch芯片完成对异常port的unbind和bind之后，将通知cpld对该异常port所对应的nvme硬盘进行上电，启动该nvme硬盘。nvme硬盘上电后将与switch芯片自动协商链路，完成对异常链路的修复操
作。
61.在本发明的一些实施方式中，方法可由switch芯片执行，包括：
62.switch芯片检测所属的各port的状态机的状态，并通过cpld获取所述各port的上的硬盘是否在位；
63.响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，switch芯片通过cpld将所述port上的硬盘下电；
64.响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
65.响应于所述unbind和bind操作完成，switch芯片通过cpld将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
66.在本实施例中，由于现有的大多数switch芯片具备可自主编程的功能，即具备一定的可编程能力，本发明所提出的存储设备pcie链路协商方法可由switch芯片执行。具体地，switch芯片对其各个port的状态机的状态进行监测，判断各个port的状态机的状态是否处于l2状态，若某port的状态机的状态不是l2状态，则通过cpld获取该port的对应的nvme的硬盘接口上是否有nvme硬盘接入。
67.进一步，如果该nvme硬盘接口存在nvme硬盘接入，则通过cpld对该硬盘下电，在下电之前switch芯片需要该nvme断开数据连接及其他控制指令。然后switch芯片则对自身的port进行unbind和bind操作。在unbind和bind完成之后。switch芯片再通过cpld对该port对应的nvme硬盘进行上电，并与该nvme进行链路协商，进一步实现对异常的pcie链路进行重新协商修复的方法。
68.在本发明的一些实施方式中，所述方法能够由bmc和switch芯片执行，并且方法还包括：
69.所述bmc和所述switch芯片采用竞争的方式执行所述方法；以及
70.响应于所述switch芯片在预定时间内无法执行上述方法，由bmc执行上述方法。
71.在本实施例中，本发明提出的存储设备pcie链路协商方法可同时由bmc和switch芯片同时以竞争的方式执行，即switch芯片和bmc同时具备存储设备pcie链路协商方法的相关程序。
72.具体地，在本实施中，在bmc中维护一个流程表，在检测到switch芯片的port的状态机的状态处于非l2状态时，bmc激活流程表，并将本发明存储设备pcie链路协商方法的步骤作为流程表的各个节点，并实时监测switch芯片上的该port状态机的状态，若在5秒内switch芯片没有执行相关步骤，则bmc向switch或cpld发送相应的指令控制switch芯片和cpld完成预定的方法步骤流程。例如，在检测到switch芯片中的某个port存在异常，而在5秒内switch芯片并未对该port执行unbind和bind操作，则bmc向switch芯片发送unbind和bind的指令，控制其对异常的port进行unbind和bind操作。并且在unbind和bind完成后则将bmc中的流程表对应的流程节点进行标记已完成，然后重新对后续的流程节点进行监控。同样如果在5秒之后switch芯片依然没有向cpld发送断开该异常port对应的nvme硬盘的供电，则bmc向switch发送断开指令，并向cpld发送对对应的nvme硬盘的下电指令。
73.通过本发明提出的一种存储设备pcie链路协商方法，通过监控switch芯片上的port的状态机的状态判断其是否正常工作，并在其异常时通过在局部模拟设备重启的方
式，将switch芯片上的异常port上的pcie设备重新挂载到switch芯片上，实现switch芯片到pcie链路的重新协商连接。有效解决计算机上因switch芯片上的port异常导致的pcie链路异常。并且可在计算机设备不开机的状态下完成。提高了计算机设备的稳定性与健壮性。
74.如图2所示，本发明的另一方面还提出了一种存储设备pcie链路协商系统，包括：
75.检测模块1，所述检测模块1配置用于实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入；
76.第一控制模块2，所述第一控制模块2配置用于响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电；
77.解绑模块3，所述解绑模块3配置用于响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
78.第二控制模块4，所述第二控制模块4配置用于响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
79.如图3所示，本发明的又一方面还提出了一种计算机设备，包括：
80.至少一个处理器21；以及
81.存储器22，所述存储器存储有可在所述处理器上运行的计算机指令23，所述指令由所述处理器执行时实现本发明的提出了一种存储设备pcie链路协商方法，包括：
82.实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入；
83.响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电；
84.响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
85.响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
86.在本发明的一些实施方式中，方法可以由bmc来执行。
87.在本发明的一些实施方式中，实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入，包括：
88.将bmc与所述switch芯片相连，并获取所述switch芯片上各port的状态机的状态，同时通过cpld检测各port对应的硬盘接口上是否存在硬盘。
89.在本发明的一些实施方式中，响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电，包括：
90.若bmc检测到所述port的状态机的状态为非l2状态，且所述port上存在硬盘接入，则bmc控制所述cpld将所述硬盘断电，并向所述switch芯片发送重新绑定指令。
91.在本发明的一些实施方式中，响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路，包括：
92.响应于所述unbind和bind操作完成，bmc控制cpld将所述port上的硬盘上电，并将上电完成信息发送到所述switch芯片。
93.在本发明的一些实施方式中，方法可由switch芯片执行，包括：
94.switch芯片检测所属的各port的状态机的状态，并通过cpld获取所述各port的上
的硬盘是否在位；
95.响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，switch芯片通过cpld将所述port上的硬盘下电；
96.响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
97.响应于所述unbind和bind操作完成，switch芯片通过cpld将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
98.在本发明的一些实施方式中，所述方法能够由bmc和switch芯片执行，并且方法还包括：
99.所述bmc和所述switch芯片采用竞争的方式执行所述方法；以及
100.响应于所述switch芯片在预定时间内无法执行上述方法，由bmc执行上述方法。
101.如图4所示，本发明的再一方面还提出了一种计算机可读存储介质401，所述计算机可读存储介质401存储有计算机程序402，所述计算机程序被处理器执行时实现本发明提出了一种存储设备pcie链路协商方法，其包括：
102.实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入；
103.响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电；
104.响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
105.响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
106.在本发明的一些实施方式中，方法可以由bmc来执行。
107.在本发明的一些实施方式中，实时监控switch芯片各port的状态机的状态，以及判断所述port上是否存在硬盘接入，包括：
108.将bmc与所述switch芯片相连，并获取所述switch芯片上各port的状态机的状态，同时通过cpld检测各port对应的硬盘接口上是否存在硬盘。
109.在本发明的一些实施方式中，响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，将所述port上的硬盘下电，包括：
110.若bmc检测到所述port的状态机的状态为非l2状态，且所述port上存在硬盘接入，则bmc控制所述cpld将所述硬盘断电，并向所述switch芯片发送重新绑定指令。
111.在本发明的一些实施方式中，响应于所述unbind和bind操作完成，将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路，包括：
112.响应于所述unbind和bind操作完成，bmc控制cpld将所述port上的硬盘上电，并将上电完成信息发送到所述switch芯片。
113.在本发明的一些实施方式中，方法可由switch芯片执行，包括：
114.switch芯片检测所属的各port的状态机的状态，并通过cpld获取所述各port的上的硬盘是否在位；
115.响应于所述port的状态机的状态为非预定状态，且所述port上存在硬盘接入，
switch芯片通过cpld将所述port上的硬盘下电；
116.响应于所述port上的硬盘下电，switch芯片对所述port依次进行unbind和bind操作；
117.响应于所述unbind和bind操作完成，switch芯片通过cpld将所述port上的硬盘上电，switch芯片对所述port上的硬盘重新协商链路。
118.在本发明的一些实施方式中，方法还包括：
119.所述bmc和所述switch芯片采用竞争的方式执行所述方法；以及
120.响应于所述switch芯片在预定时间内无法执行上述方法，由bmc执行上述方法。
121.最后需要说明的是，本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程，可以通过计算机程序来指令相关硬件来完成，所述的程序可存储于一计算机可读取存储介质中，该程序在执行时，可包括如上述各方法的实施例的流程。其中，所述的存储介质可为磁碟、光盘、只读存储记忆体(rom)或随机存储记忆体(ram)等。所述计算机程序的实施例，可以达到与之对应的前述任意方法实施例相同或者相类似的效果。
122.此外，典型地，本发明实施例公开所述的装置、设备等可为各种电子终端设备，例如手机、个人数字助理(pda)、平板电脑(pad)、智能电视等，也可以是大型终端设备，如服务器等，因此本发明实施例公开的保护范围不应限定为某种特定类型的装置、设备。本发明实施例公开所述的客户端可以是以电子硬件、计算机软件或两者的组合形式应用于上述任意一种电子终端设备中。
123.此外，根据本发明实施例公开的方法还可以被实现为由cpu执行的计算机程序，该计算机程序可以存储在计算机可读存储介质中。在该计算机程序被cpu执行时，执行本发明实施例公开的方法中限定的上述功能。
124.此外，上述方法步骤以及系统单元也可以利用控制器以及用于存储使得控制器实现上述步骤或单元功能的计算机程序的计算机可读存储介质实现。
125.此外，应该明白的是，本文所述的计算机可读存储介质(例如，存储器)可以是易失性存储器或非易失性存储器，或者可以包括易失性存储器和非易失性存储器两者。作为例子而非限制性的，非易失性存储器可以包括只读存储器(rom)、可编程rom(prom)、电可编程rom(eprom)、电可擦写可编程rom(eeprom)或快闪存储器。易失性存储器可以包括随机存取存储器(ram)，该ram可以充当外部高速缓存存储器。作为例子而非限制性的，ram可以以多种形式获得，比如同步ram(dram)、动态ram(dram)、同步dram(sdram)、双数据速率sdram(ddr sdram)、增强sdram(esdram)、同步链路dram(sldram)、以及直接rambus ram(drram)。所公开的方面的存储设备意在包括但不限于这些和其它合适类型的存储器。
126.本领域技术人员还将明白的是，结合这里的公开所描述的各种示例性逻辑块、模块、电路和算法步骤可以被实现为电子硬件、计算机软件或两者的组合。为了清楚地说明硬件和软件的这种可互换性，已经就各种示意性组件、方块、模块、电路和步骤的功能对其进行了一般性的描述。这种功能是被实现为软件还是被实现为硬件取决于具体应用以及施加给整个系统的设计约束。本领域技术人员可以针对每种具体应用以各种方式来实现所述的功能，但是这种实现决定不应被解释为导致脱离本发明实施例公开的范围。
127.结合这里的公开所描述的各种示例性逻辑块、模块和电路可以利用被设计成用于执行这里所述功能的下列部件来实现或执行：通用处理器、数字信号处理器(dsp)、专用集
成电路(asic)、现场可编程门阵列(fpga)或其它可编程逻辑器件、分立门或晶体管逻辑、分立的硬件组件或者这些部件的任何组合。通用处理器可以是微处理器，但是可替换地，处理器可以是任何传统处理器、控制器、微控制器或状态机。处理器也可以被实现为计算设备的组合，例如，dsp和微处理器的组合、多个微处理器、一个或多个微处理器结合dsp和/或任何其它这种配置。
128.结合这里的公开所描述的方法或算法的步骤可以直接包含在硬件中、由处理器执行的软件模块中或这两者的组合中。软件模块可以驻留在ram存储器、快闪存储器、rom存储器、eprom存储器、eeprom存储器、寄存器、硬盘、可移动盘、cd
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rom、或本领域已知的任何其它形式的存储介质中。示例性的存储介质被耦合到处理器，使得处理器能够从该存储介质中读取信息或向该存储介质写入信息。在一个替换方案中，所述存储介质可以与处理器集成在一起。处理器和存储介质可以驻留在asic中。asic可以驻留在用户终端中。在一个替换方案中，处理器和存储介质可以作为分立组件驻留在用户终端中。