一种FPGA码流的加解密装置及方法与流程

文档序号:18133624发布日期:2019-07-10 10:26阅读:来源:国知局

技术特征:

技术总结
本申请公开了一种FPGA码流的加解密装置及方法,该装置包括:配置数据码流,判断是否需要对所述数据码流进行加密;若采用第一加密方式进行加密,生成第一加密码流及第一加密同步字,若采用第二加密方式进行加密,生成第二加密码流及第二加密同步字;接收加密的数据码流,检测所述加密的数据码流中是否存在加密同步字;若检测到第一加密同步字,采用第一解密方式对所述加密的数据码流进行解密,若检测到第二加密同步字,采用第二解密方式对所述加密的数据码流进行解密。

技术研发人员:仇斌;厚娇
受保护的技术使用者:上海安路信息科技有限公司
技术研发日:2019.04.30
技术公布日:2019.07.09
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