SDIO设备传输速率的检测方法、系统及存储介质与流程

sdio设备传输速率的检测方法、系统及存储介质
技术领域
1.本发明涉及通信技术领域，尤其涉及一种sdio设备传输速率的检测方法、系统及存储介质。


背景技术：

2.安全数字输入输出(secure digital input and output，sdio)协议是一种由sd卡读写接口发展而来的数据传输协议。sdio接口协议中，传输双方分为sdio主设备侧(host)和sdio从设备侧(sdio card)，同时也在sdio接口内部规定了若干寄存器(也可称为存储区域)。sdio主设备侧可以通过读取sdio从设备侧的寄存器来读取其支持的最高/最大数据传输速率，并因此决定其实际的数据传输速率。
3.然而在实际应用中，sdio主设备(或sdio接口)实际支持的最大数据传输速率并非完全取决于sdio从设备能支持的最大数据传输速率，sdio主设备的时钟质量、命令(即指令)及数据传输线的建立保持时间要求、传输连线的连接质量和抗干扰能力等因素，都会对实际传输的最大数据传输速率产生影响，从而导致无法准确评估sdio主设备真实传输的最大数据传输速率。


技术实现要素：

4.本技术实施例通过提供一种sdio设备传输速率的检测方法，解决了现有技术中无法评估sdio主设备支持的最大数据传输速率的技术问题。
5.第一方面，本技术通过本技术的一实施例提供一种sdio设备传输速率的检测方法，应用于sdio主设备侧，所述方法包括以下步骤：
6.s1、获取目标伪随机码；
7.s2、向sdio从设备发送写入指令，所述写入指令用于指示按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；
8.s3、向所述sdio从设备发送读取指令，并接收所述sdio设备返回的验证数据码，其中所述读取指令用于指示从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；
9.s4、根据所述验证数据码，对所述目标伪随机码进行验证；
10.s5、在所述目标伪随机码验证成功时，增大所述数据传输速率，重复执行上述步骤s2～s4，直至所述目标伪随机码验证失败为止，并将上一次所述目标伪随机码验证成功时所对应的数据传输速率，确定为所述sdio主设备的最大数据传输速率。
11.可选地，所述验证数据码为所述首位数据码，所述步骤s4具体包括：
12.调用所述sdio主设备中的伪随机码生成器，根据所述首位数据码生成对应的验证伪随机码；
13.对所述验证伪随机码和所述目标伪随机码进行验证。
14.可选地，所述步骤s4之前，所述方法还包括：
15.判断所述验证数据码是否与所述目标伪随机码中的首位数据码相同；
16.若是，则继续执行步骤s4。
17.可选地，所述步骤s1具体包括：
18.调用所述sdio主设备中的伪随机码生成器生成所述目标伪随机码。
19.可选地，所述写入指令具体用于按照预设的数据传输速率，将所述目标伪随机码写入sdio从设备的目标存储区域中；其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。
20.第二方面，本技术通过本技术的一实施例提供另一种sdio设备传输速率的检测方法，应用于sdio从设备侧，所述方法包括以下步骤：
21.响应于sdio主设备的写入指令，按照预设的数据传输速率将目标伪随机码写入至所述sdio从设备中；
22.响应于所述sdio主设备的读取指令，从所述sdio从设备中读取验证数据码，并将所述验证数据码返回给所述sdio主设备；
23.其中，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码，所述验证数据码和所述目标伪随机码均用于确定所述sdio主设备的最大数据传输速率。
24.可选地，所述按照预设的数据传输速率将目标伪随机码写入至所述sdio从设备中包括：
25.按照预设的数据传输速率，将所述目标伪随机码写入所述sdio从设备的目标存储区域中；
26.其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。
27.第三方面，本技术通过本技术的一实施例提供一种sdio设备传输速率的检测系统，包括sdio主设备及sdio从设备，其中：
28.所述sdio主设备，用于获取目标伪随机码，向所述sdio从设备发送写入指令，所述写入指令用于指示按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；
29.所述sdio从设备，用于接收并响应所述sdio主设备的所述写入指令，按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；
30.所述sdio主设备，还用于向所述sdio从设备发送读取指令，所述读取指令用于指示从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；
31.所述sdio从设备，还用于接收并响应所述sdio主设备的所述读取指令，读取所述数据传输速率下的验证数据码，并返回给所述sdio主设备；
32.所述sdio主设备，还用于接收所述sdio设备返回的验证数据码；根据所述验证数据码，对所述目标伪随机码进行验证；在所述目标伪随机码验证成功时，增大所述数据传输速率，重复执行上述各流程步骤，直至所述目标伪随机码验证失败为止，并将上一次所述目标伪随机码验证成功时所对应的数据传输速率，确定为所述sdio主设备的最大数据传输速
率。
33.可选地，所述sdio从设备具体用于：
34.按照预设的数据传输速率，将所述目标伪随机码写入所述sdio从设备的目标存储区域中；
35.其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。
36.第四方面，本技术通过本技术的一实施例提供一种sdio主设备，所述sdio主设备包括：处理器、存储器、通信接口和总线；所述处理器、所述存储器和所述通信接口通过所述总线连接并完成相互间的通信；所述存储器存储可执行程序代码；所述处理器通过读取所述存储器中存储的可执行程序代码来运行与所述可执行程序代码对应的程序，以用于执行如上第一方面提供的所述sdio设备传输速率的检测方法。
37.第五方面，本技术通过本技术的一实施例提供一种sdio从设备，所述sdio从设备包括：处理器、存储器、通信接口和总线；所述处理器、所述存储器和所述通信接口通过所述总线连接并完成相互间的通信；所述存储器存储可执行程序代码；所述处理器通过读取所述存储器中存储的可执行程序代码来运行与所述可执行程序代码对应的程序，以用于执行如上第二方面提供的所述sdio设备传输速率的检测方法。
38.本技术通过本技术的一实施例提供一种计算机可读存储介质，所述计算机可读存储介质存储有程序，当所述程序运行在sdio设备时执行如上第一方面或第二方面提供的所述sdio设备传输速率的检测方法。
39.本技术实施例中提供的一个或多个技术方案，至少具有如下技术效果或优点：本技术通过获取目标伪随机码，向sdio从设备发送写入指令，以按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；接着向sdio从设备发送读取指令，以从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；接着根据所述验证数据码，对所述目标伪随机码进行验证，在所述目标伪随机码验证成功时增大所述数据传输效率，重新执行上述各流程步骤，直至所述目标伪随机码验证失败为止，此时将上一次所述目标伪随机码验证成功时所对应的数据传输效率确定为所述sdio主设备的最大数据传输速率。上述方案中，本技术能利用目标伪随机码来测试sdio主设备支持的最大数据传输速率，利用较小的软硬件代价实现了sdio主从设备间的数据传输速率的测试及选择过程，同时也提升了sdio设备的传输效率。
附图说明
40.为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作一简单地介绍，显而易见地，下面描述中的附图是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
41.图1是本技术实施例提供的一种sdio设备传输速率的检测系统的结构示意图。
42.图2是本技术实施例提供的一种可能的sdio主从设备之间sdio接口通信的示意图。
43.图3是本技术实施例提供的一种sdio设备传输速率的检测方法的流程示意图。
44.图4是本技术实施例提供的一种可能的prbs7伪随机码生成器的示意图。
45.图5和图6是本技术实施例提供的两种sdio设备传输速率的检测装置的结构示意图。
46.图7是本技术实施例提供的一种sdio主设备的结构示意图。
47.图8是本技术实施例提供的一种sdio从设备的结构示意图。
具体实施方式
48.申请人在提出本技术的过程中还发现：sdio协议由sd卡协会制定传输规则，有着良好的请求和响应机制，因此其在芯片间进行中等速率(10mb～100mb)传输中得到广泛地应用。在sdio 3.0/2.0接口协议中，sdio接口(传输接口)上1根时钟线、1根命令传输线及4根数据传输线，其中时钟线完全由主传输测驱动，其余传输线为双向传输。并且命令传输线与数据传输线的传输均依照时钟线的节拍来运行。在sdio协议中，传输的时序控制和总线宽度是固定的，因此接口的传输速度主要取决于时钟频率、时钟频率越高，传输效率越快。根据传输协议，sdio2.0接口至少要能支持25mhz的时钟频率，最高50mhz。而sdio 3.0接口至少要支持50mhz时钟频率，最高208mhz的时钟频率。sdio协议也在接口内部规定了若干寄存器，sdio主传输侧可以通过读取sdio从设备侧的寄存器来获取其能支持的最大传输速率，并因此决定实际的数据传输速率。由于sdio协议并未规定最低数据传输速率，因此理论上只要低于最大数据传输频率即可。
49.在实际应用中，sdio接口实际支持的最大数据传输频率并非完全取决于sdio从设备能支持的最大数据传输速率，其还受sdio主设备的时钟质量、命令及数据传输线的建立保持时间要求等因素的影响。目前，sdio从设备对应的提供商往往会提高性能冗余度，相应地sdio主设备侧的驱动程序往往会选择应用中所需要求最低的数据传输速率来进行通信，因此造成了不少的性能浪费，提高了传输成本。
50.本技术实施例通过提供一种sdio设备传输速率的检测方法，解决了现有技术中无法评估sdio主设备支持的最大数据传输速率的技术问题。
51.本技术实施例的技术方案为解决上述技术问题，总体思路如下：本技术提供一种sdio设备传输速率的检测方法，应用于sdio主设备侧，所述方法包括以下步骤：s1、获取目标伪随机码；s2、向sdio从设备发送写入指令，所述写入指令用于指示按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；s3、向所述sdio从设备发送读取指令，并接收所述sdio设备返回的验证数据码，所述读取指令用于指示从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；s4、根据所述验证数据码，对所述目标伪随机码进行验证；s5、在所述目标伪随机码验证成功时，增大所述数据传输速率，重复执行上述步骤s2～s4，直至所述目标伪随机码验证失败为止，并将上一次所述目标伪随机码验证成功时所对应的数据传输速率，确定为所述sdio主设备的最大数据传输速率。
52.为了更好的理解上述技术方案，下面将结合说明书附图以及具体的实施方式对上述技术方案进行详细的说明。
53.首先说明，本文中出现的术语“和/或”，仅仅是一种描述关联对象的关联关系，表
示可以存在三种关系，例如，a和/或b，可以表示：单独存在a，同时存在a和b，单独存在b这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
54.请参见图1，是本技术实施例提供的一种sdio设备传输速率的检测系统的结构示意图。如图1所示的系统包括：sdio主设备100和sdio从设备200。其中，所述sdio主设备100和所述sdio从设备200各自的数量并不做限定，图示仅以一个所述sdio主设备100和一个所述sdio从设备200为例示出，但并不构成限定。
55.在实际应用中，所述sdio主设备100和所述sdio从设备200之间通过网络相互通信，例如所述sdio主设备100和所述sdio从设备200相互之间通过sdio接口通信。请一并参见图2是本技术实施例提供一种sdio接口通信的示意图。所述sdio主设备100和所述sdio从设备200可以是sdio存储卡、或sdio芯片等，它们可以兼容于笔记本电脑、手机、平板电脑及数码相机等设备中。如图2中，所述sdio主设备100和所述sdio从设备200之间通过sdio接口相互通信，所述sdio接口上存在有例如时钟线(sdio_clk)、命令传输线(sdio_cmd)及数据传输线(sdio_date)等通信线。
56.基于图1所示的系统，请参见图3是本技术实施例提供的一种sdio设备传输速率的检测方法的流程示意图。如图3所示的方法应用于图1所示的系统中，所述方法包括如下实施步骤：
57.s301、sdio主设备获取目标伪随机码。
58.在一具体实施例中，本技术能根据实际使用需求在sdio主设备中设计一伪随机码生成器，其能生成对应的伪随机码(pseudo-random binary sequence，prbs)，例如prbs3、prbs7、prbs9及prbs11等。本技术能调用sdio主设备中的伪随机码生成器生成目标伪随机码。
59.需要说明的是，伪随机码(prbs码)是一种常见的高速接口测试编码，可以利用prbs码流来模拟真实的传输环境。其中，prbs码流中的“0”和“1”是随机分布的，但是码流本身是确定的，可以便捷地对数据进行校验。prbs码的周期长度与其阶数有关，常见的prbs码阶数有3、7、9及11等，其也对应被称为prbs3、prbs7、prbs9及prbs11码等。本技术采用prbs码的特点之一在于：给定一个特定数据之后，prbs码中后续的数据实际上是固定的，因此可以利用这个特性来降低prbs码校验所需的存储量。
60.举例来说，请参见图4示出一种可能的prbs7生成器的结构示意图。如图4所示的prbs7生成器，其满足x7+x6+1＝0，且无论采用硬件还是软件实现，其实现的代价都非常小。此外图示中，prbs码还可通过串并转换为4路输出，换言之将prbs码用4bit数据输出，每一路依然保持原有的特性，因此对于大多数sdio使用场景，prbs7码能符合sdio接口通信质量的测试要求。
61.s302、sdio主设备向sdio从设备发送写入指令。相应地，所述sdio从设备接收所述写入指令。所述写入指令用于指示按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中。
62.在一具体实施例中，系统可使用预设的最低数据传输频率对sdio从设备进行初始化。初始化完成后，可使用cmd52命令(command)读取sdio从设备中各寄存器(或存储区域，fnx block size)的大小，从中划定/选定一个目标存储区域(也可称为读写测试区域)。进一步本技术从预设最低的数据传输速率，使用写入指令将所述目标伪随机码连续写入所述
sdio从设备的目标存储区域中。其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。所述写入指令可具体例如为cmd53命令、或其他支持sdio接口传输通信的命令等，本技术不作限定。
63.可理解的，对于大多数sdio主设备都支持多种sdio时钟，其有可能来自于系统的时钟分频，也可能来自于单独的锁相环(phase locking loop，pll)时钟，但通常都可以通过软件配置来修改。由于设备未进行初始化，不清楚其实际支持的最低速率，因此通常选用最低的时钟频率(或其对应数据传输速率)来进行sdio从设备的初始化。例如，假设sdio主设备支持500khz、1mhz、5mhz、10mhz、20mhz及40mhz的数据传输频率，则本技术可选用500khz的数据传输频率按照sdio协议的要求对sdio从设备进行初始化，具体可对sdio从设备进行复位、判断设备类型及工作电压域获取之后即可完成初始化，可以按照寄存器的配置要求对sdio从设备进行读写操作。
64.相应地，本技术可根据sdio协议，cccr寄存器组内定义了sdio从设备中有多少个独立功能区域(其可根据io enble寄存器获得，最多能有7个)，每个独立功能区域均有存储区域大小(fnx block size)，其中x表示存储区域的序号，其可为1至7；它定义了其自有读写区间的大小，根据功能区选择一存储空间最大的自由读写区间作为校验数据的目标存储区域，记录该区域的起始地址，即首地址。
65.s303、所述sdio从设备响应所述写入指令，按照预设的数据传输速率将所述目标伪随机码写入所述sdio从设备中。
66.本技术所述sdio主设备可根据sdio协议，按照预设最低的数据传输速率开始，使用cmd53命令将目标伪随机码连续地、无长度限制地写入至sdio从设备的目标存储区域中。具体地，所述sdio主设备向所述sdio从设备发送写入指令(例如cmd53命令)，相应地所述sdio从设备接收并响应所述写入指令，按照预设最低的数据传输速率将所述目标伪随机码写入至所述sdio从设备的目标存储区域中。
67.s304、所述sdio主设备向所述sdio从设备发送读取指令。相应地，所述sdio从设备接收所述读取指令。所述读取指令用于指示从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码。
68.s305、所述sdio从设备响应所述读取指令，从所述sdio从设备中读取所述数据传输速率下的验证数据码，并返回给所述sdio主设备。相应地，所述sdio主设备接收所述数据传输速率下的验证数据码。
69.本技术所述sdio主设备还可使用读取指令，从所述sdio从设备的目标存储区域中读取所述数据传输速率下相应的验证数据码，所述验证数据码可为所述sdio从设备中存储的目标伪随机码；或者为所述sdio从设备中存储于首地址处的首位数据码等。所述读取指令可例如为cmd53命令等，本技术不做限定。
70.具体实施时，所述sdio主设备可向所述sdio从设备发送读取指令。相应地所述sdio从设备接收并响应所述读取指令，从所述sdio从设备的目标存储区域中读取相应地验证数据码。
71.s306、所述sdio主设备根据所述验证数据码，对所述目标伪随机码进行验证。
72.在一具体实施例中，在所述验证数据码为读取的所述sdio从设备中存储的目标伪随机码时，可直接对比所述验证数据码和步骤s301中的所述目标伪随机码是否相同，如果相同，则确定所述目标伪随机码验证成功，继续执行步骤s307。否则，确定所述目标伪随机码验证失败，可结束流程。
73.在另一具体实施例中，在所述验证数据码为所述sdio从设备中存储于首地址的首位数据码时，可选地本技术可先判断所述验证数据码是否与步骤s301中所述目标伪随机码的首位数据码相同。如果不相同，可结束流程。如果相同，则本技术可调用伪随机码生成器根据所述验证数据码生成与所述目标伪随机码相同长度的验证伪随机码。进而对比所述验证伪随机码和所述目标伪随机码是否相同，如果相同，则确定所述目标伪随机码验证成功，继续执行步骤s307；否则，确定所述目标伪随机码验证失败，可结束流程。
74.需要说明的是，本技术读取首地址处的验证数据码，无需读取完整的目标伪随机码，可降低sdio主设备侧对比所需的存储空间，即无需再存储之前写入sdio从设备中目标伪随机码的其他数据。
75.s307、所述sdio主设备在所述目标伪随机码验证成功时，增大所述数据传输速率，重复执行上述步骤s302～s306，直至所述目标伪随机码验证失败为止。
76.s308、所述sdio主设备将上一次所述目标伪随机码验证成功时所对应的数据传输速率，确定为所述sdio主设备的最大数据传输速率。
77.本技术当所述目标伪随机码验证成功时，可判断所述sdio主设备支持当前采用的数据传输速率，可继续执行步骤s307提高数据传输速率，重复执行步骤s302～s306，写入一组原始或新的prbs码再读出和对比验证。当完成预设最高的数据传输速率的正确传输(即在该最高的数据传输速率下目标伪随机码验证成功)后，可认为该sdio主设备可支持最高的数据传输速率(例如上例中的40mhz等)，测试结束。或者，当目标伪随机码验证失败，即sdio柱设备传输出错时，可判定sdio主设备无法支持当前的数据传输速率，因此sdio主设备支持的最高/最大数据传输速率为上一次较低的数据传输速率。
78.需要说明的是，如果当前采用的数据传输速率已为sdio主设备支持的最低的数据传输速率时，但目标伪随机码验证失败，即数据传输依然出错，则可认为该sdio主设备连接通信质量较差，虽然通过了sdio从设备的初始化，但无法将其视为一可靠的外设通道予以使用。
79.由上可以看出，本技术为了减小因为sdio接口连线质量差异较大而导致数据传输速率低、或性能冗余，本技术提供一种通用的对sdio接口通信质量进行校验的方法，通过增加prbs码生成器，选取合适的初始数据传输频率来获取sdio从设备的目标存储区域，并使用prbs码传输来模拟真实传输场景、并最终获得sdio接口最高效率的最大数据传输速率，本方案用较小的软硬件代价和延长初始化的时间，大大提高了sdio传输的可靠性和传输效率。
80.通过实施本技术实施例，本技术通过获取目标伪随机码，向sdio从设备发送写入指令，以按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；接着向sdio从设备发送读取指令，以从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；接着根据所述验证数据码，对所述目标伪随机码进行验证，在所述目标伪随机码验证
成功时增大所述数据传输效率，重新执行上述各流程步骤，直至所述目标伪随机码验证失败为止，此时将上一次所述目标伪随机码验证成功时所对应的数据传输效率确定为所述sdio主设备的最大数据传输速率。上述方案中，本技术能利用目标伪随机码来测试sdio主设备支持的最大数据传输速率，利用较小的软硬件代价实现了sdio主从设备间的数据传输速率的测试及选择过程，同时也提升了sdio设备的传输效率。
81.基于同一发明构思，本技术另一实施例提供一种实施本技术实施例中所述sdio设备传输速率的检测方法对应的装置和sdio设备。
82.请参见图5，是本技术实施例提供的一种sdio设备传输速率的检测装置的结构示意图。如图5所示的装置50包括：获取模块501、通信模块502、验证模块503、增大模块504及确定模块505，其中：
83.所述获取模块501，用于获取目标伪随机码；
84.所述通信模块502，用于向sdio从设备发送写入指令，所述写入指令用于指示按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；
85.所述通信模块502，还用于向所述sdio从设备发送读取指令，并接收所述sdio设备返回的验证数据码，所述读取指令用于指示从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；
86.所述验证模块503，用于根据所述验证数据码，对所述目标伪随机码进行验证；
87.所述增大模块504，用于在所述目标伪随机码验证成功时，增大所述数据传输速率，重复执行上述通信模块502及验证模块503各自对应的流程步骤，直至所述目标伪随机码验证失败为止；
88.所述确定模块505，用于将上一次所述目标伪随机码验证成功时所对应的数据传输速率，确定为所述sdio主设备的最大数据传输速率。
89.可选地，所述验证数据码为所述首位数据码，所述验证模块503具体用于：
90.调用所述sdio主设备中的伪随机码生成器，根据所述首位数据码生成对应的验证伪随机码；
91.对所述验证伪随机码和所述目标伪随机码进行验证。
92.可选地，所述验证模块503还用于：
93.判断所述验证数据码是否与所述目标伪随机码中的首位数据码相同；
94.若是，则继续执行所述根据所述验证数据码，对所述目标伪随机码进行验证。
95.可选地，所述获取模块501具体用于：
96.调用所述sdio主设备中的伪随机码生成器生成所述目标伪随机码。
97.可选地，所述写入指令具体用于按照预设的数据传输速率，将所述目标伪随机码写入sdio从设备的目标存储区域中；其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。
98.请一并参见图6，是本技术实施例提供的另一种sdio设备传输速率的检测装置的结构示意图。如图6所示的装置60包括：写入模块601和读取模块602，其中：
99.所述写入模块601，用于响应于sdio主设备的写入指令，按照预设的数据传输速率
将目标伪随机码写入至所述sdio从设备中；
100.所述读取模块602，用于响应于所述sdio主设备的读取指令，从所述sdio从设备中读取所述数据传输速率下的验证数据码，并将所述验证数据码返回给所述sdio主设备；
101.其中，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码，所述验证数据码和所述目标伪随机码均用于确定所述sdio主设备的最大数据传输速率。
102.可选地，所述写入模块601具体用于：
103.按照预设的数据传输速率，将所述目标伪随机码写入所述sdio从设备的目标存储区域中；
104.其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。
105.通过实施本技术实施例，本技术通过获取目标伪随机码，向sdio从设备发送写入指令，以按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；接着向sdio从设备发送读取指令，以从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；接着根据所述验证数据码，对所述目标伪随机码进行验证，在所述目标伪随机码验证成功时增大所述数据传输效率，重新执行上述各流程步骤，直至所述目标伪随机码验证失败为止，此时将上一次所述目标伪随机码验证成功时所对应的数据传输效率确定为所述sdio主设备的最大数据传输速率。上述方案中，本技术能利用目标伪随机码来测试sdio主设备支持的最大数据传输速率，利用较小的软硬件代价实现了sdio主从设备间的数据传输速率的测试及选择过程，同时也提升了sdio设备的传输效率。
106.请一并参见7，是本技术实施例提供的一种sdio主设备的结构示意图。如图7所示的sdio主设备70包括：至少一个处理器701、通信接口702、用户接口703和存储器704，处理器701、通信接口702、用户接口703和存储器704可通过总线或者其它方式连接，本发明实施例以通过总线705连接为例。其中，
107.处理器701可以是通用处理器，例如中央处理器(central processing unit，cpu)。
108.通信接口702可以为有线接口(例如以太网接口)或无线接口(例如蜂窝网络接口或使用无线局域网接口)，用于与其他终端或网站进行通信。本发明实施例中，通信接口702具体用于获取轨道参数。
109.用户接口703具体可为触控面板，包括触摸屏和触控屏，用于检测触控面板上的操作指令，用户接口703也可以是物理按键或者鼠标。用户接口703还可以为显示屏，用于输出、显示图像或数据。
110.存储器704可以包括易失性存储器(volatile memory)，例如随机存取存储器(random access memory，ram)；存储器也可以包括非易失性存储器(non-volatile memory)，例如只读存储器(read-only memory，rom)、快闪存储器(flash memory)、硬盘(hard disk drive，hdd)或固态硬盘(solid-state drive，ssd)；存储器704还可以包括上述种类的存储器的组合。存储器704用于存储一组程序代码，处理器701用于调用存储器704中存储的程序代码，执行如下操作：
111.s1、获取目标伪随机码；
112.s2、向sdio从设备发送写入指令，所述写入指令用于指示按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；
113.s3、向所述sdio从设备发送读取指令，并接收所述sdio设备返回的验证数据码，所述读取指令用于指示从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；
114.s4、根据所述验证数据码，对所述目标伪随机码进行验证；
115.s5、在所述目标伪随机码验证成功时，增大所述数据传输速率，重复执行上述步骤s2～s4，直至所述目标伪随机码验证失败为止，并将上一次所述目标伪随机码验证成功时所对应的数据传输速率，确定为所述sdio主设备的最大数据传输速率。
116.可选地，所述验证数据码为所述首位数据码，所述步骤s4具体包括：
117.调用所述sdio主设备中的伪随机码生成器，根据所述首位数据码生成对应的验证伪随机码；
118.对所述验证伪随机码和所述目标伪随机码进行验证。
119.可选地，所述步骤s4之前，所述处理器701还用于：
120.判断所述验证数据码是否与所述目标伪随机码中的首位数据码相同；
121.若是，则继续执行步骤s4。
122.可选地，所述步骤s1具体包括：
123.调用所述sdio主设备中的伪随机码生成器生成所述目标伪随机码。
124.可选地，所述写入指令具体用于按照预设的数据传输速率，将所述目标伪随机码写入sdio从设备的目标存储区域中；其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。
125.请一并参见8，是本技术实施例提供的一种sdio从设备的结构示意图。如图8所示的sdio从设备80包括：至少一个处理器801、通信接口802、用户接口803和存储器804，处理器801、通信接口802、用户接口803和存储器804可通过总线或者其它方式连接，本发明实施例以通过总线805连接为例。其中，关于处理器801、通信接口802、用户接口803及存储器804可对应参见图7中的相关介绍，这里不再赘述。所述存储器804用于存储一组程序代码，处理器801用于调用存储器804中存储的程序代码，执行如下操作：
126.响应于sdio主设备的写入指令，按照预设的数据传输速率将目标伪随机码写入至所述sdio从设备中；
127.响应于所述sdio主设备的读取指令，从所述sdio从设备中读取所述数据传输速率下的验证数据码，并将所述验证数据码返回给所述sdio主设备；
128.其中，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码，所述验证数据码和所述目标伪随机码均用于确定所述sdio主设备的最大数据传输速率。
129.可选地，所述按照预设的数据传输速率将目标伪随机码写入至所述sdio从设备中包括：
130.按照预设的数据传输速率，将所述目标伪随机码写入所述sdio从设备的目标存储区域中；
131.其中，所述目标存储区域为所述sdio从设备中支持存储所述目标伪随机码的任一存储区域，或者为所述sdio从设备中存储空间最大的存储区域。
132.由于本实施例所介绍的sdio主/从设备为实施本技术实施例中sdio设备传输速率的检测方法所采用的sdio主/从设备，故而基于本技术实施例中所介绍的方法，本领域所属技术人员能够了解本实施例的各设备的具体实施方式以及其各种变化形式，所以在此对于该设备如何实现本技术实施例中的方法不再详细介绍。只要本领域所属技术人员实施本技术实施例中sdio设备传输速率的检测方法所采用的相关设备，都属于本技术所欲保护的范围。
133.上述本技术实施例中的技术方案，至少具有如下的技术效果或优点：本技术通过获取目标伪随机码，向sdio从设备发送写入指令，以按照预设的数据传输速率将所述目标伪随机码写入sdio从设备中；接着向sdio从设备发送读取指令，以从所述sdio从设备中读取所述数据传输速率下的验证数据码，所述验证数据码为所述目标伪随机码，或者为所述目标伪随机码中存储于预设首地址的首位数据码；接着根据所述验证数据码，对所述目标伪随机码进行验证，在所述目标伪随机码验证成功时增大所述数据传输效率，重新执行上述各流程步骤，直至所述目标伪随机码验证失败为止，此时将上一次所述目标伪随机码验证成功时所对应的数据传输效率确定为所述sdio主设备的最大数据传输速率。上述方案中，本技术能利用目标伪随机码来测试sdio主设备支持的最大数据传输速率，利用较小的软硬件代价实现了sdio主从设备间的数据传输速率的测试及选择过程，同时也提升了sdio设备的传输效率。
134.本领域内的技术人员应明白，本发明的实施例可提供为方法、系统、或计算机程序产品。因此，本发明可采用完全硬件实施例、完全软件实施例、或结合软件和硬件方面的实施例的形式。而且，本发明可采用在一个或多个其中包含有计算机可用程序代码的计算机可用存储介质(包括但不限于磁盘存储器、cd-rom、光学存储器等)上实施的计算机程序产品的形式。
135.本发明是参照根据本发明实施例的方法、设备(系统)、和计算机程序产品的流程图和/或方框图来描述的。应理解可由计算机程序指令实现流程图和/或方框图中的每一流程和/或方框、以及流程图和/或方框图中的流程和/或方框的结合。可提供这些计算机程序指令到通用计算机、专用计算机、嵌入式处理机或其他可编程数据处理设备的处理器以产生一个机器，使得通过计算机或其他可编程数据处理设备的处理器执行的指令产生用于实现在流程图一个流程或多个流程和/或方框图一个方框或多个方框中指定的功能的装置。
136.这些计算机程序指令也可存储在能引导计算机或其他可编程数据处理设备以特定方式工作的计算机可读存储器中，使得存储在该计算机可读存储器中的指令产生包括指令装置的制造品，该指令装置实现在流程图一个流程或多个流程和/或方框图一个方框或多个方框中指定的功能。
137.这些计算机程序指令也可装载到计算机或其他可编程数据处理设备上，使得在计算机或其他可编程设备上执行一系列操作步骤以产生计算机实现的处理，从而在计算机或其他可编程设备上执行的指令提供用于实现在流程图一个流程或多个流程和/或方框图一
个方框或多个方框中指定的功能的步骤。
138.尽管已描述了本发明的优选实施例，但本领域内的技术人员一旦得知了基本创造性概念，则可对这些实施例作出另外的变更和修改。所以，所附权利要求意欲解释为包括优选实施例以及落入本发明范围的所有变更和修改。
139.显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。