专利名称：经由开关连接盘适配器和盘阵列的盘装置的制作方法
技术领域：
本发明涉及计算机系统中的二次存储装置，特别是涉及输入输出数据传送性能高的盘装置。
现有技术在现在的计算机系统中，CPU(中央处理装置)所需要的数据保存在二次存储装置中，根据CPU等需要时对二次存储装置进行数据的写入和读出。
作为此一二次存储装置，一般使用非易失存储媒体，作为典型者有磁盘、光盘等盘装置。
近年来随着高度信息化，在计算机系统中，要求这种二次存储装置的高性能化。
图9中示出现有技术的盘装置的方框图。
在图9中，盘装置由盘控制器DKC和盘阵列DA来构成。
盘控制器DKC由连接上位侧CPU(未画出)和盘装置的通道适配器CHA，暂时保存对盘阵列DA进行读写的数据的高速缓冲存储器CM，以及连接盘控制器DKC和盘阵列DA的盘适配器DKA组成。
通道适配器CHA和高速缓冲存储器CM和盘适配器DKA靠总线或开关相互连接。
通道适配器CHA靠C1、C2、C3、C4等4条通道与CPU连接。
盘适配器DKA靠D1、D2、D3、D4等4条通道与盘阵列连接。
这里盘阵列DA由盘组R1、R2、R3、R4组成。
在盘阵列DA中构筑RAID系统的场合，R1、R2、R3、R4分别构成RAID组。
从通道C1、C2、C3、C4所输入的写入数据在把该数据写入高速缓冲存储器CM的同时，把该数据以块为单位进行分割，把分割成块单位的数据通过通道D1、D2、D3、D4之内的3个通道，把根据前述分割数据计算的奇偶位通过其余1个通道，从盘适配器DKA向盘阵列DA发送。
在读出数据时，首先调查高速缓冲存储器CM内有没有合适的数据。
在有的场合，从高速缓冲存储器CM经由通道适配器CHA从高速缓冲存储器内读出数据向CPU发送。
在高速缓冲存储器CM内没有的场合，盘适配器DKA经由D1、D2、D3、D4从盘阵列DA读出分割成块单位的数据，经由通道适配器CHA把读出数据向CPU发送。把这种现有技术称为第1现有技术。
作为第1现有技术相关的盘装置，有例如日经BP公司刊物《日经计算机别册主机’98》(1998年)第144页至153页中所述的盘装置。
把盘适配器和盘阵列经由开关连接的盘装置，在特开平5-173722号的“多通道数据和奇偶位的交换装置”中公开了。
以下把该公报中所述的现有技术称为第2现有技术。
如果用第2现有技术，则与盘阵列相关的总线条数和与盘适配器相关的总线条数可以独立地设定。
把盘适配器和盘阵列经由缓冲控制块连接的盘装置，在特开平6-19627号的旋转型存储装置”中公开了。
以下把该公报中所述的现有技术称为第3现有技术。
如果用第3现有技术，则可以任意设定盘适配器与盘阵列间的数据传送速度，可以降低盘的旋转等待的影响。
发明内容
随着网络技术的进步，每1通道的数据传送速度年年增加。
例如盘装置中所使用的光纤通道中，虽然当前每个通道的数据传送速度为1Gbps到2Gbps，但是可以预计不远的将来向4Gbps到10Gbps高速化。
CPU与通道适配器间(以下称为前端)的吞吐量估计会跟上此一高速化。
可是，盘适配器与盘阵列间(以下称为后端)的吞吐量出于以下理由估计不会像前端那么高速化。
第1个理由是，由于盘驱动器包括机械零件，所以与仅电子元件、光元件容易进行高速化的前端相比高速化是困难的。
第2个理由是，例如即使盘驱动器高速化了，所有的盘驱动器每个都搭载高速接口，也招致有多个盘驱动器的盘装置的高成本化。
在第1现有技术中，存在着即使提高通道适配器的每个通道的数据传送速度，也因前端与后端的吞吐量背离，不能提高盘装置的性能这样的问题。
此外，虽然为了提高后端的吞吐量也可以考虑在盘适配器中设置多个低速端口，但是盘适配器的端口数增加使控制复杂。
在第2现有技术中，虽然通过在盘适配器与盘阵列之间运用开关可以增加盘增设端口数，但是由于每个通道的数据传送速度限制于盘阵列的数据传送速度，所以存在着盘适配器与盘阵列间的吞吐量成为性能瓶颈这样的问题。
第3现有技术是能够降低盘的旋转等待时间的影响的技术，存在着不能降低前端与后端的吞吐量背离这样的问题。
本发明的目的在于提供一种盘适配器与盘阵列间的吞吐量高的盘装置。
本发明的另一个目的在于提供一种盘适配器与盘阵列间的吞吐量高，且盘驱动器连接台数多的盘装置。
本发明的又一个目的在于提供一种有可靠性高的盘阵列的盘装置。
本发明的又一个目的在于提供一种有可靠性高的盘适配器与盘阵列间网络的盘装置。
本发明的又一个目的在于提供一种有可靠性和吞吐量高的盘适配器与盘阵列间网络的盘装置。
本发明的又一个目的在于提供一种能够使从盘的读出和向盘的写入高吞吐量化的盘装置。
本发明的又一个目的在于提供一种能够维持高吞吐量的盘装置。
本发明的又一个目的在于提供一种高吞吐量且低成本的盘装置。
为了实现上述目的，本发明是一种盘装置，由盘控制器和盘阵列组成，盘控制器包括通道适配器和高速缓冲存储器和盘适配器，经由有缓冲存储器的开关来连接盘适配器和盘阵列，把盘适配器与开关间的每个通道数据传送速度设定成高于开关与盘阵列间的每个通道数据传送速度，开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行盘适配器所连接的端口与构成盘阵列的盘驱动器所连接的各端口之间的端口间的连接切换。
此外，前述盘阵列由环状连接的多个盘驱动器组成，经由有缓冲存储器的开关来连接前述盘适配器和前述多个盘阵列，把盘适配器与开关间的每个通道数据传送速度设定成高于开关与多个盘阵列间的每个通道数据传送速度，开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行盘适配器所连接的端口与多个盘阵列所连接的各端口之间的端口间的连接切换。
此外，经由有缓冲存储器的开关来连接前述盘适配器和前述盘阵列，由连接于同一开关的盘驱动器的组合来构成RAID组，把盘适配器与开关间的每个通道数据传送速度设定成高于开关与盘阵列间的每个通道数据传送速度，开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行盘适配器所连接的端口与构成RAID组的盘驱动器所连接的各端口之间的端口间的连接切换。
此外，一种盘装置，由第1盘控制器和第2盘控制器和多个盘阵列组成，第1盘控制器包括第1通道适配器和第1高速缓冲存储器和第1盘适配器，第2盘控制器包括第2通道适配器和第2高速缓冲存储器和第2盘适配器，经由有缓冲存储器的第1开关来连接第1盘适配器和前述多个盘阵列，并且经由有缓冲存储器的第2开关来连接第2盘适配器和前述多个盘阵列，进而连接第1开关和第2盘适配器，连接第2开关和第1盘适配器，把第1盘适配器与第1开关间，和第2盘适配器与第1开关间的每个通道数据传送速度设定成高于第1开关与多个盘阵列间的每个通道数据传送速度，把第2盘适配器与第2开关间，和第1盘适配器与第2开关间的每个通道数据传送速度设定成高于第2开关与前述多个盘阵列间的每个通道数据传送速度，第1开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行第1盘适配器或第2盘适配器所连接的端口与前述多个盘驱动器所连接的各端口之间的端口间的连接切换，第2开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行第1盘适配器或第2盘适配器所连接的端口与前述多个盘驱动器所连接的各端口之间的端口间的连接切换。
此外，进而，经由具有与连接上述第1盘适配器和第2开关间的通道同等的数据传送速度的通道，和具有与连接第2盘适配器和第1开关间的通道同等的数据传送速度的通道来连接上述第1开关和第2开关。
此外，在从前述盘阵列的数据读出时，在前述开关中对从前述盘阵列传送到前述开关的数据进行多路化并向前述盘适配器传送，在向前述盘阵列的数据写入时，在前述开关中对从前述盘适配器传送到前述开关的数据进行去多路化并向前述盘阵列传送。
此外，在从前述盘适配器向前述盘阵列的数据写入时，前述盘适配器在送出的帧中设定发送目的地信息，以便周期地进行前述端口间的连接切换，在从前述盘阵列向前述盘适配器的数据读出时，前述开关通过轮转方式来切换前述端口间的连接。
此外，进而，把切换的端口数设定成与盘适配器和开关间的每个通道数据传送速度对开关和盘阵列间的每个通道数据传送速度之比同一程度。
此外，靠光纤缆来连接前述盘适配器与前述开关间，靠金属缆来连接前述开关与前述盘阵列间。
附图的简要说明
图1是表示本发明的第1实施例的盘装置的图。
图2是表示本发明中用的开关的构成的图。
图3是表示本发明中用的开关的构成的图。
图4是表示本发明中用的开关的动作的图。
图5是表示本发明中用的开关的动作的图。
图6是表示对本发明的第1实施例增设盘驱动器的方法的图。
图7是表示本发明的第2实施例的盘装置的图。
图8是表示本发明的第3实施例的盘装置的图。
图9是表示现有技术的盘装置的图。
图10是说明根据FC-AL的连接形态的图。
图11是说明根据FC-AL的连接形态的图。
图12是表示本发明的第4实施例的盘装置的图。
具体实施例方式
下面，参照附图详细说明本发明的实施例。
图1示出作为本发明的第1实施例的盘装置的构成。
本实施例的盘装置由盘控制器DKC和盘阵列DA组成。
盘控制器DKC由通道适配器CHA、高速缓冲存储器CM、和盘适配器DKA组成。
通道适配器CHA进行在上位CPU(未画出)和盘控制器DKC发送接收数据之际的控制。
C1、C2、C3和C4是通道适配器CHA与CPU通信的通道。
高速缓冲存储器CM是暂时保存本实施例的盘装置输入输出数据的存储器。
盘适配器DKA进行在盘控制器DKC和盘阵列DA发送接收数据之际的控制。
盘适配器DKA经由通道D01、D02、D03、D04与盘阵列DA连接。
盘适配器DKA和盘阵列DA能够在通道D01、D02、D03、D04上全二路复用通信。
这里，本实施例的盘装置，其特征在于，经由开关SW1、SW2、SW3、SW4来连接盘适配器DKA和盘阵列DA这一点。
盘阵列DA由盘组R1、R2、R3、R4组成。
盘组R1经由开关SW1与盘适配器DKA连接。
同样，盘组R2经由开关SW2，盘组R3经由开关SW3，盘组R4经由开关SW4分别与盘适配器DKA连接。
在本实施例的盘装置中，在构筑RAID系统的场合，分别把盘组R1、R2、R3、R4作为RAID组。
虽然在本实施例中，由4个盘驱动器来构成RAID组，但是构成RAID组的驱动器数不限于4个。
以盘组R1为例来描述向各盘组的数据读出或数据写入时的数据的流动。这里R1是RAID等级5的RAID组。
为了从通道C1、C2、C3、C4向盘组R1写入，从CPU所发送的数据在盘适配器DKA中分割成块单位，同时根据该分割成块单位的数据生成奇偶位。
该分割成块单位的数据和所生成的奇偶位通过通道D01输入到开关SW1。
开关SW1随着RAID控制而选择路径，把该分割成块单位的数据和所生成的奇偶位向通道D11、D12、D13、D14分配。
读出数据时，盘适配器DKA经由D11、D12、D13、D14从盘组R1读出分割成块单位的数据，靠开关SW1进行串行化，经由通道D01接收读出数据。
在图9中所示的现有技术的盘装置中，在连接于盘适配器DKA的通道D1、D2、D3、D4上，已经向盘阵列写入数据和奇偶位向各个通道分配。
与此相反，在本实施例的盘装置中，在通过开关SW1后向各个通道分配这一点上与现有技术不同。
接下来，以开关SW1为例来说明作为本实施例的盘装置的特征的开关的动作。SW2～SW4的动作也与SW1的动作相同。
如图1中所示，开关SW1有输入输出端口P1、P2、P3、P4、P5。
端口P1、P2、P3、P4、P5是能够全二路复用通信的输入输出端口，每个端口有缓冲存储器。
开关SW1的内部构成示于图2和图3。
为了简单，按数据的进行方向分别说明开关动作。
此外，通道D11、D12、D13、D14上流过的数据按帧单位发送接收，且数据按8B10B变换来编码。
图2示出从端口P1输入块内的帧，从端口P2、P3、P4、P5输出的场合。
这相当于向盘阵列写入时的开关动作。
开关SW1如图2中所示，由纵横开关XSW和开关控制器CTL组成。
纵横开关XSW是5×5的纵横开关，有输入端口in1、in2、in3、in4、in5，和输出端口out1、out2、out3、out4、out5。
从端口P1输入的帧经由串行并行变换装置SP1、缓冲存储器BM1、8B10B变换解码器DEC1，向开关控制器CTL和输入端口in1输入。
在开关控制器CTL中，解读写在输入帧的标题部分的发送目的地地址，切换纵横开关XSW。
例如，在端口P2选为输出目的地的场合，输入的帧经由输出端口out2、8B10B变换编码器ENC2、缓冲存储器BM2、并行串行变换装置PS2，从端口P2输出。
这里，缓冲存储器BM1、BM2是FIFO(先入先出)存储器。
串行并行变换装置SP1把8B10B编码的串行数据变换成10bit宽的并行数据，同步于端口P1中的数据传送速度的1/10的速度写入缓冲存储器BM1。
8B10B解码器DEC1同步于纵横开关XSW的动作速度从缓冲存储器BM1读出10bit并行数据，进行8B10B解码，变换成8bit并行数据。
8B10B编码器ENC2把由纵横开关XSW所切换的8bit并行数据再次进行8B10B编码，变换成10bit并行数据后，同步于纵横开关XSW的动作速度地写入缓冲存储器BM2。
并行串行变换装置PS2同步于端口P2中的数据传送速度的1/10的速度地从缓冲存储器BM2读出10bit并行数据，进行串行化，从端口P2输出。
通过以上，开关SW1从端口P1中的数据传送速度向端口P2中的数据传送速度进行速度变换。
图4是表示输入到端口P1的帧，和从端口P2、P3、P4、P5所输出的帧的图。
波形的凸表示帧存在的时间，凹表示帧不存在的时间。
虽然帧随着传送的数据容量其帧长变化，但是这里进行对盘阵列的顺序访问，帧长是恒定的。
在图4中，输入端口P1处的数据传送速度为输出端口P2、P3、P4、P5中的数据传送速度的m倍。
因而，端口P1中的帧Fb2的时间T1在从端口P2输出时延长为T3。
这里，T3＝m×T1。
在输入的数据传送速度快，而且输出的数据传送速度慢的场合，如果不周期地切换开关，则输出端口的缓冲存储器溢出，吞吐量降低。
为要帧没有吞吐量降低地通过开关，有必要像图4那样周期地切换输出端口。
如令开关切换端口数为n，则开关切换周期为T2≈n×T1(没有帧的时间忽略不计)。
如果T2≥T3，则没有帧的冲突，不引起吞吐量的降低。
T2≥T3等同于n≥m。
也就是说，向盘阵列写入数据时，在开关中不引起吞吐量降低用的条件是把周期地切换的开关端口数n设定成超过盘适配器与开关间的每个通道数据传送速度对开关与盘阵列间的每个通道数据传送速度之比m。
如果保持此一条件，则开关SW1在缓冲存储器中对从端口P1输入的数据进行速度变换，通过按帧单位周期地切换来进行去多路化，向端口P2、P3、P4、P5分配而输出。
周期地切换开关的方法之一是把连接于开关的盘组取为RAID组。
根据RAID的条状控制，则开关周期地切换。
图3示出从端口P2、P3、P4、P5输入帧，从端口P1输出的场合。
这相当于从盘阵列读出时的开关动作。
例如，从端口P2输入的帧经由串行并行变换装置SP2、缓冲存储器BM2、8B10B变换解码器DEC2，向开关控制器CTL和输入端口in2输入。
在开关控制器CTL中解读写在输入帧的标题部分的发送目的地地址，切换纵横开关XSW。
在图3的场合，按轮转方式切换纵横开关XSW，依次从端口P2、P3、P4、P5所输入的数据全都向端口P1输出。也就是说，在读出时，帧同时到达多个输入端口(P2、P3、P4、P5)。这些多个输入帧没有必要同步到达输入端口。开关通过循环地切换输入输出端口间连接逐帧地向输出端口(P1)传送这些多个输入帧。把像这样循环地切换开关的方式称为轮转(Round Robin)方式。按轮转方式，最终成为周期地切换开关。再者，在读出时开关一定按帧内发送目的地信息来切换。
帧经由输出端口out1、8B10B变换编码器ENC1、缓冲存储器BM1、并行串行变换装置PS1，从端口P1输出。
串行并行变换装置SP2把8B10B编码了的串行数据变换成10bit宽的并行数据，同步于端口P2中的数据传送速度的1/10的速度地写入缓冲存储器BM2。
8B10B解码器DEC2同步于纵横开关XSW的动作速度地，从缓冲存储器BM2读出10bit并行数据，进行8B10B解码，变换成8bit并行数据。
8B10B编码器ENC1对靠纵横开关XSW切换的8bit并行数据再次进行8B10B编码，变换成10bit并行数据后，同步于纵横开关XSW的动作速度地写入缓冲存储器BM1。
并行串行变换装置PS1同步于端口P1中的数据传送速度的1/10的速度地，从缓冲存储器BM1读出10bit并行数据，进行串行化，从端口P1输出。
通过以上，开关SW1从端口P2中的数据传送速度向端口P1中的数据传送速度进行速度变换。
图5是表示向端口P2、P3、P4、P5输入的帧，和从端口P1输出的帧的图。
波形的凸表示帧存在的时间，凹表示帧不存在的时间。
虽然帧随着传送的数据容量其帧长变化，但是这里进行对盘阵列的顺序访问，帧长是恒定的。
在图5中，输入端口P1处的数据传送速度为输出端口P2、P3、P4、P5中的数据传送速度的m倍。
因而，端口P5中的帧Fe5的时间T4在从端口P1输出时缩短为T5。
这里，T4＝m×T5。
令从端口P1输出帧Fe2、Fe3、Fe4、Fe5所需的时间为T6。
如令开关切换端口数为n，则T6≈n×T5(没有帧的时间忽略不计)。
在开关中为了防止凑在一起引起的吞吐量降低，有必要使T6≤T4。T6≤T4等同于n≤m。
也就是说，在从盘阵列读出数据时，在开关中不引起吞吐量降低的条件是把周期地切换的开关端口数n设定成不大于于盘适配器与开关间的每个通道数据传送速度对开关与盘阵列间的每个通道数据传送速度之比m。
如果保持此一条件，则开关SW1在缓冲存储器中对从端口P2、P3、P4、P5输入的数据进行速度变换，通过按帧单位周期地切换来进行多路化，向端口P1输出。
由此说明了为了把向盘阵列的写入和从盘阵列的读出高吞吐量化，使n≈m，也就是，把周期地切换的端口数设定成盘适配器与开关间的每个通道数据传送速度对开关与盘阵列间的每个通道数据传送速度之比同一程度就可以了。
例如，盘适配器与开关间用4Gbps的1条通道连接，开关与盘阵列间用1Gbps的4条通道连接。
此外，盘适配器与开关间用10Gbps的1条通道连接，开关与盘阵列间用2Gbps的4条通道连接。
在此一场合，由于在开关输入输出端口间没有取吞吐量的平衡，所以实际吞吐量为2Gbps×4＝8Gbps。
根据以上，由于在开关SW1中进行速度变换和多路化、去多路化，所以即使通道D11、D12、D13、D14上的数据传送速度为低速，通道D01、D02、D03、D04上的数据传送速度也可以高速。
也就是说，盘适配器DKA与盘阵列DA间的吞吐量可以提高。
作为本实施例的盘装置中的数据传送方式，可以使用光纤通道或无限带宽(InfiniBand)。
图6是表示在第1实施例的盘装置中，盘驱动器的增设方法的图。
在图6中相对于图1增设了盘驱动器R5和R6。
为了增设盘驱动器，作为开关SW1和SW2使用端口数多的开关。
如果增设盘驱动器，则由于开关的盘阵列一侧的吞吐量增加，与盘适配器一侧的吞吐量平衡被打破，所以存在着不能有效地发挥开关的速度变换功能的可能性。
因此在开关SW1中，在与盘适配器DKA之间，增设新的通道D05。
此外，在开关SW2的场合不增设新的通道，而是增加通道D02的信号传送速度，借此取盘适配器一侧与盘阵列一侧的吞吐量平衡。
例如在开关SW1中，开关与盘阵列间用1Gbps的8条通道连接，盘适配器与开关间用4 Gbps的2条通道连接。
在开关SW2中，开关与盘适配器间用1Gbps的8条通道连接，盘适配器与开关间用10Gbps的1条通道连接。
这样一来，本实施例的盘装置根据开关的端口数来增设盘驱动器是可能的。
此一盘驱动器增设方法可以运用于增设能够连接于每个端口的驱动器数少的ATA(AT连接)方式盘驱动器。
图7中示出作为本发明的第2实施例的盘装置的构成。
本实施例的盘装置相对于第1实施例的盘装置，盘阵列部分的构成方法不同。
本实施例的盘装置由盘控制器DKC和4个盘阵列DA1、DA2、DA3、DA4组成。
盘控制器DKC由通道适配器CHA、高速缓冲存储器CM、盘适配器DKA组成。
盘阵列DA1与盘适配器DKA经由通道D01和开关SW1连接。
同样，盘阵列DA2经由通道D02和开关SW2，盘阵列DA3经由通道D03和开关SW3，盘阵列DA4经由通道D04和开关SW4，分别与盘适配器DKA连接。
开关SW1、SW2、SW3、SW4与第1实施例同样作为进行速度变换和多路化、去多路化的开关发挥功能。
本实施例中的盘适配器DKA，开关SW1、SW2、SW3、SW4，和盘阵列DA1、DA2、DA3、DA4之间的数据传送方式使用光纤通道。
开关SW1、SW2、SW3、SW4是光纤通道开关。
以盘阵列DA1为例来描述本实施例中的盘阵列的构成。
盘阵列DA1、DA2、DA3、DA4是同样的驱动器构成。
盘阵列DA1由连接于通道D11上的4个盘组成的盘阵列，连接于通道D12上的4个盘组成的盘阵列，连接于通道D13上的4个盘组成的盘阵列，以及连接于通道D14上的4个盘组成的盘阵列，组成。
以通道D11为例，盘驱动器DK1、DK2、DK3、DK4连接于通道D11上。
作为像这样把多个驱动器连接于一个通道上而访问盘驱动器的方法有光纤通道仲裁环(以下称为FC-AL)。
图10中以盘驱动器DK1、DK2、DK3、DK4的连接形态为例示出FC-AL的连接形态。
各盘驱动器的输入输出端口和开关SW1的输入输出端口有发送机Tx和接收机Rx。
FC-AL的连接形态例如如图10中所示，是把各驱动器的输入输出端口和开关的输入输出端口环状连接的结构。
各驱动器的输入输出端口作为光纤通道的NL(节点环)端口发挥功能。
所谓NL端口是进行环动作的装置(这里是盘驱动器)的端口。
开关SW1的盘阵列DA1连接侧输入输出端口作为光纤通道的FL(结构环)端口发挥功能。
所谓FL端口是能够连接FC-AL的开关的端口。
由于有FL端口的环作为光纤通道的混合环发挥功能，所以通道D11形成的FC-AL成为混合环。
所谓混合环是环上的盘驱动器能够经由开关与环外的端口通信的环。
由此，盘驱动器DK1、DK2、DK3、DK4能够经由开关SW1和通道D01与盘适配器DKA通信。
虽然以上以通道D11的连接形态为例进行了说明，但是通道D12、D13、D14也是同样的。
在本实施例的盘装置中在构筑RAID系统的场合，分别以盘组R1、R2、R3、R4作为RAID组。虽然在本实施例中，由4个盘驱动器构成RAID组，但是构成RAID组的驱动器数不限于4个。
在本实施例中，在通道D11、D12、D13、D14中分别用FC-AL来连接盘驱动器。
根据FC-AL的规格，在通道D11、D12、D13、D14上可以分别连接最多到126台盘驱动器。
此外，作为通道D01、D02、D03、D04的媒体用光纤缆，作为通道D11、D12、D13、D14的媒体用金属缆。
像以上说明的这样，在本实施例的盘装置中，由于用FC-AL来连接盘驱动器，所以能够连接于开关的每个端口的驱动器台数可以增加。
也就是说，具有使每个盘装置的存储容量增加的效果。
此外，由于通过用金属缆来连接盘驱动器，没有必要在每个盘驱动器上装备高价的光纤接口，所以具有降低盘驱动器成本的效果。
图8中示出作为本发明的第3实施例的盘装置的构成。
本实施例的盘装置，其特征在于对盘控制器和开关进行二路复用这一点。
在本实施例中，盘适配器DKA1、DKA2，开关SW1、SW2，与盘阵列DA1之间的数据传送方式使用光纤通道。
本实施例的盘装置由盘控制器DKC1、DKC2，开关SW1、SW2，以及盘阵列DA1组成。
开关SW1和SW2与第1实施例同样作为进行速度变换和多路化、去多路化的开关发挥功能。
盘控制器DKC1由通道适配器CHA1、高速缓冲存储器CM1、和盘适配器DKA1组成。
盘控制器DKC2由通道适配器CHA2、高速缓冲存储器CM2、和盘适配器DKA2组成。
盘适配器DKA1和开关SW1靠通道D1a来连接，盘适配器DKA2和开关SW2靠通道D2a来连接，盘适配器DKA1和开关SW2靠通道D1b来连接，盘适配器DKA2和开关SW1靠通道D2b来连接。
构成盘阵列DA1的盘驱动器有2个输入输出端口。
例如，盘驱动器DK1、DK2、DK3、DK4与通道D11和D21两个通道连接。
盘阵列DA1由连接于通道D11和D21的4个盘组成的盘阵列，连接于通道D12和D22的4个盘组成的盘阵列，连接于通道D13和D23的4个盘组成的盘阵列，以及连接于通道D14和D24的4个盘组成的盘阵列，组成。
通道D11、D12、D13、D14、D21、D22、D23、D24靠FC-AL来连接盘驱动器。
图11中以盘驱动器DK1、DK2、DK3、DK4的连接形态为例示出本实施例中的FC-AL的连接形态。
各盘驱动器分别有2个NL端口。
各盘驱动器的输入输出端口和开关SW1、SW2的输入输出端口有发送机Tx和接收机Rx。
开关SW1、SW2的盘阵列DA1连接侧输入输出端口是FL端口。
靠通道D11把开关SW1，盘驱动器DK1、DK2、DK3、DK4环状连接。
同样，靠通道D21把开关SW2，盘驱动器DK1、DK2、DK3、DK4环状连接。
这两个环是光纤通道的混合环，盘驱动器DK1、DK2、DK3、DK4可以经由开关SW1或SW2与盘适配器DKA1或DKA2通信。
虽然以上以通道D11、D21的连接形态为例进行了说明，但是通道D12、D13、D14、D22、D23、D24也是同样的。
在本实施例的盘装置中在构筑RAID系统的场合，分别以盘组R1、R2、R3、R4作为RAID组。虽然在本实施例中，由4个盘驱动器来构成RAID组，但是构成RAID组的驱动器数不限于4个。
盘阵列DA1内的所有盘驱动器都可以从盘适配器DKA1和DKA2的某一个来访问。
本实施例的盘装置把通道D1b、D2b作为开关SW1、SW2出故障时的迂回路径来使用。
例如即使在开关SW1出故障的场合，盘适配器DK1也可以经由通道D1b和开关SW2来访问盘阵列DA1。
相反，由于在开关SW2出故障的场合，盘适配器DKA2可以经由通道D2b和开关SW1来访问盘阵列DA1，所以可以实现可靠性高的盘装置。
图12中示出作为本发明的第4实施例的盘装置的构成。
在本实施例的盘装置中，相对于第3实施例的盘装置，其特征在于设置连接开关SW1、SW2的通道D3a、D3b这一点。
在本实施例中，盘适配器DKA1、DKA2，开关SW1、SW2，和盘阵列DA1之间的数据传送方式使用光纤通道。
本实施例的盘装置由盘控制器DKC1、DKC2，开关SW1、SW2，以及盘阵列DA1组成。
开关SW1和SW2与第1实施例同样作为进行速度变换和多路化、去多路化的开关发挥功能。
盘控制器DKC1由通道适配器CHA1、高速缓冲存储器CM1、和盘适配器DKA1组成。
盘控制器DKC2由通道适配器CHA2、高速缓冲存储器CM2、和盘适配器DKA2组成。
盘适配器DKA1和开关SW1靠通道D1a来连接，盘适配器DKA2和开关SW2靠通道D2a来连接，盘适配器DKA1和开关SW2靠通道D1b来连接，盘适配器DKA2和开关SW1靠D2b来连接。
进而，开关SW1和SW2靠通道D3a、D3b来连接。
构成盘阵列DA1的盘驱动器有2个输入输出端口。
例如，盘驱动器DK1、DK2、DK3、DK4与通道D11和D21两个通道连接。
盘阵列DA1由连接于通道D11和D21的4个盘组成的盘阵列，连接于通道D12和D22的4个盘组成的盘阵列，连接于通道D13和D23的4个盘组成的盘阵列，以及连接于通道D14和D24的4个盘组成的盘阵列，组成。
通道D11、D12、D13、D14、D21、D22、D23、D24如图11中所示靠FC-AL来连接盘驱动器。
盘阵列DA1内的所有盘驱动器都可以从盘适配器DKA1和DKA2的某一个来访问。
在本实施例的盘装置中在构筑RAID系统的场合，分别以盘组R1、R2、R3、R4作为RAID组。虽然在本实施例中，由4个盘驱动器来构成RAID组，但是构成RAID组的驱动器数不限于4个。
关于盘适配器DKA1、DKA2与盘阵列DA1的访问路径，首先就定常时(开关未出故障的场合)进行说明。
盘适配器DKA1有经由通道D1a和开关SW1访问盘阵列DA1的路径(路径1)，和经由通道D1b和开关SW2和通道D3a和开关SW1访问盘阵列DA1的路径(路径2)。
同样，盘适配器DKA2有经由通道D2a和开关SW2访问盘阵列DA1的路径(路径3)，和经由通道D2b和开关SW1和通道D3b和开关SW2访问盘阵列DA1的路径(路径4)。
另一方面，在开关出故障时，把通道D1b、D2b作为迂回路径来使用。
例如即使在开关SW1出故障的场合，盘适配器DKA1也可以经由通道D1b和开关SW2来访问盘阵列DA1。
相反，在开关SW2出故障的场合，盘适配器DKA2可以经由通道D2b和开关SW1来访问盘阵列DA1。
接下来，就本实施例中的盘适配器-盘阵列间的吞吐量进行说明。
例如，令通道D1a、D1b、D2a、D2b、D3a、D3b上的数据传送速度为每个通道2Gbps，令通道D11、D12、D13、D14、D21、D22、D23、D24上的数据传送速度为每个通道1Gbps。
此时，开关SW1与盘阵列DA1间的总吞吐量为4Gbps。
盘适配器DKA1与开关SW1间，通过靠上述路径1和路径2来访问，总吞吐量成为4Gbps。
由于开关SW1的盘适配器DKA1一侧，和盘阵列DA1一侧的吞吐量共计为4Gbps，所以盘适配器DKA1与盘阵列DA1间的吞吐量成为4Gbps。
同样，开关SW2与盘阵列DA1间的总吞吐量为4Gbps。
盘适配器DKA2与开关SW2间，通过靠上述路径3和路径4来访问，总吞吐量成为4Gbps。
由于开关SW2的盘适配器DKA2一侧，和盘阵列DA1一侧的吞吐量共计为4Gbps，所以盘适配器DKA2与盘阵列DA1间的吞吐量成为4Gbps。
在第3实施例(图8)中，如果运用上述每个通道吞吐量值，则由于把通道D1a、D1b仅作为出故障时的迂回路径使用，所以盘适配器DKA1与盘阵列DA1间的吞吐量限制于通道D1a上的吞吐量，成为2Gbps。
同样，盘适配器DKA2与盘阵列DA1间的吞吐量限制于通道D2a上的吞吐量，成为2Gbps。
在第3实施例中，为了把盘适配器-盘阵列间吞吐量弄成4Gbps，有必要分别把通道D1a和D2a的数据传送速度提高到4Gbps。
根据以上，如果用本实施例，则即使盘适配器-开关间的每个通道数据传送速度低，也可以实现盘适配器-盘阵列间的总吞吐量高的盘装置。
像以上说明的这样，如果用本发明则有以下效果。
可以提供一种盘适配器与盘阵列间的吞吐量高的盘装置。
此外，可以提供一种盘适配器与盘阵列间的吞吐量高，且盘驱动器连接台数多的盘装置。
此外，可以提供一种有可靠性高的盘阵列的盘装置。
此外，可以提供一种有可靠性高的盘适配器与盘阵列间网络的盘装置。
此外，可以提供一种有可靠性和吞吐量高的盘适配器与盘阵列间网络的盘装置。
此外，可以提供一种能够使从盘的读出和向盘的写入高吞吐量化的盘装置。
此外，可以提供一种能够维持高吞吐量的盘装置。
此外，可以提供一种盘适配器与盘阵列间的吞吐量高而成本低的盘装置。
权利要求
1.一种盘装置，由盘控制器和盘阵列组成，前述盘控制器包括通道适配器和高速缓冲存储器以及盘适配器，其特征在于，其中经由具有缓冲存储器的开关来连接前述盘适配器和前述盘阵列，前述开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行前述盘适配器所连接的端口与构成前述盘阵列的盘驱动器所连接的各端口之间的端口间连接切换。
2.一种盘装置，由盘控制器和多个盘阵列组成，前述盘控制器包括通道适配器和高速缓冲存储器以及盘适配器，其特征在于，其中前述盘阵列由环状连接的多个盘驱动器组成，经由具有缓冲存储器的开关来连接前述盘适配器和前述多个盘阵列，把前述盘适配器与前述开关间的每个通道数据传送速度设定成高于前述开关与前述多个盘阵列间的每个通道数据传送速度，前述开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行前述盘适配器所连接的端口与前述多个盘阵列所连接的各端口之间的端口间连接切换。
3.一种盘装置，由盘控制器和盘阵列组成，前述盘控制器包括通道适配器和高速缓冲存储器以及盘适配器，其特征在于，其中经由具有缓冲存储器的开关来连接前述盘适配器和前述盘阵列，由连接于同一开关的盘驱动器的组合来构成RAID组，把前述盘适配器与前述开关间的每个通道数据传送速度设定成高于前述开关与前述盘阵列间的每个通道数据传送速度，前述开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行前述盘适配器所连接的端口与前述构成前述RAID组的盘驱动器所连接的各端口之间的端口间连接切换。
4.一种盘装置，由第1盘控制器和第2盘控制器和多个盘阵列组成，第1盘控制器包括第1通道适配器和第1高速缓冲存储器和第1盘适配器，第2盘控制器包括第2通道适配器和第2高速缓冲存储器和第2盘适配器，其特征在于，其中经由具有缓冲存储器的第1开关来连接第1盘适配器和前述多个盘阵列，并且经由具有缓冲存储器的第2开关来连接第2盘适配器和前述多个盘阵列，进而连接第1开关和第2盘适配器，连接第2开关和第1盘适配器，把第1盘适配器与第1开关间，和第2盘适配器与第1开关间的每个通道数据传送速度设定成高于第1开关与前述多个盘阵列间的每个通道数据传送速度，把第2盘适配器与第2开关间，和第1盘适配器与第2开关间的每个通道数据传送速度设定成高于第2开关与前述多个盘阵列间的每个通道数据传送速度，第1开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行第1盘适配器或第2盘适配器所连接的端口与前述多个盘驱动器所连接的各端口之间的端口间连接切换，第2开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行第1盘适配器或第2盘适配器所连接的端口与前述多个盘驱动器所连接的各端口之间的端口间连接切换。
5.一种盘装置，由第1盘控制器和第2盘控制器和多个盘阵列组成，第1盘控制器包括第1通道适配器和第1高速缓冲存储器和第1盘适配器，第2盘控制器包括第2通道适配器和第2高速缓冲存储器和第2盘适配器，其特征在于，其中经由具有缓冲存储器的第1开关来连接第1盘适配器和前述多个盘阵列，并且经由具有缓冲存储器的第2开关来连接第2盘适配器和前述多个盘阵列，进而连接第1开关和第2盘适配器，连接第2开关和第1盘适配器，把第1盘适配器与第1开关间，和第2盘适配器与第1开关间的每个通道数据传送速度设定成高于第1开关与前述多个盘阵列间的每个通道数据传送速度，把第2盘适配器与第2开关间，和第1盘适配器与第2开关间的每个通道数据传送速度设定成高于第2开关与前述多个盘阵列间的每个通道数据传送速度，经由具有与连接第1盘适配器和第2开关间的通道同等的数据传送速度的通道，和具有与连接第2盘适配器和第1开关间的通道同等的数据传送速度的通道来连接第1开关和第2开关，第1开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行第1盘适配器或第2盘适配器或第2开关所连接的端口与前述多个盘驱动器所连接的各端口之间的端口间连接切换，第2开关针对所输入的每一帧，按照该帧内的发送目的地信息来进行第1盘适配器或第2盘适配器或第1开关所连接的端口与前述多个盘驱动器所连接的各端口之间的端口间连接切换。
6.权利要求1至权利要求5中的任何一项所述的盘装置，其特征在于，其中在从前述盘阵列读出数据时，在前述开关中对从前述盘阵列传送到前述开关的数据进行多路化并向前述盘适配器传送，在向前述盘阵列写入数据时，在前述开关中对从前述盘适配器传送到前述开关的数据进行去多路化并向前述盘阵列传送。
7.权利要求1至权利要求5中的任何一项所述的盘装置，其特征在于，其中在从盘适配器向盘阵列写入数据时，前述盘适配器在送出的帧中设定发送目的地信息，以便周期地进行前述端口间的连接切换，在从盘阵列向盘适配器读出数据时，前述开关通过轮转方式来切换前述端口间的连接。
8.权利要求7所述的盘装置，其特征在于，其中把周期地切换的端口数设定成与盘适配器和开关间的每个通道数据传送速度对开关和盘阵列间的每个通道数据传送速度之比为同一程度。
9.权利要求1至权利要求5中的任何一项所述的盘装置，其特征在于，其中用光纤缆来连接前述盘适配器与前述开关间，用金属缆来连接前述开关与前述盘阵列间。
全文摘要
本发明提供经由开关连接盘适配器和盘阵列的盘装置，以提供一种盘控制器的盘适配器与盘阵列间的吞吐量高的盘装置。经由开关(SW1、SW2、SW3、SW4)连接盘控制器(DKC)的盘适配器(DKA)与盘阵列(DA)。在开关(SW1)中对开关(SW1)与RAID组(R1)间的通道(D11、D12、D13、D14)上的数据进行多路化并传送到开关(SW1)与盘适配器(DKA)间的通道(D01)，在开关(SW1)中对开关(SW1)与盘适配器(DKA)间的通道(D01)上的数据进行去多路化并传送到开关(SW1)与RAID组(R1)间的通道(D11、D12、D13、D14)。把盘适配器(DKA)与开关(SW1)间的通道(D01)上的数据传送速度取为高于通道(D11、D12、D13、D14)的数据传送速度。
文档编号G06F12/00GK1450443SQ02141918
公开日2003年10月22日 申请日期2002年8月27日 优先权日2002年4月9日
发明者田中勝也, 藤本和久 申请人:株式会社日立制作所