一种调试fpga预加重均衡的方法
【专利摘要】本发明公开了一种调试FPGA预加重均衡的方法，在研发设计FPGA阶段，设计FPGA验证板，板内处理器到FPGA之间，采用新型高速互联总线，处理器板同FPGA板采用正交方式连接，板边设置互联传输通道的S参数测试接口，获得真实的互联参数，通过网络分析仪测得通道的S参数，通过误码率分析仪对此通道S参数进行预加重的预测，遍历出针对此参数的最佳预加重值，固定一端的预加重，再确定接收端的CTLE值。本发明的方法是设计FPGA验证板，调试预加重均衡值很好的方法，是基于实际链路测试方法。这样通道的预加重均衡设置都在基于真实测试的情况下得出。
【专利说明】—种调试FPGA预加重均衡的方法
【技术领域】
[0001]本发明涉及本发明涉及电子领域，芯片设计及仿真测试领域，具体涉及一种调试FPGA预加重均衡的方法。
技术背景
[0002]随着信号速率的提高，信号质量在信号有效传输中所占的位置越来越重要。对于信号传输过程中无法避免的反射以及随着频率增高而增大的介质损耗，传输线损耗带来的信号失真问题，成为高速串行链路以及芯片设计所必须面对的棘手问题。
[0003]随着信号的传输速度越来越快，系统设计已经向25G方向发展。而高速串行链路传输最大的障碍是互联通道损耗的频率依赖性，随着频率增高，损耗也增加，信号正确传输到接收端成为一种挑战。所以需要通过均衡机制来增强信号传输能力。
[0004]现在一般常用的高速串行总线有PCIE，QPI, SATA, SAS, QDR, FDR等，信号速率高达14Ghz以上。芯片通过PCB传输线互连，传输路径上有反射和随着频率而增大的导体损耗，介质损耗带来的上升边退化和幅值降低，如果这样的信号到达接收端，接收机不能正确恢复，必然造成信号失真。所以需要发送接收端对信号进行一定处理，来增强信号传输能力。目前的高速串行总线都会在发送端做预加重，接收端做均衡机制，来提高信号传输能力。
[0005]在设计芯片时需要在芯片的IO部分设计发送端预加重，接收端均衡机制，尽量给板级设计中无法避免的损耗留有尽可能多的余量。所以需要通过初期研发FPGA阶段进行仿真测试，来了解芯片实际工作中的均衡能力，以便后期流片时给予芯片应用厂家PCB设计的规则，让其了解芯片的驱动能力，给予板级设计留有多大的设计余量。
【发明内容】
[0006]本发明要解决的技术问题是:提供一种调试FPGA预加重均衡的方法。
[0007]本发明所采用的技术方案为:
一种调试FPGA预加重均衡的方法，在研发设计FPGA阶段，设计FPGA验证板，板内处理器到FPGA之间，采用新型高速互联总线，处理器板同FPGA板采用正交方式连接，板边需设置互联传输通道的S参数测试接口，获得真实的互联参数，通过网络分析仪测得通道的S参数，通过误码率分析仪对此通道S参数进行预加重的预测，遍历出针对此参数的最佳预加重值，固定一端的预加重，再确定接收端的CTLE值。
[0008]这样通道的预加重均衡设置都在基于真实测试的情况下得出。
[0009]所述互联总线是一种新型的高速串行总线，总线传输速率为8Gbps。
[0010]处理器同FPGA之间通过跨板互联，PCB传输长度为15inch，路径经过一个高速正交连接器以及两个BGA下的过孔，总传输损耗约为8.5dB。
[0011]在设计FPGA板时仿照互联之间真实的走线情况在板边设计测试链路。
[0012]注:FPGA(Field — Programmable Gate Array),即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。
[0013]本发明的有益效果为:
本发明是一种基于实测的预加重均衡参数的调试方法。随着信号速率的提高，信号质量在信号有效传输中所占的位置越来越重要。对于信号传输过程中无法避免的反射以及随着频率增高而增大的介质损耗，传输线损耗带来的信号失真问题，成为高速串行链路以及芯片设计所必须面对的棘手问题。在设计芯片时需要在芯片的IO部分设计发送端预加重，接收端均衡机制，尽量给板级设计中无法避免的损耗留有尽可能多的余量。所以需要通过初期研发FPGA阶段进行仿真测试，来了解芯片实际工作中的均衡能力，以便后期流片时给予芯片应用厂家PCB设计的规则，让其了解芯片的驱动能力，给予板级设计留有多大的设计余量。
[0014]本发明的方法是设计FPGA验证板，调试预加重均衡值很好的方法，是基于实际链路测试方法。这样通道的预加重均衡设置都在基于真实测试的情况下得出。
【专利附图】
【附图说明】
[0015]图1为本发明总线拓扑结构图；
图2为本发明预加重均衡之间相互关系；
图3为误码仪基于实际链路S参数进行遍历，补偿通道损耗。
【具体实施方式】
[0016]下面参照附图，通过【具体实施方式】对本发明进一步说明:
在研发设计FPGA阶段，需设计FPGA验证板。总线拓扑为处理器与FPGA之间互联，互联总线是一种新型的高速串行总线，总线传输速率为8Gbps.处理器同FPGA之间通过跨板互联，PCB传输长度为15inch，路径经过一个高速正交连接器以及两个BGA下的过孔，总传输损耗约为8.5dB，链路拓扑如图1所示。
[0017]以FPGA为发送端，处理器为接收端为例。FPGA端TXLE，处理器端CTLE，DFE与通道之间拓扑关系如图2所示。
[0018]FPGA发送是端是三阶预加重，调节PRE-C0URE和P0ST-C0URE值有上千个组合，无法手动尝试调节，通过软件仿真做参数遍历毕竟同实际链路有差异。所以发明一种针对FPGA链路预加重均衡调试较为简易准确的方法。
[0019]在设计FPGA板时仿照互联之间真实的走线情况在板边设计测试链路，使用网络分析仪测试互联系统的S参数。将此测试得到的S参数导入误码率分析仪中，误码率分析仪会基于此通道S参数，进行FPGA预加重的遍历，这样得出一个更为客观的预加重值，如附图3所示，将互联的频率依赖性进行有效的补偿。
[0020]确定了发送端的预加重，再调整接收端的CTLE的值。通过接收端连接示波器，调整CTLE的值，因为此值选择范围小，可以通过经验来判断哪个值更为合适，当示波器出现较为理想的眼图时，就可以确定此组TXLE, CTLE同自适应的DFE是基于此链路下的最佳组合，获得通道最佳接收眼图。
[0021]联通路径相近通道可以设置统一 TXLE，CTLE值，对于差距较大的路径，继续按照此方法寻找预加重，均衡值。
[0022]此种方法是设计FPGA验证板，调试预加重均衡值很好的方法，是基于实际链路测试方法。
【权利要求】
1.一种调试FPGA预加重均衡的方法，其特征在于:在研发设计FPGA阶段，设计FPGA验证板，板内处理器到FPGA之间，采用新型高速互联总线，处理器板同FPGA板采用正交方式连接，板边设置互联传输通道的S参数测试接口，获得真实的互联参数，通过网络分析仪测得通道的S参数，通过误码率分析仪对此通道S参数进行预加重的预测，遍历出针对此参数的最佳预加重值，固定一端的预加重，再确定接收端的CTLE值。
2.根据权利要求1所述的一种调试FPGA预加重均衡的方法，其特征在于:所述互联总线是一种新型的高速串行总线，总线传输速率为8Gbps。
3.根据权利要求1所述的一种调试FPGA预加重均衡的方法，其特征在于:处理器同FPGA之间通过跨板互联，PCB传输长度为15inch，路径经过一个高速正交连接器以及两个BGA下的过孔,总传输损耗约为8.5dB。
4.根据权利要求1所述的一种调试FPGA预加重均衡的方法，其特征在于:在设计FPGA板时仿照互联之间真实的走线情况在板边设计测试链路。
【文档编号】G06F13/38GK103970699SQ201410225340
【公开日】2014年8月6日 申请日期:2014年5月23日 优先权日:2014年5月23日
【发明者】王素华 申请人:浪潮电子信息产业股份有限公司