一种实现待验证芯片互联的方法和装置制造方法
【专利摘要】本发明公开了一种实现待验证芯片互联的方法和装置，包括根据芯片间通信的信息的格式，分析通过PLI接口获得的多个信号中的信息，得到分析结果；根据预先设定的配置信息，在通过PLI接口获得的多个信号中注入延时和错误，并通过PLI接口发送经注入处理后的信号；根据分析结果和注入延时和错误的相关信息，生成日志信息。通过本发明提供的技术方案，有效提高了分析芯片间信号的能力、以及在芯片间信号中注入延时和错误的能力，从而提高了多芯片系统的验证的效率和效果，很好地满足多芯片系统验证中实现待验证芯片互联的需求。
【专利说明】-种实现待验证芯片互联的方法和装置
【技术领域】
[0001] 本发明涉及多芯片系统的验证技术，尤指一种实现待验证芯片互联的方法和装 置。
【背景技术】
[0002] 随着集成电路技术的飞速发展，对于多芯片系统的仿真验证（下文简称验证）是 必不可少的，多芯片系统的验证需求也越来越复杂。这样，在多芯片系统的验证中待验证的 芯片的互联（下文简称待验证芯片互联）方面，多芯片系统的验证需求不仅要求实现待验 证芯片互联，而且要求实现分析芯片间信号、在芯片间信号中注入延时和错误、生成上述操 作的相关日志信息等功能（下文将这些功能统称为待验证芯片互联的高级功能）。其中，对 芯片间信号的分析和生成上述操作的相关日志信息，可以增强验证的可视性，提高验证的 效率，而在芯片间信号中注入延时和错误可以更真实模拟实际环境中芯片间通信的情况， 提1?验证的效果。
[0003] 现有的实现待验证芯片互联的方法，如使用Verilog或者SystemVerilog语言实 现待验证芯片互联的方法，虽然可以实现待验证芯片互联，但在实现待验证芯片互联的高 级功能方面，尤其在芯片间接口为超高速接口（例如，速率达到lOGbps以上的接口）时，存 在分析芯片间信号的能力、以及在芯片间信号中注入延时和错误的能力不强的问题，降低 了多芯片系统的验证的效率和效果，不能很好地满足多芯片系统验证中实现待验证芯片互 联的需求。
【发明内容】
[0004] 为了解决上述技术问题，本发明提供了一种实现待验证芯片互联的方法和装置， 在实现待验证芯片互联时，能够更好地实现待验证芯片互联的高级功能，从而有效提高多 芯片系统的验证的效率和效果。
[0005] 为了达到本发明目的，本发明公开了一种实现待验证芯片互联的方法，基于 SystemC语言实现该方法，包括：
[0006] 根据芯片间通信的信息的格式，分析通过PLI接口获得的多个芯片间信号中的信 息，得到分析结果；
[0007] 根据预先设定的配置信息，在通过PLI接口获得的多个芯片间信号中注入延时和 错误，并通过PLI接口发送经注入处理后的芯片间信号；其中，配置信息为范围信息或者固 定信息；
[0008] 根据分析结果和注入延时和错误的相关信息，生成日志信息。
[0009] 所述分析的步骤、以及所述注入的步骤是参考时钟信号进行，参考的时钟信号的 频率大于或者等于芯片间接口的时钟信号的频率。
[0010] 所述分析的步骤具体包括：根据芯片间通信的信息的格式，通过寄存器级操作处 理和事务级建模处理，将通过PLI接口获得的多个芯片间信号即寄存级的信号转换成事务 级的操作，得到所述分析结果。
[0011] 所述注入的步骤具体包括：
[0012] 根据所述配置信息，通过随机处理确定操作信息；其中，操作信息至少包括第一操 作目标信息、延时信息、第二操作目标信息和翻转时间信息；
[0013] 对第一操作目标信息显示的芯片间信号，根据延时信息通过寄存器级操作处理注 入延时；
[0014] 对第二操作目标信息显示的芯片间信号，根据翻转时间信息通过寄存器级操作处 理注入错误；
[0015] 通过PLI接口发送经注入处理后的芯片间信号。
[0016] 本发明还公开了一种实现待验证芯片互联的装置，基于SystemC语言实现该装 置，包括分析单元、注入单元和日志单元，其中，
[0017] 分析单元，用于根据芯片间通信的信息的格式，分析通过PLI接口获得的多个芯 片间信号中的信息，得到分析结果；
[0018] 注入单元，用于根据预先设定的配置信息，在通过PLI接口获得的多个芯片间信 号中注入延时和错误，并通过PLI接口发送经注入处理后的芯片间信号；其中，配置信息为 范围信息或者固定信息；
[0019] 日志单元，用于根据分析结果和注入延时和错误的相关信息，生成日志信息。
[0020] 所述分析单元和所述注入单元参考时钟信号完成相应功能，参考的时钟信号的频 率大于或者等于芯片间接口的时钟信号的频率。
[0021] 所述分析单元具体用于：根据芯片间通信的信息的格式，通过寄存器级操作处理 和事务级建模处理，将通过PLI接口获得的多个芯片间信号即寄存级的信号转换成事务级 的操作，得到所述分析结果。
[0022] 所述注入单元包括随机处理模块、延时注入模块、错误注入模块和发送模块，其 中，
[0023] 随机处理模块，用于根据所述配置信息，通过随机处理确定操作信息；其中，操作 信息至少包括第一操作目标信息、延时信息、第二操作目标信息和翻转时间信息；
[0024] 延时注入模块，用于对第一操作目标信息显示的芯片间信号，根据延时信息通过 寄存器级操作处理注入延时；
[0025] 错误注入模块，用于对第二操作目标信息显示的芯片间信号，根据翻转时间信息 通过寄存器级操作处理注入错误；
[0026] 发送模块，用于通过PLI接口发送经注入处理后的芯片间信号。
[0027] 与现有技术相比，本发明的技术方案基于SystemC语言，根据芯片间通信的信息 的格式，分析通过PLI接口获得的多个芯片间信号中的信息，得到分析结果；根据预先设定 的配置信息，在通过PLI接口获得的多个芯片间信号中注入延时和错误，并通过PLI接口发 送经注入处理后的芯片间信号；根据分析结果和注入延时和错误的相关信息，生成日志信 息。通过本发明提供的技术方案，本发明通过编程语言接口（PLI)从待验证的上游芯片获 得芯片间信号，然后，基于SystemC语言实现待验证芯片互联的高级功能，最后，通过PLI将 经过处理的芯片间信号发送给待验证的下游芯片。这样，在实现待验证芯片互联的同时，有 效提高了分析芯片间信号的能力、以及在芯片间信号中注入延时和错误的能力，从而提高 了多芯片系统的验证的效率和效果，很好地满足多芯片系统验证中实现待验证芯片互联的 需求。
[0028] 本发明的其它特征和优点将在随后的说明书中阐述，并且，部分地从说明书中变 得显而易见，或者通过实施本发明而了解。本发明的目的和其他优点可通过在说明书、权利 要求书以及附图中所特别指出的结构来实现和获得。
【专利附图】
【附图说明】
[0029] 附图用来提供对本发明技术方案的进一步理解，并且构成说明书的一部分，与本 申请的实施例一起用于解释本发明的技术方案，并不构成对本发明技术方案的限制。
[0030] 图1为本发明实现待验证芯片互联的方法的流程图；
[0031] 图2为本发明实现注入的流程图；
[0032] 图3为本发明实现待验证芯片互联的装置的组成结构示意图；
[0033] 图4为本发明装置中注入单元的组成结构示意图。
【具体实施方式】
[0034] 为使本发明的目的、技术方案和优点更加清楚明白，下文中将结合附图对本发明 的实施例进行详细说明。需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中 的特征可以相互任意组合。
[0035] 在附图的流程图示出的步骤可以在诸如一组计算机可执行指令的计算机系统中 执行。并且，虽然在流程图中示出了逻辑顺序，但是在某些情况下，可以以不同于此处的顺 序执行所示出或描述的步骤。
[0036] 图1为本发明实现待验证芯片互联的方法的流程图，可以基于SystemC语言实现 该方法的各步骤，如图1所示，该方法包括如下步骤：
[0037] 步骤101 :根据芯片间通信的信息的格式，分析通过PLI接口获得的多个芯片间信 号中的信息，得到分析结果。
[0038] 通常，芯片间通信是通过多种协议完成的，每一种协议对应于芯片间通信的一个 层。例如，对于计算机网络通信来讲，芯片间通信的各层从下到上是：物理层，数据链路层， 网络层，传输层和应用层；芯片间通信的各层对应的各协议从下到上是：物理层协议，数据 链路层协议，网络层协议，传输层协议和应用层协议；其中，物理层协议可以称为底层协议， 而其他层协议可以统称为高层协议。
[0039] 可以根据多芯片系统的验证需求，确定本步骤中分析处理在芯片间通信的哪个层 上进行，并将分析处理对应的各通信协议的格式作为芯片间通信的信息的格式。
[0040] 本步骤具体来讲，根据芯片间通信的信息的格式，通过寄存器级操作处理和事务 级建模处理，将通过PLI接口获得的多个芯片间信号即寄存级的信号转换成事务级的操 作，得到分析结果。其中，
[0041] 寄存器级操作处理可以用于底层协议对应的信息的处理，事务级建模处理可以用 于高层协议对应的信息的处理。
[0042] 将通过PLI接口获得的多个芯片间信号即寄存级的信号转换成事务级的操作包 括：首先，根据底层协议的格式从通过PLI接口获得的多个芯片间信号即寄存级的信号中， 分析出底层协议对应的信息，然后，根据高层协议的格式从已分析出的信息中进一步分析 出高层协议对应的信息，即事务级的操作。其中，
[0043] 高层协议可以包括多种协议，如果高层协议包括多种协议，则按照由下到上的顺 序，根据对应的协议的格式一个协议一个协议的进行分析，得到该协议对应的信息，并将所 得到的信息作为下面分析的输入，直到分析出最高层协议对应的信息，即事务级的操作。
[0044] 本步骤参考时钟信号完成分析处理、参考的时钟信号的频率大于或者等于芯片间 接口的时钟信号的频率。
[0045] 寄存器级操作处理和事务级建模处理的具体实现、以及参考时钟信号完成分析处 理的具体实现，为本领域人员的惯用技术手段，不用于限定本发明的保护范围，此处不再赘 述。
[0046] 步骤102 :根据预先设定的配置信息，在通过PLI接口获得的多个芯片间信号中注 入延时和错误，并通过PLI接口发送经注入处理后的信号。其中，
[0047] 可以将配置信息分类成范围信息和固定信息。其中，范围信息表示一个数值范围， 例如，[0, 3]表示0到3之间的所有数值。固定信息表示一个固定的数值，例如，3表示数值 3〇
[0048] 图2为步骤102中实现注入的流程图，如图2所示，包括：
[0049] 步骤201 :根据配置信息，通过随机处理确定操作信息。其中，操作信息至少包括 第一操作目标信息、延时信息、第二操作目标信息和翻转时间信息。其中，
[0050] 第一操作目标信息显示将对其进行注入延时处理的信号。延时信息显示对第一操 作目标信息显示的信号进行注入延时处理的延时数值。
[0051] 第二操作目标信息显示将对其进行注入错误处理的信号。翻转时间信息显示对第 二操作目标信息显示的信号进行注入错误处理的时刻。
[0052] 随机处理可以通过SystemC语言提供的伪随机函数实现，通过这种方式实现的伪 随机结果在使用相同伪随机种子的情况下，是可以恢复的。
[0053] 步骤202 :对第一操作目标信息显示的信号，根据延时信息通过寄存器级操作处 理注入延时。其中，
[0054] 注入延时处理指的是增加信号的传输延时。
[0055] 步骤203 :对第二操作目标信息显示的信号，根据翻转时间信息通过寄存器级操 作处理注入错误。其中，
[0056] 注入错误处理可以通过翻转信号的方式来实现。
[0057] 步骤204 :通过PLI接口发送经注入处理后的信号。
[0058] 需要说明的是，步骤102中，当配置信息是固定信息时，通过随机处理确定出的操 作信息的数值与配置信息的数值相等，也就是说，此时由于是在固定信息即固定值的基础 上进行随机处理，随机处理不产生效果。而当配置信息是范围信息时，通过随机处理确定出 的操作信息的数值为配置信息显示的范围中的一个数值，此时，随机处理产生了效果。因 此，
[0059] 当配置信息是固定信息时，本步骤执行的效果相当于，以固定的方式注入延时和 错误。而当配置信息是范围信息时，本步骤执行的效果相当于，以随机的方式注入延时和错 误。这样，可以将配置信息是固定信息的情况，理解为配置信息是范围信息中的一种特殊情 况。
[0060] 步骤102参考时钟信号完成注入处理，参考的时钟信号的频率大于或者等于芯片 间接口的时钟信号的频率。
[0061] 参考时钟信号完成注入处理的具体实现，为本领域人员的惯用技术手段，不用于 限定本发明的保护范围，此处不再赘述。
[0062] 步骤103 :根据分析结果和注入延时和错误的相关信息，生成日志信息。其中，
[0063] 分析结果可以包括分析芯片间通信对应的各协议而得到的信息。
[0064] 注入延时和错误的相关信息，分别包括注入延时处理和注入错误处理相关信息。 具体来讲，可以包括根据配置信息通过随机处理得到的操作信息。
[0065] 生成的日志信息可以保存在一个文件中。
[0066] 图3为本发明实现待验证芯片互联的装置的组成结构示意图，如图3所示，基于 SystemC语言实现该装置，包括分析单元、注入单元和日志单元，其中，
[0067] 分析单元，用于根据芯片间通信的信息的格式，分析通过PLI接口获得的多个信 号中的信息，得到分析结果。
[0068] 注入单元，用于根据预先设定的配置信息，在通过PLI接口获得的多个信号中注 入延时和错误，并通过PLI接口发送经注入处理后的信号；其中，配置信息为范围信息或者 固定信息。
[0069]日志单元，用于根据分析结果和注入延时和错误的相关信息，生成日志信息。
[0070] 分析单元和注入单元参考时钟信号完成相应功能，参考的时钟信号的频率大于或 者等于芯片间接口的时钟信号的频率。
[0071] 进一步地，
[0072] 分析单元具体用于：根据芯片间通信的信息的格式，通过寄存器级操作处理和事 务级建模处理，将通过PLI接口获得的多个信号即寄存级的信号转换成事务级的操作，得 到分析结果。
[0073] 图4为本发明装置中注入单元的组成结构示意图，如图4,注入单元包括随机处理 模块、延时注入模块、错误注入模块和发送模块，其中，
[0074] 随机处理模块，用于根据配置信息，通过随机处理确定操作信息；其中，操作信息 至少包括第一操作目标信息、延时信息、第二操作目标信息和翻转时间信息；
[0075] 延时注入模块，用于对第一操作目标信息显示的信号，根据延时信息通过寄存器 级操作处理注入延时；
[0076] 错误注入模块，用于对第二操作目标信息显示的信号，根据翻转时间信息通过寄 存器级操作处理注入错误；
[0077] 发送模块，用于通过PLI接口发送经注入处理后的信号。
[0078] 虽然本发明所揭露的实施方式如上，但所述的内容仅为便于理解本发明而采用的 实施方式，并非用以限定本发明。任何本发明所属领域内的技术人员，在不脱离本发明所揭 露的精神和范围的前提下，可以在实施的形式及细节上进行任何的修改与变化，但本发明 的专利保护范围，仍须以所附的权利要求书所界定的范围为准。
【权利要求】
1. 一种实现待验证芯片互联的方法，其特征在于，基于SystemC语言实现该方法，包 括： 根据芯片间通信的信息的格式，分析通过PLI接口获得的多个芯片间信号中的信息， 得到分析结果； 根据预先设定的配置信息，在通过PLI接口获得的多个芯片间信号中注入延时和错 误，并通过PLI接口发送经注入处理后的芯片间信号；其中，配置信息为范围信息或者固定 信息； 根据分析结果和注入延时和错误的相关信息，生成日志信息。
2. 根据权利要求1所述的方法，其特征在于，所述分析的步骤、以及所述注入的步骤是 参考时钟信号进行，参考的时钟信号的频率大于或者等于芯片间接口的时钟信号的频率。
3. 根据权利要求1所述的方法，其特征在于，所述分析的步骤具体包括：根据芯片间通 信的信息的格式，通过寄存器级操作处理和事务级建模处理，将通过PLI接口获得的多个 芯片间信号即寄存级的信号转换成事务级的操作，得到所述分析结果。
4. 根据权利要求1所述的方法，其特征在于，所述注入的步骤具体包括： 根据所述配置信息，通过随机处理确定操作信息；其中，操作信息至少包括第一操作目 标信息、延时信息、第二操作目标信息和翻转时间信息； 对第一操作目标信息显示的芯片间信号，根据延时信息通过寄存器级操作处理注入延 时； 对第二操作目标信息显示的芯片间信号，根据翻转时间信息通过寄存器级操作处理注 入错误； 通过PLI接口发送经注入处理后的芯片间信号。
5. -种实现待验证芯片互联的装置，其特征在于，基于SystemC语言实现该装置，包括 分析单元、注入单元和日志单元，其中， 分析单元，用于根据芯片间通信的信息的格式，分析通过PLI接口获得的多个芯片间 信号中的信息，得到分析结果； 注入单元，用于根据预先设定的配置信息，在通过PLI接口获得的多个芯片间信号中 注入延时和错误，并通过PLI接口发送经注入处理后的芯片间信号；其中，配置信息为范围 信息或者固定信息； 日志单元，用于根据分析结果和注入延时和错误的相关信息，生成日志信息。
6. 根据权利要求5所述的装置，其特征在于，所述分析单元和所述注入单元参考时钟 信号完成相应功能，参考的时钟信号的频率大于或者等于芯片间接口的时钟信号的频率。
7. 根据权利要求5所述的装置，其特征在于，所述分析单元具体用于：根据芯片间通信 的信息的格式，通过寄存器级操作处理和事务级建模处理，将通过PLI接口获得的多个芯 片间信号即寄存级的信号转换成事务级的操作，得到所述分析结果。
8. 根据权利要求5所述的装置，其特征在于，所述注入单元包括随机处理模块、延时注 入模块、错误注入模块和发送模块，其中， 随机处理模块，用于根据所述配置信息，通过随机处理确定操作信息；其中，操作信息 至少包括第一操作目标信息、延时信息、第二操作目标信息和翻转时间信息； 延时注入模块，用于对第一操作目标信息显示的芯片间信号，根据延时信息通过寄存 器级操作处理注入延时； 错误注入模块，用于对第二操作目标信息显示的芯片间信号，根据翻转时间信息通过 寄存器级操作处理注入错误； 发送模块，用于通过PLI接口发送经注入处理后的芯片间信号。
【文档编号】G06F13/28GK104123253SQ201410363753
【公开日】2014年10月29日 申请日期:2014年7月28日 优先权日:2014年7月28日
【发明者】李拓, 童元满, 李仁刚 申请人:浪潮(北京)电子信息产业有限公司