本申请要求2015年12月16日提交的、标题为“operatingavliwprocessorinawirelesssensordevice”的美国申请14/971,299的优先权，其通过引用而并入于此。
背景技术：
以下说明涉及无线传感器装置中的超长指令字(vliw)处理器的操作。
超长指令字(vliw)处理器具有用以并行处理多个指令的多个执行单元。通常，vliw处理器的各执行单元可以在vliw处理器的各时钟周期期间执行指令字。执行单元可以接收“nop”指令，这表示在相应的时钟周期期间不操作执行单元。
技术实现要素：
在这里描述的一般方面，指令被通信至超长指令字(vliw)处理器装置。
在一些方面，一种处理器系统包括具有多个执行单元的超长指令字(vliw)处理器装置。所述处理器系统还包括存储单元和互连装置。所述存储单元存储要路由至所述执行单元的指令字。所述互连装置提供所述存储单元和所述执行单元之间的连接。所述互连装置适于访问针对所述vliw处理器装置的时钟周期的路由索引。所述互连装置还适于根据针对所述时钟周期的路由索引来将所述指令字从所述存储单元中的一个或多个存储单元路由至所述执行单元中的一个或多个执行单元。
在一些方面，指令字存储在处理器系统中的各存储单元处。在用于提供vliw处理器装置的所述存储单元和所述执行单元之间的连接的互连装置处，访问针对所述vliw处理器装置的时钟周期的路由索引。所述指令字根据所述路由索引从所述存储单元中的一个或多个存储单元路由至所述执行单元中的一个或多个执行单元。
在一些方面，所述处理器系统是无线传感器装置中的射频(rf)处理器系统。
这些其它方面的实现可以包括以下特征中的一个或多个。针对所述时钟周期的路由索引可以针对各执行单元表示该执行单元是否接收要在该时钟周期上执行的指令字。所述路由索引可以包括表示针对所述执行单元中的至少一个执行单元的nop指令的二进制值。
这些其它方面的实现可以包括以下特征中的一个或多个。所述vliw处理器装置可以包括n个执行单元，并且所述处理器系统可以包括n个存储单元。所述处理器系统可以包括用于提供所述n个存储单元和所述n个执行单元之间的n对n连接的n对n互连装置。
这些其它方面的实现可以包括以下特征中的一个或多个。所述处理器系统可以包括用于存储针对所述vliw处理器装置的多个时钟周期的路由索引的索引存储。所述互连装置可以适于访问来自所述索引存储的针对各时钟周期的路由索引。所述索引存储可以存储包括针对所述多个时钟周期的路由索引的二进制路由矩阵。所述处理器系统可以包括用于存储要被通信至所述存储单元的指令字的主存储装置。
这些其它方面的实现可以包括以下特征中的一个或多个。可以根据针对第一时钟周期的路由索引来提供所述存储单元中的第一存储单元和所述执行单元中的第一执行单元之间的第一连接。可以通过所述第一连接将所述指令字中的第一指令字从所述第一存储单元路由至所述第一执行单元。可以根据针对随后的第二时钟周期的路由索引来提供所述第一存储单元和所述执行单元中的不同的第二执行单元之间的不同的第二连接。可以通过所述第二连接将第二指令字从所述第一存储单元路由至所述第二执行单元。
在一些情况下，这些和其它方面的实现可以提供多个优点。例如，用于vliw处理器装置的指令可以需要较少的内存。作为另一示例，用于vliw处理器装置的指令可以根据不依赖于简档化的一般方案来路由。
在以下附图和说明书中详细阐述了一个或多个实现。根据说明书和附图以及权利要求书，其它特征、目的和优点将显而易见。
附图说明
图1a是示出示例性无线传感器装置的方面的框图。
图1b是示出示例性处理器系统的示意图。
图2是示出示例性指令集的示意图。
图3是示出无线传感器装置中的示例性信号路径的示意图。
具体实施方式
图1a是示出示例性无线传感器装置100的方面的框图。如图1a所示，无线传感器装置100包括天线系统102、射频(rf)处理器系统104和电源103。无线传感器装置可以包括附加的或不同的特征和组件，并且这些组件可以如图所示或者以其它方式布置。
在操作中，无线传感器装置100可以检测和分析无线信号。在一些实现中，尽管无线传感器装置100本身不是蜂窝网络的一部分，但是该无线传感器装置可以检测根据(例如，蜂窝网络的)无线通信标准进行交换的信号。在一些情况下，无线传感器装置100通过在宽频率范围上“收听”或“观察”rf信号并处理其检测到的rf信号来监视rf信号。可能存在没有检测到rf信号的时间，并且在无线传感器装置100的本地环境中检测到rf信号时，该无线传感器装置100可以(例如，间或地或连续地)处理这些rf信号。
示例性天线系统102例如通过电线、导线、触点或者使得天线系统102和rf处理器系统104能够交换rf信号的其它类型的连接，来与rf处理器系统104通信连接。在一些情况下，天线系统102无线地接收来自无线传感器装置100的电磁环境的rf信号，并将这些rf信号传送至rf处理器系统104以待处理(例如，数字化、分析、存储、再发送等)。在一些情况下，天线系统102接收来自rf处理器系统104的rf信号，并无线地发送来自无线传感器装置100的rf信号。
示例性rf处理器系统104可以包括被配置为处理rf信号的一个或多个芯片、芯片组、或其它类型的装置。例如，rf处理器系统104可以包括一个或多个处理器装置，其中这一个或多个处理器装置被配置为通过对根据各种无线通信标准发送的rf信号进行解调和解码来识别和分析编码在rf信号中的数据。在一些情况下，rf处理器系统104包括vliw处理器装置。例如，rf处理器系统104可以包括图1b所示的处理器系统110或其它类型的处理器系统的特征。vliw处理器装置包括用以并行处理多个指令的多个执行单元。例如，无线传感器装置100可以提供相当的计算资源以处理用于实时分析无线信号的大型指令集。
在一些实现中，例如，即使在编译器不能调度vliw处理器装置的所有可用位置(slot)中的指令字的情况下(例如，在编译器将“nop”或空集插入未使用指令位置的情况下)，rf处理器系统104也以高指令存储器利用率来处理用于vliw处理器装置的指令。例如，rf处理器系统可以使用用于为指令提供高压缩比的压缩方案。在一些情况下，压缩方案使用二进制路由矩阵来构造具有nop指令和非nop指令的操作流程。例如，二进制路由矩阵可以包括用以按照要被应用的顺序表示所有非nop指令的第一二进制索引(例如，“1”)、以及用以按照要被应用的顺序表示所有nop指令的另一二进制索引(例如，“0”)。在这样的示例中，nop指令可以减少至一位，因此与一些现有方案相比需要较少的存储。
在一些实现中，rf处理器系统104被配置为监视并分析根据例如如下的一个或多个通信标准格式化的信号：诸如全球移动系统(gsm)和gsm演进的增强数据率(edge)或egprs等的2g标准；诸如码分多址(cdma)、通用移动电信系统(umts)和时分同步码分多址(td-scdma)等的3g标准；诸如长期演进(lte)和高级lte(lte-a)等的4g标准；诸如ieee802.11等的无线局域网(wlan)或wifi标准、蓝牙、近场通信(nfc)和毫米通信；以及这些无线通信标准中的多个或其它类型的无线通信标准。在一些情况下，rf处理器系统104能够提取可用特征、同步信息、小区和服务标识符、rf的质量度量、无线通信标准的物理层、以及其它信息等。在一些实现中，rf处理器系统104被配置为处理其它类型的无线通信(例如，非标准化的信号和通信协议)。
在一些实现中，rf处理器系统104可以在频域、时域或两者中进行各种类型的分析。在一些情况下，rf处理器系统104被配置为确定所检测到的信号的带宽、功率谱密度或其它频率属性。在一些情况下，rf处理器系统104被配置为进行解调或其它操作以在时域中从无线信号提取内容，例如无线信号中所包括的信令信息(例如，前导码、同步信息、信道条件指示、wifi网络的ssid/mac地址)。rf处理器系统104和天线系统102可以基于电源103所提供的电力来进行操作。例如，电源103可以包括用于向rf处理器系统104提供ac或dc电压的电池或其它类型的组件。
在一些情况下，无线传感器装置100被实现为可用于感测无线信号并分析无线频谱使用的紧凑、便携式装置。在一些实现中，无线传感器装置100被设计为以低功耗(例如，平均约为0.1或0.2瓦以下)进行操作。在一些实现中，无线传感器装置100可以小于典型的个人计算机或膝上型计算机，并且可以在各种环境下进行操作。在一些情况下，无线传感器装置100可以在用于分析和聚合某一地理区域中的无线频谱使用的无线传感器网络或其它类型的分布式系统中进行操作。例如，在一些实现中，无线传感器装置100可以如标题为“wirelessspectrummonitoringandanalysis”的美国专利9,143,168中所描述地使用，或者无线传感器装置100可以在其它类型的环境中使用或者以其它方式进行操作。
图1b是示出示例性处理器系统110的示意图。在一些情况下，示例性处理器系统110的全部或部分可以包括在图1a所示的rf处理器系统104中。例如，处理器系统110可被配置为接收并分析天线系统所检测到的rf信号。处理器系统110可以包括在其它类型的系统和装置中。图1b中的示例性处理器系统110包括主存储111、动态存储器分配(dma)单元112、总线113、高速缓存存储器115、互连装置114、超大指令字(vliw)处理器装置117、索引存储119、以及预取队列120。在所示的示例中，高速缓存存储器115包括n个存储单元116a、116b、...116n，vliw处理器装置117包括n个执行单元118a、118b、...118n，并且互连装置114是n对n互连装置(其中n是整数)。处理器系统110可以包括附加的或不同的特征，并且处理器系统的特征可以如图所示或以其它方式布置。
示例性处理器系统110可以通过存储和处理针对vliw处理器装置117的指令集来进行操作。在一些示例中，处理器系统110存储并处理如图2所示的示例性指令集200那样格式化的指令集，其中该指令集包括二进制路由矩阵208和指令字210的集合。处理器系统110可以存储并处理更大或更小的指令集，或者处理器系统110可以存储并处理以其它方式格式化的指令集。
示例性处理器系统110包括可以存储二进制信息的三个存储器装置。所示的三个示例性存储器装置是主存储111、高速缓存存储器115和索引存储119。处理器系统110可以包括附加的或不同的存储器装置。存储器装置可以包括易失性存储器装置(例如，静态随机存取存储器、动态随机存取存储器、专用逻辑电路等)或非易失性存储器装置(例如，闪速存储器、各种形式的只读存储器等)。
示例性主存储111包括用以存储针对vliw处理器装置117的指令的存储器。例如，主存储111可以存储图2所示的指令字210的集合，或者主存储111可以存储其它格式(压缩或未压缩)的指令或其它类型的信息。
示例性dma单元112连接在主存储111和总线113之间。dma单元112能够操作以生成存储器地址，在一个或多个存储器装置(例如，主存储111、高速缓存存储器115等)中发起读取和写入操作，并进行与存储器装置相关的其它操作。在一些示例中，dma单元112可以访问主存储111中所存储的信息，并经由总线113将该信息分配至其它装置(例如，高速缓存存储器115)。例如，dma单元112可以访问主存储111中的指令字，并经由总线113将这些指令字分配至高速缓存存储器115。
示例性总线113提供dma单元112和高速缓存存储器115之间的物理连接。例如，总线113可以包括适于在dma单元112和高速缓存存储器115之间传送信息的一个或多个电线、光纤或其它物理路径。总线113可以提供处理器系统110中的其它装置或组件之间的连接。
示例性高速缓存存储器115包括n个存储单元116a、116b、...116n。整数n可以例如是十二(12)、十六(16)或其它值。在所示的示例中，整数n还是vliw处理器装置117中的执行单元118a、118b、...118n的数量。因此，在该示例中，高速缓存存储器115中的存储单元116a、116b、...116n的数量等于vliw处理器装置117中的执行单元118a、118b、...118n的数量。
高速缓存存储器115中的示例性存储单元116a、116b、...116n各自包括用以存储用于vliw处理器装置117的指令字的存储器。例如，高速缓存存储器115可以存储图2所示的指令字210中的n个指令字，其中第一存储单元116a存储指令字中的第一指令字(例如，a11)，第二存储单元116b存储指令字中的第二指令字(例如，a13)等。在所示的示例中，高速缓存存储器115可以存储针对vliw处理器装置117的至少一个时钟周期的所有指令字。在一些情况下(对于包括一个或多个nop指令的时钟周期)，高速缓存存储器115可以存储针对vliw处理器装置117的多个时钟的指令字。
示例性存储单元116a、116b、...116n存储要路由至各个执行单元118a、118b、...118n的指令字。高速缓存存储器115中的示例性存储单元116a、116b、...116n可被实现为n个独立的“微型存储”。在所示的示例中，使存储分离，以允许增加压缩并且允许对vliw处理器装置117中的执行单元118a、118b、...118n进行连续馈送。
示例性互连装置114提供存储单元116a、116b、...116n和执行单元118a、118b...118n之间的连接。在所示的示例中，互连装置114包括可以在任何存储单元和任何执行单元之间进行连接的路由逻辑，并且该路由逻辑可以修改各时钟周期的连接。互连装置114可以在各时钟周期中使用这些连接将来自各个存储单元116a、116b、...116n的指令字通信至各个执行单元118a、118b、......118n。示例性互连装置114是n对n互连，这意味着该互连装置114可以在n个存储单元中的任一个存储单元与n个执行单元中的任一个执行单元之间建立通信链路。例如，互连装置114可以提供从第一存储单元116a到第一执行单元118a、到第二执行单元118b或者vliw处理器装置117中的任何其它执行单元的连接。
示例性互连装置114适于访问针对vliw处理器装置117的各时钟周期的路由索引。在一些情况下，互连装置114可以利用预取队列120访问路由索引。路由索引可以例如格式化为二进制向量、二进制串或其它格式。针对时钟周期的路由索引表示在该时钟周期期间哪个执行单元应该接收非nop指令字以供执行。以这种方式，路由索引提供针对互连装置114的路由逻辑的指令。
在一些情况下，互连装置114针对各时钟周期提供从各个存储单元到相应的各个执行单元的直接连接。可以根据针对时钟周期的路由索引来配置针对各时钟周期的连接。针对时钟周期的路由索引可以是n个二进制值的集合，其中各执行单元118a、118b、...118n具有一个二进制路由索引。例如，针对vliw处理器装置117的时钟周期的路由索引可以是图2所示的示例性路由矩阵208的任意单独的行中的n个二进制值。在一些情况下，可以使用其它类型的路由索引。
互连装置114可以包括可根据路由索引或其它指令进行控制的数字或模拟电路。在图1b所示的示例中，示例性互连装置114的路由逻辑适于将针对vliw处理器装置117的各时钟周期的指令字从存储单元116a、116b、...116n中的一个或多个存储单元路由至执行单元118a、118b、...118n中的一个或多个执行单元。针对各时钟周期，根据针对时钟周期的路由索引来配置存储单元和执行单元之间的连接。例如，针对时钟周期的路由索引可以表示要用于接收针对该时钟周期的指令字的执行单元的子集(一个或多个执行单元)。作为处理路由索引的结果，互连装置114可以提供执行单元的子集和存储指令字的存储单元之间的连接。
在一些情况下，互连装置114可以被实现为通过索引存储119中所存储的路由信息来控制的n:n交叉开关。通过控制连接并且使得这些连接能够针对各时钟周期根据路由索引进行再配置，可以消除或减少内存分配假设，并且可以通用地且紧凑地填充存储器装置，这可以在一些情况下实现改进的压缩和实用性。例如，以这种方式操作互连装置114可以避免如下的某些情况，其中在这些情况下，预分配将(例如，由于程序较多地使用特定执行单元因而)限制程序大小。
在一些情况下，针对各时钟周期的路由索引指定vliw处理器装置中的哪些执行单元需要被馈送有针对该时钟周期的指令字。以这种方式，指令字可以从各个存储单元直接路由至正确的相应执行单元。并且存储单元和执行单元之间的路由可以随着各时钟周期而改变。例如，存储单元和执行单元之间的通信路径可以随着各时钟周期进行再配置，并且该再配置通信路径可以用于将指令字从存储单元传送至相应的执行单元。
作为如何针对各时钟周期改变连接的示例，互连装置114可以根据针对第一时钟周期的路由索引提供第一存储单元116a和第一执行单元118a之间的第一连接；然后该互连装置114可以改变连接以根据针对第二时钟周期的路由索引提供第一存储单元116a和第二存储单元118b之间的不同的第二连接。在该示例中，互连装置114可以使用第一连接来将第一指令字从第一存储单元116a路由至第一执行单元118a，然后该互连装置114可以使用第二连接来将第二指令字从第一存储单元116a路由至第二执行单元118b。第一指令字可以由第一执行单元118a在第一时钟周期期间执行，然后第二指令字可以由第二执行单元118b在第二时钟周期期间执行。
示例性索引存储119存储由互连装置114访问的路由索引。例如，索引存储可以存储路由矩阵，例如图2所示的示例性路由矩阵208的全部或部分。索引存储119可以存储其它类型或格式的路由索引。
示例性预取队列120可以用作索引存储119和互连装置114之间的流水线缓存器。预取队列120的大小可例如被设计为vliw处理器装置117的延迟位置的数量，并且预取队列120可以包含远在指令执行之前请求的路由代码。在一些情况下，在控制流的改变(例如，程序跳跃)期间，已经排好队的路由代码可以继续控制路由逻辑，直到所有的延迟位置已被执行为止。
示例性vliw处理器装置117是通过执行指令来进行逻辑操作的处理器装置。vliw处理器装置117的n个执行单元118a、118b、...118n可以并行操作，并且在vliw处理器装置117的各时钟周期中并行地执行指令。一般地，各执行单元通过执行从存储单元之一接收到的指令字来进行操作。针对各时钟周期的路由索引为各执行单元表示该执行单元是否接收要在该时钟周期上执行的指令字。在一些情况下，一个或多个执行单元118a、118b、...118n不在一个或多个时钟周期期间(例如，在执行单元接收nop指令字的时钟周期期间)进行操作。vliw处理器装置117的执行单元118a、118b、...118n可以包括被配置为处理指令字的逻辑电路或其它数据处理硬件。在操作中，执行单元执行vliw处理器装置117的算术和逻辑工作负载以及加载和存储操作等。
示例性处理器系统110可以根据一般压缩方案(例如，由图2所示的示例所表示的方案)来存储和处理指令。例如，在一些实现中，n个存储单元116a、116b、...116n中的任意存储单元可以存储针对任意执行单元118a、118b、...118n且针对任意时钟周期的任意指令字。随着程序执行的进行，vliw处理器单元117的控制单元可以判断要提取多少指令字、以及从n个存储单元116a、116b、...116n中的哪些存储单元提取这些指令字。控制单元可以例如通过使用寄存器指向当前“头”存储单元、然后对来自指令存储器的路由索引进行减少添加，来进行该判断。然后可以相应地更新头指针，以指向下一指令的开始。一旦头指针增量超过存储单元的数量，则该头指针可以以循环方式环绕。同样，指令的提取也可以环绕。在一些情况下，可以在使用路由索引将所提取的指令字扩展为vliw发出的操作期间对指令字进行再定序。
图2是示出可由处理器系统110处理的示例性指令集200的某些方面的示意图。图2所示的示例性指令集200包括路由矩阵208、以及指令字210的集合。示例性路由矩阵208是m×n矩阵，其具有m行和n列(其中m和n均为整数)。路由矩阵208的各行包括针对vliw处理器装置的单个时钟周期的路由索引。例如，第一行中的路由索引针对第一时钟周期，第二行中的路由索引针对第二时钟周期，以及第m行中的路由索引针对第m个时钟周期。路由矩阵208中的各列与vliw处理器装置中的执行单元相对应。例如，第一列中的路由索引用于由第一执行单元执行，第二列中的路由索引用于由第二执行单元执行，以及第n列中的路由索引用于由第n个执行单元执行。针对图2所示的示例中的第一时钟周期，“1”是针对第一、第三和第n个执行单元的路由索引，以及“0”是针对第二执行单元的路由索引；针对图2所示的示例中的第二时钟周期，“1”是针对第一和第二执行单元的路由索引，以及“0”是针对第三和第n个执行单元的路由索引；等等。
在图2所示的示例中，路由索引208中的各二进制索引表示是否将非nop指令路由至执行单元。具体而言，各“0”索引表示nop指令，并且各“1”索引表示非nop指令。非nop指令明确地提供于指令字210的集合中，而nop没有被明确地存储。例如，指令集200中的各非nop指令可以是指令字210的集合中的n位值。
在图2所示的示例中，指令字210的集合被存储为n位值的阵列。针对第一时钟周期的指令字在图2中被示出为{a11、a13和a1n}，以及针对第二时钟周期的指令字在图2中被示出为{a21和a22}，等等。在该示例中，a11表示在第一时钟周期上用于第一执行单元的指令字，a13表示在第一时钟周期上用于第三执行单元的指令字，a21表示在第二时钟周期上用于第一执行单元的指令字，等等。
图2所示的指令字210的示例性集合不包括任何nop指令字。作为替代，在路由矩阵208中，nop指令字被表示为“0”索引。因此，例如，指令字210的集合不包括在第一时钟周期上用于第二执行单元的指令字、在第二时钟周期上用于第三执行单元的指令字、或者与路由矩阵中的“0”索引相对应的其它位置。
图2所示的示例性指令集200表示m×n个指令字，并且在路由矩阵208中存在m×n个二进制索引。在该示例中，nop指令的数量可以表示为整数α，这意味着在路由矩阵208中存在着α个“0”索引以及(m×n-α)个“1”索引。在该示例中，各非nop指令字各自为n位值，这意味着使用(m×n-α)×n个位来存储指令字210的集合。因此，用于存储示例性指令集200的总位数为(m×n-α)×n+(m×n)。在许多情况下，指令集200需要比其它格式少的总内存。例如，在明确存储了所有nop指令和非nop指令的可选格式中，使用存储器中的(m×n×n)位来存储指令集。与该可选例相比，在nop指令的数量大于按各操作的位大小进行划分的(nop和非nop)操作的总数的情况下(即，在α＞(m×n)/n的情况下)，图2所示的格式消耗较少的内存。
在一些示例性实现中，能够在图1b所示的处理器系统110中存储并处理图2所示的指令集200。在这样的示例中，针对第一时钟周期的x个指令字a11、a13、...a1n可以存储在高速缓存存储器115中的前x个存储单元(例如，存储单元116a、存储单元116b等)上，并且针对第二时钟周期的n-x个指令字可以存储在剩余的n-x个存储单元上。例如，指令字210中的前n个指令字可以通过dma单元112的操作经由总线113从主存储111通信至高速缓存存储器115。互连装置114可以从预取队列120接收针对第一时钟周期的路由索引。互连装置114的路由逻辑可以将指令字从前x个存储单元路由至vliw处理器装置117中的适当的x个执行单元，以供在第一时钟周期期间执行。例如，指令字a11可以从第一存储单元116a路由至第一执行单元118a，指令字a13可以从第二存储单元116b路由至第三执行单元118c，指令字a1n可以从第x个存储单元路由至第n个执行单元118n，等等。在一些情况下，互连装置114然后可以从预取队列120接收针对第二时钟周期的路由索引，并且路由逻辑可以将指令字从剩余的n-x个存储单元路由至vliw处理器装置117中的适当的执行单元以供在第二时钟周期期间执行。
图3是示出无线传感器装置中可以实现的示例性信号路径300的示意图。其它类型的信号路径可用于在无线传感器装置中处理信号。图3所示的示例性信号路径300包括rf接口310(在图3中表示为“无线电路径a”)和频谱分析子系统305。信号路径可以包括附加或不同的特征，其中这些特征可以如图所示或者以其它方式进行配置。在一些情况下，图3所示的系统可以进行用于监视和分析无线传感器装置中的无线信号的所有操作。例如，信号路径300可以执行无线接收器的功能，例如解调、均衡、信道解码等。信号路径300可以支持各种无线通信标准的信号接收，并且访问频谱分析子系统305以用于分析无线信号。
在所示的示例中，rf接口310可以包括用于检测并处理rf信号的宽带或窄带前端芯片组。例如，rf接口310可以被配置为在无线通信标准的一个或多个频带的宽频谱或者在特定频带内的窄频谱中检测rf信号。在一些实现中，信号路径300可以包括一个或多个rf接口310以覆盖关注的频谱。
在图3所示的示例中，rf接口310包括天线系统322、rf多路复用器320或功率合成器(例如，rf开关)、以及一个或多个信号处理路径(例如，“路径1”330、…、“路径m”340)。图3中的示例性天线系统322连接至rf多路复用器320。在一些实现中，rf接口310可被配置为使用天线系统322以基于单输入单输出(siso)、单输入多输出(simo)、多输入单输出(miso)或多输入多输出(mimo)技术来检测rf信号。
在一些实现中，无线传感器装置的本地环境中的rf信号可以由天线系统322拾取，并被输入到rf多路复用器320中。根据rf信号的频率，从rf多路复用器320输出的信号302可以路由至处理路径(即，“路径1”330、...、“路径m”340，其中m是整数)其中之一。各路径可以包括独特的频带。例如，“路径1”330可以用于1ghz和1.5ghz之间的rf信号，而“路径m”可以用于5ghz和6ghz之间的rf信号。多个处理路径可以具有各自的中心频率和带宽。多个处理路径的带宽可以是相同或不同的。两个相邻处理路径的频带可以重叠或不相交。在一些实现中，可以基于不同的无线通信标准(例如，gsm、lte、wifi等)的所分配的频带来分配或以其它方式配置处理路径的频带。例如，可以配置为使得各处理路径负责检测特定无线通信标准的rf信号。作为示例，“路径1”330可以用于检测lte信号，而“路径m”340可以用于检测wifi信号。
各处理路径(例如，“处理路径1”330、“处理路径m”340)可以包括一个或多个rf无源元件和rf有源元件。例如，处理路径可以包括rf多路复用器、一个或多个滤波器、rf解多路复用器、rf放大器和其它组件。在一些实现中，从rf多路复用器320输出的信号302、302m可以应用于处理路径中的多路复用器(例如，“rf多路复用器1”332、...、“rf多路复用器m”342)。例如，如果选择“处理路径1”330作为信号302的处理路径，则信号302可以被馈送到“rf多路复用器1”332中。rf多路复用器可以在来自第一rf多路复用器320的信号302和由频谱分析子系统305所提供的rf校准(cal)音调338之间进行选择。“rf多路复用器1”332的输出信号304可以进入滤波器(滤波器(1,1)334a、…、滤波器(1,n)334n，其中n是整数)其中之一。滤波器进一步将处理路径的频带划分成较窄的关注频带。例如，可以将“滤波器(1,1)”334a应用于信号304以产生经滤波的信号306，并且可以将经滤波的信号306应用于“rf解多路复用器1”336。在一些情况下，可以在rf解多路复用器中放大信号306。然后，可以将放大后的信号308输入到频谱分析子系统305中。
同样地，如果选择“处理路径m”340作为信号302m的处理路径，则信号302m可以被馈送到“rf多路复用器m”342中。rf多路复用器可以在来自第一rf多路复用器320的信号302m和由频谱分析子系统305所提供的rf校准(cal)音调348之间进行选择。“rf多路复用器m”342的输出信号可以进入滤波器(滤波器(m,1)344a、…、滤波器(m,n)344n，其中n是整数)其中之一。在一些情况下，可以在rf解多路复用器m346中放大滤波器的输出信号。然后，可以将放大后的信号308m输入到频谱分析子系统305中。
频谱分析子系统305可以被配置为将检测到的rf信号转换为数字信号，并且基于检测到的rf信号来进行数字信号处理以识别信息。频谱分析子系统305可以包括一个或多个si无线电接收(rx)路径(例如，“无线电rx路径1”350a、“无线电rx路径m”350m)、dsp频谱分析引擎360、rf校准(cal)音调生成器370、前端控制模块380、以及i/o390。频谱分析子系统305可以包括附加或不同的组件和特征。
在所示的示例中，将放大后的信号308输入到“无线电rx路径1”350a中，其中该“无线电rx路径1”350a将信号308降频为基带信号并应用增益。然后，可以经由模数转换器来对降频后的信号进行数字化。数字化信号可以被输入到dsp频谱分析引擎360中。在一些情况下，频谱分析子系统305包括一个或多个处理器装置，例如超长指令字(vliw)处理器装置、数字信号处理器(dsp)装置、或者这些和其它类型的处理器装置的组合。在一些情况下，vliw处理器装置通过用于根据路由索引来对指令进行路由的互连来接收指令。例如，频谱分析子系统305可以包括图1b所示的处理器系统110或其它类型的处理器系统。
dsp频谱分析引擎360例如可以(例如，基于无线通信标准的规范)识别数字信号中所包括的包和帧，读取嵌入在数字信号中的前导码、头部、或者其它控制信息，并且确定一个或多个频率处或带宽上的信号的信号功率和snr、信道质量和容量、流量水平(例如，数据速率、重传率、延迟、丢包率等)或其它参数。dsp频谱分析引擎360的输出(例如，参数)可以适用于i/o390并针对i/o390进行格式化，例如以供发送至外部系统。
rf校准(cal)音调生成器370可以生成用于诊断和校准无线电rx路径(例如“无线电rx路径1”350a、…、“无线电rx路径m”350m)的rf校准(cal)音调。例如，可以针对线性和带宽来校准无线电rx路径。
虽然本说明书包含很多细节，但这些细节不应被解释为对所要求保护的范围的限制，而应被解释为特定于特定示例的特征描述。还可以组合本说明书在单独实现的上下文中所描述的某些特征。相反，在单个实现的上下文中所描述的各种特征还可以在多个实施例中单独实现或者以任何合适的子组合实现。
已经描述了许多实施例。然而，应当理解，可以进行各种修改。因此，其它实施例在所附权利要求书的范围内。