本申请涉及但不限于计算机
技术领域：
：，尤指一种虚拟现实设备和虚拟现实设备的配置方法。
背景技术：
：：随着计算机运行能力的大幅提升以及大数据技术的广泛应用，虚拟现实(virtualreality，简称为：vr)技术得到高速发展，不但在国防、航空航天、工业制造等领域得到越来越广泛的应用，也在个人娱乐等方面展示出其强大的娱乐性，vr设备已成为人们生活娱乐的一种重要工具。目前市场上的vr设备包括一体机和分体机。为了迎合市场发展，结合用户的实际使用需求，一体分体机成为vr设备的发展趋势，vr一体分体机的设计思想为：充分利用以中央处理器(centralprocessingunit，简称为：cpu)为核心的计算机的高速运算能力和以应用处理器(applicationprocessor，简称为：ap)为核心的手机主板模式的可移动性，实际设计中输出终端可以为液晶显示器(liquidcrystaldisplay，简称为：lcd)、有机发光二极管(organiclight-emittingdiode，简称为：oled)显示器等遵循移动产业处理器接口(mobileindustryprocessorinterface，简称为：mipi)串行显示接口(displayserialinterface，简称为：dsi)(即mipidsi接口)协议的显示器件，vr一体分体机的设计需求为实现一个设备上一体和分体两种模式的切换，然而，高速的mipidsi信号无法通过直接拓扑布线实现一体和分体两种模式下信号的切换。综上所述，现有技术中的vr设备在一体和分体两种模式的应用需求中，由于高速的mipidsi信号无法实现信号切换，从而导致很难将一体机和分体机整合在一台设备中的问题。技术实现要素：为了解决上述技术问题，本发明实施例提供了一种虚拟现实设备和虚拟现实设备的配置方法，以解决现有技术中的vr设备，由于输入的mipidsi信号无法实现信号切换，从而导致很难将一体机和分体机整合在一台设备中的问题。本发明实施例提供一种虚拟现实设备，包括：至少一个切换模块和显示模块；每个所述切换模块包括第一输入端口、第二输入端口和输出端口；其中，所述第一输入端口和所述第二输入端口，均用于输入高速信号；每个所述切换模块，用于控制本切换模块的输出端口向所述显示模块输出本切换模块的第一输入端口或第二输入端口对应的高速信号。可选地，如上所述的虚拟现实设备中，所述第一输入端口，用于接收所述虚拟现实设备的应用处理器输入的高速信号；所述第二输入端口，用于接收外接设备输入的高速信号。可选地，如上所述的虚拟现实设备中，还包括：与部分切换模块的第二输入端口或全部切换模块的第二输入端口一一对应连接的压缩模块；每个所述压缩模块的输入端口，用于接收所述外接设备输入的高速信号；每个所述切换模块的第二输入端口，用于接收所述外接设备输入的经过所述压缩模块压缩后的高速信号。可选地，如上所述的虚拟现实设备中，所述压缩模块内置于所述虚拟现实设备的应用处理器中。可选地，如上所述的虚拟现实设备中，所述外接设备通过数据转换模块连接所述压缩模块的输入端口；所述数据转换模块，用于接收所述外接设备输入的高清晰度多媒体接口hdmi信号，并将所述hdmi信号转换为高速信号后传输给所述压缩模块。可选地，如上所述的虚拟现实设备中，每个所述切换模块还包括至少一个可编程输出端口。可选地，如上所述的虚拟现实设备中，每个所述切换模块，还用于控制本切换模块中的高速信号从所述可编程输出端口输出。可选地，如上所述的虚拟现实设备中，还包括：与每个所述第一输入端口和每个所述第二输入端口一一对应连接的转接模块。本发明实施例还提供一种虚拟现实设备的配置方法，所述方法为对上述任一项所述的虚拟现实设备进行配置的方法，所述方法包括：执行预先配置的程序的操作步骤；生成所述程序的执行文件；将所述执行文件下载到每个所述切换模块中，通过所述执行文件控制对应切换模块的输出端口向所述显示模块输出本切换模块的第一输入端口或第二输入端口对应的高速信号。可选地，如上所述的虚拟现实设备的配置方法中，所述生成所述程序的执行文件之前，所述方法还包括：对所述程序进行时序仿真；根据所述时序仿真的结果验证所述虚拟现实设备中的路径延迟。可选地，如上所述的虚拟现实设备的配置方法中，所述执行预先配置的程序的操作步骤之前，所述方法还包括：采用所述仿真文件对所述程序进行仿真；所述执行预先配置的程序的操作步骤，包括：当验证仿真成功时，执行所述程序的操作步骤。可选地，如上所述的虚拟现实设备的配置方法中，所述采用仿真文件对预先配置的程序进行仿真之前，所述方法还包括：生成所述程序，初始化显示命令集只读存储器dcsrom，并配置串行显示接口dsi的外部设备；例化已生成的所述程序，生成用于验证所述程序的所述仿真文件。可选地，如上所述的虚拟现实设备的配置方法中，所述程序的底层文件处于关闭状态，所述方法还包括：通过修改所述程序的顶层文件修改所述虚拟现实设备的部分参数设置。可选地，如上所述的虚拟现实设备的配置方法中，每个所述切换模块还包括至少一个可编程输出端口，所述方法还包括：通过修改所述程序的映射文件将对应切换模块中的高速信号从所述可编程输出端口输出。本发明实施例提供的虚拟现实设备和虚拟现实设备的配置方法，该虚拟现实设备包括至少一个切换模块和显示模块，其中，切换模块具有第一、第二输入端口和一个输出端口，该两个输入端口均用于输入高速信号，通过切换模块的控制向显示模块输出的高速信号为第一输入端口或第二输入端口对应的高速信号。本发明实施例提供的虚拟现实设备，可以通过切换模块中配置的软件程序进行高速信号的传递和切换，构建出输入的高速信号可以进行切换的vr一体分体机，解决了现有技术中的vr设备，由于输入的mipidsi信号无法实现信号切换，从而导致很难将一体机和分体机整合在一台设备中的问题。附图说明附图用来提供对本发明技术方案的进一步理解，并且构成说明书的一部分，与本申请的实施例一起用于解释本发明的技术方案，并不构成对本发明技术方案的限制。图1为本发明实施例提供的一种虚拟现实设备的硬件结构示意图；图2为本发明实施例中实现切换模块的一种assp器件的功能结构示意图；图3为本发明实施例中实现切换模块的一种assp器件的版图分布示意图；图4为本发明实施例中实现切换模块的一种assp器件的软件顶层构架示意图；图5为本发明实施例提供的另一种虚拟显示设备的硬件结构示意图；图6为本发明实施例提供的又一种虚拟显示设备的硬件结构示意图；图7为本发明实施例提供的再一种虚拟显示设备的硬件结构示意图；图8为本发明实施例提供的一种虚拟现实设备的配置方法的流程图；图9为本发明实施例提供的另一种虚拟现实设备的配置方法的流程图。具体实施方式为使本发明的目的、技术方案和优点更加清楚明白，下文中将结合附图对本发明的实施例进行详细说明。需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互任意组合。本发明提供以下几个具体的实施例可以相互结合，对于相同或相似的概念或过程可能在某些实施例不再赘述。图1为本发明实施例提供的一种虚拟现实设备的硬件结构示意图。本发明实施例提供的虚拟现实设备10，可以包括：至少一个切换模块110和显示模块120。其中，每个切换模块110包括第一输入端口111、第二输入端口112和输出端口113；其中，第一输入端口111和第二输入端口112，均用于输入高速信号。本发明实施例中的高速信号以mipidsi信号为例予以说明，该mipidsi信号为遵循mipi标准并由dsi接口传输的高速信号。每个切换模块110，用于控制本切换模块110的输出端口113向显示模块120输出本切换模块110的第一输入端口111或第二输入端口112对应的高速信号。本发明实施例提供的虚拟现实设备10，例如可以为一虚拟现实头盔，该虚拟现实设备10的显示模块120为虚拟现实头盔的显式面板，用户佩戴该虚拟现实头盔时可以通过左右显式面板看到形象且真实性高的视频。通常地，vr设备的输入可以通过vr设备的ap进行输入，此时vr设备为一体机，vr设备的输入还可以以一个人计算机(personalcomputer，简称为：pc)作为输入，此时vr设备为分体机。在本发明实施例中，虚拟现实设备10通过切换模块110接收输入的高速信号，该切换模块110可以通过第一输入端口111和第二输入端口112实现两路高速信号的输入，并向显示模块120输出其中一路高速信号，输入每个切换模块110的两路高速信号均为mipidsi信号。本发明实施例中切换模块110的作用为，控制本切换模块110的输出端口选择性的输出其中一个输入端口对应的高速信号，即实现二选一的输出功能。需要说明的是，本发明实施例中不限制切换模块110的数量，可以是一个、两个，还可以根据mipidsi信号对速率的需求，构建更多的切换模块110，图1所示虚拟现实设备10以设置有两个切换模块110为例予以示出。本发明实施例中的显示模块120，可以根据每个切换模块110输出的高速信号进行显示。需要说明的是，显示模块120在同一时刻仅能显示一种输入端口对应的高速信号，即同一时刻接收到的信号为所有切换模块110的第一输入端口111对应的高速信号，或者为所有切换模块110的第二输入端口112对应的信号，因此，虚拟现实设备10中若设置有多个切换模块110，所有切换模块110控制其自身的输出端口113输出的高速信号同时为第一输入端口111对应的高速信号，或者同时为第二输入端口112对应的高速信号。在实际应用中，第一输入端口111对应一种输入形式，例如为ap输入，第二输入端口112对应另一种输入形式，例如为pc输入。在实际应用中，本发明实施例中的切换模块110可以选用一集成电路(integratedcircuit，简称为：ic)芯片，通过ic芯片进行两路高速信号的切换，选用的ic芯片可以是典型的专用标准产品(applicationspecificstandardparts，简称为：assp)器件，用户可配置的输入/输出(input/output，简称为：io)数量为15对(pairs)，最大速率为1.2gb/s每条通道(perlane)，同时内置两个标准的4-lanemipid-phy(mipi协议在物理层上的定义)实现6gb/s的高速数据传输。如图2所示，为本发明实施例中实现切换模块的一种assp器件的功能结构示意图，图2所示左侧的io为rx信号，即输入端，右侧io为tx信号，即输出端，因此最大接收数据量14.4gb/s，其中12pairs用于高速信号的输入，3pairs为控制信号，最大发射数据量12gb/s。如图2所示，简要介绍用于实现切换模块的assp器件的基本性能，该assp器件具有现场可编程门阵列(fieldprogrammablegatearray，简称为：fpga)的特性，所有引脚均为双向输入输出，由于图2左侧部分的引脚rx支持d-phy，其中，在mipi协议中，d-phy提供了对串行显示接口(dsi)和串行摄像头接口(cameraserialinterface，简称为：csi)在物理层上的定义，所以本发明实施例将左侧部分的引脚作为输入，接收ap和pc发送过来的mipi信号，15pairs引脚对应3个mipi端口(3-ports)，每个mipidsi信号包括4对数据通道(对应4pairsio)和1对控制时钟，因此，12pairs引脚用于输入高速数据信号，3pairs引脚为控制信号，mipi信号输入的最大速率为：vin-max＝1.2gb/sperlane；右侧部分的引脚为tx，2-ports输出，故mipi信号输出的最大速率为：vout-max＝1.5gb/sperlane。因此，该assp器件可以同时输入3路mipidsi信号。需要说明的是，图2中示出了assp器件可支持的各项配置，例如可编程io可以作为输入端口(rx)和输出端口(tx)，作为rx时，支持的输入信号格式包括d-phy、sublvds、lvds、slvs200和cmos，作为tx时，支持的输出信号格式包括lvds和cmos，黑体字部分为assp器件用作本发明实施例中的信号处理模块110时选用的配置，例如可编程io作为rx，输入信号格式为d-phy，传输速率为＝1.2gb/sperlane，上面的可编程io采用7pairsio的形式，下面的可编程io采用8pairsio的形式；右侧的mipid-phy作为输出(tx)，其输出速率为6gb/s。图3为本发明实施例中实现切换模块的一种assp器件的版图分布示意图，该assp器件包括5936个4输入显示查找表lut4(fourinputlookuptables)，对应10个可编辑功能单元(programmablefunctionalunits，简称为：pfu)(图3中pfu中的方块示意性的表示多个lut4，但并非lut4的个数为图中方块的数量)，以实现逻辑(logic)、运算(arithmetic)、随机存取存储器(random-accessmemory，简称为：ram)和只读存储器(read-onlymemory，简称为：rom)等功能。pfu之间穿插系统内存嵌入式ram(sysmemtmembeddedblockram，简称为：ebr)行，周围分布可编辑(programmable)iobanks(如图3中的bank0、bank1和bank2)，此处的bank为assp器件中对输入端(rx)中io的分组，每个bank具有相同的配置，嵌入式双向二线制同步串行总线(inter-integratedcircuit，简称为：embeddedi2c)(如图3中的i2c0和i2c1)和embeddedmipid-phy(如图3中的mipid-phy0和mipid-phy1)，图3中空白区域为assp器件中的其它功能模块，在此不一一介绍。图3所示assp器件的版图对切换模块110内部的软件实现提供支持，如图4所示，为本发明实施例中实现切换模块的一种assp器件的软件顶层构架示意图。通过assp器件实现的切换模块110中，软件上以知识产权核(intellectualpropertycore，简称为：ip核)形式实现程序的逐级调用。一方面，输入端构架dphy2cmos.v文件形成dphy2cmosip核，该dphy2cmosip核用于例化softmipid-phyrxipwrapper，将d-phydatalanes的串行数据转换为32-比特(bit)(gear8)或64-bit(gear16)字符(words)并行传输，该dphy2cmosip核还用于例化包含有限状态机(finitestatemachines，简称为：fsms)的rx全局控制模块(rxglobalcontroller)，以检测rx时钟和数据lanes的状态转换。另一方面，构架先入先出队列(firstinputfirstoutput，简称为：fifo)同步(synchronization，缩写为：sync)(即fifo_sync.v)文件形成fifosync，该fifosync用于例化2个32-wordfifo，rx数据通过该fifosync到达tx的时钟域，一个fifo对应一个tx通道，需要说明的是，fifo的引入是为了满足mipid-phy协议中rx、tx的字节时钟(byteclock)必须一致而设置的，因此这两个fifosync仅用于时钟同步，不进行数据缓冲。再一方面，输出端构架cmos2dphy.v文件形成cmos2dphyip核，该cmos2dphyip核用于例化内置锁相环(phaselockedloop，简称为：pll)的hardmipid-phytxwrapper，实现数据并转串操作的同时调用tx全局控制模块(txglobalcontroller)检测tx时钟和数据lanes的状态转换；另外cmos2dphy.v文件还包含显示命令设置，但是dsi外设(dsislavemode)的显示命令集(displaycommandset，简称为：dcs)参数修正由dcs_rom.v文件执行。上述各文件构架出dsi2dsiip核，dsi2dsiip核与输入端和输出端整体形成dsi_2_dsiipwrapper。图4中输入dphy2cmosip核的一个mipidsi信号为1pair时钟信号(rx_clklane)和3pairs数据信号(rx_datalanes0-3)，控制信号(pd_ch0_i和pd_ch1_i)直接输入到cmos2dphyip核进行控制操作，图4中的两个cmos2dphyip核分别对应各自的输出通道(即txchannel0和txchannel1)，每个输出通道输出的mipidsi信号同样包括1pairclklane和3pairs数据信号(tx_datalanes0-3)。图4中的各ip核实现了图2中2个mipid-phy的功能。需要说明的是，图4所示assp器件的软件顶层构架为ip核叠加调用构架，本发明实施例的软件实现方案中，使用四个“.v”文件，实现ip核例化及分层调用，完成时钟、控制和数据三大信号的传递，底层文件为关闭状态，以避免误操作的产生。另外，通过仅修改上层文件，就可以实现虚拟现实设备10中大部分参数的修改，减少编译时间，易于产品升级。现有技术中的vr设备，通常为通过ap输入实现的一体机或通过pc输入实现的分体机，在一体分体两种模式切换的背景下，一体分体机成为vr设备的发展趋势，在构建vr一体分体机时，由于输出端通常采用遵循mipidsi接口协议的显示器件，然而，高速的mipidsi信号无法通过直接拓扑布线实现一体和分体两种模式下信号的切换，该问题成为在一台vr设备上整合一体机和分体机的难点。本发明实施例提供的虚拟现实设备10通过引入具有二选一输出功能的切换模块110，并且通过在该切换模块110内部构建ip核叠加调用构架，实现ip核例化和分层调用，以及完成信号传递等功能，实现了高速信号的切换。本发明实施例提供的虚拟现实设备，包括至少一个切换模块和显示模块，其中，切换模块具有第一、第二输入端口和一个输出端口，该两个输入端口均用于输入高速信号，通过切换模块的控制向显示模块输出的高速信号为第一输入端口或第二输入端口对应的高速信号。本发明实施例提供的虚拟现实设备，可以通过切换模块中配置的软件程序进行高速信号的传递和切换，构建出输入的高速信号可以进行切换的vr一体分体机，解决了现有技术中的vr设备，由于高速的mipidsi信号无法通过直接拓扑布线实现信号切换，从而导致很难将一体机和分体机整合在一台设备中的问题。进一步地，由于本发明实施例的切换模块110中可以配置有软件程序，因此还可以通过软件程序传递顶层(top_level)文件与底层(bottom_level)文件之间的输入输出(in-out)变量，例如通过宏定义的方式进行参数传递，修改顶层文件的同时即可自动修改底层文件，即采用联动机制，无需逐级修改，易于操作。可选地，如图1所示虚拟现实设备10，本发明实施例中的第一输入端口111，用于接收虚拟现实设备10的应用处理器(ap)输入的高速信号；第二输入端口112，用于接收外接设备输入的高速信号；该外接设备例如为一pc。需要说明的是，本发明实施例不限制向第一输入端口111和第二输入端口112输入高速信号的数据源，图1所示虚拟现实设备10只是一种示意性的实现方式。本发明各实施例以第一输入端口111对应ap输入，第二输入端口112对应pc输入为例予以示出。可选地，图5为本发明实施例提供的另一种虚拟显示设备的硬件结构示意图，在图1所示虚拟现实设备10的结构基础上，本发明实施例提供的虚拟现实设备10还可以包括：与部分切换模块110的第二输入端口112或全部切换模块110的第二输入端口112一一对应连接的压缩模块130。其中，每个压缩模块130的输入端口131，用于接收外接设备输入的高速信号；每个切换模块的第二输入端口112，用于接收外接设备输入的经过压缩模块130压缩后的高速信号。需要说明的是，图5所示虚拟现实设备10以包括一个切换模块110为例予以示出，此时，该虚拟现实设备10中的所有切换模块110均有对应的压缩模块130。在本发明实施例的一种可能的实现方式中，如图6所示，为本发明实施例提供的又一种虚拟显示设备的硬件结构示意图，图6所示虚拟现实设备10以包括两个切换模块110，并且仅有一个切换模块110具有对应的压缩模块130为例予以示出。可选地，本发明实施例中的压缩模块130可以内置于虚拟现实设备10的ap中，例如exynos8890，自带支持dsc压缩的ip内核，如图6所示压缩模块130；该压缩模块130还可以独立设置于虚拟现实设备10的应用处理器之外，如图5所示压缩模块130。可选地，图7为本发明实施例提供的再一种虚拟显示设备的硬件结构示意图，在图5所示虚拟现实设备10的结构基础上，本发明实施例提供的虚拟现实设备10中，外接设备(例如为pc)可以通过数据转换模块140连接压缩模块130的输入端口131；数据转换模块140，用于接收外接设备输入的hdmi信号，并将该hdmi信号转换为高速信号后传输给压缩模块130。图7所示虚拟显示设备10中，第一输入端口111为ap输入，该ap以exynos8890为例予以说明，该exynos8890中内置压缩模块130，该压缩模块130例如为视觉无损压缩标准(displaystreamcompression，简称为：dsc)压缩算法模块，可以实现1/3数据传输，第二输入端口112为pc输入，pc使用hdmi接口，需要设置一数据转换模块140将hdmi信号转换为mipidsi信号后送入切换模块110，该数据转换模块140可以为一桥芯片(bridgeic)。需要说明的是，本发明实施例不限制压缩模块的设置方式(独立设置或者内置于ap中)，以及压缩数据的具体方式，可以为上述实现1/3数据传输的压缩方式，还可以为其它压缩方式。可选地，本发明上述实施例提供的虚拟现实设备10中，还可以包括：与每个第一输入端口111和每个第二输入端口112一一对应连接的转接模块，该转接模块可以为一柔性电路板(flexibleprintedcircuit，简称为：fpc)。由于不同输入设备(例如不同ap或不同pc)的接口可能不同，在输入端口与输入设备之间设置转接fpc，可以使虚拟现实设备10的切换模块110的输入端口适应不同ap或不同pc的接口。因此，本发明实施例提供虚拟现实设备10，对于同一ap或pc输入，真实(real)与压缩数据格式，数据量的波动等仅修改软件程序即可实现，即修改切换模块中ip核的软件程序，图1所示实施例示出了实现real数据的传输方式，图5到图7所示实施例示出了实现压缩数据的传输方式；对于不同ap或pc输入，更换转接fpc即可，无需变更整体设备构架，有利于节省硬件成本，并且大大的缩短了设备的开发周期。从本发明上述实施例提供的虚拟现实设备10，以及图1、图5到图7所示意出的虚拟现实设备10可以看出，本发明实施例提供的虚拟现实设备10的结构灵活，可以配置多种传输速率，高速数据信号兼容真实(real)格式和压缩格式。可选地，本发明实施例提供的虚拟现实设备10中，每个切换模块110还包括至少一个可编程(programmable)io作为输出端口；相应地，每个切换模块110，还用于控制本切换模块110中的高速信号从可编程io输出。在本发明实施例中，同样以切换模块110为一assp器件为例予以示出，通过在assp器件上预留1～2个programmableio作为输出，该programmableio可以是assp器件内部的空闲io，也可以复用assp器件内部用于实现其它功能的io，例如启动io，可以对assp器件中的任一信号进行软件配置，通过配置映射(mapping)将assp器件内部的任一信号输出到该programmableio，并且通过示波器捕获观察，便于对比速度(speed)、区域(area)、时序(timing)等不同约束在实际设计产品中的运行效果，优化时序的同时可对比仿真结果快速硬件定位问题，极大的提高了调试效率。另外，预留的programmableio还可以用于虚拟现实设备10的后续扩展和升级。基于本发明上述各实施例提供的虚拟现实设备10，本发明实施例还提供一种虚拟现实设备的配置方法，该虚拟现实设备的配置方法用于对由本发明上述任一实施例提供的虚拟现实设备10进行软件配置。如图8所示，为本发明实施例提供的一种虚拟现实设备的配置方法的流程图。本实施例提供的方法用于对图1到图7所示任一实施例中的虚拟现实设备10中的切换模块110进行软件配置，本发明实施例提供的方法，可以包括如下步骤：s110，执行预先配置的程序的操作步骤。s120，生成程序的执行文件。本发明实施例提供的虚拟现实设备的配置方法，基于本发明实施例提供的虚拟现实设备10的硬件结构，具体指对切换模块进行软件配置，以实现ip例化、分层调用、高速信号传递和修改参数等功能，该虚拟现实设备例如可以为一虚拟显示头盔，该虚拟现实设备的显示模块为虚拟现实头盔的显式面板，用户佩戴该虚拟现实头盔时可以通过左右显式面板看到形象且真实性高的视频。通常地，vr设备的输入可以通过vr设备的ap进行输入，此时vr设备为一体机，vr设备的输入还可以以一个pc作为输入，此时vr设备为分体机。在本发实施例中，切换模块110可以选用合适的assp器件，以选用上述图2所示assp器件为例予以示出。在高速信号二选一的设计方案中，执行操作的程序是预先配置好的，在对切换模块110配置软件程序前，可以在器件编程软件中执行该预先配置的程序的操作步骤，例如包括：合成(synthesize)，编译和绘图(translate&map)，位置和路径(place&route)等，在程序满足设计要求的基础上可以生成该程序的执行文件。s130，将执行文件下载到每个切换模块中，通过该执行文件控制对应切换模块的输出端口向显示模块输出本切换模块的第一输入端口或第二输入端口对应的高速信号。在本发明实施例中，已在执行程序无误后生成该程序的执行文件，该执行文件例如为一“.bit”文件，随后，可以将“.bit”文件通过程序设计器(programmer)下载到assp器件中，从而进行硬件验证，即验证assp器件是否可以实现控制对应切换模块的输出端口向显示模块输出本切换模块的第一输入端口或第二输入端口对应的高速信号，以实现高速数据的切换功能。需要说明的是，本发明实施例中的“.bit”文件例如可以为图4所示assp器件器件的软件顶层构架的描述文件。现有技术中的vr设备，通常为通过ap输入实现的一体机或通过pc输入实现的分体机，在一体分体两种模式切换的背景下，一体分体机成为vr设备的发展趋势，在构建vr一体分体机时，由于输出端通常采用遵循mipidsi接口协议的显示器件，然而，高速的mipidsi信号无法通过直接拓扑布线实现一体和分体两种模式下信号的切换，该问题成为在一台vr设备上整合一体机和分体机的难点。本发明实施例通过对设置有具有二选一输出功能的切换模块110的虚拟现实设备10进行软件配置的方式，在切换模块110内部构建ip核叠加调用构架，实现ip核例化和分层调用，以及完成信号传递等功能，实现了高速信号的切换。发明实施例提供的虚拟现实设备的配置方法，在上述实施例提供的虚拟现实设备的硬件基础上，为其切换模块进行软件配置的方法，使得进行软件配置后的虚拟现实设备，可以通过切换模块的控制向显示模块输出的高速信号为第一输入端口或第二输入端口对应的高速信号。本发明实施例提供的虚拟现实设备的配置方法，通过对切换模块进行软件配置在其内形成ip核叠加调用构架，使虚拟现实设备可以进行高速信号的传递和切换，构建出输入的高速信号可以进行切换的vr一体分体机，解决了现有技术中的vr设备，由于输入的mipidsi信号无法实现信号切换，从而导致很难将一体机和分体机整合在一台设备中的问题。图9为本发明实施例提供的另一种虚拟现实设备的配置方法的流程图，在图8所示实施例的基础上，本发明实施例中的方法，在s110之前，还可以包括：s100，生成程序，初始化dcsrom，并配置dsi的外部设备。该dsi的外部设备可以是输入设备和输出设备。s101，例化已生成的程序，生成用于验证该程序的仿真文件。本发实施例在实际应用中，可以在器件编程软件中创建工程，选择支持assp器件，该器件编程软件可以支持采用不同的描述语音文件创建工程，例如可以采用verilog硬件描述语言(hardwaredescriptionlanguage，简称为：hdl)文件(files)、超高速集成电路硬件描述语言(very-high-speedintegratedcircuithardware，简称为：vhdl)files或testbenchfiles；在ipexpress工具中生成程序(即dsiip核)，并且初始化dcsrom，配置dsi的外部设备。随后，在程序的在顶层文件中例化已生成的ip核，修改dsi2dsi_rtl.do文件，该dsi2dsi_rtl.do文件为器件编程软件中的文件形式，设计人员根据需求修改文件生成针对上述程序的仿真文件，该仿真文件用于验证已生成的程序是否可以满足设计要求。s102，采用仿真文件对程序进行仿真；相应地，本发明实施例中的s110具体为：当验证仿真成功时，执行程序的操作步骤。上述已经说明，生成仿真文件的作用是为了验证程序是否满足设计要求，因此，需要采用仿真文件对程序进行仿真，在实际应用。当功能仿真验证ip核例化成功时，说明上述预先配置的程序满足设计要求，执行整个设计，即执行程序的操作步骤。可选地，本发明实施例提供的虚拟现实设备的配置方法，在s120之前还可以包括：s111，对程序进行时序仿真；s112，根据时序仿真的结果验证虚拟现实设备中的路径延迟。在本发明实施例中，在执行程序的操作步骤结束后，生成执行文件(“.bit”文件)之前，还可以进行一次后仿真，此次仿真具体为时序仿真，该次仿真的目的主要是为了验证设计布局布线后虚拟显示设备内部各个路径延迟，评估功耗等。可选地，在本发明实施例中，下载到切换模块110中的程序的执行文件，其底层文件处于关闭状态，基于该特性，本发明实施例提供的方法还可以包括：通过修改程序的顶层文件修改虚拟现实设备的部分参数设置。通过该方式修改参数设置有利于减少程序的编译时间，避免误操作，易于产品升级。可选地，基于切换模块110中已配置的软件程序，本发明实施例提供的方法还可以包括：对程序中顶层文件与底层文件之间的参数进行传递。在实际应用中，本发明实施例中的软件设计采用联动机制，例如通过宏定义的方式对顶层(top_level)文件与底层(bottom_level)文件之间的参数进行传递，即修改顶层文件的同时可以自动修改底层文件，无需逐级修改，易于操作。可选地，基于上述实施例提供的虚拟现实设备的切换模块上配置有至少一个programmableio作为输出端口的硬件基础上，本发明实施例提供的方法还可以包括：通过修改程序的映射文件将对应切换模块中的高速信号从programmableio输出。也就是说，将assp器件内部的任一信号输出到该programmableio，并且通过示波器捕获观察，便于对比速度(speed)、区域(area)、时序(timing)等不同约束在实际设计产品中的运行效果，优化时序的同时可对比仿真结果快速硬件定位问题，极大的提高了调试效率。另外，预留的programmableio还可以用于虚拟现实设备10的后续扩展和升级。参考图7和图8所示任一实施例提供的虚拟现实设备的配置方法，以及图4所示所示assp器件的软件顶层构架，可以看出，ip核叠加调用构架的软件参数划分合理，切换模块中软件程序配置的初始化过程，由ip核加载导入dcsrom初始化文件实现，初始化与正常运行状态的参数配置由dcsrom初始化文件分离，清晰明了整个初始化过程，也利于电路ic化转变；另外，cmos2dphy.v文件和dcs_rom.v文件则用于实现dsi主机模式(dsimastermode)与dsi外设模式(dsislavemode)的dcs分离，程序结构的清晰度高。虽然本发明所揭露的实施方式如上，但所述的内容仅为便于理解本发明而采用的实施方式，并非用以限定本发明。任何本发明所属领域内的技术人员，在不脱离本发明所揭露的精神和范围的前提下，可以在实施的形式及细节上进行任何的修改与变化，但本发明的专利保护范围，仍须以所附的权利要求书所界定的范围为准。当前第1页12当前第1页12