扩展存储器操作的制作方法

1.本公开总体上涉及半导体存储器和方法，并且更具体地涉及用于扩展存储器操作的设备、系统和方法。


背景技术：

2.存储器装置通常以内部半导体集成电路的形式设置于计算机或其它电子系统中。存在许多不同类型的存储器，包含易失性存储器和非易失性存储器。易失性存储器可能需要电力来维护其数据(例如，主机数据、错误数据等)并且包含随机存取存储器(ram)、动态随机存取存储器(dram)、静态随机存取存储器(sram)、同步动态随机存取存储器(sdram)和晶闸管随机存取存储器(tram)等等。非易失性存储器可以通过在不供电时保留所存储的数据来提供持久数据，并且可以包含nand闪速存储器、nor闪速存储器和电阻可变存储器(如相变随机存取存储器(pcram))、电阻式随机存取存储器(rram)和磁阻式随机存取存储器(mram)，如自旋扭矩转移随机存取存储器(stt ram)，等等。
3.存储器装置可以耦接到主机(例如，主机计算装置)，以在计算机或电子系统操作时存储供主机使用的数据、命令和/或指令。例如，当在计算系统或其它电子系统的操作期间，数据、命令和/或指令可以在主机与存储器装置之间转移。
附图说明
4.图1是根据本公开的若干个实施例的呈包含设备的计算系统的形式的功能框图，所述设备包含存储控制器和若干个存储器装置。
5.图2是根据本公开的若干个实施例的呈包含存储控制器的设备的形式的功能框图。
6.图3是根据本公开的若干个实施例的呈包含存储控制器的设备的形式的另一功能框图。
7.图4a是根据本公开的若干个实施例的呈包含存储控制器的设备的形式的又另一功能框图。
8.图4b是根据本公开的若干个实施例的呈包含存储控制器的设备的形式的又另一功能框图。
9.图4c是根据本公开的若干个实施例的呈包含存储控制器的设备的形式的又另一功能框图。
10.图5是根据本公开的若干个实施例的呈计算瓦片的形式的框图。
11.图6是根据本公开的若干个实施例的呈计算瓦片的形式的另一框图。
12.图7是根据本公开的若干个实施例的表示用于扩展存储器操作的示例方法的流程图。
具体实施方式
13.描述了与扩展存储器操作有关的系统、设备和方法。扩展存储器操作可以包含由单个地址和操作数指定的操作，并且可以由包含处理单元和存储器资源的计算装置来执行。所述计算装置可以在没有接收到中间命令的情况下对通过计算瓦片流式传输的数据执行扩展存储器操作。在实例中，计算装置被配置成：接收执行操作的命令，所述操作包括利用所述计算装置的所述处理单元对数据执行操作；并且确定对应于所述操作的操作数存储在所述存储器资源中。所述计算装置可以进一步使用存储在所述存储器资源中的所述操作数来执行所述操作。
14.如本文所使用的，“扩展存储器操作”是指可以由单个地址(例如，存储器地址)和操作数(如，64位操作数)指定的存储器操作。操作数可以表示为多个位(例如，一个位串或一串位)。然而，实施例不限于由64位操作数指定的操作，并且所述操作可以由与64位相比更大的操作数(例如，128位等)或更小的操作数(例如32位)指定。如本文所描述的，可访问以用于执行扩展存储器操作的有效地址空间是主机计算系统或存储控制器可访问的存储器装置或文件系统的大小。
15.扩展存储器操作可以包含可以由计算瓦片(例如，本文图d1
‑
6中展示的计算瓦片110/210/310/410/510/610)的处理装置(例如，如本文图5和6中展示的精简指令集计算装置536/636等处理装置)执行的指令和/或操作。在一些实施例中，执行扩展存储器操作可以包含：检索存储在存储器资源(例如，本文图5和6中展示的计算瓦片存储器538/638)中的数据和/或指令；在计算瓦片内执行操作(例如，不将数据或指令传送到计算瓦片外部的电路系统)；以及将扩展存储器操作的结果存储在计算瓦片的存储器资源中或辅助存储件(例如，存储器装置，如本文图1中展示的存储器装置116)中。
16.扩展存储器操作的非限制性实例可以包含浮点加法累加、32位复杂操作、平方根地址(sqrt(addr))操作、转换操作(例如，在浮点格式与整数格式之间转换，和/或在浮点格式与posit格式之间转换)、将数据归一化为固定格式、绝对值操作等。在一些实施例中，扩展存储器操作可以包含由计算瓦片执行的就地更新的操作(例如，其中扩展存储器操作的结果存储于在执行扩展存储器操作之前存储用于执行扩展存储器操作的操作数的地址处)，以及其中使用先前存储的数据来确定新数据的操作(例如，其中存储在特定地址处的操作数用于生成盖写存储操作数的特定地址的新数据的操作)。
17.因此，在一些实施例中，执行扩展存储器操作可以减轻或消除锁定或互斥操作，因为扩展存储器操作可以在计算瓦片内执行，这可以减少多个线程执行之间的竞争。例如，在执行扩展存储器操作期间降低或消除线程上的锁定或互斥操作的执行可以使计算系统性能提高，因为扩展存储器操作可以在同一计算瓦片内并行执行或者跨彼此通信的计算瓦片中的两个或更多个计算瓦片并行执行。另外，在一些实施例中，当本文描述的扩展存储器操作的结果从执行所述操作的计算瓦片传送到主机时，所述扩展存储器操作可以减轻或消除锁定或互斥操作。
18.存储器装置可以用于在计算装置中存储重要数据或关键数据，并且可以在与计算装置相关联的主机之间传送此类数据。然而，随着存储器装置所存储的数据的大小和数量的增加，往返于主机的数据传送可能变得既耗时又耗费资源。例如，当主机使用大数据块请求执行存储器操作时，强制请求所耗费的时间量和/或资源量可能与和数据块相关联的数
据的大小和/或数量成比例地增加。
19.随着存储器装置的存储能力的增加，这些影响可能变得更显著，因为越来越多的数据能够被存储器装置存储并且因此可用于存储器操作。另外，因为可以处理数据(例如，可以对数据执行存储器操作)，所以随着能够存储在存储器装置中的数据量的增加，可以处理的数据量也可以增加。这可能导致处理时间的增加和/或处理资源消耗的增加，所述处理时间的增加和/或处理资源消耗的增加在执行某些类型的存储器操作时可能会更严重。为了减轻这些和其它问题，本文的实施例可以允许使用存储器装置、一或多个计算瓦片和/或存储器阵列来执行扩展存储器操作。
20.在一些方法中，执行存储器操作可能需要多个时钟周期和/或对计算系统的如存储器装置和/或存储器阵列等存储器的多个函数调用。相比之下，本文的实施例可以允许执行扩展存储器操作，其中存储器操作用单个函数调用或命令来执行。例如，与利用至少一个命令和/或函数调用来加载要被操作的数据并且然后利用至少一个后续函数调用或命令来存储已经被操作的数据的方法相比，本文的实施例可以允许在没有至少一个函数调用或命令的情况下执行存储器操作。
21.与执行存储器操作需要多个函数调用和/或命令的方法相比，通过减少在执行存储器操作中利用的函数调用和/或命令的数量，可以减少在执行此类操作中消耗的时间量和/或在执行此类操作中消耗的计算资源量。进一步地，本文的实施例可以减少存储器装置和/或存储器阵列内的数据移动，因为数据可能不需要在执行存储器操作之前被加载到特定位置。与某些方法相比，这可以减少处理时间，尤其是在大量数据需要进行存储器操作的情况下。
22.进一步地，与一些方法相比，本文描述的扩展存储器操作可以允许更大的类型字段集。例如，由主机执行以请求使用存储器装置(例如，存储器子系统)中的数据执行操作的指令可以包含类型、地址和数据字段。所述类型可以对应于被请求的特定操作，所述地址可以对应于存储在执行操作中要使用的数据的地址，并且所述数据字段可以对应于执行操作中要使用的数据(例如，操作数)。在一些方法中，类型字段可能限于不同大小的读取和/或写入以及一些简单的整数累加操作。相比之下，本文的实施例可以允许利用更宽范围的类型字段，因为当执行扩展存储器操作时可以使用的有效地址空间可以对应于存储器装置的大小。通过扩展可用于执行操作的地址空间，本文的实施例因此可以允许更宽范围的类型字段，并且因此，与不允许有效地址空间(即存储器装置的大小)的方法相比，可以执行更宽范围的存储器操作。
23.在本公开的以下详细说明中，参考了附图，所述附图形成所述详细说明的一部分，并且在所述附图中，通过图解的方式示出了可以如何实践本公开的一或多个实施例。对这些实施例的描述的详细程度足以使本领域的普通技术人员能够实践本公开的实施例，并且应当理解的是，可以利用其它实施例，并且在不背离本公开的范围的情况下，可以做出工艺改变、电气改变和结构改变。
24.如本文所使用的，如“x”、“y”、“n”、“m”、“a”、“b”、“c”、“d”等指示符，尤其是关于附图中的附图标记的指示符，表明可以包含若干个如此指定的特定特征。还应当理解，本文使用的术语仅出于描述特定实施例的目的而并非旨在进行限制。如本文所使用的，除非上下文另外明确规定，否则单数形式“一(a)”、“一个(an)”和“所述(the)”可以包含单数个参考
物和复数个参考物两者。另外，“若干个”、“至少一个”以及“一或多个”(例如，若干个存储器组)可以指代一或多个存储器组，然而“多个”旨在指代不止一个此类物品。此外，贯穿本技术，词语“可以(can)”和“可以(may)”以允许的意义(即，有可能、能够)而非强制性的意义(即，必须)使用。术语“包含(include)”和其派生词意指“包含但不限于”。术语“耦接(coupled)”和“耦接(coupling)”意指物理地或用于访问以及移动(传输)命令和/或数据的直接或间接连接，视情况而定。术语“数据”和“数据值”在本文中可互换地使用并且可以具有相同的含义，视情况而定。
25.本文中的附图遵循编号惯例，其中一或多个第一数字对应于附图图号，并且其余数字标识附图中的元件或组件。可以通过使用类似的数字来标识不同图之间的类似元件或组件。例如，104可以引用图1中的元件“04”，并且类似的元件可以在图2中被引用为204。一组或多个类似的元件或组件通常可以在本文中用单个元件图号来指代。例如，多个参考元件110
‑
1、110
‑
2、
…
、110
‑
n通常可以被称为110。如将理解的，可以添加、交换和/或消除在本文的各个实施例中示出的元件，以提供本公开的若干个另外的实施例。另外，在图中提供的元件的比例和/或相对尺度旨在展示本公开的某些实施例并且不应以限制性的意义而采用。
26.图1是根据本公开的若干个实施例的呈包含设备的计算系统100的形式的功能框图，所述设备包含存储控制器104和若干个存储器装置116
‑
1、
…
、116
‑
n。如本文所使用的，“设备”可以指但不限于各种结构或结构组合中的任何结构或结构组合，如电路或电路系统、管芯或晶粒、一或多个模块、一或多个装置或一或多个系统。在图1展示的实施例中，存储器装置116
‑
1、
…
、116
‑
n可以包含一或多个存储器模块(例如，单列直插存储器模块、双列直插存储器模块等)。存储器装置116
‑
1、
…
、116
‑
n可以包含易失性存储器和/或非易失性存储器。在若干个实施例中，存储器装置116
‑
1、
…
、116
‑
n可以包含多芯片装置。多芯片装置可以包含若干种不同的存储器类型和/或若干个存储器模块。例如，存储器系统可以包含任何类型的模块上的非易失性或易失性存储器。
27.存储器装置116
‑
1、
…
、116
‑
n可以提供计算系统100的主存储器，或者可以用作整个计算系统100的另外的存储器或存储件。每个存储器装置116
‑
1、
…
、116
‑
n可以包含存储器胞元，例如，易失性存储器胞元和/或非易失性存储器胞元的一或多个阵列。阵列可以是具有例如nand架构的闪存阵列。实施例不限于特定类型的存储器装置。例如，存储器装置可以包含ram、rom、dram、sdram、pcram、rram和闪速存储器等等。
28.在存储器装置116
‑
1、
…
、116
‑
n包含非易失性存储器的实施例中，存储器装置116
‑
1、
…
、116
‑
n可以是闪速存储器装置，如nand或nor闪速存储器装置。然而，实施例不限于此，并且存储器装置116
‑
1、
…
、116
‑
n可以包含其它非易失性存储器装置，如非易失性随机存取存储器装置(例如，nvram、reram、feram、mram、pcm)、“新兴”存储器装置，如3
‑
d交叉点(3d xp)存储器装置等或其组合。非易失性存储器的3d xp阵列与可堆叠交叉网格数据存取阵列结合可以基于体电阻的改变执行位存储。另外，与许多基于闪速的存储器相比，3d xp非易失性存储器可以执行写入原地操作，其中可以在非易失性存储器胞元先前未被擦除的情况下对所述非易失性存储器胞元进行编程。
29.如图1中展示的，主机102可以耦接到存储控制器104，所述存储控制器可以继而耦接到存储器装置116
‑
1、
…
、116
‑
n。在若干个实施例中，每个存储器装置116
‑
1、
…
、116
‑
n可
以经由通道(例如，通道107
‑
1、
…
、107
‑
n)耦接到存储控制器104。在图1中，包含编排控制器106的存储控制器104经由通道103耦接到主机102，并且编排控制器106经由通道105耦接到主机102。主机102可以是主机系统如个人膝上型计算机、台式计算机、数字相机、智能电话、存储卡读取器和/或支持物联网的装置以及各种其它类型的主机，并且可以包含存储器存取装置，例如处理器(或处理装置)。本领域的普通技术人员应理解，“处理器”可以意指一或多个处理器，如并行处理系统、若干个协处理器等。
30.主机102可以包含系统主板和/或背板并且可以包含若干个处理资源(例如，一或多个处理器、微处理器或其它某种类型的控制电路系统)。在一些实施例中，主机102可以包含主机控制器101，例如，所述主机控制器可以被配置成通过生成命令并将命令传送到存储控制器104以引起如扩展存储器操作等操作的执行来控制主机102和/或所述存储控制器的至少一些操作。主机控制器101可以包含电路系统(例如，硬件)，所述电路系统可以被配置成控制主机102和/或存储控制器104的至少一些操作。例如，主机控制器101可以是专用集成电路(asic)、现场可编程门阵列(fpga)或被配置成控制主机102和/或存储控制器104的至少一些操作的电路系统和/或逻辑的其它组合。
31.系统100可以包含单独的集成电路，或者主机102、存储控制器104、编排控制器106、片上网络(noc)108和/或存储器装置116
‑
1、
…
、116
‑
n可以位于同一集成电路上。系统100可以是例如服务器系统和/或高性能计算(hpc)系统和/或其一部分。尽管图1中示出的实例展示了具有冯
·
诺依曼(von neumann)架构的系统，但是本公开的实施例可以在非冯
·
诺依曼架构上实施，所述非冯
·
诺依曼架构可以不包含通常与冯
·
诺依曼架构相关联的一或多个组件(例如，cpu、alu等)。
32.存储控制器104可以包含编排控制器106、片上网络(noc)108、多个计算瓦片110
‑
1、
…
、110
‑
n和媒体控制器112，所述多个计算瓦片在本文中结合图5和6进行更详细地描述。多个计算瓦片110在本文中可以被称为“计算装置”。编排控制器106(或者，为简单起见，“控制器”)可以包含被配置成在执行本文所述的操作期间向计算瓦片110
‑
1、
…
、110
‑
n分配和解除分配资源的电路系统和/或逻辑。例如，编排控制器106可以在执行本文所述的扩展存储器操作期间向计算瓦片110
‑
1、
…
、110
‑
n分配和解除分配资源。在一些实施例中，编排控制器106可以是专用集成电路(asic)、现场可编程门阵列(fpga)或被配置成编排由计算瓦片110
‑
1、
…
、110
‑
n执行的操作(例如，扩展存储器操作)的电路系统和/或逻辑的其它组合。例如，编排控制器106可以包含用于控制计算瓦片110
‑
1、
…
、110
‑
n对接收到的数据块执行操作从而对数据(例如，数据块)执行扩展存储器操作的电路系统和/或逻辑。
33.编排控制器106可以被配置成从存储器装置116
‑
1、
…
、116
‑
n中的一或多个存储器装置请求数据块，并且使计算瓦片110
‑
1、
…
、110
‑
n对数据块执行操作(例如，扩展存储器操作)。可以执行所述操作以评估可以由与数据块相关联的单个地址和一或多个操作数指定的函数。编排控制器106可以被进一步配置成使扩展存储器操作的结果被存储在计算瓦片110
‑
1、
…
、110
‑
n中的一或多个计算瓦片中和/或被传送到接口(例如，通信路径103和/或105)和/或主机102。
34.在一些实施例中，编排控制器106可以是多个计算瓦片110之一。例如，编排控制器106可以包含与计算瓦片110
‑
1、
…
、110
‑
n所包含的电路系统相同或相似的电路系统，如本文结合图4b更详细地描述的。然而，在一些实施例中，编排控制器106可以是与计算瓦片
110
‑
1、
…
、110
‑
n不同或分开的组件，并且因此可以包含与计算瓦片110不同的电路系统，如图1所示。
35.noc 108可以是允许编排控制器106与计算瓦片110
‑
1、
…
、110
‑
n之间的通信的通信子系统。noc 108可以包含用于促进编排控制器106与计算瓦片110
‑
1、
…
、110
‑
n之间的通信的电路系统和/或逻辑。在一些实施例中，如本文结合图2更详细地描述的，noc 108可以接收来自计算瓦片110
‑
1、
…
、110
‑
n的输出(例如，已经执行过扩展存储器操作的数据)并且将来自计算瓦片110
‑
1、
…
、110
‑
n的输出传送到编排控制器106和/或主机102，反之亦然。例如，noc 108可以被配置成接收已经经受由计算瓦片110
‑
1、
…
、110
‑
n进行的扩展存储器操作的数据，并且将与扩展存储器操作的结果相对应的数据传送到编排控制器106和/或主机102。在一些实施例中，如本文结合图4b更详细地描述的，noc 108可以包含编排控制器106的至少一部分。例如，noc 108可以包含包括编排控制器106或其一部分的电路系统。
36.尽管在图1中示出了noc 108，但是实施例不限于利用noc 108来在编排控制器106与计算瓦片110
‑
1、
…
、110
‑
n之间提供通信路径。例如，如存储控制器交叉开关(xbar)等其它通信路径可以用于促进计算瓦片110
‑
1、
…
、110
‑
n与编排控制器106之间的通信。
37.媒体控制器112可以是“标准”或“哑”媒体控制器。例如，媒体控制器112可以被配置成对存储器装置116
‑
1、
…
、116
‑
n执行简单的操作如复制、写入、读取、纠错等。然而，在一些实施例中，媒体控制器112不对与存储器装置116
‑
1、
…
、116
‑
n相关联的数据执行处理(例如，用于操纵数据的操作)。例如，媒体控制器112可以使读取和/或写入操作被执行以经由通信路径107
‑
1、
…
、107
‑
n从存储器装置116
‑
1、
…
、116
‑
n读取数据或经由所述通信路径将数据写入到所述存储器装置，但是媒体控制器112可以不对从存储器装置116
‑
1、
…
、116
‑
n读取的或写入到所述存储器装置的数据执行处理。在一些实施例中，媒体控制器112可以是非易失性媒体控制器，但是实施例不限于此。
38.图1的实施例可以包含未展示以免模糊本公开的实施例的另外的电路系统。例如，存储控制器104可以包含用于锁存通过i/o电路系统在i/o连接上提供的地址信号的地址电路系统。地址信号可以由行解码器和列解码器接收和解码，以存取存储器装置116
‑
1、
…
、116
‑
n。本领域的技术人员将理解，地址输入连接的数量可以取决于存储器装置116
‑
1、
…
、116
‑
n的密度和架构。
39.在一些实施例中，可以使用图1所示的计算系统100、通过选择性地将数据(例如，文件)存储或映射到计算瓦片110中来执行扩展存储器操作。数据可以被选择性地存储在计算瓦片存储器的地址空间(例如，如本文图5中展示的计算瓦片存储器538的块543
‑
1等部分)中。在一些实施例中，可以响应于从主机102和/或编排控制器106接收到的命令而将数据选择性地存储或映射在计算瓦片110中。在从主机102接收命令的实施例中，命令可以通过接口(例如，通信路径103和/或105)被传送到计算瓦片110。接口103/105可以是外围组件互连快速(pcie)总线、双数据速率(ddr)接口或其它合适的接口或总线。然而，实施例不限于此，并且在计算瓦片从编排控制器106接收命令的实施例中，命令可以直接从编排控制器106传送或通过noc 108传送。
40.在数据(例如，待用于执行扩展存储器操作的数据)被映射到计算瓦片110中的非限制性实例中，主机控制器101可以将命令传送到计算瓦片110以发起使用映射到计算瓦片110中的数据执行扩展存储器操作。在一些实施例中，主机控制器101可以查找对应于映射
到计算瓦片110中的数据的地址(例如，物理地址)，并且基于所述地址确定所述地址(并且因此，数据)被映射到哪个计算瓦片(例如，计算瓦片110
‑
1)。然后，命令可以被传送到包含地址(并且因此，数据)的计算瓦片(例如，计算瓦片110
‑
1)。
41.在一些实施例中，数据可以是64位操作数，但是实施例不限于具有特定大小或长度的操作数。在数据是64位操作数的实施例中，一旦主机控制器101基于存储数据的地址将用于发起执行扩展存储器操作的命令传送到正确的计算瓦片(例如，计算瓦片110
‑
1)，计算瓦片(例如，计算瓦片110
‑
1)就可以使用数据执行扩展存储器操作。
42.在一些实施例中，计算瓦片110可以跨连续地址空间单独寻址，这可以促进如本文所描述的扩展存储器操作的执行。也就是说，存储数据或数据映射到的地址对于所有计算瓦片110可以是唯一的，使得当主机控制器101查找所述地址时，所述地址对应于特定计算瓦片(例如，计算瓦片110
‑
1)中的位置。
43.例如，第一计算瓦片(例如，计算瓦片110
‑
1)可以具有与其相关联的第一组地址，第二计算瓦片(例如，计算瓦片110
‑
2)可以具有与其相关联的第二组地址，第三计算瓦片(例如，计算瓦片110
‑
3)可以具有与其相关联的第三组地址，直到第n计算瓦片(例如，计算瓦片110
‑
n)，所述第n计算瓦片可以具有与其相关联的第n组地址。也就是说，第一计算瓦片110
‑
1可以具有一组地址0000000到0999999，第二计算瓦片110
‑
2可以具有一组地址1000000到1999999，第三计算瓦片110
‑
3可以具有一组地址2000000到2999999，等等。应当理解，这些地址数字仅仅是说明性而非限制性的，并且可以取决于计算瓦片110的架构和/或大小(例如，存储容量)。
44.作为扩展存储器操作包括浮点加法累加操作(floatingpoint_add_accumulate)的非限制性实例，计算瓦片110可以将目的地地址视为浮点数，将浮点数添加到存储在计算瓦片110的所述地址处的自变数，并将结果存储回原始地址中。例如，当主机控制器101(或编排控制器106)发起执行浮点加法累加扩展存储器操作时，主机查找的计算瓦片110的地址(例如，数据映射到的计算瓦片中的地址)可以被视为浮点数，并且存储在所述地址中的数据可以被视为用于执行扩展存储器操作的操作数。响应于接收到用于发起扩展存储器操作的命令，数据(例如，本实例中的操作数)映射到的计算瓦片110可以执行加法操作，以将数据添加到地址(例如，地址的数值)并将加法结果存储回计算瓦片110的原始地址中。
45.如上所述，在一些实施例中，执行此类扩展存储器操作可以只需要将单个命令(例如，请求命令)从主机102(例如，从主机控制器101)传送到存储器装置104，或者从编排控制器106传送到计算瓦片110。相比于一些先前的方法，这可以减少例如多个命令通过接口103/105的时间量和/或数据(如操作数)在计算瓦片110内从一个地址移动到另一个地址的时间量。
46.另外，根据本公开的扩展存储器操作的执行可以进一步减少处理功率或处理时间的量，因为映射到执行扩展存储器操作的计算瓦片110中的数据可以用作扩展存储器操作的操作数和/或数据映射到的地址可以用作扩展存储器操作的操作数，这与在执行操作之前必须从不同位置检索和加载操作数的方法相反。也就是说，至少因为本文的实施例允许跳过操作数的加载，所以与加载操作数并随后存储在操作数之间执行的操作的结果的方法相比，计算系统100的性能可以得到改善。
47.进一步地，在一些实施例中，因为可以使用地址和存储在地址中的数据在计算瓦
片110内执行扩展存储器操作，并且在一些实施例中，因为扩展存储器操作的结果可以存储回原始地址中，所以在执行扩展存储器操作期间，可以减少或不需要锁定或互斥操作。在执行扩展存储器操作期间降低或消除线程上的锁定或互斥操作的执行可以使计算系统100的性能提高，因为扩展存储器操作可以在同一计算瓦片110内并行执行，或者跨计算瓦片110中的两个或更多个计算瓦片并行执行。
48.在一些实施例中，计算瓦片110中的数据的有效映射可以包含基地址、段大小和/或长度。基地址可以对应于存储数据映射的计算瓦片110中的地址。段大小可以对应于计算系统100可以处理的数据的量(例如，以字节为单位)，并且长度可以对应于与数据相对应的位的数量。应注意，在一些实施例中，存储在计算瓦片110中的数据在主机102上是不可缓存的。例如，可以在计算瓦片110内完全执行扩展存储器操作，而不会在执行扩展存储器操作期间阻碍或以其它方式向主机102传送数据或从所述主机传送数据。
49.在基地址为4096、段大小为1024并且长度为16,386的非限制性实例中，映射地址7234可以在第三段中，所述第三段可以对应于多个计算瓦片110中的第三计算瓦片(例如，计算瓦片110
‑
3)。在本实例中，主机102、编排控制器106和/或noc 108可以向第三计算瓦片110
‑
3转发执行扩展存储器操作的命令(例如，请求)。第三计算瓦片110
‑
3可以确定数据是否存储在第三计算瓦片110
‑
3的存储器(例如，本文图5和6展示的计算瓦片存储器538/638)中的映射地址中。如果数据存储在映射地址(例如，第三计算瓦片110
‑
3中的地址)中，则第三计算瓦片110
‑
3可以使用所述数据执行所请求的扩展存储器操作，并且可以将扩展存储器操作的结果存储回最初存储数据的地址中。
50.在一些实施例中，包含执行扩展存储器操作所请求的数据的计算瓦片110可以由主机控制器101、编排控制器106和/或noc 108来确定。例如，可用于所有计算瓦片110的总地址空间的一部分可以被分配给每个相应的计算瓦片。因此，主机控制器101、编排控制器106和/或noc 108可以被提供有与总地址空间的哪些部分对应于哪些计算瓦片110相对应的信息，并且因此可以指示相关的计算瓦片110执行扩展存储器操作。在一些实施例中，主机控制器101、编排控制器106和/或noc 108可以将对应于相应计算瓦片110的地址(或地址范围)存储在如表等数据结构中，并且基于存储在数据结构中的地址指示计算瓦片110执行扩展存储器操作。
51.然而，实施例不限于此，并且在一些实施例中，主机控制器101、编排控制器106和/或noc 108可以确定存储器资源(例如，本文图5和6展示的每个计算瓦片存储器538/638)的大小(例如，数据量)，并且基于与每个计算瓦片110相关联的存储器资源的大小和可用于所有计算瓦片110的总地址空间来确定哪个计算瓦片110存储将用于执行扩展存储器操作的数据。在主机控制器101、编排控制器106和/或noc 108基于可用于所有计算瓦片110的总地址空间和可用于每个计算瓦片110的存储器资源量来确定存储将用于执行扩展存储器操作的数据的计算瓦片110的实施例中，可以跨计算瓦片存储器资源的多个非重叠部分执行扩展存储器操作。
52.继续以上实例，如果所请求的地址中没有数据，则第三计算瓦片110
‑
3可以如本文结合图2、3、4a
‑
4c、5和6更详细描述的那样请求数据，并且一旦数据被加载到第三计算瓦片110
‑
3的地址中，就执行扩展存储器操作。在一些实施例中，一旦计算瓦片(例如，本实例中的第三计算瓦片110
‑
3)完成了扩展存储器操作，就可以通知编排控制器106和/或主机102，
和/或可以将扩展存储器操作的结果传送到编排控制器106和/或主机102。
53.图2是根据本公开的若干个实施例的呈包含存储控制器204的设备的形式的功能框图。存储控制器204可以类似于图1中展示的存储控制器104。如图2所示，存储控制器204可以包含媒体控制器212、多个计算瓦片210
‑
1、
…
、210
‑
n、片上网络(noc)208和编排控制器206。
54.媒体控制器212可以被配置成响应于来自编排控制器206或主机(如图1中展示的主机102)的请求而从耦接到存储控制器204的存储器装置(例如，图1中展示的存储器装置116
‑
1、
…
、116
‑
n)检索数据块211
a
‑
1、
…
、211
a
‑
n、211
b
‑
1、
…
、211
b
‑
n、211
c
‑
1、
…
、211
c
‑
n、211
d
‑
1、
…
、211
d
‑
n、211
e
‑
1、
…
、211
e
‑
n。媒体控制器随后可以使数据块211
a
‑
1、
…
、211
a
‑
n、211
b
‑
1、
…
、211
b
‑
n、211
c
‑
1、
…
、211
c
‑
n、211
d
‑
1、
…
、211
d
‑
n、211
e
‑
1、
…
、211
e
‑
n传送到计算瓦片210
‑
1、
…
、210
‑
n和/或编排控制器206。
55.类似地，媒体控制器212可以被配置成从计算瓦片210和/或编排控制器206接收数据块211
a
‑
1、
…
、211
a
‑
n、211
b
‑
1、
…
、211
b
‑
n、211
c
‑
1、
…
、211
c
‑
n、211
d
‑
1、
…
、211
d
‑
n、211
e
‑
1、
…
、211
e
‑
n。媒体控制器随后可以使数据块211
a
‑
1、
…
、211
a
‑
n、211
b
‑
1、
…
、211
b
‑
n、211
c
‑
1、
…
、211
c
‑
n、211
d
‑
1、
…
、211
d
‑
n、211
e
‑
1、
…
、211
e
‑
n传送到耦接到存储控制器204的存储器装置。
56.数据块211的大小可以为大约4千字节(但是实施例不限于此特定大小)，并且可以响应于由编排控制器206和/或主机生成的一或多个命令而由计算瓦片210
‑
1、
…
、210
‑
n以流式传输的方式进行处理。在一些实施例中，数据块211可以是32位、64位、128位等，字或数据组块和/或数据块211可以对应于在执行扩展存储器操作中使用的操作数。
57.例如，如本文结合图5和6更详细地描述的，因为计算瓦片210可以响应于完成对先前的数据块211执行扩展存储器操作而对第二数据块211执行扩展存储器操作(例如，处理)，所以当数据块211由计算瓦片210处理时，数据块211可以通过计算瓦片210连续地流式传输。在一些实施例中，数据块211可以在不存在来自编排控制器206和/或主机的中间命令的情况下以流式传输的方式通过计算瓦片210进行处理。也就是说，在一些实施例中，编排控制器206(或主机)可以发出命令以使计算瓦片210处理所述计算瓦片接收到的数据块211，并且随后由计算瓦片210接收到的数据块211可以在不存在来自编排控制器206的另外的命令的情况下进行处理。
58.在一些实施例中，处理数据块211可以包含使用数据块211执行扩展存储器操作。例如，计算瓦片210
‑
1、
…
、211
‑
n可以响应于来自编排控制器206的命令而对数据块211执行扩展存储器操作，以评估一或多个功能，移除不需要的数据，提取相关数据或者结合扩展存储器操作的执行以其它方式使用数据块211。
59.在数据(例如，用于执行扩展存储器操作的数据)被映射到计算瓦片210中的一或多个计算瓦片中的非限制性实例中，编排控制器206可以将命令传送到计算瓦片206，以发起使用映射到计算瓦片210中的数据执行扩展存储器操作。在一些实施例中，编排控制器206可以查找对应于映射到计算瓦片210中的数据的地址(例如，物理地址)，并且基于所述地址确定所述地址(并且因此，数据)映射到哪个计算瓦片(例如，计算瓦片210
‑
1)。然后，命令可以被传送到包含地址(并且因此，数据)的计算瓦片(例如，计算瓦片210
‑
1)。在一些实施例中，命令可以通过noc 208传送到计算瓦片(例如，计算瓦片210
‑
1)。
60.编排控制器206(或主机)可以被进一步配置成向计算瓦片210
‑
1、
…
、210
‑
n发送命令以分配和/或解除分配可用于在使用数据块211执行扩展存储器操作中使用的计算瓦片210
‑
1、
…
、210
‑
n的资源。在一些实施例中，分配和/或解除分配可用于计算瓦片210
‑
1、
…
、210
‑
n的资源可以包含选择性地启用计算瓦片210中的一些计算瓦片，同时选择性地禁用计算瓦片210中的一些计算瓦片。例如，如果需要少于总数的计算瓦片210来处理数据块211，则编排控制器206可以向要用于处理数据块211的计算瓦片210发送命令，以仅启用期望处理数据块211的那些计算瓦片210。
61.在一些实施例中，编排控制器206可以进一步被配置成发送命令以使由计算瓦片210执行的操作(如扩展存储器操作)的执行同步。例如，编排控制器206(和/或主机)可以向第一计算瓦片(例如，计算瓦片210
‑
1)发送命令以使第一计算瓦片执行第一扩展存储器操作，并且编排控制器206(或主机)可以向第二计算瓦片(例如，计算瓦片210
‑
2)发送命令以使用第二计算瓦片执行第二扩展存储器操作。通过编排控制器206使由计算瓦片210执行的操作(如扩展存储器操作)的执行同步可以进一步包含使计算瓦片210在特定时间或以特定顺序执行特定操作。
62.如上所述，由执行扩展存储器操作产生的数据可以存储在计算瓦片210中的在执行扩展存储器操作之前数据所被存储的原始地址中，然而，在一些实施例中，由执行扩展存储器操作产生的数据块可以在执行扩展存储器操作之后转换成逻辑记录213
‑
1、
…
、213
‑
n。逻辑记录213可以包括与其物理位置无关的数据记录。例如，逻辑记录213可以是指向计算瓦片210中的至少一个计算瓦片中的地址(例如，位置)的数据记录，在所述地址中存储了与执行扩展存储器操作相对应的物理数据。
63.如本文结合图5和6更详细地描述的，扩展存储器操作的结果可以存储在计算瓦片存储器(例如，图5中展示的计算瓦片存储器538或图6中展示的计算瓦片存储器638)的地址中，所述地址与在执行扩展存储器操作之前存储数据的地址相同。然而，实施例不限于此，并且扩展存储器操作的结果可以存储在计算瓦片存储器的地址中，所述地址与在执行扩展存储器操作之前存储数据的地址相同。在一些实施例中，逻辑记录213可以指向这些地址位置，使得扩展存储器操作的结果可以从计算瓦片210进行存取并且传送到计算瓦片210外部的电路系统(例如，主机)。
64.在一些实施例中，编排控制器206可以直接从媒体控制器212接收数据块211
e
‑
1、
…
、211
e
‑
n和/或直接将所述数据块发送到所述媒体控制器。这可以允许编排控制器206将未由计算瓦片210处理的数据块211
e
‑
1、
…
、211
e
‑
n(例如，未用于执行扩展存储器操作的数据块)传送到媒体控制器212并且将所述数据块从所述媒体控制器传送。
65.例如，如果编排控制器206从耦接到存储控制器204的主机(例如，图1中展示的主机102)接收到待由耦接到存储控制器204的存储器装置(例如，图1中展示的存储器装置116)存储的未处理的数据块211
e
‑
1、
…
、211
e
‑
n，则编排控制器206可以使未处理的数据块211
e
‑
1、
…
、211
e
‑
n传送到媒体控制器212，所述媒体控制器继而可以使未处理的数据块211
e
‑
1、
…
、211
e
‑
n传送到耦接到存储控制器204的存储器装置。
66.类似地，如果主机请求未处理的(例如，完整的)数据块(例如，未由计算瓦片210处理的数据块)，则媒体控制器212可以使完整的数据块211
e
‑
1、
…
、211
e
‑
n传送到编排控制器206，所述编排控制器可以随后将未处理的数据块211
e
‑
1、
…
、211
e
‑
n传送到主机。
67.图3是根据本公开的若干个实施例的呈包含存储控制器304的设备的形式的另一功能框图。存储控制器304可以类似于本文图1中展示的存储控制器104或图2中展示的存储控制器204。如图3所示，存储控制器304可以包含媒体控制器312、多个计算瓦片310
‑
1、
…
、310
‑
n、片上网络(noc)308和编排控制器306。
68.媒体控制器312可以被配置成响应于来自编排控制器306的请求而从耦接到存储控制器304的存储器装置(例如，图1中展示的存储器装置116
‑
1、
…
、116
‑
n)检索数据块311
a
‑
1、
…
、311
a
‑
n、311
b
‑
1、
…
、311
b
‑
n、311
c
‑
1、
…
、311
c
‑
n、311
d
‑
1、
…
、311
d
‑
n、311
e
‑
1、
…
、311
e
‑
n和/或逻辑记录313
a
‑
1、
…
、313
a
‑
n、313
b
‑
1、
…
、313
b
‑
n、313
c
‑
1、
…
、313
c
‑
n、313
d
‑
1、
…
、313
d
‑
n、313
e
‑
1、
…
、313
e
‑
n。媒体控制器随后可以使数据块311
a
‑
1、
…
、311
a
‑
n、311
b
‑
1、
…
、311
b
‑
n、311
c
‑
1、
…
、311
c
‑
n、311
d
‑
1、
…
、311
d
‑
n、311
e
‑
1、
…
、311
e
‑
n和/或逻辑记录313
a
‑
1、
…
、313
a
‑
n、313
b
‑
1、
…
、313
b
‑
n、313
c
‑
1、
…
、313
c
‑
n、313
d
‑
1、
…
、313
d
‑
n、313
e
‑
1、
…
、313
e
‑
n传送到计算瓦片310
‑
1、
…
、310
‑
n和/或编排控制器306。
69.类似地，媒体控制器312可以被配置成从计算瓦片310和/或编排控制器306接收数据块311
a
‑
1、
…
、311
a
‑
n、311
b
‑
1、
…
、311
b
‑
n、311
c
‑
1、
…
、311
c
‑
n、311
d
‑
1、
…
、311
d
‑
n、311
e
‑
1、
…
、311
e
‑
n和/或逻辑记录313
a
‑
1、
…
、313
a
‑
n、313
b
‑
1、
…
、313
b
‑
n、313
c
‑
1、
…
、313
c
‑
n、313
d
‑
1、
…
、313
d
‑
n、313
e
‑
1、
…
、313
e
‑
n。媒体控制器随后可以使数据块311
a
‑
1、
…
、311
a
‑
n、311
b
‑
1、
…
、311
b
‑
n、311
c
‑
1、
…
、311
c
‑
n、311
d
‑
1、
…
、311
d
‑
n、311
e
‑
1、
…
、311
e
‑
n和/或逻辑记录313
a
‑
1、
…
、313
a
‑
n、313
b
‑
1、
…
、313
b
‑
n、313
c
‑
1、
…
、313
c
‑
n、313
d
‑
1、
…
、313
d
‑
n、313
e
‑
1、
…
、313
e
‑
n传送到耦接到存储控制器304的存储器装置。
70.数据块311的大小可以为大约4千字节，并且可以响应于由编排控制器306和/或主机生成的一或多个命令而由计算瓦片310
‑
1、
…
、310
‑
n以流式传输的方式进行处理。在一些实施例中，数据块311可以是32位、64位、128位等，字或数据组块和/或数据块311可以对应于在执行扩展存储器操作中使用的操作数。在一些实施例中，处理数据块311可以包含使用数据块311执行扩展存储器操作。例如，计算瓦片310
‑
1、
…
、310
‑
n可以响应于来自编排控制器306和/或主机的命令而对数据块311执行扩展存储器操作。例如，计算瓦片310
‑
1、
…
、310
‑
n可以响应于来自编排控制器306和/或主机的命令而处理数据块311，生成逻辑记录313，和/或将逻辑记录传送到计算瓦片310外部的位置。
71.图4a
‑
4c展示了根据本公开的若干个实施例的呈包含存储控制器404的设备的形式的功能框图的各种实例。在图4a
‑
4c中，媒体控制器412与多个计算瓦片410、noc 408和编排控制器406通信，所述编排控制器与输入/输出(i/o)缓冲器422通信。尽管在图4a
‑
4c中示出了八(8)个离散的计算瓦片410，但是应当理解，实施例不限于包含八个离散的计算瓦片410的存储控制器404。例如，存储控制器404可以包含一或多个计算瓦片410，这取决于存储控制器404和/或其中部署有存储控制器404的整个系统的特性。
72.如图4a
‑
4c所示，媒体控制器412可以包含直接存储器存取(dma)组件418和dma通信子系统419。dma 418可以促进媒体控制器418与如图1中展示的存储器装置116
‑
1、
…
、116
‑
n等存储器装置之间的通信，所述存储器装置独立于如图1中展示的主机102等主机的中央处理单元而耦接到存储控制器404。dma通信子系统419可以是如交叉开关(“xbar”)、片上网络或允许在媒体控制器412、耦接到存储控制器404的存储装置和/或计算瓦片410之间进行互连和互操作的其它通信子系统等通信子系统。
73.在一些实施例中，noc 408可以促进计算瓦片410的相应地址空间之间的可见性。例如，每个计算瓦片410
‑
1、
…
、410
‑
8可以响应于接收到数据和/或文件而将所述数据存储在计算瓦片410的存储器资源(例如，本文图5和6中展示的计算瓦片存储器548或计算瓦片存储器638)中。计算瓦片410可以将与计算瓦片410存储器资源中的存储有数据的位置相对应的地址(例如，物理地址)相关联。另外，计算瓦片410可以将与数据相关联的地址解析(例如，分解)为逻辑块。
74.在一些实施例中，可以将与数据相关联的第零逻辑块传送到处理装置(例如，本文图5和6中展示的精简指令集计算(risc)装置536或risc装置636)。特定计算瓦片(例如，计算瓦片410
‑
2)可以被配置成识别特定的逻辑地址集对于所述计算瓦片410
‑
2是可存取的，而其它计算瓦片(例如，计算瓦片410
‑
3、410
‑
4等)可以被配置成识别不同的逻辑地址集对于那些计算瓦片410是可存取的。换句话说，第一计算瓦片(例如，计算瓦片410
‑
2)可以存取与所述计算瓦片410
‑
2相关联的第一逻辑地址集，并且第二计算瓦片(例如，计算瓦片410
‑
3)可以存取与所述第二计算瓦片相关联的第二逻辑地址集，等等。
75.如果在第一计算瓦片(例如，计算瓦片410
‑
2)处请求与第二逻辑地址集(例如，第二计算瓦片410
‑
3可存取的逻辑地址)相对应的数据，则noc 408可以促进第一计算瓦片(例如，计算瓦片410
‑
2)与第二计算瓦片(例如，计算瓦片410
‑
3)之间的通信，以允许第一计算瓦片(例如，计算瓦片410
‑
2)存取与第二逻辑地址集(例如，第二计算瓦片410
‑
3可存取的逻辑地址集)相对应的数据。也就是说，noc 408可以促进计算瓦片410之间的通信，以允许计算瓦片410的地址空间彼此可见。
76.在一些实施例中，计算瓦片410之间的促进地址可见性的通信可以包含：通过第一计算瓦片(例如，计算瓦片410
‑
1)的事件队列(例如，图5和6中展示的事件队列532和632)来接收请求存取与第二逻辑地址集相对应的数据的消息；将所请求的数据加载到第一计算瓦片的存储器资源(例如，本文图5和6中展示的计算瓦片存储器538和638)中；以及将所请求的数据传送到消息缓冲器(例如，本文图5和6中展示的消息缓冲器534和634)。一旦数据已由消息缓冲器缓冲，就可以通过noc 408将数据传送到第二计算瓦片(例如，计算瓦片410
‑
2)。
77.例如，在执行扩展存储器操作期间，编排控制器406和/或第一计算瓦片(例如，计算瓦片410
‑
1)可以确定由主机命令(例如，由如图1中展示的主机102等主机生成的用于发起执行扩展存储器操作的命令)指定的地址对应于多个计算瓦片410中的第二计算瓦片(例如，计算瓦片410
‑
2)的存储器资源中的位置。在这种情况下，可以生成计算瓦片命令，并将计算瓦片命令从编排控制器406和/或第一计算瓦片410
‑
1发送到第二计算瓦片410
‑
2，以发起使用存储在由计算瓦片命令指定的地址处的第二计算瓦片410
‑
2的存储器资源中的操作数来执行扩展存储器操作。
78.响应于接收到计算瓦片命令，第二计算瓦片410
‑
2可以使用存储在由计算瓦片命令指定的地址处的第二计算瓦片410
‑
2的存储器资源中的操作数来执行扩展存储器操作。这可以减少来自主机与存储控制器和/或计算瓦片410之间的命令流量，因为主机不需要生成另外的命令来引起执行扩展存储器操作，这可以通过例如减少与向主机传送命令和从主机传送命令相关联的时间来提高计算系统的整体性能。
79.在一些实施例中，编排控制器406可以确定执行扩展存储器操作可以包含执行多
个子操作。例如，扩展存储器操作可以被解析或分解成两个或更多个子操作，所述子操作可以作为执行整个扩展存储器操作的一部分来执行。在这种情况下，编排控制器406和/或noc 408可以利用上述地址可见性来促进各个计算瓦片410执行子操作。响应于子操作的完成，编排控制器406可以使子操作的结果合并成与扩展存储器操作的结果相对应的单个结果。
80.在其它实施例中，请求存储在计算瓦片410中的数据的应用可以知道哪些计算瓦片410包含所请求的数据。在此实例中，所述应用可以从相关的计算瓦片410请求数据，和/或地址可以被加载到多个计算瓦片410中并且可以通过noc 408由请求数据的应用来存取。
81.如图4a所示，编排控制器406包括与noc 408物理分离的离散电路系统。noc 408可以是以一或多个集成电路的形式提供的通信子系统，所述通信子系统允许计算瓦片410、媒体控制器412和/或编排控制器406之间进行通信。noc 408的非限制性实例可以包含xbar或允许编排控制器406、计算瓦片410和/或媒体控制器412进行互连和/或互操作的其它通信子系统。
82.如上所述，响应于接收到由编排控制器406、noc 408和/或主机(例如，图1中展示的主机102)生成的命令，可以实现使用存储在计算瓦片410中的数据和/或来自通过计算瓦片410流式传输的数据块的数据执行扩展存储器操作。
83.如图4b所示，编排控制器406驻留在多个计算瓦片410
‑
1、
…
、410
‑
8中的计算瓦片410
‑
1之一上。如本文所使用的，术语“驻留在
…
上”是指物理地位于特定组件上的某物。例如，编排控制器406“驻留在”计算瓦片410之一上是指编排控制器406物理耦接到特定计算瓦片的条件。术语“驻留在
…
上”可以在本文中与如“部署在
…
上”或“位于
…
上”等其它术语互换使用。
84.如上所述，响应于接收到由计算瓦片410
‑
1/编排控制器406、noc 408和/或主机生成的命令，可以实现使用存储在计算瓦片410中的数据和/或来自通过计算瓦片410流式传输的数据块的数据执行扩展存储器操作。
85.如图4c所示，编排控制器406驻留在noc 408上。在一些实施例中，将编排控制器406设置为noc 408的一部分使得编排控制器406和noc 408紧密耦接，这可以减少使用编排控制器406执行扩展存储器操作的时间消耗。
86.如上所述，响应于接收到由编排控制器406、noc 408和/或主机生成的命令，可以实现使用存储在计算瓦片410中的数据和/或来自通过计算瓦片410流式传输的数据块的数据执行扩展存储器操作。
87.图5是根据本公开的若干个实施例的呈计算瓦片510的形式的框图。如图5所示，计算瓦片510可以包含：排队电路系统，所述排队电路系统可以包含系统事件队列530和/或事件队列532；以及消息缓冲器534(例如，出站缓冲电路系统)。计算瓦片510可以进一步包含如精简指令集计算(risc)装置536等处理装置(例如，处理单元)、计算瓦片存储器538部分和直接存储器存取缓冲器539(例如，入站缓冲电路系统)。risc装置536可以是可以采用如risc
‑
v isa等精简指令集架构(isa)的处理资源，然而实施例不限于risc
‑
v isa，并且可以使用其它处理装置和/或isa。为了简单起见，risc装置536可以被称为“处理单元”。在一些实施例中，图5中示出的计算瓦片510可以用作编排控制器(例如，本文图1
‑
4中展示的编排控制器106/206/306/406)。
88.系统事件队列530、事件队列532和消息缓冲器534可以与如图1
‑
4中分别展示的编
排控制器106、206、306和406等编排控制器通信。在一些实施例中，系统事件队列530、事件队列532和消息缓冲器534可以与编排控制器直接通信，或者系统事件队列530、事件队列532和消息缓冲器534可以与片上网络(如分别在图1
‑
3中展示的noc 108、208和308)进行通信，所述片上网络可以进一步与编排控制器和/或主机(如图1中展示的主机102)通信。
89.系统事件队列530、事件队列532和消息缓冲器534可以从编排控制器和/或主机接收消息和/或命令和/或可以向编排控制器和/或主机发送消息和/或命令，以控制计算瓦片510的操作，以便对由计算瓦片510存储的数据(例如，本文图2和3中展示的数据块211和311)执行扩展存储器操作。在一些实施例中，命令和/或消息可以包含用于在执行扩展存储器操作期间分配或解除分配可用于计算瓦片510的资源的消息和/或命令。另外，命令和/或消息可以包含用于使计算瓦片510的操作与部署在存储控制器(例如，图1
‑
4中分别展示的存储控制器104、204、304和404)中的其它计算瓦片同步的命令和/或消息。
90.例如，系统事件队列530、事件队列532和消息缓冲器534可以促进计算瓦片510、编排控制器和/或主机之间的通信，以使计算瓦片510使用存储在计算瓦片存储器538中的数据来执行扩展存储器操作。在非限制性实例中，系统事件队列530、事件队列532和消息缓冲器534可以处理从编排控制器和/或主机接收到的命令和/或消息，以使计算瓦片510对存储的数据和/或与存储数据的计算瓦片存储器538内的物理地址相对应的地址执行扩展存储器操作。这可以允许在将数据传送到计算瓦片510外部的电路系统(如编排控制器、noc或主机(例如，本文图1中展示的主机102))之前，使用存储在计算瓦片存储器538中的数据来执行扩展存储器操作。
91.系统事件队列530可以从编排控制器或noc接收中断消息。中断消息可以由系统事件队列532处理，以使从编排控制器、主机或noc发送的命令或消息立即执行。例如，中断消息可以指示系统事件队列532使计算瓦片510中止未决命令或消息的操作，并且代替地执行从编排控制器、主机或noc接收到的新命令或消息。在一些实施例中，新命令或消息可以涉及发起使用存储在计算瓦片存储器538中的数据的扩展存储器操作的命令或消息。
92.事件队列532可以接收可以串行处理的消息。例如，事件队列532可以从编排控制器、主机或noc接收消息和/或命令，并且可以以串行方式处理接收到的消息，使得按照接收消息的顺序来处理消息。可以由事件队列接收并处理的消息的非限制性实例可以包含来自编排控制器和/或noc的发起对数据块的处理的请求消息(例如，计算瓦片510上的远程程序调用)、来自其它计算瓦片的提供或改变接收消息请求的计算瓦片的计算瓦片存储器538中的特定存储器位置的内容的请求消息(例如，用于发起在计算瓦片之间进行远程读取或写入操作的消息)、来自其它计算瓦片的使使用存储在计算瓦片中的数据执行扩展存储器操作同步的同步消息请求等。
93.消息缓冲器534可以包括缓冲区域以缓冲要从计算瓦片510被传送到计算瓦片510外部的电路系统(如编排控制器、noc和/或主机)的数据。在一些实施例中，消息缓冲器534可以以串行方式操作，使得数据(例如，扩展存储器操作的结果)按照由消息缓冲器534接收数据的顺序从缓冲器传送出计算瓦片510。消息缓冲器534可以进一步通过控制数据从消息缓冲器534传送的速率来提供路由控制和/或瓶颈控制。例如，消息缓冲器534可以被配置成以允许在不对编排控制器、noc和/或主机造成数据瓶颈或路由问题的情况下从计算瓦片510传送数据的速率来从计算瓦片510传送数据。
94.risc装置536可以与系统事件队列530、事件队列532和消息缓冲器534通信，并且可以处理由系统事件队列530、事件队列532和消息缓冲器534接收到的命令和/或消息，以促进对由计算瓦片510存储或接收到的数据执行操作。例如，risc装置536可以包含被配置成处理命令和/或消息以引起使用由计算瓦片510存储或接收到的数据来执行扩展存储器操作的电路系统。risc装置536可以包含单核或者可以是多核处理器。
95.在一些实施例中，计算瓦片存储器538可以是如随机存取存储器(例如，ram、sram等)等存储器资源。然而，实施例不限于此，并且计算瓦片存储器538可以包含各种寄存器、高速缓存、缓冲器和/或存储器阵列(例如，1t1c、2t2c、3t等dram阵列)。计算瓦片存储器538可以被配置成接收并存储来自例如存储器装置(如本文图1中展示的存储器装置116
‑
1、
…
、116
‑
n)的数据。在一些实施例中，计算瓦片存储器538的大小可以为大约256千字节(kb)，然而实施例不限于此特定大小，并且计算瓦片存储器538的大小可以大于或小于256kb。
96.计算瓦片存储器538可以被划分成一或多个可寻址存储器区域。如图5所示，计算瓦片存储器538可以被划分成可寻址存储器区域，从而可以在其中存储各种类型的数据。例如，一或多个存储器区域可以存储由计算瓦片存储器538使用的指令(“instr”)541，一或多个存储器区域可以存储数据543
‑
1、
…
、543
‑
n，所述数据可以在执行扩展存储器操作期间用作操作数，和/或一或多个存储器区域可以用作计算瓦片存储器538的本地存储器(“local mem.”)545部分。尽管在图5中示出了二十(20)个不同的存储器区域，但是应当理解，计算瓦片存储器538可以被划分为任意数量的不同的存储器区域。
97.如以上所讨论的，可以响应于由编排控制器(例如，本文图1
‑
4中展示的编排控制器106、206、306、406)和/或主机(例如，本文图1中展示的主机102)生成的消息和/或命令而从存储器装置检索数据并且将数据存储在计算瓦片存储器538中。在一些实施例中，命令和/或消息可以由如在图1
‑
4中分别展示的媒体控制器112、212、312或412等媒体控制器处理。一旦数据由计算瓦片510接收，所述数据就可以由dma缓冲器539缓冲并且随后被存储在计算瓦片存储器538中。
98.因此，在一些实施例中，计算瓦片510可以提供对从存储器装置接收到的数据的操作的数据驱动执行。例如，计算瓦片510可以响应于从存储器装置接收到数据而开始对所述数据执行操作(例如，扩展存储器操作等)。
99.例如，因为从存储器装置到计算瓦片510的数据传送的不确定性(例如，因为在将数据传送到计算瓦片510之前由媒体控制器执行纠错操作而使得某些数据可能花费更长的时间才能到达计算瓦片510等)，所以与不以数据驱动的方式工作的方法相比，对数据的操作的数据驱动执行可以提高计算性能。
100.在一些实施例中，编排控制器可以发送由计算瓦片510的系统事件队列530接收到的命令或消息。如上所述，命令或消息可以是指示计算瓦片510请求数据并对数据执行扩展存储器操作的中断。然而，由于从存储器装置到计算瓦片510的数据传送的不确定性，数据可能没有立即准备好从存储器装置发送到计算瓦片510。然而，一旦数据由计算瓦片510接收，计算瓦片510就可以立即开始使用数据执行扩展存储器操作。换句话说，计算瓦片510可以响应于接收到数据而开始对数据执行扩展存储器操作，而不需要来自外部电路系统(如主机)的用于引起执行扩展存储器操作的另外的命令或消息。
101.在一些实施例中，可以通过选择性地在计算瓦片存储器538中移动数据以执行所
请求的扩展存储器操作来执行扩展存储器操作。在请求执行浮点加法累加扩展存储器操作的非限制性实例中，可以将其中存储在执行扩展存储器操作中待用作操作数的数据的计算瓦片存储器538中的地址添加到数据中，并且浮点加法累加操作的结果可以存储于在执行浮点加法累加扩展存储器操作之前存储数据的计算瓦片存储器538中的地址中。在一些实施例中，risc装置536可以执行指令以引起执行扩展存储器操作。
102.随着扩展存储器操作的结果被传送到消息缓冲器534，后续数据可以从dma缓冲器539传送到计算瓦片存储器538，并且可以在计算瓦片存储器538中发起使用所述后续数据的扩展存储器操作。通过在使用先前数据的扩展存储器操作完成之前将后续数据缓冲到计算瓦片510中，可以在不存在来自编排控制器或主机的发起对后续数据的扩展存储器操作的另外的命令或消息的情况下将数据通过计算瓦片连续地流式传输。另外，通过抢先将后续数据缓冲到dma缓冲器539中，由于从存储器装置到计算瓦片510的数据传送的不确定性引起的延迟可以得到减轻，因为扩展存储器操作是对正通过计算瓦片510流式传输的数据执行的。
103.当扩展存储器操作的结果要从计算瓦片510移动到计算瓦片510外部的电路系统(例如，noc、编排控制器和/或主机)时，risc装置536可以将命令和/或消息发送到编排控制器和/或主机，所述编排控制器和/或主机可以继而发送命令和/或消息以从计算瓦片存储器538请求扩展存储器操作的结果。
104.计算瓦片存储器538可以响应于请求扩展存储器操作的结果的命令和/或消息而将扩展存储器操作的结果传送到期望的位置(例如，传送到noc、编排瓦片和/或主机)。例如，响应于请求扩展存储器操作的结果的命令，扩展存储器操作的结果可以被传送到消息缓冲器534，并且随后被传送出计算瓦片510。
105.图6是根据本公开的若干个实施例的呈计算瓦片610的形式的另一框图。如图6所示，计算瓦片610可以包含系统事件队列630、事件队列632和消息缓冲器634。计算瓦片610可以进一步包含指令高速缓存635、数据高速缓存637、如精简指令集计算(risc)装置636等处理装置、计算瓦片存储器638部分和直接存储器存取缓冲器639。图6所示的计算瓦片610可以类似于图5中展示的计算瓦片510，然而图6中展示的计算瓦片610进一步包含指令高速缓存635和/或数据高速缓存637。在一些实施例中，图6中示出的计算瓦片610可以用作编排控制器(例如，本文图1
‑
4中展示的编排控制器106/206/306/406)。
106.指令高速缓存635和/或数据高速缓存637的大小可以小于计算瓦片存储器638的大小。例如，计算瓦片存储器可以为大约256kb，而指令高速缓存635和/或数据高速缓存637的大小为大约32kb。然而，实施例不限于这些特定大小，只要指令高速缓存635和/或数据高速缓存637的大小小于计算瓦片存储器638的大小即可。
107.在一些实施例中，指令高速缓存635可以存储和/或缓冲在risc装置636到计算瓦片存储器638之间传送的消息和/或命令，而数据高速缓存637可以存储和/或缓冲在计算瓦片存储器638与risc装置636之间传送的数据。
108.图7是根据本公开的若干个实施例的表示用于扩展存储器操作的示例方法750的流程图。在框752处，方法750可以包含由耦接到多个计算装置的控制器接收发起执行操作的命令，所述多个计算装置中的每个计算装置彼此耦接并且每个计算装置包括处理单元和被配置为处理单元的高速缓存的存储器阵列，所述操作包括利用所述多个计算装置中的特
定计算装置的处理单元对数据执行操作。控制器瓦片可以类似于本文图1
‑
3和4a
‑
4c中展示的编排控制器106/206/306/406。计算装置可以类似于本文图1
‑
、4a
‑
4c和5
‑
6中展示的计算瓦片110/210/310/410/510/610。
109.在一些实施例中，接收发起执行操作的命令可以包含接收与特定计算装置中的存储器位置相对应的地址，所述特定计算装置中存储与操作执行相对应的操作数。例如，如上所述，地址可以是其中存储在操作执行中用作操作数的数据的存储器部分(例如，计算瓦片存储器，如本文图5和6中展示的计算瓦片存储器538/638)中的地址。
110.在框754处，方法750可以包含由控制器确定所述多个计算装置中的特定计算装置是否存储与由所述命令指示的操作相对应的操作数。特定计算装置可以类似于本文图1
‑
6中展示的计算瓦片110/210/310/410/510/610之一。
111.在框756处，方法750可以包含响应于确定特定计算装置存储操作数而由特定计算装置对数据执行操作。在一些实施例中，如本文所描述的，执行操作可以包含执行扩展存储器操作。所述操作可以进一步包含在没有从可耦接到控制器的主机接收到主机命令的情况下由特定计算装置执行操作。响应于执行操作的完成，方法750可以包含向可耦接到控制器的主机发送通知。
112.在一些实施例中，发起执行操作的命令可以包含与特定计算装置的存储器阵列中的位置相对应的地址，并且方法750可以包含将操作的结果存储在与特定计算装置中的位置相对应的地址中。例如，方法750可以包含将操作的结果存储在与特定计算装置中的存储器位置相对应的地址中，在执行扩展存储器操作之前与执行操作相对应的操作数被存储在所述存储器位置中。也就是说，在一些实施例中，操作的结果可以存储在计算装置的在执行操作之前存储用作操作的操作数的数据的同一地址位置中。
113.在一些实施例中，方法750可以包含由控制器确定与执行操作相对应的操作数未由特定计算瓦片存储。响应于此确定，方法750可以进一步包含由控制器确定与执行操作相对应的操作数存储在耦接到所述多个计算装置的存储器装置中。方法750可以进一步包含：从存储器装置检索与执行操作相对应的操作数；使与执行操作相对应的操作数存储在所述多个计算装置中的至少一个计算装置中；和/或引起使用所述至少一个计算装置执行操作。存储器装置可以类似于图1中展示的存储器装置116。
114.在一些实施例中，方法750可以进一步包含：确定至少一个子操作将作为操作的一部分被执行；向不同于特定计算装置的计算装置发送命令以引起执行子操作；和/或使用所述不同于特定计算装置的计算装置来执行子操作作为执行操作的一部分。例如，在一些实施例中，可以做出操作将分解为多个子操作的确定，并且控制器可以使不同的计算装置执行不同的子操作作为执行操作的一部分。在一些实施例中，编排控制器可以在与通信子系统(如本文图1
‑
4中展示的noc 108/208/308/408)协作的情况下将子操作指配给计算装置中的两个或更多个计算装置，作为执行操作的一部分。
115.尽管本文已经展示并描述了具体实施例，但是本领域的普通技术人员应理解，旨在实现相同结果的布置可以替换所示出的具体实施例。本公开旨在覆盖本公开的一或多个实施例的改编形式或变化形式。应理解，上面的描述以说明性方式而非限制性方式进行。回顾以上描述，以上实施例的组合和本文未具体描述的其它实施例对于本领域的技术人员而言将是显而易见的。本公开的一或多个实施例的范围包含以上结构和工艺被使用的其它应
用。因此，本公开的一或多个实施例的范围应当参考所附权利要求连同与此类权利要求被赋予的等效物的全部范围确定。
116.在以上具体实施方式中，出于使本公开简单化的目的，在单个实施例中将一些特征分组在一起。本公开的此方法不应被解释为反映本公开的所公开实施例必须使用比每项权利要求中明确引用的特征更多的特征。相反，正如以下的权利要求书所反映的，创造性主题在于少于单个公开的实施例的全部特征。因此，下面的权利要求据此并入到具体实施方式中，其中每项权利要求作为单独的实施例而独立存在。