专利名称：发送设备、接收设备和传输系统的制作方法
技术领域：
本公开涉及一种发送设备、接收设备和传输系统。
背景技术：
随着信息量的增加，要求提高信号处理LSI (大规模集成电路)之间的接口的传输速度。为了满足该要求，采用诸如多路并行信号处理、提高接口的时钟频率、降低信号的电压等技术。然而，对于上面刚刚描述的技术，噪声耐受性降低，导致难以正确地发送数据。此外，在与要求抑制功耗相关的接口，诸如移动设备的信号处理LSI之间的接口中，不要求这样提高传输速度，而促进电压的降低，且难以正确地发送数据。为了解决上面描述的这些问题，已经进行了传输信道的电性能的改善，诸如⑶R(时钟数据恢复)电路或者均衡器的性能的改善，并且还采用由接收端校正由噪声造成的错误的纠错码。作为纠错码，可以采用里德-所罗门(Reed-Solomon)码等。在接收端的LSI中，可以执行纠错码的解码处理以在某种程度上校正数据错误。Serial ATA:High Speed Serialized AT Attachment Revision I. Oa (2003 年 I月7日)列为现有技术的非专利文献。
实用新型内容在普通的LSI之间的接口中，即使在LSI之间采用多条传输线，通常仍利用同一单个传输路径发送具有附加到其的纠错码的由传输数据构成的一个码字的数据。因此，如果一个码字中出现的位错误的数目超过校正能力(该校正能力取决于纠错码的位数)，则该错误不能校正，导致数据丢失。取决于系统，检测校正中的故障并执行数据重发。信号处理LSI之间的接口要求的传输能力在加速提高，并且这使得很可能发生传输错误，并且难以保证足够重发数据的传输频带因此，希望提供可以在提高数据的传输速度的同时增强纠错能力的发送设备、接收设备和传输系统。根据所公开技术的第一实施例，提供了发送设备，包括纠错码计算部件，适配为根据作为信息字的传输对象的数据来计算纠错码；划分部件，适配为将构成通过将由纠错码计算部件的计算而确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线；以及多个传输部件，与多条传输线对应地提供，并且适配为通过传输线将由划分部件分配的编码数据发送到接收设备。发送设备可以配置为使得划分部件将具有预定值的填充数据分配到向其分配比其它传输线更少量的编码数据的任意传输线，使得分配等于向其它传输线的编码数据的分配量的编码数据量，并且与向其分配了填充数据的传输线对应地提供的发送部件紧接着编码数据发送填充数据。在该情况下，划分部件以从纠错码计算部件提供编码数据的顺序，向传输线中的不同传输线分配构成同一码字的编码数据。根据所公开技术的第二实施例，提供了接收设备，包括多个接收部件，与多条传输线对应地提供，并适配为接收从根据作为信息字的传输对象的数据计算纠错码的发送设备发送的编码数据，将构成通过将由计算确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线，以及发送分配到该传输线的编码数据；耦合部件，适配为基于由多个接收部件接收到的编码数据产生码字；以及纠错部件，适配为基于由耦合部件产生的码字中包括的纠错码来执行传输对象的数据的纠错。接收设备可以配置为使得在传输设备将具有预定值的填充数据分配到向其分配比其它传输线更少量的编码数据的任意传输线，以使得分配等于向其它传输线的分配量的编码数据量，并且该填充数据由与向其分配了填充数据的传输线对应的接收部件之一接收的情况下，耦合部件去除填充数据。根据所公开技术的第三实施例，提供了包括发送设备和接收设备的传输系统。该传输设备包括纠错码计算部件，适配为根据作为信息字的传输对象的数据来计算纠错码；划分部件，适配为将构成通过将由纠错码计算部件的计算而确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线；以及多个传输部件，与多条传输线对应地提供，并且适配为通过传输线将由划分部件分配的编码数据发送到接收设备。该接收设备包括多个接收部件，与传输线对应地提供，并且适配为接收从发送设备发送的编码数据；耦合部件，适配为基于由多个接收部件接收到的编码数据产生码字；以及纠错部件，适配为基于由耦合部件产生的码字中包括的纠错码来执行传输对象的数据的纠错。在所公开技术的第一实施例中，纠错码计算部件根据作为信息字的传输对象的数据计算纠错码。划分部件将构成通过将由纠错码计算部件的计算而确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线。然后，与多条传输线对应地提供的多个传输部件通过传输线将由划分部件分配的编码数据发送到接收设备。在所公开技术的第二实施例中，与多条传输线对应地提供的多个接收部件接收从根据作为信息字的传输对象的数据来计算纠错码的传输设备发送的编码数据，将构成通过将由计算确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线，以及发送分配到传输线的编码数据。然后，耦合部件基于由多个接收部件接收到的编码数据产生码字。然后，纠错部件基于由耦合部件产生的码字中包括的纠错码来执行传输对象的数据的纠错。在所公开技术的第三实施例中，发送设备根据作为信息字的传输对象的数据来计算纠错码；将构成通过将由计算确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线。此外，发送设备利用与多条传输线对应地提供的多个传输部件通过传输线将所分配的编码数据发送到接收设备。同时，接收设备利用与传输线对应地提供的多个接收部件接收从发送设备发送的编码数据。然后，接收设备基于由多个接收部件接收到的编码数据产生码字；并基于所产生的码字中包括的纠错码来执行传输对象的数据的纠错。总之，利用发送设备、接收设备和传输系统，在提高数据的传输速度的同时，可以增强纠错能力。
图I是示出传输系统的配置的示例的框图；图2是示出传输数据的重排的示例的简图；图3是示出纠错编码的示例的简图；图4是示出传输数据的传输线划分的示例的简图； 图5是示出传输数据的传输线划分的另一个示例的简图；图6是示出传输帧的帧构成的简图；图7是示出传输数据的传输线耦合的简图；图8是示出纠错解码的示例的简图；图9是示出发送端模块的发送处理的流程图；图10是示出接收端模块的接收处理的流程图；图11是示出传输系统的修改例的框图；以及图12是示出计算机的配置的示例的框图。
具体实施方式
模块的配置图I示出根据在此公开的技术的实施例的传输系统的配置的示例。参考图1，所示的传输系统I包括发送端模块11和接收端模块12。发送端模块11和接收端模块12例如由互相不同的LSI实现，或者由相同的LSI实现并提供在其中处理信息的同一设备中，该设备诸如是数码相机、便携式电话机或者个人计算机。在图I所示的示例中，发送端模块11和接收端模块12通过四条传输线Cl至C4互相连接。传输线Cl至C4可以是有线传输线或者无线传输线。此外，发送端模块11与接收端模块12之间的传输线的数量可以是5个或者更多。发送端模块的配置首先，描述发送端模块11的配置。发送端模块11包括信号处理部分21、重排处理部分22、ECC (纠错码)处理部分23、划分部分24和发送处理部分25_1至25-4。发送处理部分25-1包括帧形成部分31-1、调制部分32_1、DAC (数模转换器)33-1和发送放大器34-1，而发送处理部分25-2包括帧形成部分31_2、调制部分32_2、DAC33-2和发送放大器34-2。发送处理部分25-3包括帧形成部分31_3、调制部分32_3、DAC33-3和发送放大器34-3，而发送处理部分25-4包括帧形成部分31_4、调制部分32_4、DAC 33-4和发送放大器34-4。以这样的方式，如果更靠近传输线的配置确定为更低级配置，则在发送端模块11中，划分部分24提供在比ECC处理部分23低的位置处。此外，在比划分部分24低的位置处，与传输线Cl至C4中的每条对应地提供包括帧形成部分、调制部分、DAC和发送放大器的发送处理部分。信号处理部分21执行各种信号处理，并且将发送数据(其是通过执行信号处理而获得的诸如图像数据、文本数据和音频数据之类的传输对象的数据)输出到重排处理部分
622。此外，可以采用其中将传输数据从发送端模块11的外部电路输入到重排处理部分22的不同配置。例如，可以以一个像素数据接着一个像素数据的顺序输入构成由诸如CMOS (互补金属氧化物半导体)图像拾取器件之类的外部图像拾取器件拾取的图像的像素数据来作为传输数据。重排处理部分22获取从信号处理部分21提供到其的传输数据，并且对所获取的传输数据进行重排。例如，在传输数据是其码元由诸如12位的预定数量的位构成的数据的情况下，重排处理部分22执行数据的重排，以将该数据转换为以8位为单位的数据。图2示出传输数据的重排的示例。图2的左侧所示的四个垂直细长块表示分别为12位数据形式的码元SI至S4。块的垂直长度表示12位。例如，如果输入码元SI至S4作为传输数据，则重排处理部分22以输入的顺序收集每8位，并且将码元SI至S4重排为作为以8位为单位的数据的码元SI至S6，如图2中的箭头标记向前所示。码元SI由从码元SI的第一位到第八位的8位构成。码元S2由包括从码元S I的第九位到第十二位的四位和从码元S2的第一位到第四位的四位的8位构成。码元S3由从码元S2的第五位到第十二位的8位构成。码元S4由从码元S3的第一位到第八位的8位构成。码元S5由包括从码元S3的第九位到第十二位的四位和从码元S4的第一位到第四位的四位的8位构成。码元S6由从码元S4的第五位到第十二位的8位构成。构成传输数据的每个码元有时由与12不同的位数表示。重排处理部分22将重排传输数据处理为以8位为单位的数据，以使得无论以什么位数表示传输数据的每个码元，位于后续级处的处理部分都可以通过相同处理产生传输帧。重排处理部分22将重排获得的以8位为单位的传输数据输出到ECC处理部分23。ECC处理部分23基于传输数据计算用于从重排处理部分22提供到其的以8位为单位的传输数据的纠错的纠错码。此外，ECC处理部分23将作为由计算确定的纠错码的奇偶校验位添加到传输数据以执行纠错编码。例如，里德-所罗门码用作纠错码。图3示出ECC处理部分23执行的纠错编码的示例。ECC处理部分23将预定数量的以8位为单位的传输数据作为信息字代入应用于生成多项式，以执行奇偶校验位的计算。例如，ECC处理部分23确定的奇偶校验位也是以8位为单位的数据。ECC处理部分23将由计算确定的奇偶校验位添加到信息字以产生码字，如白心箭头的头部所示。ECC处理部分23将作为以8位为单位的生成的码字的数据的编码数据输出到划分部分24。划分部分24将从ECC处理部分23提供到其的以8位为单位的编码数据从顶部数据开始连续分配到传输线Cl至C4，以执行传输线划分。划分部分24执行传输线划分，以使得当向传输线C4分配特定编码数据时，从传输线Cl开始向传输线连续分配后续的编码数据。图4示出传输线划分的示例。参考图4，数字表示的每个块分别代表以8位为单位的传输数据或者奇偶校验位。一个码字由块I至3、块4至6、块7至9和块10至12的24位的数据构成，并且依次提供
7块I至12的编码数据。在该情况下，划分部分24以提供的顺序将从ECC处理部分23提供到其的编码数据分配到传输线Cl至C4，以使得不利用同一传输线来发送构成同一码字的那些编码数据。在图4所示的示例中，构成码字I的块1、2和3的编码数据分别被分配到传输线Cl、C2和C3，而构成码字2的块4、5和6的编码数据分别被分配到传输线C4、Cl和C2。此外，构成码字3的块7、8和9的编码数据分别被分配到传输线C3、C4和Cl，而构成码字4的块10、11和12的编码数据分别被分配到传输线C2、C3和C4。分配到传输线Cl的块1、5和9的编码数据依次顺序提供到帧形成部分31-1，而分配到传输线C2的块2、6和10的编码数据依次顺序提供到帧形成部分31-2。此外，分配到传输线C3的块3、7和11的编码数据依次顺序提供到帧形成部分31-3，而分配到传输线C4的块4、8和12的编码数据依次顺序提供到帧形成部分31-4。图5不出传输线划分的另一个不例。参考图5描述对5条传输线Cl至C5分配上面参考图4描述的块I至12。在发送端模块11和接收端模块12通过5条传输线互相连接在一起的情况下执行图5所示的传输线划分。此外，在该示例中，划分部分24以提供的顺序将从ECC处理部分23提供的编码数据分配到传输线Cl至C5，以使得类似地利用同一传输线不可能发送构成同一码字的那些编码数据。在图5的示例中，构成码字I的块1、2和3的编码数据分别被分配到传输线Cl、C2和C3，而构成码字2的块4、5和6的编码数据分别被分配到传输线C4、C5和Cl。此外，构成码字3的块7、8和9的编码数据分别被分配到传输线C2、C3和C4，而构成码字4的块IOUl和12的编码数据分别被分配到传输线C5、C1和C2。在所有编码数据分配到传输线后，划分部分24将填充数据分配到向其分配更少量的编码数据的那些传输线中的每条传输线，以使得向所有传输线分配的编码数据的数据量可以互相相等。此外，填充数据是8位数据，并且具有诸如“ 00000000 ”之类的预定值。在图5的示例中，将一个填充数据应用于向其分配更少量的编码数据的传输线C1、C4和C5。在图5中，斜线示出的块代表填充数据。分配到传输线Cl的块1、6和11的编码数据依次提供到帧形成部分31-1，而分配到传输线C2的块2、7和12的编码数据依次提供到帧形成部分31-2。分配到传输线C3的块3和8的编码数据和接着块8的编码数据分配到传输线C3的填充数据Pl依次提供到帧形成部分31-3。分配到传输线C4的块4和9的编码数据和接着块9的编码数据分配到传输线C4的填充数据P2依次提供到帧形成部分31-4。分配到传输线C5的块5和10的编码数据和接着块10的编码数据分配到传输线C5的填充数据P3依次提供到未示出的传输处理部分，该传输处理部分执行从传输线C5发送到其的数据的处理。在向各传输线分配的编码数据的数据量以这种方式不同的情况下，由划分部分24应用填充数据。要分配的所有填充数据的数量或者位数等于将传输线数量减去当编码数据的数量除以传输线的数量时的余数而获得的数量。由于以这种方式使得向传输线分配的数据大小互相相等，所以在传输处理部分25-1至25-4并行执行的处理之中可以建立同步。发送部分25-1的帧形成部分31-1通过将从划分部分24提供到其的编码数据放置在有效载荷中并且向该有效载荷添加关于传输数据的报头和脚注来产生分组。在向传输线Cl分配填充数据的情况下，与编码数据类似地，帧形成部分31-1也将填充数据置于有效载荷中。此外，帧形成部分31-1将表示分组数据的开始位置的开始码添加到分组的顶部，而将表示分组数据的结束位置的结束码添加到分组的末端，以产生传输帧。图6示出传输帧的帧构成。参考图6，报头(header)和脚注(footer)添加到其中放置编码数据的有效载荷，以构成一个分组。此外，开始码和结束码添加到该分组，以构成传输帧。帧形成部分31-1以从顶部数据开始的顺序将帧数据(其是具有如图6所示的这种帧构成的传输帧的数据)输出到调制部分32-1。调制部分32-1根据预定方法对从帧形成部分31-1提供到其的帧数据进行调制，并且将调制后的帧数据输出到DAC 33-1。DAC 33-1对从调制部分32_1提供到其的帧数据执行D/A转换，并且将通过D/A转换获得的模拟信号输出到发送放大器34-1。发送放大器34-1对从DAC 33-1提供到其的信号的信号电压进行调节，并且通过传输线Cl，将调节后的信号发送到接收端模块12。此外，在发送处理部分25-2至25-4中，执行与由发送处理部分25_1的部件执行的处理相同的处理。具体地说，发送处理部分25-2对分配到传输线C2的编码数据执行帧形成、调制和D/A转换，并且通过传输线C2发送表示帧数据的信号。同时，发送处理部分25-3对分配到传输线C3的编码数据执行帧形成、调制和D/A转换，并且通过传输线C3发送表示帧数据的信号。此外，发送处理部分25-4对分配到传输线C4的编码数据执行帧形成、调制和D/A转换，并且通过传输线C4发送表示帧数据的信号。接收端模块的配置接着，将描述接收端模块12的配置。参考图1，接收端模块12包括接收处理部分51-1至51-4、耦合部分52、ECC处理部分53、重排处理部分54以及信号处理部分55。接收处理部分51-1包括接收放大器61-1、时钟再现部分62_1、ADC(模数转换器)63-1、解调部分64-1和帧同步部分65-1。接收处理部分51_2包括接收放大器61_2、时钟再现部分62-2、ADC 63-2、解调部分64-2和帧同步部分65-2。接收处理部分51_3包括接收放大器61-3、时钟再现部分62-3、ADC 63_3、解调部分64_3和帧同步部分65_3。接收处理部分51-4包括接收放大器61-4、时钟再现部分62-4、ADC 63_4、解调部分64_4和帧同步部分65-4。从发送端模块11的发送放大器34-1发送的信号输入到接收放大器61-1，而从发送放大器34-2发送的信号输入到接收放大器61-2。从发送放大器34-3发送的信号输入到接收放大器61-3,而从发送放大器34-4发送的信号输入到接收放大器61-4。以这种方式，如果更靠近传输线的配置看作较下级的配置，则在接收端模块12中，耦合部分52在低于ECC处理部分53的位置处提供。此外，在低于耦合部分52的位置处以与传输线Cl至C4中每个对应的关系，提供具有接收放大器、时钟再现部分、ADC、解调部分和帧同步部分的接收处理部分。接收处理部分51-1的接收放大器61-1接收从发送端模块11发送到其的信号，调节所接收到的信号的信号电压，并且输出调节了信号电压的信号。从接收放大器61-1输出的信号输入到时钟再现部分62-1和ADC 63-1。时钟再现部分62-1检测输入信号的边沿，以建立位同步，并且基于边沿的检测周期来再现时钟信号。时钟再现部分62-1将再现的时钟信号输出到ADC 63-1。ADC 63-1根据由时钟再现部分62_1再现的时钟信号对该输入信号执行抽样，并且将通过抽样获得的帧数据输出到解调部分64-1。解调部分64-1通过与由发送端模块11的调制部分32-1使用的调制方法对应的方法对该帧数据进行解调，并且将解调后的帧数据输出到帧同步部分65-1。帧同步部分65-1从解调部分64-1提供到其的帧数据中检测开始码和结束码，以建立帧同步。帧同步部分65-1检测从开始码到结束码的数据作为分组数据，并且将位于分组数据的有效载荷内的编码数据输出到耦合部分52。此外，接收处理部分51-2至51-4执行与由接收处理部分51的部件执行的处理相同的处理。具体地说，接收处理部分51-2对通过传输线C2发送到其的信号执行抽样，对通过抽样获得的帧数据进行解调和帧同步，并且将编码数据输出到耦合部分52。接收处理部分51-3对通过传输线C3发送到其的信号执行抽样，对通过抽样获得的帧数据进行解调和帧同步，并且将编码数据输出到耦合部分52。此外，接收处理部分51-4对通过传输线C4发送到其的信号执行抽样，对通过抽样获得的帧数据进行解调和帧同步，并且将编码数据输出到耦合部分52。耦合部分52以与由发送端模块11的划分部分24向传输线分配编码数据的顺序相反的顺序重排从接收处理部分51-1至51-4提供到其的编码数据，以执行传输线耦合或
者整合。图7示出传输线I禹合的示例。假定以上面参考图4描述的方式执行块I至12的编码数据的传输线划分。在这种情况下，耦合部分52以与在传输线划分时向传输线分配编码数据的顺序相反的顺序重排编码数据，以产生顺序与从ECC处理部分23输出编码数据的顺序相同的编码数据，如图7中的白心箭头的头部所示。耦合部分52将构成通过执行重排产生的每个码字的块I至12的编码数据连续输出到ECC处理部分53。在从接收处理部分51-1至51-4在编码数据之后提供填充数据的情况下，耦合部分52去除填充数据，并且仅输出编码数据。ECC处理部分53基于从耦合部分52提供到其的编码数据中包括的奇偶校验位来执行纠错算术运算，以检测传输数据中的错误，并且执行检测到的错误的校正。图8示出ECC处理部分53的纠错解码的示例。例如，假定图8的上部所示的码字的数据作为编码数据从发送端模块11发送，并且接收到如白心箭头#11的头部所示的数据。图8中的接收数据中的位El和E2是错误位。在该示例中，ECC处理部分53基于奇偶校验位执行检错算术运算，以检测位El和E2，并且校正位El和E2，如白心箭头#12的头部所示。ECC处理部分53对每个码字执行纠错解码，并且将纠错后的传输数据输出到重排处理部分54。重排处理部分54以与发送端模块11的重排处理部分22的重排顺序相反的顺序重排从ECC处理部分53提供到其的以8位为单位的传输数据。具体地说，重排处理部分54
1执行与上面参考图2描述处理相反的处理，以将以8位为单位的传输数据变换为以诸如12位之类的预定位数为单位的传输数据。重排处理部分54将重排获得的传输数据输出到信号处理部分55。信号处理部分55利用从重排处理部分54提供到其的传输数据执行各种处理。例如，如果该传输数据是构成图像的像素数据，则信号处理部分55基于该像素数据产生一帧的图像，并且执行诸如压缩图像数据、显示图像以及将图像数据记录在记录介质中的各种处理。模块的操作在此，描述发送端模块11和接收端模块12的一系列处理。首先，参考图9所示的流程图，描述发送端模块11的发送处理。在步骤SI，信号处理部分21执行信号处理，并且输出通过信号处理获得的传输数据。在步骤S2，重排处理部分22获取从信号处理部分21提供到其的传输数据，并且以上面参考图2描述的方式对该数据执行重排。在步骤S3，ECC处理部分23基于通过重排获得的以8位为单位的传输数据来计算奇偶校验位，并且将该奇偶校验位添加到传输数据，以执行纠错编码。在步骤S4，划分部分24对通过纠错编码获得的编码数据执行传输线划分。传输处理部分25-1至25-4并行重复步骤S5至S8的处理。具体地说，在步骤S5，帧形成部分31-1至31-4分别将通过纠错编码获得的编码数据放置在有效载荷内，并且添加报头和脚注以产生分组。此外，帧形成部分31-1至31-4将开始码添加到分组的顶部，而将结束码添加到分组的末端，以执行分组的帧形成。在步骤S6，调制部分32-1至32-4分别对构成通过帧形成获得的传输帧的帧数据执行调制处理。在步骤S7，DAC 33-1至33_4对通过调制处理获得的帧数据执行D/A转换。在步骤S8，发送放大器34-1至34-4将通过D/A转换获得的信号分别发送到接收端模块12。对从信号处理部分21输出的所有传输数据重复执行步骤S2至S8的处理，并且当对所有传输数据的处理结束时结束。现在，将参考图10的流程图，描述接收端模块12的接收处理。接收处理部分51-1至51-4并行执行步骤Sll至S15的处理。具体地说，在步骤S11，接收放大器61-1至61-4分别接收从发送端模块11发送到其的信号，并且调节该接收信号的信号电压。在步骤S12，块再现部分62-1至62_4分别检测分别从接收放大器61_1至61_4提供到其的信号的边沿，以产生时钟信号。在步骤S13，ADC 63-1至63_4分别根据由时钟再现部分62_1至62_4再现的时钟信号执行抽样。在步骤S14，解调模块64-1至64_4对通过抽样获得的帧数据执行解调处理。在步骤S15，帧同步模块65-1至65_4分别从解调模块64_1至64_4提供到其的帧数据中检测开始码和结束码，以建立帧同步。帧同步模块65-1至65-4将放置于有效载荷内的编码数据输出到耦合部分52。[0109]在步骤S16，耦合部分52以与在进行传输线划分时向传输线分配编码数据的顺序相反的顺序对从帧同步模块65-1至65-4提供到其的编码数据执行重排，以执行传输线耦
入
口 ο在步骤S17，ECC处理部分53基于由编码数据构成的码字中包括的奇偶校验位来执行纠错解码，以校正传输数据的错误。在步骤S18，重排处理部分54对纠错后的传输数据执行重排，以产生以与从发送端模块11内的信号处理部分21输出的数据的预定位数相同的预定位数为单位的传输数据。重复执行步骤Sll至S18的处理，直到对从发送端模块11发送的信号的处理结束为止。当对从发送端模块11发送的信号的处理结束时，在步骤S19，信号处理部分55基于从重排处理部分54提供到其的传输数据执行信号处理。当信号处理结束时，信号处理部分55结束处理。以这样的方式，在传输系统I中，利用添加到传输数据的纠错码来校正传输线上出现的传输数据的错误。因此，当出现传输数据的错误时，没必要向发送端模块11发出重发传输数据的请求，因此，在保证防错措施的同时，可以保证数据传输的实时特性。此外，由于没必要提供用于重发请求的传输线，所以可以预料简化电路配置并且降低成本。此外，由于电路配置可以简化，所以功耗也降低。此外，通过划分编码数据并且在划分之后并行执行处理，然后，利用多条传输线并行发送编码数据，可以实现高速数据传输。此外，通过以在低于ECC处理部分的位置处执行传输线划分/耦合，必须在发送端模块11和接收端模块12中的每个内设置一个ECC处理部分，这样减小了电路规模。例如，如果以另外的方式在高于执行纠错编码的ECC处理部分的位置处执行传输线划分，则必须准备等于传输线的数量的多个ECC处理部分，这样增大了发送端模块11的电路规模。然而，可以防止刚描述的这种情况。此外，如果以另外的方式在高于执行检错解码的ECC处理部分的位置处执行传输线耦合，则必须准备等于传输线的数量的多个ECC处理部分，这样增大了接收端模块12的电路规模。然而，可以防止刚描述的这种情况。图11示出在传输线划分之后执行纠错编码的发送端模块11的配置和在传输线耦合之前执行纠错解码的接收端模块12的配置。在图11所示的发送端模块11中，在低于划分部分24的位置处提供等于传输线的数量的多个ECC处理部分23-1至23-4。此外，在接收端模块12中，在低于耦合部分52的位置处提供等于传输线的数量的多个ECC处理部分53-1 至 53-4。此外，通过在传输线划分之前执行纠错编码并且通过不同传输线发送构成同一码字的编码数据，在解码之后，传输线上出现的突发错误，即，连续错误可以散布到码字中。因此，可以提闻纠错能力。例如，考虑传输线C2上出现2字节的突发错误的情况，如图7中的左侧所示。沿传输线C2连续发送的块6的编码数据和块10的编码数据存在错误。在图7所示的块中，斜线所示的每个块分别表示存在错误的编码数据块，而非斜线所示的每个块表示不存在错误的编码数据块。在该示例中，在传输线耦合之后的编码数据中，通过传输线C2发送的块6的编码数据和块10的编码数据散布到不同码字中，如图7的空白实线箭头向前所示。通常，大多数纠错码容易受到突发错误的影响。例如，在里德-所罗门码的情况下，由于每个码字可以校正的错误的数量确定，所以如果可以在不同的码字之间散布集中在一个码字上的突发错误，则可以增强纠错能力。计算机的配置示例尽管可以利用硬件执行上面描述的一系列处理，但是还可以利用软件执行。在利用软件执行该一系列处理的情况下，构成软件的程序从程序记录介质安装到并入专用硬件中的计算机、通用个人计算机等内。图12示出根据程序执行上面描述的一系列处理的计算机的配置的示例。参考图12，在所示的计算机中，中央处理单元(CPU) 101、只读存储器(ROM) 102和随机存取存储器(RAM) 103通过总线104互相连接。此外，输入/输出接口 105连接到总线104。包括键盘、鼠标等的输入部分106和包括显示单元、扬声器等的输出部分107连接到输入/输出接口 105。此外，由硬盘、非易失性存储器等构成的存储部分108、由网络接口等构成的通信部分109和用于驱动可拆卸介质111的驱动器110连接到输入/输出接口 105。在以上面描述的方式配置的计算机中，CPU 101通过输入/输出接口 105和总线104将例如存储部分108中存储的程序装载到RAM 103内，并且执行该程序以执行上面描述的一系列处理。CPU 101要执行的程序可以例如记录在可拆卸介质111上，也可以通过诸如局域网、因特网或者数字广播之类的有线或者无线传输介质提供，并且安装在存储部分108上。请注意，计算机要执行的程序可以是以本说明书中描述的顺序以时间顺序执行的处理的类型，也可以是并行执行处理的类型，或者诸如当调用处理时的必要时间单独执行处理的类型。尽管利用特定术语描述了所公开的技术的优选实施例，但是这种描述仅具有说明性目的，并且应当明白，可以进行修改和变型，而不脱离下面的权利要求书的实质范围。本公开文本包含与于2010年11月19日向日本专利局提交的第JP2010-258570号日本优先权专利申请披露的主题有关的主题，在此通过引用包括该专利申请的全部内容。
1权利要求1.一种发送设备，包括纠错码计算部件，适配为根据作为信息字的传输对象的数据来计算纠错码；划分部件，适配为将构成码字的编码数据以每预定数量为单位分配到多条传输线，其中通过将由所述纠错码计算部件的计算而确定的纠错码附加到传输对象的数据而获得所述码字；以及多个传输部件，与多条传输线对应地提供，并且适配为通过传输线将由所述划分部分分配的编码数据发送到接收设备。
2.根据权利要求I所述的发送设备，其特征在于所述划分部件将具有预定值的填充数据分配到向其分配比向其它传输线分配更少量的编码数据的任意传输线，以使得分配等于向其它传输线分配的编码数据的分配量的编码数据量；以及与向其分配了填充数据的传输线对应地提供的传输部件紧接着编码数据发送填充数据。
3.根据权利要求2所述的发送设备，其特征在于，所述划分部件以从所述纠错码计算部件提供编码数据的顺序，向传输线中的不同传输线分配构成同一码字的编码数据。
4.一种接收设备，包括多个接收部件，与多条传输线对应地提供，并且适配为接收从根据作为信息字的传输对象的数据来计算纠错码的发送设备发送的编码数据，将构成通过将由计算确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线，以及发送分配到所述传输线的编码数据；耦合部件，适配为基于由所述多个接收部件接收到的编码数据产生码字；以及纠错部件，适配为基于由所述耦合部件产生的码字中包括的纠错编码来执行传输对象的数据的纠错。
5.根据权利要求4所述的接收设备，其特征在于，在所述发送设备将具有预定值的填充数据分配到向其分配比其它传输线更少量的的编码数据的任意传输线，以使得分配等于向其它传输线分配的编码数据量的编码数据量，并且所述填充数据由与向其分配了填充数据的传输线对应的所述接收部件之一接收的情况下，所述耦合部件去除填充数据。
6.—种传输系统,包括发送设备；以及接收设备；所述发送设备包括纠错码计算部件，适配为根据作为信息字的传输对象的数据来计算纠错码；划分部件，适配为将构成码字的编码数据以每预定数量为单位分配到多条传输线，其中通过将由所述纠错码计算部件的计算而确定的纠错码附加到传输对象的数据而获得所述码字；以及多个发送部件，与多条传输线对应地提供，并且适配为通过传输线将由所述划分部件分配的编码数据发送到所述接收设备，以及所述接收设备，包括多个接收部件，与传输线对应地提供，并且适配为接收从所述发送设备发送的编码数页据；耦合部件，适配为基于由所述多个接收部件接收到的编码数据产生码字；以及纠错部件，适配为基于由所述耦合部件产生的码字中包括的纠错码来执行传输对象的数据的纠错。专利摘要在此公开了发送设备、接收设备和传输系统。该发送设备包括纠错码计算部分，用于根据作为信息字的传输对象的数据来计算纠错码；划分部分，用于将构成通过将由纠错码计算部分的计算而确定的纠错码附加到传输对象的数据而获得的码字的编码数据以每预定数量为单位分配到多条传输线；以及多个传输部分，与多条传输线对应地提供，并且用于通过传输线将由划分部分分配的编码数据发送到接收设备。
文档编号H04L1/18GK202737883SQ20112045160
公开日2013年2月13日 申请日期2011年11月15日 优先权日2010年11月19日
发明者新桥龙男, 舟本一久, 松本英之, 城下宽司, 丸子健一, 杉冈达也, 越坂直弘 申请人:索尼公司