一种无效时钟路径检查的方法技术资料下载

技术编号:6500703

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当今超深亚微米工艺条件下,超大规模信息系统集成并固化在芯片上。其中时钟系统的设计亦日趋复杂,芯片的时序收敛与时钟综合的好坏息息相关,减少时钟网络耗能也是低功耗芯片设计的一个重要目标。本文提出了一种无效时钟路径(invalidclockpath)检查的方法,它定义了门控时钟的数据信号引入时钟网络从而构成无效时钟路径;分析了无效时钟路径会引起不必要的时钟缓冲器单元插入和时钟信号延时的增加;并提供了在复杂时钟系统当中寻找且鉴别无效时钟路径的方法;最后针对无效时钟...
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