用于目标刷新操作的时序交错的设备和方法与流程

本公开涉及用于目标刷新操作的设备和方法，特别涉及用于目标刷新操作的时序交错的设备和方法。

背景技术：

信息可以作为物理信号(例如，电容性元件上的电荷)存储在存储器的各个存储器单元上。所述存储器可以是易失性存储器，并且所述物理信号可以随着时间而衰减(这可能破坏存储在存储器单元中的信息或使其降级)。可能需要周期性地刷新存储器单元中的信息，例如通过重写信息以将物理信号恢复到初始值。

随着存储器组件尺寸的减小，存储器单元的密度大大增大。可以执行自动刷新操作；在自动刷新操作中，一系列存储器单元被周期性地刷新。对特定存储器单元或存储器单元组的重复访问(通常被称为“行锤”)可能会使附近的存储器单元中数据降级的速率增加。除了自动刷新操作之外，可能期望的是在目标刷新操作中标识并且刷新受行锤影响的存储器单元。所述目标刷新操作可以以在自动刷新操作之间穿插的时序进行。

技术实现要素：

本申请的一个方面涉及一种设备，其包括：第一存储器管芯，其被配置成响应于刷新信号的第一激活执行目标刷新操作；和第二存储器管芯，所述第二存储器管芯被配置成响应于所述刷新信号的第二激活而不是所述刷新信号的所述第一激活执行目标刷新操作。

本申请的另一方面涉及一种设备，其包括：多个存储器管芯，其中响应于刷新命令，所述多个存储器管芯中的每个存储器管芯被配置成执行一或多个刷新操作，其中所述刷新操作中的每个刷新操作可以是第一类型的刷新操作或第二类型的刷新操作，并且其中当所述多个存储器管芯中的最大数量的存储器管芯同时执行刷新操作时，所述多个存储器管芯中的至少一个执行所述第一类型的刷新操作并且所述多个存储器管芯中的至少另一个执行所述第二类型的刷新操作。

本申请的又一方面涉及一种设备，其包括：接口，其被配置成提供刷新信号；第一存储器管芯，其被配置成响应于所述刷新信号提供第一刷新泵信号的激活，其中所述第一存储器管芯进一步被配置成在所述第一刷新泵信号的第一数量的激活之后执行目标刷新操作；第二存储器管芯，其被配置成响应于所述刷新信号提供第二刷新泵信号的激活，其中所述第二存储器管芯进一步被配置成在所述第二刷新泵信号的第二数量的激活之后执行目标刷新操作，其中所述第二数量不同于所述第一数量。

附图说明

图1是根据本公开的一个实施例的半导体装置的框图。

图2是根据本公开的一个实施例的存储器封装的主/从配置的框图。

图3是根据本公开的一个实施例的存储器封装的框图。

图4是根据本公开的一个实施例的存储器模块的框图。

图5是根据本公开的一个实施例的刷新地址控制电路的框图。

图6是根据本公开的一个实施例的行解码器的框图。

图7是根据本公开的一个实施例的刷新操作的时序图。

图8是根据本公开的一个实施例的刷新泵之间的交错刷新时序的时序图。

图9是根据本公开的一个实施例的交错刷新操作的时序图。

具体实施方式

以下对某些实施例的说明在本质上仅仅是示范性的并且并非旨在以任何方式限制本公开或其应用或用途的范围。在以下对本系统和方法的实施例的详细说明中，对附图进行了参考，所述附图构成详细说明的一部分并且在可以实践所述系统和方法的具体实施例中以说明方式示出。对这些实施例进行了足够详细的说明，以使本领域技术人员能够实践当前公开的系统和方法，并且应当理解，在不脱离本公开的精神和范围的情况下，可以利用其它实施例并且可以进行结构和逻辑改变。此外，为了清楚起见，当某些特征的详细说明对于本领域技术人员而言显而易见时，将不对它们进行讨论，以免模糊本公开的实施例的说明。因此以下详细说明不应以限制的含义来理解，并且本公开的范围仅由所附权利要求来限定。

存储器装置可以包含多个存储器单元。存储器单元可以存储信息，并且可以被组织在字线(行)和位线(列)的交点处。字线和位线可以被组织成存储器库，并且所述存储器装置可以包含至少一个存储器管芯，所述至少一个存储器管芯包含一或多个存储器库。一或多个存储器管芯可以被组织成存储器封装。在一些实施例中，存储器封装的所述存储管芯可以彼此堆叠。在一些实施例中，一或多个存储器封装可以被组织成存储器模块。存储器装置可以接收一或多个命令信号，所述命令信号可以指示在一或多个存储器封装的一或多个管芯中的操作。存储器管芯可以共同耦合到命令信号，可以从主管芯和/或接口芯片接收命令，和/或可以单独接收命令。例如，封装的存储器管芯可以接收刷新信号，所述刷新信号可以控制存储器管芯中的刷新操作的时序。

存储器单元中的信息可随时间衰减。可以逐行刷新存储器单元。在刷新操作期间，可以读出一或多个行中的信息，并且然后将其写回到相应的行中。刷新信号(例如，自动刷新信号aref)可以控制刷新操作的时序。在一些实施例中，存储器装置可以生成一或多个“泵”，所述泵可以是响应于接收到刷新信号的激活的内部刷新信号的激活。存储器管芯可以能够响应于刷新信号和/或刷新泵执行多于一种类型的刷新操作。存储器管芯可以具有确定执行哪种类型的刷新操作的内部逻辑和/或可以(例如，从接口和/或控制器)接收指示应执行哪种类型的刷新操作的信号。

一种类型的刷新操作可以是自动刷新操作。响应于自动刷新操作(其可以具有基于自动刷新信号的激活和/或泵的激活的时序)，存储器堆栈中的每个管芯可以刷新序列中的存储器的一组多个行，并且然后可以响应于下一自动刷新操作刷新存储器的下一组多个行。自动刷新操作可以循环通过存储器的不同行以防止数据丢失，并且可以以基于存储器单元中的正常数据降级速率的时序刷新每个行。

另一种类型的刷新操作可以是目标行刷新操作。对特定存储器行(例如，攻击者行)的重复访问可能导致相邻行(例如，受害者行)中的衰减速率增加，这是由于例如行之间的电磁耦合。受害者行中的信息可能以一定速率衰减，使得如果所述数据在所述行的下一自动刷新操作之前未被刷新，则所述数据可能丢失。为了防止信息丢失，可能有必要标识攻击者行，并且然后执行目标刷新操作；在目标刷新操作中，能够刷新一或多个关联的受害者行。在一些实施例中，目标刷新操作可以“窃取”本将以其它方式用于自动刷新操作的时隙(例如，泵的激活、自动刷新信号的激活)。

可能重要的是，在刷新操作期间控制存储器装置消耗的电流量。自动刷新操作可能比目标刷新操作消耗更多的电流，因为与给定目标刷新操作期间相比，可能在给定自动刷新操作期间刷新更多个行。在一些实施例中，太多的存储器管芯同时执行自动刷新操作可以使存储器装置消耗比允许电流量更多的电流。

本公开涉及用于交错刷新操作的时序的设备、系统和方法。因为目标刷新操作比自动刷新操作消耗更少的电流，所以可能希望通过让一些管芯替代地执行目标刷新操作来减少同时执行自动刷新操作的存储器管芯的数量。例如，在最大数量的管芯执行刷新操作时的某一时刻，至少一个管芯可以执行目标刷新操作而不是自动刷新操作。在一个示范性实施方案中，每个管芯可以在刷新时序信号(例如，自动刷新信号和/或泵)的不同激活下执行目标刷新操作。因此，响应于刷新时序信号的第一激活，第一存储器管芯可以执行目标刷新操作，并且第二管芯可以执行自动刷新操作；并且响应于刷新时序信号的第二激活，第一存储器管芯可以执行自动刷新操作，并且第二管芯可以执行目标刷新操作。

图1是根据本公开的至少一个实施例的半导体装置的框图。半导体装置100可以是半导体存储器装置，例如集成在单个半导体芯片上的dram装置。图1的示范性装置100包含存储器封装，例如位于基板123上的存储器管芯的堆栈125，其可以用作(并且可以被称为)接口。尽管在堆栈125的管芯中示出了某些组件，并且在基板123上示出了某些组件，但是在其它示范性实施例中，堆栈125和基板123之间的装置100的组件的其它布置是可能的。在一些实施例中，装置100可以包含多个堆栈125。

为了图示的简洁和清晰，图1中仅示出了存储器堆栈125中的一个存储器管芯的组件。通常，堆栈125的不同管芯可以各自具有彼此类似的组件。在一些实施例中，堆栈125的每个管芯可以在物理上彼此相同。基板123可以用作接口，并且可以向外部发送并从外部接收信息(例如，数据、命令)，而堆栈125中的存储器管芯与基板的组件进行通信。如本文所描述，由基板123发送的命令和其它信号可以被发送到堆栈125中的所有管芯，或可以被单独寻址到堆栈125的各个管芯。

半导体装置100包含存储器阵列118。存储器阵列118可以位于存储器堆栈125的管芯中。存储器阵列118被示出为包含多个存储器库。在图1的实施例中，存储器阵列118被示出为包含八个存储器库bank0-bank7。在其它实施例的存储器阵列118中可以包含更多或更少的存储器库。每个存储器库包含多个字线wl、多个位线bl和/bl、和布置在多个字线wl与多个位线bl和/bl的交点处的多个存储器单元mc。字线wl的选择由行解码器108执行，并且位线bl和/bl的选择由列解码器110执行。行解码器108和列解码器110也可以位于存储器堆栈125的管芯中。在图1的实施例中，行解码器108包含每个存储器库的相应的行解码器，并且列解码器110包含每个存储器库的相应的列解码器。位线bl和/bl耦合到相应的感测放大器(samp)。来自位线bl或/bl的读取数据通过感测放大器samp放大，并且通过互补的局部数据线(liot/b)、传输门(tg)和互补的主数据线(miot/b)传输到读取/写入放大器120。相反地，从读取/写入放大器120输出的写入数据通过互补的主数据线miot/b、传输门tg和互补的局部数据线liot/b传输到感测放大器samp，并且写入耦合到位线bl或/bl的存储器单元mc中。

半导体装置100可以采用多个外部端子，所述多个外部端子包含耦合到命令和地址总线以接收命令和地址的命令和地址(c/a)端子、和cs信号、用于接收时钟ck和/ck的时钟端子、用于提供数据的数据端子dq、以及用于接收电源电位vdd、vss、vddq和vssq的电源端子。外部端子可以位于基板123上。

时钟端子配有提供给输入电路112的外部时钟ck和/ck。外部时钟可以是互补的。输入电路112基于ck和/ck时钟生成内部时钟iclk。iclk时钟被提供给命令解码器110和内部时钟发生器114。内部时钟发生器114基于iclk时钟提供各种内部时钟lclk。iclk时钟可以用于各种内部电路的时序操作。内部数据时钟lclk被提供给输入/输出电路122以对输入/输出电路122中包含的电路的操作进行时序控制，例如被提供给数据接收器以对写入数据的接收进行时序控制。

c/a端子可以配有存储器地址。向c/a端子提供的存储器地址经由命令/地址输入电路102传输到地址解码器104。地址解码器104接收所述地址，并且向行解码器108提供解码的行地址xadd并向列解码器110提供解码的列地址yadd。地址解码器104还可以提供解码的库地址badd，所述库地址可以指示含有解码的行地址xadd和列地址yadd的存储器阵列118的库。在一些实施例中，地址解码器104还可以指示用于激活的存储器堆栈125的特定存储器管芯。c/a端子可以配有命令。命令的实例包含用于控制各种操作的时序的时序命令、用于访问存储器的访问命令(例如，用于执行读取操作的读取命令和用于执行写入操作的写入命令)以及其它命令和操作。访问命令可以与一或多个行地址xadd、列地址yadd和库地址badd相关联以指示待访问的一(或多)个存储器单元。

命令可以以内部命令信号的形式经由命令/地址输入电路102被提供给命令解码器106。命令解码器106包含用于解码内部命令信号以生成用于执行操作的各种内部信号和命令的电路。例如，命令解码器106可以提供用于选择字线的行命令信号和用于选择位线的列命令信号。

装置100可以接收访问命令，所述访问命令为写入命令。当接收读取命令并且库地址、行地址和列地址(和任选的管芯地址)及时地配有读取命令时，从对应于行地址和列地址的存储器阵列118中的存储器单元读取读取数据。读取命令由命令解码器106接收，所述命令解码器106提供内部命令，使得来自存储器阵列118的读取数据被提供给读取/写入放大器120。读取数据经由输入/输出电路122从数据端子dq输出到外部。

装置100可以接收访问命令，所述访问命令为写入命令。当接收写入命令并且库地址、行地址和列地址(和任选的管芯地址)及时地配有写入命令时，将提供给数据端子dq的写入数据写入对应于行地址和列地址的存储器阵列118中的存储器单元中。写入命令由命令解码器106接收，所述命令解码器106提供内部命令，使得写入数据由输入/输出电路122中的数据接收器接收。还可以向外部时钟端子提供写入时钟，以对输入/输出电路122的数据接收器对写入数据的接收进行时序控制。写入数据经由输入/输出电路122被提供给读取/写入放大器120，并且通过读取/写入放大器120被提供给存储器阵列118以被写入存储器单元mc中。

装置100还可以接收命令，使其执行刷新操作。刷新信号aref可以是脉冲信号，所述脉冲信号在命令解码器106接收到指示刷新命令的信号时被激活。在一些实施例中，刷新命令可以从外部发布到存储器装置100。在一些实施例中，刷新命令可以由装置的组件周期性地生成。在一些实施例中，当外部信号指示自刷新进入命令时，还可以激活刷新信号aref。刷新信号aref可以在命令输入后立即激活一次，并且此后可以以期望的内部时序循环地激活。因此，刷新操作可以自动继续。自刷新退出命令可以使刷新信号aref的自动激活停止并返回idle状态。

刷新信号aref被提供给刷新地址控制电路116。刷新地址控制电路116向行解码器108提供刷新行地址rxadd，所述行解码器108可以刷新由刷新行地址rxadd指示的字线wl。刷新地址控制电路116可以控制刷新操作的时序，并且可以生成并提供刷新地址rxadd。可以控制刷新地址控制电路116以改变刷新地址rxadd的细节(例如，如何计算刷新地址、刷新地址的时序)，或刷新地址控制电路116可以基于内部逻辑进行操作。

刷新地址控制电路116可以选择性地作为目标刷新操作的一部分提供目标刷新地址(例如，受害者地址)或作为自动刷新操作的一部分提供一或多个自动刷新地址(自动刷新地址)来作为刷新地址rxadd。自动刷新地址可以是基于自动刷新信号aref的激活而提供的一系列地址的一部分。刷新地址控制电路116可以以由aref确定的速率循环通过所述一系列自动刷新地址。可以作为自动刷新操作的一部分提供多个地址来作为刷新地址rxadd。在一些实施例中，一组或一批地址可以全部由刷新地址rxadd指示，并且行解码器108可以刷新整组或整批地址。

刷新地址控制电路116还可以基于存储器阵列118中的附近地址(例如，对应于攻击者行的攻击者地址)的访问模式来确定目标刷新地址，所述目标刷新地址是需要刷新的地址(例如，对应于受害者行的受害者地址)。刷新地址控制电路116可以选择性地使用装置100的一或多个信号计算目标刷新地址rxadd。例如，可以基于由地址解码器提供的行地址xadd来计算刷新地址rxadd。在一些实施例中，刷新地址控制电路116可以对由地址解码器104提供的行地址xadd的当前值进行采样，并且基于一或多个采样地址来确定目标刷新地址。

目标刷新地址可以基于从地址解码器104接收的行地址xadd的随时间的特性。刷新地址控制电路116可以对当前行地址xadd进行采样以确定其随时间的特性。采样可以间歇性地进行，其中每个样本都是基于随机或半随机时序而获取的。刷新地址控制电路116可以基于采样行地址xadd而使用不同的方法计算目标刷新地址。例如，刷新地址控制电路116可以确定给定行是否是攻击者地址，并且然后计算对应于攻击者地址的受害者地址并将其作为目标刷新地址提供。在一些实施例中，多于一个受害者地址可以对应于给定攻击者地址。在这种情况下，刷新地址控制电路可以将多个目标刷新地址排队，并且在确定应提供目标刷新地址时顺序地提供所述多个目标刷新地址。刷新地址控制电路116可以立即提供目标刷新地址，或可以将目标刷新地址排队以在稍后的时间(例如，在可进行目标刷新的下一时隙中)提供。

刷新地址rxadd可以设有基于刷新信号aref时序的时序。刷新地址控制电路116可以具有对应于aref时序的时隙，并且可以在每个时隙期间提供一或多个刷新地址rxadd。在一些实施例中，可以在本将以其它方式分配给自动刷新地址的(例如，“窃取”)时隙中发布目标刷新地址。在一些实施例中，可以为目标刷新地址保留某些时隙，并且刷新地址控制电路116可以确定是否提供目标刷新地址，在所述时隙期间不提供地址，或在所述时隙期间替代地提供自动刷新地址。

在一些实施例中，刷新地址控制电路116可以包含逻辑(例如，状态机和/或计数器)，所述逻辑用于确定是否将执行自动刷新操作或目标刷新操作。例如，刷新地址控制电路可以用计数器对刷新信号aref的激活次数进行计数。当计数器达到最大值并且“翻转”回最小值时，可以执行目标刷新操作。逻辑还可以耦合到设置(例如，熔丝(fuse)设置)，所述设置可以用于更改给定管芯中逻辑的操作。

由于与目标刷新操作期间相比，可能在自动刷新操作期间以刷新地址rxadd的形式提供更多个地址，所以自动刷新操作可能比目标刷新操作消耗更多的电流(例如，更多的功率)。为了减少在刷新操作期间任何给时间点由装置100拉动的峰值电流，可以使目标刷新操作可以在存储器堆栈的不同管芯之间(和/或存储器阵列118的其它组织之间)在时间上交错。存储器堆栈125的不同管芯可以具有使目标刷新操作在不同管芯中在不同时间进行的设置。在一个示范性实施方案中，在存储器堆栈125中的不同管芯中的刷新地址控制电路116可以指示基于刷新信号的频率的目标刷新操作(例如，可以响应于刷新信号aref的每n次激活执行目标刷新操作)。每个管芯可以以相同的频率执行目标刷新操作，但是每个管芯中的设置(例如，熔丝设置)可以偏移目标刷新操作的相位。

如前所述，目标刷新操作的时序可以在时间上交错，以减少在刷新操作期间由存储器装置100消耗的峰值功率。可以设置堆栈125的不同管芯的设置，使得当在一或多个管芯上进行最大次数的同时刷新操作时，所述管芯中的至少一个执行目标刷新操作而不是自动刷新操作。

电源端子配有电源电位vdd和vss。电源电位vdd和vss被提供给内部电压发生器电路124。内部电压发生器电路124基于提供给电源端子的电源电位vdd和vss来生成各种内部电位vpp、vod、vary、vperi等。内部电位vpp主要用于行解码器108中，内部电位vod和vary主要用于存储器单元阵列118中包含的感测放大器samp中，并且内部电位vperi用于多种外围电路块中。

电源端子还配有电源电位vddq和vssq。电源电位vddq和vssq被提供给输入/输出电路122。在本公开的一个实施例中，提供给电源端子的电源电位vddq和vssq可以是与提供给电源端子的电源电位vdd和vss相同的电位。在本公开的另一个实施例中，提供给电源端子的电源电位vddq和vssq可以是与提供给电源端子的电源电位vdd和vss不同的电位。提供给电源端子的电源电位vddq和vssq用于输入/输出电路122，使得由输入/输出电路122生成的电源噪声不会传播到其它电路块。

图2是根据本公开的一个实施例的存储器封装的主/从配置的框图。在一些实施例中，存储器封装200可以是图1的半导体装置100和存储器堆栈125的一个实施方案。存储器封装200是表示一种可能将存储器管芯(和基板/接口)组织成可以在存储器装置中使用的存储器封装的一个实例。存储器封装200包含封装基板227，所述封装基板227包含向存储器封装200外部的其它组件发送信息和自其接收信息的端子。封装200还包含主存储器管芯(主管芯或主dram)228和多个从存储器管芯(从管芯或从dram)229a-c。主管芯228向基板227发送信号并且从基板227接收信号，并且进而向从管芯229a-c提供信号并且从从管芯229a-c接收信号。尽管仅示出了管芯228和229a-c的单个堆栈，但是在一些实施例中，封装基板227可以包含多个管芯堆栈。

大体上类似于存储器封装200的结构的实施例可以被称为3ds封装，并且每个管芯通常可以被称为逻辑秩。图2的存储器封装200示出了具有4个不同的存储器管芯(例如，主管芯228和3个从管芯229a-c)的一个示范性实施例。在其它示范性实施例中，可以使用更多或更少的存储器管芯。例如，一些存储器堆栈可以包含8或2个存储器管芯。

主存储器管芯228和从存储器管芯229a-c中的每个存储器管芯可以包含一或多个存储器阵列(例如，图1的存储器阵列118)。管芯228和229a-c还可以各自包含存储器装置的其它组件，例如刷新地址控制电路(例如，图1的刷新地址控制电路116)和行解码器和列解码器(例如，图1的108和110)。存储器装置的其它组件(例如，在基板123上示出的图1的存储器装置100的组件)可以分布在基板227和存储器管芯228和229a-c之间。在一些实施例中，主管芯228和每个从管芯229a-c可以在物理上彼此相同。

主管芯228可以耦合到基板227和第一从管芯229a。第一从管芯229a耦合到主管芯228并且还耦合到下一从管芯229b，依此类推。管芯228和229a-c可以通过多种方法彼此耦合(并且耦合到基板227)。在一些实施例中，管芯可以通过引线键合而耦合在一起。在一些实施例中，管芯可以使用硅穿孔(tsv)而耦合在一起。在3ds封装中，可以存在另外的基于峰值功率(和/或电流)的功率约束，所述峰值功率(和/或电流)可以通过管芯之间的耦合(例如，引线键合和/或tsv)拉动。

基板227可以接收指示封装200应被置于刷新状态的刷新命令。在一些实施例中，命令可以指定应被置于刷新状态的一或多个管芯228和229a-c。当处于刷新状态时，管芯228和229a-c中的每个管芯可以执行一或多次刷新操作(例如，自动刷新操作和/或目标刷新操作)。在一些实施例中，响应于刷新命令，3ds封装200可以不将所有管芯228和229a-c(逻辑秩)同时置于刷新状态。相反地，在逻辑秩中的一个开始执行刷新操作之后，在下一逻辑秩可以开始执行刷新操作之前，可能存在必须经过的最小时序。因此，在第一逻辑秩的第一刷新操作和第二逻辑秩的第一刷新操作之间可能存在至少所述最小时序的偏移。

当封装200处于刷新模式时，基板227可以接收刷新命令并且将其提供给主管芯228。主管芯228可以解码所述刷新命令并且将刷新信号aref提供给从管芯229a-c(以及主管芯228的内部组件)。刷新信号可以被周期性地激活(例如，升高到逻辑高电平)。每个逻辑秩可以从基板接收刷新信号(例如，aref)，其可以控制逻辑秩中的刷新操作的时序。在一些实施例中，逻辑秩(例如，管芯228和229a-c)可以响应于刷新信号的激活执行一或多次刷新操作。在一些实施例中，逻辑秩可以响应于接收刷新信号开始提供刷新泵信号的激活，并且可以响应于刷新泵信号的激活执行刷新操作。

在一些实施例中，每个逻辑秩可以具有刷新地址控制电路(例如，图1的116)，所述刷新地址控制电路确定将进行自动刷新操作还是目标刷新操作。每个逻辑秩(例如，管芯228和229a-c)可以包含一或多个设置，所述设置可以确定自动刷新操作和目标刷新操作的时序。例如，管芯228和229a-c中的每个管芯中的熔丝可以用于控制每个管芯中不同类型的刷新操作的时序。在一些实施例中，响应于刷新信号(和/或刷新泵信号)，管芯可以执行自动刷新操作。然而，管芯可以具有计数器，使得在刷新信号(和/或刷新泵信号)的某一次数的激活之后，它们替代地执行目标刷新操作。在一些实施例中，管芯可以以相同频率(例如，在对刷新信号的相同次数的激活进行计数之后)执行目标刷新操作，但是可以通过使用设置来更改计数的初始值来对其进行时间偏移。其它实施例可以使用其它方法来在时间上交错目标刷新操作。

在一些实施例中，主管芯228可以确定主管芯228和每个从管芯229a-c中的自动刷新和目标刷新操作的时序。例如，主管芯可以为每个从管芯229a-c提供单独的目标刷新信号(例如，rhr)。主管芯228可以包含内部逻辑，并且可以对内部逻辑何时将每个单独的目标刷新信号提供给其相应的管芯进行时序控制。作为一个示范性操作，当主管芯228接收刷新信号的第一激活时，其可以向从管芯229a发送目标刷新信号。当主管芯228接收刷新信号的第二激活时，其可以向从管芯229b发送目标刷新信号。当主管芯228接收刷新信号的第三激活时，其可以向从管芯229c发送目标刷新信号。在刷新信号的随后激活中，主管芯228可以再次重复所述循环。在其它示范性实施例中可以使用其它操作方法。

在一些实施例中，可以在组装存储器封装200时确定控制自动刷新和目标刷新操作的时序的刷新时序设置。在一些实施例中，可以基于管芯彼此的相对位置来确定时序设置(例如，管芯229a可以基于其远离主管芯228的管芯的数量等来采取某些时序设置)。

图3是根据本公开的一个实施例的存储器封装的框图。在一些实施例中，存储器封装300可以是图1的存储器堆栈125和接口123的示范性布置。存储器封装300与存储器封装200的不同之处可以在于，在存储器封装300中，管芯329a和329b(例如，dram229a-b)各自单独地耦合到基板327，而不是通过主管芯而耦合。管芯329a-b可以通过引线键合或tsv耦合到基板327。存储器封装300通常可以以类似于图2的存储器封装200的方式进行操作。为了简洁起见，不再重复与前面描述的那些相似的组件、结构和/或操作。

基板327可以接收命令，然后所述命令被传递给管芯329a-b中的一或两个。在一个实施例中，每个管芯329a和329b可以接收单独的命令。在一个实施例中，管芯329a-b可以同时接收相同的命令。在任一种情况下，两个管芯329a-b可以同时处于刷新模式。

响应于处于刷新模式，管芯329a-b可以执行一或多次刷新操作。管芯329a-b可以以基于基板327可以提供的刷新信号的时序执行刷新操作。管芯329a-b可以响应于刷新信号执行自动刷新操作或目标刷新操作。管芯329a-b可以交错目标刷新操作的时序。例如，第一管芯329a可以响应于刷新信号的第一激活执行目标刷新操作，而第二管芯329b可以响应于刷新信号的第二激活执行目标刷新操作。管芯329a-b中的设置(例如，熔丝设置)可以用于控制刷新操作的时序。

尽管存储器封装300示出了一对管芯329a-b，但是在其它实施例中可以使用更多或更少的管芯。使用一对管芯的实施例通常可以被称为双管芯封装(ddp)，而具有单管芯的一个实施例可以是单管芯封装(sdp)。

图4是根据本公开的一个实施例的存储器模块的框图。一或多个存储器封装425可以被组织在一起成为存储器模块400。存储器封装425可以包含在存储器模块400的一侧或两侧上。每个存储器封装425可以是存储器封装的任何布置，例如图1的存储器装置100、图2的存储器封装200和/或图3的存储器封装300中的一或多个。在一些实施例中，存储器封装425可以都是相同类型的存储器封装，在一些实施例中，可以使用不同类型的存储器封装的混合。控制器426可以向存储器封装425提供各种命令信号。

尽管图4中所示出的存储器模块400具有9个存储器封装425，但是在其它实施例中可以使用更多或更少的封装425。例如，在一些实施例中，可以将存储器封装425组织成不同的物理秩。例如，在模块400的第一侧上可以存在第一物理秩(例如，如图4中所示出的9个存储器封装425)，并且在模块400的后侧上可以存在第二物理秩(例如，在模块400的相反侧上的另外9个存储器封装)。在一些实施例中，每个物理秩可以存在18个封装425，并且在存储器模块400中存在一或多个物理秩。

类似于如本文所描述的使存储器封装425内的自动刷新和目标刷新操作间隔开，也可能期望管理模块400的封装425之间的时序。为了简洁起见，不再重复与前面描述的那些相似的组件、结构和/或操作。例如，一或多个封装425可以进入刷新模式，其中其相应的管芯中的一或多个执行自动刷新操作或目标刷新操作。除了在给定存储器封装的管芯之间交错之外，目标刷新操作还可以在模块的不同封装425之间交错。图7示出了目标刷新操作分布在封装内的不同管芯(例如，不同的逻辑秩)之间和不同的封装(例如，不同的物理秩)之间的一个实施例的示范性操作。图8示出了目标刷新操作在管芯同时开始执行刷新操作时分布在不同管芯中的不同刷新泵之间的一个实施例的示范性操作。图9示出了类似于图8的一个实施例的示范性操作，只是每个管芯在不同时间开始执行刷新操作。

图5是根据本公开的一个实施例的刷新地址控制电路的框图。刷新地址控制电路516的某些内部组件和信号被示出以说明刷新地址控制电路516的操作。在某些实施例中，虚线518被示出以表示每个组件(例如，刷新地址控制电路516和行解码器508)可以对应于特定存储器库，并且对于对每个存储器库来说，这些组件可以针重复。在一些实施例中，虚线518内所示出的组件可以位于每个存储器库中。因此，可以存在多个刷新地址控制电路516和行解码器508。为了简洁起见，将仅描述单个库的组件。在一些实施例中，刷新地址控制电路516可以实施图1的刷新地址控制电路116，并且可以位于存储器封装的每个管芯中。

dram接口526可以向地址刷新控制电路516和行解码器508提供一或多个信号。刷新地址控制电路516可以包含样本时序发生器530、地址采样器532、行锤刷新(rhr)状态控制器536和刷新地址发生器534。dram接口526可以提供一或多个控制信号，例如自动刷新信号aref和行地址xadd。样本时序发生器530生成采样信号armsample。

刷新地址控制电路516示出了与通过以随机或半随机时序对行地址xadd的传入值进行采样来检测攻击者地址的特定实施方案相关联的组件。在其它实施例中可以使用检测攻击者地址的其它方法，并且可以在刷新地址控制电路516中提供其它组件。

地址采样器532可以响应于armsample的激活来对当前行地址xadd进行采样(例如，锁存)。地址采样器532还可以向刷新地址发生器534提供一或多个锁存地址作为匹配地址hitxadd。rhr状态控制器536可以提供信号rhr以指示应进行行锤刷新操作(例如，对应于标识的攻击者行的受害者行的刷新)。rhr状态控制器536还可以提供内部刷新信号iref以指示应进行自动刷新操作。rhr状态控制器536可以用于控制目标刷新操作和自动刷新操作的时序。rhr状态控制器536可以耦合到特定于管芯的设置，例如熔丝设置(和/或可以包含设置)。在一些实施例中，rhr状态控制器536可以包含计数器，并且可以基于刷新信号aref的激活次数来提供信号rhr。在一些实施例中，熔丝设置可以控制rhr状态控制器536中计数器的初始值。以这种方式，可以在不同的管芯(和/或模块的不同封装)中生成rhr和iref的不同模式以交错目标刷新操作的时序。

响应于rhr的激活，刷新地址发生器534可以提供刷新地址rxadd，所述刷新地址rxadd可以是自动刷新地址或可以是与对应于与匹配地址hitxadd的攻击者行的受害者行对应的一或多个受害者地址。行解码器508可以响应于刷新地址rxadd和行锤刷新信号rhr执行刷新操作。行解码器508可以基于刷新地址rxadd和内部刷新信号iref来执行自动刷新操作。

dram接口526可以表示向库的组件提供信号的一或多个组件。在一些实施例中，dram接口526可以表示耦合到半导体存储器装置(例如，图1的装置100)的存储器控制器。在一些实施例中，dram接口526可以表示组件，例如图1的命令地址输入电路102、地址解码器104和/或命令解码器106。dram接口526可以提供行地址xadd、自动刷新信号aref、激活信号act和预充电信号pre。自动刷新信号aref可以是周期性信号，所述周期性信号可以指示何时应进行自动刷新操作。在一些实施例中(例如，其中dram接口526表示存储器控制器)，dram接口526可以向管芯提供刷新信号，并且管芯可以在内部生成自动刷新信号aref。可以提供激活信号act以激活给定存储器库。可以提供预充电信号pre以对给定存储器库预充电。行地址xadd可以是包含多个位(其可以串行或并行传输)的信号，并且可以对应于激活的存储器库的特定行。

样本时序发生器230提供采样信号armsample。armsample可以在逻辑低电平和逻辑高电平之间交替。armsample的激活可以是“脉冲”，其中armsample升高到逻辑高电平并且然后返回到逻辑低电平。armsample的脉冲之间的间隔可以是随机的、伪随机的和/或基于装置的一或多个信号(例如，aref)。

地址采样器532可以从dram接口526接收行地址xadd，并且从样本时序发生器530接收armsample。行地址xadd可以随着dram接口526将访问操作(例如，读取和写入操作)指向存储器单元阵列(例如，图1的存储器单元阵列118)的不同行而改变。每次地址采样器532接收armsample的激活(例如，脉冲)时，地址采样器532可以对xadd的当前值进行采样。在一些实施例中，地址采样器532可以提供xadd的当前采样值作为匹配地址hitxadd。刷新地址发生器234可以提供与匹配地址hitxadd相关联的一或多个受害者地址作为刷新地址rxadd。

在一些实施例中，响应于armsample的激活，地址采样器532可以基于采样的行地址xadd来确定一或多行是否是攻击者行，并且可以提供标识的攻击者行作为匹配地址hitxadd。作为本确定的一部分，地址采样器532可以响应于armsample的激活记录(例如，通过锁存和/或存储在寄存器中)xadd的当前值。xadd的当前值可以与地址采样器532中先前记录的地址(例如，存储在锁存器/寄存器中的地址)进行比较，以确定采样地址随时间的访问模式。如果地址采样器532确定当前行地址xadd正被重复地访问(例如，是攻击者行)，则armsample的激活也可以使地址采样器532提供攻击者行的地址作为匹配地址hitxadd。在一些实施例中，匹配地址(例如，攻击者地址)hitxadd可以存储在锁存器电路中，以供稍后由刷新地址发生器534检索。例如，可以存储一或多个匹配地址hitxadd的值，直到信号rhr指示目标刷新操作。

rhr状态控制器536可以接收自动刷新信号aref并且提供行锤刷新信号rhr。自动刷新信号aref可以周期性地生成并且可以用于控制刷新操作的时序。存储器装置可以执行一系列自动刷新操作，以便周期性地刷新存储器装置的行。可以生成rhr信号，以便指示所述装置应刷新特定目标行(例如，受害者行)，而不是来自所述一些列自动刷新地址的地址。rhr状态控制器536可以使用内部逻辑来提供rhr信号。在一些实施例中，rhr状态控制器536可以基于aref的某一激活次数(例如，aref的每4次激活)来提供rhr信号。在一些实施例中，计数器电路可以用于跟踪aref的激活次数。耦合到rhr状态控制器536的管芯特定设置可以改变计数器电路的初始值。

rhr状态控制器536还可以提供内部刷新信号iref，所述内部刷新信号可以控制刷新操作的时序。在一些实施例中，针对刷新信号aref的每次激活，可能存在iref的多次激活。在一些实施例中，内部刷新信号iref可以用作刷新泵信号以控制信号泵的激活。在一些实施例中，aref的每次激活可以与iref的激活次数相关联，所述iref的激活次数可以与刷新操作的次数相关联，所述刷新操作可以是目标刷新操作和自动刷新操作的混合。例如，iref的每次激活可以对刷新地址rxadd的刷新操作相关联，而rhr的状态可以确定刷新地址rxadd与自动刷新操作相关联还是与目标刷新操作相关联。在一些实施例中，信号iref可以用于指示应进行自动操作，而信号rhr用于指示应进行目标刷新操作。例如，可以生成信号rhr和iref，使得其不同时处于激活状态(例如，不同时均处于逻辑高电平)，并且iref的每次激活可以与自动刷新操作相关联，而rhr的每次激活可以与目标刷新操作相关联。

在一些实施例中，dram接口526和/或rhr状态控制器536可以在刷新信号aref的每次激活时执行多次刷新操作。在这些实施例中，响应于刷新信号aref的激活，接口526和/或状态控制器536可以提供刷新泵信号的一或多次激活。响应于刷新泵信号的每次激活，rhr状态控制器536可以提供iref或rhr。在一些实施例中，针对刷新信号aref的每次激活，可能存在刷新泵信号的4-6次激活。在其它实施例中可以使用更多或更少的泵。

刷新地址发生器534可以接收行锤刷新信号rhr和匹配地址hitxadd。匹配地址hitxadd可以表示攻击者行。刷新地址发生器534可以基于匹配地址hitxadd来确定一或多个受害者行的位置，并且提供其作为刷新地址rxadd。在一些实施例中，受害者行可以包含在物理上与攻击者行相邻的行(例如，hitxadd+1和hitxadd-1)。在一些实施例中，受害者行还可以包含在物理上与攻击者行的物理上相邻行相邻的行(例如，hitxadd+2和hitxadd-2)。在其它实例中，可以使用受害者行和标识的攻击者行之间的其它关系。

刷新地址发生器534可以基于行锤刷新信号rhr来确定刷新地址rxadd的值。在一些实施例中，当信号rhr不处于激活状态时，刷新地址发生器534可以提供一系列自动刷新地址中的一个。当信号rhr处于激活状态时，刷新地址发生器534可以提供目标刷新地址(例如，受害者地址)作为刷新地址rxadd。

行解码器508可以基于接收的信号和地址来对存储器阵列(未示出)执行一或多次操作。例如，响应于激活信号act和行地址xadd(并且iref和rhr处于逻辑低电平)，行解码器508可以在特定的行地址xadd上引导一或多次访问操作(例如，读取操作)。响应于rhr信号处于激活状态，行解码器508可以刷新刷新地址rxadd。

图6是根据本公开的一个实施例的行解码器的框图。在本公开的一些实施例中，行解码器600可以包含在图1的行解码器108中。行解码器600可以确定是否激活对应于行地址xadd或刷新地址rxadd的存储器库(例如，图1的存储器阵列118的库)的字线。

如图6中所示，行解码器600设有行激活时序发生器642，所述行激活时序发生器642接收内部刷新信号iref和行锤刷新信号rhr、激活信号act和预充电信号pre，并且提供状态信号refpd、字线激励信号wden、感测放大器激励信号saen和位线均衡信号bleq。在一些实施例中，信号iref和rhr可以是自动刷新信号aref。将状态信号refpd被提供给多路复用器640，所述多路复用器640选择行地址xadd和刷新地址rxadd中的一个。由多路复用器640选择的地址xaddi被提供给行冗余控制电路644。如果由地址xaddi指示的字线被冗余字线替换，则命中信号redmatch被激活，并且生成作为替换目的地的行地址xaddd1。地址xaddi和xaddd1被提供给多路复用器646；其中如果命中信号redmatch未被激活，则选择地址xaddi；并且如果命中信号redmatch被激活，则选择地址xaddd1。选择的地址xadd2被提供给x地址解码器648。x地址解码器648基于字线激励信号wden、感测放大器激励信号saen和位线均衡信号bleq来控制由地址xadd2指示的字线、与其对应的感测放大器、均衡电路等的操作。

图7是根据本公开的一个实施例的刷新操作的时序图。时序图700可以说明包含两个物理秩(物理秩0和物理秩1)的特定示范性存储器装置的交错刷新时序，所述物理秩中的每个物理秩包含4个物理秩(例如，逻辑0-3)。根据时序图700操作的示范性存储器装置可以具有在第一逻辑秩进入刷新模式之后、下一逻辑秩可以进入刷新之前的最小时间。在一些实施例中，时序图700可以说明包含两个3ds封装(例如，类似于图2的存储器封装200的封装)的存储器模块(例如，图4的存储器模块400)。所述两个封装中的每个封装可以表示物理秩，而所述封装内的每个管芯可以表示其相应的物理秩的逻辑秩。

在第一时间t0(并且在随后的时间t1-t4)，两个物理秩均可以接收刷新信号(例如，aref)。这可能使两个物理秩在第一逻辑秩中开始执行刷新操作(自动刷新或目标刷新)。在时序图700的示范性实施例中，存在在下一逻辑秩可以进入刷新操作之前必须经过的最小时间tmin。这个时间tmin可以表示系统的属性，并且可以例如是存储器装置的设置。时序图700说明了以最小允许时序(例如，以由刷新信号触发的每次刷新操作之间的tmin)执行刷新操作的场景。因此，在t0时，逻辑0开始执行刷新操作。t0后不久(由存储器的最小时序确定)，逻辑1开始执行刷新操作。在其后不久，逻辑2开始执行刷新操作，以此类推。

在一些实施例中，每个逻辑秩执行的刷新操作可以长于最小延迟时间，并且因此在不同逻辑秩中的刷新操作可以在时间上彼此重叠。在一些实施例中，刷新操作和aref信号的时序可以是这样的，使得只要最终刷新操作结束(例如，在逻辑3完成其刷新操作之后)，就接收新的aref，这使第一逻辑秩(例如，逻辑0)再次开始刷新操作。

每次逻辑秩中的一个响应于刷新信号中的一个执行刷新操作时，其可以执行自动刷新操作或目标刷新操作。与自动刷新期间相比，可能在目标刷新期间刷新更少的字线，并且因此目标刷新可以消耗更少的功率。逻辑秩中的每个逻辑秩(例如，单独的存储器管芯，例如图2的管芯228和229a-c和/或图3的管芯329a-b)可以以相同的速率执行自动刷新操作，但是可以在时间上交错。在一些实施例中，所述速率可以与刷新信号aref有关联，使得针对给定逻辑秩，在每对目标刷新操作之间存在aref的某一次数的激活。在时序图700中所示的特定实施例中，在给定的一对目标刷新操作之间可以存在四次自动刷新操作。换言之，在aref的每第五次激活时可以进行目标刷新操作。

为了交错目标刷新操作，逻辑秩中的每个逻辑秩(例如，存储器管芯)可以包含在时间上偏移目标刷新操作的设置。在一个示范性实施方案中，每个逻辑秩可以包含计数器(例如，在图1的刷新地址控制电路116中)，所述计数器对aref激活进行计数，但是每个逻辑秩可以包含设置(例如，熔丝设置)以改变计数器的初始值。所述设置还可以在两个逻辑秩之间变化。以这种方式，通过交错管芯之间的目标刷新操作的时序，可以减少在给定时间进行的自动刷新操作的最大次数，这可以减少刷新操作期间的最大功率。

在第一时间t0时，两个物理秩接收第一aref命令。响应于第一aref命令，物理秩0中的逻辑0执行目标刷新操作，而其余秩执行自动刷新操作。在第二时间t1时，接收下一aref，并且与第一aref命令相反，物理秩0的逻辑1和物理秩1的逻辑0均执行目标刷新操作，而其余秩执行自动刷新操作。在第三时间t2时，响应于第三aref命令，物理秩0中的逻辑2和物理秩1的逻辑1均执行目标刷新操作，而其余秩执行自动刷新操作。在第四时间t3时，响应于第四aref命令，物理秩0中的逻辑3和物理秩1的逻辑2均执行目标刷新操作，而其余秩执行自动刷新操作。在第五时间t4时，响应于第五aref命令，物理秩1中的逻辑3执行目标刷新操作，而其余秩执行自动刷新操作。在接收aref的下一时间，所述循环可以重复，并且物理秩0中的逻辑0可以执行目标刷新操作。

如图7的示范性操作所示，存在响应于任何给定刷新命令aref执行自动刷新操作的最多7个秩。这可以减小在存储器装置执行刷新操作时被拉动的峰值功率。

图8是根据本公开的一个实施例的刷新泵之间的交错刷新时序的时序图。时序图800示出了用于存储器装置的一个实施例，其中响应于每个刷新信号(例如，aref)，每个存储器管芯生成多个刷新泵，所述刷新泵中的每个刷新泵在其相应的管芯中触发自动刷新或目标刷新操作。目标刷新操作可以在存储器装置的不同管芯之间交错，使得在任何给定时间点进行的自动刷新操作的最大次数减少。

时序图800可以说明具有四个管芯的存储器装置的示范性刷新操作(在其它实施例中可以使用更多或更少的管芯)。所述管芯全都可以在初始时间t0时接收刷新信号aref。在时序图700所示的示范性实施例中，所述管芯中的每个管芯可以响应于接收刷新信号aref产生一系列刷新泵。由于所有四个管芯都接收到相同的aref激活，所以刷新泵通常可以彼此同步。

所述管芯中的每个管芯包含确定响应于给定泵执行自动刷新操作还是目标刷新操作的设置。所述设置可以用于交错不同刷新泵之间的目标刷新操作。在图8的示范性实施例中，响应于aref的每次激活，生成四个刷新泵(在其它实施例中可以生成更多或更少的泵)。每个管芯可以具有对一或多个特定刷新泵执行目标刷新操作的设置(例如，管芯2可以被设置成对四个泵中的第二个泵执行目标刷新，而管芯3可以被设置为对四个泵中的第三个泵执行目标刷新)。通过改变管芯之间的设置，可以交错目标刷新，这可以降低峰值刷新功率需求。

在初始时间t0之后的第一时间t1时，所述管芯中的每个管芯生成第一刷新泵。管芯1执行目标刷新操作，而管芯2-4执行自动刷新操作。在第二时间t2时，所述管芯中的每个管芯生成第二刷新泵，并且管芯2执行目标刷新操作，而其余管芯执行自动刷新操作。在第三时间t3时，每个管芯生成第三刷新泵，并且管芯3执行目标刷新操作，而其余管芯执行自动操作。在第四时间t4时，所述管芯中的每个管芯生成第四刷新泵，并且管芯4执行目标刷新操作，而其余管芯执行自动操作。以这种方式，在任何给定刷新泵期间，自动刷新操作绝不会超过3次。

图9是根据本公开的一个实施例的交错刷新操作的时序图。时序图900可以表示一个示范性实施例，其中目标刷新操作在刷新泵之间交错，但是逻辑秩中的每个逻辑秩(例如，管芯)不是同时开始生成泵。时序图900中说明的存储器装置可以类似于图7的时序图700中的实例，因为存储器装置可能要求，在给定逻辑秩(例如，管芯)开始生成刷新泵之后、在下一逻辑秩开始生成刷新泵之前需经过至少最小时间量tmin。在时序图900中，逻辑秩可以开始生成刷新泵，所述刷新泵在本实例中可以是足够的时间，使得给定秩在下一逻辑秩可以开始生成刷新泵之前生成两个刷新泵。在本实施例中，每个逻辑秩可以响应于进入刷新模式(例如，响应于刷新信号(例如，aref))生成六个刷新泵。

在第一时间t0时，逻辑秩0可以开始生成刷新泵。逻辑秩0中的泵1和2可以均指示自动刷新操作。在第二时间t1时，逻辑秩1也可以开始生成刷新泵。逻辑秩0的泵3和4以及逻辑秩1的泵1和2均可以与自动刷新操作相关联。在第二时间t2时，逻辑秩2可以开始生成刷新泵。逻辑秩0的泵5和逻辑秩1的泵4均可以与目标刷新操作相关联，而逻辑秩0的泵6、逻辑秩1中的泵3和逻辑秩2的泵1和2均可以与自动刷新操作相关联。在第四时间t3时，逻辑秩0可以停止提供刷新泵，由于其已响应于进入刷新状态提供了6个刷新泵。在t3时，逻辑秩3可以开始生成自动刷新泵。逻辑秩2的泵3和逻辑秩3的泵2可以与其相应的逻辑秩中的目标刷新操作相关联，而逻辑秩1的泵5和6、逻辑秩2的泵4和逻辑秩3的泵1均可以与其相应的逻辑秩中的自动刷新操作相关联。在第五时间t4时，逻辑秩1可以停止提供刷新泵(由于其已提供了6个泵)。t4之后，逻辑秩2和逻辑秩3中的其余泵均可以与其相应的管芯中的自动刷新操作相关联。

在图9的实施例中，不同逻辑秩中的每个逻辑秩在不同数量的相应泵之后执行目标刷新操作(例如，逻辑秩0对泵5执行目标刷新操作，而逻辑秩1对泵4执行目标刷新操作)。在一些实施例中，所述不同逻辑秩中的每个逻辑秩可以包含管芯内部的设置(例如，熔丝设置)以在执行目标刷新操作之前控制泵的数量。由于逻辑秩都在不同时间开始提供泵，所以可以延迟第一目标刷新操作(例如，在逻辑秩0中的泵5)，直到在给定时间存在最大数量的泵。在时序图900的示范性实施例中，在给定时间存在的泵的最大数量是3，其发生在t2和t4之间。对每个管芯中的目标刷新进行时序控制，使得当在给定时间存在最大数量的刷新泵(例如，3)时，所述泵中的至少一个与在所述管芯中的至少一个中的目标刷新操作相关联。在一些实施例中，可以对目标刷新操作进行时序控制，使得所述目标刷新操作直到存在最大数量的同时刷新泵时才开始(例如，在t2)，并且在不再存在最大数量的同时刷新泵时结束(例如，在t4)。因此，在任何给定时间点进行的自动刷新操作绝不会超过两次。

当然，应当理解，根据本系统、装置和方法，本文描述的实例、实施例或过程中的任何一个可以与一或多个其它实例、实施例和/或过程组合或是分开的，和/或在不同的装置或装置部分中执行。

最后，上述讨论仅旨在说明本系统，并且不应被解释为将所附权利要求限制为任何特定实施例或实施例组。因此，尽管已经参照示范性实施例特别详细地描述了本系统，但是还应当理解，本领域普通技术人员可以设计出许多修改和替代实施例而不脱离如以下权利要求中阐述的本系统的更广泛和预期的精神和范围。因此，本说明书和附图应以说明性方式看待，并且并非旨在限制所附权利要求的范围。