专利名称：一种多阶m序列发生电路的制作方法
专利说明
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图1为现有9阶M序列发生电路的结构原理图。图2为本实用新型的结构示意图。
具体实施方式
下面结合具体附图和实施例对本实用新型作进一步说明。为了能够使得M序列发生电路能够稳定可靠地输出所需的M序列，本实用新型包 括触发电路及与所述触发电路对应相连的异或门，所述异或门通过至少一条微带线与触发 电路相连，通过微带线延迟所需的时间后，触发电路输出所需的M序列。当异或门通过微带 线与触发电路连接后，利用微带线延迟精准的特性避免了传统电路里高速门电路的不确定 延时，利用微带线的延迟小妾时长可控的特点，提高了 M序列的工作频率，同时可以减少触 发电路中门电路的数量。如图2所示为本实用新型的具体实现方式。触发电路包括第一 D触发器、第二 D 触发器及第三D触发器，触发电路中至少包括第一 D触发器与第二 D触发器；其中，第一 D 触发器为a8，第二 D触发器为a0，第三D触发器为al。第一 D触发器a8的Q端与第三D触 发器的D端相连，第三D触发器的Q端与第二 D触发器的D端相连，第二 D触发器的Q端输 出所需的M序列；第一 D触发器的Q端与第二 D触发器的Q端均与异或门的输入端相连，异 或门的输出端通过微带线与第一 D触发器的D端相连，第二 D触发器的Q端也可以通过微 带线与异或门的输入端相连。当通过设置相应的微带线后，异或门可以只通过与输出端相 连的微带线达到所需的延迟时间，使得触发电路输出相应的M序列；异或门也可以只通过 与输入端相连的微带线达到所需的延迟时间，使得触发电路输出相应的M序列，同理，异或 门的输入端与输出端都可以与相应的微带线相连。在多阶M序列发生电路中，也可以包括 多个异或门，多具有多个异或门时，异或门间串接在一起。如图2所示工作时，根据需要选择触发电路中相应D触发器的数量，并根据所需 的M序列及触发电路选择相应长度的微带线，异或门通过微带线与触发电路相连。触发电 路与相应的脉冲信号相连，经过触发电路后，触发电路输出相应的M序列。当需要得到较高 频率的M序列时，触发电路内的D触发器与异或门均应选择相应高速的型号。随着芯片频 率的提高，还可以适用于更高频率的M序列，并可以使用于其他阶数的M序列以及其它相类 似的伪随机序列。本实用新型异或门与触发电路间至少通过一条微带线相连，通过微带线延迟所需 的时间能，触发电路能够输出所需的M序列；频率高，能够轻松实现GHz级的时钟频率；成 本低，所需器件少，本实用新型中只使用了三个D触发器和一个异或门实现多阶M序列，可 靠性高，稳定性好、可用于通讯、雷达领域；利用微带线构建的高频多阶M序列发生电路解决了 M序列发生电路储频频率低、调试困难的问题，并可广泛应用于各种高频信号发生电 路中。
权利要求1.一种多阶M序列发生电路，包括触发电路及与所述触发电路对应相连的异或门；其特征是所述异或门通过至少一条微带线与触发电路对应相连，异或门通过微带线延迟所需的时间后，由触发电路输出所需的M序列。
2.根据权利要求I所述的多阶M序列发生电路，其特征是所述触发电路包括第一D触发器及第二 D触发器，所述第一 D触发器的Q端与第二 D触发器的D端相连；第一 D触发器的Q端与第二 D触发器的Q端分别与异或门的输入端相连，异或门的输出端通过微带线与第一 D触发器的D端相连，第二 D触发器的Q端输出所需的M序列。
3.根据权利要求2所述的多阶M序列发生电路，其特征是所述第二D触发器的Q端通过微带线与异或门的输入端相连。
4.根据权利要求2所述的多阶M序列发生电路，其特征是所述触发电路还包括第三D触发器，所述第一 D触发器的Q端与第三触发器的D端相连，第三D触发器的Q端与第二 D触发器的D端相连。
专利摘要本实用新型涉及一种多阶M序列发生电路，其包括触发电路及与所述触发电路对应相连的异或门；所述异或门通过至少一条微带线与触发电路对应相连，异或门通过微带线延迟所需的时间后，由触发电路输出所需的M序列。本实用新型异或门与触发电路间至少通过一条微带线相连，通过微带线延迟所需的时间能，触发电路能够输出所需的M序列；频率高，能够轻松实现GHz级的时钟频率；成本低，所需器件少，本实用新型中只使用了三个D触发器和一个异或门实现多阶M序列，可靠性高，稳定性好、可用于通讯、雷达领域；利用微带线构建的高频多阶M序列发生电路解决了M序列发生电路储频频率低、调试困难的问题，并可广泛应用于各种高频信号发生电路中。
文档编号H03K3/02GK202475380SQ201220055858
公开日2012年10月3日 申请日期2012年2月20日 优先权日2012年2月20日
发明者叶述平, 张成裕, 张磊, 韩盈春 申请人:北方通用电子集团有限公司