栅极移位寄存器和包括其的有机发光显示设备的制作方法

本申请要求享有于2017年12月11日提交的韩国专利申请no.10-20170169638的权益，出于所有目的通过引用将该韩国专利申请并入到本文中，就如同在本文中被全面阐述。

本公开涉及移位寄存器和包括其的有机发光显示设备。

背景技术：

有源矩阵型有机发光显示设备包括自发光有机发光二极管(oled)并有利地具有快速响应速度、高发光效率、高亮度和宽视角。

oled是一种自发光装置，包括阳极电极、阴极电极和形成在其间的有机化合物层(空穴注入层(hil)、空穴传输层(htl)、发光层(eml)、电子传输层(etl)和电子注入层(eil))。有机化合物层包括hil、htl、eml、etl和eil。在向阳极电极和阴极电极施加驱动电压时，穿过htl的空穴和穿过etl的电子向eml移动以形成激子，结果导致eml发射可见光。

在有机发光显示设备中，以矩阵形式布置均包括oled的像素，并根据图像数据的梯度调节像素的亮度。每一个像素都包括控制流入oled的驱动电流的驱动元件(或驱动晶体管)、用于对驱动元件的栅-源电压进行编程的多个开关元件、以及至少一个存储电容器。

有机发光显示设备包括用于驱动在像素中提供的开关元件的栅极驱动器。开关元件的栅极电极通过栅极线连接到栅极驱动器。栅极驱动器产生栅极信号并相继地向栅极线供应栅极信号。栅极信号在栅极高电压与栅极低电压之间摆动，在栅极高电压下可以使开关元件导通，在栅极低电压下可以使开关元件截止。栅极驱动器可以被实施为包括多个级的栅极移位寄存器。

各级要工作需要多个移位时钟。移位时钟是多个脉冲，所述多个脉冲在相位上被相继移位，并在栅极高电压与栅极低电压之间摆动。移位时钟可以包括扫描移位时钟和进位移位时钟，并还可以包括感测移位时钟。扫描移位时钟用于产生扫描控制信号，进位移位时钟用于产生进位信号，并且感测移位时钟用于产生感测控制信号。

扫描控制信号可以作为栅极高电压与扫描移位时钟同步输出。在根据具有栅极高电压的扫描控制信号使像素中的开关元件导通时，向像素中写入用于显示图像的数据电压。同时，进位信号可以作为栅极高电压与进位移位时钟同步输出。可以根据栅极高电压的进位信号激活相应级的操作。感测控制信号可以作为栅极高电压与感测移位时钟同步输出。在根据栅极高电压的感测控制信号使像素中的开关元件导通时，向像素中写入用于显示图像的参考电压。

经由时钟线向各级供应移位时钟。因此，如果将移位时钟分类为用于扫描、进位或感测目的的时钟，则需要大量的时钟线。栅极移位寄存器可以直接形成在显示面板的边框区域中，在这种情况下，时钟线数量的增加可能使得难以减小边框区域。

同时，为了实现窄边框，时钟线在显示面板上被设置成彼此接近，这增大了时钟线之间的寄生电容。结果，在向相邻时钟线施加具有不同相位的移位时钟的情况下，由于耦合效应而使移位时钟可能会失真。失真的移位时钟可能会使栅极信号和与其相对应的像素的电压电荷定时失真，降低图像质量。

技术实现要素：

本公开提供了一种能够通过减少时钟线的数量来实现窄边框的栅极移位寄存器，以及包括其的有机发光显示设备。

本公开还提供了一种能够通过使由于时钟线之间的耦合效应导致的移位时钟失真最小化而改善图像质量的栅极移位寄存器、以及一种包括所述栅极移位寄存器的有机发光显示设备。

在方面中，一种具有多个级的栅极移位寄存器包括：向所述级供应产生扫描控制信号所需的具有不同相位的扫描移位时钟的多条扫描时钟线；以及向所述级供应产生进位信号所需的具有不同相位的进位移位时钟的多条共享进位时钟线，其中所述共享进位时钟线的数量是所述扫描时钟线的数量一半，并且包括彼此相邻的奇数序号级和偶数序号级的每一级对共享一个进位移位时钟。

附图说明

图1示出了根据本公开的实施例的有机发光显示设备；

图2示出了构成图1中的栅极移位寄存器的级之间的连接结构；

图3是示出根据本公开的实施例的级的电路图；

图4是示出连接到图3中的级的一个像素和数据驱动电路的视图；

图5是示出根据本公开的另一实施例的级的电路图；

图6是示出连接到图5中的级的一个像素和数据驱动电路的视图；

图7是示出连接到图3所示的级的设置在面板内栅极基板上的时钟线的布置示例的视图；

图8是示出施加到图7中的时钟线的移位时钟的波形的视图；

图9是示出连接到图5所示的级的设置在面板内栅极基板上的时钟线的布置示例的视图；

图10是示出施加到图9中的时钟线的移位时钟的波形的视图；

图11是示出连接到图5所示的级的设置在面板内栅极基板上的时钟线的另一布置示例的视图；

图12是示出施加到图11中的时钟线的移位时钟的波形的视图；

图13是示出连接到图5所示的级的设置在面板内栅极基板上的时钟线的另一布置示例的视图；

图14是示出施加到图13中的时钟线的移位时钟的波形的视图；

图15是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图7修改的视图；

图16是示出施加到图15中的时钟线的移位时钟的波形的视图；

图17是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图9修改的视图；

图18是示出施加到图17中的时钟线的移位时钟的波形的视图；

图19是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图11修改的视图；

图20是示出施加到图19中的时钟线的移位时钟的波形的视图；

图21是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图13修改的视图；以及

图22是示出施加到图21中的时钟线的移位时钟的波形的视图。

具体实施方式

在下文中，将参考附图详细描述本公开的实施例。在整个说明书中，相似的附图标记表示基本相同的元件。在描述本公开时，如果认为针对相关已知功能或构造的详细解释会不必要地分散本公开的主旨，将省略这样的解释，但会被本领域的技术人员理解。以下描述中使用的元件名称是为了描述目的选择的，可以与实际产品中的元件名称不同。

在以下描述中，“前级”是指位于参考级上方并产生相对于从参考级输出的栅极信号在相位上超前的栅极信号的级。此外，“后级”是指位于参考级下方并产生相对于从参考级输出的栅极信号在相位上滞后的栅极信号的级。在以下描述中，构成本公开的栅极移位寄存器的开关元件可以被实现为氧化物元件、非晶硅元件和多晶硅元件的至少任一种。激活特定节点是指利用高电位源极电压或相应电压对节点进行充电，去激活特定节点是指对节点的电位进行放电以达到低电位源极电压或相应电压。

在本公开中，可以由具有n型金属氧化物半导体场效应晶体管(mosfet)结构(但不限于此)的薄膜晶体管(tft)实现形成在显示面板的基板上的像素电路和栅极移位寄存器。tft是包括栅极、源极和漏极的三电极元件。源极是向晶体管供应载流子的电极。在tft中，载流子开始从源极流动。漏极是载流子离开tft的电极。

图1示出了根据本公开的实施例的包括栅极移位寄存器的有机发光显示设备。

参考图1，本公开的有机发光显示设备包括显示面板100、数据驱动电路(未示出)、栅极驱动器130和150、以及定时控制器110。

在显示面板100中，多条数据线和多条栅极线彼此交叉，像素以矩阵形式布置在交叉点处，形成像素阵列。每个像素可以包括有机发光二极管(oled)、驱动tft、存储电容器和至少一个开关tft。每个tft都被实现为p型、n型或混合p型和n型的混合型。此外，每个tft的半导体层都可以包括非晶硅、多晶硅或氧化物。

数据驱动电路包括多个源极驱动器ic120。源极驱动器ic120从定时控制器110接收图像数据rgb。响应于来自定时控制器110的源极定时控制信号，源极驱动器ic120将图像数据rgb转换成伽马补偿电压，以产生数据电压并与栅极信号同步地将数据电压供应到显示面板100的数据线。源极驱动器ic120可以通过玻璃上芯片(cog)工艺或带式自动接合(tab)工艺连接到显示面板100的数据线。

栅极驱动器130和150包括连接在定时控制器110与显示面板100的栅极线之间的电平移位器和栅极移位寄存器。

电平移位器将从定时控制器110输入的时钟信号clk的晶体管-晶体管-逻辑(ttl)电平电压电平移位到能够切换形成在显示面板100中的tft的栅极高电压和栅极低电压。电平移位器向栅极移位寄存器供应经电平移位的移位时钟。

栅极移位寄存器可以直接形成在面板内栅极(gip)基板中的显示面板100的下基板上。在该实施例中，栅极移位寄存器形成在面板内栅极基板上。栅极移位寄存器形成在显示面板100上不显示图像的区域(即，边框区域bz)中。栅极移位寄存器包括时钟线和连接到时钟线的多个级，从电平移位器向所述时钟线施加移位时钟。稍后将参考图7到22详细描述时钟线的布置。在gip方案中，电平移位器可以安装在印刷电路板(pcb)140上。

定时控制器110通过各种已知的接口方法从外部主机系统接收图像数据rgb。定时控制器110可以校正图像数据rgb，从而在基于实时感测的感测结果的基础上补偿像素的电特性变化，并然后向源极驱动器ic120发送校正后的图像数据。

定时控制器110从主机系统接收定时信号，例如垂直同步信号vsync、水平同步信号hsync、数据使能信号de、主时钟mclk等。定时控制器110产生用于相对于来自主机系统的定时信号控制数据驱动电路的操作定时的数据定时控制信号，以及用于控制栅极驱动器的操作定时的栅极定时控制信号。

栅极定时控制信号包括启动信号vsp、移位时钟clk等。

数据定时控制信号包括源极采样时钟ssc、源极输出使能信号soe等。源极采样时钟ssc是基于上升沿或下降沿来控制源极驱动器ic120中的数据的采样定时的时钟信号。源极输出使能信号soe是用于控制数据电压的输出定时的信号。

图2示出了包含在图1中的栅极驱动器130中的栅极移位寄存器的级的连接结构。

参考图2，根据本公开的实施例的栅极移位寄存器包括彼此相关连接的多个级stgn至stgn+3132。级stgn至stgn+3132可以是形成在面板内栅极(gip)基板上的gip元件。可以在最上级之前进一步提供至少一个上虚设级，可以在最下级之后进一步提供至少一个下虚设级。

级stgn至stgn+3132独立于扫描控制信号sct(n)至sct(n+3)产生进位信号cry(n)至cry(n+3)。由于级stgn至stgn+3132独立于扫描控制信号sct(n)至sct(n+3)产生进位信号cry(n)至cry(n+3)，因此可以防止进位信号由于栅极线的负载而失真。级stgn至stgn+3132产生扫描控制信号sct(n)至sct(n+3)，并将其供应到显示面板的栅极线。级stgn至stgn+3132可以产生进位信号cry(n)至cry(n+3)，并将进位信号作为启动信号供应到后级之一，并将进位信号作为复位信号供应给前级中的任何一级。

同时，尽管未示出，但级stgn至stgn+3132可以进一步产生感测控制信号，并然后将感测控制信号供应到栅极线。感测控制信号是用于在像素与感测线之间切换电流的栅极信号。感测控制信号可以在图4所示的像素结构中被省略掉，但在图6所示的用于外部补偿的像素结构中是有用的。

为了产生扫描控制信号sct(n)至sct(n+3)、进位信号cry(n)至cry(n+3)以及感测控制信号，级stgn至stgn+3132可以从外部定时控制器(未示出)接收全局启动信号vsp、移位时钟clk、全局复位信号(未示出)等。

全局启动信号vsp、移位时钟clk和全局复位信号是公共供应给级stgn至stgn+3132的信号。全局启动信号vsp可以被进一步传送到上虚设级的启动端子，全局复位信号可以被进一步传送到下虚设级的复位端子。

级stgn至stgn+3132中的每一级根据在每一帧施加到启动端子的前级进位信号激活节点q的操作。前级进位信号是从前级之一施加的进位信号。在此，级stgn至stgn+3132中的一些可以从上虚设级接收进位信号。上虚设级可以根据全局启动信号vsp进行操作并向上级中的一些供应进位信号。

级stgn至stgn+3132中的每一级根据在每一帧施加到复位端子的后级进位信号去激活节点q的操作。后级进位信号是从后级之一施加的进位信号。在此，级stgn至stgn+3132中的一些可以从下虚设级接收进位信号。下虚设级可以根据全局复位信号进行操作并向下级中的一些供应进位信号。

可以向级stgn至stgn+3132中的每一级供应多个移位时钟clk。移位时钟clk可以包括在相位上相继移位的扫描移位时钟和在相位上相继移位的进位移位时钟，并还可以包括在相位上相继移位的感测移位时钟。扫描移位时钟是用于产生扫描控制信号sct(n)至sct(n+3)的时钟信号，并且进位移位时钟是用于产生进位信号cry(n)至cry(n+3)的时钟信号。感测移位时钟是用于产生感测信号的时钟信号。扫描移位时钟在栅极高电压与栅极低电压之间摆动以与扫描控制信号sct(n)至sct(n+3)同步。进位移位时钟与进位信号cry(n)至cry(n+3)同步地在栅极高电压狱栅极低电压之间摆动。感测移位时钟在栅极高电压与栅极低电压之间摆动以与感测信号同步。

可以以重叠方式驱动这些移位时钟clk5，以确保在高速驱动时有充分的充电时间。相邻相位的时钟可以根据重叠驱动彼此重叠预定的栅极高时段(栅极导通时段)。

为了简化级stgn至stgn+3132的连接配置，并减小边框区域bz，可以消除一些用于供应移位时钟clk的时钟线。将参考图7至22对此进行详细的描述。

级stgn到stgn+3132中的每一级都可以从外部电源单元(未示出)接收电源电压ps。电源电压ps包括高电位电源电压和低电位电源电压。高电位电源电压可以被设置为栅极高电压，例如12v。低电位电源电压可以被设置为多个栅极低电压，例如-6v和-12v，以抑制属于级stgn至stgn+3132中的每一级的晶体管的漏电流。在这种情况下，扫描移位时钟可以在-6v与12v之间摆动，并且进位移位时钟可以在-12v与12v之间摆动。换言之，进位移位时钟的摆动宽度可以大于扫描移位时钟的摆动宽度。进位信号cry(n)至cry(n+3)的摆动宽度可以大于扫描控制信号sct(n)至sct(n+3)的摆动宽度。这在抑制下拉晶体管的劣化方面是有效的，在所述下拉晶体管中栅极电极连接到每一级中的节点qb。

图3是示出根据本公开的实施例的级的电路图。图4是示出连接到图3中的级的像素和数据驱动电路的视图。

图3示出了第n级stgn132，其输出第n栅极信号sct(n)和第n进位信号cry(n)。在图3中，高电位电源电压gvdd具有来自电源ps的栅极高电压电平。低电位电源电压gvss可以基本等于来自电源ps的栅极低电压。由于图3中的级连接到图4所示的像素，因此不必通过接收感测移位时钟来输出感测控制信号。

参考图3，级stgn包括输入单元bk1、反相器单元bk2、输出缓冲器bk3和稳定单元bk4。

响应于通过启动端子输入的前级进位信号cry(n-3)，输入单元bk1将节点q(n)的电位激活到高电位电源电压gvdd。响应于通过复位端子输入的后级进位信号cry(n+3)，输入单元bk1将节点q(n)的电位去激活到低电位电源电压gvss。

为此，输入单元bk1包括多个晶体管t1和t2。晶体管t1包括连接到被施加了前级进位信号cry(n-3)的启动端子的栅极电极和漏极电极，以及连接到节点q(n)的源极电极，并向节点q(n)施加前级进位信号cry(n-3)。晶体管t2包括连接到被施加了后级进位信号cry(n+3)的复位端子的栅极电极，连接到节点q(n)的漏极电极，以及连接到节点gvss的源极电极。晶体管t2将节点q(n)与低电位电源电压gvss连接，而后级进位信号cry(n+3)被输入以去激活节点q(n)。

反相器单元bk2对节点qb(n)进行与节点q(n)相反的充电和放电。反相器单元bk2可以通过根据节点n1的电位向节点qb(n)施加高电位电源电压gvdd来激活节点qb(n)。与根据节点q(n)相反的方式控制节点n1的电位。在激活节点q(n)的同时，将节点n1去激活到低电位电源电压gvss，并且在去激活节点q(n)的同时，将节点n1激活到高电位电源电压gvdd。换言之，将节点qb(n)的电位激活到高电位电源电压gvdd，同时向节点q(n)施加低电位电源电压gvss。

为此，反相器单元bk2包括多个晶体管t4、t5和t6。晶体管t4包括连接到节点n1的栅极电极、被施加了高电位电源电压gvdd的漏极电极、以及连接到节点qb(n)的源极电极。晶体管t5包括被施加了高电位电源电压gvdd的栅极电极和漏极电极、以及连接到节点n1的源极电极。晶体管t6包括连接到节点q(n)的栅极电极、连接到节点n1的漏极电极、以及被施加了低电位电源电压gvss的源极电极。

在节点q(n)被激活时，反相器单元bk2将节点qb(n)的电位去激活到低电位电源电压gvss。反相器单元bk2还可以根据前级进位信号cry(n-3)将节点qb(n)的电位去激活到低电位电源电压gvss，以便改善操作的可靠性。

为此，反相器单元bk2还包括多个晶体管t7和t8。晶体管t7包括连接到节点q(n)的栅极电极、连接到节点qb(n)的漏极电极、以及被施加了低电位电源电压gvss的源极电极。晶体管t8包括被施加了前级进位信号cry(n-3)的栅极电极、连接到节点qb(n)的漏极电极、以及被施加了低电位电源电压gvss的源极电极。

在节点q(n)的电位升高到提升电平时，输出缓冲器bk3在输出节点n3处输出扫描移位时钟scclk(n)作为扫描控制信号sct(n)，并在输出节点n2处输出进位移位时钟crclk(n)作为进位信号cry(n)。

为此，输出缓冲器bk3包括第一和第二上拉晶体管t9a和t10a以及电容器cx。第一上拉晶体管t9a包括连接到节点q(n)的栅极电极、连接到进位时钟线10中的任何一条的漏极电极、以及连接到输出节点n2的源极电极。第二上拉晶体管t10a包括连接到节点q(n)的栅极电极、连接到扫描时钟线20中的任何一条的漏极电极、以及连接到输出节点n3的源极电极。电容器cx连接在节点q(n)与输出节点n3之间。

稳定单元bk4在节点qb(n)激活期间向节点q(n)以及输出节点n2和n3施加低电位电源电压gvss，以稳定节点q(n)以及输出节点n2和n3。

为此，稳定单元bk4包括晶体管t3以及第一和第二下拉晶体管t9b和t10b。晶体管t3包括连接到节点qb(n)的栅极电极、连接到节点q(n)的漏极电极、以及被施加了低电位电源电压gvss的源极电极。第一下拉晶体管t9b包括连接到节点qb(n)的栅极电极、连接到输出节点n2的漏极电极、以及被施加了低电位电源电压gvss的源极电极。第二下拉晶体管t10b包括连接到节点qb(n)的栅极电极、连接到输出节点n3的漏极电极、以及被施加了低电位电源电压gvss的源极电极。

从级stgn132输出的扫描控制信号sct(n)通过如图4所示的栅极线gln被传送到像素pix。在图4的像素pix上不执行针对外部补偿的感测操作。针对外部补偿的感测是用于感测像素的电特性(即，驱动tft的阈值电压和迁移率的变化、oled的操作点电压的变化等)以及基于感测结果校正图像数据的技术。

图4中的像素pix在用于图像显示的基本模式下工作。在基本模式下，在其中激活扫描控制信号sct(n)的编程周期期间，像素pix将驱动tftdt的栅-源电压vgs设置为用于显示梯度实施的驱动电流，接下来在其中去激活扫描控制信号sct(n)的发光周期期间，允许oled根据驱动电流发光。

为此，像素pix可以包括oled、驱动tftdt、开关tftst1和存储电容器cst。在编程周期期间，使开关tftst1导通以向驱动tftdt的栅极电极ng供应数据线dl上的数据电压vdata。在编程周期期间，也使源极驱动器ic120的开关sw1导通以向驱动tftdt的源极电极ns供应参考电压vref。因此，在编程周期期间，将驱动tftdt的栅-源电压vgs确定为vdata-vref。在发光周期期间，使开关tftst1和开关sw1截止。在发光周期期间，由存储电容器cst维持驱动tftdt的栅-源电压vgs。在发光周期期间，与vdata-vref的平方成比例的驱动电流流经驱动tftdt，并且oled通过驱动电流发光。在图4中，dac表示用于将图像数据rgb转换为数据电压vdata的数模转换器，并且rl是用于向像素pix供应参考电压vref的电源线。

在编程周期期间，根据扫描控制信号sct(n)使开关tftst1导通。如果由于扫描移位时钟scclk(n)失真而使扫描控制信号sct(n)的波形失真，则可能使开关tftst1没有充分导通预定的周期。由于根据开关tftst1的导通周期确定数据电压vdata的充电时间，因此如果开关tftst1的导通周期不足，则驱动tftdt的栅-源电压vgs可能由于充电不足而达不到期望值。在这种情况下，还减小了流经驱动tftdt的驱动电流和oled的发光量，导致亮度变化并使图像质量退化。因此，为了改善图像质量，使扫描移位时钟scclk(n)的失真最小化是有帮助的。

图5是示出根据本公开的另一实施例的级stgn132的电路图。图6是示出连接到图5中的级stgn132的一个像素和数据驱动电路的视图。

因为图5中的级stgn132连接到如图6所示的像素，所以必须施加感测移位时钟seclk(n)以输出感测控制信号set(n)。因此，与图3相比，图5中的级stgn132基本与输入单元bk1和反相器单元bk2相同，在输出缓冲器bk3和稳定单元bk4的配置上不同。

与图3相比，图5的输出缓冲器bk3还包括用于输出感测控制信号set(n)的部件。为此，图5的输出缓冲器bk3还包括第三上拉晶体管t11a。第三上拉晶体管t11a包括连接到节点q(n)的栅极电极、连接到感测时钟线30中的任何一条的漏极电极、以及连接到输出节点n4的源极电极。在节点q(n)的电位升高到提升电平时，第三上拉晶体管t11a在输出节点n4处输出感测移位时钟seclk(n)作为感测控制信号set(n)。

与图3相比，图5的稳定单元bk4还包括第三下拉晶体管t11b。第三下拉晶体管t11b包括连接到节点qb(n)的栅极电极、连接到输出节点n4的漏极电极、以及被施加了低电位电源电压gvss的源极电极。

从级stgn输出的扫描控制信号sct(n)通过如图6所示的栅极线gln被传送到像素pix。从级stgn输出的感测控制信号set(n)通过如图6所示的栅极线gl2n被传送到像素pix。在图6的像素pix上执行针对外部补偿的感测操作。针对外部补偿的感测是一种感测像素的电特性并基于感测结果校正图像数据的技术。

与图4相比，图6中的像素pix还包括第二开关tftst2，并且图6中的源极驱动器ic120还包括感测电路。根据感测控制信号set(n)使第二开关tftst2导通以将驱动tftdt的源极节点ns连接到感测线sl。感测电路包括用于对驱动tftdt的源极节点ns的两端电压进行采样的采样和保持部sh、用于连接感测线sl与采样和保持部sh的开关sw2、以及将在采样和保持部sh采样的电压转换为数字数据s-data的模数转换器adc。仅在用于感测像素pix的电特性的感测模式下激活感测电路，其不在用于显示图像的基本模式下工作。

用于图6中的像素pix的基本模式包括编程周期和发光周期。

在编程周期期间，使第一开关st1导通以向驱动tftdt的栅极电极ng供应数据线dl上的数据电压vdata。在编程周期期间，也使源极驱动器ic120的第二开关tftst2和开关sw1导通以向驱动tftdt的源极电极ns供应参考电压vref。因此，在编程周期期间，将驱动tftdt的栅-源电压vgs确定为vdata-vref。在发光周期期间，使第一和第二开关tftst1和st2以及开关sw1截止。在发光周期期间，由存储电容器cst维持tftdt的栅-源电压vgs。在发光周期期间，与vdata-vref的平方成比例的驱动电流流经驱动tftdt，并且oled通过该驱动电流发光。

用于图6中的像素pix和感测电路的感测模式包括编程周期和感测周期。在感测模式下，oled不发光。

编程周期的操作与基本模式的操作相同。在编程周期期间，使开关sw1导通，并且使开关sw2截止。

在感测周期期间，使第一开关tftst1和开关sw1截止，并且使第二开关tftst2和开关sw2导通。在感测周期期间，由流入驱动tftdt的电流改变驱动tftdt的源极电极ns的电压。驱动tftdt的源极电极ns的电压变化的程度取决于驱动tftdt的电特性(例如，阈值电压、迁移率)和oled的电特性(例如，操作点电压)。因此，通过在感测周期期间通过操作感测电路来感测驱动tftdt的源极电极ns的电压，可以知道像素pix的电特性。而且，通过基于像素pix感测结果校正图像数据，可以补偿由于像素pix的电特性偏差造成的亮度偏差。

同时，在基本模式下，在编程周期期间，根据扫描控制信号sct(n)使开关tftst1导通。如果由于扫描移位时钟scclk(n)失真而使扫描控制信号sct(n)的波形失真，则可能使开关tftst1没有充分导通预定的周期。由于根据开关tftst1的导通周期确定数据电压vdata的充电时间，因此如果开关tftst1的导通周期不足，则驱动tftdt的栅-源极压vgs可能由于充电不足而达不到期望值。在这种情况下，减小了流入驱动tftdt的驱动电流和oled的发光量，导致亮度变化并使图像质量退化。因此，为了改善图像质量，使扫描移位时钟scclk(n)的失真最小化是有帮助的。

图7是示出作为连接到图3所示的级stgn132的设置在面板内栅极基板上的时钟线的布置示例的stgn132中的电路的部分的视图；图8是示出施加到图7的时钟线的移位时钟的波形的视图。示出的bk3和bk4的部分与图3和5以及其他附图中的类似电路相对应，并具有相同的参考数字和标记。

参考图7和8，栅极移位寄存器可以包括设置在面板内栅极基板上并向级stg1至stg7供应具有不同相位的进位移位时钟crclk2、crclk4和crclk6的多条共享进位时钟线12、14和16、以及设置在面板内栅极基板上并向级stg1至stg7供应具有不同相位的扫描移位时钟scclk1至scclk6的多条扫描时钟线21至26。

可以将共享进位时钟线12、14和16的数量设置为扫描时钟线21至26的数量的一半，以便减少连接到级stg1至stg7的时钟线的数量。为此，级对stg1/stg2、stg3/stg4、stg5/stg6等，包括相邻的奇数序号级stg1、stg3和stg5等以及相邻的偶数序号级stg2、stg4和stg6等，可以分别共享一个进位移位时钟crclk2、crclk4或crclk6。

在此，供应给奇数序号级stg1、stg3和stg5的奇数序号的扫描移位时钟scclk1、sccclk3和scclk5以及供应给偶数序号级stg2、stg4和stg6的偶数序号的扫描移位时钟scclk2、scclk4和scclk6在导通周期(vgh周期)中部分重叠。共享的进位移位时钟crclk2、crclk4和crclk6可以在导通周期(vgh周期)中在奇数序号的扫描移位时钟scclk1、scclk3和scclk5以及偶数序号的扫描移位时钟scclk2、scclk4和scclk6中的任何一个中重叠。因此，尽管减少了进位时钟线的数量，但栅极移位寄存器可以正常工作。同时，在图8中，进位移位时钟crclk2、crclk4和crclk6分别针对用于偶数序号的扫描移位时钟scclk2、scclk4和scclk6的基本显示操作的整个电路完全重叠，但也可以进行设计使得进位移位时钟crclk2、crclk4和crclk6分别与奇数序号的扫描移位时钟scclk1、scclk3和scclk5完全重叠。其他时钟信号在定时和电压电平上部分重叠。

连接到级stg1至stg7的共享进位时钟线12、14和16可以设置成彼此相邻，并且连接到级stg1至stg7的扫描时钟线21至26可以设置成彼此相邻。为了实现窄边框，可以将时钟线12、14、16以及21至26之间的间距设计为较窄，在这种情况下，时钟线12、14、16以及21至26之间存在的寄生电容c的耦合效应可能较显著。在两个相邻的时钟线之间的间距窄的情况下，如果向时钟线施加具有相同相位和电压电平的信号，则信号的上升和下降定时相同，由此可以不发生由于耦合效应而造成的信号失真，因为在处于不同的电压电平的导电线彼此紧密相邻时相邻线之间的寄生电容c的耦合效应才发生。

然而，在向时钟线施加具有不同相位的信号时，信号的上升和下降定时不同，由于寄生电容耦合效应导致信号失真。如上文参考图4和6所述，扫描移位时钟scclk1至scclk6的失真导致扫描控制信号sct(1)至sct(7)失真，这可能直接影响图像质量。

图9是示出连接到图5所示的级的设置在面板内栅极基板上的时钟线的布置示例的视图；图10是示出施加到图9的时钟线的移位时钟的波形的视图；

参考图9和10，栅极移位寄存器可以包括向级stg1至stg7供应具有不同相位的进位移位时钟crclk2、crclk4和crclk6的多条共享进位时钟线12、14和16、向级stg1至stg7供应具有不同相位的扫描移位时钟scclk1至scclk6的多条扫描时钟线21至26、以及设置在面板内栅极基板上并向级stg1至stg7供应具有不同相位的感测移位时钟seclk1至seclk6的多条感测时钟线31至36。

为了减少连接到级stg1至stg7的设置在面板内栅极基板上的时钟线数量，可以将共享进位时钟线12、14和16的数量设置为扫描时钟线21至26的数量的一半。为此，级对stg1/stg2、stg3/stg4、stg5/stg6等，包括相邻的奇数序号级stg1、stg3和stg5等以及相邻的偶数序号级stg2、stg4和stg6等，可以分别共享进位移位时钟crclk2、crclk4和crclk6。

另一种减小总的寄生电容耦合效应的方式是具有很少的导电线，由此通过使用单条进位时钟线12，crclk2来为两级提供时钟。由此，如图7所示，进位时钟线12耦合到级1和2，使需要设置在pcb140上的进位时钟线的数量减少了一半。通过具有更少的时钟线，减小了总的电容耦合。

在此，供应给奇数序号级stg1、stg3和stg5的奇数序号的扫描移位时钟scclk1、sccclk3和scclk5以及供应给偶数序号级stg2、stg4和stg6的偶数序号的扫描移位时钟scclk2、scclk4和scclk6在导通周期(vgh周期)中部分重叠。共享的进位移位时钟crclk2、crclk4和crclk6可以在导通周期(vgh周期)中在奇数序号的扫描移位时钟scclk1、scclk3和scclk5中的任何一个中部分重叠并与偶数序号的扫描移位时钟scclk2、scclk4和scclk6重叠。在一些实施例中，时钟部分重叠，而在其他实施例中，时钟完全重叠。因此，尽管减少了进位时钟线的数量，但栅极移位寄存器可以正常工作。同时，在图10中，进位移位时钟crclk2、crclk4和crclk6分别与偶数序号的扫描移位时钟scclk2、scclk4和scclk6重叠，但进位移位时钟crclk2、crclk4和crclk6可以被设计为分别与奇数序号的扫描移位时钟scclk1、scclk3和scclk5重叠。

可以将感测时钟线31至36的数量可以设置为等于扫描时钟线21至26的数量，并且可以将感测移位时钟seclk1至seclk6设置为与扫描移位时钟scclk1至scclk6同相。因此，共享的进位移位时钟crclk2、crclk4和crclk6可以在导通周期(vgh周期)中与奇数序号的感测移位时钟seclk1、seclk3和seclk5或偶数序号的感测移位时钟seclk2、seclk4和seclk6重叠。

连接到级stg1至stg7的共享进位时钟线12、14和16可以设置成彼此相邻，连接到级stg1至stg7的扫描时钟线21至26可以设置成彼此相邻，并且连接到级stg1至stg7的感测时钟线31至36可以设置成彼此相邻。为了实现窄边框，可以将设置在面板内栅极基板上的时钟线12、14、16、21至26以及31至36之间的间距设计为较窄，在这种情况下，时钟线12、14、16以及21至26之间存在的寄生电容c的耦合效应可能较显著。在两个相邻的时钟线之间间距窄的情况下，如果向时钟线施加具有相同相位的信号，则信号的上升和下降定时相同，由此可以不发生由于耦合效应造成的信号失真。然而，在向时钟线施加具有不同相位的信号时，信号的上升和下降定时不同，由于耦合效应导致信号失真。如上文参考图4和6所述，扫描移位时钟scclk1至scclk6的失真导致扫描控制信号sct(1)至sct(7)失真，这可能直接影响图像质量。

图11是示出连接到如图5所示的级的设置在面板内栅极基板上的时钟线的另一布置示例的视图。图12是示出施加到图11的时钟线的移位时钟的波形的视图；

参考图11和12，栅极移位寄存器可以包括向级stg1至stg7供应具有不同相位的扫描移位时钟scclk1至scclk6的多条扫描时钟线21至26、以及向级stg1至stg7供应具有不同相位的感测移位时钟seclk1至seclk6的多条共享感测时钟线32、34、36。

为了减少连接到级stg1至stg7的时钟线的数量，可以将共享进位时钟线12、14和16的数量设置为扫描时钟线21至26的数量的一半，还可以将共享感测时钟线32、34、36的数量设置为扫描时钟线21至26的数量的一半。为此，级对stg1/stg2、stg3/stg4、stg5/stg6等，包括相邻的奇数序号级stg1、stg3和stg5和相邻的偶数序号级stg2、stg4和stg6，可以分别共享进位移位时钟crclk2、crclk4和crclk6，还可以分别共享感测移位时钟seclk2、seclk4和seclk6。

在此，供应给奇数序号级stg1、stg3和stg5的奇数序号的扫描移位时钟scclk1、sccclk3和scclk5以及供应给偶数序号级stg2、stg4和stg6的偶数序号扫描移位时钟scclk2、scclk4和scclk6在导通周期(vgh周期)中部分重叠。而且，共享的进位移位时钟crclk2、crclk4和crclk6可以在导通周期(vgh周期)中与奇数序号的扫描移位时钟scclk1、scclk3和scclk5或偶数序号的扫描移位时钟scclk2、scclk4和scclk6重叠。而且，共享的感测移位时钟seclk2、seclk4和seclk6可以在导通周期(vgh周期)中与奇数序号的扫描移位时钟scclk1、scclk3和scclk5或偶数序号的扫描移位时钟scclk2、scclk4和scclk6重叠。因此，尽管减少了进位时钟线的数量和感测时钟线的数量，但栅极移位寄存器可以正常工作。同时，在图12中，进位移位时钟crclk2、crclk4和crclk6以及感测移位时钟seclk2、seclk4和seclk6分别与偶数序号的扫描移位时钟scclk2、scclk4和scclk6重叠，但进位移位时钟crclk2、crclk4和crclk6以及感测移位时钟seclk2、seclk4和seclk6可以被设计为分别与奇数序号的扫描移位时钟scclk1、scclk3和scclk5重叠。

连接到级stg1至stg7的共享进位时钟线12、14和16可以布置成彼此相邻，连接到级stg1至stg7的扫描时钟线21至26可以布置成彼此相邻，并且连接到级stg1至stg7的感测时钟线32、34和36可以布置成彼此相邻。为了实现窄边框，可以将时钟线12、14、16、21至26、32、34和36之间的间距设计为较窄，在这种情况下，时钟线12、14、16、21至26、32、34和36之间存在的寄生电容c的耦合效应可能较显著。在两个相邻的时钟线之间间距窄的情况下，如果向时钟线施加具有相同相位的信号，则信号的上升和下降定时相同，由此可以不发生由于耦合效应造成的信号失真。然而，在向时钟线施加具有不同相位的信号时，信号的上升和下降定时不同，由于耦合效应导致信号失真。如上文参考图4和6所述，扫描移位时钟scclk1至scclk6的失真导致扫描控制信号sct(1)至sct(7)失真，这可能直接影响图像质量。

图13是示出连接到图5所示的级的设置在面板内栅极基板上的时钟线的另一布置示例的视图。图14是示出施加到图13的时钟线的移位时钟的波形的视图；

参考图13和14，栅极移位寄存器可以包括向级stg1至stg7供应具有不同相位的进位移位时钟crclk1至crclk6的多条共享进位时钟线11到16、向级stg1至stg7供应具有不同相位的扫描移位时钟scclk1至scclk6的多条扫描时钟线21到26、以及向级stg1至stg7供应具有不同相位的感测移位时钟seclk2、seclk4和seclk6的多条共享感测时钟线32、34和36。

为了减少连接到级stg1至stg7的时钟线的数量，也可以将共享感测时钟线32、34和36的数量设置为扫描时钟线21至26的数量的一半。为此，级对stg1/stg2、stg3/stg3istg4、stg5/stg6等，包括相邻的奇数序号级stg1、stg3和stg5等以及相邻的偶数序号级stg2、stg4和stg6等，可以分别共享感测移位时钟seclk2、seclk4和seclk6。

在此，供应给奇数序号级stg1、stg3和stg5的奇数序号的扫描移位时钟scclk1、scclk3和scclk5以及供应给偶数序号级stg2、stg4和stg6的偶数序号的扫描移位时钟scclk2、scclk4和scclk6在导通周期(vgh周期)中部分重叠。共享的感测移位时钟seclk2、seclk4和seclk6可以在导通周期(vgh周期)中在奇数序号的扫描移位时钟scclk1、scclk3和scclk5以及偶数序号的扫描移位时钟scclk2、scclk4和scclk6中的任何一个中重叠。因此，尽管减少了感测时钟线的数量，但栅极移位寄存器可以正常工作。同时，在图12中，进位移位时钟crclk2、crclk4和crclk6以及感测移位时钟seclk2、seclk4和seclk6分别与偶数序号的扫描移位时钟scclk2、scclk4和scclk6重叠，但感测移位时钟seclk2、seclk4和seclk6可以被设计为分别与奇数序号的扫描移位时钟scclk1、scclk3和scclk5重叠。

可以将进位时钟线11到16的数量设置为等于扫描时钟线21至26的数量，并且可以将进位移位时钟crclk1至crclk6设置为与扫描移位时钟scclk1至scclk6同相。因此，共享的感测移位时钟seclk2、seclk4和seclk6可以在导通周期(vgh周期)中与奇数序号的进位移位时钟crclk1、crclk3和crclk5或偶数序号的进位移位时钟crclk2、crclk4和crclk6重叠。

连接到级stg1至stg7的进位时钟线11至16可以设置成彼此相邻，连接到级stg1至stg7的扫描时钟线21至26可以设置成彼此相邻，并且连接到级stg1至stg7的感测时钟线32、34和36可以设置成彼此相邻。为了实现窄边框，可以将时钟线11至16、21至26、32、34和36之间的间距可以设计为较窄，在这种情况下，时钟线11至16、21至26、32、34和36之间存在的寄生电容c的耦合效应可能较显著。在两个相邻的时钟线之间间距窄的情况下，如果向时钟线施加具有相同相位的信号，则信号的上升和下降定时相同，由此可以不发生由于耦合效应造成的信号失真。然而，在向时钟线施加具有不同相位的信号时，信号的上升和下降定时不同，由于耦合效应导致信号失真。如上文参考图4和6所述，扫描移位时钟scclk1至scclk6的失真导致扫描控制信号sct(1)至到sct(7)失真，这可能直接影响图像质量。

图15是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图7修改的视图。图16是示出施加到图15的时钟线的移位时钟的波形的视图。

参考图15和16，与图7相比，栅极移位寄存器具有不同的时钟线布置顺序，以使由于耦合造成的信号失真最小化。亦即，共享进位时钟线12、14和16可以设置在扫描时钟线21至26之间，从而使同相时钟信号被传送到其上的时钟线设置成彼此相邻。一个进位移位时钟被传送在其上的共享进位时钟线12、14和16设置成与相位和进位移位时钟相同的扫描移位时钟被传送到其上的扫描时钟线相邻。例如，进位移位时钟crclk2被传送到其上的共享进位时钟线12设置成与扫描移位时钟scclk2被传送到其上的扫描时钟线22相邻，进位移位时钟crclk4被传送到其上的共享进位时钟线14设置成与扫描移位时钟scclk4被传送到其上的扫描时钟线24相邻，进位移位时钟crclk6被传送到其上的共享进位时钟线16设置成与扫描移位时钟scclk6被传送到其上的扫描时钟线26相邻。

在向彼此相邻的时钟线施加具有相同相位的信号的情况下，因为信号的上升和下降定时相同，所以不会发生由于耦合效应造成的信号失真。因此，本公开可以通过减小时钟线的数量和时钟线的间距来实现窄边框，并通过适当的时钟线布置来使信号失真最小化而提高显示质量。正如指出的那样，在一个实施例中，进位移位时钟crclk2、crclk4和crclk6上的信号完全重叠，并因此与偶数序号的扫描移位时钟scclk2、scclk4和scclk6上的信号相同。在一个实施例中，对于pcb140上的电路布局，传送信号crclk2和scclk2的导电线可以设置成彼此相邻，并且对于其他电压电平和相位完全重叠的线也是类似的。因为相同的电压电平将在信号的相同时序中相同地位于这二者上，所以寄生电容耦合将变为零。由此，可以将pcb140上的导电线的布局选择为处于减小各种时钟信号的电容耦合效应的位置处。因而，可以将时钟线的布局选择为将具有相同电压电平和相同电位的时钟线设置成彼此紧密相邻。

图17是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图9修改的视图。图18是示出施加到图17的时钟线的移位时钟的波形的视图。

参考图17和18，与图9相比，栅极移位寄存器具有不同的时钟线的布置顺序，以使由于耦合造成的信号失真最小化。亦即，共享进位时钟线12、14和16可以设置在扫描时钟线21至26和感测时钟线31至36之间，从而使同相时钟信号被传送到其上的时钟线设置成彼此相邻。换言之，在感测时钟线上传送感测时钟。而且，连接到同一级的扫描时钟线21至26和感测时钟线31至36可以设置成彼此相邻。

在此，一个进位移位时钟被传送到其上的共享进位时钟线12、14和16设置成与相位和进位移位时钟相同的扫描移位时钟或相位和进位移位时钟相同的感测移位时钟被传送到其上的扫描时钟线相邻。例如，进位移位时钟crclk2被传送到其上的共享进位时钟线12设置成与扫描移位时钟scclk2被传送到其上的扫描时钟线22或感测移位时钟seclk2被传送到其上的感测时钟线32相邻，进位移位时钟crclk被传送到其上4的共享进位时钟线14设置成与扫描移位时钟scclk4被传送到其上的扫描时钟线24或感测移位时钟seclk4被传送到其上的感测时钟线34相邻，并且进位移位时钟crclk6被传送到其上的共享进位时钟线16设置成与扫描移位时钟scclk6被传送到其上的扫描时钟线26或感测移位时钟seclk6被传送到其上的感测时钟线36相邻。

在向彼此相邻的时钟线施加具有相同相位的信号的情况下，信号的上升和下降时间相同，由此不会发生由于耦合造成的信号失真。因而，本公开可以通过减小时钟线的数量和时钟线的间距来实现窄边框，并通过适当的时钟线布置来使信号失真最小化而改善显示质量。

图19是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图11修改的视图。图20是示出施加到图19的时钟线的移位时钟的波形的视图。

参考图19和20，与图11相比，栅极移位寄存器具有不同的时钟线布置顺序，以使由于耦合造成的信号失真最小化。亦即，共享进位时钟线12、14、16可以设置在扫描时钟线21至26之间，从而使具有相同相位的时钟信号被传送到其上的时钟线布置成彼此相邻。在此，一个感测移位时钟被传送到其上的共享感测时钟线32、34和36可以设置成分别与共享进位时钟线12、14和16相邻。

一个进位移位时钟被传送到其上的共享进位时钟线12、14和16设置成与相位和进位移位时钟相同的扫描移位时钟被传送到其上的扫描时钟线相邻。例如，进位移位时钟crclk2被传送到其上的共享进位时钟线12设置成与扫描移位时钟scclk2被传送到其上的扫描时钟线22相邻，进位移位时钟crclk4被传送到其上的共享进位时钟线14设置成与扫描移位时钟scclk4被传送到其上的扫描时钟线24相邻，进位移位时钟crclk6被传送到其上的共享进位时钟线16设置成与扫描移位时钟scclk6被传送到其上的扫描时钟线26相邻。

在向彼此相邻的时钟线施加相同相位的信号时，因为信号的上升和下降定时相同，所以不会产生由于耦合效应导致的信号失真。因此，本公开可以通过减小时钟线的数量和间距并通过适当的时钟线布置使信号失真最小化而实现窄边框，由此改善显示质量。

图21是示出用于减小设置在面板内栅极基板上的时钟线之间的耦合效应的图13修改的视图。图22是示出施加到图21的时钟线的移位时钟的波形的视图。

参考图21和22，与图13相比，栅极移位寄存器具有不同的时钟线的布置顺序，以使由于耦合造成的信号失真最小化。亦即，连接到同一级的进位时钟线11到16和扫描时钟线21至26设置成彼此相邻，从而使具有相同相位的时钟信号被传送到其上的时钟线布置成彼此相邻。在此，一个感测移位时钟被传送到其上的共享感测时钟线32、34和36可以设置成分别与扫描时钟线22、24和26相邻。

传送有奇数序号的扫描移位时钟的奇数序号的扫描时钟线和传送有奇数序号的进位移位时钟的奇数序号的进位时钟线设置成彼此相邻，并且传送有偶数序号的扫描移位时钟的偶数序号的扫描时钟线和传送有偶数序号的进位移位时钟的偶数序号的进位时钟线可以设置成彼此相邻。在此，奇数序号的扫描移位时钟和奇数序号的进位移位时钟同相，并且偶数序号的扫描移位时钟和偶数序号的进位移位时钟同相。

在向彼此相邻的时钟线施加具有相同相位的信号的情况下，因为信号的上升和下降定时相同，所以不会发生由于耦合效应造成的信号失真。因此，本公开可以通过减小时钟线的数量和时钟线的间距来实现窄边框，并通过适当的时钟线布置来使信号失真最小化而提高显示质量。

如上所述，本公开可以通过减小进位时钟线和/或感测时钟线的数量而实现窄边框。

此外，根据本公开，供应具有相同相位的时钟信号的时钟线布置成彼此相邻，以减小或完全抑制耦合效应，由此使由于耦合效应造成的移位时钟失真最小化并改善图像质量。

在以上示范性系统中，尽管已经基于使用一系列步骤或方框的流程图描述了方法，但本公开不限于步骤的顺序，一些步骤可以按照与其余步骤不同的顺序来执行，或者可以与其余步骤同时执行。此外，本领域的技术人员将理解，流程图中所示的步骤不是排他的，可以包括其他步骤，或者可以删除流程图的一个或多个步骤而不影响本公开的范围。

可以组合以上描述的各种实施例以提供其他的实施例。在本说明书中提交和/或在申请数据表中列出的所有美国专利、美国专利申请公开、美国专利申请、外国专利、外国专利申请和非专利申请通过引用整体并入到本文中。如果有必要采用不同专利、申请和公开的概念以提供进一步的实施例，那么可以修改实施例的方面。

可以根据以上详细的描述对实施例进行这些和其他改变。通常，在所附权利要求书中，所使用的术语不应被解释为限制对本说明书和权利要求书中所公开的具体实施例的权利要求，而应被解释为包括所有可能的实施例以及这些权利要求被赋予的等效方案的所有范围。因而，权利要求不受本公开的限制。