显示面板、像素电路及其驱动方法与流程

本发明涉及显示技术领域，具体涉及一种显示面板、像素电路及其驱动方法。

背景技术：

amoled(active-matrixorganiclight-emittingdiode，有源矩阵有机发光二极体或主动矩阵有机发光二极体)显示屏由于广视角、低功耗等优势被大量应用于手机、电视中。

然而，随着时间的流逝，oled(organiclight-emittingdiode，有机发光二极体)的效率也会快速衰退，这将导致屏体亮度逐渐降低。影响显示效果，影响显示面板的使用寿命。

技术实现要素：

本申请主要解决的问题是提供一种显示面板、像素电路及其驱动方法，能够提高显示面板的显示效果，提高显示面板的使用寿命。

为解决上述技术问题，本申请采用的一技术方案是：提供一种像素电路，该像素电路包括驱动芯片、以及与驱动芯片连接的若干个像素电路单元和若干个侦测电路单元，其中，每一侦测电路单元分别独立的对应沿第一方向排布的一组像素电路单元，并与一组像素电路单元中每一像素电路单元选择性耦合连接，第一方向为呈阵列排布的像素电路单元的行方向或列方向；其中，每一像素电路单元至少包括第一开关管和电致发光元件，第一开关管的一通路端与电致发光元件的阳极电连接，第一开关管的控制端连接扫描信号端；每一侦测电路单元至少包括选择电路，选择电路至少包括第二开关管，第二开关管的第一通路端通过对应像素电路单元连接其中的电致发光元件的阳极，第二开关管的控制端连接第一时序信号端，第二开关管的第二通路端连接驱动芯片；其中，当侦测电路单元中的第二开关管处于导通状态且与其耦合连接的像素电路单元中的第一开关管也处于导通状态时，驱动芯片侦测导通状态的第一开关管对应的像素电路单元中电致发光元件的阳极的电位；若干个侦测电路单元分为多组，每组中包括至少两个侦测电路单元，每组中各侦测电路单元之间通过连接端子连接，并通过连接端子对应连接驱动芯片的同一个引脚；其中，每组中各侦测电路所对应连接的位于同一行中的像素电路单元中的电致发光元件的发光颜色相同。

为解决上述技术问题，本申请采用的另一技术方案是：提供一种上述像素电路的驱动方法，驱动方法包括：侦测每一像素电路单元中电致发光元件的阳极的电位，并将电致发光元件的阳极的电位收录在驱动芯片中形成阳极电压补偿信号；其中，每一像素电路单元至少包括第一开关管和电致发光元件；每一侦测电路单元至少包括选择电路，选择电路至少包括第二开关管；侦测每一像素电路单元中电致发光元件的阳极的电位的步骤包括：输入第一时序信号控制侦测电路单元中第二开关管导通，输入扫描信号控制对应像素电路单元中第一开关管导通，以使得驱动芯片与对应像素电路单元中电致发光元件的阳极导通，进而获取电致发光元件的阳极的电位；驱动芯片调用阳极电压补偿信号并将阳极电压补偿信号输出至对应的像素电路单元；其中，所述像素电路中的若干个侦测电路单元分为多组，每组中包括至少两个侦测电路单元，每组中各所述侦测电路单元之间通过连接端子连接，并通过所述连接端子对应连接所述驱动芯片的同一个引脚，在输入第一时序信号控制侦测电路单元中第二开关管导通的步骤中，控制位于同一组中各侦测电路单元中的第二开关管分别单独导通，以在不同的时间段分别获取对应像素电路单元中的所述电致发光元件的阳极的电位。

为解决上述技术问题，本申请采用的又一技术方案是：提供一种显示面板，该显示面板包括基板和设置于基板上的像素电路，像素电路为上述的像素电路。

本申请通过设置像素电路包括驱动芯片、以及与驱动芯片连接的若干个像素电路单元和若干个侦测电路单元，利用侦测电路单元导通驱动芯片与对应像素电路单元中电致发光元件的阳极。从而能够便于驱动芯片获取到电致发光元件的阳极电位，便于后续显示阶段对阳极电位的补偿，该电路能够较好的与像素电路单元融合，电路结构简单，且该电路结构便于侦测阶段与显示阶段相互独立设计，使得侦测阶段不会对显示阶段产生影响，并且通过将至少两个相同颜色电致发光元件的像素电路单元(通过对应的侦测电路单元)对应连接驱动芯片的同一引脚，可以节省驱动芯片上的引脚，便于硬件资源的节约。

附图说明

为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。其中：

图1是本申请第一实施例的像素电路的电路结构示意图；

图2是本申请第二实施例的像素电路的电路结构示意图；

图3是本申请实施例双栅开关管结构的原理示意图；

图4是本申请实施例的像素电路的驱动方法的实施例的流程示意图；

图5是本申请实施例的像素电路的驱动方法的实施例一种显示阶段的具体流程示意图；

图6是本申请实施例显示面板的结构示意图。

具体实施方式

下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部实施例。基于本申请中的实施例，本领域普通技术人员在没有做出创造性的劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。

请参阅图1，图1是本申请第一实施例的像素电路的电路结构示意图。

在本实施例中，像素电路包括驱动芯片10以及与驱动芯片10连接的若干个像素电路单元20和若干个侦测电路单元30。

每一侦测电路单元30分别独立的对应沿第一方向排布的一组像素电路单元20，并与一组像素电路单元20中每一像素电路单元20选择性耦合连接，第一方向为呈阵列排布的像素电路单元20的行方向或列方向。

例如，第一方向可以为呈阵列排布的像素电路单元的列方向。图1中仅为示意，其仅示意出一列的若干个像素电路单元20中的一个像素电路单元20与侦测电路单元30的连接关系，不难理解，该列的其他像素电路单元20与该侦测电路单元30的连接关系与之相同，图中不逐一体现。

其中，若干个侦测电路单元分为多组，每组中包括至少两个侦测电路单元，每组中各侦测电路单元之间通过连接端子连接，并通过连接端子对应连接驱动芯片的同一个引脚；其中，每组中各侦测电路所对应连接的位于同一行中的像素电路单元中的电致发光元件的发光颜色相同。在本实施例中若干个侦测电路单元可以沿第二方向排布，第二方向与第一方向不同，其为呈阵列排布的像素电路单元20的列方向或行方向。例如，如图1所示，第二方向为呈阵列排布的像素电路单元20的行方向。当然在另外的实施例中，位于每组中侦测电路单元30的数量不限于两个，可以为三个、四个、甚至更多。

每一像素电路单元20至少包括第一开关管t1和电致发光元件d，第一开关管t1的一通路端与电致发光元件d的阳极电连接，第一开关管t1的控制端连接扫描信号(scan)端。

每一侦测电路单元30至少包括选择电路31，选择电路31至少包括第二开关管t2，第二开关管t2的第一通路端通过对应像素电路单元20连接其(指代该对应像素电路单元)中的电致发光元件d的阳极，第二开关管t2的控制端连接第一时序信号(s1)端，第二开关管t2的第二通路端(作为连接端子)连接驱动芯片10(的相应引脚)。其中，对应像素电路单元是指与侦测电路单元30处于导通状态的像素电路单元。

当侦测电路单元30中的第二开关管t2处于导通状态且与其耦合连接的像素电路单元20中的第一开关管t1也处于导通状态时，驱动芯片10侦测导通状态的第一开关管t1对应的像素电路单元20中电致发光元件d的阳极的电位。

可选地，沿第二方向排布的各像素电路单元20中的第一开关管t1连接至同一扫描信号端，即共用同一扫描信号scan。可选地，每一侦测电路单元30进一步包括复位电路32，复位电路32至少包括第三开关管t3，第三开关管t3的第一通路端通过对应像素电路单元20连接其(指代该对应像素电路单元)中电致发光元件d的阳极，第三开关管t3的控制端连接第二时序信号s2，第三开关管t3的第二通路端连接复位信号(reset)端。

请参阅图2，图2是本申请第二实施例的像素电路的电路结构示意图。

在本实施例中，每一像素电路单元20进一步包括存储电容c和与电致发光元件d的阳极耦合连接的电流控制驱动管(t5)，存储电容c的一端选择性与驱动芯片10耦合连接，另一端选择性与电流控制驱动管(t5)的控制端耦合连接，用于接收并存储来自驱动芯片10的阳极电压补偿信号，并根据阳极电压补偿信号控制电流控制驱动管(t5)。

每一侦测电路单元30中第三开关管t3的第一通路端选择性与存储电容c耦合连接，用于对储存电容c进行选择性复位处理。通过对储存电容c进行复位处理，有利于提高存储电容c对阳极电压补偿信号的存储精度。

可选地，在每一所述侦测电路单元的选择电路中还包括第十开关管t10，该第十开关管t10的第一通路端与存储电容c的一端耦合连接，第十开关管t10的第二通路端与连接端子和驱动芯片10连接，第十开关管t10的控制端连接第五时序信号端(s5)。

可选地，像素电路单元20进一步包括第四开关管t4、第五驱动管t5、第六开关管t6、第七开关管t7、第八开关管t8以及第九开关管t9，其中，第五驱动管t5为电流控制驱动管。

第四开关管t4的第一通路端连接第一工作电压vdd和储存电容c的第一端，同时储存电容c的第一端也连接第一工作电压(vdd)端，第四开关管t4的第二通路端连接第五驱动管t5的第一通路端和第九开关管t9的第二通路端，同时第五驱动管t5的第一通路端也连接第九开关管t9的第二通路端，第四开关管t4的控制端连接使能信号(em)端。

第五驱动管t5的第二通路端连接第六开关管t6的第一通路端和第七开关管t7的第二通路端，同时第六开关管t6的第一通路端也连接第七开关管t7的第二通路端；第五驱动管t5的控制端连接存储电容c的第二端。

第六开关管t6的第二通路端连接第一开关管t1的第二通路端和电致发光元件d的阳极，第六开关管t6的控制端连接使能信号(em)端。

第七开关管t7的第一通路端连接第五驱动管t5的控制端和储存电容的第二端，第七开关管t7的控制端连接第三时序信号(s3)端。

第八开关管t8的第一通路端连接存储电容c的第二端，第八开关管t8的第二通路端连接第一开关管t1的第一通路端、第二开关管t2的第一通路端和第三开关管t3的第一通路端，第八开关管t8的控制端连接第四时序信号(s4)端。

第九开关管t9的第一通路端连接第五开关管t5的第一通路端，第九开关管t9的第二通路端连接第十开关管t10的第一通路端，第十开关管t10的第二通路端连接前述连接端子且连接驱动芯片10(的相应引脚)，第九开关管t9的控制端连接第三时序信号(s3)端，第十开关管t10的控制端连接第五时序信号(s5)端。

存储电容c的第一端连接第一工作电压(vdd)端，电致发光元件d的阴极连接第二工作电压(vss)端，第二开关管t2的第一通路端连接第一开关管t1的第一通路端和第八开关管t8的第二通路端，第三开关管t3的第一通路端连接第一开关管t1的第一通路端和第八开关管t8的第二通路端。

可选地，沿第二方向排布的各像素电路单元20中的第一开关管t1共用同一扫描信号(scan)端；沿第一方向排布的各像素电路单元20中的第一开关管t1各自独立连接相应扫描信号；在侦测阶段和显示阶段，沿第一方向对像素电路中各像素电路单元20进行逐行扫描。

可选地，对应于沿第二方向排布的各像素电路单元20，侦测电路单元30中第三开关管t3共用同一第二时序信号s2和同一复位信号reset。

可选地，对应于沿第二方向排布的各像素电路单元20，侦测电路单元30中第二开关管t2的控制端根据相应像素电路单元20中电致发光元件d的发光颜色接入不同的第一时序信号s1(r)、s1(g)或者s1(b)。

可选地，对应于沿第二方向排布的各像素电路单元20，位于同一组中的各侦测电路单元30中第二开关管t2的第二通路端连接驱动芯片10的相同输入输出引脚，位于不同组中的侦测电路单元30中第二开关管t2的第二通路端各自独立的连接驱动芯片10的不同输入输出引脚out(1)、out(2)或者out(3)。

例如，如图1所示，第一方向为列方向，第二方向为行方向，同一行的各像素电路单元20中的第一开关管t1共用同一扫描信号scan；同一列的各像素电路单元20中的第一开关管t1各自独立连接相应扫描信号，即不同时接收扫描信号；在侦测阶段和显示阶段，沿列方向对像素电路中各像素电路单元20进行逐行扫描。对于同一行的各像素电路单元20，侦测电路单元30中第三开关管t3共用同一第二时序信号s2和同一复位信号reset。对于同一行的各像素电路单元20，侦测电路单元30中第二开关管t2的控制端根据相应像素电路单元20中电致发光元件d的发光颜色接入不同的第一时序信号s1(r)、s1(g)或者s1(b)。对于同一行的各像素电路单元20，位于同一组中的各侦测电路单元30中第二开关管t2的第二通路端连接驱动芯片10的相同输入输出引脚(例如out(1)、out(2)、out(3)……中的任一个)，位于不同组中的侦测电路单元30中第二开关管t2的第二通路端各自独立的连接驱动芯片10的不同输入输出引脚out(1)(附图中对应红色(r)电致发光元件)、out(2)(附图中对应绿色(g)电致发光元件)或者out(3)(附图中对应蓝色(b)电致发光元件)。

具体而言，每一像素电路单元20对应于显示面板的一个亚像素单元，例如图2中从左到右的三个亚像素单元分别为红色亚像素单元(r)、绿色亚像素单元(g)、蓝色亚像素单元(b)。相邻的红、绿、蓝三种颜色的亚像素单元(rgb)组成一个像素单元，通过控制亚像素单元的不同灰阶，使得红、绿、蓝三种颜色的亚像素单元(rgb)混色实现像素单元的不同显示颜色。

请参阅图3，图3是本申请实施例双栅开关管结构的原理示意图。可选地，第七开关管t7和第八开关管t8均为双栅开关管结构，双栅开关管结构包括第一子开关管t01和第二子开关管t02，第一子开关管t01和第二子开关管t02的栅极连接在一起作为双栅开关管结构的控制端，第一子开关管t01的第一通路端作为双栅开关管结构的第一通路端，第二子开关管t02的第二通路端作为双栅开关管结构的第二通路端，第一子开关管t01的第二通路端和第二子开关管t02的第一通路端连接。

通过上述方式，可以降低第七开关管t7和第八开关管t8的漏电流，降低功率损耗，提升电致发光元件d的显示效果。当然，在其他实施例中，第七开关管t7和第八开关管t8也可以采用单个栅极的mos管，本申请实施例对此不做限定。

可选地，第一开关管t1、第二开关管t2、第三开关管t3、第四开关管t4、第五驱动管t5、第六开关管t6、第七开关管t7、第八开关管t8以及第九开关管t9均为可以为mos管，具体可以是薄膜晶体管，且在控制端接入低电位时第一通路端与第二通路端导通，在控制端接入高电位时第一通路端与第二通路端截止。在其他实施例中，可以进行相反的配置，例如，在控制端接入低电位时第一通路端与第二通路端截止，在控制端接入高电位时第一通路端与第二通路端导通。例如，p型mos管是在控制端接入低电位信号时导通，接入高电位信号时截止；n型mos管是在控制端接入高电位导通，接入低电位时截止。

可选地，第一开关管t1、第二开关管t2、第三开关管t3、第四开关管t4、第五驱动管t5、第六开关管t6、第七开关管t7、第八开关管t8以及第九开关管t9各自的第一通路端和第二通路端中的其中一者为源极，另一者为漏极，各自的控制端均为栅极。

可选地，电致发光元件可以是oled发光元件，具体可以是amoled(active-matrixorganiclight-emittingdiode，有源矩阵有机发光二极体或主动矩阵有机发光二极体)。在其他实施例中，也可以采用其他的电致发光元件，本申请实施例对此不做限定。

请参阅图4，图4是本申请实施例的像素电路的驱动方法的实施例的流程示意图。

在本实施例中，像素电路的驱动方法可包括：

步骤s11：侦测阶段：侦测每一像素电路单元中电致发光元件的阳极的电位，并将电致发光元件的阳极的电位收录在驱动芯片中形成阳极电压补偿信号。

其中，每一像素电路单元20至少包括第一开关管t1和电致发光元件d；每一侦测电路单元30至少包括选择电路31，选择电路至少包括第二开关管t2；侦测每一像素电路单元20中电致发光元件d的阳极的电位的步骤具体可以包括：输入第一时序信号s1控制侦测电路单元30中第二开关管t2的第一通路端和第二通路端导通，输入扫描信号scan控制第一开关管t1的第一通路端和第二通路端导通，以使得驱动芯片10与对应像素电路单元20中电致发光元件d的阳极导通，进而获取电致发光元件d的阳极的电位。

其中，所述像素电路中的若干个侦测电路单元30分为多组，每组中包括至少两个侦测电路单元30，每组中各侦测电路单元30之间通过连接端子连接，并通过连接端子对应连接驱动芯片的同一个引脚，在输入第一时序信号s1控制侦测电路单元30中第二开关管t2导通的步骤中，控制位于同一组中的各侦测电路单元30(对应与相同颜色的像素电路单元)中的第二开关管t2分别单独导通，以在不同的时间段分别获取对应像素电路单元20中的电致发光元件d的阳极的电位。此外，可以在相同的时间段控制每组侦测电路单元30中都有一个第二开关管t2单独导通，以在同一时间段获取对应像素电路单元20中的电致发光元件d的阳极的电位。

可选地，在侦测阶段，第一时序信号s1的电位和第二时序信号s2的电位可以没有要求，其能够使得电致发光元件d发光即可，但为了减少侦测阶段对于电致发光元件d的影响，建议第一时序信号s1的电位和第二时序信号s2的电位的尽可能的小。

本申请中对于第一时序信号s1可以没有限制，只要保持每个侦测阶段中所采用的第一时序信号s1相同，且保持每个侦测阶段中所采用的第二时序信号s2相同，通过每次侦测电致发光元件d的阳极的电位差异形成阳极电压补偿信号。

步骤s12：显示阶段：驱动芯片调用阳极电压补偿信号并将阳极电压补偿信号输出至对应的像素电路单元。

本申请中每一侦测电路单元30进一步包括复位电路32，复位电路32至少包括第三开关管t3；可选地，侦测每一像素电路单元20中电致发光元件d的阳极的电位的步骤还包括：在获取对应像素电路单元20中电致发光元件d的阳极的电位之前，预先对该电致发光元件d的阳极的电位进行初始化处理。

其中对电致发光元件d的阳极的电位进行初始化处理的步骤包括：输入第二时序信号s2控制第三开关管t3的第一通路端和第二通路端导通，输入扫描信号scan控制第一开关管t1的第一通路端和第二通路端导通，以使复位信号(reset)端与对应像素电路单元20中电致发光元件d的阳极导通，进而对电致发光元件d的阳极的电位进行初始化。

可选地，在侦测与一个侦测电路单元30对应的一组像素电路单元20中电致发光元件d的阳极的电位(包括对阳极进行初始化的过程)的过程中，输入第二时序信号s2控制第三开关管t3的第一通路端和第二通路端持续导通，从而使得电致发光元件d持续发光，从而能够减少侦测阶段对于电致发光元件d的影响。

请参阅图5，图5是本申请实施例的像素电路的驱动方法的实施例一种显示阶段的具体流程示意图。每一像素电路单元20还包括存储电容c和与电致发光元件d的阳极耦合连接的电流控制驱动管(t5)，每一侦测电路单元30的所述选择电路进一步包括第十开关管t10。

可选地，显示阶段具体可以包括：

步骤s121：对每一像素电路单元30中存储电容c进行信号写入处理。

其中，对每一像素电路单元30中存储电容c进行信号写入处理的步骤包括：控制侦测电路单元20中第十开关管t10处于导通状态，并控制第十开关管t10与对应像素电路单元30中的存储电容c之间的电路处于导通状态，以使驱动芯片10与对应像素电路单元30中的存储电容c电连通，进而将驱动芯片10中阳极电压补偿信号输出至对应像素电路单元30中的储存电容c中。

可选地，对每一像素电路单元30中存储电容c进行信号写入处理的步骤中，还包括(在信号写入前)预先对对应像素电路单元20中的存储电容c进行初始化处理的步骤；对对应像素电路单元20中的存储电容c进行初始化处理的步骤包括：控制侦测电路单元30中第三开关管t3处于导通状态，并控制第三开关管t3与对应像素电路单元20中的存储电容c之间的电路处于导通状态，以使复位信号(reset)端与对应像素电路单元20中的存储电容c导通，进而对该存储电容c进行初始化。

其中，控制第十开关管t10与对应像素电路单元20中的存储电容c之间的电路处于导通状态的步骤中，控制对应侦测电路单元30中第二开关管t2处于截止状态，并控制位于同一组中各侦测电路单元中的第十开关管t10分别单独导通，以在不同的时间段将驱动芯片10中阳极电压补偿信号输出至对应像素电路单元20中的储存电容c中。

步骤s122：驱动每一像素电路单元30中电致发光元件d进行发光。

其中驱动每一像素电路单元20中电致发光元件d进行发光的步骤包括：释放存储电容c中的电流，以控制与该存储电容c处于导通状态的电流控制驱动管(t5)处于开通状态，进而使得对应的电致发光元件d处于发光状态。

可选地，驱动每一像素电路单元30中电致发光元件d进行发光的步骤，还包括(在促使电致发光元件d发光前)预先对对应像素电路单元20中的电致发光元件d的阳极进行复位处理的步骤；对对应像素电路单元20中的电致发光元件d的阳极进行复位处理的步骤包括：控制侦测电路单元30中第三开关管t3处于导通状态，并控制对应的像素电路单元20中第一开关管t1处于导通状态，以使复位信号(reset)端与对应像素电路单元20中的电致发光元件d的阳极导通，以对相应电致发光元件d的阳极电位进行复位处理。

可选地，侦测阶段采用的复位信号与显示阶段所采用的复位信号不同，具体而言，在侦测阶段，复位信号reset的电位高于第二工作电压vss，且复位信号reset与第二工作电压vss的压差大于电致发光元件d的开启电压。在显示阶段，复位信号reset的电位小于等于第二工作电压vss的电位。通过上述方式，能够使得在侦测阶段电致发光元件d发光，以减少侦测过程对于电致发光元件d的影响。

如图2所示，每一像素电路单元20进一步包括第四开关管t4、第五驱动管t5、第六开关管t6、第七开关管t7、第八开关管t8以及第九开关管t9。

具体而言，对每一像素电路单元20中存储电容c进行信号写入处理的步骤中，

对对应像素电路单元中的存储电容进行初始化处理的步骤包括：控制使能信号em，以控制第四开关管t4的第一通路端和第二通路端截止，且控制第六开关管t6的第一通路端和第二通路端截止；控制扫描信号scan，以控制第一开关管t1的第一通路端和第二通路端截止；控制第三时序信号s3，以控制第七开关管t7的第一通路端和第二通路端截止，且控制第九开关管t9的第一通路端和第二通路端截止；输入第二时序信号s2，以控制第三开关管t3的第一通路端和第二通路端导通，输入第四时序信号s4，以控制第八开关管t8的第一通路端和第二通路端导通，以使复位信号reset对存储电容c进行复位。

将驱动芯片10中阳极电压补偿信号输出至对应像素电路单元中的储存电容的步骤包括：控制使能信号em，以控制第四开关管t4的第一通路端和第二通路端截止，且控制第六开关管t6的第一通路端和第二通路端截止；控制扫描信号scan，以控制第一开关管t1的第一通路端和第二通路端截止；控制第四时序信号s4，以控制第八开关管t8的第一通路端和第二通路端截止；输入第三时序信号s3，以控制第七开关管t7的第一通路端和第二通路端导通，且控制第九开关管t9的第一通路端和第二通路端导通；输入第五时序信号s5，以控制第十开关管t10的第一通路端和第二通路端导通，以使驱动芯片10将阳极电压补偿信号写入存储电容c。

在前面描述的步骤中，第五驱动管t5也是处于导通状态的，这是因为存储电容c在完成初始化处理后，会留存一定电流，这部分电流会输入第五驱动管的控制端，以控制第五驱动管t5的第一通路端和第二通路端导通，此时第十开关管t10、第九开关管t9、第五驱动管t5和第七开关管t7均处于导通状态，驱动芯片10能够将阳极电压补偿信号写入存储电容c，与此同时，第七开关管t7第一通路端输出的电流会有一部分流入第五驱动管t5的控制端，以控制第五驱动管t5的第一通路端和第二通路端处于导通状态。

具体地，驱动每一像素电路单元20中电致发光元件d进行发光的步骤中，

对对应像素电路单元20中的电致发光元件d的阳极进行复位处理的步骤包括：控制使能信号em，以控制第四开关管t4的第一通路端和第二通路端截止，且控制第六开关管t6的第一通路端和第二通路端截止；控制第三时序信号s3，以控制第七开关管t7的第一通路端和第二通路端截止，且控制第九开关管t9的第一通路端和第二通路端截止；控制第四时序信号s4，以控制第八开关管t8的第一通路端和第二通路端截止，输入扫描信号scan，以控制第一开关管t1的第一通路端和第二通路端导通；输入第二时序信号，以控制第三开关管t3的第一通路端和第二通路端以使复位信号reset对电致发光元件d的阳极电位进行复位。

使得对应的电致发光元件d处于发光状态的步骤包括：控制扫描信号scan控制第一开关管t1的第一通路端和第二通路端截止；控制第三时序信号s3，以控制第七开关管t7的第一通路端和第二通路端截止，且控制第九开关管t9的第一通路端和第二通路端截止；控制第四时序信号s4，以控制第八开关管t8的第一通路端和第二通路端截止；输入使能信号em，以控制第四开关管t4的第一通路端和第二通路端导通，且控制第六开关管t6的第一通路端和第二通路端导通，以使得电致发光元件d发光。

本申请所提供的驱动方法是一个连续的过程，具体地，控制扫描信号scan对沿第一方向排布的各像素电路单元20进行逐行(第二方向)扫描，对位于同一行(第二方向)且连接于位于不同组的侦测电路单元的各像素电路单元20同步扫描，以进行存储电容c初始化、存储电容c信号写入、电致发光元件d的阳极电位复位、电致发光元件d发光；对位于同一行(第二方向)且连接于位于相同组的侦测电路单元的各像素电路单元20，依次进行扫描，以进行存储电容c初始化、存储电容c信号写入、电致发光元件d的阳极电位复位、电致发光元件d发光；同时，对位于同一列(第一方向)中的像素电路单元20依次进行扫描，以进行存储电容c初始化、存储电容c信号写入、电致发光元件d的阳极电位复位、电致发光元件d发光处理；即，在对第四列中像素电路单元20中存储电容c初始化时，对完成存储电容c初始化的第三列的像素电路单元20中的存储电容c进行信号写入，对完成存储电容c信号写入的第二列的像素电路单元20中的电致发光元件d的阳极电位进行复位，对完成电致发光元件d的阳极电位复位的第一列的像素电路单元20中的电致发光元件d进行发光。

请参阅图6，图6是本申请实施例显示面板的结构示意图。在本实施例中，显示面板包括基板41和设置于基板41上的像素电路42。该像素电路42可以是上述任意一实施例中的像素电路。

基板41可以为硬质基板也可以为柔性基板，本申请实施例对此不做限定。

本申请通过设置像素电路包括驱动芯片、以及与驱动芯片连接的若干个像素电路单元和若干个侦测电路单元，利用侦测电路单元导通驱动芯片与对应像素电路单元中电致发光元件的阳极。从而能够便于驱动芯片获取到电致发光元件的阳极电位，便于后续显示阶段对阳极电位的补偿，该电路能够较好的与像素电路单元融合，电路结构简单，且该电路结构便于侦测阶段与显示阶段相互独立设计，使得侦测阶段不会对显示阶段产生影响，并且通过将至少两个对应颜色相同电致发光元件的像素电路单元(通过对应的侦测电路单元)的侦测电路单元通过连接端子相连，并通过所述连接端子连接所述驱动芯片的同一引脚，可以节省驱动芯片上的引脚，便于硬件资源的节约。

以上仅为本申请的实施例，并非因此限制本申请的专利范围，凡是利用本申请说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本申请的专利保护范围内。