Cache中地址标记方法、装置、图形处理系统及电子设备与流程

cache中地址标记方法、装置、图形处理系统及电子设备
技术领域
1.本公开涉及计算机技术领域，尤其涉及一种cache中地址标记方法、装置、图形处理系统和电子设备。


背景技术：

2.cache即高速缓冲，是除寄存器以外最靠近处理器的存储单元，通常由sram组成。将cache部署在处理器和主存之间，同时将主存中的部分数据也存储在cache中，处理器可以通过访问cache读写数据以避免直接访问主存，由于对cache的读写速度比对主存读写的速度要快，因此提升了读写效率，同时也减少了处理器对主存的访问次数。
3.在使用cache进行访问的过程中，存在从cache中识别出主存地址连续的多个缓存行（cache line）的需求。


技术实现要素：

4.本公开的目的是提供一种cache中地址标记方法、装置、图形处理系统和电子设备。
5.根据本公开的一个方面，提供一种cache中地址标记方法，所述cache的映射方式被配置为组相联，所述cache中的每一路中的每个缓存行被配置有对应的连续地址标记，任一缓存行对应的连续地址标记用于标记：与该缓存行存在地址连续关系的缓存行所在的路；其中，存在地址连续关系包括：任意两个缓存行对应的主存地址连续；所述方法包括：在对目标缓存行进行更新后，确定更新后的目标缓存行的tag标记，并获取与目标缓存行所在的目标组相邻的组之中的各缓存行的tag标记；根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的缓存行的连续地址标记进行更新。
6.在一个实施例中，其中，主存地址中的存储库地址以及行地址被映射为tag标记；所述根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的各缓存行的连续地址标记进行更新，包括：若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记所述目标缓存行所在的路，并将其他第一缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路；其中，所述第一缓存行为目标组上一组中的缓存行；若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记所述第二缓存行所在的路；其中，所述第二缓存行为目标组下一组中的缓存行。
7.在一个实施例中，所述将其他第一缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路，包括：若任一第一缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第一
缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
8.在一个实施例中，主存地址中的存储库地址以及行地址被映射为tag标记；所述根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的各缓存行的连续地址标记进行更新，包括：若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记所述目标缓存行所在的路，并将其他第二缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路；其中，所述第二缓存行为目标组下一组中的缓存行；若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记所述第一缓存行所在的路；其中，所述第一缓存行为目标组上一组中的缓存行。
9.在一个实施例中，所述将其他第一缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路，包括：若任一第一缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
10.在一个实施例中，其中，主存地址中的存储库地址以及行地址被映射为tag标记；所述根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的各缓存行的连续地址标记进行更新，包括：若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记所述目标缓存行所在的路，并将其他第二缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路；其中，所述第二缓存行为目标组下一组中的缓存行；若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记所述第一缓存行所在的路；其中，所述第一缓存行为目标组上一组中的缓存行。
11.在一个实施例中，所述将其他第二缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路，包括：若任一第二缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
12.根据本公开的第二个方面，提供一种cache中地址标记装置，所述cache的映射方式被配置为组相联，所述cache中的每一路中的每个缓存行被配置有对应的连续地址标记，任一缓存行对应的连续地址标记用于标记：与该缓存行存在地址连续关系的缓存行所在的路；其中，存在地址连续关系包括：任意两个缓存行对应的主存地址连续；所述装置包括：获取模块，用于在对目标缓存行进行更新后，确定更新后的目标缓存行的tag标记，并获取与目标缓存行所在的目标组相邻的组之中的各缓存行的tag标记；更新模块，用于根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的缓存行的连续地址标记进行更新。
13.在一个实施例中，其中，主存地址中的存储库地址以及行地址被映射为tag标记；
所述更新模块，具体用于若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记所述目标缓存行所在的路，并将其他第一缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路；其中，所述第一缓存行为目标组上一组中的缓存行；若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记所述第二缓存行所在的路；其中，所述第二缓存行为目标组下一组中的缓存行。
14.在一个实施例中，所述更新模块，具体用于若任一第一缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
15.在一个实施例中，其中，主存地址中的存储库地址以及行地址被映射为tag标记；所述更新模块，具体用于若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记所述目标缓存行所在的路，并将其他第二缓存行的连续地址标记更新为不用于标记所述目标缓存行所在的路；其中，所述第二缓存行为目标组下一组中的缓存行；若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记所述第一缓存行所在的路；其中，所述第一缓存行为目标组上一组中的缓存行。
16.在一个实施例中，所述更新模块，具体用于若任一第二缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
17.根据本公开的第三个方面，提供一种图形处理系统，包括上述第二方面所述的装置。
18.根据本公开的第四个方面，提供一种电子组件，包括上述第三方面所述的图形处理系统。
19.根据本公开的第五个方面，提供一种电子设备，包括第四方面的电子组件。
20.应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本公开。
附图说明
21.图1为本公开一个实施例提供的主存和缓存直接映射的结构示意图；图2为本公开一个实施例提供的主存和缓存组相联映射的结构示意图；图3为本公开一个实施例提供的主存和缓存全相联映射的结构示意图；图4为本公开一个实施例提供的一种基于cache地址标记方法的流程示意图；图5为本公开一个实施例提供的一种后向址连续数据标记的示意图；图6为本公开一个实施例提供的另一种后向址连续数据标记的示意图；图7为本公开一个实施例提供的又一种后向址连续数据标记的示意图；图8为本公开一个实施例提供的再一种后向址连续数据标记的示意图；图9为本公开一个实施例提供的一种cache中地址标记装置的结构示意图；图10为本公开一个实施例提供的图形处理系统的结构示意图。
具体实施方式
22.在介绍本公开实施例之前，应当说明的是：本公开部分实施例被描述为处理流程，虽然流程的各个操作步骤可能被冠以顺序的步骤编号，但是其中的操作步骤可以被并行地、并发地或者同时实施。
23.本公开实施例中可能使用了术语“第一”、“第二”等等来描述各个特征，但是这些特征不应当受这些术语限制。使用这些术语仅仅是为了将一个特征与另一个特征进行区分。
24.本公开实施例中可能使用了术语“和/或”，“和/或”包括其中一个或更多所列出的相关联特征的任意和所有组合。
25.应当理解的是，当描述两个部件的连接关系或通信关系时，除非明确指明两个部件之间直接连接或直接通信，否则，两个部件的连接或通信可以理解为直接连接或通信，也可以理解为通过中间部件间接连接或通信。
26.为了使本公开实施例中的技术方案及优点更加清楚明白，以下结合附图对本公开的示例性实施例进行进一步详细的说明，显然，所描述的实施例仅是本公开的一部分实施例，而不是所有实施例的穷举。需要说明的是，在不冲突的情况下，本公开中的实施例及实施例中的特征可以相互组合。
27.cache的容量相对于主存的容量较小，它保存的数据是主存的一个子集，且cache和主存进行地址交换是以缓存行为单位的。即把主存和cache分割成一定大小的块，这个块在主存中称为数据块data block，在cache中称为缓存行即cacheline，将主存中的data block映射到cache中的缓存行中就需要采用相应的映射方式，常见的映射方式包括直接映射、组相联映射以及全相联映射。
28.直接映射采用取模的方式进行一对一映射，容易出现cache不命中的情况。组相联中每一组（set）中可以存储更多的信息，因此相对于直接映射的方式，增加了cache命中的几率。全相联是极端的组相联，即cache只有一个set，实现较为复杂，目前业界最常用的映射方法为组相联。
29.如图1所示，为直接映射的示意图，在直接映射的方式中，如果cache中共有8个缓存行，那么主存中的0、8、16、24...号数据块会被映射到缓存行0中，同理1、9、17....号数据块会被映射到缓存行1中。当主机的读取顺序是数据块0-数据块8-数据块0-数据块8的情况下，由于缓存行0只能同时缓存一个数据块，因此，在读取数据块8以及第二次读取数据块0时，会发生cache不命中的情况，即在cache中无法找到数据块需要去主存中查找数据块。因此，直接映射的方式中cache命中的几率并不高，进而整体的读写效率也不高。
30.在组相联的方式中包括n个路（way），每个way中包括m组（set）。每一组即每一set中包括n个缓存行。如图2所示，存在两个way，即way0和way1，每一way有8行，对应8组，每组中有2个缓存行，即way0的cache line0和way1的cache line0为一组。
31.这样主存中数据块0、8、16、24
…
中任意两个数据块可以同时存储在缓存中的两个cache line0中，进而组相联映射的方式相对于直接映射增加了cache命中的概率提升了整体的读写效率。
32.如图3所示，为全相联的示意图，全相联是极端的组相联，即cache只有一个组。每一个数据块都可以存进任何一个缓存行。全相联方式中cache命中的概率也较高，但是实现
较为复杂，工作延时也较高。
33.在直接映射和组相联的映射方式中，处理器发送到cache中的地址被划分为3段，包括tag、index、line offset。其中line offset用来表示该地址在缓存行中的偏移，index表示该地址位于哪一个组(set)中（组相联映射的方式中）或哪一行中（直接映射的方式中），tag用于确定是否命中数据块。其中，每个缓存行中包括有效位v、标记位tag和数据位data block。cache根据接收地址的tag和标记位tag进行对比就能判断出该地址在cache中是否命中。
34.而在全相联的场景中不存在组的概念，因此处理器发来的地址只包括块号tag和line offset。
35.本公开中的主存可以是ddr sdram，即双倍速率同步动态随机存储器，主存地址通常由column（列）地址、bank（存储库）地址、row（行）组成。
36.表1例如，如表1所示，ddr颗粒由12bit的column（列）地址，4bit的bank（存储库）地址和14bit的row（行）地址组成。另外，在一些场景中，主存地址中可能并不包含bank，仅由row和column组成。其中，一个row也为主存的一个主存页，如果需要从主存中读写数据，则需要先定位和开启主存页，进一步在主存页中的相应位置读写数据。
37.另外，如前文介绍，在直接映射和组相联映射的方式中，在缓存中cache line地址被分为了tag、index以及line offset，因此主存中的row、bank、column在映射到缓存中时，会被映射为tag、index以及line offset。
38.在实际应用中，在直接映射和组相联的方式中，可以将主存地址中的row地址和bank地址被映射为tag。
39.例如，如表2所示：表2此外，row地址也可以被映射为tag；row地址和bank地址还可能被映射为包含于tag，例如tag中包括row地址、bank地址以及column中的部分地址，具体的映射方式往往和cache中cache line即缓存行的数量以及缓存行中包含的数据量的大小相关，具体方式可以参照相关技术，本公开对此不进行详述。
40.由于组相联相对于直接相联cache命中率较高，且相对于全相联效率较高，因此目前业界通常使用组相联的方式进行映射。
41.在使用cache进行访问的过程中，存在从cache中识别出主存地址连续的多个cache line的需求，例如将多个主存地址连续的缓存行一起写回至主存，以提升写回效率，其中主存地址连续是指多个缓存行中的数据在主存中的地址是连续的，将连续的数据写回
到主存中，相对于将不连续的多个缓存行分别写回至主存的不同位置，写回效率明显较高。
42.在组相联的映射方式中，如果想要找到主存地址连续的多个c缓存行，则需要通过对各个way中各个set的缓存行的tag值进行查找和对比，来找的主存地址连续的多个cache line，这种方式效率较低，需要较高的延时。
43.以图2示出的组相联为例，如果想要查找出目前cache中主存地址连续的缓存行，需要查看每个cache line的tag，例如，如果主存地址中的row地址和bank地址被映射为tag，在获取了way0的cache line0的tag后，如果，想要知道是否有cache line与way0的cache line0存在主存地址连续的关系，则需要获取way0的cache line1以及way1的cache line1的tag，如果way1的cache line1的tag或者way0的cache line1的tag与way0的cache line0的tag相同，则确定way0的cache line1或者way1的cache line1与way0的cache line0存在主存地址连续的关系。
44.可见，如果想要确定cache中全部存在主存地址连续的缓存行时，需要遍历全部cache line的tag，并进行匹配了，效率较低，如果需要利用主存地址连续的缓存行进行后续事务处理，则需要较高延时。
45.为了解决上述问题，本公开提出在cache中为每个缓存行配置对应的连续地址标记，该连续地址标记用于标记：与该缓存行存在地址连续关系的缓存行所在的way，并且在cache中的缓存行发生更新时，对连续地址标记进行更新，以对cache中的各个缓存行的主存地址连续性进行标记，进而在需要获取或确定主存地址连续的缓存行时，可以基于连续地址标记快速获取。
46.如图4所示，本公开提出一种cache中地址标记方法，其中，cache的映射方式被配置为组相联，cache中的每一way中的每个缓存行被配置有对应的连续地址标记，任一缓存行对应的连续地址标记用于标记：与该缓存行存在地址连续关系的缓存行所在的way；其中，存在地址连续关系包括：任意两个缓存行对应的主存地址连续；方法包括：s401，在对目标缓存行进行更新后，确定更新后的目标缓存行的tag标记，并获取与目标缓存行所在的目标组相邻的组之中的各缓存行的tag标记；s402，根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的各缓存行的连续地址标记进行更新。
47.采用上述方式，可以在缓存行发生更新时，就将cache中各缓存行的主存地址连续关系进行标记，在需要获取主存地址连续的缓存行时，可以基于连续地址标记快速获取。
48.在cache中，通常存在对cache中的缓存行进行更新的场景，本公开中对缓存行进行更新的场景包括：将cache中的缓存行进行替换，以及对cache中的空缓存行进行写入。对cache中的缓存行进行替换是指，在需要将主存中的某个数据块写入cache中，但是cache中的各个缓存行均占用后，需要将某个缓存行的数据写回至主存，并将数据块写入该缓存行中。在确定需要替换的缓存行时，可以是将较长时间不使用的缓存行中的数据写回至主存，或者将最早写入cache的缓存行的数据写回至主存，对cache中的数据进行替换的场景可以参照相关技术，本公开不进行详述。而对cache中的空缓存行进行写入是指，在cache中的某个缓存行还未存储数据时，可以将需要使用cache的数据块存储到该缓存行中。
49.上述s401，可以是在发生替换或者写入空的缓存行时执行。
50.在下述实施例中，默认主存地址中的bank地址以及row地址被映射为tag标记。下
面以替换的场景为例，对本公开的地址连续数据标记方法进行详述。
51.在组相联中，存在主存地址连续关系的缓存行必定位于相邻的组中，因此，想要标记与某个缓存行存在主存地址连续关系的缓存行，实际上就是标记缓存行所在的way。
52.如图5所示，为采用本公开提出的其中一种cache中地址标记方法进行处理后的cache，图5中的way编号，即为每个缓存行配置的对应的连续地址标记，如way0的cache line0的tag=0x1000，与way1中的cache line1的tag=0x1000相同，因此，将way0的cache line0的连续地址标记记为1，以标记与way0的cache line0存在主存地址连续关系的缓存行在way1，即为way1的cache line1。图5中，way编号中的0用于表示与该缓存行存在的主存地址连续的缓存行在way0，1用于表示与该缓存行存在的主存地址连续的缓存行在way1。4用于表示不存在与该缓存行具有主存地址连续关系的缓存行，其中4也可以是任意不为0和1的值。
53.图5中用连续地址标记，标记出了目标缓存行下一组中，哪个way中存在与目标缓存行主存地址连续的缓存行，本公开称这种标记方式为后向标记。在另一实施例中，还可以是标记出了目标缓存行上一组中，哪个way中存在与目标缓存行主存地址连续的缓存行，本公开称这种标记方式为前向标记。
54.在后向标记的方式中，上述s402具体为：若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记目标缓存行所在的way，并将其他第一缓存行的连续地址标记更新为不用于标记目标缓存行所在的way；其中，第一缓存行为目标组上一组中的缓存行；若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记第二缓存行所在的way；其中，第二缓存行为目标组下一组中的缓存行。
55.其中，若任一第一缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
56.例如，如图6所示，如果发生cache替换1，即将tag=0x1200的数据块替换掉way1 cache line1中的数据块，由于更新后的tag=0x1200与way1 cache line2相同，因此需要将way1 cache line1的连续地址标记由4更新为1，以指示与该way1 cache line1存在主存地址连续的缓存行在way1cache line2；同时，由于way0 cache line0的tag=0x1000，与更新前的way1 cache line1的tag相同，而与更新后的way1cache line1的tag不同，因此需要将way0 cache line0的连续地址标记由1更新为4。
57.又如7所示，如果发生cache替换2，即将tag=0x1200的数据块替换掉way1 cache line5中的数据块，由于更新后的tag=0x1200与way1 cache line4相同，因此要将way1 cache line4的连续地址标记由4更新为1，以指示与该way1 cache line4存在主存地址连续的缓存行在way1cache line5，同时，由于更新后的way1 cache line5地tag不再与way1 cache line6的tag相同，因此，需要将way1 cache line5的连续地址标记由1更新为4。
58.再如8所示，如果发生cache替换3，即将tag=0x4000的数据块替换掉way0 cache line5中的数据块，由于更新后的tag=0x4000与way0 cache line6和way1 cache line6的tag都不同，因此要将way0cache line5的连续地址标记由0更新为4，同时，由于更新后的
way0 cache line5地tag不再与way0 cache line4的tag相同，因此，需要将way0 cache line4的连续地址标记由0更新为4。
59.上述实施例中，均是在目标缓存行的行更新后，及需要对目标缓存行对应的连续地址标记进行更新，也需要对目标缓存行所在的目标组相邻的组之中的缓存行的连续地址标记进行更新。
60.在其他实施例中，可能仅需要对目标缓存行对应的连续地址标记进行更新，无需对目标缓存行所在的目标组相邻的组之中的缓存行的连续地址标记进行更新，例如，将图8中的way1 cacheline1的tag=0x1000数据块更新为tag=0x1200的数据块，则仅需要将way1 cache line1的连续地址标记更新为1，无需更新其他缓存行的标记。
61.在一些实施例中，也可以无需对目标缓存行对应的连续地址标记进行更新，仅需对目标缓存行所在的目标组相邻的组之中的缓存行的连续地址标记进行更新。
62.例如，将图6中的way1 cacheline4的tag=0x1200数据块更新为tag=2000的数据块，则仅需要将way1 cache line3的连续地址标记更新为1，无需更新其他缓存行的标记。
63.在前向标记的方式中，上述s402具体为：根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的各缓存行的连续地址标记进行更新，包括：若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记目标缓存行所在的way，并将其他第二缓存行的连续地址标记更新为不用于标记目标缓存行所在的way；其中，第二缓存行为目标组下一组中的缓存行；若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记第一缓存行所在的way；其中，第一缓存行为目标组上一组中的缓存行。
64.其中，若任一第二缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
65.可以理解，前先标记的过程与后向标记的过程类似，区别仅在于，后向标记，标记出了目标缓存行下一组中，哪个way中存在与目标缓存行主存地址连续的缓存行。前向标记，标记出了目标缓存行上一组中，哪个way中存在与目标缓存行主存地址连续的缓存行，本公开不再对前向标记进行赘述。
66.在对连续地址进行标记后，在需要获取主存地址连续的缓存行时，即可以根据连续地址标记快速查找，如图5所示，通过查看way0 cacheline0的连续地址标记确定way1 cacheline1与该way0 cacheline0存在主存地址连续的关系，连续的地址被串成一个指针链，way编号=4打断指针链。因此可依次读取连续地址标记来查找连续的地址块，如基于图7得到的主存地址连续的cacheline，包括：way0 cache line0-way1 cache line1；way1 cache line0
‑ꢀ
way0 cache line1-way0 cacheline2
‑ꢀ
way1cache line3；way0 cache line3-way0 cache line4
‑ꢀ
way0 cacheline5
‑ꢀ
way0 cachelin6-way0cachelin7；way1 cache line4-way1 cache line5。
67.可见，采用本公开的方式，在cache中为每个缓存行配置对应的连续地址标记，该连续地址标记用于标记：与该缓存行存在地址连续关系的缓存行所在的way，并且在cache
中的缓存行发生更新时，对连续地址标记进行更新，以对cache中的各个缓存行的主存地址连续性进行标记，进而在需要获取或确定主存地址连续的缓存行时，可以基于连续地址标记快速获取，有效提升了获取效率。
68.可以理解，在主存地址中的bank地址以及row地址被映射为包含于tag标记时，可以是在获取tag标记后，从中获取bank地址以及row地址，基于bank地址以及row地址进行标记，即将上述实施例中的基于tag标记相同进行标记，改为基于bank地址以及row地址相同进行标记，本公开对此不在进行详述。另外，可以理解的是，上述例子中虽然均以两个way为例进行说明，但是本公开可以适用于多个way的场景中，在连续地址标记中用不同的标记表示不同的way，用预定义的、不同于各个way的标记，来表示不存在连续地址。
69.与前述一种cache中地址标记方法相对应，如图9所示，本公开还提出一种cache中地址标记装置，其中，cache的映射方式被配置为组相联，cache中的每一路中的每个缓存行被配置有对应的连续地址标记，任一缓存行对应的连续地址标记用于标记：与该缓存行存在地址连续关系的缓存行所在的路；其中，存在地址连续关系包括：任意两个缓存行对应的主存地址连续；该装置包括：获取模块910，用于在对目标缓存行进行更新后，确定更新后的目标缓存行的tag标记，并获取与目标缓存行所在的目标组相邻的组之中的各缓存行的tag标记；更新模块920，用于根据获取的tag标记，对目标缓存行对应的连续地址标记，和/或，与目标缓存行所在的目标组相邻的组之中的缓存行的连续地址标记进行更新。
70.在一个实施例中，主存地址中的存储库地址以及行地址被映射为tag标记；更新模块920，具体用于若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记目标缓存行所在的路，并将其他第一缓存行的连续地址标记更新为不用于标记目标缓存行所在的路；其中，第一缓存行为目标组上一组中的缓存行；若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记第二缓存行所在的路；其中，第二缓存行为目标组下一组中的缓存行。
71.在一个实施例中，更新模块920，具体用于若任一第一缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第一缓存行的连续地址标记更新为用于标记不存在连续地址的预定义标记。
72.在一个实施例中，主存地址中的存储库地址以及行地址被映射为tag标记；更新模块920，具体用于若更新后的目标缓存行的tag标记和任一第二缓存行的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记该目标缓存行所在的路，并将其他第二缓存行的连续地址标记更新为不用于标记该目标缓存行所在的路；其中，该第二缓存行为目标组下一组中的缓存行；若更新后的目标缓存行的tag标记和任一第一缓存行的tag标记相同，则将该目标缓存行的连续地址标记更新为用于标记该第一缓存行所在的路；其中，该第一缓存行为目标组上一组中的缓存行。
73.在一个实施例中，更新模块920，具体用于若任一第二缓存行的tag标记与该目标缓存行更新前的tag标记相同，则将该第二缓存行的连续地址标记更新为用于标记不存在
连续地址的预定义标记。
74.本公开实施例还提供一种图形处理系统，包括上述地址标记装置。
75.在一个具体的实施例中，本公开中所描述图形处理系统，如图10所示，其至少包括：gpu core，用来处理命令，例如处理画图的命令，根据画图命令，执行图像渲染的pipeline。其中，gpu core里面主要包含了计算单元，用于执行shader编译后的指令，属于可编程模块，由大量的alu组成；cache（存储器），用于缓存gpu core的数据，以减少对内存的访问；控制器（图中未示出）另外，gpu core 还具有多种功能模块，例如光栅化（3d渲染管线的一个固定的阶段）、tilling（tbr和tbdr gpu架构中对一帧进行划片处理）、裁剪（3d渲染管线的一个固定的阶段，裁剪掉观察范围外，或者背面不显示的图元）、后处理（对画完的图进行缩放，裁剪，旋转等操作）等。
76.通用dma，用于执行主机内存到gpu显卡内存之间的数据搬移，例如，用于3d画图的vertex数据，通用dma将vertex数据从主机内存搬到gpu显卡内存；片上网络，用于soc上各个master和salve之间的数据交换；应用处理器，用于soc上各个模块任务的调度，例如gpu渲染完一帧图后通知应用处理器，应用处理器再启动显示控制器将gpu画完的图显示到屏幕上；pcie控制器，用于和主机通信的接口，实现pcie协议，使gpu显卡通过pcie接口连接到主机上。主机上运行了图形api,以及显卡的驱动等程序；内存控制器，用于连接内存设备，用于保存soc上的数据；地址标记装置，用于执行上文中所描述的地址标记方法；显示控制器，用于控制将内存里的frame buffer以显示接口(hdmi, dp等)输出到显示器上；视频解码器，用于将主机硬盘上的编码的视频解码成能显示的画面。
77.视频编码器，用于将主机硬盘上原始的视频码流编码成指定的格式返回给主机。
78.基于相同的发明构思，本公开实施例还提供一种电子组件，该电子组件包括上述任一实施例中所述的图形处理系统。在一些使用场景下，该电子组件的产品形式体现为显卡；在另一些使用场景下，该电子装置的产品形式体现为cpu主板。
79.本公开实施例还提供一种电子设备，该电子设备包括上述的图形处理系统。在一些使用场景下，该电子设备的产品形式是便携式电子设备，例如智能手机、平板电脑、vr设备等；在一些使用场景下，该电子设备的产品形式是个人电脑、游戏主机等。
80.以上尽管已描述了本公开的优选实施例，但本领域内的技术人员一旦得知了基本创造性概念，则可对这些实施例做出另外的变更和修改。所以，所附权利要求意欲解释为包括优选实施例以及落入本公开范围的所有变更和修改，本领域的技术人员在不脱离本公开的精神和范围的前提下，做出的变更和修改也应视为本公开实施例的保护范围。