显示基板及显示装置的制作方法

1.本公开涉及显示技术领域，尤其涉及一种显示基板及显示装置。


背景技术：

2.随着显示技术的不断发展，显示装置已经逐渐遍及在人们的生活中。其中，有机发光二极管(organic light-emitting diode，简称：oled)显示面板由于具有自发光、低功耗、宽视角、响应速度快、高对比度等优点，因而被广泛的应用于手机、电视、笔记本电脑等智能产品中。然而，中大尺寸的显示面板存在能耗较大及温升较快的问题。


技术实现要素：

3.本公开提供一种显示基板及显示装置，以降低显示装置的显示面板的能耗，减缓显示装置的显示面板的温升。
4.一方面，提供一种显示基板。所述显示基板包括衬底、第二电极层和第一电压信号线。所述衬底包括显示区和围绕所述显示区的周边区，所述周边区包括第一边框区、第二边框区、第三边框区和第四边框区；所述第一边框区和所述第三边框区位于所述显示区在第一方向上相对的两侧；所述第二边框区和所述第四边框区在第二方向上位于所述显示区相对的两侧；所述第一方向与所述第二方向相垂直。所述第二电极层,设置于所述衬底上；所述第二电极层由所述显示区延伸至所述周边区。所述第一电压信号线包括第一走线和第二走线；所述第一走线和所述第二走线并行设置，且至少位于所述第二边框区、所述第三边框区和所述第四边框区，且所述第一走线和所述第二走线的两端均延伸至所述第一边框区，以接收第一电压信号。
5.其中，所述第一走线在所述第二边框区、所述第三边框区和所述第四边框区与所述第二电极层连接，所述第二走线在所述第三边框区与所述第二电极层连接和/或与所述第一走线连接，且所述第二走线在所述第二边框区和所述第四边框区的部分，与所述第二电极层及所述第一走线分离。
6.在一些实施例中，所述显示基板还包括设置于所述衬底和所述第二电极层之间的至少一个导电层。所述第一走线包括至少一个第一走线图案，每个第一走线图案位于所述至少一个导电层中的一者；在所述第一走线包括多个第一走线图案的情况下，所述多个第一走线图案沿垂直于所述衬底的方向叠置且连接。所述第二走线包括至少一个第二走线图案，每个第二走线图案位于所述至少一个导电层中的一者；在所述第二走线包括多个第二走线图案的情况下，所述多个第二走线图案沿垂直于所述衬底的方向叠置且连接。
7.在一些实施例中，所述第一走线和所述第二走线中，至少一个第一走线图案和至少一个第二走线图案位于同一导电层。在所述第二边框区和所述第四边框区，位于同一导电层的第一走线图案和第二走线图案间隔设置。在所述第三边框区，位于同一导电层的第一走线图案和第二走线图案连接；或，位于同一导电层的第一走线图案和第二走线图案间隔设置，且所述第二走线中最远离衬底的一个第二走线图案与所述第二电极层连接。
8.在一些实施例中，所述至少一个导电层包括第一源漏导电层和第一电极层，所述第一电极层位于所述第一源漏导电层和所述第二电极层之间。
9.在一些实施例中，所述第一走线包括两个第一走线图案，分别位于所述第一源漏导电层和所述第一电极层；每个第一走线图案至少设置于所述第二边框区、所述第三边框区和所述第四边框区；位于所述第一电极层的第一走线图案与所述第二电极层连接。所述第二走线包括两个第二走线图案，分别位于所述第一源漏导电层和所述第一电极层，位于所述第一源漏导电层的第二走线图案至少设置于所述第二边框区、所述第三边框区和所述第四边框区；位于所述第一电极层的第二走线图案至少设置于所述第三边框区，且与所述第二电极层连接。
10.在一些实施例中，所述第一走线包括两个第一走线图案，分别位于所述第一源漏导电层和所述第一电极层；每个第一走线图案至少设置于所述第二边框区、所述第三边框区和所述第四边框区。所述第二走线包括一个第二走线图案，位于所述第一源漏导电层；所述第二走线图案至少设置于所述第二边框区、所述第三边框区和所述第四边框区，且所述第二走线图案在所述第三边框区与位于所述第一源漏导电层的第一走线图案连接。
11.在一些实施例中，所述至少一个导电层还包括第二源漏导电层，所述第二源漏导电层位于所述第一源漏导电层和所述第一电极层之间。
12.在一些实施例中，所述第一走线包括三个第一走线图案，分别位于所述第一源漏导电层、所述第二源漏导电层和所述第一电极层；每个第一走线图案至少设置于所述第二边框区、所述第三边框区和所述第四边框区。所述第二走线包括三个第二走线图案，分别位于所述第一源漏导电层、所述第二源漏导电层和所述第一电极层；位于所述第一源漏导电层的第二走线图案，以及位于所述第二源漏导电层的第二走线图案，均至少设置于所述第二边框区、所述第三边框区和所述第四边框区；位于所述第一电极层的第二走线图案至少设置于所述第三边框区，且与所述第二电极层连接。
13.在一些实施例中，所述第一走线包括三个第一走线图案，分别位于所述第一源漏导电层、所述第二源漏导电层和所述第一电极层；每个第一走线图案至少设置于所述第二边框区、所述第三边框区和所述第四边框区；位于所述第一电极层的第一走线图案与所述第二电极层连接。所述第二走线包括两个第二走线图案，分别位于所述第一源漏导电层和所述第二源漏导电层；每个第二走线图案至少设置于所述第二边框区、所述第三边框区和所述第四边框区。位于所述第一源漏导电层的第一走线图案和第二走线图案在所述第三边框区连接，和/ 或，位于所述第二源漏导电层的第一走线图案和第二走线图案在所述第三边框区连接。
14.在一些实施例中，在所述第三边框区，所述第二走线的设定线段与所述第二电极层连接和/或与所述第一走线连接。所述设定线段的长度等于所述第二走线中位于所述第三边框区的部分的长度；或者，所述第二走线包括多个设定线段，所述多个设定线段沿所述第三边框区间隔设置。
15.在一些实施例中，所述第一边框区包括绑定区，所述显示基板还包括至少一个第一电源引脚，所述至少一个第一电源引脚设置于所述绑定区。所述第一电源引脚被配置为传输第一电压信号；所述第一电压信号线与所述第一电源引脚电连接。
16.在一些实施例中，所述第一走线和所述第二走线在所述绑定区分别与不同的所述
第一电源引脚连接。或者，所述显示基板还包括设置于所述第一边框区的电源连接线，所述第一走线和所述第二走线在所述第一边框区与所述电源连接线连接，所述电源连接线与所述第一电源引脚连接。
17.在一些实施例中，所述第二走线设置于所述第一走线和所述显示区之间，所述第二电极层在所述衬底上的正投影与所述第二走线在所述衬底上的正投影至少部分重叠。或者，所述第一走线设置于所述第二走线和所述显示区之间，所述第二电极层在所述衬底上的正投影与所述第二走线在所述衬底上的正投影之间具有间距。
18.在一些实施例中，所述显示基板还包括至少一个扫描控制电路，设置于所述周边区。所述至少一个扫描控制电路位于所述第一电压信号线和所述显示区之间，或，位于所述第一走线和所述第二走线之间。
19.本公开的一些实施例提供的显示基板，第二走线仅位于第三边框区的部分与第二电极层直接电连接。这样，在第一电压信号由第一边框沿着第二走线传输至第三边框区的过程中，第一电压信号经过第二走线位于第二边框区和第四边框区的部分所产生的压降较低，也即，传输至第二走线位于第三边框区的部分的第一电压信号的电压下降较小；并且由于在上边框与电连接，因此，第二走线可以在第三边框区处对第一走线的压降进行补偿，从而使得第一电压信号线整体产生的压降下降，从而降低能耗，减缓温升。
20.另一方面，提供一种显示装置。所述显示装置包括显示基板和覆盖于所述显示基板的出光侧的封装层，所述显示基板为上述任一实施例所述的显示基板。
21.本公开的一些实施例提供的显示装置的有益效果与上述技术方案提供的显示基板的有益效果相同，在此不做赘述。
附图说明
22.为了更清楚地说明本公开中的技术方案，下面将对本公开一些实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本公开的一些实施例的附图，对于本领域普通技术人员来讲，还可以根据这些附图获得其他的附图。此外，以下描述中的附图可以视作示意图，并非对本公开实施例所涉及的产品的实际尺寸、方法的实际流程、信号的实际时序等的限制。
23.图1为根据一些实施例的显示装置的结构图；
24.图2为根据一些实施例的显示面板的剖面图；
25.图3为根据一些实施例的显示基板与电路板绑定的结构图；
26.图4为根据一些实施例的像素驱动电路的的结构图；
27.图5为根据一些实施例的显示基板的结构图；
28.图6为根据另一些实施例的显示基板的结构图；
29.图7为根据又一些实施例的显示基板的结构图；
30.图8为图7所示的一种显示基板沿剖面线a-a处的剖面图；
31.图9为图7所示的一种显示基板沿剖面线b-b处的剖面图；
32.图10为图7所示的另一种显示基板沿剖面线b-b处的剖面图；
33.图11为图7所示的另一种显示基板沿剖面线a-a处的剖面图；
34.图12为图7所示的又一种显示基板沿剖面线b-b处的剖面图；
35.图13为图5或图7所示的一种显示基板沿剖面线c-c处的剖面图；
36.图14为图5或图7所示的另一种显示基板沿剖面线c-c处的剖面图。
具体实施方式
37.下面将结合附图，对本公开一些实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本公开一部分实施例，而不是全部的实施例。基于本公开所提供的实施例，本领域普通技术人员所获得的所有其他实施例，都属于本公开保护的范围。
38.除非上下文另有要求，否则，在整个说明书和权利要求书中，术语“包括(comprise)”及其他形式例如第三人称单数形式“包括(comprises)”和现在分词形式“包括(comprising)”被解释为开放、包含的意思，即为“包含，但不限于”。在说明书的描述中，术语“一个实施例(one embodiment)”、“一些实施例(some embodiments)”、“示例性实施例(exemplary embodiments)”、“示例(example)”、“特定示例(specific example)”或“一些示例(someexamples)”等旨在表明与该实施例或示例相关的特定特征、结构、材料或特性包括在本公开的至少一个实施例或示例中。上述术语的示意性表示不一定是指同一实施例或示例。此外，所述的特定特征、结构、材料或特点可以以任何适当方式包括在任何一个或多个实施例或示例中。
39.以下，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征。在本公开实施例的描述中，除非另有说明，“多个”的含义是两个或两个以上。
40.在描述一些实施例时，可能使用了“连接”及其衍伸的表达。例如，描述一些实施例时可能使用了术语“连接”以表明两个或两个以上部件彼此间有直接物理接触或电接触。这里所公开的实施例并不必然限制于本文内容。
[0041]“a、b和c中的至少一个”与“a、b或c中的至少一个”具有相同含义，均包括以下a、b和c的组合：仅a，仅b，仅c，a和b的组合，a和c的组合，b和c的组合，及a、b和c的组合。
[0042]“a和/或b”，包括以下三种组合：仅a，仅b，及a和b的组合。
[0043]
本文中“适用于”或“被配置为”的使用意味着开放和包容性的语言，其不排除适用于或被配置为执行额外任务或步骤的设备。
[0044]
如本文所使用的那样，“约”、“大致”或“近似”包括所阐述的值以及处于特定值的可接受偏差范围内的平均值，其中所述可接受偏差范围如由本领域普通技术人员考虑到正在讨论的测量以及与特定量的测量相关的误差(即，测量系统的局限性)所确定。
[0045]
本文参照作为理想化示例性附图的剖视图和/或平面图描述了示例性实施方式。在附图中，为了清楚，放大了层和区域的厚度。因此，可设想到由于例如制造技术和/或公差引起的相对于附图的形状的变动。因此，示例性实施方式不应解释为局限于本文示出的区域的形状，而是包括因例如制造而引起的形状偏差。例如，示为矩形的蚀刻区域通常将具有弯曲的特征。因此，附图中所示的区域本质上是示意性的，且它们的形状并非旨在示出设备的区域的实际形状，并且并非旨在限制示例性实施方式的范围。
[0046]
本公开的一些实施例提供了一种显示基板1及显示装置100。以下对显示基板1及显示装置100分别进行介绍。
[0047]
如图1所示，本公开的一些实施例提供了一种显示装置100，该显示装置 100可以是显示不论运动(例如，视频)还是固定(例如，静止图像)的且不论文字还是的图像的任何装置。更明确地说，预期所述实施例可实施在多种电子装置中或与多种电子装置关联，所述多种电子装置例如(但不限于)移动电话、无线装置、个人数据助理(pda)、手持式或便携式计算机、gps接收器/导航器、相机、mp4视频播放器、摄像机、游戏控制台、手表、时钟、计算器、电视监视器、平板显示器、计算机监视器、汽车显示器(例如，里程表显示器等)、导航仪、座舱控制器和/或显示器、相机视图的显示器(例如，车辆中后视相机的显示器)、电子相片、电子广告牌或指示牌、投影仪、建筑结构、包装和美学结构(例如，对于一件珠宝的图像的显示器)等。
[0048]
在一些实施例中，如图1所示。显示装置100包括显示面板10。
[0049]
示例性地，参阅图1和图3，上述显示装置100还可以包括框架、电路板 20、以及其他电子配件等。其中，显示面板10例如可以设置在该框架内。
[0050]
上述显示面板10的类型包括多种，可以根据实际需要选择设置。
[0051]
示例性地，上述显示面板10可以为有机发光二极管(organic light emittingdiode，简称oled)显示面板、量子点发光二极管(quantum dot light emittingdiodes，简称qled)显示面板、微发光二极管(micro light emitting diodes，简称micro led)显示面板等，本公开对此不做具体限定。
[0052]
下面以上述显示面板10为oled显示面板为例，对本公开的一些实施例进行示意性说明。
[0053]
在一些实施例中，如图2所示，显示面板10包括上述显示基板1和用于封装该显示基板1的封装层2。
[0054]
此处，封装层2可以为封装薄膜，也可以为封装基板。在一些实施例中，该封装层2包括第一无机薄膜21、有机薄膜22和第二无机薄膜23，以避免外界环境中的水汽和氧气进入显示面板10内，损伤发光器件中的有机材料而造成显示面板10的寿命缩短。
[0055]
在一些实施例中，如图3所示，显示基板1具有显示区a和位于显示区a 至少一侧的周边区b，附图3以周边区b包围显示区a为例进行示意。
[0056]
其中，显示区a为显示图像的区域，显示区a被配置为设置子像素p。
[0057]
示例性地，如图2和图3所示，显示基板1可以包括衬底sub和设置于衬底sub上且位于显示区a的子像素p，每个子像素p均包括设置于衬底sub上的发光器件11和像素驱动电路12，像素驱动电路12包括多个薄膜晶体管121。薄膜晶体管121包括有源层1211、源极1212、漏极1213和栅极1214，源极1212 和漏极1213分别与有源层1211接触。沿远离衬底sub的方向，发光器件11包括依次设置的第一电极层111、发光功能层112以及第二电极层113，第一电极层111和多个薄膜晶体管121中作为驱动晶体管的薄膜晶体管的源极1212或漏极1213电连接，图2中以第一电极层111和薄膜晶体管121的源极1212电连接进行示意。
[0058]
需要说明的是，上述源极1212和漏极1213可以互换，即图2中的1212表示漏极，图2中的1213表示源极。
[0059]
在一些实施例中，发光功能层112仅包括发光层。在另一些实施例中，发光功能层112除包括发光层外，还包括电子传输层(election transporting layer，简称etl)、电子注入层(election injection layer，简称eil)、空穴传输层(holetransporting layer，
简称htl)和空穴注入层(hole injection layer，简称hil)中的至少一个。
[0060]
在一些实施例中，如图2所示，显示基板1还包括像素界定层pdl，像素界定层pdl包括多个开口区，一个发光器件15设置于一个开口区中。
[0061]
在一些实施例中，如图2所示，显示基板1还包括隔垫物ps，隔垫物ps 设置于像素界定层pdl与发光层功能层112之间。
[0062]
在一些实施例中，如图2所示，显示基板1还包括半导体层、第一栅绝缘层gi1、第一栅导电层、第二栅绝缘层gi2、第二栅导电层、层间绝缘层ild。
[0063]
如图2和图11所示，半导体层、第一栅绝缘层gi1、第一栅导电层、第二栅绝缘层gi2、第二栅导电层和层间绝缘层ild依次层叠设置于衬底sub和第一电极层111之间。
[0064]
其中，半导体层的材料包括非晶硅、单晶硅、多晶硅、或金属氧化物半导体材料；例如，半导体层act的材料包括铟镓锌氧化物(indium gallium zincoxide，igzo)、氧化锌(zno)，本公开不限于此。半导体层包括各个晶体管的有源层1211。
[0065]
第一栅导电层与半导体层交叠部分，分别形成晶体管。其中，第一栅导电层的材料包括导电金属；例如，第一栅导电层的材料包括铝、铜、钼中的至少一种，本公开不限于此。第一栅导电层包括各个晶体管的栅极235和电容器的第一极板。
[0066]
第一栅绝缘层gi1设置于半导体层和第一栅导电层之间，用于将半导体层和第一栅导电层电绝缘。其中，第一栅绝缘层gi1的材料包括氮化硅、氮氧化硅和氧化硅的无机绝缘材料中的任一种；例如，第一栅绝缘层gi1的材料包括二氧化硅，本公开不限于此。
[0067]
第二栅导电层与第一栅导电层交叠部分，形成存储电容器。其中，第二栅导电层的材料包括导电金属；例如，第二栅导电层的材料包括铝、铜、钼中的至少一种，本公开不限于此。第二栅导电层包括电容器的第二极板。
[0068]
第二栅绝缘层gi2设置于第一栅导电层和第二栅导电层之间，用于将第一栅导电层和第二栅导电层电绝缘。其中，第二栅绝缘层gi2的材料包括氮化硅、氮氧化硅和氧化硅的无机绝缘材料中的任一种；例如，第二栅绝缘层gi2的材料包括二氧化硅，本公开不限于此。
[0069]
层间介质层ild设置于第一源漏导电层sd1和第二栅导电层之间，用于将第一源漏导电层sd1和第二栅导电层电绝缘。其中，层间介质层ild的材料包括氮化硅、氮氧化硅和氧化硅的无机绝缘材料中的任一种；例如，第二栅绝缘层gi2的材料包括二氧化硅，本公开不限于此。
[0070]
其中，周边区b为不显示的区域，周边区b可以被配置为设置扫描驱动电路、电路走线和绑定引脚等。
[0071]
示例性地，如图2和图3所示，周边区b包括绑定区c，电路板20与显示基板1在绑定区c绑定电连接。详细地，衬底sub上的绑定区c设有多个绑定引脚13，电路板20上设有多个绑定电极，多个绑定电极与多个绑定引脚13对应连接，实现电路板20与显示基板1的电连接。
[0072]
需要说明的是，多个绑定引脚13包括电源引脚130、数据引脚和栅极引脚等。其中，电源引脚130用于向子像素p发光提供电源信号，数据引脚用于向像素驱动电路12写入数据信号，栅极引脚用于向扫描驱动电路200提供控制信号。
[0073]
示例性地，如图2和图3所示，显示基板1还可以包括衬底sub和设置于衬底sub上且
位于周边区b的扫描驱动电路200、源极驱动电路300、第一电压信号线vss和第二电压信号线vdd。
[0074]
此处，扫描驱动电路200可以包括用于向像素驱动电路12输入栅扫描信号 gate的栅极驱动电路，以及用于向像素驱动电路12输入发光扫描信号em的发光驱动电路。源极驱动电路300用于向像素驱动电路12输入数据信号data。第一电压信号线vss用于向发光器件11输入第一电压信号vss。第二电压信号线 vdd用于向发光器件11输入第二电压信号vdd。
[0075]
其中，第一电压信号线vss输入的第一电压信号vss的电位小于第二电压信号线vdd输入的第二电压信号vdd的电位。例如，上述电源引脚130包括第一电源引脚131和第二电源引脚132，第一电压信号线vss与第一电源引脚131 电连接，第一电源引脚131与电源的负极电连接，被配置为传输第一电压信号 vss；第二电压信号线vdd与第二电源引脚132电连接，第二电源引脚132与电源的正极电连接，被配置为传输第二电压信号vdd。
[0076]
在一些实施例中，如图3所示，第一电压信号线vss设置于周边区b，且至少部分围绕显示区a。第二电压信号线vdd设置于绑定区c与显示区a之间的周边区。
[0077]
需要说明的是，这里所描述的第一电压信号线vss围绕显示区a，并非指的是第一电压信号线vss严格意义上的完全的围绕显示区a一周。其中，第一电压信号线vss在至少围绕显示区a对应绑定区c的边界以外的其他边界即可。例如，如图3所示，第一电压信号线vss在衬底sub上的正投影大致为u 形。
[0078]
为了方便说明，本公开中上述多个子像素p是以矩阵形式排列为例进行的说明。在这种情况下，沿第一方向x排列成一排的子像素p称为同一行子像素 p；沿第二方向y排列成一列的子像素p称为同一列子像素p。其中，第一方向 x与第二方向y垂直。
[0079]
参阅图3，每一子像素p中均包括用于控制子像素p显示的像素驱动电路 12，位于同行的像素驱动电路12与同一栅扫描信号线gl及同一发光扫描信号线em耦接，位于同列的像素驱动电路12与同一数据线dl耦接。
[0080]
其中，栅扫描信号线gl用于向像素驱动电路12传输栅扫描信号gate；发光扫描信号线em用于向像素驱动电路12传输发光扫描信号em；数据线dl 用于向像素驱动电路12传输数据信号data。
[0081]
在一些实施例中，如图3所示，扫描驱动电路200可以设置在沿栅扫描信号线gl的延伸方向上的侧边，源极驱动电路300可以设置在沿数据线dl的延伸方向上的侧边。图3中以两个扫描驱动电路200分别位于栅扫描信号线gl的延伸方向上为例进行示意。
[0082]
在一些实施例中，参阅图3，上述扫描控制电路200为goa(gate driver onarray)电路，即扫描控制电路200直接集成在显示基板1中，以减小显示基板 1的边框尺寸，降低显示基板1的制作成本，实现窄边框设计。以下实施例均是以扫描控制电路200为goa电路为例进行说明。
[0083]
上述像素驱动电路12的结构包括多种，可以根据实际需要选择设置。例如，像素驱动电路12的结构可以包括“2t1c”、“3t1c”、“6t1c”、“7t1c”、“6t2c”或“7t2c”等结构。其中，“t”表示为晶体管，位于“t”前面的数字表示为晶体管的数量，“c”表示为存储电容器，位于“c”前面的数字表示为存储电容器的数量。
[0084]
本公开以采用外部补偿的方式(对驱动晶体管进行感测)，且像素驱动电路12采用“3t1c”的结构为例，对子像素p的结构及工作过程进行示意性说明。
[0085]
示例性地，如图4所示，像素驱动电路12可以包括：开关晶体管t1、驱动晶体管t2、感测晶体管t3和存储电容器cst。
[0086]
例如，如图4所示，开关晶体管t1的控制极与第一扫描信号端g1电连接，开关晶体管t1的第一极与数据信号端data电连接，开关晶体管t1的第二极与第一节点g电连接。其中，开关晶体管t1被配置为，响应于在第一扫描信号端 g1处接收的第一扫描信号，将在数据信号端data处接收的数据信号传输至第一节点g。
[0087]
例如，如图4所示，驱动晶体管t2的控制极与第一节点g电连接，驱动晶体管t2的第一极与第一电压信号端elvdd电连接，驱动晶体管t2的第二极与第二节点s电连接。其中，驱动晶体管t2被配置为，在第一节点g的电压的控制下，将在第一电压信号端elvdd处接收的来自第一电压信号线vdd(参见图3)的第一电压信号传输至第二节点s。
[0088]
例如，如图4所示，存储电容器cst的第一端与第一节点g电连接，存储电容器cst的第二端与第二节点s电连接。其中，开关晶体管t1在对第一节点 g进行充电的过程中，同时对存储电容器cst进行充电。
[0089]
例如，如图4所示，发光器件11的阳极与第二节点s电连接，发光器件11 的阴极与第二电压信号端elvss电连接。发光器件11被配置为，在来自第二节点s处的第一电压信号和第二电压信号端elvss处接收的来自第二电压信号线vss(参见图3)的第二电压信号的相互配合下，进行发光。
[0090]
例如，如图4所示，感测晶体管t3的控制极与第二扫描信号端g2电连接，感测晶体管t3的第一极与第二节点s电连接，感测晶体管t3的第二极与感测信号端sense电连接。其中，感测晶体管t3被配置为，响应于在第二扫描信号端g2处接收的第二扫描信号，检测驱动晶体管t2的电特性以实现外部补偿。该电特性例如包括驱动晶体管t2的阈值电压和/或载流子迁移率。
[0091]
此处，感测信号端sense可以提供复位信号或获取感测信号，其中，复位信号用于在显示时段对第二节点s进行复位，获取感测信号用于在消隐时段获取驱动晶体管t2的阈值电压。
[0092]
相关技术中，第一电压信号线vss直接环绕设置于显示面板的周边区，发光器件的阴极由显示区延伸至周边区，且与位于周边区的第一电压信号线连接。
[0093]
然而，对于中大尺寸的显示面板而言，第一电压信号线vss走线长度也较长，第一电压信号线vss产生的压降(ir-drop)也较大，从而导致显示面板出现了能耗较大及温升较快的问题，无法满足客户要求。
[0094]
基于此，在本实用新型的一些实施例所提供的显示基板1中，参阅图1和图5，周边区b包括第一边框区b1、第二边框区b2、第三边框区b3和第四边框区b4。如图1和图5所示，沿第一方向x，第一边框区b1和第三边框区b3 位于显示区a相对的两侧。沿第二方向y，第二边框区b2和第四边框区b4位于显示区a相对的两侧。其中，上述绑定区c位于第一边框区b1。
[0095]
需要说明的是，第一边框区b1、第二边框区b2、第三边框区b3和第四边框区b4外轮廓的形状并不限于矩形，还包括其他形状，例如，第一边框区b1、第二边框区b2、第三边框区b3和第四边框区b4围成环形，每个边框区为环形的一段，本公开在此不做具体限定。
[0096]
参阅图1、图2和图5，第二电极层113由显示区a延伸至周边区b。第一电压信号线vss包括第一走线vss1和第二走线vss2，第一走线vss1和第二走线vss2并行设置，且至少位
于第二边框区b2、第三边框区b3和第四边框区b4，且第一走线vss1和第二走线vss2的两端均延伸至第一边框区b1，移接收第一电压信号vss。
[0097]
其中，第一走线vss1在显示区a的周侧(包括第二边框区b2、第三边框区b3和第四边框区b4)均与第二电极层113连接，第二走线vss2在第三边框区b3与第二电极层113连接和/或与第一走线vss1连接，且第二走线vss2在第二边框区b2和第四边框区b4的部分，与第二电极层113及第一走线vss1 分离。
[0098]
也就是说，第二走线vss2位于第三边框区b3的部分，通过与第二电极层 113电接触，从而与第一走线vss1电连接；或与第一走线vss1直接电接触。
[0099]
在这种情况下，第二走线vss2仅位于第三边框区b3的部分与第二电极层 113直接电连接。这样，在第一电压信号vss由第一边框b1沿着第二走线vss2 传输至第三边框区b3的过程中，第一电压信号vss经过第二走线vss2位于第二边框区b2和第四边框区b4的部分所产生的压降较低，也即，传输至第二走线vss2位于第三边框区b3的部分的第一电压信号vss的电压下降较小；并且由于vss2在上边框与vss1电连接，因此，第二走线vss2可以在第三边框区 b3处对第一走线vss1的压降进行补偿，从而使得第一电压信号线vss整体产生的压降下降，从而降低能耗，减缓温升。
[0100]
其中，上述第一走线vss1和上述第二走线vss2的相对位置关系并不唯一。
[0101]
示例性地，如图5所示，第二走线vss2设置于第一走线vss1和显示区a 之间，即第一走线vss1环绕在第二走线vss2的外侧，第二电极层113在衬底 sub上的正投影与第二走线vss2在衬底sub上的正投影至少部分重叠；例如，第二电极层113在衬底sub上的正投影，完全覆盖第二走线vss2在衬底sub 上的正投影。
[0102]
示例性地，如图6所示，第一走线vss1设置于第二走线vss2和显示区a 之间，即第二电极层113在衬底sub上的正投影与第二走线vss2在衬底sub 上的正投影之间具有间距。
[0103]
为了便于说明，下面以上述第二走线vss2设置于第一走线vss1和显示区 a之间为例，对本公开的一些实施例进行示意性说明。
[0104]
在一些实施例中，如图5所示，上述扫描控制电路200设置于第一电压信号线vss和显示区a之间。以这种方式设置，第一电压信号线vss可以起到信号屏蔽的作用，以降低扫描控制电路200受到其他电子器件的电磁干扰。
[0105]
在另一些实施例中，如图6所示，上述扫描控制电路200设置于第一走线 vss1和第二走线vss2之间。此时，第一走线vss1和第二走线vss2均可以起到信号屏蔽的作用，从而降低扫描控制电路200受到其他电子器件的电磁干扰。
[0106]
在一些实施例中，参阅图7和图11，上述显示基板1还包括设置于衬底sub 和第二电极层113之间的至少一个导电层140。至少一个导电层140所包括的膜层可以参考下文，本公开在此不做赘述。
[0107]
参阅图7和图11，第一走线vss1包括至少一个第一走线图案141，每个第一走线图案141位于至少一个导电层140中的一者。在第一走线vss1包括多个第一走线图案141的情况下，多个第一走线图案141沿垂直于衬底sub的方向叠置且连接。
[0108]
其中，在第一走线vss1包括多个第一走线图案141的情况下，显示基板1 包括多个导电层140，多个导电层140之间设有用于电隔离多个导电层140的绝缘膜层，用于电隔离多个导电层140的绝缘膜层可以参考下文，本公开在此不做赘述。这里，多个第一走线图案141
沿垂直于衬底sub的方向叠置且连接，可以是多个导电层140之间的绝缘膜层之间设有过孔，多个第一走线图案141 在该过孔处叠置，并通过接触形成电连接。
[0109]
在一些实施例中，如图8、图9和图10所示，上述至少一个导电层140包括第一源漏导电层sd1和/或第一电极层111。
[0110]
示例性地，上述至少一个导电层140包括第一源漏导电层sd1和第一电极层111，第一电极层111位于第一源漏导电层sd1和第二电极层113之间，第一源漏导电层sd1位于层间绝缘层ild远离衬底sub的一侧。其中，结合图2，第一源漏导电层sd1包括薄膜晶体管121的源极1212和漏极1213。
[0111]
如图8、图9和图10所示，第一走线vss1可以包括沿垂直于衬底sub的方向叠置的两个第一走线图案141，两个第一走线图案141分别位于第一源漏导电层sd1和第一电极层113，且两个第一走线图案141叠置形成电连接。
[0112]
需要说明的是，参阅图8、图9和图10，显示基板1还包括设置于第一源漏导电层sd1和第一电极层113之间的第一平坦层pln1。此时，第一平坦层 pln1上设有过孔，两个第一走线图案141在该过孔处叠置，并通过接触形成电连接。
[0113]
其中，每个第一走线图案141至少设置于第二边框区b2、第三边框区b3 和第四边框区b4，例如，每个第一走线图案141设置于第二边框区b2、第三边框区b3、第四边框区b4和第一边框区b1中绑定区c以外的区域。位于第一电极层111的第一走线图案141与第二电极层113连接。以这种方式设置，第一走线vss1的横截面积较大，电阻较小，可以降低第一走线vss1的所产生的irdrop。
[0114]
需要说明的是，发光功能层112仅设置于显示区a，且像素界定层pdl对应第一电极层111的第一走线图案141处设有避让开口，使得位于第一电极层 111的第一走线图案141与第二电极层113可以直接接触形成电连接。
[0115]
在一些实施例中，显示基板1还包括第二源漏导电层sd2，上述至少一个导电层140包括第一源漏导电层sd1、第二源漏导电层sd2和第一电极层111 中的至少一者。
[0116]
示例性地，如图8、图9和图10所示，上述至少一个导电层140包括第一源漏导电层sd1、第二源漏导电层sd2和第一电极层111，第二源漏导电层sd2 位于第一源漏导电层sd1和第一电极层111之间。其中，第二源漏导电层sd2 包括连接电极150(参见图2)、初始化信号线151(参见图2)和辅助信号线中的至少一者，本公开不限于此。
[0117]
参阅图11～图14，第一走线vss1包括沿垂直于衬底sub的方向叠置的三个第一走线图案141，三个第一走线图案141分别位于第一源漏导电层sd1、第二源漏导电层sd2和第一电极层113，且三个第一走线图案141叠置形成电连接。
[0118]
需要说明的是，参阅图11～图14，显示基板1还包括设置于第一源漏导电层sd1和第二源漏导电层sd2之间的第一平坦层pln1，以及设置于第二源漏导电层sd2和第一电极111之间的第二平坦层pln2。此时，第一平坦层pln1 和第二平坦层pln2上均设有过孔，且第一平坦层pln1上设有的过孔与第二平坦层pln2上设有的过孔至少部分重合，例如完全重合。这样的话，三个第一走线图案141可以在过孔处叠置，并通过接触形成电连接。
[0119]
其中，每个第一走线图案141至少设置于第二边框区b2、第三边框区b3 和第四边框区b4，例如，每个第一走线图案141设置于第二边框区b2、第三边框区b3、第四边框区b4和第一边框区b1中绑定区c以外的区域。其中，位于第一电极层111的第一走线图案141与第二
电极层113连接。以这种方式设置，第一走线vss1的横截面积较大，电阻较小，可以降低第一走线vss1的所产生的ir drop。
[0120]
需要说明的是，发光功能层112仅设置于显示区a，且像素界定层pdl对应第一电极层111的第一走线图案141处设有避让开口，使得位于第一电极层 111的第一走线图案141与第二电极层113可以直接接触形成电连接。
[0121]
参阅图7和图11，第二走线vss2包括至少一个第二走线图案142，每个第二走线图案142位于至少一个导电层140中的一者。在第二走线vss2包括多个第二走线图案142的情况下，多个第二走线图案142沿垂直于衬底sub的方向叠置且连接。
[0122]
其中，在第二走线vss2包括多个第二走线图案142的情况下，显示基板1 包括多个导电层140，多个导电层140之间设有用于电隔离多个导电层140的绝缘膜层，用于电隔离多个导电层140的绝缘膜层可以参考下文，本公开在此不做赘述。这里，多个第二走线图案142沿垂直于衬底sub的方向叠置且连接，可以是多个导电层140之间的绝缘膜层之间设有过孔，多个第二走线图案142 在该过孔处叠置，并通过接触形成电连接。
[0123]
在一些实施例中，如图8、图9和图10所示，上述至少一个导电层140包括第一源漏导电层sd1和/或第一电极层111。
[0124]
示例性地，上述至少一个导电层140包括第一源漏导电层sd1和第一电极层111，第一电极层111位于第一源漏导电层sd1和第二电极层113之间，第一源漏导电层sd1位于层间绝缘层ild远离衬底sub的一侧。其中，结合图2，第一源漏导电层sd1包括薄膜晶体管121的源极1212和漏极1213。
[0125]
参阅图8和图10，第二走线vss2可以包括沿垂直于衬底sub的方向叠置的两个第二走线图案142，两个第二走线图案142分别位于第一源漏导电层sd1 和第一电极层113，且两个第二走线图案142叠置形成电连接。
[0126]
需要说明的是，参阅图8和图10，显示基板1还包括设置于第一源漏导电层sd1和第一电极层113之间的第一平坦层pln1。此时，第一平坦层pln1上设有过孔，两个第二走线图案142在该过孔处叠置，并通过接触形成电连接。
[0127]
其中，位于第一源漏导电层sd1的第二走线图案142至少设置于第二边框区b2、第三边框区b3和第四边框区b4，例如，位于第一源漏导电层sd1的第二走线图案142设置于第二边框区b2、第三边框区b3、第四边框区b4和第一边框区b1中绑定区c以外的区域。
[0128]
位于第一电极层111的第二走线图案142至少设置于第三边框区b3，例如，位于第一电极层111的第二走线图案142仅设置于第三边框区b3。其中，位于第一电极层111的第二走线图案142在第三边框区b3与第二电极层113连接。以这种方式设置，第二走线vss2位于第三边框区b3的横截面积较大，电阻较小，可以降低第二走线vss2所产生的ir drop。
[0129]
需要说明的是，发光功能层112仅设置于显示区a，且像素界定层pdl对应位于第一电极层111的第二走线图案142处设有避让开口，使得位于第一电极层111的第二走线图案142在第三边框区b3与第二电极层113可以直接接触形成电连接。
[0130]
参阅图8和图9，第二走线vss2还可以仅包括一个第二走线图案142，第二走线图案142位于第一源漏导电层sd1。
[0131]
其中，第二走线图案142至少设置于第二边框区b2、第三边框区b3和第四边框区b4，例如，位于第一源漏导电层sd1的第二走线图案142设置于第二边框区b2、第三边框区
b3、第四边框区b4和第一边框区b1中绑定区c以外的区域。第二走线图案142在第三边框区b3与位于第一源漏导电层sd1的第一走线图案141连接。以这种方式设置，第二走线vss2的制备工艺简单，制备成本较低。
[0132]
在一些实施例中，显示基板1还包括第二源漏导电层sd2，上述至少一个导电层140包括第一源漏导电层sd1、第二源漏导电层sd2和第一电极层111 中的至少一者。
[0133]
示例性地，如图8、图9和图10所示，上述至少一个导电层140包括第一源漏导电层sd1、第二源漏导电层sd2和第一电极层111，第二源漏导电层sd2 位于第一源漏导电层sd1和第一电极层111之间。其中，第二源漏导电层sd2 包括连接电极150(参见图2)、初始化信号线151(参见图2)和辅助信号线中的至少一者，本公开不限于此。
[0134]
参阅图11、图12和图13，第二走线vss2可以包括沿垂直于衬底sub的方向叠置的三个第二走线图案142，三个第二走线图案142分别位于第一源漏导电层sd1、第二源漏导电层sd2和第一电极层113，且三个第二走线图案142叠置形成电连接。
[0135]
需要说明的是，参阅图11、图12和图13，显示基板1还包括设置于第一源漏导电层sd1和第二源漏导电层sd2之间的第一平坦层pln1，以及设置于第二源漏导电层sd2和第一电极111之间的第二平坦层pln2。此时，第一平坦层pln1和第二平坦层pln2上均设有过孔，且第一平坦层pln1上设有的过孔与第二平坦层pln2上设有的过孔至少部分重合。这样的话，三个第二走线图案 142可以在过孔处叠置，并通过接触形成电连接。
[0136]
其中，位于第一源漏导电层sd1的第二走线图案142，以及位于第二源漏导电层sd2的第二走线图案142，均至少设置于第二边框区b2、第三边框区b3 和第四边框区b4，例如，位于第一源漏导电层sd1的第二走线图案142，以及位于第二源漏导电层sd2的第二走线图案142，均设置于第二边框区b2、第三边框区b3、第四边框区b4和第一边框区b1中绑定区c以外的区域。
[0137]
位于第一电极层111的第二走线图案142至少设置于第三边框区b3，例如，位于第一电极层111的第二走线图案142仅设置于第三边框区b3。其中，位于第一电极层111的第二走线图案142在第三边框区b3与第二电极层113连接。以这种方式设置，第二走线vss2位于第三边框区b3的横截面积较大，电阻较小，可以降低第二走线vss2所产生的ir drop。
[0138]
需要说明的是，发光功能层112仅设置于显示区a，且像素界定层pdl对应位于第一电极层111的第二走线图案142处设有避让开口，使得位于第一电极层111的第二走线图案142在第三边框区b3与第二电极层113可以直接接触形成电连接。
[0139]
参阅图11和图14，第二走线vss2还可以包括沿垂直于衬底sub的方向叠置的两个第二走线图案142，两个第二走线图案142分别位于第一源漏导电层 sd1和第二源漏导电层sd2。
[0140]
其中，每个第二走线图案142至少设置于第二边框区b2、第三边框区b3 和第四边框区b4。其中，位于第一源漏导电层sd1的第一走线图案141和第二走线图案142在第三边框区b3连接；和/或，位于第二源漏导电层sd2的第一走线图案141和第二走线图案142在第三边框区b3连接。
[0141]
如上所述，第一走线vss1和第二走线vss2中，至少一个第一走线图案 141和至少一个第二走线图案142可以位于同一导电层140。在这种情况下，参阅图7和图8，在第二边框区b2和第四边框区b4，位于同一导电层140的第一走线图案141和第二走线图案142间隔设
置。参阅图7和图9，在第三边框区 b3，位于同一导电层140的第一走线图案141和第二走线图案142连接。或者，参阅图7和图10，在第三边框区b3，位于同一导电层140的第一走线图案141 和第二走线图案142间隔设置，且第二走线vss2中最远离衬底sub的一个第二走线图案142与第二电极层113连接。
[0142]
其中，在第三边框区b3，第二走线vss2的设定线段160与第二电极层113 连接和/或与第一走线vss1连接。
[0143]
在一些实施例中，如图5和图13所示，设定线段160的长度等于第二走线 vss2中位于第三边框区b3的部分的长度。在这种情况下，第二走线vss2与第二电极层113和/或与第一走线vss1连接的区域较大，电阻较小。在另一些实施例中，如图7所示，第二走线vss2包括多个设定线段160，多个设定线段 160沿第三边框区b3间隔设置。
[0144]
在一些实施例中，如图5所示，第一走线vss1和第二走线vss2在绑定区 c分别与不同的第一电源引脚131连接。
[0145]
在另一些实施例中，如图1和图7所示，显示基板1还包括设置于第一边框区b1的电源连接线110，第一走线vss1和第二走线vss2在第一边框区b1 与电源连接线110连接，电源连接线110与第一电源引脚131连接。
[0146]
为了证明上述显示基板1的第一电压信号线vss的ir drop较低，下面对本公开实施例获得的显示基板1进行性能测试，以下说明仅用于解释本公开实施例所提供的显示基板1的有益效果，不在于限定显示基板1的具体参数。
[0147]
将上述实施例的尺寸为15寸的显示基板1及相关技术中的尺寸为15寸的显示基板1进行对比测试，测试结果见表1。
[0148]
表1
[0149] 相关技术实施例1实施例2vss1宽度/μm230019001500vss2宽度/μm0400800vss ir drop/v1.921.831.71
[0150]
由表1可知，在第一电压信号线vss的总宽度不变的情况下，实施例1相较于相关技术，其第一电压信号线vss的ir drop下降了0.09v；实施例2相较于相关技术，其第一电压信号线vss的ir drop下降了0.21v。因此，本公开实施例提供的显示基板1，可以降低第一电压信号线vss的ir drop，从而降低显示面板10的能耗以及减缓显示面板10的温升。
[0151]
以上所述，仅为本公开的具体实施方式，但本公开的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本公开揭露的技术范围内，想到变化或替换，都应涵盖在本公开的保护范围之内。因此，本公开的保护范围应以所述权利要求的保护范围为准。