本发明一般涉及负载开关，并且更具体地涉及负载开关中的栅极电容的控制。
背景技术：
一些负载开关使用外部电容器，该外部电容器直接连接到电源开关的栅极，以控制上升时间和到栅极的浪涌电流。在开关断开时，输入供电电源用于为一电路供电，该电路使外部电容器放电以准备下一个导通时间。当输入供电电源下降而开关导通时，不存在电力来使外部电容器放电。这种情况导致两个问题：(a)当外部电容器没有放电时，由于高栅极/源极电压vgs，控制输出电压的晶体管中的栅极氧化物可靠性问题；和(b)当输入电源再次上升时，输出电压中会出现不受控制的输出或尖峰，可能导致下游的问题。
技术实现要素：
示例实施例提供了电路系统以在晶体管完全导通之后，将外部电容器与控制vout的晶体管的栅极断开。然后在开关仍然导通时使电容器放电。
在用于控制供电电源的开关的一个实施例中，开关包括：第一晶体管，其具有连接在vin和vout之间的漏极和源极以及经连接以被驱动至大于vin的第一电压的栅极；外部电容器，其在连接到第一晶体管的栅极时，可操作以控制vout的上升时间；以及耦合到第一晶体管的栅极并且耦合到外部电容器的电路，该电路经连接以响应于使能信号导通而将外部电容器耦合到第一晶体管的栅极并且响应于栅极上的电压达到第一电压而将外部电容器与第一晶体管的栅极去耦合。
在操作负载开关的方法的一个实施例中，该方法包括响应于on(通)引脚变高，将外部栅极电容器耦合到选择性地连接vin和vout的晶体管的栅极；以及响应于栅极达到大于vin的给定电压，将外部栅极电容器与晶体管的栅极去耦合。
附图说明
图1描绘了根据一个实施例的与负载开关相关联的vgate、vct和vout信号的期望响应。
图2描绘了根据一个实施例的可以实现图1的期望输出的负载开关。
图2a描绘了包括图2的电路的芯片。
图3说明了在1v的示例输入电压下的图1的实施例的仿真信号。
图4a-图4b说明了在5.5v的示例输入电压和两个不同放大率下图1的实施例的仿真信号。
图5描绘了所描述的开关的一个实施例的测量信号。
图6描绘了根据一个实施例的操作负载开关的方法的流程图。
图7a描绘了传统负载开关的示意图。
图7b说明了与图7a的负载开关相关联的各种信号。
图8说明了当输入功率下降而开关导通时可能出现的问题。
图9a-图9c描绘了与输入功率下降相关联的问题的传统解决方案的示意图。
具体实施方式
在附图中，相同的参考标记表明类似的元件。在本说明书中，阐述了许多具体细节以提供更透彻的理解，但是可以在没有这些具体细节的情况下实践实施例。在其他实例中，未详细描述已知特征以避免不必要地使描述复杂化。
在本说明书中：(a)“耦合”可用于表明可以是或可以不是彼此直接物理或电接触的两个或多个元件相互合作或相互作用；以及b)“连接”可以用于表明在彼此耦合的两个或多个元件之间通信的建立，即通信关系。通常，在一个或更多个示例实施例中，如果元件、组件或模块能够执行或以其他方式在结构上经布置以执行功能，那么元件、组件或模块可以经配置以执行该功能。
负载开关是用于导通和断开电源轨的集成电路继电器。图7a示出了已知的示例性负载开关700的示意性框图。nmos晶体管m1是负载开关700的主要部件，并连接在输入信号vin和输出信号vout之间。m1的特性确定了负载开关700可以处理的最大输入电压和负载电流，以及负载开关的导通电阻，其用于计算负载开关700消耗的功率。
驱动器708以受控速率对m1的栅极充电，该受控速率由外部电容器cext的电容确定。该受控速率定义了器件的上升时间。为了在开关导通时在vin和vout之间具有低电阻，希望将m1的栅极驱动至高于vin的给定电压vgv。(vin+vgv)被确定为能够在m1上提供最低电阻而不会对m1造成损坏的电压。在一个传统的负载开关中，vgv被确定为等于7伏。电荷泵706用于从vin产生该较高电压，并且将该较高电压提供给驱动器708。
在m1的栅极已经被充电到vin+vgv之后，期望将振荡器704和电荷泵706置于休眠模式以提供低功率操作。电荷状态检测器(soc_detector)716将栅极电压vgate与vout+vgv进行比较，并在vgate较大时提供休眠信号718。在一个示例实施例中，soc_detector716在vgate>vin+7v时提供休眠信号。提供控制逻辑的导通缓冲器(on-buffer)710由外部逻辑信号on驱动，该外部逻辑信号on控制通过fet(passfet)和其他块的导通和断开。偏置电路712在必要时提供偏置电流。
放电电路714连接在fetm1的栅极和接地电压之间，以便使m1的栅极和电容器cext两者放电。当信号on指示开关将导通时，放电电路714接收使能信号(en)。反相器720将使en反相以驱动nmos晶体管mgpd，使得当外部逻辑信号on被断开时，晶体管mgpd导通并且使外部电容器cext放电。
图7b公开了在正常操作期间负载开关700上的信号的仿真。在初始状态下，输入电压vin为高，而所有其他信号为低。在时间t1，on信号变高并且驱动器708开始对nmos晶体管m1的栅极充电，导致vgate(也是vct)开始上升。最初，栅极电压上升，但输出电压vout保持低，直到达到nmos晶体管m1的阈值电压，此时vout开始以受控速率上升直到它达到vin。在所示的示例中，vct将继续上升，直到它达到vin+vgv，以在m1的两端提供低导通电阻。在vout已经稳定且vct已经达到vin+vgv之后的时间t2，触发休眠信号718，振荡器704和电荷泵706进入休眠，并且栅极电压vct停止上升。
图8公开了当vin下降而on信号仍然为高时，负载开关700上的信号的仿真，其导致了不期望的后果。如图8所示，von在时间t3导通。在此之后，vct开始上升，并且一旦已经达到m1上的阈值电压，vout也开始上升。在vout已经到达vin后，vin在时间t4下降。vout下降至零，但vct不能被完全放电，因为不存在供电电源来操作放电电路714，因此vct保持残余电压vres。过量的vgs(其等于vres)导致在vin＝0v时主开关的可靠性问题。在时间t5，on开关断开，并且在时间t6，vin恢复。在电力恢复之后，放电电路714能够使vct放电，但是在栅极电压可以放电之前，vout开始导通，导致在vout中被圈出的尖峰。
图9a说明了这些问题的一种传统解决方案，其使用双供电电源902来提供另一电源，其在图9a中标记为到负载开关904的vbias，负载开关904包括具有晶体管m1a和m1b的双负载开关。vbias用于为控制电路系统供电。然而，该解决方案增加了引脚计数和用于该实施方式所需的面积，这两者都对解决方案的成本和便利性产生不利影响。
图9b说明了第二传统解决方案，其修改负载开关以防止损坏栅极。图9b与图7a大致相同，除了在晶体管m1的栅极和源极之间添加了钳位电路912以确保m1的vgs不上升到选定值以上。在vgv＝7伏特的一个示例实施例中，当vgs变得大于7.1v(即大于vgv)时，钳位电路912将放电，并且将使vgs放电至7.1v，但不会使电容器完全放电。因此，虽然钳位电路可以防止来自过高vgs的损坏，但是钳位电路912不能防止vout上的凸起(bump)并且不会使vgs归零。另一个问题是添加钳位电路可能在电路的处理期间需要额外的掩模。此外，钳位在ic工艺、电压和温度的某些组合下可能会有些活跃，从而导致在这些情况下静态电流(当使能器件和输出无负载时消耗的电流)和导通电阻(ron)的增加，其降低开关器件的性能。尽管静态电流应该保持尽可能的低，但是负载开关通常具有一些静态电流以提供输入电压两端的低的ron。ct引脚处的最大电压等于vin_max+vclamp。
图9c说明了对负载开关的进一步的传统修改以防止损坏栅极。为了在没有vin的情况下断开开关，低通滤波器被添加到放电电路918。包括电容器cflt和电阻rflt的低通滤波器将保持电压vstr，直到放电电路918被激活(即，当on开关被断开时)，此时所存储的电压用于给放电电路918供电足够长的时间以使vct放电。当外部电容器cext是低电容时，此方法很好地工作，但是此方法不能用于ct引脚处的大的外部电容，因为这将需要更大的面积用于电容器cflt，由于增加了成本，所以对于这种电路此方法是不期望的。
图1说明了与负载开关的期望响应相关联的许多信号。在vout达到vin之后，外部电容器已经完成其功能并且不再被需要，因此电容器可以在开关仍然导通时放电。如图表100所示，在时间t1，vgate和vct开始上升，当on开关变高并且在t2时，vout也开始上升。vgate和vct继续一起上升，直到vout在时间t3达到vin为止，此时可以区别对待vgate和vct这两个电压。如图所示，这两个电压分开，其中vgate快速上升直到它达到用于m1的低ron的设计电压，而与外部电容器相关联的vct放电。当在时间t4失去(lost)vin，vgate也放电到零电压。在外部电容器和m1的栅极两者都放电之后，vin的恢复不会导致vout上的尖峰，因为栅极没有过量电荷。允许vgate和vct分开的时间可以基于slp_latch，其是图7a中的sleep信号的锁存版本。在这种情况下，当on开关在t5变低，然后在t6恢复vin时，在vout上没有出现尖峰。
图2示出了根据一个实施例的负载开关的简化电路图。尽管如图7a所示的负载开关的其他元件在图2中并未示出，但是为了强调所描述的电路，图2仅示出了驱动器208、晶体管m1和与外部电容器耦合的ct引脚。在负载开关200中，引脚ct和外部电容器cext不直接连接到晶体管m1的栅极；相反，这些元件由子电路203的晶体管mn1分开，其中mn1的漏极连接到m1的栅极，且mn1的源极连接到引脚ct。晶体管mn1的栅极由电压vz控制，电压vz由电路202提供。电路202从电荷泵接收电压vcp，且在该实施例中包括串联连接的电流源cs、齐纳二极管z1、z2、z3和nmos晶体管mn4。nmos晶体管mn2具有通过反相器204耦合到电压vz的栅极，耦合到引脚ct的漏极和耦合到低(电压)轨的源极。nmos晶体管mn3具有连接到电压vz的漏极，连接到低(电压)轨的源极和由slp_latch控制的栅极。
当slp_latch为低时，晶体管mn3断开/截止，允许电压vz保持为高，这导通晶体管mn1。由于晶体管mn1导通，引脚ct上的电压与vgate相同。如果slp_latch触发至高电平，则晶体管mn3导通，将vz拉至接地并断开晶体管mn1。当mn1断开时，引脚ct与m1的栅极去耦合。与此同时，在mn1导通时已经断开的mn2现在将导通并使外部电容器cext放电。当sleep信号再次变低时，引脚ct将再次连接到晶体管m1的栅极。所描述的实施例中的晶体管被说明为nmos晶体管，但是该电路也可以用其他技术实现，例如双极结型晶体管或pmos晶体管。在大的外部电容器cext的充电不再是问题之后，使来自具有较小电容的内部栅极的残余电压放电可以由内部放电模块来处理，该内部放电模块由存储电容器(例如图9c中的电路)供电。图2a示出了芯片210，其将负载开关200和内部放电模块218结合到较初期芯片的电路系统中。
为了使电路按预期工作，应当为电压vz选择适当的值。vz应大于最大的组合(vin+m1的vth+mn1的vth)，以确保在最大vin时mn1导通。超过该最小电压，希望保持vz的值为低，因为电路上的较高电压通常需要部件之间的较宽的间距，导致硅面积的增加。此外，vct限于(vin+vgv)和(vz-mn1的vth)中的较小者。这些限制中的后者是因为高于该值时mn1的钳位操作，该钳位操作是因为(vz-mn1的vth)小于(vin+vgv)而发生的，并且如下文所述在一些实施例中可能是有用的。vin+vgv是触发slp_latch的电压，其将ct引脚与m1的栅极分开。由于该实施例中对于vct的限制可以小于传统电路中所必需的电压，因此这允许与该电路一起使用的低电压外部电容器和低电压静电放电(esd)单元。
在图3和图4a-图4b中示出了所描述的电路的不同仿真实施例的两个示例。图3描绘了与图2的负载开关200相关联的信号的仿真，其中vin的值＝1v，外部电容器上的电容为10nf，在vin+2.75v时触发sleep，并且vz＝5v。如图表300底部所示，和vz一样，on开关在时间0.0时导通，并且vgate和vct两者一起上升。在大约3ms时，vout也开始上升，直到vout达到vin的值并且稳定。vgate和vct继续上升直到大约26ms，此时slp_latch变高，因为vgate变得大于vin+2.75v。vct与vgate断开，并在几毫秒内放电。
图4a描绘了一个仿真，其中vin为5.5v，vz为8v并且在vin+2.0v时触发sleep信号；电容保持在10nf。信号如前面的示例那样响应，直到vct达到7v，此时晶体管mn1被钳位(mn1的vth等于1v)并且vct停止上升。在图4a中被圈出的该时间点的信号在图4b中被放大，以使信号更清晰。如图4b所示，随着vct停止上升，外部电容器不再抑制/压制vgate的上升时间，然后vgate是非常快地自由上升。因为vout已经稳定在5.5v，所以这不是问题。当slp_latch在时间为48.2ms时变为高时，vct在十分之几毫秒内放电。通过设置vz使得(vz-mn1的vth)<(vin+vsoc_detect)，vct可以低于此负载开关的传统版本，允许选择低电压外部电容器。
图5示出了测试期间的信号on、vin、vct和vout，其在该实施例中处于vin等于5.0v。所有四个信号被示出为彼此叠加，使得它们的关系易于看到。在区域502中示出了在on仍然为高时vin的失去。当在区域504处重新获得vin时，vout没有凸起，并且vct已经放电。
图6描绘了操作负载开关的方法的流程图。方法600在600a中开始，确定(605)on引脚是否已经变高。如果引脚不为高，则负载开关处于等待模式，但是如果on引脚已经变高，则该方法将外部电容器耦合(610)到选择性地连接vin和vout的晶体管的栅极。随着栅极充电，该方法确定(615)栅极是否已经达到大于vin的给定(即预定)电压。如果栅极未达到给定电压，则电路继续对栅极充电；否则，该方法将外部栅极电容器与晶体管的栅极去耦合(620)。该方法在600b中继续，将外部栅极电容器连接(625)到低(电压)轨。负载开关将继续在600c处正常操作，同时该方法确定(630)on引脚是否已经变低。在引脚变为低之后，该方法例如通过使用如图2a所示的存储的电容器使晶体管的栅极放电(635)。
在示例实施例中，负载开关及其操作方法可以提供以下优点中的一个或更多个：
●当开关导通而失去vin时，防止损坏开关晶体管的栅极氧化物；
●当vin恢复时，防止vout上出现不受控制的凸起；
●无需额外的引脚；
●ct引脚上的低电压；
●由于ct引脚上的低电压，减少了所需的电路板面积；和
●对外部电容器的电容没有限制。
在本说明书中，除非明确地陈述，否则对单数元件的引用并不意味着“一个且仅一个”，而是“一个或更多个”。
在权利要求的范围内，在所描述的实施例中，修改是可能的，并且其他实施例也是可能的。