基于fpga的逻辑画面叠加装置及方法_2

文档序号:8923568阅读:来源:国知局
据RGB画面时序产生模块产生的RGB同步信号将所要得到某一行中的某一个像素的信息通过RGB画面输出模块传输给图像存储控制模块,所述RGB同步信号包括视频帧同步信号、视频行同步信号和视频数据有效信号,图像存储控制模块则从DDR存储器模块中取出该像素对应的颜色值,图像存储控制模块将该对应的颜色值传输给RGB画面输出模块,RGB画面输出模块将接收到的对应颜色值和RGB同步信号中的视频数据有效信号同步到一起,从而产生并行的RGB图像信号输出;
[0021]步骤11,多传输链路低电压差分信号传输模块将并行的RGB图像信号根据上层接口模块输送过来的LVDS传输编码控制信号进行编码和输出颜色位宽设置,再根据上层接口模块输送过来的LVDS传输链路数控制信号进行相应的LVDS传输调制串化处理,使得输出为标准的图像LVDS传输链路信号在各个对应的传输链路上输出给待测液晶模组。
[0022]本发明的有益效果在于:
[0023]1、本发明可通过上层软件配置来实现不同的逻辑画面显示功能,可通过上层软件配置的各种画面的关键参数,来显示各种类型的逻辑画面。很好的满足了高分辨率液晶显示模组检测的要求。
[0024]2、本发明通过上层软件配置可适应不同分辨率的模组,显示大小可最小为I个像素的图案。
[0025]3、本发明自身可实现常用的逻辑画面类型,如渐变类、放射类、矩形类、三角形类、圆形类、点和线类等逻辑画面,并可通过扩展逻辑画面接口连接到不同的扩展逻辑画面功能设备上来产生其他类型的逻辑画面图案。
[0026]4、本发明可进行逻辑画面的叠加功能,即将不同的已实现的逻辑画面叠加到一起形成新的更复杂的逻辑画面,如矩形里内接圆形;三角形里有虚线填充等。这样能满足高分辨率液晶显示模组的各种检测要求。使得高分辨率液晶显示模组的检测结果更加真实准确。
[0027]5、本发明可通过用FPGA芯片来实现所述功能,技术方案实现容易,而且实现成本较低,且工作稳定。
【附图说明】
[0028]图1为本发明中的结构框图。
[0029]其中,I一上层接口模块、2 —图像参数缓存模块、3 —图像参数转换模块、4一逻辑画面叠加控制模块、5—液晶模组、6—逻辑画面产生模块、7 —图像产生控制模块、8—图像存储控制模块、9一DDR存储器模块、10 — RGB画面输出模块、11 一RGB画面时序产生模块、12—外部逻辑画面功能扩展卡、13—多传输链路低电压差分信号传输模块、14 一基本逻辑画面功能模块。
【具体实施方式】
[0030]以下结合附图和具体实施例对本发明作进一步的详细说明:
[0031]如图1所述的基于FPGA的逻辑画面叠加装置,它包括上层接口模块1、图像参数缓存模块2、图像参数转换模块3、逻辑画面叠加控制模块4、逻辑画面产生模块6、图像产生控制模块7、图像存储控制模块8、RGB画面输出模块10、RGB画面时序产生模块11和多传输链路低电压差分信号传输模块13 ;
[0032]其中,所述上层接口模块I的逻辑画面参数输出端连接图像参数缓存模块2的信号输入端,图像参数缓存模块2的信号输出端连接图像参数转换模块3的逻辑画面缓存参数输入端,所述图像参数转换模块3的逻辑画面参数及控制命令输出端分别连接逻辑画面叠加控制模块4和逻辑画面产生模块6的信号输入端,逻辑画面叠加控制模块4和逻辑画面产生模块6的信号输出端连接图像产生控制模块7的图像数据输入端,图像产生控制模块7的信号输出端连接图像存储控制模块8的信号输入端,图像存储控制模块8的通信端连接RGB画面输出模块10的通信端,RGB画面时序产生模块11的RGB同步信号输出端连接RGB画面输出模块10的RGB同步信号输入端,所述RGB画面输出模块10的RGB图像信号输出端连接多传输链路低电压差分信号传输模块13的RGB图像信号输入端,多传输链路低电压差分信号传输模块13的LVDS视频信号输出端用于连接待测液晶模组5 ;
[0033]所述上层接口模块I的LVDS传输编码控制信号输出端、模组显示色阶位宽控制信号输出端和LVDS传输链路数控制信号输出端分别连接多传输链路低电压差分信号传输模块13对应的LVDS传输编码控制信号输入端、模组显示色阶位宽控制信号输入端和LVDS传输链路数控制信号输入端;
[0034]所述图像参数转换模块3的液晶模组图像时序信号输出端连接RGB画面时序产生模块11的液晶模组图像时序信号输入端,图像参数转换模块3的图像控制信号输出端分别连接RGB画面输出模块10和图像产生控制模块7的图像控制信号输入端,所述图像存储控制模块8的图像存储状态信号输出端连接图像参数转换模块3的图像存储状态信号输入端。
[0035]上述技术方案中,所述逻辑画面产生模块6还能连接外部逻辑画面功能扩展卡
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[0036]上述技术方案中,所述图像存储控制模块8还连接有DDR存储器模块9。
[0037]一种利用上述基于FPGA的逻辑画面叠加装置进行逻辑画面叠加的方法,它包括如下步骤:
[0038]步骤1:上位机将液晶模组水平分辨率、液晶模组垂直分辨率、液晶模组图像显示时序、多组所需逻辑画面的配置信息发送给上层接口模块1,上述每组所需逻辑画面的配置信息包括所需逻辑画面的类型编号、所需逻辑画面产生参数(不同逻辑画面类型有不同的参数,如矩形类逻辑画面有左上角顶点坐标位置、右下角顶点坐标位置等,圆形类逻辑画面有圆心坐标位置,半径长度,即长度值为多少个像素等,渐变类画面有渐变形式,即水平渐变、垂直渐变、放射渐变、渐变颜色色阶值)、所需逻辑画面的RGB各分量颜色值、所需逻辑画面的背景色和所需逻辑画面填充参数;
[0039]步骤2:上层接口模块I将液晶模组水平分辨率、液晶模组垂直分辨率、液晶模组图像显示时序、多组所需逻辑画面配置信息进行解析,并将解析后的液晶模组水平分辨率、液晶模组垂直分辨率、液晶模组图像显示时序、多组所需逻辑画面配置信息保存到图像参数缓存模块2中;
[0040]步骤3:图像参数转换模块3读取图像参数缓存模块2中缓存的所多组显示逻辑画面配置信息,图像参数转换模块3根据多组所需逻辑画面配置信息向逻辑画面产生模块6传输液晶模组水平分辨率、液晶模组垂直分辨率、多组所需逻辑画面的配置参数传输控制命令和显示逻辑画面配置信息;
[0041]同时,图像参数转换模块3将液晶模组图像显示时序发给RGB画面时序产生模块11以产生液晶模组图像显示的时序;
[0042]步骤4:图像参数转换模块3完成步骤3所述的操作后,图像参数转换模块3向图像产生控制模块7发送图像控制信号,用于启动后续图像存储控制模块8、DDR存储器模块9、RGB画面输出模块10和RGB画面时序产生模块11产生画面;
[0043]步骤5:逻辑画面产生模块6根据第一组所需逻辑画面的类型启动相应类型的逻辑画面子功能类型(如矩形类逻辑画面子类型、渐变类逻辑画面子类型、圆形类逻辑画面子类型等),这些逻辑画面子功能类型在工作时会根据液晶模组水平分辨率、液晶模组垂直分辨率、对应所需逻辑画面配置信息进行符合显示效果的计算处理,从而产生第一组所需逻辑画面特征点的像素位置和像素颜色值(如矩形图案中形成边长的点的像素位置坐标和颜色),在逻辑画面产生模块6产生第一组所需逻辑画面的过程中,会因计算形成中间变量和数据,这些中间变量和数据在计算处理中会反复用到,因此逻辑画面产生模块6将这些中间变量和数据缓存起来,随时存入随
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