一种接口电路、信号处理方法、器件及介质与流程

本申请涉及电子电路
技术领域：
，特别是涉及一种接口电路、信号处理方法、器件及介质。
背景技术：
：iic(inter-integratedcircuit，集成电路)总线是一种双向二线制同步串行总线，iic总线包括sda(serialdata，串行数据线)和scl(serialclock，串行时钟线)，sda和scl都是双向i/o线。一般来说，电路板上的处理器上集成有iic总线的接口，通过该接口，iic设备可以连接至处理器。一些处理器上没有集成iic总线接口，或者其集成的iic总线的接口不能支持iic协议时，iic设备可以通过cpld(complexprogrammablelogicdevice，复杂可编程逻辑器件)与处理器进行连接。常见的做法是，cpld通过可编程逻辑代码实现并行总线接口模块和iic总线控制器模块，如图1所示，cpld包括并行总线接口模块和iic总线控制器模块，处理器通过并行总线与并行总线接口模块连接和通信，iic设备通过iic总线与cpld连接和通信。cpld通过并行总线接收处理器发送的时序信号，并对时序信号进行解析处理，转换成满足iic协议的时序信号，再将该时序信号转发至iic设备，进而实现处理器与iic设备的通信。然而，由于并行总线和iic总线的差异，cpld需要对处理器发送的时序信号进行诸多处理，例如，需要串并转换、协议定义的交互等。这样，cpld需要实现的功能较多，需要实现庞大的状态控制机制和复杂的逻辑功能，使得cpld所需的逻辑代码较多且较复杂，进而降低了cpld的可靠性。技术实现要素：本申请实施例的目的在于提供一种接口电路、信号处理方法、器件及介质，以降低cpld逻辑代码的复杂度以及提高cpld的可靠性。具体技术方案如下：第一方面，本申请实施例提供了一种接口电路，接口电路包括处理器、可编程逻辑器件，其中：所述处理器包括多个管脚，所述处理器通过所述多个管脚与所述可编程逻辑器件连接，所述多个管脚包括电平信号管脚和信号方向管脚，所述电平信号管脚用于传输表示iic信号的电平信号，所述信号方向管脚用于传输表示电平信号的传输方向的方向信号；所述可编程逻辑器件通过iic总线与iic设备连接；所述可编程逻辑器件，用于对获取到的电平信号进行逻辑计算处理，并基于从所述信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至所述iic设备；或，基于从所述信号方向管脚接收到的方向信号，将获取到的电平信号发送至所述处理器。可选地，所述电平信号包括scl信号和sda信号，所述电平信号管脚包括用于传输所述scl信号的scl管脚和用于传输所述sda信号的sda管脚，所述信号方向管脚包括scl方向管脚和sda方向管脚，其中，所述scl方向管脚用于传输表示所述scl信号的传输方向的scl方向信号，所述sda方向管脚用于传输表示所述sda信号的传输方向的sda方向信号；所述处理器，用于通过所述scl管脚、与所述可编程逻辑器件之间传输scl信号，通过所述sda管脚、与所述可编程逻辑器件之间传输所述sda信号；还用于，通过所述scl方向管脚、与所述可编程逻辑器件之间传输scl方向信号，以及通过所述sda方向管脚、与所述可编程逻辑器件之间传输sda方向信号；所述可编程逻辑器件，用于对获取到的所述scl信号进行逻辑计算处理，并基于接收到的scl方向信号，将逻辑计算处理后的scl信号发送至所述iic设备；或基于接收到的scl方向信号，将接收的scl信号发送至所述处理器；还用于对获取到的所述sda信号进行逻辑计算处理，并基于接收到的sda方向信号，将逻辑计算处理后的sda信号发送至所述iic设备；或，基于接收到的sda方向信号，将接收的sda信号发送至所述处理器。可选地，所述scl信号包括输入所述处理器的scl输入信号和从所述处理器输出的scl输出信号，所述scl管脚包括用于传输scl输入信号的scl输入管脚和用于传输scl输出信号的scl输出管脚；所述可编程逻辑器件，用于当从所述scl方向管脚输出的scl方向信号表示输出方向时，接收从所述scl输出管脚输出的scl输出信号，对所接收到的scl输出信号进行逻辑计算处理，并将逻辑计算处理后的scl输出信号通过所述iic总线发送至所述iic设备；当从所述scl方向管脚输出的scl方向信号表示输入方向时，接收所述iic设备发送的scl输入信号，并将所接收的scl输入信号发送至所述scl输入管脚。可选地，所述sda信号包括输入所述处理器的sda输入信号和从所述处理器输出的sda输出信号，所述sda管脚包括用于传输sda输入信号的sda输入管脚和用于传输sda输出信号的sda输出管脚；所述可编程逻辑器件，用于当从所述sda方向管脚输出的sda方向信号表示输出方向时，接收从所述sda输出管脚输出的sda输出信号，对所接收到的sda输出信号进行逻辑计算处理，并将逻辑计算处理后的sda输出信号通过所述iic总线发送至所述iic设备；当从所述sda方向管脚输出的sda方向信号表示输入方向时，接收所述iic设备发送的sda输入信号，并将所接收的sda输入信号发送至所述sda输入管脚。可选地，所述可编程逻辑器件，具体用于在接收到从所述scl方向管脚输出的scl方向信号，并接收到从所述scl输出管脚输出的scl输出信号之后，判断该scl方向信号是否为低电平信号、且该scl输出信号是否为低电平信号，如果是，则生成低电平的scl输出信号，如果否，则生成高阻态的scl输出信号；具体用于在接收到从所述scl方向管脚输出的scl方向信号后，判断该scl方向信号是否为高电平信号，如果是，接收所述iic设备发送的scl输入信号，并将所接收的scl输入信号发送至所述scl输入管脚，如果否，生成高电平的信号，并将该信号发送至所述scl输入管脚。可选地，所述可编程逻辑器件，具体用于在接收到从所述sda方向管脚输出的sda方向信号，并接收到从所述sda输出管脚输出的sda输出信号之后，判断该sda方向信号是否为低电平信号、且该sda输出信号是否为低电平信号，如果是，则生成低电平的sda输出信号，如果否，则生成高阻态的sda输出信号；具体用于在接收到从所述sda方向管脚输出的sda方向信号后，判断该sda方向信号是否为高电平信号，如果是，接收所述iic设备发送的sda输入信号，并将所接收的sda输入信号发送至所述sda输入管脚，如果否，生成高电平的信号，并将该信号发送至所述sda输入管脚。可选地，所述可编程逻辑器件，还用于将所述电平信号的上升沿时间调整为满足iic协议的规范要求的上升沿时间；和/或，将所述电平信号的下降沿时间调整为满足iic协议的规范要求的下降沿时间。可选地，所述可编程逻辑器件包含第一端口和第二端口，其中，所述第一端口的电压为所述处理器的接口电平，所述第二端口的电压为所述iic设备的接口电平；所述处理器通过所述多个管脚与所述第一端口连接，所述iic设备通过所述iic总线与所述第二端口连接。可选的，所述电平信号中携带用于接收所述电平信号的iic设备的地址；所述可编程逻辑器件，具体用于当所述可编程逻辑器件连接有一个或多个iic设备时，对接收到的所述电平信号进行逻辑计算处理，并基于接收到的方向信号，将逻辑计算处理后的电平信号发送至所述地址对应的iic设备。可选地，所述sda信号中携带用于接收该sda信号的iic设备的地址；所述可编程逻辑器件，具体用于当所述可编程逻辑器件连接有一个或多个iic设备时，对接收到的所述sda信号进行逻辑计算处理，并基于接收到的所述sda方向信号，将逻辑计算处理后的sda信号发送至所述地址对应的iic设备。第二方面，本申请实施例提供了一种信号处理方法，应用于可编程逻辑器件，所述可编程逻辑器件通过iic总线与iic设备连接，所述可编程逻辑器件通过处理器的多个管脚与所述处理器连接，其中，所述多个管脚包括电平信号管脚和信号方向管脚，所述电平信号管脚用于传输表示iic信号的电平信号，所述信号方向管脚用于传输表示电平信号的传输方向的方向信号；所述方法包括：从所述信号方向管脚接收所述处理器发送的方向信号；对所获取的电平信号进行逻辑计算处理，并基于所述方向信号，将逻辑计算处理后的电平信号发送至所述iic设备；或，基于所述方向信号，将获取到的电平信号发送至所述处理器。可选地，所述电平信号包括scl信号和sda信号，所述电平信号管脚包括用于传输所述scl信号的scl管脚和用于传输所述sda信号的sda管脚，所述信号方向管脚包括scl方向管脚和sda方向管脚，其中，所述scl方向管脚用于传输表示所述scl信号的传输方向的scl方向信号，所述sda方向管脚用于传输表示所述sda信号的传输方向的sda方向信号；所述从所述信号方向管脚接收所述处理器发送的方向信号，包括：接收所述处理器通过所述scl方向管脚发送的scl方向信号，接收所述处理器通过所述sda方向管脚发送的sda方向信号；所述对所获取的电平信号进行逻辑计算处理，并基于所述方向信号，将逻辑计算处理后的电平信号发送至所述iic设备；或，基于所述方向信号，将获取到的电平信号发送至所述处理器，包括：对获取到的所述scl信号进行逻辑计算处理，并基于所述scl方向信号，将逻辑计算处理后的scl信号发送至所述iic设备，或，基于所述scl方向信号，将所获取的scl信号发送至所述处理器；对获取到的所述sda信号进行逻辑计算处理，并基于所述sda方向信号，将逻辑计算处理后的sda信号发送至所述iic设备，或，基于所述sda方向信号，将所获取的sda信号发送至所述处理器。可选地，所述scl信号包括输入所述处理器的scl输入信号和从所述处理器输出的scl输出信号，所述scl管脚包括用于传输scl输入信号的scl输入管脚和用于传输scl输出信号的scl输出管脚；所述对获取到的所述scl信号进行逻辑计算处理，并基于所述scl方向信号，将逻辑计算处理后的scl信号发送至所述iic设备，包括：当从所述scl方向管脚输出的scl方向信号表示输出方向时，接收从所述scl输出管脚输出的scl输出信号，对所接收到的scl输出信号进行逻辑计算处理，并将逻辑计算处理后的scl输出信号通过所述iic总线发送至所述iic设备；当从所述scl方向管脚输出的scl方向信号表示输入方向时，接收所述iic设备发送的scl输入信号，并将所接收到的scl输入信号发送至所述scl输入管脚。可选地，所述sda信号包括输入所述处理器的sda输入信号和从所述处理器输出的sda输出信号，所述sda管脚包括用于传输sda输入信号的sda输入管脚和用于传输sda输出信号的sda输出管脚；所述对获取到的所述sda信号进行逻辑计算处理，并基于所述sda方向信号，将逻辑计算处理后的sda信号发送至所述iic设备，包括：当从所述sda方向管脚输出的sda方向信号表示输出方向时，接收从所述sda输出管脚输出的sda输出信号，对所接收到的sda输出信号进行逻辑计算处理，并将逻辑计算处理后的sda输出信号通过所述iic总线发送至所述iic设备；当从所述sda方向管脚输出的sda方向信号表示输入方向时，接收所述iic设备发送的sda输入信号，并将所接收到的sda输入信号发送至所述sda输入管脚。可选地，所述从当所述scl方向管脚输出的scl方向信号表示输出方向时，接收从所述scl输出管脚输出的scl输出信号，对所接收到的scl输出信号进行逻辑计算处理，并将逻辑计算处理后的scl输出信号通过所述iic总线发送至所述iic设备，包括：在接收到从所述scl方向管脚输出的scl方向信号，并接收从所述scl输出管脚输出的scl输出信号之后，判断该scl方向信号是否为低电平信号、且该scl输出信号是否为低电平信号，如果是，则生成低电平的scl输出信号，如果否，则生成高阻态的scl输出信号；所述从当所述scl方向管脚输出的scl方向信号表示输入方向时，接收所述iic设备发送的scl输入信号，并将所接收到的scl输入信号发送至所述scl输入管脚，包括：在接收到从所述scl方向管脚输出的scl方向信号后，判断该scl方向信号是否为高电平信号，如果是，接收所述iic设备发送的scl输入信号，并将所接收的scl输入信号发送至所述scl输入管脚，如果否，生成高电平的信号，并将该信号发送至所述scl输入管脚。可选地，所述当从所述sda方向管脚输出的sda方向信号表示输出方向时，接收从所述sda输出管脚输出的sda输出信号，对所接收到的sda输出信号进行逻辑计算处理，并将逻辑计算处理后的sda输出信号通过所述iic总线发送至所述iic设备，包括：在接收到从所述sda方向管脚输出的sda方向信号，并接收到从所述sda输出管脚输出的sda输出信号之后，判断该sda方向信号是否为低电平信号、且该sda输出信号是否为低电平信号，如果是，则生成低电平的sda输出信号，如果否，则生成高阻态的sda输出信号；所述当从所述sda方向管脚输出的sda方向信号表示输入方向时，接收所述iic设备发送的sda输入信号，并将所接收到的sda输入信号发送至所述sda输入管脚，包括：在接收到从所述sda方向管脚输出的sda方向信号后，判断该sda方向信号是否为高电平信号，如果是，接收所述iic设备发送的sda输入信号，并将所接收的sda输入信号发送至所述sda输入管脚，如果否，生成高电平的信号，并将该信号发送至所述sda输入管脚。可选地，所述方法还包括：将所述电平信号的上升沿时间调整为满足iic协议的规范要求的上升沿时间；和/或，将所述电平信号的下降沿时间调整为满足iic协议的规范要求的下降沿时间。可选地，所述可编程逻辑器件包含第一端口和第二端口，其中，所述第一端口的电压为所述处理器的接口电平，所述第二端口的电压为所述iic设备的接口电平；所述可编程逻辑器件通过所述第一端口与所述多个管脚连接，通过所述第二端口与所述iic总线连接。可选的，所述电平信号中携带用于接收所述电平信号的iic设备的地址；所述对所获取的电平信号进行逻辑计算处理，并基于所述方向信号，将逻辑计算处理后的电平信号发送至所述iic设备，包括：当所述可编程逻辑器件连接有一个或多个iic设备时，对接收到的所述电平信号进行逻辑计算处理，并基于接收到的方向信号，将逻辑计算处理后的电平信号发送至所述地址对应的iic设备。可选地，所述sda信号中携带用于接收该sda信号的iic设备的地址；所述对获取到的所述sda信号进行逻辑计算处理，并基于所述sda方向信号，将逻辑计算处理后的sda信号发送至所述iic设备，包括：当所述可编程逻辑器件连接有一个或多个iic设备时，对接收到的所述sda信号进行逻辑计算处理，并基于接收到的所述sda方向信号，将逻辑计算处理后的sda信号发送至所述地址对应的iic设备。第三方面，本申请实施例提供了一种信号处理装置，应用于可编程逻辑器件，所述可编程逻辑器件通过iic总线与iic设备连接，所述可编程逻辑器件通过处理器的多个管脚与所述处理器连接，其中，所述多个管脚包括电平信号管脚和信号方向管脚，所述电平信号管脚用于传输表示iic信号的电平信号，所述信号方向管脚用于传输表示电平信号的传输方向的方向信号；所述装置包括：接收模块，用于从所述信号方向管脚接收所述处理器发送的方向信号；逻辑计算模块，用于对所获取的电平信号进行逻辑计算处理，并基于所述方向信号，将逻辑计算处理后的电平信号发送至所述iic设备；或，基于所述方向信号，将获取到的电平信号发送至所述处理器。第四方面，本申请实施例提供了一种可编程逻辑器件，包括通用处理器、通信接口、存储器和通信总线，其中，通用处理器，通信接口，存储器通过通信总线完成相互间的通信；存储器，用于存放计算机程序；通用处理器，用于执行存储器上所存放的程序时，实现任一所述的信号处理方法步骤。第五方面，本申请实施例提供了一种机器可读存储介质，所述机器可读存储介质内存储有计算机程序，所述计算机程序被通用处理器执行时实现任一所述的信号处理方法步骤。本申请实施例提供的技术方案中，可编程逻辑器件通过多个管脚与处理器连接，并通过iic总线与iic设备连接，其中多个管脚包括电平信号管脚和信号方向管脚，可编程逻辑器件对获取到的电平信号进行逻辑计算处理，并基于从信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至iic设备；或基于方向信号，将获取到的电平信号发送至处理器。通过本申请实施例提供的技术方案，处理器的管脚能够输出表示iic信号的电平信号和表示电平信号的传输方向的方向信号，这样，可编程逻辑器件也可以直接获取到表示iic信号的电平信号和表示电平信号的传输方向的方向信号，而不需再进行诸多处理来解决并行总线和iic总线的差异的问题，可编程逻辑器件仅需对电平信号进行逻辑计算处理，减少了可编程逻辑器件的处理操作，进而降低逻辑代码的复杂度，提高可编程逻辑器件的可靠性。附图说明为了更清楚地说明本申请实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。图1为现有技术的连接示意图；图2为本申请实施例提供的接口电路的第一种连接示意图；图3为本申请实施例提供的接口电路的第二种连接示意图；图4-1为本申请实施例提供的接口电路的第三种连接示意图；图4-2为本申请实施例提供的接口电路的第四种连接示意图；图5为本申请实施例提供的信号处理方法的一种流程图；图6为本申请实施例提供的信号处理装置的一种结构示意图；图7为本申请实施例提供的可编程逻辑器件的一种结构示意图。具体实施方式下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。为了解决可编程逻辑器件的逻辑代码较多且较复杂以及可靠性低的问题，本申请实施例提供了一种接口电路、信号处理方法及装置，其中，一种接口电路包括处理器、可编程逻辑器件，其中：处理器包括多个管脚，处理器通过多个管脚与可编程逻辑器件连接，多个管脚包括电平信号管脚和信号方向管脚，电平信号管脚用于传输表示iic信号的电平信号，信号方向管脚用于传输表示电平信号的传输方向的方向信号；可编程逻辑器件通过iic总线与iic设备连接；可编程逻辑器件，用于对获取到的电平信号进行逻辑计算处理，并基于从信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于从信号方向管脚接收到的方向信号，将获取到的电平信号发送至处理器。本申请实施例提供的技术方案中，可编程逻辑器件通过多个管脚与处理器连接，并通过iic总线与iic设备连接，其中多个管脚包括电平信号管脚和信号方向管脚，可编程逻辑器件对获取到的电平信号进行逻辑计算处理，并基于从信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于从信号方向管脚接收到的方向信号，将获取到的电平信号发送至处理器。通过本申请实施例提供的技术方案，处理器的管脚能够直接输出表示iic信号的电平信号和表示电平信号的传输方向的方向信号，这样，可编程逻辑器件也可以直接获取到表示iic信号的电平信号和表示电平信号的传输方向的方向信号，而不需再进行诸多处理来解决并行总线和iic总线的差异的问题，可编程逻辑器件仅需对电平信号进行逻辑计算处理，减少了可编程逻辑器件的处理操作，进而降低逻辑代码的复杂度，提高可编程逻辑器件的可靠性。下面首先对本申请实施例提供的一种接口电路进行介绍。如图2所示的本申请实施例提供的接口电路的一种结构示意图，该接口电路包括处理器和可编程逻辑器件。其中，可编程逻辑器件为一种通用的集成电路，可编程逻辑器件的逻辑功能可以是自定义的，具体地可以通过自定义的可编程逻辑代码来确定。可编程逻辑器件可以为cpld(complexprogrammablelogicdevice，复杂可编程逻辑器件)、pal(programmablearraylogic，可编程阵列逻辑)、gal(genericarraylogic，通用阵列逻辑)、fpga(field-programmablegatearray，现场可编程门阵列)等器件中的任一种，在此不作限定。下面以可编程逻辑器件为cpld为例进行介绍。其中，cpld的型号包括多种，例如，altera的epm1270、epm240，lattice的lcmxo2_1200u等。处理器可以包括多个管脚，其中，该多个管脚为gpio管脚。处理器通过该多个管脚与可编程逻辑器件连接。其中，多个管脚可以包括电平信号管脚和信号方向管脚。电平信号管脚用于传输表示iic信号的电平信号。具体地，处理器可以通过电平信号管脚输出电平信号，还可以通过电平信号管脚接收电平信号。信号方向管脚用于传输表示电平信号的传输方向的方向信号，电平信号的传输方向包括输出和输入。信号方向管脚可以传输两种方向信号：输出方向信号和输入方向信号，输出方向信号表示电平信号的传输方向为输出方向，即从处理器输出电平信号，输入方向信号表示电平信号的传输方向为输入方向，即将电平信号输入至处理器。其中，管脚的功能可以是自定义设置的，设置的方式可以是软件方式实现的，例如，利用可编程逻辑代码来模拟电平信号管脚所需传输的电平信号的时序。可编程逻辑器件可以通过iic总线与iic设备连接，iic总线用于传输针对scl(serialclock，串行时钟线)的信号和针对sda(serialdata，串行数据线)的信号。其中，iic总线上传输的信号是满足iic协议的信号，即可编程逻辑器件输出的信号以及从iic设备输入至可编程逻辑器件的信号均满足iic协议。可编程逻辑器件可以用于对获取到的电平信号进行逻辑计算处理，其中，可编程逻辑器件获取到的电平信号可以是来自于iic设备，还可以来自于处理器。电平信号可以为多种类型信号，例如，scl输入信号，scl输出信号，sda输入信号，sda输出信号等。对于不同类型的电平信号，可编程逻辑器件的逻辑计算处理可以不相同。可编程逻辑器件还可以从处理器上的信号方向管脚接收方向信号，信号方向管脚用于传输表示电平信号的传输方向的信号。当可编程逻辑器件接收到的方向信号表示输出方向，表示处理器输出电平信号给可编程逻辑器件，此时，可编程逻辑器件在对电平信号进行逻辑计算处理之后，将逻辑计算处理后的电平信号发送至iic设备。当可编程逻辑器件接收到的方向信号表示输入方向，表示可编程逻辑器件将从iic设备接收到的电平信号转发至处理器，即可编程逻辑器件对来自于iic设备的电平信号进行逻辑计算处理之后，将逻辑计算处理后的电平信号发送至处理器。一种实施方式中，电平信号可以包括scl信号和sda信号，电平信号管脚包括用于传输scl信号的scl管脚和用于传输sda信号的sda管脚。处理器可以通过scl管脚、与可编程逻辑器件之间传输scl信号，通过sda管脚、与可编程逻辑器件之间传输sda信号；还用于，通过scl方向管脚、与可编程逻辑器件之间传输scl方向信号，以及通过sda方向管脚、与可编程逻辑器件之间传输sda方向信号。如表1所示：表1基于电平信号包括scl信号和sda信号，信号方向管脚可以包括scl方向管脚和sda方向管脚。其中，scl方向管脚用于传输表示scl信号的传输方向的scl方向信号，处理器与可编程逻辑器件之间通过scl方向管脚传输scl方向信号，当可编程逻辑器件接收到从scl方向管脚输出的scl方向信号后，可以确定scl信号的传输方向，传输方向包括scl信号从处理器输出至可编程逻辑器件，或者由可编程逻辑器件输入至处理器。其中，sda方向管脚用于传输表示sda信号的传输方向的sda方向信号，处理器与可编程逻辑器件之间通过sda方向管脚传输sda方向信号，当可编程逻辑器件接收到从sda方向管脚输出的sda方向信号后，可以确定sda信号的传输方向，传输方向包括sda信号从处理器输出至可编程逻辑器件，或者由可编程逻辑器件输入至处理器。针对信号方向管脚，如表2所示：表2针对于可编程逻辑器件，可以用于对获取到的scl信号进行逻辑计算处理，并基于接收到的scl方向信号，将逻辑计算处理后的scl信号发送至iic设备；或基于接收到的scl方向信号，将接收的scl信号发送至处理器。其中，当scl方向信号表示的方向为输出方向时，可编程逻辑器件接收处理器从scl管脚发送的scl信号，并对该scl信号进行逻辑计算处理，在完成逻辑计算处理之后，可以将逻辑计算处理后的scl信号发送至iic设备。当scl方向信号表示的方向为输入方向时，可编程逻辑器件可以接收iic设备发送的scl信号，并对该scl信号进行逻辑计算处理，在完成逻辑计算处理之后，可以将逻辑计算处理后的scl信号发送至处理器。可编程逻辑器件还可以用于对获取到的sda信号进行逻辑计算处理，并基于接收到的sda方向信号，将逻辑计算处理后的sda信号发送至iic设备；或，基于接收到的sda方向信号，将接收的sda信号发送至处理器。其中，当sda方向信号表示的方向为输出方向时，可编程逻辑器件接收处理器从sda管脚发送的sda信号，并对该sda信号进行逻辑计算处理，在完成逻辑计算处理之后，可以将逻辑计算处理后的sda信号发送至iic设备。当sda方向信号表示的方向为输入方向时，可编程逻辑器件可以接收iic设备发送的sda信号，并对该sda信号进行逻辑计算处理，在完成逻辑计算处理之后，可以将逻辑计算处理后的sda信号发送至处理器。结合图3举例说明，如图3所示，管脚1为scl管脚，管脚2为sda管脚，管脚3为scl方向管脚，管脚4为sda方向管脚。处理器与可编程逻辑器件之间通过scl管脚传输scl信号，通过sda管脚传输sda信号，通过scl方向管脚传输scl方向信号，通过sda方向管脚传输sda方向信号。可编程逻辑器件与iic设备之间的iic总线包括两条，一条是针对scl信号，即用于传输逻辑计算处理后的scl信号；另一条是针对sda信号，即用于传输逻辑计算处理后的sda信号。一种实施方式中，scl信号可以包括scl输入信号和scl输出信号。其中，scl输入信号的传输方向为从可编程逻辑器件传输至处理器，scl输出信号的传输方向为从处理器传输至可编程逻辑器件。针对scl信号，如下表3所示：表3scl管脚可以包括scl输入管脚和scl输出管脚。其中，scl输入管脚用于传输scl输入信号，scl输出管脚用于传输scl输出信号。针对scl管脚，如下表4所示：表4可编程逻辑器件可以用于当从scl方向管脚输出的scl方向信号表示输出方向时，接收从scl输出管脚输出的scl输出信号，对所接收到的scl输出信号进行逻辑计算处理，并将逻辑计算处理后的scl输出信号通过iic总线发送至iic设备。对scl输出信号进行逻辑计算处理的一种实现方式中，对所接收到的scl输出信号与scl方向信号进行逻辑与计算，可以得到相应的逻辑与计算结果，将该结果作为逻辑计算处理后的scl输出信号，通过iic总线发送至iic设备。可编程逻辑器件还可以用于当从scl方向管脚输出的scl方向信号表示输入方向时，接收iic设备发送的scl输入信号，并将所接收到的scl输入信号发送至scl输入管脚，这样处理器能够接收到scl输入管脚输入的该scl输入信号。以图4-1为例进行说明，管脚11为scl输出管脚，管脚12为scl输入管脚，可编程逻辑器件可以接收从管脚11输出的scl输出信号；还可以将scl输入信号发送至处理器的管脚12，从而通过管脚12将scl输入信号传输至处理器。一种实施方式中，可编程逻辑器件接收到从scl方向管脚输出的scl方向信号，并接收到从scl输出管脚输出的scl输出信号之后，判断该scl方向信号是否为低电平信号、且该scl输出信号是否为低电平信号，如果是，则生成低电平的scl输出信号，如果否，则生成高阻态的scl输出信号，即可编程逻辑器件用于输出scl输出信号的管脚输出高阻态，其中，高阻态可以用z表示。如下表5所示：表5例如，对于scl方向信号，低电平时表示输出方向，高电平时表示输入方向，即逻辑电平0时表示输出方向，逻辑电平1时表示输入方向。当scl方向信号为逻辑电平0且scl输出信号为逻辑电平0时，表示处理器使能输出针对scl的信号，则可编程逻辑器件可以生成逻辑电平0的scl输出信号，并将该逻辑电平0的scl输出信号发送至iic设备。若scl方向信号和scl输出信号为以下三种情况中的任一种：scl方向信号为逻辑电平1且scl输出信号为逻辑电平0，scl方向信号为逻辑电平0且scl输出信号为逻辑电平1，scl方向信号为逻辑电平1且scl输出信号为逻辑电平1。此时，可编程逻辑器件用于输出scl输出信号的管脚输出高阻态。如下表6所示：表6一种实施方式中，可编程逻辑器件接收到从scl方向管脚输出的scl方向信号后，判断该scl方向信号是否为高电平，如果是，接收所述iic设备发送的信号，可编程逻辑器件接收到该信号后，将该信号作为scl输入信号发送至scl输入管脚。如果scl方向信号不是高电平，即低电平时，生成电平值为高电平的一个信号，并将该信号发送至scl输入管脚，该信号用于表示输入方向不使能，处理器可以不进行处理。处理器接收到该高电平的信号后，针对该高电平的信号可以不进行处理。如下表7所示：表7scl方向信号向处理器发送的信号高电平scl输入信号低电平高电平的信号例如，对于scl方向信号，低电平时表示输出方向，高电平时表示输入方向。当scl方向信号为逻辑电平1时，表示输入方向，此时可编程逻辑器件可以接收iic设备发送的信号，并将该信号作为scl输入信号通过scl输入管脚发送至处理器。当scl方向信号为逻辑电平0时，表示输出方向，处理器输出scl输出信号，可编程逻辑器件通过scl输入管脚向处理器输入逻辑电平为1的一个信号。如下表8所示：表8scl方向信号向处理器发送的信号1scl输入信号01一种实施方式中，sda信号可以包括sda输入信号和sda输出信号。其中，sda输入信号的传输方向为从可编程逻辑器件传输至处理器，sda输出信号的传输方向为从处理器传输至可编程逻辑器件。针对sda信号，如下表9所示：表9sda管脚可以包括sda输入管脚和sda输出管脚。其中，sda输入管脚用于传输sda输入信号，sda输出管脚用于传输sda输出信号。针对sda管脚，如下表10所示：表10可编程逻辑器件可以用于当从sda方向管脚输出的sda方向信号表示输出方向时，接收从sda输出管脚输出的sda输出信号，对所接收到的sda输出信号进行逻辑计算处理，并将逻辑计算处理后的sda输出信号通过iic总线发送至iic设备。对sda输出信号进行逻辑计算处理的一种实现方式中，对所接收到的sda输出信号与sda方向信号进行逻辑与计算，可以得到相应的逻辑与计算结果，将该结果作为逻辑计算处理后的sda输出信号，通过iic总线发送至iic设备。可编程逻辑器件还可以用于当从sda方向管脚输出的sda方向信号表示输入方向时，接收iic设备发送的sda输入信号，并将所接收到的sda输入信号发送至sda输入管脚。以图4-1为例进行说明，管脚21为sda输出管脚，管脚22为sda输入管脚，可编程逻辑器件可以从管脚21接收sda输出信号；还可以通过管脚22将sda输入信号发送至处理器。一种实施方式中，可编程逻辑器件接收到从sda方向管脚输出的sda方向信号，并接收到从sda输出管脚输出的sda输出信号之后，判断该sda方向信号是否为低电平信号、且该sda输出信号是否为低电平信号，如果是，则生成低电平的sda输出信号，如果否，则生成高阻态的sda输出信号，即可编程逻辑器件用于输出sda输出信号的管脚输出高阻态。如下表11所示：表11例如，对于sda方向信号，低电平时表示输出方向，高电平时表示输入方向，即逻辑电平0时表示输出方向，逻辑电平1时表示输入方向。当sda方向信号为逻辑电平0且sda输出信号为逻辑电平0时，表示处理器使能输出针对sda的信号，则可编程逻辑器件可以生成逻辑电平0的sda输出信号，并将该逻辑电平0的sda输出信号发送至iic设备。若sda方向信号和sda输出信号为以下三种情况中的任一种：sda方向信号为逻辑电平1且sda输出信号为逻辑电平0，sda方向信号为逻辑电平0且sda输出信号为逻辑电平1，sda方向信号为逻辑电平1且sda输出信号为逻辑电平1。此时，生成高阻态的sda输出信号，即可编程逻辑器件用于输出sda输出信号的管脚输出高阻态。如下表12所示：表12一种实施方式中，可编程逻辑器件接收到从sda方向管脚输出的sda方向信号后，判断该sda方向信号是否为高电平信号，如果是，接收所述iic设备发送的信号，可编程逻辑器件接收到该信号后，将该信号作为sda输入信号发送至sda输入管脚。如果sda方向信号不是高电平信号，即低电平信号时，生成电平值为高电平的一个信号，并将该信号发送至sda输入管脚。处理器接收到该高电平的信号后，针对该高电平的信号可以不进行处理。如下表13所示：表13scl方向信号向处理器发送的信号高电平scl输入信号低电平高电平的信号例如，对于sda方向信号，低电平时表示输出方向，高电平时表示输入方向。当sda方向信号为逻辑电平1时，表示输入方向，此时可编程逻辑器件可以接收iic设备发送的信号，并将该信号作为sda输入信号通过sda输入管脚发送至处理器。当sda方向信号为逻辑电平0时，表示输出方向，处理器输出sda输出信号，可编程逻辑器件向sda输入管脚输入逻辑电平为1的信号。如下表14所示：表14scl方向信号向处理器发送的信号1scl输入信号01一种实施方式中，可编程逻辑器件，还用于将电平信号的上升沿时间调整为满足iic协议的规范要求的上升沿时间；和/或，将电平信号的下降沿时间调整为满足iic协议的规范要求的下降沿时间。根据电平信号包括scl信号和sda信号，可以分为以下两种情况。第一种情况，可编程逻辑器件可以对scl信号的边沿时间进行调整，边沿时间包括上升沿时间和下降沿时间。其中，scl信号包括scl输入信号和scl输出信号。下面以对scl输出信号的边沿时间进行调整为例进行说明，具体地可以包括如下步骤。将scl输出信号的上升沿时间调整为满足iic协议的规范要求的上升沿时间；和/或，将scl输出信号的下降沿时间调整为满足iic协议的规范要求的下降沿时间。其中，调整后的scl上升沿时间和scl下升沿时间均满足iic协议的规范要求。通过本申请实施例提供的实施方式，可编程逻辑器件可以对scl输出信号的上升沿时间和下降沿时间进行设置，进而使得输出的scl输出信号的上升沿时间和下降沿时间均能满足iic协议的规范要求。第二种情况，可编程逻辑器件可以对sda信号的边沿时间进行调整，边沿时间包括上升沿时间和下降沿时间。其中，sda信号包括sda输入信号和sda输出信号。下面以对sda输出信号的边沿时间进行调整为例进行说明，具体地可以包括如下步骤。将sda输出信号的上升沿时间调整为满足iic协议的规范要求的上升沿时间；和/或，将sda输出信号的下降沿时间调整为满足iic协议的规范要求的下降沿时间。其中，调整后的sda上升沿时间和sda下升沿时间均满足iic协议的规范要求。通过本申请实施例提供的实施方式，可编程逻辑器件可以对sda输出信号的上升沿时间和下降沿时间进行设置，进而使得输出的sda输出信号的上升沿时间和下降沿时间均能满足iic协议的规范要求。一种实施方式中，可编程逻辑器件可以将多个管脚上输出的电压进行转换，进而使得可编程逻辑器件与iic设备连接处的电压与iic设备的电压一致。具体地，可编程逻辑器件在通过多个管脚连接处理器、且通过iic总线连接iic设备之后，可编程逻辑器件可以检测出处理器的管脚上的电压，以及所连接的iic设备的电压，再判断多个管脚的电压与iic设备的电压是否一致。若多个管脚的电压与iic设备的电压不一致，可编程逻辑器件可以进行电压转换，将可编程逻辑器件与iic设备连接处输出的电压转换为iic设备的电压。例如，处理器的电压为1.7v，则该处理器的各管脚上的电压为1.7v，iic设备的电压为3.3v，可编程逻辑器件可以检测出管脚的电压与iic设备的电压不一致，则可以将可编程逻辑器件与iic设备连接处输出的电压转换为3.3v。通过本申请实施例提供的实施方式，在多个管脚的电压与iic设备的电压不一致的情况下，可以由可编程逻辑器件直接进行电压转换，使得可编程逻辑器件与iic设备连接处输出的电压与iic设备的电压一致。这样避免了另外增加电压转换器件，不仅简化了电路结构，而且还节省了电压转换器件的资源。一种实现方式中，可编程逻辑器件包括多个物理分区(即bank)，每个物理分区的电压可以单独设置。具体的，可编程逻辑器件可以包含第一端口和第二端口，第一端口的第一电压和第二端口的第二电压可以不同。其中，第一端口的第一电压设置为处理器的接口电平，第二端口的第二电压设置为iic设备的接口电平。处理器通过多个管脚与第一端口连接，iic设备通过iic总线与第二端口连接。这样，在处理器的接口电平与iic设备的接口电平不一样的情况下，可编程逻辑器件可以为不同物理分区设置不同的电压，进而使得处理器与iic设备可以通过可编程逻辑器件连接起来。例如，处理器的接口电平为1.7v，iic设备的接口电平3.3v，可编程逻辑器件的第一端口的第一电压为1.7v，第二端口的第二电压为3.3v，从而将处理器与第一端口连接，第二端口连接iic设备。可编程逻辑器件包含的端口并不仅限于上述第一端口和第二端口，还可以包括多个端口。可编程逻辑器件中端口的电压等级并不仅限于上述两种，为了提高可编程逻辑器件的通用性，可编程逻辑器件中端口的电压等级可以包括多种电压等级，例如，端口的电压等级可以包括1.7v、2.5v、3.3v等。一种实施方式中，所述电平信号中携带用于接收所述电平信号的iic设备的地址；所述可编程逻辑器件，具体用于当所述可编程逻辑器件连接有一个或多个iic设备时，对接收到的所述电平信号进行逻辑计算处理，并基于接收到的方向信号，将逻辑计算处理后的电平信号发送至所述地址对应的iic设备。一种实施例中，如图4-2所示，可编程逻辑器件可以连接多个iic设备，例如iic设备1和iic设备2。sda信号可以携带用于接收该sda信号的iic设备的地址。例如，假设iic设备2的地址为0x68，sda输出信号中携带的地址为0x68，则表示该sda输出信号是发送至地址为0x68的iic设备2的。本申请实施例提供的技术方案中，可编程逻辑器件通过多个管脚与处理器连接，并通过iic总线与iic设备连接，其中多个管脚包括电平信号管脚和信号方向管脚，可编程逻辑器件对获取到的电平信号进行逻辑计算处理，并基于从信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于接收到的sda方向信号，将接收的sda信号发送至处理器。通过本申请实施例提供的技术方案，处理器的管脚能够直接输出表示iic信号的电平信号和表示电平信号的传输方向的方向信号，这样，可编程逻辑器件也可以直接获取到表示iic信号的电平信号和表示电平信号的传输方向的方向信号，而不需再进行诸多处理来解决并行总线和iic总线的差异的问题，可编程逻辑器件仅需对电平信号进行逻辑计算处理，减少了可编程逻辑器件的处理操作，进而降低逻辑代码的复杂度，提高可编程逻辑器件的可靠性。本申请实施例还提供一种接口电路，如图4-2所示，接口电路包括处理器和可编程逻辑器件，可编程逻辑器件通过iic总线分别与iic设备1和iic设备2连接。其中，处理器包括管脚11、管脚12、管脚21、管脚22、管脚3和管脚4，管脚11为scl输出管脚，管脚12为scl输入管脚，管脚21为sda输出管脚，管脚22为sda输入管脚，管脚3为scl方向管脚，管脚4为sda方向管脚。可编程逻辑器件可以接收到从管脚4输出的sda方向信号，并接收到从管脚21输出的sda输出信号之后，判断该sda方向信号是否为低电平信号、且该sda输出信号是否为低电平信号，如果是，则生成低电平的sda输出信号。当sda输出信号中携带iic设备1的地址时，可编程逻辑器件将所生成的低电平的sda输出信号通过iic总线发送至iic设备1。如果否，则生成高阻态的sda输出信号，当sda输出信号中携带iic设备1的地址时，可编程逻辑器件将所生成的高阻态的sda输出信号通过iic总线发送至iic设备1。可编程逻辑器件可以接收从管脚4输出的sda方向信号，判断该sda方向信号是否为高电平信号，如果是，接收iic设备发送的sda输入信号，并将所接收的sda输入信号发送至管脚22，这样处理器从管脚22可以获取到sda输入信号，如果否，生成高电平的信号，并将该信号发送至管脚22，这样处理器从管脚22可以获取到该信号。可编程逻辑器件可以接收从管脚3输出的scl方向信号，并接收到从管脚11输出的scl输出信号之后，判断该scl方向信号是否为低电平信号、且该scl输出信号是否为低电平信号。如果是，则生成低电平的scl输出信号。基于sda输出信号中携带iic设备2的地址，可编程逻辑器件将所生成的低电平的scl输出信号通过iic总线发送至iic设备2。如果否，则生成高阻态的scl输出信号，基于sda输出信号中携带iic设备2的地址，可编程逻辑器件将所生成的高阻态的scl输出信号通过iic总线发送至iic设备2。可编程逻辑器件可以接收从管脚3输出的scl方向信号，判断该scl方向信号是否为高电平信号，如果是，接收iic设备发送的scl输入信号，并将所接收的scl输入信号发送至管脚12，这样处理器从管脚12可以获取到scl输入信号，如果否，生成高电平的信号，并将该信号发送至管脚12，这样处理器从管脚12可以获取到该信号。相应于上述接口电路实施例，本申请实施例还提供一种信号处理方法，应用于可编程逻辑器件，可编程逻辑器件通过iic总线与iic设备连接，可编程逻辑器件通过处理器的多个管脚与处理器连接，其中，多个管脚包括电平信号管脚和信号方向管脚，电平信号管脚用于传输表示iic信号的电平信号，信号方向管脚用于传输表示电平信号的传输方向的方向信号；如图5所示，该信号处理方法包括：s501，从信号方向管脚接收处理器发送的方向信号；s502，对所获取的电平信号进行逻辑计算处理，并基于方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于方向信号，将获取到的电平信号发送至处理器。可选地，电平信号包括scl信号和sda信号，电平信号管脚包括用于传输scl信号的scl管脚和用于传输sda信号的sda管脚，信号方向管脚包括scl方向管脚和sda方向管脚，其中，scl方向管脚用于传输表示scl信号的传输方向的scl方向信号，sda方向管脚用于传输表示sda信号的传输方向的sda方向信号；所述从信号方向管脚接收处理器发送的方向信号(步骤s501)，可以包括：接收处理器通过scl方向管脚发送的scl方向信号，接收处理器通过sda方向管脚发送的sda方向信号；所述对所获取的电平信号进行逻辑计算处理，并基于方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于方向信号，将获取到的电平信号发送至处理器(步骤s502)，可以包括：对获取到的scl信号进行逻辑计算处理，并基于scl方向信号，将逻辑计算处理后的scl信号发送至iic设备，或，基于scl方向信号，将所获取的scl信号发送至处理器；对获取到的sda信号进行逻辑计算处理，并基于sda方向信号，将逻辑计算处理后的sda信号发送至iic设备，或，基于sda方向信号，将所获取的sda信号发送至处理器。可选地，scl信号包括输入处理器的scl输入信号和从处理器输出的scl输出信号，scl管脚包括用于传输scl输入信号的scl输入管脚和用于传输scl输出信号的scl输出管脚；所述对获取到的scl信号进行逻辑计算处理，并基于scl方向信号，将逻辑计算处理后的scl信号发送至iic设备，可以包括：当从scl方向管脚输出的scl方向信号表示输出方向时，接收从scl输出管脚输出的scl输出信号，对所接收到的scl输出信号进行逻辑计算处理，并将逻辑计算处理后的scl输出信号通过iic总线发送至iic设备；当从scl方向管脚输出的scl方向信号表示输入方向时，接收iic设备发送的scl输入信号，并将所接收到的scl输入信号发送至scl输入管脚。可选地，sda信号包括输入处理器的sda输入信号和从处理器输出的sda输出信号，sda管脚包括用于传输sda输入信号的sda输入管脚和用于传输sda输出信号的sda输出管脚；所述对获取到的sda信号进行逻辑计算处理，并基于sda方向信号，将逻辑计算处理后的sda信号发送至iic设备，包括：当从sda方向管脚输出的sda方向信号表示输出方向时，接收从sda输出管脚输出的sda输出信号，对所接收到的sda输出信号进行逻辑计算处理，并将逻辑计算处理后的sda输出信号通过iic总线发送至iic设备；当从sda方向管脚输出的sda方向信号表示输入方向时，接收iic设备发送的sda输入信号，并将所接收到的sda输入信号发送至sda输入管脚。可选地，所述从当scl方向管脚输出的scl方向信号表示输出方向时，接收从scl输出管脚输出的scl输出信号，对所接收到的scl输出信号进行逻辑计算处理，并将逻辑计算处理后的scl输出信号通过iic总线发送至iic设备，包括：在接收到从scl方向管脚输出的scl方向信号，并接收到从scl输出管脚输出的scl输出信号之后，判断该scl方向信号是否为低电平信号、且该scl输出信号是否为低电平信号，如果是，则生成低电平的scl输出信号，如果否，则生成高阻态的scl输出信号；所述从当scl方向管脚输出的scl方向信号表示输入方向时，接收iic设备发送的scl输入信号，并将所接收到的scl输入信号发送至scl输入管脚，包括：在接收到从scl方向管脚输出的scl方向信号后，判断该scl方向信号是否为高电平信号，如果是，接收iic设备发送的scl输入信号，并将所接收的scl输入信号发送至scl输入管脚，如果否，生成高电平的信号，并将该信号发送至scl输入管脚。可选地，所述从当sda方向管脚输出的sda方向信号表示输出方向时，接收从sda输出管脚输出的sda输出信号，对所接收到的sda输出信号进行逻辑计算处理，并将逻辑计算处理后的sda输出信号通过iic总线发送至iic设备，包括：接收到从sda方向管脚输出的sda方向信号，并接收到从sda输出管脚输出的sda输出信号之后，判断该sda方向信号是否为低电平信号、且该sda输出信号是否为低电平信号，如果是，则生成低电平的sda输出信号，如果否，则生成高阻态的sda输出信号；所述当从sda方向管脚输出的sda方向信号表示输入方向时，接收iic设备发送的sda输入信号，并将所接收到的sda输入信号发送至sda输入管脚，包括：接收到从sda方向管脚输出的sda方向信号后，判断该sda方向信号是否为高电平信号，如果是，接收iic设备发送的sda输入信号，并将所接收的sda输入信号发送至sda输入管脚，如果否，生成高电平的信号，并将该信号发送至sda输入管脚。可选地，该方法还可以包括：将电平信号的上升沿时间调整为满足iic协议的规范要求的上升沿时间；和/或，将电平信号的下降沿时间调整为满足iic协议的规范要求的下降沿时间。可选地，可编程逻辑器件包含第一端口和第二端口，其中，第一端口的电压为处理器的接口电平，第二端口的电压为iic设备的接口电平；可编程逻辑器件通过第一端口与多个管脚连接，通过第二端口与iic总线连接。可选的，所述电平信号中携带用于接收所述电平信号的iic设备的地址；所述对所获取的电平信号进行逻辑计算处理，并基于所述方向信号，将逻辑计算处理后的电平信号发送至所述iic设备，包括：当所述可编程逻辑器件连接有一个或多个iic设备时，对接收到的所述电平信号进行逻辑计算处理，并基于接收到的方向信号，将逻辑计算处理后的电平信号发送至所述地址对应的iic设备。可选地，sda信号中携带用于接收该sda信号的iic设备的地址；对获取到的sda信号进行逻辑计算处理，并基于sda方向信号，将逻辑计算处理后的sda信号发送至iic设备，包括：当可编程逻辑器件连接有一个或多个iic设备时，对接收到的sda信号进行逻辑计算处理，并基于接收到的sda方向信号，将逻辑计算处理后的sda信号发送至地址对应的iic设备。本申请实施例提供的技术方案中，可编程逻辑器件通过多个管脚与处理器连接，并通过iic总线与iic设备连接，其中多个管脚包括电平信号管脚和信号方向管脚，可编程逻辑器件对获取到的电平信号进行逻辑计算处理，并基于从信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于方向信号，将获取到的电平信号发送至处理器。通过本申请实施例提供的技术方案，处理器的管脚能够直接输出表示iic信号的电平信号和表示电平信号的传输方向的方向信号，这样，可编程逻辑器件也可以直接获取到表示iic信号的电平信号和表示电平信号的传输方向的方向信号，而不需再进行诸多处理来解决并行总线和iic总线的差异的问题，可编程逻辑器件仅需对电平信号进行逻辑计算处理，减少了可编程逻辑器件的处理操作，进而降低逻辑代码的复杂度，提高可编程逻辑器件的可靠性。相应于上述接口电路实施例，本申请实施例还提供一种信号处理装置，应用于可编程逻辑器件，可编程逻辑器件通过iic总线与iic设备连接，可编程逻辑器件通过处理器的多个管脚与处理器连接，其中，多个管脚包括电平信号管脚和信号方向管脚，电平信号管脚用于传输表示iic信号的电平信号，信号方向管脚用于传输表示电平信号的传输方向的方向信号；如图6所示，该信号处理装置包括：接收模块610，用于从信号方向管脚接收处理器发送的方向信号；逻辑计算模块620，用于对所获取的电平信号进行逻辑计算处理，并基于方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于所述方向信号，将获取到的电平信号发送至所述处理器。可选地，电平信号包括scl信号和sda信号，电平信号管脚包括用于传输scl信号的scl管脚和用于传输sda信号的sda管脚，信号方向管脚包括scl方向管脚和sda方向管脚，其中，scl方向管脚用于传输表示scl信号的传输方向的scl方向信号，sda方向管脚用于传输表示sda信号的传输方向的sda方向信号；接收模块610具体用于：接收所述处理器通过所述scl方向管脚发送的scl方向信号，接收所述处理器通过所述sda方向管脚发送的sda方向信号；逻辑计算模块620具体用于：对获取到的scl信号进行逻辑计算处理，并基于scl方向信号，将逻辑计算处理后的scl信号发送至iic设备，或，基于所述scl方向信号，将所获取的scl信号发送至所述处理器；对获取到的sda信号进行逻辑计算处理，并基于sda方向信号，将逻辑计算处理后的sda信号发送至iic设备，或，基于所述sda方向信号，将所获取的sda信号发送至所述处理器。可选地，scl信号包括输入处理器的scl输入信号和从处理器输出的scl输出信号，scl管脚包括用于传输scl输入信号的scl输入管脚和用于传输scl输出信号的scl输出管脚；逻辑计算模块620具体用于：当从所述scl方向管脚输出的scl方向信号表示输出方向时，接收从所述scl输出管脚输出的scl输出信号，对所接收到的scl输出信号进行逻辑计算处理，并将逻辑计算处理后的scl输出信号通过所述iic总线发送至所述iic设备；当从所述scl方向管脚输出的scl方向信号表示输入方向时，接收所述iic设备发送的scl输入信号，并将所接收到的scl输入信号发送至所述scl输入管脚。可选地，sda信号包括输入处理器的sda输入信号和从处理器输出的sda输出信号，sda管脚包括用于传输sda输入信号的sda输入管脚和用于传输sda输出信号的sda输出管脚；逻辑计算模块620具体用于：当从所述sda方向管脚输出的sda方向信号表示输出方向时，接收从所述sda输出管脚输出的sda输出信号，对所接收到的sda输出信号进行逻辑计算处理，并将逻辑计算处理后的sda输出信号通过所述iic总线发送至所述iic设备；当从所述sda方向管脚输出的sda方向信号表示输入方向时，接收所述iic设备发送的sda输入信号，并将所接收到的sda输入信号发送至所述sda输入管脚。可选地，逻辑计算模块620具体用于：在接收到从所述scl方向管脚输出的scl方向信号，并接收从所述scl输出管脚输出的scl输出信号之后，判断该scl方向信号是否为低电平信号、且该scl输出信号是否为低电平信号，如果是，则生成低电平的scl输出信号，如果否，则生成高阻态的scl输出信号；在接收到从所述scl方向管脚输出的scl方向信号后，判断该scl方向信号是否为高电平信号，如果是，接收所述iic设备发送的scl输入信号，并将所接收的scl输入信号发送至所述scl输入管脚，如果否，生成高电平的信号，并将该信号发送至所述scl输入管脚。可选地，逻辑计算模块620具体用于：在接收到从所述sda方向管脚输出的sda方向信号，并接收到从所述sda输出管脚输出的sda输出信号之后，判断该sda方向信号是否为低电平信号、且该sda输出信号是否为低电平信号，如果是，则生成低电平的sda输出信号，如果否，则生成高阻态的sda输出信号；在接收到从所述sda方向管脚输出的sda方向信号后，判断该sda方向信号是否为高电平信号，如果是，接收所述iic设备发送的sda输入信号，并将所接收的sda输入信号发送至所述sda输入管脚，如果否，生成高电平的信号，并将该信号发送至所述sda输入管脚。可选地，该装置还可以包括调整模块，该调整模块用于：将所述电平信号的上升沿时间调整为满足iic协议的规范要求的上升沿时间；和/或，将所述电平信号的下降沿时间调整为满足iic协议的规范要求的下降沿时间。可选地，可编程逻辑器件包含第一端口和第二端口，其中，第一端口的电压为处理器的接口电平，第二端口的电压为iic设备的接口电平；可编程逻辑器件通过第一端口与多个管脚连接，通过第二端口与iic总线连接。可选的，所述电平信号中携带用于接收所述电平信号的iic设备的地址；所述逻辑计算模块620具体用于：当所述可编程逻辑器件连接有一个或多个iic设备时，对接收到的所述电平信号进行逻辑计算处理，并基于接收到的方向信号，将逻辑计算处理后的电平信号发送至所述地址对应的iic设备。可选地，sda信号中携带用于接收该sda信号的iic设备的地址；逻辑计算模块620具体用于：当可编程逻辑器件连接有一个或多个iic设备时，对接收到的sda信号进行逻辑计算处理，并基于接收到的sda方向信号，将逻辑计算处理后的sda信号发送至地址对应的iic设备。本申请实施例提供的技术方案中，可编程逻辑器件通过多个管脚与处理器连接，并通过iic总线与iic设备连接，其中多个管脚包括电平信号管脚和信号方向管脚，可编程逻辑器件对获取到的电平信号进行逻辑计算处理，并基于从信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于方向信号，将获取到的电平信号发送至处理器。通过本申请实施例提供的技术方案，处理器的管脚能够直接输出表示iic信号的电平信号和表示电平信号的传输方向的方向信号，这样，可编程逻辑器件也可以直接获取到表示iic信号的电平信号和表示电平信号的传输方向的方向信号，而不需再进行诸多处理来解决并行总线和iic总线的差异的问题，可编程逻辑器件仅需对电平信号进行逻辑计算处理，减少了可编程逻辑器件的处理操作，进而降低逻辑代码的复杂度，提高可编程逻辑器件的可靠性。本申请实施例还提供了一种可编程逻辑器件，如图7所示，包括通用处理器710、通信接口720、存储器730和通信总线740，其中，通用处理器710，通信接口720，存储器730通过通信总线740完成相互间的通信；存储器730，用于存放计算机程序；通用处理器710，用于执行存储器730上所存放的程序时，实现如下步骤：从信号方向管脚接收处理器发送的方向信号；对所获取的电平信号进行逻辑计算处理，并基于方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于方向信号，将获取到的电平信号发送至处理器。本申请实施例提供的技术方案中，可编程逻辑器件通过多个管脚与处理器连接，并通过iic总线与iic设备连接，其中多个管脚包括电平信号管脚和信号方向管脚，可编程逻辑器件对获取到的电平信号进行逻辑计算处理，并基于从信号方向管脚接收到的方向信号，将逻辑计算处理后的电平信号发送至iic设备；或，基于方向信号，将获取到的电平信号发送至处理器。通过本申请实施例提供的技术方案，处理器的管脚能够直接输出表示iic信号的电平信号和表示电平信号的传输方向的方向信号，这样，可编程逻辑器件也可以直接获取到表示iic信号的电平信号和表示电平信号的传输方向的方向信号，而不需再进行诸多处理来解决并行总线和iic总线的差异的问题，可编程逻辑器件仅需对电平信号进行逻辑计算处理，减少了可编程逻辑器件的处理操作，进而降低逻辑代码的复杂度，提高可编程逻辑器件的可靠性。上述电子设备提到的通信总线可以是外设部件互连标准(peripheralcomponentinterconnect，pci)总线或扩展工业标准结构(extendedindustrystandardarchitecture，eisa)总线等。该通信总线可以分为地址总线、数据总线、控制总线等。为便于表示，图中仅用一条粗线表示，但并不表示仅有一根总线或一种类型的总线。通信接口用于上述电子设备与其他设备之间的通信。存储器可以包括随机存取存储器(randomaccessmemory，ram)，也可以包括非易失性存储器(non-volatilememory，nvm)，例如至少一个磁盘存储器。可选的，存储器还可以是至少一个位于远离前述处理器的存储装置。上述的通用处理器或处理器可以包括中央处理器(centralprocessingunit，cpu)、网络处理器(networkprocessor，np)等；还可以是数字信号处理器(digitalsignalprocessing，dsp)、专用集成电路(applicationspecificintegratedcircuit，asic)、现场可编程门阵列(field-programmablegatearray，fpga)或者其他可编程逻辑器件、分立门或者晶体管逻辑器件、分立硬件组件。相应于上述信号处理方法实施例，本申请实施例还提供一种机器可读存储介质，该机器可读存储介质内存储有计算机程序，该计算机程序被通用处理器执行时实现上述任一所述的信号处理方法步骤。需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。本说明书中的各个实施例均采用相关的方式描述，各个实施例之间相同相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。尤其，对于信号处理方法、信号处理装置、可编程逻辑器件以及机器可读存储介质实施例而言，由于其基本相似于接口电路实施例，所以描述的比较简单，相关之处参见接口电路实施例的部分说明即可。以上所述仅为本申请的较佳实施例而已，并非用于限定本申请的保护范围。凡在本申请的精神和原则之内所作的任何修改、等同替换、改进等，均包含在本申请的保护范围内。当前第1页12