一种优化USB链路阻抗的方法与流程

本发明涉及主板信号传输线路的改进，尤其涉及一种优化usb链路阻抗的方法。

背景技术：

usb(universalserialbus)全称通用串行总线，用于规范主机与外部设备的连接和通讯。usb是应用在pc、电子通讯领域的接口技术，支持设备的即插即用和热插拔功能，由于其传输数据信号强、适用范围广，因而被广泛用于多种电子设备中。

usb设备系统分为两个部分，usbhost端和usbdevice端，以usb接口的u盘为例子，u盘自身是一个usbdevice，pc机的usb接口以及相关的控制电路为usbhost部分。每个部分由硬件部分和软件部分组成，硬件部分由usb主机控制器和usb接口芯片来组成，固件(软件)由两侧的驱动程序组成。

在传统数字系统中，高速互联现象常常可以忽略不计，因为它们对系统的性能影响很微弱。然而，随着计算机技术发展，在众多决定系统性能的因素里，高速互联现象正起着主导作用，常常导致一些不可预见问题的出现，极大的增加了系统设计及使用的复杂性。

在服务器系统高速信号链路设计过程中，链路阻抗的优化设计尤其重要，若链路阻抗连续性较差，会引起信号反射、增加链路损耗，进而影响信号传输质量，甚至导致设计失败和产品故障。在usb链路中由于常会含有线缆cable，阻抗不连续点较多，因此在usb链路设计时进行阻抗优化显得尤为重要。

在现有的usb链路中，针对链路阻抗连续性问题，通常会采用分板卡阻抗管控，尽量保证每块板卡上的阻抗一致，例如，在pcb上使用均匀传输线以保证传输线在板卡上感受到的容性及感性相同，降低阻抗突变带来的反射等影响。通常，主板上会以85ohm的差分阻抗管控pcb走线。

虽然这种措施能够在一定程度上降低阻抗不连续性，保证局部的阻抗连续性，但由于整个usb链路除了主板外还会有cable、前控板等部分，这些部分的阻抗和主板走线阻抗并不一定相同，这就导致usb链路局部阻抗一致但整体仍存在阻抗不连续的现象，同样会影响信号传输质量。对此，现有技术中大多通过降低链路阻抗的方式，来优化usb链路，但导致usb链路在整体的阻抗优化上存在不足，也是本领域迫切需要解决的问题。

技术实现要素：

本发明提供一种优化usb链路阻抗的方法，用于解决现有技术存在的问题。

本发明通过以下技术方案予以实现：

一种优化usb链路阻抗的方法，包括安装有信号发射端、连接器的主板以及用于外部usb设备与连接器之间信号传输的usb线缆，所述信号发射端、连接器、usb线缆之间依次电连接并形成usb信号传输链路，所述usb信号传输链路阻抗优化方法通过以下步骤实现：

s1.将主板信号发射端至连接器的usb信号传输链路，根据主板布局分布分成bga区和正常走线区，所述bga区和正常走线区内的usb链路阻抗相同；

s2.将主板连接器和usb线缆之间的usb信号传输链路，其usb链路阻抗设置为bga区或正常走线区内的usb链路阻抗相同。

如上所述的一种优化usb链路阻抗的方法，所述bga区和正常走线区内的usb链路阻抗均为90ohm。

如上所述的一种优化usb链路阻抗的方法，所述bga区和正常走线区内的usb链路具有相同的走线宽度和间距。

如上所述的一种优化usb链路阻抗的方法，所述bga区的usb链路走线宽度和间距分别为3.5mil、4mil，所述正常走线区内的usb链路走线宽度和间距分别为4.4mil、7.8mil。

如上所述的一种优化usb链路阻抗的方法，所述信号发射端为中央处理器、逻辑芯片或发射芯片。

与现有技术相比，本发明的优点在于：

本发明提出了在usb链路设计时需要关注链路整体的阻抗，通过优化主板正常区走线的阻抗，保证主板正常区走线与bga走线的阻抗一致，避免信号阻抗先降后升，提高链路阻抗一致性；同时，与现有技术所采用的常见阻抗优化措施相反，本发明通过增高正常区走线usb链路阻抗，保证了整体链路阻抗的统一性，取得了较好的效果。

附图说明

为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作一简单地介绍。

图1是本实施例的usb链路拓扑图；

图2是本实施例的usb链路阻抗仿真对比图；

图3是本实施例的正常走线区usb链路损耗仿真图。

附图标记：1-主板，11-bga区，12-正常走线区，2-信号发射端，3-连接器，4-usb线缆，5-usb设备，51-usb接收端。

具体实施方式

为使本发明实施例的目的、技术方案和优点更加清楚，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明一部分实施例，而不是全部的实施例。

如图1-图3所示，本实施例公开的一种优化usb链路阻抗的方法，包括安装有信号发射端2、连接器3的主板1以及用于外部usb设备5与连接器3之间信号传输的usb线缆4，信号发射端2、连接器3、usb线缆4之间依次电连接并形成usb信号传输链路，usb信号传输链路阻抗优化方法通过以下步骤实现：

s1.将主板1信号发射端2至连接器3的usb信号传输链路，根据主板1布局分布分成bga区11和正常走线区12，bga区11和正常走线区12内的usb链路阻抗相同；

s2.将主板1连接器3和usb线缆4之间的usb信号传输链路，其usb链路阻抗设置为bga区11或正常走线区12内的usb链路阻抗相同。

本实施例针对现有技术中存在的usb整体链路阻抗不连续的问题，对传统主板的usb链路方式和采用本发明的主板usb链路阻抗优化进行对比仿真，比较不同情况下链路的阻抗连续性。

以图1所示的某特定主板上的usb链路拓扑为例详细说明。在usb链路的传输路径中，信号从发射端发出后经bga区和正常区走线到达连接器3，经usb线缆4到达终端usb设备5和usb接收端51。

设该链路bga区阻抗90ohm，bga区走线长度l1为1.5inch，正常区走线l2为8inch，usb线缆4cable长度20inch，阻抗90ohm。

为了突出主板1正常区走线对整体链路的影响，仿真验证过程中忽略链路中usb线缆4两端连接器3及过孔的影响，分别对bga区11走线、正常走线区12、usb线缆4进行建模。改进后的设计通过调整正常区走线的线宽线距以达到目标阻抗，改进前后的链路信息对比如下表1所示：

表1改进前后的链路信息表

使用两种方法形成的链路阻抗仿真结果，如图2所示，可以明显看出，改前链路阻抗有先降后升的变化趋势，这是由于信号先后经过bga区走线90ohn、正常区走线85ohmh和usb线缆90ohm。改进后的设计明显比较平滑，信号在主板1上的阻抗都是90ohm，避免先降后升的过程，有利于链路整体的阻抗连续性，阻抗一致性优于原始设计。

在正常区走线的阻抗管控过程中，也可以让正常走线区的线宽、线距与bga区保持一致，选择线宽线距为3.5/4mil，这样也能保证阻抗与bga区相同。但是正常区走线空间比bga区大，若线宽线距较小，会增加整体链路的损耗，所以本实施例中如上表所示，根据主板实际布线空间分布，选择线宽线距为4.4/7.8mil，在保证链路阻抗的前提下，又尽量不增加额外的链路损耗，最大程度的优化信号质量。

如图3所示，根据正常走线区usb链路损耗仿真结果看，上述两种情况下主板走线l2的损耗，可以看出优化后的链路损耗优于bga设计。

综合上述仿真结果分析，通过优化usb链路中主板正常走线区的阻抗设计，可以有效提高整体链路的阻抗一致性，降低反射；通过设计合理的线宽线距，可以降低链路损耗，提高信号传输质量。

链路阻抗一致性对链路信号质量有重要影响，在usb链路设计时要整体考量各部分阻抗设计规则，设计时通过合理优化主板正常走线区的线宽线距，保证主板正常区走线与bga走线的阻抗一致，同时避免增加链路损耗，提高链路阻抗一致性，优化信号传输质量。

本发明未详尽描述的技术内容均为公知技术。