栅极结构、半导体器件以及形成半导体器件的方法与流程

本发明的实施例涉及半导体领域，更具体地涉及栅极结构、半导体器件以及形成半导体器件的方法。

背景技术：

半导体工业已经经历了指数增长，朝着更高的密度和器件性能以及更低的成本的目标不断发展。除了诸如金属氧化物半导体场效应晶体管(mosfet)的传统的平面晶体管之外，已经开发了诸如鳍状场效应晶体管(finfet)的各种非平面晶体管或三维(3d)晶体管，以实现更高的器件密度以及优化器件功效。平面和3dfet两者的制造都专注于尺寸按比例缩小以增加半导体器件的封装密度。

随着对于平面和3dfet的高密度集成的增强的需求，迫切需要不断完善finfet的制造方法，以获得更加加强的半导体结构。

技术实现要素：

本发明的实施例提供了一种栅极结构，包括：栅极堆叠件，包括：掺杂的功函数金属(wfm)堆叠件；和金属栅电极，位于所述掺杂的功函数金属堆叠件上面；以及掺杂的间隔件，位于所述栅极堆叠件的侧壁上面。

本发明的实施例还提供了一种半导体器件，包括：衬底，具有源极区域和漏极区域；栅极堆叠件，位于介于所述源极区域和所述漏极区域之间的衬底上面，所述栅极堆叠件包括：掺杂的栅极氧化物层；掺杂的功函数金属(wfm)堆叠件，位于所述掺杂的栅极氧化物层上面；和金属栅电极，位于所述掺杂的功函数金属堆叠件上面；掺杂的氧化物层，位于所述衬底的表面上面；以及掺杂的间隔件，位于所述掺杂的氧化物层上面并且位于所述栅极堆叠件的侧壁上面。

本发明的实施例还提供了一种形成半导体器件的方法，所述方法包括：在衬底上面形成氧化物层，所述衬底具有源极区域和漏极区域；形成第一栅极堆叠件和间隔件，其中，所述第一栅极堆叠件位于介于所述源极区域和所述漏极区域之间的衬底上面，并且所述间隔件位于所述第一栅极堆叠件的侧壁上面；掺杂所述氧化物层和所述间隔件，以形成掺杂的氧化物层和掺杂的间隔件；在所述衬底上面并且在所述掺杂的间隔件之间形成功函数金属(wfm)堆叠件；热处理所述掺杂的间隔件和所述掺杂的氧化物层，以形成掺杂的功函数金属堆叠件；以及在所述掺杂的功函数金属堆叠件上面形成金属栅电极，以形成第二栅极堆叠件。

附图说明

当结合附图进行阅读时，根据下面详细的描述可以最佳地理解本发明的各个方面。应该注意，根据工业中的标准实践，各种部件没有被按比例绘制。实际上，为了清楚的讨论，各种部件的尺寸可以被任意增加或减少。

图1是根据一些实施例的半导体器件的截面图。

图2是根据一些其他实施例的另一半导体器件的截面图。

图3是根据又一些实施例的又一半导体器件的截面图。

图4是根据一些实施例的形成半导体器件的工艺流程。

图5a至图5f是根据一些实施例的形成半导体器件的方法的中间阶段的截面图。

具体实施方式

以下公开内容提供了许多不同实施例或实例，用于实现所提供主题的不同特征。以下将描述组件和布置的具体实例以简化本发明。当然，这些仅是实例并且不意欲限制本发明。例如，在以下描述中，在第二部件上方或上形成第一部件可以包括第一部件和第二部件直接接触的实施例，也可以包括形成在第一部件和第二部件之间的附加部件使得第一部件和第二部件不直接接触的实施例。而且，本发明在各个实例中可以重复参考数字和/或字母。这种重复仅是为了简明和清楚，其自身并不表示所论述的各个实施例和/或配置之间的关系。

除非上下文另外清楚规定，单数形式“一”、“一个”和“所述”包括复数所指。因此，除非上下文另外清楚地指示，例如，关于形貌(topography)区域包括具有两个或多个这种形貌区域的方面。此外，为了便于描述，本文中可以使用诸如“在…下方”、“在…下面”、“下部”、“在…上面”、“上部”等的空间关系术语，以描述如图中所示的一个元件或部件与另一元件或部件的关系。除了图中所示的方位外，空间关系术语旨在包括器件在使用或操作过程中的不同方位。装置可以以其他方式定位(旋转90度或在其他方位)，并且在本文中使用的空间关系描述符可以同样地作相应地解释。

虽然通过参考半导体结构的形成来解释本发明，但是应该理解，本发明等同应用与任何制造工艺，其中可以有利地形成半导体结构。

如前所述，制造具有按比例缩小的尺寸的mosfet或finfet中的栅极结构越来越具有挑战性。在形成栅极结构的工艺中，第一步是为了形成由多晶硅制成的伪栅极，之后形成位于伪栅极的侧壁上的一对间隔件。然后，去除伪栅极以留下间隔、并且促进将要被填充在间隔中的电极、功函数金属(wfm)堆叠件和下面的栅极氧化物层的填充、以及形成栅极结构。

然而，随着mosfet或finfet的尺寸的按比例缩小，栅极堆叠件的宽度或间隔件之间的距离不断缩小，这不仅使得在去除伪栅极之后难以通过栅极填充窗将栅极材料填充在间隔件之间的间隔中，而且管型(casts)不利地影响mosfet或finfet的性能。由于栅极堆叠件的变窄的宽度，所以源极和漏极区域之间的结也变短了。变短的结导致缩短的电子沟道。

缩短的沟道导致有限的亚阈值斜率，影响阈值电压，并且因此在源极和漏极之间的电压差变得显著时导致来自源极区域的电子隧穿至漏极区域。换句话说，从漏极区域至源极区域的截止状态的泄漏电流增加，这也被称为漏极感应势垒降低(draininductionbarrierlower，dibl)。

除了dibl之外，短沟道还诱发金属栅极和源极/漏极区域之间的短路，这也有助于泄漏电流。短沟道的以上影响可以统称为短沟道效应(sce)，这是有关半导体器件的性能的主要问题。

虽然通过选择性地外延硅生长使源极/漏极(s/d)区域凸起来减少电流泄漏，但是仍存在诸如s/d区域的电阻的其他缺陷。然而，s/d区域的掺杂可以改善这些缺陷，掺杂s/d区域中的需要的热工艺不期望地增加了掺杂剂的横向扩散，从而增加了栅极至漏极重叠电容(gatetodrainoverlapcapacitance)。而且，为了补偿由于热工艺导致的s/d区域中的掺杂剂损失，可以采用s/d区域中的更高的注入剂量。尽管如此，s/d区域中的掺杂剂的增加的浓度不仅带来更深的s/d结深度(xj)。结深度越深，短沟道效应越显著。

虽然超浅结(usj)的形成可以抵消增加的结深度的影响，但是需要更高的掺杂剂注入浓度来避免较浅的结深度处的寄生电阻的增加。形成超浅结所需的掺杂剂注入是困难的，并且对通过形成无定形或无序晶格区域来对衬底造成损害，从而不能解决问题。因此，迫切需要对利用按比例缩小的尺寸制造mosfet或finfet的方法的不断改进以克服短沟道效应。

为了解决上述问题，本发明提供一种栅极结构、一种半导体器件和用于形成半导体器件的方法，其包括掺杂的间隔件和掺杂的氧化物层以克服mosfet或finfet中的短沟道效应。通过这种方式，尽管mosfet或finfet尺寸的按比例缩小，但是可以提高半导体器件的封装密度和性能。

参考图1，示出了根据一些实施例的半导体器件100的示例性区域布置的截面图。半导体器件100包括栅极结构200，在一些实施例中该半导体器件还称为场效应晶体管(fet)。

在各个实施例中，栅极结构200包括栅极堆叠件210和位于栅极堆叠件210的侧壁上面的间隔件220'。栅极堆叠件210可以包括栅电极、位于栅电极下面的功函数金属(wfm)堆叠件212'、以及位于功函数金属(wfm)堆叠件212'下面的栅极氧化物层215'。在一些实施例中，可以通过包括沉积、光刻图案化和蚀刻的任何适当的方法来形成栅极堆叠件210。沉积方法包括化学汽相沉积(cvd)、物理汽相沉积(pvd)、原子层沉积(ald)或它们的组合。

在各个实施例中，电流可以施加至栅电极上。一旦来自栅电极的输入电流达到阈值电压(vt)，负电荷将可以相应地累积在栅极氧化物层215'下方，并且可以在栅极结构200下方感应介于源极区域110和漏极区域111(也称为源极/漏极(s/d)区域)之间的电子沟道。

在一些实施例中，栅极结构200的阈值电压主要由功函数金属(wfm)堆叠件212'确定。功函数指示在邻近的电场作用下从固体表面移除电子至闭合位置(closeposition)的最小热力学功或能量。因此，功函数金属堆叠件212'通过影响栅极堆叠件210下面的电子的自由能量来调制阈值电压调谐(tuning)。

在一些实施例中，栅电极可以由多晶硅(poly-si)或多晶硅锗(poly-sige)初始形成。然而，如果poly-si栅电极与由二氧化硅(sio2)制成的栅极氧化物结合，那么可以诱使阈值电压不稳定并且诱发泄漏电流。因此，可以最终由金属材料来替换栅电极以改善阈值电压调制和半导体器件性能。在各个实施例中，用于金属栅电极216的材料包括钽(ta)、氮化钽(tan)、铌(nb)、碳化钽(tac)、钨(w)、氮化钨(wn)、碳化钨(wc)、以及任何合适的金属或它们的组合。

另外，为了完全克服以上问题，需要同时完成金属栅电极216的引入和具有高介电常数(高k)的栅极氧化物层215'的引入。在各个实施例中，由于镧(la)是强电正性金属，所以诸如氧化镧(la2o3)的氧化物适合于n型fet(nfet)。另一方面，由于防止外在功函数偏移的能力，所以氧化铝(al2o3)适合于p型fet(pfet)。通常，栅极氧化物层215'可以由以下介电材料制成，诸如：氧化铝(al2o3)、氧化镧(la2o3)、氧化钽(ta2o5)、氧化钛(tio2)、氧化铪(hfo2)、二氧化硅(sio2)、氧化铪硅(hfsio)、氧化锆(zro2)、以及任何合适的金属或它们的组合。

由于从低k/poly-si栅极至高k/金属栅极的转变，需要相应地修改功函数金属堆叠件212'以满足栅极结构200的阈值电压要求。由于上部中间禁带(uppermid-gap)功函数、突出的热稳定性和独特的扩散特性，所以氮化钛(tin)用作wfm的合适的候选者。对于二维mosfet和三维finfet的栅极堆叠件增强而言，为了获得期望的有效功函数(ewf)而对tin的功函数进行的修改是至关重要的。除了增加tin层的厚度以提高wfm堆叠件中的ewf之外，引入诸如氮化钛硅(tisin)层的另一层高k功函数金属还可以微调ewf。

因此，在各个实施例中，wfm堆叠件212'包括tin层213'和位于tin层213'下面的tisin层214'。由于tisin层214'和栅极氧化物层215'两者都是无定形的并且具有高介电常数(通常高于二氧化硅的介电常数或3.9)，所以tisin层214'可以用于与下面的栅极氧化物层215'协调以提高栅极结构200的性能。

就长沟道晶体管而言，阈值电压由施加至源极/漏极区域之间的沟道的守恒电荷以及包括tin层和tisin层的功函数金属(wfm)的特点确定。然而，随着半导体器件的按比例缩小，栅极结构200的宽度和栅极氧化物层215'的厚度以及s/d区域之间的更近的结(closerjunctions)不断减小，从而导致短沟道晶体管。就短沟道晶体管而言，随着沟道长度减少，阈值电压出现衰减，并且因此阈值电压不仅受到wfm堆叠件212'影响，还受到更近的结的影响。

为了抵消短沟道晶体管中的短沟道效应(sce)和热载荷效应(hce)，s/d区域的位于栅极结构200下面的部分被轻掺杂，形成轻掺杂漏极/源极(ldd)区域112，还称为源极/漏极延伸(sde)区域。然而，仅掺杂ldd区域112显示出对于克服sce的有限的影响以及对于短沟道器件中的阈值电压的控制的更加有限的作用。

还通过掺杂wfm堆叠件212'来改善阈值电压的调制。对于n型晶体管(nfet)来说，如果通过n型掺杂剂掺杂wfm堆叠件212'中的tisin层214'和tin层213'，那么可以降低阈值电压。相反地，如果通过p型掺杂剂掺杂wfm堆叠件212'中的tisin层214'和tin层213'，那么可以提高阈值电压。对于p型晶体管(pfet)来说，阈值电压的调制是相反的。为了实现wfm堆叠件212'的掺杂，需要额外的层来用作栅极结构200中的掺杂剂施主(donors)。

根据各个实施例，形成位于栅极结构200的侧壁上面的间隔件220'。高浓度的掺杂剂密封在间隔件220'中以形成掺杂的间隔件220，从而用作wfm堆叠件212'的掺杂剂施主。如果栅极堆叠件210和栅极堆叠件210下面的衬底102形成n型晶体管，那么掺杂的间隔件220掺杂有硼(b)或其他p型掺杂剂，以增加阈值电压并且减小由sce导致的泄漏电流。如果栅极堆叠件210和栅极堆叠件210下面的衬底102形成p型晶体管，那么掺杂的间隔件220掺杂有砷(as)或其他n型掺杂剂，以增加阈值电压并且抵消由sce导致的泄漏电流。

掺杂的间隔件220的掺杂浓度为大约5×10²⁰原子/立方厘米至大约5×10²¹原子/立方厘米，以提供至wfm堆叠件212'中的足够的掺杂剂。在一些实施例中，掺杂的间隔件220由以下介电材料制成，包括氮化硅(sin)、氮氧化硅(sion)、碳化硅(sic)、碳氧化硅(sioc)、碳氮氧化硅(sicon)、氟氧化硅(siof)或它们的组合。

在一些实施例中，通过热工艺的集合来促使掺杂剂的固态扩散(sfd)从掺杂的间隔件220至wfm堆叠件212'，导致包括掺杂的tisin层214和掺杂的tin层213的掺杂的功函数金属(wfm)堆叠件212和掺杂的栅极氧化物层215。由于掺杂的wfm堆叠件212中的掺杂剂与掺杂的氧化物层300中的掺杂剂和掺杂的间隔件220中的掺杂剂相同，所以nmos和n型finfet中的掺杂剂是硼，而pmos和p型finfet中的掺杂剂是砷。在一些实施例中，在比掺杂的间隔件220的浓度低或由于扩散梯度而在低于大约5×10²⁰原子/立方厘米至大约5×10²¹原子/立方厘米的浓度下对掺杂的wfm堆叠件212进行掺杂。

取决于栅极堆叠件210下面的衬底102的轮廓，可以在不同类型的fet中出现从掺杂的间隔件220至wfm堆叠件中的掺杂剂的固态扩散(sfd)。在一些实施例中，衬底102包含源极区域110和漏极区域111，其可以一起称为源极/漏极(s/d)区域。衬底102可以嵌入基底层(未示出)中，并且因此，栅极堆叠件210可以位于基底层以及衬底102的介于源极区域110和漏极区域111之间的顶面上方，这形成了平面集成电路结构，还称为mosfet。

在一些其他的实施例中，具有源极区域110和漏极区域111的衬底102是位于基底层上面的凸起的区域，从而形成三维鳍结构。栅极堆叠件210位于基底层和一个或多个凸起的鳍结构上方，从而形成三维集成电路结构，还称为finfet。

在一些实施例中，衬底102的材料包括：硅；硅锗；碳化硅；砷化镓；磷化镓；磷化铟；砷化铟；锑化铟；包括sige、gaasp、alinas、algaas、gainas、gainp、gainasp的合金半导体；或它们的组合。在各个实施例中，可以通过邻近s/d区域的浅沟槽隔离(sti)区域来隔离不同组s/d区域。sti区域可以由介电材料组成，诸如氧化硅、氮化硅、氮氧化硅、掺杂氟的硅酸盐玻璃和它们的组合。

可以通过诸如光刻和蚀刻的任何合适的工艺制造衬底102。光刻可以包括：在衬底102上方形成(如，旋涂)光刻胶层(未示出)、软烘、掩模对准、通过曝光图案化光刻胶层、操作曝光后烘焙、以及显影图案以形成在执行蚀刻以形成衬底102时用作衬底的保护部件的光刻胶掩模。

在一些实施例中，为了进一步完成wfm堆叠件212'，氧化物层300'可以形成在衬底102上以覆盖衬底102的暴露的表面。换句话说，氧化物层300'形成在衬底102的表面上以围绕栅极堆叠件210或者形成在衬底102的未与栅极堆叠件210接触的表面上。还为了用作wfm堆叠件212'的掺杂剂施主，氧化物层300'还掺杂有高浓度的掺杂剂以形成掺杂的氧化物层300。当栅极堆叠件210和位于栅极堆叠件210下面的衬底102形成诸如n型mosfet(nmos)或n型finfet的nfet时，掺杂的氧化物层300掺杂有硼(b)或其他p型掺杂剂。当栅极堆叠件210和位于栅极堆叠件210下面的衬底102形成诸如p型mosfet(pmos)或p型finfet的pfet时，掺杂的氧化物层300掺杂有砷(as)或其他n型掺杂剂。

掺杂的氧化物层300的掺杂浓度为大约5×10²⁰原子/立方厘米至大约5×10²¹原子/立方厘米，以提供至wfm堆叠件212'中的足够的掺杂剂并且有助于掺杂的wfm堆叠件212的形成。在一些实施例中，掺杂的氧化物层300由以下介电材料制成，诸如：氧化铝(al2o3)、氧化镧(la2o3)、氧化铝镧(allao3)、氧化钽(ta2o5)、氧化钛(tio2)、氧化铪(hfo2)、二氧化硅(sio2)、氧化铪硅(hfsio)和氧化锆(zro2)。

接下来参考图2，示出了根据一些实施例的另一半导体器件的截面图。衬底102包含源极区域110、漏极区域111、一组ldd区域112和一组sti区域104。在一些实施例中，栅极结构200位于源极区域110和漏极区域111之间的衬底102上面。更具体地，栅极结构200位于介于两个ldd区域112之间的衬底102上面。掺杂的氧化物层300形成在衬底102上以围绕栅极结构200，更具体地介于两个sti区域104之间。

在各个实施例中，栅极堆叠件210包括金属栅电极216、位于金属栅电极216下面的掺杂的功函数金属(wfm)堆叠件212、以及位于掺杂的功函数金属(wfm)堆叠件212下面的掺杂的栅极氧化物层215。在一些实施例中，掺杂的间隔件220仅位于栅极堆叠件210的侧壁和掺杂的氧化物层300的邻近栅极堆叠件210的侧壁的部分上面。由于掺杂的氧化物层300和掺杂的间隔件220两者可以用作掺杂剂施主，并且掺杂的间隔件220的位于栅极结构200的侧壁和掺杂的氧化物层300上面的部分可以完全覆盖wfm堆叠件212'，所以掺杂的间隔件220的位于掺杂的氧化物层300上面的部分成为可选的，这是因为该部分未与wfm堆叠件212'直接接触。换句话说，在一些实施例中，掺杂的氧化物层300未被掺杂的间隔件220覆盖，但是掺杂的氧化物层300邻近栅极堆叠件210。换句话说，掺杂的间隔件220包括位于栅极堆叠件210的侧壁和邻近栅极堆叠件210的掺杂的氧化物层300上面的部分、以及位于不邻近栅极堆叠件210的掺杂的氧化物层300上面的部分。由于掺杂的间隔件220的位于不邻近栅极堆叠件210的掺杂的氧化物层300上面的部分与wfm堆叠件212'不接触，所以该部分不能用作掺杂剂施主，并且因此，该部分是可选的。在各个实施例中，邻近栅极堆叠件210的掺杂的氧化物层300位于ldd区域112上面，而不邻近栅极堆叠件210的掺杂的氧化物层300位于s/d区域和sti区域104上面。

参考图3，示出了根据一些实施例的又一半导体器件的截面图。衬底102包括源极区域110、漏极区域111、介于源极/漏极区域之间的ldd区域112、以及邻近源极/漏极区域的一组sti区域104。栅极结构200位于源极区域110和漏极区域111之间的衬底102上面。更具体地，栅极结构200形成在介于两个ldd区域112之间的衬底102上方。

在一些实施例中，掺杂的间隔件220位于栅极堆叠件210的侧壁和介于两个sti区域104之间的衬底102上面。由于掺杂的间隔件220和掺杂的氧化物层300两者可以用作掺杂剂施主，并且掺杂的栅极氧化物层215的介电功能可以代替掺杂的氧化物层300的介电功能，所以掺杂的氧化物层300成为可选的。换句话说，一旦掺杂的间隔件220位于衬底102上面，就可以利用掺杂的间隔件220来代替掺杂的氧化物层300的掺杂功能，并且因此掺杂的氧化物层300可以是可选的。换句话说，在一些其他的实施例中，半导体器件100不包括掺杂的氧化物层300，并且掺杂的间隔件220位于栅极堆叠件210的侧壁和衬底102的表面两者上面。(见图3)。

接下来参考图4，示出了根据一些实施例的形成半导体器件的工艺流程图。在形成半导体器件100中，其中提供具有源极区域110和漏极区域111的衬底102，并且执行在衬底102上面形成氧化物层300'的过程402。在适当地去除氧化物层300'的一部分之后，第一栅极堆叠件211可以形成在介于源极区域110和漏极区域111之间的衬底102上方，并且间隔件220'可以形成在第一栅极堆叠件211的侧壁上方，以上都包括在过程404中。

在各个实施例中，在形成氧化物层300'、第一栅极堆叠件211和间隔件220'之后，然后进行掺杂氧化物层300'和间隔件220'的过程406，以将氧化物层300'和间隔件220'转变成掺杂剂施主。在掺杂工艺之后，执行将wfm堆叠件212'形成为掺杂剂受主(acceptor)的过程408。然后，执行对掺杂的氧化物层300和掺杂的间隔件220进行热处理的过程410，以将掺杂剂的固态扩散(spd)从掺杂的氧化物层300和掺杂的间隔件220驱动至wfm堆叠件212'。热扩散工艺之后是在掺杂的wfm堆叠件212上面形成金属栅电极216的过程412，以形成第二栅极堆叠件。

参考图5a，提供衬底102，该衬底具有源极区域110、漏极区域111、邻近源极区域110和漏极区域111的内侧壁的一对轻掺杂源极/漏极(ldd)区域112、以及邻近源极区域110和漏极区域111的外侧壁的一对浅沟槽隔离(sti)区域。形成半导体器件100的第一步是在衬底102上方形成氧化物层300'。形成方法包括化学汽相沉积(cvd)、等离子体增强的cvd(pecvd)、原子层cvd(alcvd)、低压cvd(lpcvd)、任何其他适当的沉积方法和它们的组合。

参考图5b，氧化物层300'可以经受光刻以蚀刻掉氧化物层300'的位于介于源极区域110和漏极区域111之间的衬底102上面的部分、并且留下用于将要在介于源极区域110和漏极区域111之间的衬底102上形成第一栅极堆叠件211的空间。光刻可以包括：在氧化物层300'上方形成光刻胶层(未示出)、掩模对准、通过曝光图案化光刻胶层、以及显影图案以形成光刻胶掩模。在执行蚀刻以去除氧化物层300'的位于介于源极区域110和漏极区域111之间的衬底102上面的部分时，光刻胶掩模用作氧化物层300'的保护部件。

在氧化物层300'的蚀刻之后，暴露衬底102的介于源极区域110和漏极区域111之间的部分，第一栅极堆叠件211可以形成在该部分上。第一栅极堆叠件211还可以称为伪栅极堆叠件，其可以由诸如多晶硅(poly-si)、多晶硅锗(poly-sige)、氮化硅(sin)和它们的组合的材料制成。第一栅极堆叠件211的形成之后，间隔件220'可以形成在为沿着第一栅极堆叠件211的侧壁并且位于氧化物层300'的表面上面。形成方法包括化学汽相沉积(cvd)、等离子体增强的cvd(pecvd)、原子层cvd(alcvd)、低压cvd(lpcvd)、任何其他适当的沉积方法和它们的组合。

接下来参考图5c，间隔件220'可以在大约5×10²⁰原子/立方厘米至大约5×10²¹原子/立方厘米的浓度下掺杂有诸如硼(b)或砷(as)的掺杂剂，以形成掺杂的间隔件220并且用作wfm堆叠件的掺杂剂施主。可以通过适当的掺杂方法来掺杂间隔件220'，包括通过原子层沉积(ald)的原位掺杂或通过等离子体沉积或离子金属等离子体(imp)沉积的非原位掺杂。

在一些实施例中，氧化物层300'可以在大约5×10²⁰原子/立方厘米至大约5×10²¹原子/立方厘米的浓度下掺杂有诸如硼(b)或砷(as)的掺杂剂，以形成作为wfm堆叠件的掺杂剂施主的掺杂的氧化物层300。可以通过适当的掺杂方法来掺杂氧化物层300'，包括通过等离子体沉积或离子金属等离子体(imp)沉积的非原位掺杂。

参考图5d，可以去除第一栅极堆叠件211以暴露介于s/d区域之间的衬底并且有助于在衬底的暴露表面上形成wfm堆叠件212'。在形成wfm堆叠件212'之前，进行外延工艺或外延生长过程，以促进无定形(amorphous)栅极氧化物层215'的形成。利用高介电常数或高于3.9的介电常数，栅极氧化物层215'用作层间介电材料以调制wfm堆叠件的有效功函数。在各个实施例中，通过首先沉积tisin层214'、之后通过在tisin层214'上沉积tin层213'，在栅极氧化物层215'上形成wfm堆叠件212'。

接下来参考图5e，通过热工艺执行wfm堆叠件212'和栅极氧化物层215'的掺杂。热工艺还可以划分为两个阶段：后金属退火(post-metalannealing，pma)和后盖退火(post-capannealing，pca)。在形成wfm堆叠件212'之后直接进行后金属退火(pma)以有助于从掺杂的间隔件220和掺杂的氧化物层300至wfm堆叠件212'的tin层213'中的掺杂剂的固态扩散。在各个实施例中，在大约750℃至大约900℃的温度下执行后金属退火(pma)并且持续大约1秒至大约30秒以将掺杂剂迅速地驱动至wfm堆叠件212'中，同时防止来自ldd区域112的掺杂剂的不期望的外扩散。

在pma之后，可以在tin层213'上沉积通常由poly-si制成的伪栅电极(还称为si盖，未示出)，以用于进一步的热工艺。在一些实施例中，在形成si盖之后，随后进行后盖退火(pca)以将来自掺杂的间隔件220和掺杂的氧化物层300的掺杂剂进一步驱动至tin层213'和tisin层214'中。在各个实施例中，在大约800℃至大约1000℃的温度下执行后盖退火(pca)并且持续大约1秒至大约10秒以将掺杂剂迅速地驱动至wfm堆叠件212'中，同时防止来自其他区域的掺杂剂的不期望的外扩散。

pma和pca的进行不仅形成包括掺杂的tin层213和掺杂的tisin层214的掺杂的wfm堆叠件212，还形成了位于掺杂的wfm堆叠件212下面的掺杂的栅极氧化物层215。在形成掺杂的wfm堆叠件212之后，可以去除si盖以暴露掺杂的wfm堆叠件212的顶面。

参考图5f，在通过诸如反应离子蚀刻(rif)或高密度等离子体(hdp)蚀刻的适当的方法去除si盖之后，金属栅电极216可以沉积在掺杂的tin层213上以形成第二栅极堆叠件(还称为栅极堆叠件210)，该第二栅极堆叠件是高k/金属栅极结构的一部分。在一些实施例中，通过利用金属栅电极216来代替si盖，可以实现掺杂的wfm堆叠件212中的功函数的改善以及掺杂的wfm堆叠件212、金属栅电极216和掺杂的栅极氧化物层300之间的协调。

根据以上所述以及各个实施例，使用掺杂的间隔件220和掺杂的氧化物层300来对wfm堆叠件212'进行热掺杂，与此同时，采用高k栅极氧化物层215'和金属栅电极216可以微调栅极结构200的阈值电压、减少由短沟道效应导致的泄漏电流、以及增强半导体器件100的性能以及高密度进程。

根据一些实施例，栅极结构200包括栅极堆叠件210和位于栅极堆叠件210的侧壁上面的掺杂的间隔件220。栅极堆叠件210包含掺杂的功函数金属(wfm)堆叠件212和位于掺杂的wfm堆叠件212上面的金属栅电极216。

根据一些实施例，半导体器件100包括衬底102、栅极堆叠件210、掺杂的间隔件220和掺杂的氧化物层300。衬底102具有源极区域110和漏极区域111、以及位于衬底102上面并且介于源极区域110和漏极区域111之间的栅极堆叠件210。栅极堆叠件210包括掺杂的栅极氧化物层215、位于掺杂的栅极氧化物层215上面的掺杂的功函数金属(wfm)堆叠件212、以及位于掺杂的wfm堆叠件212上面的金属栅电极216。掺杂的氧化物层300位于衬底102的表面上面。掺杂的间隔件220位于掺杂的氧化物层300上面并且位于栅极堆叠件210的侧壁上面。

根据一些实施例，形成半导体器件100的方法包括：在具有源极区域110和漏极区域111的衬底102上面形成氧化物层300'(过程402)；形成第一栅极堆叠件211和间隔件220'(过程404)；掺杂氧化物层300'和间隔件220'以形成掺杂的氧化物层300和掺杂的间隔件220(过程406)；在衬底上面并且在掺杂的间隔件220之间形成功函数金属(wfm)堆叠件212'(过程408)；热处理掺杂的间隔件220和掺杂的氧化物层300以形成掺杂的wfm堆叠件212(过程410)；以及在掺杂的wfm堆叠件212上面形成金属栅电极216以形成第二栅极堆叠件210(过程412)。在形成第一栅极堆叠件211和间隔件220'的过程404中，第一栅极堆叠件211位于介于源极区域110和漏极区域111之间的衬底102上面，并且间隔件220'位于第一栅极堆叠件211的侧壁上面。

本发明的实施例提供了一种栅极结构，包括：栅极堆叠件，包括：掺杂的功函数金属(wfm)堆叠件；和金属栅电极，位于所述掺杂的功函数金属堆叠件上面；以及掺杂的间隔件，位于所述栅极堆叠件的侧壁上面。

根据本发明的一个实施例，其中，所述掺杂的功函数金属堆叠件掺杂有硼(b)或砷(as)。

根据本发明的一个实施例，其中，在5×10²⁰原子/立方厘米至5×10²¹原子/立方厘米的浓度下掺杂所述掺杂的间隔件。

根据本发明的一个实施例，其中，所述掺杂的功函数金属堆叠件包括掺杂的tisin层和位于所述掺杂的tisin层上面的掺杂的tin层。

根据本发明的一个实施例，其中，所述栅极堆叠件包括位于所述掺杂的tisin层下面的掺杂的栅极氧化物层，并且所述掺杂的栅极氧化物层和所述掺杂的tisin层是无定形的。

根据本发明的一个实施例，其中，所述掺杂的间隔件为氮化硅(sin)、氮氧化硅(sion)、碳化硅(sic)、碳氧化硅(sioc)、碳氮氧化硅(sicon)、氟氧化硅(siof)或它们的组合。

根据本发明的一个实施例，其中，所述金属栅电极为cu、al、ni、co、nb、ta、tan、tac、w、wn、wc或它们的组合。

本发明的实施例还提供了一种半导体器件，包括：衬底，具有源极区域和漏极区域；栅极堆叠件，位于介于所述源极区域和所述漏极区域之间的衬底上面，所述栅极堆叠件包括：掺杂的栅极氧化物层；掺杂的功函数金属(wfm)堆叠件，位于所述掺杂的栅极氧化物层上面；和金属栅电极，位于所述掺杂的功函数金属堆叠件上面；掺杂的氧化物层，位于所述衬底的表面上面；以及掺杂的间隔件，位于所述掺杂的氧化物层上面并且位于所述栅极堆叠件的侧壁上面。

根据本发明的一个实施例，其中，所述掺杂的功函数金属堆叠件、所述掺杂的间隔件和所述掺杂的氧化物层是硼掺杂的。

根据本发明的一个实施例，其中，所述掺杂的功函数金属堆叠件、所述掺杂的间隔件和所述掺杂的氧化物层是砷掺杂的。

根据本发明的一个实施例，其中，所述衬底是被所述栅极堆叠件跨越的凸起的鳍结构。

根据本发明的一个实施例，其中，所述掺杂的氧化物层为氧化铝(al2o3)、氧化镧(la2o3)、氧化钽(ta2o5)、氧化钛(tio2)、氧化铪(hfo2)、二氧化硅(sio2)、氧化锆(zro2)或它们的组合。

根据本发明的一个实施例，其中，所述掺杂的间隔件仅位于所述栅极堆叠件的侧壁和所述掺杂的氧化物层的邻近所述栅极堆叠件的侧壁的部分上面。

本发明的实施例还提供了一种形成半导体器件的方法，所述方法包括：在衬底上面形成氧化物层，所述衬底具有源极区域和漏极区域；形成第一栅极堆叠件和间隔件，其中，所述第一栅极堆叠件位于介于所述源极区域和所述漏极区域之间的衬底上面，并且所述间隔件位于所述第一栅极堆叠件的侧壁上面；掺杂所述氧化物层和所述间隔件，以形成掺杂的氧化物层和掺杂的间隔件；在所述衬底上面并且在所述掺杂的间隔件之间形成功函数金属(wfm)堆叠件；热处理所述掺杂的间隔件和所述掺杂的氧化物层，以形成掺杂的功函数金属堆叠件；以及在所述掺杂的功函数金属堆叠件上面形成金属栅电极，以形成第二栅极堆叠件。

根据本发明的一个实施例，方法还包括：在所述掺杂的氧化物层上面形成间隔件。

根据本发明的一个实施例，其中，热处理所述掺杂的氧化物层和所述掺杂的间隔件包括后金属退火(pma)的工艺和后盖退火(pca)的工艺。

根据本发明的一个实施例，其中，在750℃至900℃的温度下执行所述后金属退火(pma)并且持续1秒至30秒。

根据本发明的一个实施例，其中，在800℃至1000℃的温度下执行所述后盖退火(pca)并且持续1秒至10秒。

根据本发明的一个实施例，其中，掺杂所述氧化物层和所述间隔件包括利用原子层沉积(ald)的间隔件的原位掺杂或利用等离子体沉积或离子金属等离子体(imp)沉积的间隔件的非原位掺杂。

根据本发明的一个实施例，其中，掺杂所述氧化物层和所述间隔件包括利用等离子体沉积或离子金属等离子体(imp)沉积的氧化物层的非原位掺杂。

以上论述了若干实施例的部件，使得本领域的技术人员可以更好地理解本发明的各个方面。本领域技术人员应该理解，可以很容易地使用本发明作为基础来设计或更改其他的处理和结构以用于达到与本发明所介绍实施例相同的目的和/或实现相同优点。本领域技术人员也应该意识到，这些等效结构并不背离本发明的精神和范围，并且在不背离本发明的精神和范围的情况下，可以进行多种变化、替换以及改变。