显示面板的制作方法

1.本发明涉及显示领域，具体涉及一种显示面板。


背景技术：

2.低温多晶氧化物(low temperature polycrystalline oxide，ltpo)技术由于同时具备了低温多晶硅薄膜晶体管(low temperature poly
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siliconthinfilmtransistor，ltps tft)的迁移率高和驱动能力强，以及氧化物薄膜晶体管(oxide tft)的漏电流小和功耗低的特点，广泛应用于显示面板领域。
3.oxide tft的导体化工艺通常是通过源漏极层与有源层之间的连接孔进行离子注入来实现，然而，现有ltpo显示面板中oxide tft的沟道距离连接孔的位置较远，导致oxide tft的导体化程度低，显示面板压降大和数据写入不足，进而导致显示面板出现白边现象。
4.因此，现有ltpo显示面板存在oxide tft的导体化程度低的问题，需要解决。


技术实现要素：

5.本发明实施例提供一种显示面板，以解决现有ltpo显示面板存在oxide tft的导体化程度低的问题。
6.本发明实施例提供一种显示面板，包括氧化物晶体管，在所述氧化物晶体管的氧化物有源层和源漏极层之间，所述氧化物晶体管的沟道两侧分别设置有第一过孔和第二过孔，氧化物晶体管的源极和漏极分别通过所述第一过孔和所述第二过孔连接所述氧化物有源层。
7.可选的，在本发明的一些实施例中，所述第一过孔到所述氧化物晶体管的沟道的距离和所述第二过孔到所述氧化物晶体管的沟道的距离相同。
8.可选的，在本发明的一些实施例中，所述第一过孔和所述第二过孔关于所述氧化物晶体管的沟道对称设置。
9.可选的，在本发明的一些实施例中，所述第一过孔的孔径和所述第二过孔的孔径相同。
10.可选的，在本发明的一些实施例中，所述显示面板包括层叠设置的第二栅极层、第二有源层、第三栅极层和第一源漏极层；所述第二栅极层形成所述氧化物晶体管的低栅结构，所述第二有源层为所述氧化物薄膜晶体管的所述氧化物有源层且形成所述氧化物晶体管的沟道，所述第三栅极层形成所述氧化物晶体管的顶栅结构，所述第一源漏极层为所述氧化物薄膜晶体管的源漏极层且形成所述氧化物晶体管的源极和漏极。
11.可选的，在本发明的一些实施例中，所述显示面板还包括至少一个低温多晶硅晶体管，所述显示面板还包括第一有源层和第一栅极层，所述第一有源层为低温多晶硅有源层，所述第一栅极层形成所述低温多晶硅晶体管的底栅结构，所述第二栅极层形成所述低温多晶硅晶体管的顶栅结构，所述所述第一源漏极层为所述低温多晶硅晶体管的源漏极层且形成所述低温多晶硅晶体管的源极和漏极；所述第一有源层、所述第一栅极层、所述第二
栅极层、所述第二有源层、所述第三栅极层和所述第一源漏极层依次叠层设置。
12.可选的，在本发明的一些实施例中，所述显示面板还包括第二源漏极层，所述第二源漏极层设置于所述第一源漏极层远离所述第三栅极层高的一侧，所述第二源漏极层在所述第二有源层上的投影覆盖所述氧化物晶体管的沟道。
13.可选的，在本发明的一些实施例中，所述显示面板两个包括第一氧化物晶体管和第二氧化物晶体管，所述第一氧化物晶体管的源极和所述第二氧化物晶体管的漏极连接。
14.可选的，在本发明的一些实施例中，所述第一氧化物晶体管的源极和所述第二氧化物晶体管的漏极之间通过连接线连接，所述连接线与所述氧化物晶体管的源漏极同层设置。
15.可选的，在本发明的一些实施例中，所述显示面板包括像素驱动电路，所述像素驱动电路包括第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管和第七薄膜晶体管；其中，所述第三薄膜晶体管和所述第四薄膜晶体管为所述氧化物晶体管，所述第一薄膜晶体管、所述第二薄膜晶体管、所述第五薄膜晶体管、所述第六薄膜晶体管和所述第七薄膜晶体管为低温多晶硅晶体管。
16.本发明提供的显示面板包括氧化物晶体管，氧化物晶体管的氧化物有源层和源漏极层之间，氧化物晶体管的沟道两侧分别设置有第一过孔和第二过孔，氧化物晶体管的源极和漏极分别通过第一过孔和第二过孔连接氧化物有源层。本发明通过在氧化物晶体管的沟道两侧分别设置第一过孔和第二过孔，经由第一过孔和第二过孔对氧化物晶体管沟道两侧的区域进行导体化，解决了由于氧化物晶体管的沟道距离过孔的位置较远，导致氧化物晶体管的导体化程度低的技术问题。
附图说明
17.为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
18.图1是本发明实施例提供的显示面板的像素驱动电路图；
19.图2是本发明实施例提供的显示面板的剖面结构示意图；
20.图3是本发明实施例提供的显示面板的各膜层的平面叠加结构示意图；
21.图4是本发明实施例提供的显示面板的第一有源层的平面结构示意图；
22.图5是本发明实施例提供的显示面板的第一栅极层的平面结构示意图；
23.图6是本发明实施例提供的显示面板的第二栅极层的平面结构示意图；
24.图7是本发明实施例提供的显示面板的第二有源层的平面结构示意图；
25.图8是本发明实施例提供的显示面板的第三栅极层的平面结构示意图；
26.图9是本发明实施例提供的显示面板的第一源漏极层的平面结构示意图；
27.图10是本发明实施例提供的显示面板的第二源漏极层的平面结构示意图。
具体实施方式
28.下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完
整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。此外，应当理解的是，此处所描述的具体实施方式仅用于说明和解释本发明，并不用于限制本发明。在本发明中，在未作相反说明的情况下，使用的方位词如“上”和“下”通常是指装置实际使用或工作状态下的上和下，具体为附图中的图面方向；而“内”和“外”则是针对装置的轮廓而言的。
29.本发明实施例提供一种显示面板，以解决现有ltpo显示面板存在oxide tft的导体化程度低的问题。以下分别进行详细说明。需说明的是，以下实施例的描述顺序不作为对实施例优选顺序的限定。
30.在一种实施例中，请参照图1，图1示出了本发明实施例提供的显示面板的像素驱动电路图。如图1所示，本发明实施例提供的显示面板包括发光器件el和驱动该发光器件el发光显示的像素驱动电路，该像素驱动电路包括第一薄膜晶体管t1、第二薄膜晶体管t2、第三薄膜晶体管t3、第四薄膜晶体管t4、第五薄膜晶体管t5、第六薄膜晶体管t6、第七薄膜晶体管t7、第一电容cst和第二电容cboost，该像素驱动电路还包括电源信号线vdd、数据信号线data、第一扫描信号线pscan(n)、第二扫描信号线nscan(n)、第三描信号线nscan(n
‑
1)、第一初始化信号vi1、第二初始化信号线vi2和发光控制信号线em。
31.其中，第一薄膜晶体管t1的栅极连接第一电容cst的第二电极板、第二电容cboost的第一电极板、第三薄膜晶体管t3的第一电极、第四薄膜晶体管t4的第二电极于第一节点q，第一薄膜晶体管t1的第一电极连接第五薄膜晶体管t5的第二电极和第二薄膜晶体管t2的第二电极于第二节点a，第一薄膜晶体管t1的第二电极连接第三薄膜晶体管t3的第二电极和第六薄膜晶体管t6的第一电极于第三节点b；
32.第二薄膜晶体管t2的栅极连接第二电容cboost的第二电极板且同时接入第一扫描信号pscan(n)，第二薄膜晶体管t2的第一电极接入数据信号data；
33.第三薄膜晶体管t3的栅极接入第二扫描信号nscan(n)；
34.第四薄膜晶体管t4的栅极接入第三扫描信号nscan(n
‑
1)，第四薄膜晶体管t4的第一电极接入第二初始化信号vi2；
35.第五薄膜晶体管t5的栅极连接第六薄膜晶体管t6的栅极于第四节点c，且同时接入发光控制信号em，第五薄膜晶体管t5的第一电极连接第一电容cst的第一电极板且同时接入电源信号vdd；
36.第六薄膜晶体管t6的第二电极连接第七薄膜晶体管t7的第二电极和发光器件el于第五节点d；
37.第七薄膜晶体管t6的第一电极接入第一初始化信号vi1。
38.在薄膜晶体管t1
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t7中，薄膜晶体管的第一电极和第二电极分别为源电极和漏电极，可以是第一电极为源电极第二电极为漏电极，也可以是第一电极为漏电极第二电极为源电极。
39.其中，第一薄膜晶体管t1为驱动晶体管，用于在第一节点q和第二节点a电位的控制下，驱动发光器件el发光；
40.第二薄膜晶体管t2为开关晶体管，用于在第一扫描信号pscan(n)的控制下，向第二节点a输入数据信号data；
41.第三薄膜晶体管t3为补偿晶体管，通过第一节点q和第三节点b与驱动晶体管t1连接，用于在第二扫描信号nscan(n)的控制下，补偿驱动晶体管t1的阈值电压；
42.第四薄膜晶体管t4为第一初始化晶体管，用于在第三扫描信号nscan(n
‑
1)的控制下，向第一节点q输入第二初始化信号vi2；
43.第五薄膜晶体管t5为第一发光控制晶体管，通过第二节点a与驱动晶体管t1相连，用于在发光控制信号em的控制下，向驱动晶体管t1输入电源信号vdd；
44.第六薄膜晶体管t6为第二发光控制晶体管，通过第三节点b与驱动晶体管t1相连，用于在发光控制信号em的控制下，导通驱动晶体管t1流向发光器件el的电流；
45.第七薄膜晶体管t7为第二初始化晶体管，用于在第一扫描信号pscan(n)的控制下，向发光器件el输入第一初始化信号vi1；
46.第一电容cst为存储电容，通过第一节点q与驱动晶体管t1相连，通过第四节点c与电源信号vdd相连，用于存储数据信号vdd；
47.第二电容cboost为升压电容，通过第一节点q与驱动晶体管t1相连，用于存第一扫描信号pscan(n)，且在特定时间段内提升驱动晶体管t1的栅极电压。
48.其中，补偿晶体管t3、第一初始化晶体管t4和第二初始化晶体管t7为氧化物晶体管，驱动晶体管t1、开关晶体管t2、第一发光控制晶体管t5和第二发光控制晶体管t6为低温多晶硅晶体管。
49.进一步，请参照图2，图2示出了本发明实施例提供的显示面板的剖面结构示意图。如图2所示，本发明实施例提供的显示面板包括从下到上依次设置的衬底100、遮光层110、缓冲层120、第一有源层130、第一栅极绝缘层140、第一栅极层150、第二栅极绝缘层160、第二栅极层170、第三栅极绝缘层180、第二有源层190、第四栅极绝缘层200、第三栅极层210、层间绝缘层220、第一源漏极层230、钝化层240、平坦化层250、第二源漏极层260。其中，第一有源层130、第一栅极层150、第二栅极层170和第一源漏极层230共同形成低温多晶硅晶体管，如图2中左侧的膜层结构所示，在本发明实施例提供的显示面板的像素驱动电路中，第一薄膜晶体管t1、第二薄膜晶体管t2、第五薄膜晶体管t5、第六薄膜晶体管t6和第七薄膜晶体管t7采用该膜层结构；第二栅极层170、第二有源层190、第三栅极层210和第一源漏极层230氧化物晶体管，如图2中右侧的膜层结构所示，在本发明实施例提供的显示面板的像素驱动电路中，第三薄膜晶体管t3和第四薄膜晶体管t4采用该膜层结构。
50.显示面板的膜层具体结构请参照图3至图10，图3示出了本发明实施例提供的显示面板的各膜层的平面叠加结构示意图，图4至图10分别示出了本发明实施例提供的显示面板的各个膜层的平面结构示意图。下面结合图3至图10对显示面板的膜层结构进行具体说明。
51.第一有源层130为低温多晶硅有源层，请参照图3和图4，图3示出了本发明实施例提供的显示面板的各膜层的平面叠加结构示意图，具体包括如图4至图10所示的各个膜层，图4示出了本发明实施例提供的显示面板的第一有源层130的平面结构示意图。如图4所示，第一有源层130图案化形成相互连通的第一有源层图案，第一有源层130的图案与第一栅极层150的图案在衬底100上的投影存在部分重合，其中，第一有源层130与第一电容cst的第一电极板投影相互重合的部分构成第一薄膜晶体管t1的沟道，第一有源层130与第一扫描线151投影相互重叠的部分构成第二薄膜晶体管t2的沟道，第一有源层130与第一扫描线
152投影相互重叠的部分构成第七薄膜晶体管t7的沟道，第一有源层130与发光控制信号线em投影相互重叠的部分分别构成第五薄膜晶体管t5的沟道和第六薄膜晶体管t6的沟道。第一有源层130形成的图案还分别对应于第五过孔101、第六过孔102、第七过孔103、第八过孔104和第九过孔105，第五过孔101位于第二薄膜晶体管t2沟道的一侧，第七过孔103位于第五薄膜晶体管t5沟道的一侧，第六过孔102和第八过孔104分别位于第六薄膜晶体管t6沟道的两侧，第八过孔104和第九过孔105分别位于第七薄膜晶体管t7沟道的两侧。第一有源层130中各薄膜晶体管沟道区域以外的部分为离子掺杂区，通过离子掺杂实现第一薄膜晶体管t1的第一电极与第二薄膜晶体管t2的第二电极、第五薄膜晶体管t5的第二电极电性连接，第一薄膜晶体管t1的第二电极与第六薄膜晶体管t6的第一电极电性连接，第七薄膜晶体管t7的第二电极与第六薄膜晶体管t6的第二电极电性连接。
52.请参照图3、图4和图5，图5示出了本发明实施例提供的显示面板的第一栅极层150的平面结构示意图。如图5所示，第一栅极层150图案化形成第二初始化信号线vi2、发光控制信号线em、第一电容cst的第一电极板、第二电容cboost的第一电极板、以及两条第一扫描信号线pscan(n)151和152，第二初始化信号线vi2用于接入第二初始化信号vi2，发光控制信号线em用于接入发光控制信号em，第一扫描信号线pscan(n)151和152用于接入第一扫描信号pscan(n)。其中，第一电容cst的第一电极板与第一有源层130在衬底100上投影重合的区域同时构成第一薄膜晶体管t1的栅极，第一电容cst的第一电极还对应于第十过孔106；第二初始化信号线vi2的局部区域对应于第十一过孔107；发光控制信号线em与第一有源层130在衬底100上投影重合的区域分别构成第五薄膜晶体管t5的栅极和第六薄膜晶体管t6的栅极；第一扫描信号线151与第一有源层130在衬底100上投影重合的区域构成第二薄膜晶体管t2的栅极，第一扫描信号线151上的突出部分构成第二电容cboost的第一电极板；第一扫描信号线152与第一有源层130在衬底100上投影重合的区域构成第七薄膜晶体管t7的栅极。
53.请参照图3、图5、图6和图7，图6示出了本发明实施例提供的显示面板的第二栅极层170的平面结构示意图。如图6所示，第二栅极层170图案化形成第一初始化信号线vi1、第一电容cst的第二电极板、第二电容cboost的第二电极板、第一栅极线171和第二栅极线172，第一初始化信号线vi1用于接入第一初始化信号vi1。其中，第一电容cst的第二电极板上设置有对应于第一电容cst的第一电极板的局部挖空区域，第十过孔106在衬底100上的投影落在该挖空区域在衬底100上的投影内且与该挖空区域在衬底100上的投影边界不存在重合，第一电容cst的第二电极板的局部区域还对应于第十二过孔108；第一初始化信号线vi1的局部区域对应于第十三过孔109；第二电容cboost的第二电极板的局部区域还对应于第十四过孔115；第一栅极线171与第二有源层190的图案在衬底100上存在部分重合，第一栅极线171上与第二有源层190投影重合的区域构成第四薄膜晶体管t4的底栅；第二栅极线172与第二有源层190的图案在衬底100上存在部分重合，第二栅极线172上与第二有源层190投影重合的区域构成第三薄膜晶体管t3的底栅。
54.由于氧化物有源层对光照较为敏感，第二栅极层170通常采用不透光的金属材料，因此，第三薄膜晶体管t3的底栅结构和第四薄膜晶体管t4的底栅结构可以分别阻挡从第二栅极层170一侧射入第三薄膜晶体管t3沟道和第四薄膜晶体管t4沟道的环境光，防止光对第三薄膜晶体管t3或第四薄膜晶体管t4造成干扰，提高了第三薄膜晶体管t3和第四薄膜晶
体管t4的稳定性。另一方面，由于氧化物晶体管在长时间使用时，会出现阈值电压漂移现象，阈值电压会发生正偏或负偏，此时，可以向各氧化物晶体管的底栅输入电信号，对阈值电压漂移进行校正调整，使得流过发光器件el的驱动电流稳定。此外，第二栅极层170的材料为金属，可以作为氢阻挡层，阻挡下方氢离子对氧化物有源层的影响，避免造成氧化物晶体管阈值电压漂移，进一步提高电路的稳定性。
55.第二有源层190为氧化物有源层，请参照图3、图6、图7和图8，图7示出了本发明实施例提供的显示面板的第二有源层190的平面结构示意图。如图7所示，第二有源层190图案化形成相互连通的第二有源层图案，第二有源层190的图案与第二栅极层170图案、第三栅极层210的图案在衬底100上的投影存在部分重合，其中，第二有源层190与第二栅极线172、第二扫描信号线nscan(n)投影相互重合的部分构成第三薄膜晶体管t3的沟道，第二有源层190与第一栅极线171、第三扫描信号线nscan(n
‑
1)投影相互重合的部分构成第四薄膜晶体管t4的沟道。第二有源层190形成的图案还分别对应于第一过孔111、第二过孔112、第三过孔113和第四过孔114，其中，第一过孔111和第二过孔112分别位于第三薄膜晶体管t3沟道的两侧，第三过孔113和第四过孔114分别位于第四薄膜晶体管t4沟道的两侧。
56.请参照图3、图7和图8，图8示出了本发明实施例提供的显示面板的第三栅极层210的平面结构示意图。如图8所示，第三栅极层210图案化形成第二扫描信号线nscan(n)和第三扫描信号线nscan(n
‑
1)，第二扫描信号线nscan(n)用于接入第二扫描信号nscan(n)，第三扫描信号线nscan(n
‑
1)用于接入第三扫描信号nscan(n
‑
1)。其中，第二扫描信号线nscan(n)与第二有源层190投影相互重合的部分构成第三薄膜晶体管t3的顶栅，第三扫描信号线nscan(n
‑
1)与第二有源层190投影相互重合的部分构成第四薄膜晶体管t4的顶栅。
57.请参照图3、图4、图5、图6、图7和图9，图9示出了本发明实施例提供的显示面板的第一源漏极层230的平面结构示意图。如图9所示，第一源漏极层230图案化形成数据信号线data、第一连接线231、第二连接线232、第三连接线233、第四连接线234和第五连接线235，数据信号线data用于接入数据信号data。其中，数据线信号data的局部突出区域对应于第五过孔101，数据线信号data通过第五过孔101与第一有源层130连接，从而实现第二薄膜晶体管t2的第一电极接入数据信号data；第一连接线231的局部区域分别向下对应于第七过孔103和第十二过孔108，向上对应于第十五过孔116和第十六过孔117，第一连接线231通过第七过孔103与第一有源层130连接，第一连接线231通过第十二过孔108与第二栅极层170中第一电容cst的第二电极板连接；第二连接线232的局部区域向下对应于第十一过孔107和第一过孔111，第二连接线232通过第十一过孔107与第一栅极层150中的第二初始化信号线vi2连接，通过第一过孔111与第二有源层190连接，从而实现第四薄膜晶体管t4的第一电极接入第二初始化信号线vi2；第三连接线233的局部区域分别向下对应于第十过孔106、第二过孔112、和第三过孔113，向上对应于第十四过孔115，第三连接线233通过第十过孔106与第一栅极层150中第一电容cst的第一电极板连接，第三连接线233通过第二过孔112和第三过孔113分别与第二有源层190连接，从而实现第一薄膜晶体管t1的栅极与第一电容cst的第二电极板、第二电容cboost的第一电极板、第三薄膜晶体管t3的第一电极、第四薄膜晶体管t4的第二电极连接；第四连接线234的局部区域分别向下对应于第六过孔102和第四过孔114，第四连接线234通过第六过孔102与第一有源层130连接，第四连接线234通过第四过孔114与第二有源层190连接，从而实现第一薄膜晶体管t1的第二电极与第三薄膜晶体管t3
的第二电极、第六薄膜晶体管t6的第一电极连接；第五连接线235的局部区域分别向下对应于第九过孔105和第十三过孔109，第五连接线235通过第九过孔105与第一有源层130连接，第五连接线235通过第十三过孔109与第二栅极层170中第一初始化信号线vi1连接，从而实现第七薄膜晶体管t7的第一电极接入第一初始化信号vi1。
58.请参照图3和10，图10示出了本发明实施例提供的显示面板的第二源漏极层260的平面结构示意图。如图10所示，第二源漏极层260图案化形成电源信号线vdd，电源信号线vdd的局部区域向下对应于第十五过孔116和第十六过孔117，电源信号线vdd通过第十五过孔116和第十六过孔117分别与第一源漏极层230中的第一连接线231连接，从而实现第五薄膜晶体管t5的第一电极、第一电容cst的第二电极板接入电源信号vdd。
59.如图3所示，第二源漏极层260在第二有源层190上的投影覆盖第三薄膜晶体管t3的沟道和第四薄膜晶体管t4的沟道。第二源漏极层260同样采用不透光的金属材料，因此，电源信号线vdd可以阻挡从第二源漏极层260一侧射入第三薄膜晶体管t3沟道和第四薄膜晶体管t4沟道的光，防止光对第三薄膜晶体管t3或第四薄膜晶体管t4造成干扰，提高了第三薄膜晶体管t3和第四薄膜晶体管t4的稳定性。另一方面，第二源漏极层260的材料为金属，可以作为氢阻挡层，阻挡上方氢离子对氧化物有源层的影响，避免造成氧化物晶体管阈值电压漂移，进一步提高电路的稳定性。
60.在本发明实施例提供的显示面板中，通过在氧化物晶体管t3的沟道两侧分别设置第一过孔111和第二过孔112，在氧化物晶体管t4的沟道两侧分别设置第三过孔113和第四过孔114，经由第一过孔111和第二过孔112对氧化物晶体管t3沟道两侧的区域进行导体化，经由第三过孔113和第四过孔114对氧化物晶体管t4沟道两侧的区域进行导体化，解决了由于氧化物晶体管的沟道距离过孔的位置较远，导致氧化物晶体管的导体化程度低，显示面板压降大和数据写入不足，进而导致显示面板出现白边现象的问题。
61.在一种实施例中，如图3和图7所示，第一过孔111和第二过孔112分别设置于第三薄膜晶体管t3的沟道的两侧，且第一过孔111到第三薄膜晶体管t3的沟道的距离与第二过孔112到第三薄膜晶体管t3的沟道的距离相同，这样可以保证第三薄膜晶体管t3的沟道两端第二有源层190导体化的位置到第三薄膜晶体管t3沟道的距离相同，进而保证了第三薄膜晶体管t3的沟道两端导体化程度的均一性。进一步，第一过孔111和第二过孔112关于第三薄膜晶体管t3的沟道对称设置，这样更进一步保证了第三薄膜晶体管t3的对称性和第三薄膜晶体管t3沟道两端导体化程度的均一性，提高第三薄膜晶体管t3的导体化程度，提高第三薄膜晶体管t3的电学性能，进而提高显示面板的显示效果。
62.同样的，第三过孔113和第四过孔114分别设置于第四薄膜晶体管t4的沟道的两侧，且第三过孔113到第四薄膜晶体管t4的沟道的距离与第四过孔114到第四薄膜晶体管t4的沟道的距离相同。进一步，第三过孔113和第四过孔114关于第四薄膜晶体管t4的沟道对称设置。
63.更进一步，第一过孔111到第三薄膜晶体管t3的沟道的距离与第三过孔113到第四薄膜晶体管t4的沟道的距离相同，这样，第三薄膜晶体管t3的沟道两端第二有源层190导体化的位置到第三薄膜晶体管t3沟道的距离与第四薄膜晶体管t4的沟道两端第二有源层190导体化的位置到第四薄膜晶体管t4沟道的距离相同，使得第三薄膜晶体管t3沟道两端的导体化位置和第四薄膜晶体管t4沟道两端的导体化位置相统一，保证了第三薄膜晶体管t3和
第四薄膜晶体管t4导体化程度的均一性。
64.在一种实施例中，第一过孔111的孔径和第二过孔112的孔径设置相同，使得通过第一过孔111和第二过孔112分别对第三薄膜晶体管t3沟道两侧区域进行离子导体化的通道相同，保证了第三薄膜晶体管t3沟道两侧区域导体化处理一致性，进而保证了第三薄膜晶体管t3两侧区域导体化程度的均一性。
65.同样的，第三过孔113的孔径和第四过孔114的孔径设置相同。
66.更进一步，第一过孔111的孔径和第三过孔113的孔径设置相同，使得第三薄膜晶体管t3沟道两侧区域和第四薄膜晶体管t4沟道两侧区域离子导体化的通道均相同，进一步保证了第三薄膜晶体管t3和第四薄膜晶体管t4导体化程度的均一性，提高了第三薄膜晶体管t3和第四薄膜晶体管t4的导体化程度，提高第三薄膜晶体管t3和第四薄膜晶体管t4的电学性能，进而提高显示面板的显示效果。
67.另外，在本发明实施例提供的显示面板中，第三连接线233同时连接第一薄膜晶体管t1的栅极、第一电容cst的第二电极板、第二电容cboost的第一电极板、第三薄膜晶体管t3的第一电极和第四薄膜晶体管t4的第二电极。第三薄膜晶体管t3和第四薄膜晶体管t4直接通过导电率高的第三连接线233进行连接，避免了第三薄膜晶体管t3的第一电极和第四薄膜晶体管t4的第二电极通过第二有源层190连接，而造成显示面板压降大和数据写入不足，进而导致显示面板出现白边现象的问题，提高了显示面板的显示效果。
68.以上对本发明实施例所提供的一种显示面板进行了详细介绍，本文中应用了具体个例对本发明的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本发明的方法及其核心思想；同时，对于本领域的技术人员，依据本发明的思想，在具体实施方式及应用范围上均会有改变之处，综上所述，本说明书内容不应理解为对本发明的限制。