在通信系统中发送/接收数据的装置和方法与流程

本发明通常涉及在通信系统中发送/接收数据的装置和方法，更具体地说，涉及在通信系统中产生用于数据发送/接收的奇偶校验比特的装置和方法。

背景技术：
通常，在通信系统中，链路性能由于噪声、衰落、码间干扰(ISI)等会恶化。因此，需要发展用于克服这些问题的技术以便提高通信系统的链路性能。具体来说，这种技术的发展对于需要高数据吞吐量和高可靠性的，诸如下一代移动通信、数字广播和移动互联网的高速数字通信系统来说是特别重要的。为克服这些问题所提出的一些技术可以包括纠错码。在通过有效恢复信息失真来提高通信可靠性的经典技术中使用纠错码。纠错码的实例包括Turbo码、低密度奇偶校验(LDPC)码等。当在通信系统中使用纠错码发送信息时，发送设备典型地从与要发送的期望信息相对应的系统比特序列以及通过编码所获得的奇偶校验比特序列中确定或选择要发送的比特。通信系统的发送设备使用所确定的比特产生具有预设格式的帧，并且以所产生的帧为单位发送所期望的信息。对于通信系统的这种发送设备，必须准备在多个帧上发送奇偶校验比特的技术，以便不仅获得附加的分集增益，而且最小化编码或解码所需的附加模块的数量。具体地说，对于支持诸如第二代地面数字视频广播(DVB-T2)和DVB下一代手持(DVB-NGH)的广播服务的通信系统，已经提出除了所述被基本发送的奇偶校验比特序列之外还发送奇偶校验比特序列的技术，以获得附加的分集增益。然而，必须优化用于产生被附加发送的奇偶校验比特序列的技术，以便在支持广播服务的通信系统中获得足够的分集增益。

技术实现要素：
技术问题因此，已经设计了本发明以解决至少以上提及的问题，并且提供至少以下所述的优点。本发明的一方面提供在多个帧上发送奇偶校验比特的通信系统中用于产生被提供以获得附加分集增益的附加奇偶校验比特的数据发送装置和方法。本发明的另一方面提供根据通过编码输出的奇偶校验比特序列产生一个第一奇偶校验比特序列(或者基本奇偶校验比特序列)和至少一个附加奇偶校验比特序列的数据发送装置和方法。进一步，本发明的另一方面提供使用从发送设备接收的至少一个第一奇偶校验比特序列(或者基本奇偶校验比特序列)和至少一个附加奇偶校验比特序列来解码信息比特序列的数据接收装置和方法。问题的解决根据本发明的一个方面，提供在通信系统的发送设备中产生要在多个帧上发送的奇偶校验比特序列的方法。所述方法包括：通过使用第一打孔图案编码第一奇偶校验比特序列对第一奇偶校验比特序列进行打孔；将使用第一打孔图案对第一奇偶校验比特序列打孔后剩余的未打孔奇偶校验比特输出为基本奇偶校验比特序列；使用第二打孔图案，对通过使用第一打孔图案打孔第一奇偶校验比特序列或者通过编码第一奇偶校验比特序列而被打孔的第二奇偶校验比特序列进行打孔；以及将用第二打孔图案打孔第二奇偶校验比特序列之后所剩余的未打孔奇偶校验比特输出为附加奇偶校验比特序列。根据本发明另一方面，提供在通信系统的发送设备中产生要在多个帧上发送的奇偶校验比特序列的装置。所述装置包括：基本奇偶校验产生器，通过使用第一打孔图案编码第一奇偶校验比特序列对第一奇偶校验比特序列进行打孔，并且将用第一打孔图案对第一奇偶校验比特序列打孔后剩余的未打孔奇偶校验比特输出为基本奇偶校验比特序列；以及附加奇偶校验产生器，使用第二打孔图案，对通过使用第一打孔图案打孔第一奇偶校验比特序列或者通过编码第一奇偶校验比特序列而被打孔的第二奇偶校验比特序列进行打孔，并且将用第二打孔图案对第二奇偶校验比特序列打孔之后剩余的未打孔奇偶校验比特输出为附加奇偶校验比特序列。根据本发明的进一步的另一方面，提供在通信系统的接收设备中用于恢复在多个帧上发送的奇偶校验比特序列的方法。所述方法包括：从所接收的帧中提取第一基本奇偶校验比特序列和至少一个第一附加奇偶校验比特序列；通过使用第一掩膜图案将打孔的奇偶校验比特插入到所提取的第一基本奇偶校验比特序列来重建第二基本奇偶校验比特序列；以及通过使用第二掩膜图案将打孔的奇偶校验比特插入到所提取的至少一个第一附加奇偶校验比特序列来重建至少一个第二附加奇偶校验比特序列，其中，通过预设的掩膜图案来产生第一掩膜图案和次要掩膜图案，并且使用第一掩膜图案和次要掩膜图案来产生第二掩膜图案。根据本发明的另一方面，提供在通信系统的接收设备中用于恢复在多个帧上发送的奇偶校验比特序列的装置。所述装置包括：帧分解器，从所接收的帧中提取第一基本奇偶校验比特序列和至少一个第一附加奇偶校验比特序列；以及奇偶校验重建单元，通过使用第一掩膜图案将打孔的奇偶校验比特插入到所提取的第一基本奇偶校验比特序列来重建第二基本奇偶校验比特序列，并且通过使用第二掩膜图案将打孔的奇偶校验比特插入到所提取的至少一个第一附加奇偶校验比特序列来重建至少一个第二附加奇偶校验比特序列，其中，通过预设的掩膜图案产生第一掩膜图案和次要掩膜图案，并且使用第一掩膜图案和次要掩膜图案来产生第二掩膜图案。附图说明从结合附图的以下描述中，本发明的某些实施例的以上和其它方面、特点和优点将更加显而易见，其中：图1是示出根据本发明实施例的超帧的结构的图示；图2是示出根据本发明实施例的用于奇偶校验比特发送的数据结构的图示；图3是示出根据本发明实施例的图2中所示的第一奇偶校验部分的结构的图示；图4是示出根据本发明实施例的图2中所示的附加奇偶校验部分的结构的图示；图5是示出根据本发明实施例的在通信系统的发送设备中的发送帧产生设备的配置的框图；图6是示出根据本发明实施例的图5中所示的附加奇偶校验产生器的配置的实例的框图；图7是示出根据本发明实施例的图5中所示的附加奇偶校验产生器的配置的另一实例的框图；图8是示出根据本发明实施例的图7中所示的附加奇偶校验产生器中的操作时序的图示；图9是示出根据本发明实施例的图5中所示的附加奇偶校验产生器的配置的进一步的另一实例的框图；图10是示出根据本发明实施例的被包含在接收设备中的、并且与图9中所示的发送设备的配置相对应的组件的框图；以及图11是示出根据本发明实施例的图10中所示的奇偶校验重建单元的配置的框图。具体实施方式参照附图详细描述本发明实施例。在以下描述中，仅仅提供诸如详细配置和组件的特定细节以有助于本发明实施例的全面理解。因此，在不脱离本发明精神和范围的情况下可以进行这里所描述的实施例的各种改变和修改。此外，为了简明起见，可以省略对众所周知功能和结构的描述。在所有附图中，相同的图形参考编号将被理解为指代相同的元件、特点和结构。在以下所述的本发明实施例中，详细描述对在为产生基本奇偶校验比特序列而打孔期间被打孔的奇偶校验比特通过使用预设的打孔图案附加地打孔，产生被发送以获得足够分集增益的附加奇偶校验比特序列的装置和方法。根据本发明实施例，也可以使用掩膜图案来代替被用于产生基本奇偶校验比特序列的打孔图案和被用于产生附加奇偶校验比特序列的打孔图案。虽然在本发明的以下所述实施例中将硬件结构以产生附加奇偶校验比特的方式进行描述，但是在根据本发明实施例的实际实现中，不仅可以通过硬件结构而且也可以通过软件及其组合来实现相同的产生。图1是示出根据本发明实施例的超帧结构的图示。更特定地，图1示出作为在例如DVB-T2系统的广播系统中使用的超帧的DVB-T2帧。所述DVB-T2系统指代支持由覆盖全球数字电视(DTV)广播标准之一的数字视频广播(DVB)组织所运行的第二代数字地面电视广播的系统。参照图1，T2超帧包括多个T2帧和多个未来扩展帧(FEF)部分。考虑到DVB-T2标准的补充和演化，为了引入诸如多输入多输出(MIMO)的最新技术，将每个FEF部分插入到预设数量的T2帧之间。例如，图1示出具有其中将FEF部分插入到每两个T2帧之间的间隔的结构的T2超帧。然而，本发明实施例不限于FEF部分的这种具体插入周期，并且根据本发明实施例可以使用其他的间隔。对于本发明实施例，在与第iFEF部分相对应的第i帧中，发送针对与下一个第(i+1)FEF部分相对应的第(i+1)帧的附加奇偶校验比特。特定地，与每个FEF部分相对应的帧包含用于附加奇偶校验比特发送的附加奇偶校验部分110，其对应于被包含在用于第一奇偶校验比特(也被称为基本奇偶校验比特)发送的下一帧中的L1-Dyn部分120。提供此结构以便获得分集增益。图2是示出根据本发明实施例的用于奇偶校验比特发送的数据结构的图示。例如，图2示出图1中所示的附加奇偶校验部分110和L1-Dyn部分120的结构。参照图2，L1-Dyn部分120包括被提供以记录LDPC信息的广播信道(BCH)信息字段和BCH前向纠错(FEC)字段，以及被提供以记录第N个发送奇偶校验比特(即，形成第N个发送奇偶校验的比特)的第一奇偶校验部分(这里也被称为基本奇偶校验部分)。在L1-Dyn部分120中记录的所述信息可以是没有附加奇偶校验比特就能够解码的形式。将附加奇偶校验部分110附着于前面的帧以便获得高分集增益。图3是示出根据本发明实施例的图2中所示的第一奇偶校验部分的结构的图示。如图3中所示，第一奇偶校验部分包括未打孔奇偶校验比特。第一奇偶校验部分发送根据预设打孔图案对通过编码所产生的奇偶校验比特打孔之后所剩余的这些奇偶校验比特。图4是示出根据本发明实施例的图2中所示的附加奇偶校验部分的结构的图示。如图4中所示，附加奇偶校验部分包括从已打孔奇偶校验比特中选择的奇偶校验比特。附加奇偶校验部分发送从在为了从通过编码产生的奇偶校验比特当中选择被记录在第一奇偶校验部分中的奇偶校验比特而打孔期间被打孔的奇偶校验比特中选择的这些奇偶校验比特的一部分。图5是示出根据本发明实施例的，在通信系统的发送设备中的发送帧产生设备的配置的框图。特定地，图5示出在通信系统的发送设备中用于产生在多个帧上发送的奇偶校验比特序列的设备的配置。参照图5，编码器510使用预设的编码技术和编码速率对所接收的信息比特进行编码以便被发送。可以将用于此目的的编码技术和/或编码速率根据协议提前设置为特定技术和/或数值，或者可以在考虑信道条件的情况下做适当改变。编码器510通过编码输出与信息比特相对应的系统比特序列以及与附加奇偶校验比特序列相对应的至少一个奇偶校验比特序列。在图5中将假定编码器510输出一个奇偶校验比特序列。将由编码器510输出的系统比特序列提供给帧产生器530。将由编码器510输出的奇偶校验比特序列提供给奇偶校验重建单元520。奇偶校验重建单元520根据从编码器510提供的奇偶校验比特序列产生基本奇偶校验比特序列(即，第一奇偶校验比特序列)以及至少一个附加奇偶校验比特序列。在根据图5的本实例中，由奇偶校验重建单元520产生一个附加奇偶校验比特序列。为此，奇偶校验重建单元520包括用于产生基本奇偶校验比特序列的基本奇偶校验产生器522以及用于产生附加奇偶校验比特序列的附加奇偶校验产生器524。基本奇偶校验产生器522将使用预设打孔图案(此后被称为第一打孔图案)对通过编码输出的奇偶校验比特序列进行打孔之后所剩余的未打孔奇偶校验比特序列输出为基本奇偶校验比特序列。第一打孔图案可以由基本奇偶校验产生器522产生或选择，或者可以从外部实体提供。如果未打孔奇偶校验比特的数目超过了最后将被输出的基本奇偶校验比特的数目，则基本奇偶校验产生器522可以从未打孔奇偶校验比特中选择与最终输出的基本奇偶校验比特的数目相同数目的奇偶校验比特，或者可以去除与未打孔奇偶校验比特超过基本奇偶校验比特的数目相同数目的奇偶校验比特。如果未打孔奇偶校验比特的数目小于最终输出的基本奇偶校验比特数目，则基本奇偶校验产生器522通过重复一些未打孔奇偶校验比特可以输出与所期望数目相同数目的基本奇偶校验比特。然而，通过有效地使用第一打孔图案，可以将未打孔奇偶校验比特的数目与最终输出的基本奇偶校验比特的数目相匹配。通过根据第一打孔图案对通过执行编码所输出的奇偶校验比特序列进行打孔，基本奇偶校验产生器522将没有作为基本奇偶校验比特序列输出的奇偶校验比特提供给附加奇偶校验产生器524。然而，当附加奇偶校验产生器524根据从编码器510提供的奇偶校验比特序列产生附加奇偶校验比特序列时，它不必提供由基本奇偶校验产生器522打孔的奇偶校验比特。附加奇偶校验产生器524使用预设打孔图案(此后称为第二打孔图案)对被基本奇偶校验产生器522打孔的奇偶校验比特或者由编码器510提供的奇偶校验比特序列进行打孔，并且将打孔后剩余的未打孔奇偶校验比特输出为附加奇偶校验比特序列。第二打孔图案可以由附加奇偶校验产生器524来产生或选择，或者可以从外部实体提供。如果未打孔奇偶校验比特数目超过最终将输出的附加奇偶校验比特数目，则附加奇偶校验产生器524可以从未打孔奇偶校验比特中选择与最终输出的附加奇偶校验比特数目相同数目的奇偶校验比特，或者可以去除与未打孔奇偶校验比特超过附加奇偶校验比特的数目相同数目的奇偶校验比特。如果未打孔奇偶校验比特的数目小于最终输出的附加奇偶校验比特数目，则附加奇偶校验产生器524通过重复一部分未打孔奇偶校验比特，可以输出与所期望数目相同的附加奇偶校验比特。然而，通过有效地使用第二打孔图案，未打孔奇偶校验比特的数目可以与最终输出的附加奇偶校验比特的数目相匹配。帧产生器530基于从编码器510提供的系统比特序列以及从奇偶校验重建单元520提供的基本奇偶校验比特序列和至少一个附加奇偶校验比特序列产生要发送的帧(此后称为发送帧)。例如，帧产生器530可以产生以在图1至4中所示的结构的发送帧。图6是示出根据本发明实施例的图5中所示的附加奇偶校验产生器524的配置的实例的框图。参照图6，附加奇偶校验产生器524使用第二打孔图案对从基本奇偶校验产生器522提供的已打孔奇偶校验比特进行打孔，并且将在用第二打孔图案打孔后所剩余的未打孔奇偶校验比特输出为附加奇偶校验比特序列。第二打孔图案可以由事先已知的打孔图案产生，或者可以从外部实体提供。例如，如果第二打孔图案由已知的打孔图案产生，则附加奇偶校验产生器524使用已知的打孔图案产生或选择第一和第二打孔图案，并且将第一打孔图案提供给基本奇偶校验产生器522。附加奇偶校验产生器524使用第二打孔图案对从基本奇偶校验产生器522提供的已打孔奇偶校验比特进行打孔。为了执行上述操作，附加奇偶校验产生器524包括打孔器630、控制器620和存储器610。然而，如上所述，附加奇偶校验产生器524可以仅包括打孔器630，而控制器620和存储器610可以从外部实体单独提供。在此情形中，附加奇偶校验产生器524的存储器610可以存储一个或多个打孔图案。控制器620使用从存储器610提供的打孔图案产生第一和第二打孔图案，并且将所产生的第一打孔图案提供给基本奇偶校验产生器522。控制器620将所产生的第二打孔图案提供给打孔器630。可替换地，控制器620可以直接从存储器610接收第一和第二打孔图案，代替使用从存储器610提供的所述打孔图案来产生第一和第二打孔图案。在此情形中，控制器620可以不需要单独地执行产生第一和第二打孔图案的操作。换句话说，在此情形中，控制器620简单地从存储器610读取第一和第二打孔图案，并且将第一和第二打孔图案分别提供给基本奇偶校验产生器622和打孔器630。打孔器630使用由控制器620提供的第二打孔图案对从基本奇偶校验产生器522提供的已打孔奇偶校验比特进行打孔。打孔器630将使用第二打孔图案执行打孔后所剩余的未打孔奇偶校验比特输出为附加奇偶校验比特序列。在前面描述中，为了产生第一和第二打孔图案，存储器610向控制器620不仅可以提供相同的打孔图案而且也可以提供不同的打孔图案。由控制器620产生的第一和第二打孔图案可以具有相同或不同的打孔图案。图7是示出根据本发明实施例的图5中所示的附加奇偶校验产生器的配置的另一实例的框图。参照图7，附加奇偶校验产生器524使用附加掩膜图案对从编码器510提供的奇偶校验比特进行打孔，并且将在打孔后剩余的未打孔奇偶校验比特输出为附加奇偶校验比特序列。所述的附加掩膜图案可以由事先已知的打孔图案产生，或者可以从外部实体提供。例如，如果由已知的打孔图案产生附加掩膜图案，则附加奇偶校验产生器524使用已知的打孔图案产生或选择基本掩膜图案和附加掩膜图案，并且将基本掩膜图案提供给基本奇偶校验产生器522。附加奇偶校验产生器524使用附加掩膜图案对从编码器510提供的奇偶校验比特进行打孔。例如，附加奇偶校验产生器524可以使用由已知打孔图案产生的次要掩膜图案和基本掩膜图案产生附加掩膜图案。为了执行上述操作，附加奇偶校验产生器524包括存储器710、控制器720、第一掩膜产生器730、第二掩膜产生器740、模运算器750以及打孔器760。然而，被包含作为图7中的附加奇偶校验产生器524的组件的控制器720和存储器710根据本发明实施例可以从外部实体单独提供。在附加奇偶校验产生器524的配置的详细描述中，存储器710可以存储被用于产生基本掩膜图案(a)和/或次要掩膜图案(b)的一个或多个掩膜图案。响应于来自控制器720的请求，存储器710向控制器720提供所存储的掩膜图案之一。例如，存储器710可以独立地管理被用于产生基本掩膜图案(a)的一个或多个掩膜图案，以及被用于产生次要掩膜图案(b)的一个或多个掩膜图案。在此情形中，存储器710可以向控制器720独立地提供被用于产生基本掩膜图案(a)的掩膜图案以及被用于产生次要掩膜图案(b)的掩膜图案。控制器720将从存储器710读取的掩膜图案提供给第一和第二掩膜产生器730和740。第一掩膜产生器730使用预设的掩膜图案产生基本掩膜图案(a)。例如，所述的预设掩膜图案可以由控制器720从存储器710提供，或者可以由控制器720从内部产生或选择。第二掩膜产生器740使用预设的掩膜图案产生次要掩膜图案(b)。例如，所述的预设掩膜图案可以由控制器720从存储器710提供，或者可以由控制器720从内部产生或选择。次要掩膜图案(b)是被用于与基本掩膜图案(a)一起产生附加掩膜图案的掩膜图案。模运算器750通过对由第一掩膜产生器730产生的基本掩膜图案(a)和由第二掩膜产生器740产生的次要掩膜图案(b)执行或(OR)操作或模操作来产生附加掩膜图案。打孔器760使用由模运算器750产生的附加掩膜图案对从编码器510输出的奇偶校验比特序列进行打孔。打孔器760将用附加掩膜图案打孔之后剩余的未打孔奇偶校验比特输出为附加奇偶校验比特序列。图8是示出根据本发明实施例的，在图7中所示的附加奇偶校验产生器中的操作时序的图示。特定地，图8示出基于基本掩膜图案和次要掩膜图案产生附加掩膜图案的操作时序。参照图8，在由模操作所产生的附加掩膜图案中输出附加奇偶校验比特的间隔(即，其中对奇偶校验比特序列不执行打孔的间隔)由在基本掩膜图案中执行打孔的间隔和在次要掩膜图案中不执行打孔的间隔来定义。如下的表1示出基于基本掩膜图案和次要掩膜图案确定附加掩膜图案的实例。表1[表1]基本掩膜图案次要掩膜图案附加掩膜图案打孔间隔打孔间隔打孔间隔打孔间隔未打孔间隔未打孔间隔未打孔间隔未打孔间隔打孔间隔未打孔间隔打孔间隔打孔间隔根据表1，仅仅当基本掩膜图案对通过编码输出的奇偶校验比特序列执行打孔，并且次要掩膜图案不要求打孔时，通过对通过编码输出的奇偶校验比特序列未打孔(即，不打孔)可以输出附加奇偶校验比特序列。表1示出产生附加掩膜图案的实例，并且可以以各种不同的图案产生所述的附加掩膜图案。图9是进一步示出根据本发明实施例的图5中所示的附加奇偶校验产生器524的配置的另一实例的框图。特定地，图9示出被扩展为产生多个附加奇偶校验比特序列的，图7中所示的附加奇偶校验产生器524的配置的实例。考虑到产生附加奇偶校验比特序列的数量，图9中所示的附加奇偶校验产生器524额外地包括：掩膜产生器930-1、930-2、…..930-n；模运算器940-1、940-2、….940-n以及打孔器950-1、950-2、….950-n。作为实例，图9示出为了产生(n-1)个附加奇偶校验比特序列，附加奇偶校验产生器524具有每一个包含掩膜产生器、模运算器和打孔器的(n-1)个产生器，所述产生器与要产生的附加奇偶校验比特序列相匹配。换句话说，附加奇偶校验产生器524包括(n-1)个产生它们自己的附加奇偶校验比特序列的产生器。通过对由构成在前一级被提供以产生附加奇偶校验比特序列的装置的掩膜产生器所产生的次要掩膜图案执行模操作，以及对由其自身掩膜产生器所产生的次要掩膜图案执行模操作，形成n-1个产生器的每一个的模运算器940-n产生附加掩膜图案。图10是示出根据本发明实施例的，用于从通信系统的发送设备中的发送帧中恢复信息比特的配置的框图。特定地，图10示出用于使用在通信系统的发送设备中的多个帧上发送的奇偶校验比特序列获得信息比特的设备。参照图10，除了系统比特序列之外，帧分解器1010还从由预定义结构所接收的发送帧中提取基本奇偶校验比特序列和至少一个附加奇偶校验比特序列。帧分解器1010输出所提取的系统比特序列、基本奇偶校验比特序列和至少一个附加奇偶校验比特序列。将系统比特序列提供给用于解码的解码器1030。同时，由于在发送设备中已经对这些序列进行了打孔，因此将基本奇偶校验比特序列和至少一个附加奇偶校验比特序列代替地提供给奇偶校验重建单元1020用于恢复。如果发送设备调制了从帧分解器1010输出的系统比特序列、基本奇偶校验比特序列和至少一个附加奇偶校验比特序列，则可以提前执行对系统比特序列、基本奇偶校验比特序列和至少一个附加奇偶校验比特序列的解调过程。为了简明起见，省略了对解调过程和配置的详细描述。然而，为了描述方便，在图中将从帧分解器1010输出并且输出给奇偶校验重建单元1020的基本奇偶校验比特序列和一个或多个附加奇偶校验比特序列分别用LLR(奇偶校验)和LLR(AP1)至LLR(APn)来表示，假设对这些序列进行了解调。考虑到在发送设备中通过预设的打孔图案对这些序列进行打孔，奇偶校验重建单元1020重建基本奇偶校验比特序列LLR(奇偶校验)和至少一个附加奇偶校验比特序列LLR(AP1)至LLR(APn)。奇偶校验重建单元1020将被重建的基本奇偶校验比特序列LLR(奇偶校验)和至少一个附加奇偶校验比特序列LLR(AP1)至LLR(APn)输出给解码器1030。解码器1030对从帧分解器1010提供的系统比特序列以及从奇偶校验重建单元1020提供的基本奇偶校验比特序列LLR(奇偶校验)和一个或多个附加奇偶校验比特序列LLR(AP1)至LLR(APn)进行解码，并且输出通过解码获得的信息比特序列。图11是示出根据本发明实施例的图10中所示的奇偶校验重建单元的配置的框图。图11中所示的结构重建一个基本奇偶校验比特序列和n个附加奇偶校验比特序列。参照图11，存储器1120存储被预设以重建基本奇偶校验比特序列和至少一个附加奇偶校验比特序列的一个或多个掩膜图案或打孔图案。一旦接收到来自控制器1110的请求，存储器1120从所存储的一个或多个掩膜图案或打孔图案当中输出被请求数量的掩膜图案或打孔图案之一。控制器1110向第一至第三掩膜产生器1130、1132和1134提供从存储器1120读取的所述掩膜图案或打孔图案。为了描述方便，术语“掩膜图案”此后指代掩膜图案和打孔图案两者。第一掩膜产生器1130使用从控制器1110提供的掩膜图案产生基本掩膜图案。通过基于基本掩膜图案将由发送设备打孔的奇偶校验比特插入到基本奇偶校验比特序列LLR(奇偶校验)中，第一掩膜单元1150重建作为由发送设备经历打孔之前存在的序列的基本奇偶校验比特序列LLR(奇偶校验)。第一掩膜单元1150将已重建的基本奇偶校验比特序列LLR(奇偶校验)输出给解码器1030。第二掩膜产生器1132使用从控制器1110提供的掩膜图案产生第一次要掩膜图案。由第二掩膜产生器1132产生的第一次要掩膜图案与由第一掩膜产生器1130产生的基本掩膜图案通过逻辑运算器1140执行或操作(或者逻辑和操作)，从而产生第一附加掩膜图案。通过基于第一附加掩膜图案将由发送设备打孔的奇偶校验比特插入到第一附加奇偶校验比特序列LLR(AP1)，第二掩膜单元1152重建作为在由发送设备经历打孔之前的序列的第一附加奇偶校验比特序列LLR(AP1)。第二掩膜单元1152将已重建的第一附加奇偶校验比特序列LLR(AP1)输出给解码器1030。第n掩膜产生器1134使用从控制器1110提供的掩膜图案产生第n个次要掩膜图案。由第n掩膜产生器1134产生的第n个次要掩膜图案与由前一级的逻辑运算器产生的第n-1附加掩膜图案通过逻辑运算器1142执行或操作，从而产生第n附加掩膜图案。通过基于第n附加掩膜图案将由发送设备打孔的奇偶校验比特插入到第n附加奇偶校验比特序列LLR(APn)，第n掩膜单元1154重建作为在由发送设备进行打孔之前的序列的第n附加奇偶校验比特序列LLR(APn)。第n掩膜单元1154将已重建的第n附加奇偶校验比特序列LLR(APn)输出给解码器1030。正如在前面描述中所显而易见的，在本发明实施例中，通过产生被用于获得足够分集增益的附加奇偶校验比特序列，可以提高广播系统的性能。从前面描述中，各种其它的效果可以以明示或暗示方式显而易见。在前面描述中，尽管在上述的本发明实施例中假定在存储器中存储了打孔图案，按照本发明实施例，当必要时可以通过序列产生器(图中未示出)产生所述的打孔图案。尽管参照其某些实施例已经示出和描述了本发明，本领域技术人员将理解到，在不脱离由所附权利要求书及其等价物所定义的本发明范围情况下，可以在那里对其在形式和细节上进行各种改变。