专利名称：可以自动切换启动模式的解码器装置的制作方法
技术领域：
本实用新型属于通信技术领域，尤其涉及解码器技术领域。
背景技术：
解码器则包括视频解码器和音频解码器。目前，通常的解码器，一般将解码器的启动程序存放在PCI (Peripheral Component Interconnect，外围组件互联接口标准)主机的驱动程序中，而没有在解码器内部设置用于解码器的启动程序备份的存储器。这样，一旦 PCI主机出现故障或者PCI驱动程序被破坏，解码器的启动程序将完全丢失，使解码器不能单独进行维修和调试。
实用新型内容本实用新型的目的是为了克服现有的解码器不能单独启动的不足，提出了可以自动切换启动模式的解码器装置。本实用新型的技术方案是可以自动切换启动模式的解码器装置，包括处理器单元、内存单元和PCI连接器，其特征在于，还包括总线开关单元和存储器单元，所述总线开关单元通过EMIFA总线和处理器单元联结实现通信，通过Flash总线和存储器单元联结实现通信，通过PCI总线和PCI连接器连接实现通信，所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接，用以控制总线开关单元与存储器单元和PCI连接器通信的开断，所述PCI信号检测线具有连接有电阻的高电平端。所述总线开关单元具有三个控制端，其中两个控制端分别为高电平和低电平，一个控制端与PCI连接器连接，当PCI连接器与PCI主机连接时PCI连接器输出低电平，当 PCI连接器与PCI主机断开时PCI连接器输出高电平，从而用以控制总线开关单元与存储器单元和PCI连接器通信的开断。本实用新型的有益效果是由于本实用新型的解码器自身具有可以存储解码器的启动程序的存储器单元，而且具有控制制总线开关单元与存储器单元和PCI连接器通信的开断的PCI信号检测线，因此本实用新型的解码器可以自动选择通过PCI主机调取驱动程序或者通过调取自身存储器单元的驱动程序启动，从而使解码器自成一个完整的模块，可以单独进行启动，这样，一旦PCI主机出现故障或者PCI驱动程序被破坏，就可以把解码器从PCI主机上取下，在单独供电的情况下单独启动解码器，从而可以单独对解码器进行调试或软件升级，以排除解码器本身的问题。
图1是本实用新型的具体实施例的结构原理图。图2是本实用新型的具体实施例内启动时的结构原理图。图3是本实用新型的具体实施例外启动时的结构原理图。图4是本实用新型的具体实施例总线开关单元的结构原理图。[0011]附图标记说明处理器单元1、内存单元2、总线开关单元3、PCI连接器4、存储器单元5、电源单元6。
具体实施方式
以下结合附图和具体实施例对本实用新型做进一步的说明。再对具体实施例进行说明前，先做如下基础性定义。本实用新型中解码器的启动模式被分为内启动和外启动两种模式，当解码器从其自身的存储器单元调取备份的解码器的驱动程序单独启动时被称为内启动，当解码器通过 PCI连接器从PCI主机中调取解码器的驱动程序启动时被称为外启动。另外，本实用新型中高电平和低电平的定义是相对的，如定义高电平为5V，低电平为0V，此时高电平和低电平相当于控制信号中的数字信号“1”和“0”，当然也可以将高电平和低电平的具体数值进行调整或者将高电平和低电平对应的数字信号做相反定义，这些情况都不会被视为对本实用新型的保护范围的限制。如图1所示，可以自动切换启动模式的解码器装置，包括处理器单元、内存单元、PCI连接器、总线开关单元和存储器单元，所述总线开关单元通过EMIFA总线 (Asynchronous External Memory Interface，异步外围存储器接口)和处理器单元联结实现通信，通过Flash总线和存储器单元联结实现通信，通过PCI总线和PCI连接器连接实现通信，所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接用以控制总线开关单元与存储器单元和PCI连接器通信的开断，所述PCI信号检测线具有连接有电阻的高电平端。图中的处理器单元可以是具备DDR(Double Data Rate SDRAM，双倍速率同步动态随机存储器)专用接口的DSP (Digital Signal I^rocessor，数字信号处理器)或专用媒体处理器，该处理器单元还必须具备EMIFA总线接口 ；内存单元可以是DDR、DDR2、DDR3等；总线开关单元的信号连通电阻需要小于5Ω，且信号的通道数不能低于PCI连接器的信号数据总数，总线开关单元推荐使用型号为SN74CBT16214或SN74CBTLV16214的总线开关，该总线开关有三位通路选择控制端，可以切换8组信号的连接状态，但是本实施例只需切换两组信号的连接状态；存储器单元可以是N0R(或非门FLASH存储器)类型，也可以是NAND (与非门FLASH存储器)类型。如图4所示为具体实施例总线开关单元的结构原理图，所述总线开关单元具有三个控制端SO、Sl和S2，其中两个控制端SO和Sl分别为高电平和低电平，一个控制端S2与 PCI连接器连接，当PCI连接器与PCI主机连接时PCI连接器输出低电平，当PCI连接器与 PCI主机断开时PCI连接器输出高电平，从而用以控制总线开关单元与存储器单元和PCI连接器通信的开断。图中出现的电源单元6可以不被视为本解码器装置的组成部分，它用于向解码器装置的各个组成单元输出各种电压，本实施例中电源单元6的输入端分别接入5V电压和 12V电压，输入端输出分别输出1.2V、1.8V、3. 3V或5V电压，当外启动时输入5V电压，内启动时输入12V电压。由于在本实施例中只需切换两组信号的连接状态，将处理器单元的控制端SO拉高为高电平、控制断Sl拉低为低电平，仅使用控制端S2 —端就可以实现二选一开关控制，当[S0S1S2] = 100时，EMIFA总线侧与PCI侧连通；当S0S1S2=101时，EMIFA总线侧与Flash总线侧连通。PCI信号检测线连接到PCI连接器的一个地信号连接脚。当解码器没有连接PCI 主机时，该连接脚因上拉电阻(此处电阻取值1ΚΩ)的电平上移作用呈现为高电平，从而使使处理器单元的控制端S2也为高电平；另外，当解码器连接PCI主机时，该连接脚因主机上 PCI插槽连接到地而使其电平下移为低电平，从而使处理器单元的控制端S2为低电平。由于采用上述原理，使处理器单元的控制端S2的电平随着解码器连接PCI主机或不连接PCI 主机而发生高电平和低电平即数字信号0、1之间的逻辑改变，从而解码器自动改变了启动模式。如图2所示为实施例内启动时的结构原理图，当解码器没有连接到PCI主机时， PCI信号检测线连接的处理器单元的控制端S2也高电平，此时，总线开关单元将EMIFA总线与Flash总线接通(同时将EMIFA总线与PCI总线断开)，在电源和其它系统控制信号稳定后，解码器将自动从存储器单元加载解码器的启动程序，弓丨导主程序的运行。如图3所示为实施例外启动时的结构原理图，当解码器连接到PCI主机时，PCI 信号检测线连接的处理器单元的控制端S2为低电平，此时，总线开关单元将EMIFA总线与 Flash总线断开(同时将EMIFA总线与PCI总线接通)，在电源和其它系统控制信号稳定后， 解码器将自动从PCI主机加载解码器的启动程序，引导主程序的运行。本领域的普通技术人员将会意识到，这里所述的实施例是为了帮助读者理解本实用新型的原理，应被理解为本实用新型的保护范围并不局限于这样的特别陈述和实施例。 本领域的普通技术人员可以根据本实用新型公开的这些技术启示做出各种不脱离本实用新型实质的其它各种具体变形和组合，这些变形和组合仍然在本实用新型的保护范围内。
权利要求1.可以自动切换启动模式的解码器装置，包括处理器单元、内存单元和PCI连接器，其特征在于，还包括总线开关单元和存储器单元，所述总线开关单元通过EMIFA总线和处理器单元联结实现通信，通过Flash总线和存储器单元联结实现通信，通过PCI总线和PCI连接器连接实现通信，所述PCI连接器弓丨出有一根PCI信号检测线和总线开关单元连接，用以控制总线开关单元与存储器单元和PCI连接器通信的开断，所述PCI信号检测线具有连接有电阻的高电平端。
2.根据权利要求1所述的可以自动切换启动模式的解码器装置，所述总线开关单元具有三个控制端，其中两个控制端分别为高电平和低电平，一个控制端与PCI连接器连接。
专利摘要本实用新型涉及可以自动切换启动模式的解码器装置，包括处理器单元、内存单元和PCI连接器，其特征在于，还包括总线开关单元和存储器单元，所述总线开关单元通过EMIFA总线和处理器单元联结实现通信，通过Flash总线和存储器单元联结实现通信，通过PCI总线和PCI连接器连接实现通信，所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接用以控制总线开关单元与存储器单元和PCI连接器通信的开断，所述PCI信号检测线具有连接有电阻的高电平端。本实用新型的有益效果是在单独供电的情况下可以单独启动解码器，从而可以单独对解码器进行调试或软件升级，以排除解码器本身的问题。
文档编号G05B19/042GK201984310SQ20102058146
公开日2011年9月21日 申请日期2010年10月29日 优先权日2010年10月29日
发明者王勤 申请人:成都九洲电子信息系统有限责任公司