一种高电子迁移率晶体管及制备方法与流程

1.本发明涉及半导体技术领域，具体而言，涉及一种高电子迁移率晶体管及制备方法。


背景技术：

2.第三代半导体材料氮化镓由于具有大禁带宽度(3.4ev)、高电子饱和速率(2
×
107cm/s),高的击穿电场(1
×
1010～3
×
1010v/cm)，较高热导率,耐腐蚀和抗辐射性能，成为当前研究热点，具有广阔的应用前景。在高电子迁移率晶体管(hemt)器件应用中，发现当hemt源漏电压较高时，器件的输出电流大大减小；而且rf信号下器件的输出功率明显减小(rf power compression)，同时，输出功率密度和功率附加效率也会随之减小(rf dispersion)，这种电流崩塌现象引起的器件性能衰退，限制了器件性能的发挥。
3.现有为抑制gan hemt器件的电流崩塌和在rf应用中的功率压缩，一种方法采用的方法有生长氮化硅钝化层，来改善algan与钝化层界面来调控陷阱态，另一种方法是调控沟道层下缓冲层掺杂状态，用以调控关态漏电流，来实现对外延材料中外延生长的陷阱态的调控，利用制造微漏电通道的方法来调控陷阱态引起的电流降低，从而抑制电流崩塌现象。但目前此两种方法对电流崩塌的抑制效果均有限，而且对高频频散的抑制并不显著。


技术实现要素：

4.本发明的目的在于，针对上述现有技术中的不足，提供一种高电子迁移率晶体管及制备方法，以改善现有对电流崩塌抑制效果不佳以及提高器件高频频散的抑制效果。
5.为实现上述目的，本发明实施例采用的技术方案如下：
6.本发明实施例的一方面，提供一种高电子迁移率晶体管制备方法，方法包括：在衬底上依次形成第一缓冲层、磁性介质层和第二缓冲层；在第二缓冲层上形成漂移层；在漂移层上分别形成源极金属、漏极金属和栅极金属，源极金属、漏极金属和栅极金属在衬底的正投影均位于磁性介质层在衬底上的正投影内。
7.可选的，第一缓冲层、磁性介质层和第二缓冲层的厚度之和小于3μm。
8.可选的，磁性介质层的厚度为10nm至100nm。
9.可选的，在第二缓冲层上形成漂移层之后，方法还包括：通过台面隔离工艺或绝缘离子注入工艺在漂移层上界定出有源区和无源区，磁性介质层位于漂移层的有源区。
10.可选的，在漂移层上分别形成源极金属、漏极金属和栅极金属包括：在漂移层上形成钝化层；刻蚀钝化层以形成源极开口和漏极开口；在源极开口和漏极开口内的漂移层上蒸镀金属以分别形成源极金属和漏极金属，源极金属和漏极金属分别与漂移层欧姆接触；在源极金属和漏极金属之间的钝化层上刻蚀形成栅极开口；在栅极开口内的漂移层上蒸镀金属形成栅极金属，栅极金属与漂移层形成肖特基接触。
11.可选的，漂移层包括依次形成于第二缓冲层上的沟道层、插入层和势垒层。
12.可选的，磁性介质层为cr2ge2te6、fe3gete2、cri3、bi系陶瓷薄膜和ir系陶瓷薄膜中
的一种。
13.可选的，漂移层包括依次形成的gan层和algan层，栅极金属为ni。
14.本发明实施例的另一方面，提供一种高电子迁移率晶体管，包括衬底，设置在衬底上的第一缓冲层，设置在第一缓冲层上的磁性介质层，设置在磁性介质层上的第二缓冲层，设置在第二缓冲层上的漂移层，设置在漂移层上的源极金属、漏极金属和栅极金属，源极金属、漏极金属和栅极金属在衬底的正投影均位于磁性介质层在衬底上的正投影内。
15.可选的，磁性介质层为cr2ge2te6、fe3gete2、cri3、bi系陶瓷薄膜和ir系陶瓷薄膜中的一种。
16.本发明的有益效果包括：
17.本发明提供了一种高电子迁移率晶体管及制备方法，方法包括：在衬底上依次形成第一缓冲层、磁性介质层和第二缓冲层；在第二缓冲层上形成漂移层；在漂移层上分别形成源极金属、漏极金属和栅极金属，源极金属、漏极金属和栅极金属在衬底的正投影均位于磁性介质层在衬底上的正投影内，在此状态下，磁性介质层工作在交变电场中，在射频磁场介入时，会产生交变电场，进而产生磁场，在磁场的作用下，磁性介质层中由于磁化作用，会产生感应电流，进而形成微导电通道，抵消由于trapping效应中捕获载流子引发的器件电流崩塌现象，以此来调控陷阱态造成的电流降低现象，有效的缩短了栅延迟时间，改善射频应用中的功率压缩和高频散射，提升hemt器件的性能和稳定性。
附图说明
18.为了更清楚地说明本发明实施例的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，应当理解，以下附图仅示出了本发明的某些实施例，因此不应被看作是对范围的限定，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他相关的附图。
19.图1为本发明实施例提供的一种高电子迁移率晶体管制备方法的流程示意图；
20.图2为本发明实施例提供的一种高电子迁移率晶体管的状态示意图之一；
21.图3为本发明实施例提供的一种高电子迁移率晶体管的状态示意图之二；
22.图4为本发明实施例提供的一种高电子迁移率晶体管的状态示意图之三；
23.图5为本发明实施例提供的一种高电子迁移率晶体管的状态示意图之四；
24.图6为本发明实施例提供的一种高电子迁移率晶体管的状态示意图之五；
25.图7为本发明实施例提供的一种高电子迁移率晶体管的状态示意图之六；
26.图8为本发明实施例提供的一种高电子迁移率晶体管的机构示意图。
27.图标：100
‑
衬底；210
‑
第一缓冲层；220
‑
第二缓冲层；230
‑
沟道层；240
‑
插入层；250
‑
势垒层；310
‑
磁性介质层；410
‑
钝化层；500
‑
无源区；610
‑
源极金属；620
‑
漏极金属；630
‑
栅极金属。
具体实施方式
28.为使本发明实施例的目的、技术方案和优点更加清楚，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明一部分实施例，而不是全部的实施例。通常在此处附图中描述和示出的本发明实施
例的组件可以以各种不同的配置来布置和设计。
29.因此，以下对在附图中提供的本发明的实施例的详细描述并非旨在限制要求保护的本发明的范围，而是仅仅表示本发明的选定实施例。需要说明的是，在不冲突的情况下，本发明的实施例中的各个特征可以相互结合，结合后的实施例依然在本发明的保护范围内。
30.应注意到：相似的标号和字母在下面的附图中表示类似项，因此，一旦某一项在一个附图中被定义，则在随后的附图中不需要对其进行进一步定义和解释。
31.在本发明的描述中，需要说明的是，术语“第一”、“第二”、“第三”等仅用于区分描述，而不能理解为指示或暗示相对重要性。
32.本发明实施例的一方面，提供一种高电子迁移率晶体管制备方法，其可以通过磁性介质层改善对hemt器件的电流崩塌效应和高频频散抑制的效果，如图1所示，该方法包括：
33.s010：在衬底上依次形成第一缓冲层、磁性介质层和第二缓冲层。
34.首先提供一种衬底100，该衬底100可以是用于承载半导体集成电路元器件的基材，例如si、sic、蓝宝石等。如图2所示，然后在衬底100上先沉积形成第一缓冲层210，如图3所示，在第一缓冲层210上继续沉积形成磁性介质层310，在形成磁性介质层310后，如图4所示，在磁性介质层310上继续沉积形成第二缓冲层220，其中，磁性介质层310、第一缓冲层210和第二缓冲层220可以是单层、双层或多层等等，本技术对其不做具体限制。通过在磁性介质层310的上下两侧均形成缓冲层的方式，可以在器件中插入磁性介质层310时有效的提高器件的稳定性。上述沉积的方式可以是通过化学气相沉积(cvd)、物理气相沉积(pvd)或原子层沉积(ald)等工艺进行，在漂移层上沉积磁性介质层310，磁性介质层310可以是通过ald、pecvd、lpcvd、其他cvd、mbe、转移(撕拉、电化学转移)、溶胶凝胶等方法中的一种或者任意两种或三种的组合制作，本技术对其不做限定，具体可以根据实际需求进行合理选择。在一些实施方式中，可以利用mocvd 800c沉积1μm厚的第一缓冲层210，然后采用mbe 600c沉积100nm厚的磁性介质层310，利用mocvd 800c沉积200nm厚的第二缓冲层220。
35.s020：在第二缓冲层上形成漂移层。
36.如图5所示，为了形成hemt器件的基本层级结构，还可以在第二缓冲层220上继续沉积形成漂移层，其中，漂移层可以是两层或多层，设置时应当结合器件需求进行合理选择，本技术不对其做限制，当然，本领域技术人员应当知晓，漂移层应当至少包括沟道层230和势垒层250，如此，能够形成具有异质结的导电沟道。
37.s030：在漂移层上分别形成源极金属、漏极金属和栅极金属，源极金属、漏极金属和栅极金属在衬底的正投影均位于磁性介质层在衬底上的正投影内。
38.如图8所示，在s020中形成hemt器件的漂移层后，在漂移层上通过光刻、蒸镀金属、剥离的方式分别形成源极金属610、漏极金属620和栅极金属630，其中，源极金属610和漏极金属620分别与漂移层形成欧姆接触，栅极金属630与漂移层形成肖特基接触。栅极金属630位于源极金属610和漏极金属620之间，从而对源漏之间形成的沟道进行控制，且源极金属610、漏极金属620和栅极金属630间隔设置，应当使得源极金属610、漏极金属620和栅极金属630在衬底100的正投影均位于磁性介质层310在衬底100上的正投影内，在此状态下，磁性介质层310工作在交变电场中，在射频磁场介入时，会产生交变电场，进而产生磁场，在磁
场的作用下，磁性介质层310中由于磁化作用，会产生感应电流，进而形成微导电通道，抵消由于trapping效应中捕获载流子引发的器件电流崩塌现象，以此来调控陷阱态造成的电流降低现象，有效的缩短了栅延迟时间，改善射频应用中的功率压缩和高频散射，提升hemt器件的性能和稳定性。
39.可选的，第一缓冲层210、磁性介质层310和第二缓冲层220的厚度之和小于3μm，如此，能够有效提高器件的性能。
40.可选的，磁性介质层310可以是cr2ge2te6的铁磁性薄膜、fe3gete2、cri3或铋bi系、铱ir系陶瓷薄膜等中的一种，磁性介质层310的厚度可以是10nm至100nm，例如30nm、50nm、70nm、90nm等，以此，当射频信号引入时，会产生交变电场，进而产生磁场，磁性介质层310在磁场作用下产生感应电流，抵消gan器件固有的陷阱态引入的电流崩塌，进而达到抑制器件高频频散和功率塌缩的效果。
41.可选的，如图5至图8所示，漂移层可以包括依次形成于第二缓冲层220上的沟道层230、插入层240和势垒层250，其中，第二缓冲层220可以是gan，沟道层230可以是gan，插入层240可以是aln，势垒层250可以是algan。
42.在一些实施方式中，可以利用mocvd 800c沉积300nm厚的沟道层230，利用mocvd 1080c沉积1nm厚的插入层240，利用mocvd 1080c沉积22nm厚的势垒层250，利用pecvd或ald进行钝化层410的沉积。
43.此外，栅极金属630可以是根据漂移层中的势垒层250和沟道层230进行合理选择，其应当相对于势垒层250和沟道层230具有更大的功函数，以保证通过二者功函数差，可以将栅极区域沟道中的电子耗尽。例如栅极金属630可以是ni、镍基氧化物或者其它材料，可以是低温或高温或通过对金属材料进行氧化形成。
44.可选的，在漂移层上分别形成源极金属610、漏极金属620和栅极金属630时，如图7所示，可以先在漂移层上沉积钝化层410，然后通过刻蚀钝化层410，刻蚀方式可以是通过干法刻蚀，在钝化层410上打开两个开口，分别作为源极开口和漏极开口，使得位于钝化层410下方的漂移层分别在源极开口和漏极开口内露出。如图8所示，接着在钝化层410上的源极开口和漏极开口内蒸镀金属，从而在源极开口内形成与漂移层欧姆接触的源极金属610，在漏极开口内形成与漂移层欧姆接触的漏极金属620，制作时，通常可以将源极金属610和漏极金属620在同一步骤中制作形成，源极金属610和漏极金属620都可以是叠层金属，例如ti/au。然后继续刻蚀钝化层410并且终止于漂移层，从而在钝化层410上形成栅极开口，栅极开口位于源漏之间的钝化层410上，在栅极开口内露出钝化层410下方的漂移层，然后通过光刻、蒸镀金属、剥离金属等方式，在栅极开口内形成栅极金属630。利用钝化层410可以对器件起到保护作用，同时，钝化层410还可以隔离源极金属610、漏极金属620和栅极金属630。
45.可选的，为了使得半导体器件具有较好的性能表现，还可以在通过s020在第二缓冲层220上形成漂移层后，如图6所示，通过台面隔离工艺或绝缘离子注入工艺在漂移层上形成无源区500，同时，也界定出有源区，无源区500可以是位于有源区的外围，源极金属610、漏极金属620和栅极金属630也均位于有源区。
46.以下将以绝缘离子注入工艺为例进行说明：
47.如图6所示，可以先在漂移层上涂覆光阻，为了使得涂布的更加均匀，还可以采用
旋转涂布，然后将涂布有光阻的器件，经软烘、边缘光刻胶去除、对准、曝光、显影、硬烘等步骤，在光阻上打开开口，此时，对应将位于光阻下方的漂移层在开口内漏出，而后，采用绝缘离子注入工艺，向开口内的漂移层上注入绝缘离子，以此，使得漂移层上被注入绝缘离子的区域形成无源区500，同时，被光阻遮挡而未被注入的区域则作为有源区。
48.本发明实施例的另一方面，提供一种高电子迁移率晶体管，如图8所示，包括衬底100，设置在衬底100上的第一缓冲层210，设置在第一缓冲层210上的磁性介质层310，设置在第二缓冲层220上的漂移层，设置在漂移层上的源极金属610、漏极金属620和栅极金属630，源极金属610、漏极金属620和栅极金属630在衬底100的正投影均位于磁性介质层310在衬底100上的正投影内，在此状态下，磁性介质层310工作在交变电场中，在射频磁场介入时，会产生交变电场，进而产生磁场，在磁场的作用下，磁性介质层310中由于磁化作用，会产生感应电流，进而形成微导电通道，抵消由于trapping效应中捕获载流子引发的器件电流崩塌现象，以此来调控陷阱态造成的电流降低现象，有效的缩短了栅延迟时间，改善射频应用中的功率压缩和高频散射，提升hemt器件的性能和稳定性。
49.可选的，磁性介质层310可以是cr2ge2te6的铁磁性薄膜、fe3gete2、cri3或铋bi系、铱ir系陶瓷薄膜等中的一种，磁性介质层310的厚度可以是10nm至100nm，例如30nm、50nm、70nm、90nm等，以此，当射频信号引入时，会产生交变电场，进而产生磁场，磁性介质层310在磁场作用下产生感应电流，抵消gan器件固有的陷阱态引入的电流崩塌，进而达到抑制器件高频频散和功率塌缩的效果。
50.以上所述仅为本发明的优选实施例而已，并不用于限制本发明，对于本领域的技术人员来说，本发明可以有各种更改和变化。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。