专利名称:振荡电路的制作方法
本发明涉及一种振荡电路，特别涉及这样一种振荡电路这种电路适用于产生一个频率稳定的输出，该频率被锁到一个频率恒定的参考信号上。
在视频信号仪器中，需要使用这样一种高频脉冲信号，该信号对一个视频信号周期(例如水平扫描周期)具有预定的相位。高频脉冲信号用作仪器的采样脉冲或时钟脉冲，以把视频信号转化成数字信号，一个包括供视频信号使用的电荷耦合器件(CCD)在内的延迟电路等等。
在先有技术中，具有压控振荡器(以下称为VCO)的锁相环(以下称PLL)已得到广泛地应用。基本上在这种迴路中，将VCO的输出作除法运算，被除法的输出与参考信号作相位比较，而VCO由一个误差信号控制，因此可以得到一个频率比参考信号还要高的稳定信号。在视频仪器中，一般以水平扫描频率(fH)作为参考信号的频率，而用等于或低于fH910倍的频率作为VCO的振荡频率。因为NTSC彩色电视系统的fH是15，734，246赫芝，其910倍约为14.3兆赫。因为能够用市场上的数字电路元件在这样的频率上很好地工作，所以上述PLL电路已被使用。
然而，在上述技术中，因为必须使用除法器把VCO的输出分成参考信号的频率，所以存在一些问题。这就是说电路的规模比较大，並且在VCO中产生的噪声也会迭加到视频信号上。
本发明的目的之一是提供一个不含除法器的振荡电路。
本发明的另一个目的是，提供一个电路规模小的PLL型振荡器。
为了达到上述目的，根据本发明，振荡电路中含有以下的装置一个电压控制振荡装置，其振荡频率是参考信号频率的N倍;一个用来选择性地提取振荡输出的预定相位之一的装置，上述相位在参考信号的每个重复周期中参考信号的一个预定相位的附近;一个把振荡输出的被提取的相位与参考信号的预定相位进行比较的装置;还有一个低通滤波器(LPF)，用来通过相位比较装置的输出，其中LPF的输出用作电压控制振荡装置的频率控制信号。
此外，根据本发明，可以使用一种有三个D-型触发器(DFF)的数字电路，或者使用另一种包括有二个T型触发器(TFF)和一个DFF的数字电路作为提取装置和比较装置。在前一种电路中，两个DFF的输入端D接收参考信号，而两个DFF的时钟端CK分别接收电压控制振荡装置的振荡输出及其振荡输出的倒相脉冲。两个DFF的Q输出分别输给第三个DFF的时钟端CK和输入端D。第三个DFF的Q输出加到LPF上以产生频率控制信号。
另外，在后一种电路中，两个TFF的清除(Clear)端CLR接收参考信号的倒相信号，而两个TFF的时钟端CK则分别接收振荡输出的倒相脉冲及该振荡输出。两个TFF的Q输出分别加到DFF的时钟端CK和输入端。DFF的Q输出则输给LPF以产生频率控制信号。
例如，用振荡输出的前沿或后沿作为振荡输出的预定相位。而且，用参考信号的每个重复周期的前沿或后沿作为参考信号的预定相位。在这个技术领域：
中，整数N大约定为几百或几十。
图1是本发明振荡电路的一个实施例的方框图，图2A-2C是图1方框图中主要部份的波形，
图3是图1实施例电压控制振荡器6的一个例子的线路图，图4是图1所示相位提取器8(Phase extractor)的一个实施例的方框图，图5A-5D示出了图4方框图中主要部份的波形，图6是图1所示相位提取器8和相位比较器3的一个实施例的方框图，图7A-7G示出了图6方框图中主要部份的波形，图8例出了图1中相位比较器3和相位提取器8的另一个实施例的线路图，图9是图1所示相位比较器3和相位提取器8的另一个实施例的方框图，图10A-10E是图9所示方框图中的主要部份的波形，图11是本发明振荡电路的另一个实施例的方框图，图12A-12I是图11所示方框图中主要部份的波形。
图1是解释本发明实质的方框图，参看图1，参考脉冲信号1和反馈信号2在相位比较器3上进行比较。相位比较器3的输出信号经低通滤波器(LPF)4滤波。电压控制振荡器(VCO)6由来自LPF4的频率控制电压5控制。在本发明中，为了产生反馈信号2，用相位提取器8来代替先有技术中的除法器。在每个参考脉冲信号重复周期的参考脉冲信号1的前沿附近，相位提取器8提取VCO6的输出信号7的一个前沿。
图2A是参考脉冲信号1的波形。T代表参考脉冲信号1的重复周期。图2B表示VCO6的输出信号7。参考脉冲信号1的前沿a，VCO6的输出信号7的前沿b的每个重复周期均被提取，从而产生如图2C所示的反馈信号2，该信号具有脉冲边沿b的相位信息。相位比较器3把参考脉冲信号1与反馈信号2进行比较，並提供输出信号，该信号在图2C的左侧所示情况下处于高电平，而在图2C右侧所示情况下处于低电平。
为了稳定VCO6的振荡频率，这里需要在左侧所示的前沿b和右侧所示的前沿b之间保持一个间隔，即保持输出信号7的一个预定的周波数。这就是说，为了把VCO6的振荡频率稳定到Nf0(N是一个整数，f0是参考脉冲信号1的重复频率)，当左侧所示的前沿b编为零号时，右侧表示的前沿b必须成为第N个脉冲边沿，此外那些每一个都从低电平变到高电平並置于第零个前沿右侧的前沿依次从第一开始起算。
如下所述，上述条件将得到满足。用一个从晶体振荡器产生的稳频信号作为参考脉冲信号1。例如，可使用从广播电台发射的水平扫描频率脉冲或从电视摄象机得到的同一类脉冲。这些脉冲的频率变化一般稳定在参考值的正负百万分之10到20(±10～20PPm)。
此外，图1中的VCO6可使用如图3所示的采用晶体振荡器9的晶体振荡型VCO，参看图3，10，11，12和13分别表示倒相器，电阻，电容器和变容二极管。图3所示的VCO在这个技术领域：
中是众所周知的。当频率控制电压5变大时，变容二极管13的电容变低，而VCO的输出信号7变高。VCO的频率变化范围设计为Nf0的±60PPm。
结果，VCO6的振荡频率的最大偏差低于±100PPm。即，如果参考脉冲信号1的频率定为水平扫描频率fH，而VCO的频率置于910×fH，即在NTSC电视系统中大约为14.3兆赫时，则参考脉冲信号的每个周期中VCO的脉冲数是910±0.091。因此，上述条件得到满足。
图4是相位提取器8的一个实施例的方框图。图5A-5D是其主要部份的波形。
参考图4，标号15和16表示单稳态多谐振荡器(MMV)，18是D型触发器(DFF)。图5C所示的脉冲17由MMV16产生。脉冲17的脉冲宽度要比输出信号7的一个周期窄，並包括参考脉冲信号7的前沿的一个记时。
当脉冲17输到DFF18的输入端D，而输出信号7加到时钟端CK上时，DFF18产生脉冲2，该脉冲的相位在输出端Q上与参考脉冲信号7的前沿重合。
因为脉冲17的脉冲宽度选得比输出信号7的周期窄，所以在每一个参考脉冲信号的重复周期中仅有一个前沿被提取。在电源接通后的一个瞬间，可能检测不到信号7的前沿，或许检测到的是预定数的±1的前沿。然而对于前一种情况，如果使用数字式相位比较器作为相位比较器3，则有可能产生这样的控制电压5，使得在没有反馈信号2的情况下振荡频率较高。还有，如果选择(如电容器12的电容等)VCO6的参数，使得20VCO6的输出信号7具有预定的频率，而该频率几乎位于控制电压5的最大值和最小值之间的中心值上的话，则不可能在DFF18的输出端Q上保持没有脉冲的状态。
对于后一种情况，因为在参考脉冲信号1的每个重复周期中输出信号7的相位偏离都很小，所以可在静态下选择性地提取输出信号7的预定编号的前沿。
在图4所示的实施例中，需要使用MMV15和MMV16，它们所产生脉冲的相位在环境条件-如电源电压或环境温度改变等情况下是稳定的。
其次，按照图6和图7A-7E来解释另一个不需要使用这种高度稳定的MMV的实施例。参考图6，标号19，20和24表示DFF。参考脉冲信号1输给DFF19和20的输入端D，VCO6的输出信号加到DFF19的时钟端CK，而来自倒相器21的倒相脉冲提供给DFF20的时钟端CK。
在这种情况下，响应于参考脉冲信号1的前沿a和输出信号7的前沿b之间的相位关系，DFF19的Q输出23与DFF20的Q输出22之间的相位关系发生变化。图7C和7D分别示出了Q输出22和23。Q输出22供给DFF24的输入端D，而Q输出23供给DFF24的时钟端CK。结果，作为相位误差信号的DFF24的Q输出25在前沿b超过前沿a时变成低电平，如图7A和7B的左侧所示;而当前沿b滞后于前沿a时，DFF24的Q输出25变成高电平，如图7A和7B的右侧所示。图7E表示了Q输出25的波形。当Q输出25输给LPF4时，控制电压5在前一种情况下减少而在后一种情况下则增加。因此，响应于控制电压5，VCO6产生具有预定频率的输出信号7，因而有可能使输出信号7被锁相到参考脉冲信号1。
例如，如果VCO6输出信号7在控制电压5的最大值的70%电平处具有与参考脉冲信号1频率的预定关系，则Q输25的低电平周期和高电平周期之比为3∶7。因为输出信号7相对于参考脉冲信号1的相位偏差很小，所以前沿b几乎与前沿a重合。
正如从上述解释所看到的，根据图6所示的实施例，输出信号7的前沿b被选择提取，並与参考脉冲信号的每个重复周期中的参考脉冲信号1的前沿a进行相位比较，从而得到作为相位误差信号的Q输出25。
图8表示本发明的另一个实施例，它由装有倒相器26和27，与非门(NAND)28和与门(AND)29，P-通道MOS晶体管30和N-通道MOS晶体管31的电路来代替图6中的DFF24，以便产生相位误差信号25′。图7F和7G分别示出NAND门28的输出32及AND门29的输出33的波形。P-通道的MOS晶体管30在输出32的低电平上导通，以传送一个高电压34作为相位误差信号25′，並在输出32的高电平处关闭。与此相反，N-通道MOS晶体管31在输出33的高电平处导通，以传送一个低电压，例如，图8中的地电平，N-通道MOS晶体管31在输出33的低电平时关闭。因此，当相位误差信号传输给图1中的LPF4时，可得到和图6的实施例一样的控制电压5。
图9表示本发明的另一个实施例，其中以一般的T型触发器(TFF)35和36来替代图6的DFF19和20。参考TFF35和36，CK端的圆圈表示TFF35和36工作在输入信号的后沿，而在它的清除端(CLR)上的圆圈则表示TFF35和36停止在参考脉冲信号1的低电平上。图10A到10E表示图9所示电路主要部份的波形图。图10A的参考脉冲信号1输给CLR端。VCO6的输出信号7及其倒相信号则分别送给TFF36和35的CK端。当输出信号7的前沿b如图10B左侧所示超前于参考脉冲信号1的前沿a时，TFF35的Q输出37如图10C和10D的右侧所示超前于TFF36的Q输出38。与此相反，当如图10B右侧所示前沿b跟随前沿a时，TFF36的Q输出38如图10C和10D右侧所示将超前于TFF35的Q输出37。因此，结果是如图10E所示那样可以在DFF24的Q输出端产生一个与该实施例同样的相位误差信号。
顺便指出，在图9所示的实施例中，TFF35和36产生的脉冲是一些将VCO6的输出信号7用2除的脉冲。例如，当输出信号7的频率是14.3兆赫时，则被2除的脉冲的频率约为7.16兆赫。因此，在涉及NTSC电视信号的仪器中(它的频带是4兆赫左右)，即使来自TFF35和36的噪声迭加在电视信号上，该噪声也可用加在视频信号电路中的LPF等来消除。
还有，在这个技术领域：
中，很容易制做出这样的电路只将参考脉冲信号1的前沿a之后的Q输出37和38的第一批脉冲输给DFF24，而不传送Q输出37和38的其它脉冲。
此外，可以用具有适当延迟时间的脉冲延迟电路来代替倒相器21，因为需要使向图6和图8中的DFF20的CK端及图9中的TFF35提供的时钟脉冲具有与输出信号7不同的相位。
图11表明了本发明的另一类实施例，这里不用信号7，而用输出信号7进行除法运算后得到的脉冲45来作为相位提取器8的输入脉冲。在图11中，脉冲45是通过用3去除输出信号7得到的。图12A到12I是图11中所示电路的主要部份的波形。
有一种固体成象器件，其时钟脉冲频率为水平扫描频率fH的910/3倍，即约为4.8兆赫，例如日立公司生产的一种使用固体成象器件HE98，255的固体成象传感器，图11所示的实施例适用于这种器件。
输出信号7由用3除的除法器39作除法运算，产生三个相位脉冲411，412和413(如图12C，12D和12E所示)，它们的相位偏差是输出信号7的一个周期。此外，参考脉冲信号1也由用3除的除法器40进行除法运算，由此产生由图12F，12G和12H所示的三个相位脉冲421，422和423。在这个技术领域：
中，运用数字电路技术来制作用3除的除法器39和40是众所周知的事。AND门43和或(OR)门44根据三个相位脉冲411，412和413产生如图12I所示的脉冲45。脉冲45是依次选取的三个相位脉冲411，412和413中的一个。在这种结构中，可能在参考信号的每个重复周期中获得输出信号7的预定脉冲的前沿b。因此，当脉冲45被用来代替图4、6、8、9电路中的输出信号7时，有可能在参考脉冲信号1的每个重复周期中选取输出脉冲7的前沿b，以便将它与参考脉冲信号的前沿a进行比较。
在这个实施例中，因为用3除的除法器39和40，AND门43和OR门44都与用来产生频率为fH的910/3倍的时钟脉冲电路共用，所以可减小整个电路的规模。
正如前面所详细叙述的那样，根据本发明，当具有频率为f0的参考信号与通过PLL电路由VCO产生的频率为Nf0的输出信号锁相时，则不需使用把VCO的输出信号除以N(例如几百)的除法器，因此有可能减小整个电路的规模並防止可能由除法器产生的噪声的影响。
权利要求
1.一种振荡电路，它含有一个产生输出频率为Nf0(N是一个整数，f0是参考信号的重复频率)的电压控制振荡器(VCO)，其特征在于它由以下装置组成一个用来选取相位的装置，它在参考信号的每个重复周期中，在参考信号的预定相位附近提取电压控制振荡器(VCO)输出的预定振荡相位中的一个相位。用来把上述已提取的相位与上述参考信号的预定相位进行相位比较，产生一个相位误差信号的装置。用来由上述相位比较装置产生的上述相位误差信号，产生一个控制VCO的信号的装置。
2.根据权利要求
1所述的一种振荡电路，其特征在于上述相位提取装置包括两个串联的单稳态多谐振荡器(MMV)和一个D型触发器(DFF)，上述第一个MMV接受参考信号，而上述第二个MMV的输出输给上述DFF的输入端D，而VCO的输出则输给上述DFF的时钟端CK。
3.根据权利要求
1所述的振荡电路，其特征在于上述控制信号产生装置是一个低通滤波器(LPF)。
4.根据权利要求
1所述的振荡电路，其特征在于上述相位提取装置和上述相位比较装置包括三个DFF，其中第一个DFF在输入端D上接收参考信号及在时钟端CK上接收VCO输出;第二个DFF在输入端D上接收参考信号及在时钟端上接收脉冲信号，这个脉冲信号的相位与VCO的输出的相位不同;第三个DFF在输入端D上接收上述第二个DFF的Q输出及在时钟端CK上接收上述第一个DFF的Q输出，并产生上述的相位误差信号作为它的Q输出。
5.根据权利要求
4所述的振荡电路，其特征在于上述其相位与输出的相位不同的脉冲信号是通过将VCO的输出倒相产生的。
6.根据权利要求
1所述的振荡电路，其特征在于上述相位提取装置和上述相位比较装置包括二个T型触发器(TFF)和一个DFF，上述第一个TFF在清除端CLR接收一个参考信号的倒相信号及在时钟端CK上接收VCO的输出的倒相信号;上述第二个TFF在清除端CLR接收参考信号的倒相信号及在时钟端CK上接收VCO的输出，而上述的DFF在输入端D上接收上述第二个TFF的Q输出，而在时钟端CK上接收上述第一个TFF的Q输出，并产生作为其Q输出的上述相位误差信号。
7.一种振荡电路，它使用包括一个电压控制振荡器(VCO)的锁相环，该振荡器产生频率为Nf0的输出(N是一个整数，f0是供锁相环使用的参考信号的重复频率)，其特征在于它由下列装置组成一个用来在参考信号的每个重复周期中把参考信号的预定相位与VCO的输出的各预定振荡相位中被提取的一个相位进行比较的装置，以便产生一个相位误差信号。上述被提取的相位是从靠近参考信号的上述预定相位的VCO输出的预定振荡相位中选取的，一个用来根据上述相位误差信号为VCO产生控制信号的装置。
8.根据权利要求
7所述的振荡电路，其特征在于VCO输出的上述预定振荡相位是该输出的前沿。
9.根据权利要求
8所述的振荡电路，其特征在于参考信号的上述预定相位是该参考信号的前沿。
10.根据权利要求
7所述的振荡电路，其特征在于上述相位比较装置包括第一个和第二个D型触发器(DFF)，它们的输入端D接收参考信号，而它们的时钟端CK接收时钟脉冲，时钟脉冲的相位互不相同，并且是根据VCO的输出产生的。
11.根据权利要求
10所述的振荡电路，其特征在于上述相位比较装置还包括第三个DFF，它的输入端D接收上述第二个DFF的输出Q，而它的时钟端CK接收上述第一个DFF的输出Q。
12.根据权利要求
7所述的振荡电路，其特征在于上述相位比较装置包括第一和第二T型触发器(TFF)，它们的清除端CLR接收根据参考信号产生的清除脉冲，它们的时钟端CK接收相位互不相同的时钟脉冲，并且这些时钟脉冲是根据VCO的输出来产生的。
13.根据权利要求
12所述的振荡电路，其特征在于上述相位比较装置还包括一个D型触发器(DFF)，它的输入端D接收上述第二个TFF的输出Q，而它的时钟端CK接收上述第一个TFF的输出Q。
14.根据权利要求
7所述的振荡电路，其特征在于它还包括把VCO的输出用3来除的装置，该装置位于VCO和上述相位比较装置之间。
专利摘要
一使用锁相环的振荡电路包括一电压控制振荡器(VCO)，一相位比较器一低通滤波器(LPF)和一电路规模较小的相位提取器，参考脉冲信号的每个重复周期输给相位比较器的一输入端，其频率是VCO的振荡频率的1/N倍。相位提取器选取一位于参考脉冲信号前沿附近的VCO的输出脉冲的一前沿。被提取的VCO的输出脉冲的前沿输给相位比较器的另一输入端，并由相位比较器将其与参考脉冲信号的前沿进行相位比较。由相位比较器产生的相位误差信号通过LPF加到VCO上作为一控制信号来稳定振荡频率。
文档编号H04N5/335GK86101017SQ86101017
公开日1986年8月27日 申请日期1986年2月20日
发明者鲇沢 申请人:株式会社日立制作所导出引文BiBTeX, EndNote, RefMan