专利名称：时钟产生器以及通用串行总线模块的制作方法
技术领域：
本发明是有关于一种时钟产生器，特别是有关于一种通用串行总线模块的时钟产
生器。
背景技术：
通用串行总线(Universal Serial Bus, USB)为连接外部设备的一种串行总线标 准，其可支持热插拔(Hot plug)和即插即用(Plug and Play)等功能。
现今，USB 2. 0规格可提供低速、全速以及高速传输，其可分别支持最大1. 5Mbps、 12Mbps及480Mbps的数据量。然而，随着复杂功能的增加，电子产品需要更高速的USB传输 速率，以便能更快速地从外部设备存取数据并执行相关的操作程序。 因此，USB实施论坛(USB Implementers Forum)制订了 USB 3. 0的规格，其可同 时提供超高速(SuperSpeed)以及非超高速(即USB 2.0)的信息交换，其中超高速传输可 支持最大5G bps的数据量。
发明内容
本发明提供一种时钟产生器。上述时钟产生器包括一石英振荡器，具有一第一端 以及一第二端；一反相器，并联于上述石英振荡器，用以于上述石英振荡器的上述第一端以 及上述第二端分别产生一第一信号以及一第二信号；一第一电路，耦接于上述石英振荡器 的上述第一端，用以根据上述第一信号产生具有固定频率的一第一时钟信号；以及一第二 电路，耦接于上述石英振荡器的上述第二端，用以根据上述第二信号产生具有可变频率的 一第二时钟信号。 再者，本发明提供一种通用串行总线模块。上述通用串行总线模块包括一时钟产 生器，产生一时钟信号以及一扩频时钟信号；一通用串行总线3.0控制器，耦接于上述时钟 产生器，用以根据上述扩频时钟信号执行超高速的信息交换；以及一通用串行总线2. 0控 制器，耦接于上述时钟产生器，用以根据上述时钟信号执行非超高速的信息交换。
图l是显示根据本发明
以及通用串行总线模块；以及 图2是显示根据本发明 [ooog][主要元件标号说明] 100 主机板； 120 PCIe模块； 140 时钟产生器； 20 时钟产生器； 210 石英振荡器；
实施例所述的桥接芯片，其包括快捷外围元件互连模块 实施例所述的通用串行总线模块。
110 USB模±央；
130 桥接芯片；
150 扩频时钟产生器； 200 通用串行总线模块； 220 反相器；
230 锁相回路电路； 240 扩频时钟产生器； 250 通用串行总线3.0控制器； 260 通用串行总线2.0控制器 270 连接器； CLK1、 CLK2、 PECLK+、 PECLK- 时钟信号； D+/D-、 SSTX+/SSTX-、 SSRX+/SSRX- 差动对信号；以及 XTAL1 、 XTAL2 信号。
具体实施例方式
为让本发明的上述和其它目的、特征、和优点能更明显易懂，下文特举出较佳实施 例，并配合所附图式，作详细说明如下
实施例 对支持通用串行总线(USB)3. 0的主机(Host)或装置(Device)而言，由于可提供 最大5G bps的数据量，因此需要使用扩频技术(Spread Spectrum)将超高速(SuperSpeed) 信号的频率散开。通过分散特定频率的能量，超高速信号将会具有较低的能量分布或 是较低的频率范围，因此可降低USB 3.0的主机或装置的电磁干扰(Electromagnetic Interference, EMI)。 于同步数字系统中，时钟信号用以驱动此系统，该时钟信号通常是主要的EMI来 源之一。因其本身的周期特性，时钟信号无可避免地具有窄频谱。事实上，完美的时钟信号 会令其所有能量集中至单一频率及其谐波频率，因此会辐射具有无限频谱密度的能量。实 际的同步数字系统会辐射电磁能量于扩展在该时钟频率及其谐波频率上的多个窄频带，而 产生一谱频。该频谱的某些频率可能会超出电磁干扰的规范限制，例如美国联邦通讯委员 会(FCC)、日本JEITA及欧洲IEC所制定的规范限制。 扩频时钟产生器(SSCG)多用以设计同步数字系统，特别是包含有微处理器者，以 降低该等系统所产生的EMI的频谱密度。扩频时钟产生器是宽带(wide-band)频率调制 (FM)的一特例，能够有效降低时钟信号的基础谐波及高阶谐波，例如降低时钟信号的峰值 辐射能量，而有效降低EMI发射。因此，扩频时钟产生器对系统的电磁发射进行塑形，以符 合电磁兼容规范。 图1是显示根据本发明一实施例所述的桥接芯片130，其中桥接芯片130包括快捷 夕卜围元件互连(Peripheral Component Interconnect Express, PCIe)模块120以及USB 模块IIO。在图1中，桥接芯片130是设置于主机板100上，其中桥接芯片130可提供PCIe 规格对USB规格的数据转换。在主机板100中，时钟产生器140会提供时钟信号？￡0^+以 及时钟信号PECLK-至桥接芯片130中以供PCIe模块120使用，其中时钟产生器140所产 生的时钟信号PECLK+以及时钟信号PECLK-是作为PCIe模块120的参考时钟。 一般而言， 时钟信号PECLK+与时钟信号PECLK-的频率为IOOM赫兹。此外，在PCIe的规格中，扩频时 钟为非必须的(optional)。因此，当主机板100有内建扩频时钟产生器150时，时钟信号 PECLK+与时钟信号PECLK-则为扩频时钟信号，且PCIe模块120的参考时钟亦为扩频时钟 信号。反之，若主机板100无设置扩频时钟产生器150时，PCIe模块120的参考时钟则无 扩频成分在内。由于主机板100不一定会提供扩频时钟信号至桥接芯片130，因此桥接芯 片130内的通用串行总线模块110需具有扩频时钟产生器，以便提供具有扩频成分的参考时钟来接收以及传送超高速信号。 图2是显示根据本发明一实施例所述的通用串行总线模块200。通用串行总线模 块200包括时钟产生器20、通用串行总线3. 0控制器250、通用串行总线2. 0控制器260 以及连接器270，其中时钟产生器20包括石英振荡器(crystal oscillator) 210、反相器 220、锁相回路(Phase Locked Loop，PLL)电路230以及扩频时钟产生器(Spread Spectrum Clock Generator, SSCG)240。在时钟产生器20中，通过将反相器220并联于石英振荡器 210，则可使石英振荡器210起振并产生信号XTALl与信号XTAL2，其中信号XTAL2为信号 XTALl的反相信号。如图2所显示，锁相回路电路230耦接于石英振荡器210以及通用串行 总线2. 0控制器260之间，而扩频时钟产生器240耦接于石英振荡器210以及通用串行总 线3. 0控制器250之间，其中锁相回路电路230以及扩频时钟产生器240分别耦接于石英 振荡器210的两端点。锁相回路电路230会根据所接收的信号XTAL1而提供时钟信号CLK1 至通用串行总线2. 0控制器260。锁相回路电路230为一种利用回授控制机制来同步时钟 信号CLK1与信号XTAL1的电路。在此实施例中，时钟信号CLK1的频率大于信号XTAL1的 频率。此外，时钟信号CLK1的频率是根据实际上通用串行总线2. 0控制器260所需的操作 频率所决定。接着，通用串行总线2. 0控制器260会经由连接器270接收以及传送符合USB 2.0规格的差动对(differential pair)信号D+/D_。为了简化说明，连接器270上的接地 线以及电源线将不进一步描述。 再者，在图2中，扩频时钟产生器240会根据所接收的信号XTAL2而提供时钟信号 CLK2至通用串行总线3. 0控制器250，其中时钟信号CLK2为一扩频时钟信号。扩频时钟产 生器240会根据信号XTAL2于时钟信号CLK2中添加抖动(jitter)，使得时钟信号CLK2具 有可变频率，以便将造成电磁干扰的能量由特定频率打散，进而减轻其干扰程度。在此实施 例中，时钟信号CLK2的频率大于信号XTAL2的频率。此外，时钟信号CLK2的频率是根据实 际上通用串行总线3. 0控制器250所需的操作频率所决定。接着，通用串行总线3. 0控制 器250会经由连接器270接收以及传送符合超高速规格的差动对信号，其中超高速的差动 对信号又可分为传送差动对信号SSTX+/SSTX-以及接收差动对信号SSRX+/SSRX-。
在图2中，通用串行总线2. 0控制器260会根据具有固定频率的时钟信号CLK1执 行非超高速的信息(即差动对信号0+/0-)交换，而通用串行总线3.0控制器250会根据具 有可变频率的时钟信号CLK2执行超高速的信息(即差动对信号SSTX+/SSTX-与差动对信 号SSRX+/SSRX-)交换。因此，时钟信号CLK2的频率大于时钟信号CLK1的频率。
在图2中，通用串行总线模块200可设置于符合USB 3. 0规格的主机端或是装置 端。举例来说，当通用串行总线模块200是设置在如图1所描述的桥接芯片130时(即主 机端)，连接器270可以为通用串行总线3. 0的插座(rec印tacle)，例如符合标准规格-A、 标准规格-B.微规格-AB或微规格-B的插座。反之，当通用串行总线模块200是设置在装 置端时，例如随身碟(PenDrive)或是MP3播放器等，连接器270可以为通用串行总线3. 0 的插头(plug)，例如符合标准规格-A、标准规格-B、微规格-AB或微规格-B的插头。
根据图2所描述的实施例，通过使用石英振荡器210两端的信号XTAL1与信号 XTAL2，可分别通过锁相回路电路230以及扩频时钟产生器240产生具有固定频率的时钟信 号CLK1以及具有可变频率的时钟信号CLK2。 虽然本发明已以较佳实施例揭露如上，然其并非用以限定本发明，任何所属技术领域中具有通常知识者，在不脱离本发明的精神和范围内，当可作些许的更动与润饰，因此 本发明的保护范围当视所附的权利要求范围所界定者为准。
权利要求
一种时钟产生器，包括石英振荡器，具有第一端以及第二端；反相器，并联于上述石英振荡器，用以于上述石英振荡器的上述第一端以及上述第二端分别产生第一信号以及第二信号；第一电路，耦接于上述石英振荡器的上述第一端，用以根据上述第一信号产生具有固定频率的第一时钟信号；以及第二电路，耦接于上述石英振荡器的上述第二端，用以根据上述第二信号产生具有可变频率的第二时钟信号。
2. 根据权利要求1所述的时钟产生器，其中上述第一电路为锁相回路电路，以及上述 第二电路为扩频时钟产生器。
3. 根据权利要求1所述的时钟产生器，其中上述第二时钟信号为扩频时钟信号，以及 上述第二电路提供上述第二时钟信号至通用串行总线控制器，以供上述通用串行总线控制 器执行超高速的信息交换。
4 根据权利要求3所述的时钟产生器，其中上述通用串行总线控制器为符合通用串行 总线3.0规格的控制器。
5. 根据权利要求1所述的时钟产生器，其中上述第一电路提供上述第一时钟信号至通 用串行总线控制器，以供上述通用串行总线控制器执行非超高速的信息交换。
6. 根据权利要求5所述的时钟产生器，其中上述通用串行总线控制器为符合通用串行 总线2.0规格的控制器。
7. 根据权利要求1所述的时钟产生器，其中上述第二信号为上述第一信号的反相信号。
8. 根据权利要求7所述的时钟产生器，其中上述第一时钟信号的频率大于上述第一信 号的频率，以及上述第二时钟信号的频率大于上述第一时钟信号的频率。
9. 一种通用串行总线模块，包括 时钟产生器，产生时钟信号以及扩频时钟信号；通用串行总线3. 0控制器，耦接于上述时钟产生器，用以根据上述扩频时钟信号执行 超高速的信息交换；以及通用串行总线2. 0控制器，耦接于上述时钟产生器，用以根据上述时钟信号执行非超 高速的信息交换。
10. 根据权利要求9所述的通用串行总线模块，其中上述时钟产生器包括 石英振荡器，具有第一端以及第二端；反相器，并联于上述石英振荡器，用以于上述石英振荡器的上述第一端以及上述第二 端分别产生第一信号以及第二信号；第一 电路，耦接于上述石英振荡器的上述第一端，用以根据上述第一信号产生上述时 钟信号；以及第二电路，耦接于上述石英振荡器的上述第二端，用以根据上述第二信号产生上述扩 频时钟信号。
11. 根据权利要求io所述的通用串行总线模块，其中上述时钟信号具有固定频率而上述扩频时钟信号具有可变频率。
12. 根据权利要求IO所述的通用串行总线模块，其中上述第一电路为锁相回路电路， 以及上述第二电路为扩频时钟产生器。
13. 根据权利要求IO所述的通用串行总线模块，其中上述第二信号为上述第一信号的 反相信号。
14. 根据权利要求13所述的通用串行总线模块，其中上述第一时钟信号的频率大于上 述第一信号的频率，以及上述第二时钟信号的频率大于上述第一时钟信号的频率。
全文摘要
一种时钟产生器。一石英振荡器具有一第一端以及一第二端。一反相器并联于上述石英振荡器，用以于上述石英振荡器的上述第一端以及上述第二端分别产生一第一信号以及一第二信号。一第一电路耦接于上述石英振荡器的上述第一端，用以根据上述第一信号产生具有固定频率的一第一时钟信号。一第二电路耦接于上述石英振荡器的上述第二端，用以根据上述第二信号产生具有可变频率的一第二时钟信号。
文档编号G06F13/42GK101739061SQ20091025317
公开日2010年6月16日 申请日期2009年12月4日 优先权日2009年12月4日
发明者曾纹郁, 林小琪 申请人:威盛电子股份有限公司