存储器控制器的操作方法、以及存储器件及其操作方法与流程

本公开要求于2017年9月13日在韩国知识产权局提交的韩国专利申请no.10-2017-0117390的优先权，其全部内容通过引用并入本文中。

本文描述的发明构思的实施例涉及半导体存储器，并且更具体地，涉及存储器控制器的操作方法、包括存储器控制器的存储器件以及存储器件的操作方法。

背景技术：

半导体存储器件可以被分类为断电时丢失存储在其中的数据的易失性存储器件以及即使断电时也保留存储在其中的数据的非易失性存储器件，易失性存储器件例如是静态随机存取存储器(sram)、动态ram(dram)和同步dram(sdram)，非易失性存储器件例如是只读存储器(rom)、可编程rom(prom)、电可编程rom(eprom)、电可擦除可编程rom(eeprom)、闪存器件、相变ram(pram)、磁ram(mram)、电阻ram(rram)和铁电ram(fram)。

闪存器件被广泛用作计算系统的大容量存储器。闪存使用外部提供的外部电源电压来操作。在由于各种因素导致电源电压变得不稳定的情况下，可能无法确保存储在闪存中的数据的可靠性或要存储在闪存中的数据的可靠性。

技术实现要素：

本发明构思的实施例提供了能够提高可靠性的存储器控制器的操作方法、包括存储器控制器的存储器件以及存储器件的操作方法。

本发明构思的实施例提供了一种控制非易失性存储器件的存储器控制器的操作方法。该操作方法包括：存储器控制器从非易失性存储器件接收关于操作失败的信息；存储器控制器将与关于操作失败的信息相对应的非易失性存储器件的存储块确定为失败块；存储器控制器从非易失性存储器件接收锁出(lock-out)状态信息；存储器控制器基于锁出状态信息来确定是否输出了锁出信号；以及存储器控制器根据所述确定是否输出了锁出信号来将失败块确定为正常块或坏块。

本发明构思的实施例还提供了一种包括控制非易失性存储器件的存储器控制器的存储器件的操作方法。该操作方法包括：存储器控制器对非易失性存储器件的存储块执行编程操作、读取操作和擦除操作中的一个操作；当操作失败时，存储器控制器将存储块确定为失败块；当操作失败时，存储器控制器确定非易失性存储器件是否输出了锁出信号；以及根据所述确定是否输出了锁出信号来将失败块确定为正常块或坏块。

本发明构思的实施例还提供了一种存储器件，包括包含多个存储块在内的非易失性存储器件；以及存储器控制器，被配置为控制非易失性存储器件。存储器控制器还被配置为：基于来自非易失性存储器件的锁出状态信息来确定非易失性存储器件是否输出了锁出信号；将多个存储块中的与从非易失性存储器件接收的关于操作失败的信息相对应的存储块确定为失败块；以及根据是否输出了锁出信号来将失败块确定为正常块或坏块。

附图说明

通过参考以下附图的以下描述，上述和其他目的和特征将变得显而易见，其中，除非另有说明，否则相似的附图标记在各个附图中指代相似的部件，并且在附图中：

图1示出了根据本发明构思的实施例的存储器件的框图；

图2示出了图1的存储器控制器的框图；

图3示出了图1的非易失性存储器件的框图；

图4示出了图3的非易失性存储器件的编程操作的示例性失败的视图；

图5示出了图1的存储器控制器的操作的流程图；

图6示出了描述根据图5所示的流程图执行的操作的视图；

图7示出了图1的存储器控制器的操作方法的流程图；

图8示出了描述根据图7的流程图的操作方法的视图；

图9示出了图1的存储器件的操作方法的流程图；

图10示出了根据本发明构思的实施例的存储器件的框图；

图11示出了图10的外部电压检测器的框图；

图12示出了其中图10的存储器件包括多个非易失性存储器件的例证的框图；

图13示出了描述图12的存储器件的复位操作的视图；

图14示出了图10的存储器件的操作方法的流程图；

图15示出了非易失性存储器件的衬垫的模式如何改变的视图；

图16示出了图10的存储器件的操作方法的流程图；

图17示出了根据本发明构思的实施例的存储器件的框图；

图18示出了根据本发明构思的实施例的存储器件的框图；

图19示出了根据本发明构思的实施例的存储器件的框图；以及

图20示出了应用根据本发明构思的存储器件的固态驱动器系统的框图。

具体实施方式

现在将参考附图来详细描述本发明构思的示例实施例。

如在发明构思领域中常见的，可以根据执行所描述的一个或多个功能的块来描述和示出实施例。在本文中可以称为单元或模块等的这些块通过诸如逻辑门、集成电路、微处理器、微控制器、存储器电路、无源电子组件、有源电子组件、光学组件、硬连线电路等的模拟和/或数字电路物理地实现，并且可以可选地由固件和/或软件驱动。例如，电路可以实现在一个或多个半导体芯片中，或者在诸如印刷电路板等的衬底支撑件上。构成块的电路可以由专用硬件或处理器(例如，一个或多个编程的微处理器和相关联的电路)来实现，或者由用来执行该块的一些功能的专用硬件和用来执行该块的其他功能的处理器的组合来实现。在不脱离本发明构思的范围的情况下，实施例的每个块可以物理地分成两个或更多个交互和分立的块。类似地，在不脱离本发明构思的范围的情况下，实施例的块可以物理地组合成更复杂的块。

图1示出了根据本发明构思的实施例的存储器件100的框图。参考图1，存储器件100包括存储器控制器110和非易失性存储器件120。

存储器控制器110可以将数据存储在非易失性存储器件120中，可以读取存储在非易失性存储器件120中的数据，或者可以擦除存储在非易失性存储器件120中的数据。例如，存储器控制器110可以向非易失性存储器件120提供非易失性存储器件120操作所需的电源电压vcc。存储器控制器110可以将命令cmd和地址addr发送到非易失性存储器件120以将数据(data)存储在非易失性存储器件120中，读取存储在非易失性存储器件120中的数据或者擦除存储在非易失性存储器件120中的数据。

存储器控制器110可以将复位命令发送到非易失性存储器件120以复位非易失性存储器件120。复位命令可以被包括在命令cmd中，或者可以通过单独的信号线被提供给非易失性存储器件120。存储器控制器110可以从非易失性存储器件120接收状态信息r/b(例如，就绪/忙碌)，该状态信息指示正在非易失性存储器件120中执行的操作的状态。在非易失性存储器件120处于忙碌状态的情况下，存储器控制器110可以不发送命令cmd或控制信号ctrl。

非易失性存储器件120可以从存储器控制器110接收电源电压vcc、命令cmd和地址addr。响应于接收到的信号，非易失性存储器件120可以存储来自存储器控制器110的数据，可以将存储在其中的数据提供给存储器控制器110，或者可以擦除存储在其中的数据。非易失性存储器件120可以响应于从存储器控制器110接收的复位命令执行复位操作。

在下文中，将在由存储器控制器110提供电源电压vcc的假设下给出描述。然而，本发明构思的范围和精神不限于此。例如，在一些实施例中，可以从单独的电源设备(未示出)提供电源电压vcc。

非易失性存储器件120包括电压检测器121和锁出(lko)状态寄存器122。电压检测器121检测来自存储器控制器110的电源电压vcc是否低于参考电压。例如，从存储器控制器110提供的电源电压vcc可能由于各种因素低于参考电压，例如易出故障或故障的外部电源设备、存储器控制器110的易出故障或故障的电源电路、布线问题、非易失性存储器件120的故障的内部电路或从外部供应的电力突然中断。

在本发明构思的实施例中，电压检测器121可以是包括在非易失性存储器件120中的锁出电路。在电源电压vcc低于参考电压的情况下，电压检测器121可以输出锁出信号lko。非易失性存储器件120可以基于是否输出了锁出信号lko来执行恢复操作。例如，非易失性存储器件120可以基于是否输出了锁出信号lko来停止操作(例如，编程操作、读取操作或擦除操作)并且可以进入稳定操作待机状态。

在电源电压vcc降低到特定电压或更低电压的情况下，非易失性存储器件120可能无法正常操作。因此，存储在非易失性存储器件120中的数据或要存储在其中的数据的可靠性降低。在这种情况下，非易失性存储器件120可以基于是否输出了电压检测器121的锁出信号lko来执行恢复操作，从而确保所存储的数据或要存储的数据的可靠性。

当在非易失性存储器件120无法正常操作的情况下从存储器控制器110接收到复位命令时，非易失性存储器件120可以执行复位操作。在执行复位操作之后，非易失性存储器件120可以稳定地经历断电和通电，从而再次正常操作。

锁出状态寄存器122可以基于是否输出了锁出信号lko来存储锁出状态信息。在一个实施例中，当电源电压vcc降低到参考电压或更低电压时，锁出状态寄存器122可以基于电压检测器121输出的锁出信号lko来存储锁出状态信息。这可以使存储器控制器110能够根据存储在锁出状态寄存器122中的值来确定是否输出了锁出信号lko。

在一个实施例中，存储器控制器110可以从非易失性存储器件120接收状态信息nsi。状态信息nsi可以包括表示是否正常执行了编程操作的信息(例如，编程通过或失败)。例如，非易失性存储器件120可以响应于从存储器控制器110接收到的程序命令来对数据进行编程。非易失性存储器件120可以基于是否正常执行了编程操作来将状态信息nsi发送到存储器控制器110。

非易失性存储器件120的编程操作的失败可能由于各种因素而发生。例如，在要被编程的存储单元劣化的情况下或者在没有正常提供电源电压vcc的情况下，可能不能正常执行编程操作。在这种情况下，从非易失性存储器件120提供给存储器控制器110的状态信息nsi可以包括关于编程失败的信息。在下文中，在其中发生编程失败的存储块被称为“失败块”。也就是说，失败块可以表示包括存储单元的存储块，其中由于各种因素，没有对数据进行正常编程。

在状态信息nsi包括关于编程失败的信息的情况下，存储器控制器110可以基于是否输出了非易失性存储器件120的锁出信号lko来将失败块确定为坏块或正常块之一。例如，存储器控制器110可以将单独的请求命令发送到非易失性存储器件120以用于确定是否输出了锁出信号lko。存储器控制器110可以接收存储在锁出状态寄存器122中的锁出状态信息以确定是否输出了锁出信号lko。存储器控制器110可以基于是否输出了锁出信号lko来将失败块确定为坏块或正常块之一。

在提供给非易失性存储器件120的电源电压vcc异常的情况下，可以输出锁出信号lko。存储器控制器110可以确定是否输出了锁出信号lko，以确定电源电压vcc是否异常。在输出了锁出信号lko的情况下，存储器控制器110可以将失败块的原因确定为异常电源电压vcc，而不是存储单元的缺陷。因此，存储器控制器110可以重新使用失败块，从而提高非易失性存储器件120的可靠性。

上述实施例是基于编程操作进行描述的。然而，本发明构思的实施例不限于此。本发明构思的范围和精神可以应用于编程操作、读取操作或擦除操作。在下文中，为了简要描述本发明构思，将基于编程操作来描述实施例。

图2详细地示出了图1的存储器控制器110的框图。为了简要描述，图2中仅示出了存储器控制器110的一些部件。然而，本发明构思的范围和精神可以不限于此。例如，存储器控制器110还可以包括诸如纠错码(ecc)电路的其他组件。

参考图1和图2，存储器控制器110包括系统总线112、处理器113、随机存取存储器(ram)114、只读存储器(rom)115、主机接口116和闪存接口117。

系统总线112被配置为提供存储器控制器110的组件之间的通道。处理器113可以执行并控制存储器控制器110的整体操作。ram114可以用作存储器控制器110的缓冲存储器、高速缓冲存储器或工作存储器。ram114可以存储处理器113执行的代码和命令。ram114可以存储由处理器113处理的数据。ram114可以包括例如静态ram(sram)。

在一个实施例中，ram114可以包括闪存转换层(ftl)111。ftl111可以是执行存储器控制器110的软件操作的软件层并且可以由处理器113驱动。ftl111可以存储在ram114中，并且可以在主机(未示出)和非易失性存储器件120之间执行各种维护操作，使得非易失性存储器件120被有效使用。例如，ftl111可以执行逻辑地址和物理地址之间的转换操作。逻辑地址是指由主机的文件系统管理的信息，并且物理地址是指表示存储数据的非易失性存储器件120的物理位置的信息。ftl111可以通过映射表(未示出)管理地址转换操作。ftl111可以执行逻辑地址与物理地址之间的转换操作以分配将在其中执行编程操作的存储块。

在一个实施例中，ftl111可以从包括在非易失性存储器件120中的多个存储块中分配将执行编程操作的存储块。在编程操作失败的情况下，即，在ftl111从非易失性存储器件120接收到包括表示编程失败的信息的状态信息nsi的情况下，如果满足给定条件，则ftl111可以将失败块作为坏块进行管理。

例如，在发生失败块并且未输出锁出信号lko的情况下，ftl111可以将失败块作为坏块进行管理。ftl111可以通过使用表示多个存储块的状态的元数据(未示出)来将与失败块相对应的存储块作为坏块进行管理。ftl111可以将与失败块相对应的存储块标记为坏块，并且可以不将该失败块分配给用于对数据进行编程的存储块。因此，ftl111可以不将表示坏块的物理地址映射到逻辑地址。

备选地，在发生失败块并且输出了锁出信号lko的情况下，ftl111可以将失败块作为正常块进行管理。ftl111可以将与失败块相对应的存储块确定为正常块，并且可以在稍后执行编程操作时重新使用该存储块。因此，ftl111可以将表示正常块的物理地址映射到逻辑地址。

表示存储块的状态的元数据可以存储在ram114中，并且可以由ftl111管理元数据。元数据可以包括包含关于坏块的信息的坏块表。rom115可以存储存储器控制器110以固件的形式操作所需的各种信息。

存储器控制器110可以通过主机接口116与主机通信。存储器控制器110可以通过闪存接口117与非易失性存储器件120通信。在一个实施例中，存储器控制器110可以通过闪存接口117发送复位命令，并且可以从非易失性存储器件120接收包括表示是否正常执行编程操作的信息的状态信息nsi。存储器控制器110可以通过闪存接口117请求表示是否输出了锁出信号lko的锁出状态信息，并且可以从非易失性存储器件120接收锁出状态信息。

存储器控制器110可以通过ftl111确定是否重新使用失败块，从而提高非易失性存储器件120的可靠性。在重新使用失败块的情况下，可以确保存储器件100的存储空间，并且因此ftl111操作以确保存储空间的次数可以减小。因此，可以改善存储器件100的性能。

图3是示出了图1的非易失性存储器件120的框图。参考图1和图3，非易失性存储器件120包括电压检测器121、锁出状态寄存器122、存储单元阵列123、地址(addr)解码器124、电压产生器125、页缓冲器电路126、输入/输出(i/o)电路127以及控制逻辑电路128。

电压检测器121可以将电源电压vcc与参考电压vref进行比较以输出锁出信号lko。参考电压vref可以是在电压产生器125中产生的电压，以具有提前确定的电平。例如，在电源电压vcc低于参考电压vref的情况下，电压检测器121可以输出锁出信号lko。电源电压vcc低于参考电压vref意味着非易失性存储器件120无法正常操作。在这种情况下，电压检测器121可以输出锁出信号lko以允许非易失性存储器件120执行恢复操作。

在电源电压vcc不低于参考电压vref(换句话说，电源电压vcc高于或等于参考电压vref)的情况下，电压检测器121可以不输出锁出信号lko。原因在于电源电压vcc高于参考电压vref意味着非易失性存储器件120正常操作。在一个实施例中，参考电压vref可以被用作非易失性存储器件120的锁出电压。

锁出状态寄存器122可以存储锁出状态信息lkos。锁出状态信息lkos表示关于是否从电压检测器121输出锁出信号lko的信息。例如，在从电压检测器121输出锁出信号lko的情况下，锁出状态寄存器122可以存储高(例如“1”)值的锁出状态信息lkos。在未从电压检测器121输出锁出信号lko的情况下，锁出状态寄存器122可以存储低(例如，“0”)值的锁出状态信息lkos。可以根据存储在锁出状态寄存器122中的锁出状态信息lkos来确定电源电压vcc是否低于参考电压vref。

锁出状态寄存器122的上述值是示例性的，并且本发明构思的范围和精神不限于此。例如，在其他实施例中，低(例如，“0”)值的锁出状态信息lkos可以指示从电压检测器121输出了锁出信号lko，并且高(例如，“1”)值的锁出状态信息lkos可以指示未从电压检测器121输出锁出信号lko。如图3所示，锁出状态寄存器122可以从控制逻辑电路128接收锁出状态信息lkos。然而，本发明构思的范围和精神不限于此。例如，锁出状态寄存器122可以通过另一路径接收锁出状态信息lkos。

存储单元阵列123包括多个存储块(例如，blk1、blk2、blk3、blk4、......blkz)，每个存储块具有多个存储单元。存储单元可以与多个字线wl相连。每个存储单元可以是存储1比特数据的单层单元(slc)或存储两比特数据或更多比特的数据的多层单元(mlc)。

地址解码器124可以经由串选择线ssl、字线wl和地选择线gsl与存储单元阵列123相连。地址解码器124可以从存储器控制器110接收地址addr。地址解码器124可以从电压产生器125接收各种操作电压vop。地址解码器124可以对接收到的地址addr进行解码，并且可以基于经解码的地址将相应的操作电压vop提供给串选择线ssl、字线wl和地选择线gsl。

电压产生器125可以从存储器控制器110接收电源电压vcc。电压产生器125可以通过使用接收到的电源电压vcc来产生非易失性存储器件120操作所需的各种操作电压。在一个实施例中，操作电压vop可以包括各种电平的电压，例如编程电压、通过电压、验证电压、选择读取电压、非选择读取电压和擦除电压。电压产生器125可以产生参考电压vref并且可以将产生的参考电压vref提供给电压检测器121。在一个实施例中，在电压产生器125中产生的参考电压vref可以具有预设电平。备选地，虽然图2中未示出，但是可以在单独的参考电压产生器(未示出)中产生参考电压vref。

页缓冲器电路126可以通过位线bl与存储单元阵列123相连。页缓冲器电路126可以临时存储要在存储单元阵列123中编程或存储的数据或从存储单元阵列123读取的数据。

输入/输出电路127可以通过数据线dl与页缓冲器电路126相连，并且可以通过数据线dl与页缓冲器电路126交换数据。输入/输出电路127可以在控制逻辑电路128的控制下与存储单元阵列123交换数据。

在控制逻辑电路128的控制下，输入/输出电路127可以将状态信息nsi发送到存储器控制器110，该状态信息nsi包括表示是否正常执行编程操作的信息。输入/输出电路127可以在控制逻辑电路128的控制下将存储在锁出状态寄存器122中的锁出状态信息lkos发送到存储器控制器110。响应于存储器控制器110的请求，可以沿数据线将锁出状态信息lkos发送到存储器控制器110。备选地，可以在将锁出状态信息lkos包括在状态信息nsi中之后，将锁出状态信息lkos发送到存储器控制器110。输入/输出电路127可以将从存储单元阵列123读取的数据data发送到存储器控制器110，并且可以将从存储器控制器110接收的数据data编程到存储单元阵列123中。

控制逻辑电路128可以控制非易失性存储器件120的整体操作。例如，控制逻辑电路128可以响应于从存储控制器110接收的命令cmd和控制信号ctrl来控制地址解码器124、电压产生器125、页缓冲器电路126和输入/输出电路127。

在一个实施例中，控制逻辑电路128可以从存储器控制器110接收程序命令和地址addr，并且可以对与接收到的地址addr相对应的存储块执行编程操作。控制逻辑电路128可以通过输入/输出电路127将状态信息nsi发送到存储器控制器110，状态信息nsi包括表示编程操作通过或失败的信息。

在一个实施例中，控制逻辑电路128可以通过输入/输出电路127将存储在锁出状态寄存器122中的锁出状态信息lkos发送到存储器控制器110。此外，当从存储器控制器110接收到复位命令时，控制逻辑电路128可以执行复位操作。

图4示出了图3的非易失性存储器件120的编程操作的示例性失败的视图。在图4中，横轴表示时间，纵轴表示电压大小。参考图3和图4，当执行编程操作时，提供给非易失性存储器件120的电源电压vcc可能变得低于参考电压vref。例如，在特定时段ta中，电源电压vcc可能低于参考电压vref。在这种情况下，电压检测器121可以检测到电源电压vcc低于参考电压，以输出锁出信号lko。当输出了锁出信号lko时，锁出状态寄存器122可以存储锁出状态信息lkos。这样，存储在锁出状态寄存器122中的值可以从“0”改变为“1”

在输出了锁出信号lko的情况下，非易失性存储器件120可以停止正在执行的编程操作，并且可以将非易失性存储器件120的操作状态从忙碌状态改变为就绪状态。由于电源电压vcc低于参考电压vref，因此在非易失性存储器件120中执行的编程操作可能失败。这样，非易失性存储器件120可以将包括表示编程失败的信息的状态信息nsi发送到存储器控制器110。

图5示出了图1的存储器控制器110的操作方法的流程图。参考图1、图2和图5，在操作s111中，存储器控制器110从非易失性存储器件120接收状态信息nsi。状态信息nsi可以包括关于编程操作通过或失败的信息。

在操作s112中，存储器控制器110确定是否出现失败块。例如，在状态信息nsi包括关于编程失败的信息的情况下，存储器控制器110确定出现失败块。备选地，在状态信息nsi包括关于编程通过的信息的情况下，存储器控制器110确定未出现失败块。

如果在操作s112中确定出现了失败块(是)，则在操作s113中，存储器控制器110将对锁出状态信息lkos的请求发送到非易失性存储器件120，并从非易失性存储器件120接收锁出状态信息lkos。如果在操作s112中确定未出现失败块(否)，则操作方法结束。

在操作s114中，存储器控制器110基于锁出状态信息lkos来确定是否输出了锁出信号lko。例如，在锁出状态信息lkos与高值相对应的情况下，存储器控制器110确定输出了锁出信号lko。在锁出状态信息lkos与低值相对应的情况下，存储器控制器110确定未输出锁出信号lko。

如果在操作s114中确定输出了锁出信号lko(是)，则在操作s115中，存储器控制器110将失败块确定为正常块。如果失败块被确定为正常块，则存储器控制器110可以在稍后执行编程操作时重新使用该失败块(即，被确定为正常块的失败块)。正常块可以是在其中确定不存在缺陷的存储块。在非易失性存储器件120包括的存储块中的未被确定为坏块的存储块可以是正常块。

在操作s116中，存储器控制器110使在其中执行编程操作的存储块(即，被确定为正常块的失败块)的数据无效。例如，存储在失败块中的数据可能不同于正常数据(即，在编程操作未失败的情况下存储的数据)。这样，存储器控制器110可以使数据无效，从而防止错误的数据被使用。

在一个实施例中，存储器控制器110可以在映射表(未示出)中记录无效标记，使得编程的数据无效。备选地，存储器控制器110可以不更新映射表(未示出)中关于编程操作的执行的信息，使得数据无效。

在操作s117中，存储器控制器110执行复位操作。存储器控制器110可以在执行复位操作时复位非易失性存储器件120。存储器控制器110可以将复位命令(即，复位信号)发送到非易失性存储器件120以复位非易失性存储器件120。当执行存储器控制器110和非易失性存储器件120的复位操作时，可以解决电源电压vcc中的故障。在一个实施例中，可以省略操作s117以防止频繁的复位操作。如图所示，在操作s117之后，操作方法结束。

如果在操作s114中确定未输出锁出信号lko(否)，则在操作s118中，存储器控制器110将失败块确定为坏块。在操作s119中，存储器控制器110将失败块标记为坏块。存储器控制器110可以将表示失败块与坏块相对应的信息记录在用于管理坏块的元数据中。存储器控制器110可以在稍后执行编程操作时不使用被标记为坏块的存储块。在操作s119之后，操作方法结束。

状态信息nsi可以包括表示是否输出了锁出信号lko的锁出状态信息lkos、以及编程操作的通过或失败信息。在状态信息nsi包括锁出状态信息lkos的情况下，存储器控制器110将不需要随后向非易失性存储器件120请求锁出状态信息lkos。因此，当在操作s111中接收到的状态信息nsi包括锁出状态信息lkos的情况下，可以省略操作s113。

如上所述，根据本发明构思的实施例，即使编程操作失败，如果输出了锁出信号lko，存储器控制器110也可能不将失败块确定为坏块。也就是说，在由于电源电压vcc或外部电源电压evc中出现噪声而导致电源电压低于参考电压vref的情况下，存储器控制器110不将编程操作的失败确定为由存储块的缺陷所引起。也就是说，相应的存储块不被视为有缺陷。因此，存储器件100可以防止实际无缺陷的存储器块被确定为坏块，并且可以重新使用没有缺陷的失败块。这可以提高非易失性存储器件120的存储块的可靠性。

图6示出了描述根据图5所示的流程图执行的操作的视图。将参照图6描述存储器控制器110管理失败块的示例性操作。为了便于描述，假设编程操作在非易失性存储器件120的多个存储块中的第二存储块blk2和第四存储块blk4中失败。

参考图6，在编程操作在第二存储块blk2中失败并且未输出锁出信号lko(由lko(x)指示)的情况下，存储器控制器110将第二存储块blk2确定为坏块。由于未输出锁出信号lko，所以编程操作的失败不是因为电源电压vcc的故障，因此存储器控制器110将第二存储块blk2确定为坏块。

存储器控制器110可以用“坏”值标记与第二存储块blk2相对应的坏块表bbt的值，并且可以将第二存储块blk2作为坏块进行管理。坏块表bbt可以被包括在存储器控制器110的元数据中。基于元数据中包括的坏块表bbt，存储器控制器110可以在执行编程操作时从存储块的分配中排除第二存储块blk2。

在编程操作在第四存储块blk4中失败并且输出了锁出信号lko(由lko(o)指示)的情况下，存储器控制器110将第四存储块blk4确定为正常块。由于输出了锁出信号lko，所以编程操作的失败不是因为存储块的缺陷而是因为电源电压vcc的故障，因此存储器控制器110将第四存储块blk4确定为正常块。

存储器控制器110可以用“正常”值来维持与第四存储块blk4相对应的坏块表bbt的值，并且可以在执行编程操作时分配第四存储块blk4。

本发明构思的存储器控制器110管理失败块的方法不限于图6的流程图，并且通过使用如图6所示的元数据标记块信息的任何方法都可以被包括在本发明构思的范围和精神内。

图7示出了图1的存储器控制器110的操作方法的流程图。参考图1和图7，存储器控制器110执行操作s121至操作s124。操作s121至操作s124类似于图5的操作s111至操作s114，因此省略操作s121至操作s124的详细描述。

当在操作s124中输出了锁出信号lko(是)的情况下，在操作s125中，存储器控制器110请求非易失性存储器件120发送最大循环状态信息，然后从非易失性存储器件120接收最大循环状态信息。最大循环状态信息是指表示非易失性存储器件120的编程操作的操作循环是否达到最大循环次计数的信息。

例如，在操作循环与最大循环状态相对应(即，操作循环达到最大循环计数)的情况下，最大循环状态信息可以是“1”。在操作循环与最大循环状态不相对应(即，操作循环未达到最大循环计数)的情况下，最大循环状态信息可以是“0”。

在操作s126中，存储器控制器110确定与失败块相关联的操作循环计数是否达到最大循环计数。在一个实施例中，在以增量步进程序脉冲(ispp)方式执行编程操作时，可以重复执行操作循环(例如，编程循环)。可以提前确定在编程操作期间要执行的操作循环的数量。在编程操作失败的情况下，即使操作循环达到最大循环，包括在失败块中的存储单元也可能处于劣化状态。

如果在操作s126中发生编程失败的操作循环被确定为不是最大循环(否)，则在操作s127中，存储器控制器110将失败块确定为正常块。如果失败块被确定为正常块，则存储器控制器110可以在稍后执行编程操作时重新使用该失败块。

在操作s128中，存储器控制器110使在被确定为正常块的相应失败块中经历编程操作的数据无效。在操作s129中，存储器控制器110执行复位操作。操作s128和操作s129类似于图5的操作s116和操作s117，因此省略操作s128和s129的详细描述。

在由存储器控制器110确定在操作s124中未输出锁出信号lko(否)或者在操作s126中在失败块中执行的操作循环是最大循环(是)的情况下，存储器控制器110执行操作s12a和操作s12b。操作s12a和操作s12b类似于图5的操作s118和操作s119，因此省略操作s12a和s12b的详细描述。

状态信息nsi可以包括最大循环状态信息。在这种情况下，存储器控制器110将不需要向非易失性存储器件120请求最大循环状态信息。即，可以省略操作s125。存储器控制器110可以根据在操作s121中接收到的状态信息nsi来确定与失败块相关联的操作循环是否是最大循环。

如上所述，在编程操作失败的情况下，存储器控制器110不立即将失败块确定为坏块。即使编程操作失败，如果输出了锁出信号lko并且操作循环不是最大循环，存储器控制器110也不将失败块确定为坏块。在操作循环是最大循环的情况下，即使输出了锁出信号lko，存储器控制器110也将失败块确定为坏块。也就是说，如果不管电源电压vcc是否发生失败，存储单元恶化的可能性都很高，则存储器控制器110可以确定编程操作的失败是由于存储块的缺陷引起的。因此，存储器件100可以防止将实际有缺陷的存储块确定为正常块。这可以提高非易失性存储器件120的存储块的可靠性。

图8示出了描述根据图7的流程图的操作方法的视图。将参考图8描述存储器控制器110管理失败块的示例性操作。为了便于描述，假设编程操作在非易失性存储器件120的多个存储块中的第一存储块blk1至第三存储块blk3中失败。

参考图8，在关于第一存储块blk1未输出锁出信号lko(由lko(x)指示)的情况下，存储器控制器110将第一存储块blk1确定为坏块。存储器控制器110可以在坏块表bbt中用“坏”值标记与第一存储块blk1相对应的值，并可以将第一存储块blk1作为坏块进行管理。

在关于第二存储块blk2输出了锁出信号lko(由lko(o)指示)并且操作循环是最大循环(由maxloop(o)指示)的情况下，存储器控制器110将第二存储块blk2确定为坏块。即使输出了锁出信号lko，第二存储块blk2也被确定为坏块，这是因为操作循环是最大循环。存储器控制器110可以在坏块表bbt中用“坏”值标记与第二存储块blk2相对应的值，并可以将第二存储块blk2作为坏块进行管理。

在关于第三存储块blk3输出了锁出信号lko(由lko(o)指示)并且操作循环不是最大循环(由maxloop(x)指示)的情况下，存储器控制器110将第三存储块blk3确定为正常块。存储器控制器110可以在坏块表bbt中用“正常”值维持与第三存储块blk3相对应的值，并可以将第三存储块blk3作为正常块进行管理。

图9示出了图1的存储器件100的操作方法的流程图。参考图1和图9，在操作s131中，存储器件100对数据执行编程操作。在一个实施例中，存储器件100可以响应于从外部接收到的编程信号来执行编程操作。存储器件100执行操作s132至操作s139。操作s132至操作s139分别类似于图7的操作s122、s124、s126、s127、s128、s129、s12a和s12b。图7的操作s122至操作s12b被描述为在存储器控制器110中执行。然而，由于存储器控制器110被包括在存储器件100中，所以存储器件100可以被表征为执行操作s122至操作s12b。因此，省略对图9的操作s132至操作s139的详细描述。

图10示出了根据本发明构思的实施例的存储器件200的框图。参考图10，存储器件200包括存储器控制器210、非易失性存储器件220和外部电压检测器230。图10中的存储器控制器210和非易失性存储器件220类似于参考图1描述的存储器控制器110和非易失性存储器件120，因此将省略类似特征和操作的详细描述，并且以下描述可以集中在图10的实施例与图1的实施例的不同之处。除了包括存储器控制器210和非易失性存储器件220之外，存储器件200还包括外部电压检测器230。外部电压检测器230检测从外部提供的外部电源电压evc是否低于外部参考电压vref_e。在一个实施例中，在外部电源电压evc低于外部参考电压vref_e的情况下，外部电压检测器230输出第一复位信号rst1和第二复位信号rst2。第一复位信号rst1被发送到存储器控制器210，并且第二复位信号rst2被发送到非易失性存储器件220。外部电压检测器230可以被包括在内部电源组件(例如，电源管理集成电路(pmic))中。备选地，外部电压检测器230可以独立于内部电源组件而存在。

存储器控制器210响应于第一复位信号rst1执行复位操作，并且非易失性存储器件220响应于第二复位信号rst2执行复位操作。在一个实施例中，可以在相对于第一复位信号rst1的输出时间点的给定时间之后，将第二复位信号rst2从外部电压检测器230发送到非易失性存储器件220。这样，存储器控制器210可以执行复位操作，并且非易失性存储器件220可以在经过一段时间之后执行复位操作。备选地，可以同时输出第一复位信号rst1和第二复位信号rst2。

非易失性存储器件220响应于第二复位信号rst2执行复位操作，并且复位操作可以包括恢复操作。在一个实施例中，非易失性存储器件220可以停止操作并且可以进入稳定操作待机状态。在执行复位操作之后，非易失性存储器件120可以稳定地经历断电和通电操作，从而再次正常操作。

图11示出了图10的外部电压检测器230的框图。参考图10和图11，外部电压检测器230可以包括比较器231和延迟电路232。比较器231将外部电源电压evc的大小与外部参考电压vref_e的大小进行比较。在外部电源电压evc低于外部参考电压vref_e的情况下，比较器231输出第一复位信号rst1。延迟电路232将第一复位信号rst1延迟预设时间，以输出第二复位信号rst2。备选地，延迟电路232可以立即输出第二复位信号rst2而不延迟第一复位信号rst1。第一复位信号rst1被发送到存储器控制器210，并且第二复位信号rst2被发送到非易失性存储器件220。

图12示出了图10的存储器件200包括多个非易失性存储器件的例证的框图。参考图12，存储器件200包括存储器控制器210、非易失性存储器件220和外部电压检测器230。非易失性存储器件220包括多个非易失性存储器件。在一个实施例中，非易失性存储器件220可以包括第一非易失性存储器件220-1和第二非易失性存储器件220-2。例如，第一非易失性存储器件220-1和第二非易失性存储器件220-2中的每一个可以被实现为一个封装或一个芯片，或者可以用一个封装或一个芯片来实现。存储器控制器210和外部电压检测器230与图10的存储器控制器210和外部电压检测器230基本相同，因此省略其详细描述。

第一非易失性存储器件220-1和第二非易失性存储器件220-2中的每一个响应于来自外部电压检测器230的第二复位信号rst2执行复位操作。因此，第一非易失性存储器件220-1和第二非易失性存储器件220-2同时执行复位操作。

第一非易失性存储器件220-1包括第一内部电压检测器221-1，并且第二非易失性存储器件220-2包括第二内部电压检测器221-2。由于第一非易失性存储器件220-1和第二非易失性存储器件220-2执行相同的操作，因此将基于第一非易失性存储器件220-1来描述第一非易失性存储器件220-1和第二非易失性存储器件220-2的操作。

在从存储器控制器210提供的电源电压vcc低于第一内部参考电压vref_i1的情况下，第一内部电压检测器221-1输出锁出信号lko。在一个实施例中，在外部电源电压evc异常的情况下，从外部电压检测器230输出第一复位信号rst1和第二复位信号rst2。此外，在电源电压vcc是由于异常的外部电源电压evc而异常的情况下，第一内部电压检测器221-1输出锁出信号lko。

第一内部电压检测器221-1可以独立于外部电压检测器230的操作而操作。例如，即使正常提供外部电源电压evc，并且因此外部电压检测器230未输出第一复位信号rst1和第二复位信号rst2，如果电源电压vcc低于第一内部参考电压vref_i1，第一内部电压检测器221-1也可以输出锁出信号lko。

根据外部电源电压evc的大小与电源电压vcc的大小相同的假设，外部参考电压vref_e可以高于(即，大于)第一内部参考电压vref_i1。这样，外部电压检测器230可以在第一内部电压检测器221-1检测到电源电压vcc异常之前检测外部电源电压evc是否异常，并且非易失性存储器件220可以在锁出信号lko被输出之前接收到第二复位信号rst2。非易失性存储器件220可以响应于接收到第二复位信号rst2而执行恢复操作。在这种情况下，即使输出了锁出信号lko，非易失性存储器件220也可以不考虑锁出信号lko的输出而单独地执行恢复操作。因此，在第二复位信号rst2和锁出信号lko都被输出的情况下，非易失性存储器件220可以执行仅与第二复位信号rst2相对应的恢复操作而不重复执行。

第一内部电压检测器221-1基于第一内部参考电压vref_i1输出锁出信号lko，并且第二内部电压检测器221-2基于第二内部参考电压vref_i2输出锁出信号lko。即使第一内部参考电压vref_i1和第二内部参考电压vref_i2被设置为具有相同大小，由于构成相应电路的元件的各种物理因素，第一内部参考电压vref_i1和第二内部参考电压vrefi2之间也可能出现差异。在第一内部参考电压vref_i1的大小不同于第二内部参考电压vref_i2的大小的情况下，关于相同的电源电压vcc，可以在不同的时间从第一内部电压检测器221-1和第二内部电压检测器221-2输出锁出信号lko。在一个实施例中，来自第一内部电压检测器221-1和第二内部电压检测器221-2的锁出信号lko的输出时间可以彼此不同。在锁出信号lko的输出时间彼此不同并且未执行与第二复位信号rst2相对应的恢复操作的情况下，第一非易失性存储器件220-1和第二非易失性存储器件220-2可以在不同的时间执行恢复操作。

此外，由于第一内部参考电压vref_i1的大小和第二内部参考电压vref_i2的大小之间的差异，因此可以从第一内部电压检测器221-1和第二内部电压检测器221-2中的任一个输出锁出信号lko。这样，第一非易失性存储器件220-1和第二非易失性存储器件220-2中的任一个可以执行恢复操作。在多个非易失性存储器件220-1和220-2不同时执行恢复操作的情况下，非易失性存储器件220的可靠性可能降低。

外部电压检测器230可以同时向第一非易失性存储器件220-1和第二非易失性存储器件220-2发送第二复位信号rst2。这样，第一非易失性存储器件220-1和第二非易失性存储器件220-2可以同时执行复位操作，并因此可以提高非易失性存储器件220的可靠性。

图13示出了描述图12的存储器件200的复位操作的视图。在图13中，横轴表示时间“t”，纵轴表示电压大小“v”。为了便于描述，假设外部电源电压evc和电源电压vcc具有相同的大小。如图13所示，外部电源电压evc和电源电压vcc可以维持在给定的大小，可以减小到特定电压vd的大小，并且可以再次增加。

假设不存在外部电压检测器230，在电源电压vcc减小到第一内部参考电压vref_i1和第二内部参考电压vref_i2之间的特定电压vd的情况下，第一内部电压检测器221-1不输出锁出信号lko。在这种情况下，仅第二内部电压检测器221-2在第二时间点t2输出锁出信号lko。这样，仅第一非易失性存储器件220-1和第二非易失性存储器件220-2中的第二非易失性存储器件220-2执行与锁出信号lko相关联的恢复操作。由于当电源电压vcc异常时第一非易失性存储器件220-1不执行恢复操作，因此存储器件200的可靠性可能降低。

然而，外部电压检测器230将外部电源电压evc的大小与外部参考电压vref_e的大小进行比较。第一内部电压检测器221-1将电源电压vcc的大小与第一内部参考电压vref_i1的大小进行比较。第二内部电压检测器221-2将电源电压vcc的大小与第二内部参考电压vref_i2的大小进行比较。外部参考电压vref_e的大小大于第一内部参考电压vref_i1和第二内部参考电压vref_12的大小，并且第一内部参考电压vref_i1的大小可以小于第二内部参考电压vref_i2的大小。因此，外部电压检测器230可以在第一内部电压检测器220-1和第二内部电压检测器220-2检测到异常电源电压vcc之前检测到异常外部电源电压evc。外部电压检测器230在第一时间点t1检测到异常外部电源电压evc，并将第二复位信号rst2发送到第一非易失性存储器件220-1和第二非易失性存储器件220-2。因此，第一非易失性存储器件220-1和第二非易失性存储器件220-2可以响应于第二复位信号rst2同时执行复位操作。因此，可以通过使用外部电压检测器230提高存储器件200的可靠性。

根据本发明构思的实施例的存储器件200不限于图12和图13所示的例证。例如，其中多个非易失性存储器件220中的每一个包括内部电压检测器221-1/221-2的存储器件200可以被包括在本发明构思的范围和精神内。

图14示出了图10的存储器件200的操作方法的流程图。参考图10和图14，在操作s211中，外部电压检测器230检测外部电源电压evc。在操作s212中，外部电压检测器230将外部电源电压evc与外部参考电压vref_e进行比较。如果在操作s212中外部电源电压evc低于外部参考电压vref_e(是)，则在操作s213中，外部电压检测器230输出第一复位信号rst1和第二复位信号rst2，以发送到存储器控制器210和非易失性存储器件220。当在操作s212中外部电源电压evc不低于外部参考电压vref_e(否)的情况下，外部电压检测器230不输出第一复位信号rst1和第二复位信号rst2，并且操作方法随后结束。

图15示出了非易失性存储器件220的衬垫的模式如何改变的视图。参考图15，用于接收第二复位信号rst2的衬垫的模式可能改变。参考图10和图15，非易失性存储器件220包括多个衬垫p1至pn，以从存储器控制器210(未示出)接收各种信号。衬垫p1、p2至pn可以分别通过连接到衬垫p1至pn的信号线l1、l2、...、ln接收发送到非易失性存储器件220的信号。不同种类的信号可以通过不同的衬垫p1至pn发送到非易失性存储器件220。非易失性存储器件220可以执行与通过衬垫p1至pn接收的信号相对应的操作。

非易失性存储器件220可以不包括用于接收第二复位信号rst2的衬垫。这样，存储器控制器210可以改变衬垫p1至pn中的任一个的模式，以允许非易失性存储器件220接收第二复位信号rst2。在一个实施例中，存储器控制器210可以通过模式改变电路mcc来改变多个衬垫p1至pn中的一个衬垫的模式。经模式改变的衬垫可以是支持多模式的衬垫。

例如，存储器控制器210可以将第一衬垫p1的模式改变为用于从外部电压检测器230(未示出)接收第二复位信号rst2的模式。第二复位信号rst2可以通过与第一衬垫p1相连的第一信号线l1输入到第一衬垫p1。在通过第一衬垫p1接收到第二复位信号rst2的情况下，非易失性存储器件220可以执行复位操作。

因此，根据本发明构思的实施例的存储器件200可以响应于第二复位信号rst2执行复位操作，而不改变非易失性存储器件220的硬件。根据本发明构思的实施例改变衬垫的模式的方式不限于图15的示例。例如，本发明构思可以通过使用能够改变衬垫p1至pn的模式的电路、配置、器件和/或软件来改变衬垫的模式。

图16示出了图10的存储器件200的操作方法的流程图。参考图10和图16，在步骤s221中，存储器控制器210改变包括在非易失性存储器件220中的一个衬垫的模式。存储器控制器210可以将非易失性存储器件220中包括的多个衬垫中的支持多模式的衬垫的模式改变为用于接收第二复位信号rst2的模式。在一个实施例中，存储器控制器210可以在存储器件200通电之后立即将衬垫的模式改变为用于接收第二复位信号rst2的模式。因此，存储器控制器210可以允许非易失性存储器件220从外部电压检测器230接收第二复位信号rst2。

外部电压检测器230可以执行操作s222至操作s224。操作s222至操作s224类似于图14的操作s211至操作s213，因此省略操作s222、s223和s224的详细描述。

图17示出了根据本发明构思的实施例的存储器件300的框图。参考图17，存储器件300包括存储器控制器310、非易失性存储器件320和外部电压检测器330。存储器控制器310、非易失性存储器件320和外部电压检测器330类似于图10的存储器控制器210、非易失性存储器件220和外部电压检测器230。因此，将省略存储器控制器310、非易失性存储器件320和外部电压检测器330的类似特征和操作的详细描述，并且以下描述可以集中在图17的实施例与图10的实施例的不同之处。

在外部电源电压evc低于外部参考电压vref_e的情况下，外部电压检测器330将第一复位信号rst1输出到存储器控制器310。存储器控制器310接收第一复位信号rst1并执行复位操作，并将第二复位信号rst2发送到非易失性存储器件320。非易失性存储器件320接收第二复位信号rst2并执行复位操作。这样，在存储器控制器310执行复位操作之后，非易失性存储器件320执行复位操作。

在如图17的实施例中一样由存储器控制器310直接将第二复位信号rst2发送到非易失性存储器件320，而不是如图10的实施例中一样由外部电压检测器330将第二复位信号rst2发送到非易失性存储器件320的情况下，存储器控制器310在接收到第一复位信号rst1之后，将第二复位信号rst2发送到非易失性存储器件320。在这种情况下，由于在基于存储器控制器310接收到第一复位信号rst1的时间的给定时间之后，非易失性存储器件320接收到第二复位信号rst2，因此外部电压检测器330可以不包括单独的延迟电路。

如上所述，根据关于图10和图17描述的本发明构思的实施例的存储器件200和300分别在其中包括外部电压检测器230和330。然而，根据本发明构思的实施例的存储器件不限于此。例如，外部电压检测器可以设置在存储器件的外部。此外，根据本发明构思的实施例的外部电压检测器可以作为存储器控制器被设置在内部。也即是说，根据本发明构思的实施例的外部电压检测器的位置不限于上述例证，并且外部电压检测器可以设置在能够检测外部电源电压evc的任何位置处。

图18示出了根据本发明构思的实施例的存储器件400的框图。参考图18，存储器件400包括存储器控制器410、非易失性存储器件420和外部电压检测器430。非易失性存储器件420包括内部电压检测器421和锁出状态寄存器422。图18所示的存储器件400可以包括图1的存储器件100和图10的存储器件200的全部功能，并因此在此将不重复其详细描述。存储器控制器410和非易失性存储器件420类似于图1的存储器控制器110和非易失性存储器件120。因此，将省略存储器控制器410和非易失性存储器件420的类似特征和操作的详细描述，并且以下描述可以集中在图18的实施例与图1的实施例的不同之处。

存储器件400使用外部电压检测器430提前检测异常的外部电源电压evc。也就是说，外部电压检测器430将外部电源电压evc与外部参考电压vref_e进行比较，并且当外部电源电压evc低于外部参考电压vref_e时，外部电压检测器430将第一复位信号rst1发送到存储器控制器410并将第二复位信号rst2发送到非易失性存储器件420。在存储器件400中，存储器控制器410和非易失性存储器件420可以响应于来自外部电压检测器430的第一复位信号rst1和第二复位信号rst2同时执行复位操作。

此外，存储器件400基于是否从内部电压检测器421输出了锁出信号lko，来将失败块确定为坏块或正常块之一。在从存储器控制器410提供的电源电压vcc低于内部参考电压vref_i的情况下，内部电压检测器421输出锁出信号lko。存储器控制器410接收存储在锁出状态寄存器422中的锁出状态信息以确定是否输出了锁出信号lko。在编程操作失败(即，出现失败块)并且非易失性存储器件420输出锁出信号lko的情况下，存储器控制器410将失败块确定为正常块。在未输出锁出信号lko的情况下，存储器控制器410将失败块确定为坏块。在一个实施例中，在操作循环是最大循环的情况下，即使输出了锁出信号lko，存储器控制器410也将失败块确定为坏块。在输出了锁出信号lko并且操作循环不是最大循环的情况下，存储器控制器410将失败块确定为正常块。

存储器件400可以提前检测异常的外部电源电压evc，以允许存储器控制器410和非易失性存储器件420提前执行复位操作，由此防止不能及时执行恢复操作的事件。此外，存储器件400可以根据给定的条件来将失败块确定为正常块，从而防止将实际无缺陷的存储块确定为坏块。因此，可以提高存储器件400的可靠性。

图19示出了根据本发明构思的实施例的存储器件500的框图。参考图19，存储器件500包括存储器控制器510、非易失性存储器件520和外部电压检测器530。非易失性存储器件520包括第一非易失性存储器件520-1和第二非易失性存储器件520-2。例如，第一非易失性存储器件520-1和第二非易失性存储器件520-2中的每一个可以用一个封装或一个芯片来实现，或者可以被实现为一个封装或一个芯片。第一非易失性存储器件520-1包括内部电压检测器521。图19所示的存储器件500包括图1、图10、图17和图18的存储器件100、200、300和400的所有功能，并因此将省略类似特征和操作的详细描述，并且以下描述可以集中在图19的实施例与上面提到的先前实施例的不同之处。

作为参考设备的第一非易失性存储器件520-1控制第二非易失性存储器件520-2的复位操作。在一个实施例中，第一非易失性存储器件520-1将新的第二复位信号rst2’输出到第二非易失性存储器件520-2。第二非易失性存储器件520-2响应于新的第二复位信号rst2’执行复位操作。

例如，第一非易失性存储器件520-1接收第二复位信号rst2以执行复位操作。第一非易失性存储器件520-1可以从外部电压检测器530或存储器控制器510接收第二复位信号rst2。当接收到第二复位信号rst2时，第一非易失性存储器件520-1将新的第二复位信号rst2’输出到第二非易失性存储器件520-2。第二非易失性存储器件520-2接收新的第二复位信号rst2’并响应于此执行复位操作。

备选地，在内部电压检测器521输出锁出信号lko的情况下，第一非易失性存储器件520-1将新的第二复位信号rst2’输出到第二非易失性存储器件520-2。第二非易失性存储器件520-2接收新的第二复位信号rst2’并响应于此执行复位操作。

在图19中仅示出了第一非易失性存储器件520-1和第二非易失性存储器件520-2。然而，本发明构思不限于此。例如，非易失性存储器件520还可以包括其他非易失性存储器件。因此，第一非易失性存储器件520-1可以将新的第二复位信号rst2’同时输出到多个非易失性存储器件。这样，包括在非易失性存储器件520中的多个非易失性存储器件可以同时执行复位操作。

图20示出了应用根据本发明构思的存储器件的固态驱动器(ssd)系统1000的框图。参考图20，ssd系统1000包括主机1100和ssd1200。

ssd1200通过信号连接器1201与主机1100交换信号sig，并通过电源连接器1202向ssd1200供应电力pwr。ssd1200包括ssd控制器1210、多个闪存(nvm)1221、1222至122n、外部电压检测器1230和缓冲存储器1240。

ssd控制器1210可以响应于来自主机1100的信号sig来控制闪存1221至122n。闪存1221至122n可以在ssd控制器1210的控制下操作。在从主机1100输入的电力pwr的大小小于参考电压的大小的情况下，外部电压检测器1230可以将第一复位信号rst1和第二复位信号rst2分别输出到ssd控制器1210和多个闪存1221至122n。ssd控制器1210和多个闪存1221至122n可以响应于第一复位信号rst1和第二复位信号rst2执行复位操作。

缓冲存储器1240用作ssd1200的缓冲存储器。例如，缓冲存储器1240可以临时存储从主机1100或从闪存1221至122n接收的数据，或者可以临时存储闪存1221至122n的元数据(例如，映射表)。备选地，缓冲存储器1240可以临时存储ssd控制器1210操作所需的各种信息。

在一个实施例中，闪存1221至122n中的每一个可以包括参考图1至图18描述的电压检测器。电压检测器可以基于输入到闪存1221至122n的电源电压的大小来输出锁出信号。在与闪存1221至122n相关联的编程操作失败的情况下，ssd控制器1210可以基于是否输出了锁出信号来将失败块确定为坏块或正常块。此外，在与闪存1221至122n相关联的编程操作失败的情况下，ssd控制器1210可以基于是否输出了锁出信号以及操作循环是否是最大循环来将失败块确定为坏块或正常块。

根据本发明构思，可以防止无缺陷的存储块被确定为坏块，从而通过重新使用存储块来确保存储空间。此外，在检测到不稳定的外部电源电压的情况下，存储器件的操作状态可以改变为待机状态，并且因此存储器件可以稳定地断电。因此，可以提供能够提高可靠性的存储器控制器的操作方法、包括存储器控制器的存储器件以及存储器件的操作方法。

尽管已经参照各种实施例描述了本发明构思，但是对于本领域技术人员来说显而易见的是，在不脱离本发明构思的精神和范围的情况下，可以进行各种改变和修改。因此，应当理解的是，上述实施例不是限制性的而是说明性的。