专利名称：一种利用n型离子注入形成双深度隔离沟道的方法
技术领域：
本发明涉及CMOS半导体器件工艺领域，尤其涉及一种利用N型离子注入形成双深度隔离沟道的方法。
背景技术：
自上世纪60年代末期美国贝尔实验室开发出固态成像器件和一维CXD(电荷耦合元件，Charge-Coupled Device)模型器件以来，CCD在图像传感、信号处理、数字存储等方面发展迅速。随着CCD器件的广泛应用，其缺点逐渐显露出来，为此人们又开发了另外几种固态图像传感器，其中最有发展潜力的是采用标准CMOS制造工艺制造的CMOS图像传感器。到了 90年代初期，超大规模集成技术的飞速发展，而CMOS图像传感器可在单芯片内集成A/D 转换、信号处理、自动增益控制、精密放大和存储等功能，大大减小了系统复杂性，降低了成本，此外，它还具有低功耗、单电源、低工作电压、成品率高等优点，因而显示出强劲的发展势头。成像质量是衡量CMOS图像传感器性能的最重要指标之一，要得到好的成像质量， 提高器件的信噪比是一个有效的方法。为了提高信噪比，在版图设计上可以加大器件中用来收集光信号的有源区面积所占全部芯片面积的比例(即像素填充率)。图1显示了图像传感器像素单元区的有源区形貌，其中，感光器件有源区100和控制器件有源区200被隔离沟道300隔离开。随着填充率的提高，有源区100、200尺寸的加大会造成隔离沟道300的尺寸减小，当隔离沟道300减小到一定程度时就会因为深宽比过大而产生沟道填充不充分的问题，比如空洞或者缝隙等；图2显示了一个典型的因为隔离沟道深宽比过大而产生的空洞 000。为了解决这个问题，目前比较成熟的解决方法是用两次有源区形成工艺来分别对图像传感器的像素单元区和之外的逻辑电路区进行图形化，通过刻蚀时间的不同来分别控制两个不同区域的隔离沟道的深度，使像素单元区的深度适当降低来减小这一区域沟道的深宽比，从而解决沟道填充不充分的难题。但是这种工艺需要重复进行有源区的图形化，且需要额外的光罩，工艺流程复杂，制造成本高昂。KirtR. Williams 和 Richard S. Muller 两人合著并于 1996 年公开发表于 IEEE 微机电系统杂志上的一篇文章《微机械加工的刻蚀率》(Etch Rates for Micromachining Processing)中指出，单晶硅中因为掺杂了 N型离子所以费米能级上升，从而使得干法刻蚀的过程中硅原子更容易与刻蚀气体中的卤族原子如氯，溴等结合而形成易挥发的物质，因此其刻蚀速率比没有掺杂的像素单元区快。
发明内容
针对上述存在的问题，本发明的目的是提供一种利用N型离子注入形成双深度隔离沟道的方法，在保证后续沟道填充工艺不受影响的条件下，隔离沟道深度降低后的像素单元区允许像素单元之间的间隔缩小，从而增加像素单元中感光有源区的面积，进而增加了感光有源区所占芯片总面积的比例，即像素填充率，从而提高传感器的成像质量，简化了工艺流程步骤，降低了制造成本。本发明的目的是通过下述技术方案实现的
一种利用N型离子注入形成双深度隔离沟道的方法，其中，包括下列步骤 提供包含像素单元区和外围电路区的半导体衬底，所述半导体衬底上形成有衬底氧化物层；
在所述衬底氧化物层上沉积硬掩膜层；
在所述硬掩膜层上形成光刻胶层，进行光刻，从而在所述光刻胶层的与所述像素单元区在垂直方向上的延伸区域交叠的区域中形成第一开口，在所述光刻胶层的与所述外围电路区在垂直方向上的延伸区域交叠的区域中形成第二开口；
利用所述第一开口和所述第二开口对所述硬掩膜层进行刻蚀并且刻蚀停止于所述衬底氧化物层，以在所述硬掩膜层的与所述像素单元区在垂直方向上的延伸区域交叠的区域中形成第三开口，同时在所述硬掩膜层的与所述外围电路区在垂直方向上的延伸区域交叠的区域中形成第四开口，之后去除剩余的光刻胶；
通过光阻将所述像素单元区上方的和所述外围电路区上方的所述硬掩膜层覆盖，并同时覆盖所述第三开口和所述第四开口，进行光刻，移除所述外围电路区上方的所述硬掩膜层上的光阻，并将所述第四开口予以暴露；
通过所述第四开口将N型离子注入至所述外围电路区； 去除光阻，通过热处理方式活化注入N型离子；
通过所述第三开口和所述第四开口分别对所述像素单元区和所述外围电路区进行刻蚀，所述第三开口和所述第四开口下方的所述衬底氧化物层同时也被刻蚀掉，以在所述像素单元区和所述外围电路区内分别形成隔离沟道，位于所述像素单元区内的隔离沟道的深度浅于位于所述外围电路区内的隔离沟道的深度。上述利用N型离子注入形成双深度隔离沟道的方法，其中，所述衬底氧化物层为
氧化硅层。上述利用N型离子注入形成双深度隔离沟道的方法，其中，所述硬掩膜层为氮化硅层。上述利用N型离子注入形成双深度隔离沟道的方法，其中，所述活化注入离子采用的热处理方式为快速加热退火方式。上述利用N型离子注入形成双深度隔离沟道的方法，其中，所述快速加热退火方式为在1000摄氏度的温度条件下退火20秒钟。上述利用N型离子注入形成双深度隔离沟道的方法，其中，所述的通过光阻将所述像素单元区上方的和所述外围电路区上方的所述硬掩膜层覆盖后进行光刻是采用负性光刻胶。上述利用N型离子注入形成双深度隔离沟道的方法，其中，对所述像素单元区和所述外围电路区进行刻蚀以形成隔离沟道是采用以卤族气体为刻蚀剂的干法刻蚀。上述利用N型离子注入形成双深度隔离沟道的方法，其中，所述干法刻蚀的刻蚀条件为气压20毫托，射频电源频率为13. 56兆赫兹，上电极射频电源功率为400瓦，下电极射频电源功率为80瓦，氯气气体流量为每分钟100标准立方厘米，氧气气体流量为每分钟10标准立方厘米，氦气气体流量为每分钟100标准立方厘米，刻蚀时间为50秒。上述利用N型离子注入形成双深度隔离沟道的方法，其中，位于所述外围电路区内的隔离沟道深度为3500埃，而进行了离子注入的位于所述像素单元区内的隔离沟道深度为3200埃。上述利用N型离子注入形成双深度隔离沟道的方法，其中，所述N型离子为磷原子。上述利用N型离子注入形成双深度隔离沟道的方法，其中，用1000电子伏特的能量将IX IO15个每平方厘米浓度的磷原子注入所述外围电路区中。与已有技术相比，本发明的有益效果在于双深度隔离沟道的形成允许电路设计者在不增加芯片面积的条件下增加感光有源区的面积，即增加像素的填充率，从而提高图像传感器芯片的图像质量。本发明方法不仅适用于图像传感器产品工艺，还适合其他需要双深度隔离沟道的工艺流程。
参考所附附图，以更加充分地描述本发明的实施例，然而，所附附图仅用于说明和阐述，并不构成对本发明范围的限制。图1是现成技术中CMOS图像传感器像素单元区的俯视示意图2是现成技术形成的CMOS图像传感器中浅隔离沟道中产生缺陷的示意图； 图3是本发明利用N型离子注入形成双深度隔离沟道的方法的最佳实施例的流程示意框图4广图4f是本发明利用N型离子注入形成双深度隔离沟道的方法的最佳实施例的工艺流程中每个步骤的结构示意图。
具体实施例方式下面结合原理图和具体操作实施例对本发明作进一步说明。本发明公开了一种利用N型离子注入形成双深度隔离沟道的方法，如图3所示，最佳实施方式具体包括下列步骤
51.提供包含像素单元区和外围电路区的半导体衬底，半导体衬底上形成有衬底氧化物层；
52.在衬底氧化物层上沉积硬掩膜层；
53.在硬掩膜层上形成光刻胶层，进行光刻，从而在光刻胶层的与像素单元区在垂直方向上的延伸区域交叠的区域中形成第一开口，在光刻胶层的与外围电路区在垂直方向上的延伸区域交叠的区域中形成第二开口；
54.利用第一开口和第二开口对硬掩膜层进行刻蚀并且刻蚀停止于衬底氧化物层，以在硬掩膜层的与像素单元区在垂直方向上的延伸区域交叠的区域中形成第三开口，同时在硬掩膜层的与外围电路区在垂直方向上的延伸区域交叠的区域中形成第四开口，之后去除剩余的光刻胶；
55.通过光阻将像素单元区上方的和外围电路区上方的硬掩膜层覆盖，并同时覆盖第三开口和第四开口，进行光刻，移除外围电路区上方的硬掩膜层上的光阻，并将第四开口予以暴露；
56.通过第四开口将N型离子注入至外围电路区；
57.去除光阻，通过热处理方式活化注入N型离子；
58.通过第三开口和第四开口分别对像素单元区和外围电路区进行刻蚀，第三开口和第四开口下方的衬底氧化物层同时也被刻蚀掉，以在像素单元区和外围电路区内分别形成隔离沟道，位于像素单元区内的隔离沟道的深度浅于位于外围电路区内的隔离沟道的深度。具体地，执行步骤Si、S2和S3，包含像素单元区01和外围电路区02的半导体衬底O上形成有衬底氧化物层1，在衬底氧化物层1上沉积硬掩膜层2 ；在硬掩膜层2上形成光刻胶层3，进行光刻，从而在光刻胶层3的与像素单元区01在垂直方向上的延伸区域交叠的区域中形成第一开口 11，在光刻胶层3的与外围电路区02在垂直方向上的延伸区域交叠的区域中形成第二开口 22，从而形成有源区的光阻图形，执行完后的效果图如图4a所示。进一步地，衬底氧化物层1为氧化硅层，硬掩膜层2为氮化硅层，衬底氧化物层1 的作用为在后续刻蚀过程中保护其下面的半导体衬底0不被损坏。执行步骤S4，利用第一开口 11和第二开口 22对硬掩膜层2进行刻蚀并且刻蚀停止于衬底氧化物层1，以在硬掩膜层2的与像素单元区01在垂直方向上的延伸区域交叠的区域中形成第三开口 33，同时在硬掩膜层2的与外围电路区02在垂直方向上的延伸区域交叠的区域中形成第四开口 44，之后去除剩余的光刻胶3，执行完毕后的效果图如图4b所示。执行步骤S5，接下来的工艺是进行像素单元区01覆盖的光刻。通过光阻4将像素单元区01上方的和外围电路区02上方的硬掩膜层2覆盖，并同时覆盖第三开口 33和第四开口 44，进行光刻，移除外围电路区02上方的硬掩膜层2上的光阻，并将第四开口 44予以暴露，光刻后形成的效果图如图4c所示。进一步地，通过光阻4将像素单元区01上方的和外围电路区02上方的硬掩膜层2 覆盖后进行光刻是采用负性光刻胶，利用光阻4结合负性光阻的光刻工艺刚好可以把外围电路区02暴露出来而覆盖像素单元区01。执行步骤S6，光刻工艺后通过第四开口 44将N型离子注入至外围电路区02，因为硬掩模层2的存在而且像素单元区域01被光阻4覆盖，所以N型离子5只能注入到外围电路区域02中硬掩模层2被打开的区域，也就是第四开口 44内，也就是需要形成隔离沟道的地方，离子注入过程中的结构示意图如图4d所示。进一步地，N型离子5为磷原子。更进一步地，具体是采用1000电子伏特的能量将1 X IO15个每平方厘米浓度的磷原子5注入外围电路区02中。执行步骤S7，在完成上面的N型离子注入以后，晶圆表面的光阻4被去除，然后通过热处理来活化注入的N型离子5，这时候注入的离子5将沿深度方向以一定的浓度分布在将要被刻蚀掉的单晶硅衬底0中，完成后的效果图如图4e所示。进一步地，活化注入离子采用的热处理方式为快速加热退火方式。更进一步地，快速加热退火方式为在1000摄氏度的温度条件下退火20秒钟。执行步骤S8，通过第三开口 33和第四开口 44分别对像素单元区01和外围电路区02进行刻蚀，第三开口 33和第四开口 44下方的衬底氧化物层1同时也被刻蚀掉，由于外围电路区02的单晶硅中掺杂了 N型离子，所以费米能级上升从而使得干法蚀刻的过程中硅原子更容易与蚀刻气体中的卤族原子如氯，溴等结合而形成易挥发的物质，因此其蚀刻速率比没有掺杂的像素单元区01快，这样便在在外围电路区02和像素单元区01内分别形成一条浅隔离沟道021、011，位于像素单元区01内的隔离沟道的深度浅于位于外围电路区 02内的隔离沟道的深度，完成后的效果图如图4f所示。进一步地，对像素单元区01和外围电路区02进行刻蚀以形成隔离沟道011、021 是采用以卤族气体为刻蚀剂的干法刻蚀，干法刻蚀的刻蚀条件为气压20毫托，射频电源频率为13. 56兆赫兹，上电极射频电源功率为400瓦，下电极射频电源功率为80瓦，氯气气体流量为每分钟100标准立方厘米，氧气气体流量为每分钟10标准立方厘米，氦气气体流量为每分钟100标准立方厘米，刻蚀时间为50秒。按上述干法刻蚀进行后的外围电路区02 内的隔离沟道021深度为3500埃，而进行了离子注入的像素单元区01的隔离沟道011深度为3200埃。在应用了本发明的上述方法后，像素单元区隔离沟道的深度与原来比较降低了 8%，因此像素单元中有源区之间的间隔尺寸也可以等比例地缩小8%而不会发生沟道填充不充分的问题，避免了沟道空洞等缺陷的出现，像素单元间隔的缩小就实现了感光有源区面积增加的目的。以上对本发明的具体实施例进行了详细描述，但本发明并不限制于以上描述的具体实施例，其只是作为范例。对于本领域技术人员而言，任何对该利用N型离子注入形成双深度隔离沟道的方法进行的等同修改和替代也都在本发明的范畴之中。因此，在不脱离本发明的精神和范围下所作出的均等变换和修改，都应涵盖在本发明的范围内。
权利要求
1.一种利用N型离子注入形成双深度隔离沟道的方法，其特征在于，包括下列步骤提供包含像素单元区和外围电路区的半导体衬底，所述半导体衬底上形成有衬底氧化物层；在所述衬底氧化物层上沉积硬掩膜层；在所述硬掩膜层上形成光刻胶层，进行光刻，从而在所述光刻胶层的与所述像素单元区在垂直方向上的延伸区域交叠的区域中形成第一开口，在所述光刻胶层的与所述外围电路区在垂直方向上的延伸区域交叠的区域中形成第二开口；利用所述第一开口和所述第二开口对所述硬掩膜层进行刻蚀并且刻蚀停止于所述衬底氧化物层，以在所述硬掩膜层的与所述像素单元区在垂直方向上的延伸区域交叠的区域中形成第三开口，同时在所述硬掩膜层的与所述外围电路区在垂直方向上的延伸区域交叠的区域中形成第四开口，之后去除剩余的光刻胶；通过光阻将所述像素单元区上方的和所述外围电路区上方的所述硬掩膜层覆盖，并同时覆盖所述第三开口和所述第四开口，进行光刻，移除所述外围电路区上方的所述硬掩膜层上的光阻，并将所述第四开口予以暴露；通过所述第四开口将N型离子注入至所述外围电路区；去除光阻，通过热处理方式活化注入N型离子；通过所述第三开口和所述第四开口分别对所述像素单元区和所述外围电路区进行刻蚀，所述第三开口和所述第四开口下方的所述衬底氧化物层同时也被刻蚀掉，以在所述像素单元区和所述外围电路区内分别形成隔离沟道，位于所述像素单元区内的隔离沟道的深度浅于位于所述外围电路区内的隔离沟道的深度。
2.根据权利要求1所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 所述衬底氧化物层为氧化硅层。
3.根据权利要求1所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 所述硬掩膜层为氮化硅层。
4.根据权利要求1所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 所述活化注入离子采用的热处理方式为快速加热退火方式。
5.根据权利要求4所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 所述快速加热退火方式为在1000摄氏度的温度条件下退火20秒钟。
6.根据权利要求1所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 所述的通过光阻将所述像素单元区上方的和所述外围电路区上方的所述硬掩膜层覆盖后进行光刻是采用负性光刻胶。
7.根据权利要求1所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 对所述像素单元区和所述外围电路区进行刻蚀以形成隔离沟道是采用以卤族气体为刻蚀剂的干法刻蚀。
8.根据权利要求7所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 所述干法刻蚀的刻蚀条件为气压20毫托，射频电源频率为13. 56兆赫兹，上电极射频电源功率为400瓦，下电极射频电源功率为80瓦，氯气气体流量为每分钟100标准立方厘米，氧气气体流量为每分钟10标准立方厘米，氦气气体流量为每分钟100标准立方厘米，刻蚀时间为50秒。
9.根据权利要求8所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于， 位于所述外围电路区内的隔离沟道深度为3500埃，而进行了离子注入的位于所述像素单元区内的隔离沟道深度为3200埃。
10.根据权利要求1所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于，所述N型离子为磷原子。
11.根据权利要求10所述的利用N型离子注入形成双深度隔离沟道的方法，其特征在于，用1000电子伏特的能量将IX IO15个每平方厘米浓度的磷原子注入所述外围电路区中。
全文摘要
本发明公开了一种利用N型离子注入形成双深度隔离沟道的方法，具体是通过对图像传感器外围电路区进行N型离子注入，利用在浅沟道隔离蚀刻过程中掺杂后的衬底硅比不掺杂衬底硅蚀刻速率高的特点，适当缩短蚀刻时间来降低像素单元区的沟道深度而保证外围电路区隔离沟道的深度不受影响，从而在芯片的不同区域形成不同深度的隔离浅沟道。在保证后续沟道填充工艺不受影响的条件下，隔离沟道深度降低后的像素单元区允许像素单元之间的间隔缩小，从而增加像素单元中感光有源区的面积，进而增加了感光有源区所占芯片总面积的比例(即像素填充率)，从而提高传感器的成像质量。
文档编号H01L27/146GK102437081SQ20111022215
公开日2012年5月2日 申请日期2011年8月4日 优先权日2011年8月4日
发明者罗飞 申请人:上海华力微电子有限公司