一种占空比校正电路的制作方法
【专利摘要】本发明属于信号处理【技术领域】，公开了一种占空比校正电路，包括：输入缓冲器，用于接收差分信号clka和clkb，通过设置共模电平实现差分信号的占空比的初步调整，并输出信号out1a和out1b；占空比调节电路，接收信号out1a和out1b，调整占空比，并输出信号out2ah和out2b；第一级CML转CMOS电路，接收信号out2a和out2b，放大和整形，输出信号out3a和out3b；占空比比较电路，接收信号out3a和out3b，将占空比误差放大积分，输出差分控制电压Vc+和Vc-，反馈控制占空比调节电路；占空比调节电路包括：差分放大器电路，对信号out1a和out1b进行放大，调节占空比，输出给下一级电路；补偿调节单元，接收反馈差分控制电压，输出电流补偿，调节输出信号out2a和out2b的共模电平，实现占空比反馈调节。本发明提升了校正精度和效率。
【专利说明】—种占空比校正电路
【技术领域】
[0001]本发明涉及信号处理【技术领域】，特别涉及一种占空比校正电路。
【背景技术】
[0002]随着无线通信、卫星定位、遥控遥测技术以及精密制导等现代高技术的广泛应用和不断发展，差分信号作为重要的信号载体，参与众多的信号传输系统。而差分信号的性能除了传统的时钟抖动外，时钟的占空比越来越成为影响高速集成电路性能的关键因素。
[0003]目前，常用的占空比调节电路大体可以分为数字和模拟两个种类型。相比较而言，数字占空比调节电路由于需要延迟线间的匹配，要有复杂的控制逻辑单元，其校正精度存在离散性，从而不能获得精确的校正结果，而且数字调节电路大都使用驱动器和计数器等电路结构来实现，这使得整个系统的工作频率不能太高，从而限制了其在高频系统中的应用；传统的模拟校正电路采用开关电容，由于电荷泄露等原因降低了校正精度，而且也限制了工作频率。
【发明内容】
[0004]本发明所要解决的技术问题是提供一种能够提升占空比校正精度的电路。
[0005]为解决上述技术问题，本发明提供了一种占空比校正电路，用于实时调整差分信号的占空比；包括:
[0006]输入缓冲器，用于接收差分信号clka和clkb，通过设置共模电平实现差分信号的占空比的初步调整，并输出信号outla和outlb ；
[0007]占空比调节电路，用于接收信号outla和outlb，调整器占空比，并输出信号out2ah 和 out2b ；
[0008]第一级CML转CMOS电路，用于接收信号out2a和out2b，并对其摆幅进行放大和整形，输出信号out3a和out3b ；
[0009]占空比比较电路，接收信号out3a和out3b，提取占空比信息，将占空比误差放大积分，输出差分控制电压V。+和Ne-,反馈控制所述占空比调节电路；
[0010]其中，占空比调节电路包括:
[0011]差分放大器电路，对信号OUtla和OUtlb进行放大，调节占空比，输出给下一级电路；
[0012]补偿调节单元，接收所述占空比比较电路输出的反馈差分控制电压，输出电流补偿，拉高或者降低占空比调节电路的输出信号out2a和out2b的共模电平，实现占空比反馈调节。
[0013]进一步地，所述差分放大器电路包括:M0S管MpMOS管M2、M0S管M5以及两个负载电阻R ;
[0014]所述MOS管M1的栅极接信号outla，MOS管M2的栅极接信号outlb ；
[0015]所述MOS管M1和MOS管M2的源极与M5的漏极相连；
[0016]所述MOS管M1和MOS管M2的漏极分别通过一个负载电阻R连接Vdd ；
[0017]所述MOS管M1和MOS管M2的漏极分别连接所述补偿调节单元的输出端，构成所述差分放大器电路的输出端，所述MOS管M1的漏极输出信号out2b，所述皿^管仏的漏极out2a ；
[0018]所述MOS管M5的栅极连接偏置电压Vbias，源极接地。
[0019]进一步地，所述补偿调节单元包括:M0S管M3、MOS管M4以及MOS管M6 ；
[0020]所述MOS管M3和MOS管M4的源极与所述MOS管M6的漏极相连；
[0021 ] 所述MOS管M3的栅极连接所述占空比比较电路的差分控制电压V。+，所述MOS管M3的漏极连接所述MOS管M1的漏极，输出信号out2b ；
[0022]所述MOS管M4的栅极连接所述占空比比较电路的差分控制电压Vc-，所述MOS管M4的漏极连接所述MOS管M2的漏极，输出信号out2a ；
[0023]所述MOS管M6的栅极连接偏置电压Vbias，源极接地。
[0024]进一步地，所述占空比比较电路包括:
[0025]第一输入放大器电路，用于将第一级CML转CMOS电路的输出CMOS信号转换成CML电平信号；
[0026]第二差分放大电器电路，用于共模提取占空比的误差并放大积分，输送给下一级电路；
[0027]RC滤波电路，将所述第二差分放大器的输出信号转化成差分控制电压，反馈给所述补偿单元，调节占空比。
[0028]进一步地，所述第一输入放大器电路包括:M0S管M31、M0S管M32、M0S管M33以及两个负载电阻Rl ；
[0029]所述MOS管M31和MOS管M32构成输入对管，将所述第一级CML转CMOS的输出信号out3a和out3b由CMOS信号转换为CML电平信号；
[0030]其中，所述MOS管M31和MOS管M32的源极与所述MOS管M33的漏极相连；
[0031 ] 所述MOS管M31的栅极连接信号out3a，漏极通过一个所述负载电阻Rl连接VDD，将信号out3a转换成CML电平信号Vcn-，由所述MOS管M31的漏极输出给所述第二差分放大器电路；
[0032]所述MOS管M32的栅极连接信号out3b，漏极通过一个所述负载电阻Rl连接VDD，将信号out3b转换成CML电平信号Vcn+，由所述MOS管M32的漏极输出给所述第二差分放大器电路；
[0033]所述MOS管M33的栅极连接偏置电压Vbn，所述第一输入放大器提供尾电流，所述MOS管M33的源极接地。
[0034]进一步地，所述第二差分放大器电路包括:M0S管M34、M0S管M35、M0S管M36、M0S管M37> MOS 管 M38> MOS 管 M39> MOS 管 M30 以及 CS 电容；
[0035]所述MOS管M39的栅极连接电平信号Vcn+，所述MOS管M3tl的栅极连接电平信号Vcn-, MOS管M39和MOS管M3tl源极与所述MOS管M34的漏极相连，所述MOS管M34连接偏置电压Vbn为所述第二差分放大器电路提供尾电流；
[0036]所述MOS管M35、所述MOS管M36、所述MOS管M37以及所述MOS管M38构成负载，源极同时连接VDD，所述MOS管M35和所述MOS管M36的漏极与所述MOS管M39的漏极连接，所述MOS管M37和所述MOS管M38的漏极与所述MOS管M3tl的漏极连接，并且所述MOS管M36和所述MOS管M38的栅漏短接构成二极管负载，所述MOS管M35和所述MOS管M37的栅极分别连接至所述MOS管M3tl和所述MOS管M39的漏极，构成交叉耦合正反馈电路；
[0037]所述MOS管M3tl的漏极和所述MOS管M39的漏极均分别通过一个CS电容接地构成共模提取电路，将占空比误差放大积分，输出给所述RC滤波电路。
[0038]进一步地，所述RC滤波电路包括:两个低通滤波电路，将所述第二差分放电器电路的输出信号转换成差分控制电压V。+和V。-，反馈给所述占空比调节电路，调整输入信号的共模电压，实现占空比调节。
[0039]进一步地，还包括:第二级CML转CMOS电路；
[0040]所述第二级CML转CMOS电路接收所述第一级CML转CMOS电路的输出信号out3a和out3b,进行整形微调,输出信号outa和outb。
[0041]本发明提供的占空比校正电路是一种闭环负反馈式结构的占空比校正电路，通过周期性连续的对信号的占空比进行比较和调节，提高校正的精度；同时本发明电路中的输入缓冲器、占空比调节、CML_CM0S电路模块都具有对占空比进行调节的能力，极大程度地改善了电路的校正能力和误差；通过占空比调整和比较电路的反馈控制，能够提升信号转化效率和精度，抑制温度偏移等干扰；同时本校正电路是一种高度对称的全模拟电路，电路结构简单，功耗低，降低了实现的复杂度，避免了数字电路翻转和时序紊乱所带来的影响；同时由于电路的对称性，可以保证电路对PVT等因素的抗干扰能力强，提高电路的稳定性，电路的鲁棒性好。
【专利附图】
【附图说明】
[0042]图1为本发明实施例提供的占空比校正电路的结构示意图；
[0043]图2为本发明实施例提供的输入缓冲器的结构示意图；
[0044]图3为本发明实施例提供的占空比调节电路的结构示意图；
[0045]图4为本发明实施例提供的CML转CMOS电路结构示意图；
[0046]图5为本发明实施例提供的占空比比较电路结构示意图。
【具体实施方式】
[0047]参见图1和图3，本发明实施例提供的一种占空比校正电路，用于实时调整差分信号的占空比；包括:
[0048]输入缓冲器100，用于接收差分信号clka和clkb，通过设置共模电平实现差分信号的占空比的初步调整，并输出信号outla和outlb ；
[0049]占空比调节电路110，用于接收信号outla和outlb，调整器占空比，并输出信号out2ah 和 out2b ；
[0050]第一级CML转CMOS电路120，用于接收信号out2a和out2b，并对其摆幅进行放大和整形，输出信号out3a和out3b ；
[0051]占空比比较电路130，接收信号out3a和out3b，提取占空比信息，将占空比误差放大积分，输出差分控制电压V。+和Vc-，反馈控制所述占空比调节电路。
[0052]其中，占空比调节电路110包括:
[0053]差分放大器电路111，对信号outIa和outlb进行放大，调节占空比，输出给下一级电路；
[0054]补偿调节单元112，接收占空比比较电路输出的反馈差分控制电压，输出电流补偿，拉高或者降低占空比调节电路的输出信号out2a和out2b的共模电平，实现占空比反馈调节；
[0055]本发明实施例提供的电路经由输入缓冲器100对输入的差分信号clka和clkb的共模电平进行重新设置，从而对其占空比进行微调；占空比比较电路130完成对输入信号的占空比信息提取，并将其转换成电压信息反馈至占空比调节电路110，然后通过对输入信号共模电平的调节来实现占空比的校正；CML转CMOS电路对信号的摆幅进行放大和整形，最终输出占空比为50%的时钟信号。该电路是闭环负反馈式结构，通过周期性连续的对占空比进行比较和调节，可以提高校正的精度。同时，本发明是一种高度对称的全模拟电路结构，结构简单，功耗低，可以在极高频率极大范围内对输入时钟信号的占空比进行校正，并且对工艺、电压和温度(PVT)等因素的抗干扰能力强。
[0056]基于反馈的电压信号来调节输入缓冲器的输出时钟信号占空比误差，并将调节后的时钟信号传输至一级CML_CM0S电路，对其再次进行微调整形。
[0057]差分放大器电路111对输入缓冲器输出信号outla和outlb进行放大，并对占空比的误差微调，将其传输至补偿调节单元112，有效抑制温度漂移等干扰。补偿调节单元112的输入端接收反馈的电压信号，不同的电压信号将会引起电流补偿，从而改变输出差分信号的共模电平，通过拉高或者降低输入信号的共模电平来调节其占空比，并将产生的输出信号连接至第一级CML_CM0S电路120。
[0058]差分放大器电路包括:M0S管Mp MOS管M2、MOS管M5以及两个负载电阻R。
[0059]MOS管M1的栅极接信号outla，MOS管M2的栅极接信号outlb ；
[0060]MOS管M1和MOS管M2的源极与M5的漏极相连；
[0061]MOS管M1和MOS管M2的漏极分别通过一个负载电阻R连接Vdd ；
[0062]MOS管M1和MOS管M2的漏极分别连接所述补偿调节单元的输出端，构成所述差分放大器电路的输出端，所述MOS管M1的漏极输出信号out2b，所述MOS管M2的漏极out 2a。
[0063]MOS管M5的栅极连接偏置电压Vbias，源极接地。
[0064]补偿调节单元包括:M0S管M3、MOS管M4以及MOS管M6 ；
[0065]所述MOS管M3和MOS管M4的源极与所述MOS管M6的漏极相连；
[0066]所述MOS管M3的栅极连接所述占空比比较电路的差分控制电压V。+，所述MOS管M3的漏极连接所述MOS管M1的漏极，输出信号out2b ；
[0067]所述MOS管M4的栅极连接所述占空比比较电路的差分控制电压V。-，所述MOS管M4的漏极连接所述MOS管M2的漏极，输出信号out2a ；
[0068]所述MOS管M6的栅极连接偏置电压Vbias，源极接地。
[0069]占空比调节电路110通过调整时钟信号的共模电平来实现。当输入的时钟信号outla超过50%时，则MOS管M1的漏端电压小于MOS管M2的漏端电压，则此电流经由第一级CML转CMOS电路输出，也使得输出的占空比大于50%，该差分信号接入至占空比比较电路的输入端，占空比比较电路通过提取占空比的信息并将其转化为电压反馈控制信号，此时反馈信号V。+的值会大于Vc-，电流通过MOS管M3流入MOS管M1，将MOS管M1的漏端电压提高，补偿由输入差分信号引起的电压差值；同理，当输入信号的占空比小于50%时，占空比比较电路同样将输入的差分信号转化成电压控制信号，并反馈至调节电路的输入端，通过拉高或降低输入信号的共模电平，完成对占空比的调节。
[0070]参见图5，占空比比较电路130包括:
[0071]第一输入放大器电路131，用于将第一级CML转CMOS电路120的输出CMOS信号转换成CML电平信号；
[0072]第二差分放大电器电路132，用于共模提取占空比的误差并放大积分，输送给下一级电路；
[0073]RC滤波电路133，将第二差分放大器的输出信号转化成差分控制电压，反馈给补偿单元112，调节占空比。
[0074]占空比比较电路按输入信号out3a和out3b的跳变周期将时钟信号的积分值作为平均电平值输出，再由反馈环路将输出的电压信号V。+和V。—接至占空比调节电路的第三输入端和第四输入端，使其对占空比进行调节；
[0075]第一输入放大器电路131将CMOS信号转为CML电平信号,可以减小由于时钟信号周期性跳变而导致的电压抖动；第二差分放大器电路132将占空比的误差进行放大，由于输入信号的占空比不同将导致放大器对输出节点的充放电时间不同；RC滤波电路133将第二差分放大器电路132的输出信号信息转化成差分控制电压，并将其反馈至占空比调节电路110的输入端，构成闭环环路。
[0076]第一输入放大器电路131包括:M0S管M31、MOS管M32、MOS管M33以及两个负载电阻Rl ；
[0077]MOS管M31和MOS管M32构成输入对管，将第一级CML转CMOS的输出信号out3a和out3b由CMOS信号转换为CML电平信号；
[0078]其中，MOS管M31和MOS管M32的源极与MOS管M33的漏极相连；
[0079]MOS管M31的栅极连接信号out3a，漏极通过一个所述负载电阻Rl连接VDD，将信号out3a转换成CML电平信号Vcn-，由MOS管M31的漏极输出给第二差分放大器电路；
[0080]MOS管M32的栅极连接信号out3b，漏极通过一个负载电阻Rl连接VDD，将信号out3b转换成CML电平信号Vcn+，由MOS管M32的漏极输出给第二差分放大器电路；
[0081]MOS管M33的栅极连接偏置电压Vbn,第一输入放大器提供尾电流,所述MOS管M33的源极接地，该放大器将CMOS信号转为CML电平信号，可以减小由于时钟信号周期性跳变而导致的电压抖动；
[0082]第二差分放大器电路132包括:M0S管M34、M0S管M35、M0S管M36、M0S管M37、M0S管M38> MOS 管 M39、MOS 管 M3tl 以及 CS 电容；
[0083]MOS管M39的栅极连接电平信号Vcn+，MOS管M3tl的栅极连接电平信号Vcn_，MOS管M39和MOS管M3tl源极与MOS管M34的漏极相连，MOS管M34连接偏置电压Vbn为第二差分放大器电路提供尾电流；
[0084]MOS管M35、MOS管M36、MOS管M37以及MOS管M38构成负载，源极同时连接VDD，MOS管M35和MOS管M36的漏极与MOS管M39的漏极连接，MOS管M37和MOS管M38的漏极与MOS管M30的漏极连接，并且MOS管M36和MOS管M38的栅漏短接构成二极管负载，MOS管M35和MOS管M37的栅极分别连接至MOS管M3tl和MOS管M39的漏极，构成交叉耦合正反馈电路；使得信号的转换速率高，更陡的信号边沿对于时钟抖动的抑制效果也会更好；
[0085]MOS管M3tl的漏极和MOS管M39的漏极均分别通过一个CS电容接地构成共模提取电路，将占空比误差放大积分，输出给RC滤波电路。
[0086]RC滤波电路包括:两个低通滤波电路，将第二差分放电器电路的输出信号转换成差分控制电压V。+和V。-，反馈给占空比调节电路，调整输入信号的共模电压，实现占空比调节。RC滤波器将第二差分放大器的输入信号信息转化成差分控制电压，并将其反馈至占空比调节电路的输入端，构成闭环环路。
[0087]参见图1和图4，CML转CMOS电路是一个差分输入差分输出的电平转换电路；第一级CML转CMOS电路120用于将低摆幅的输入信号out2a和out2b放大至轨到轨的全摆幅输出时钟信号，同时可以对时钟信号的占空比进行微调，产生接至占空比比较电路和第二级CML转CMOS电路的信号out3a和out3b ;第二级CML转CMOS电路的作用是通过对调节后的时钟信号再次进行整形微调，使得最终的时钟信号能够稳定到50%。
[0088]本发明的CML转CMOS电路晶体管数目少，结构简单，具有对称性，能够将低摆幅的输入信号放大成完全对称的全摆幅输出信号，对时钟信号进行整形微调。
[0089]参见图4，CML转CMOS电路由两个差分转单端电路和伪差分放大器电路组成。所述第一差分转单端电路121是一个5管差分输入单端输出电路,其中输入对管MOS管M21和MOS管M22的栅极分别接前级电路的差分信号IP和IN，MOS管M21和MOS管M22的源极与MOS管M25的漏极相连，MOS管M21和MOS管M22的漏极分别与MOS管M23和MOS管M24的漏极相连；M0S管M23的栅漏短接，与MOS管M24的栅极连在一起，且MOS管M23和MOS管M24的源极和衬底同时接VDD，构成PMOS电流镜负载；M0S管M25的栅极接偏置电压Vbl，源极和衬底同时接地，为输入对管提供尾电流；第二差分转单端电路122与第一差分转单端电路121结构一样，只是其中输入对管MOS管M11和MOS管M12的栅极分别接信号IN和IP。第一伪差分放大器电路123是一个4管的差分输入放大器，其中输入对管MOS管M28和MOS管M29的栅极分别接第一差分转单端电路121与第二差分转单端电路122的输出端125和126，管MOS管M28和MOS管M29的源极和衬底同时接VDD，且管MOS管M28和MOS管M29的漏极分别与MOS管M26和MOS管M27的漏极相连；M0S管M26的栅漏短接，与MOS管M2的栅极连在一起，且MOS管M26和MOS管M27的源极和衬底同时接地，构成NMOS电流镜负载，从MOS管M27和MOS管M29的漏极引出输出端口 OP ;第二伪差分放大器电路124与第一伪差分放大器电路123结构一样，只是其输入对管MOS管M18和MOS管M19的栅极分别接信号126和125。
[0090]参见图2，输入缓冲器100是交流耦合缓冲器，包括:第一电容101、第二电容104、第一电阻102、第二电阻103、第三电阻105、第四电阻106 ;第一电容(101)和第二电容104的容值相等，一端分别接第一输入的时钟信号clka和clkb ;第一电阻102的一端接电源电压vdd，另一端接第二输出时钟信号outla，第二电阻103的一端接地,另一端也与第二输出时钟信号outla相连；第三电阻105的一端接电源电压VDD，另一端接第二时钟信号outlb，第二电阻106的一端接地，另一端也与第二时钟信号outlb相连；电阻102和105的阻值相等，103和106的阻值相等。差分输入信号分别经由电阻102和103，105和106的阻值之比来决定其共模电平，从而对其占空比进行微调，增强信号的驱动能力。
[0091]本实施例提供的占空比校正电路是一种闭环负反馈式结构的占空比校正电路，通过周期性连续的对信号的占空比进行比较和调节，提高校正的精度；同时本发明电路中的输入缓冲器、占空比调节、CML_CMOS电路模块都具有对占空比进行调节的能力，极大程度地改善了电路的校正能力和误差；通过占空比调整和比较电路的反馈控制，能够提升信号转化效率和精度，抑制温度偏移等干扰；同时本校正电路是一种高度对称的全模拟电路，电路结构简单，功耗低，降低了实现的复杂度，避免了数字电路翻转和时序紊乱所带来的影响；同时由于电路的对称性，可以保证电路对PVT等因素的抗干扰能力强，提高电路的稳定性，电路的鲁棒性好。
[0092]最后所应说明的是，以上【具体实施方式】仅用以说明本发明的技术方案而非限制，尽管参照实例对本发明进行了详细说明，本领域的普通技术人员应当理解，可以对本发明的技术方案进行修改或者等同替换，而不脱离本发明技术方案的精神和范围，其均应涵盖在本发明的权利要求范围当中。
【权利要求】
1.一种占空比校正电路，用于实时调整差分信号的占空比；其特征在于，包括:输入缓冲器，用于接收差分信号Clka和clkb，通过设置共模电平实现差分信号的占空比的初步调整，并输出信号outla和outlb ； 占空比调节电路，用于接收信号outla和outlb，调整器占空比，并输出信号out2a和out2b ； 第一级CML转CMOS电路，用于接收信号out2a和out2b，并对其摆幅进行放大和整形，输出信号out3a和out3b ； 占空比比较电路，接收信号out3a和out3b，提取占空比信息，将占空比误差放大积分，输出差分控制电压1+和Vc-，反馈控制所述占空比调节电路； 其中，占空比调节电路包括:差分放大器电路，对信号outla和outlb进行放大，调节占空比，输出给下一级电路；补偿调节单元，接收所述占空比比较电路输出的反馈差分控制电压，输出电流补偿，拉高或者降低占空比调节电路的输出信号out2a和out2b的共模电平，实现占空比反馈调节。
2.如权利要求1所述的占空比校正电路，其特征在于，所述差分放大器电路包括:M0S管MpMOS管以及两个负载电阻R; 所述M0S管Mi的栅极接信号outla，M0S管M2的栅极接信号outlb ； 所述M0S管Mi和M0S管M2的源极与M5的漏极相连； 所述M0S管Mi和M0S管M2的漏极分别通过一个负载电阻R连接VDD ； 所述M0S管Mi和M0S管M2的漏极分别连接所述补偿调节单元的输出端，构成所述差分放大器电路的输出端，所述皿^管札的漏极输出信号out2b，所述皿^管仏的漏极out 2a ；所述1?5管仏的栅极连接偏置电压Vbias，源极接地。
3.如权利要求2所述的占空比校正电路，其特征在于，所述补偿调节单元包括:M0S管M3、M0S 管 M4 以及 M0S 管 M6 ； 所述M0S管M3和M0S管M4的源极与所述M0S管M6的漏极相连； 所述M0S管M3的栅极连接所述占空比比较电路的差分控制电压Ve+，所述M0S管M3的漏极连接所述M0S管Mi的漏极，输出信号out2b ； 所述M0S管M4的栅极连接所述占空比比较电路的差分控制电压V。-，所述M0S管M4的漏极连接所述M0S管M2的漏极，输出信号out2a ； 所述1?5管仏的栅极连接偏置电压Vbias，源极接地。
4.如权利要求1所述的占空比校正电路，其特征在于，所述占空比比较电路包括: 第一输入放大器电路，用于将第一级CML转CMOS电路的输出CMOS信号转换成CML电平?目号; 第二差分放大电器电路，用于共模提取占空比的误差并放大积分，输送给下一级电路； RC滤波电路，将所述第二差分放大器的输出信号转化成差分控制电压，反馈给所述补偿单元，调节占空比。
5.如权利要求4所述的占空比校正电路，其特征在于，所述第一输入放大器电路包括:M0S管M31、M0S管M32、M0S管Μ33以及两个负载电阻R1 ； 所述M0S管M31和M0S管M32构成输入对管，将所述第一级CML转CMOS的输出信号out3a和out3b由CMOS信号转换为CML电平信号； 其中，所述M0S管M31和M0S管M32的源极与所述M0S管M33的漏极相连； 所述M0S管M31的栅极连接信号out3a，漏极通过一个所述负载电阻R1连接VDD，将信号out3a转换成CML电平信号Vcn_,由所述M0S管M31的漏极输出给所述第二差分放大器电路； 所述M0S管M32的栅极连接信号out3b，漏极通过一个所述负载电阻R1连接VDD，将信号out3b转换成CML电平信号Vcn+，由所述M0S管M32的漏极输出给所述第二差分放大器电路； 所述M0S管M33的栅极连接偏置电压Vbn，所述第一输入放大器提供尾电流，所述M0S管M33的源极接地。
6.如权利要求5所述的占空比校正电路，其特征在于，所述第二差分放大器电路包括:M0S 管 M34、M0S 管 M35、M0S 管 M36、M0S 管 M37、M0S 管 M38、M0S 管 M39、M0S 管 M30 以及 CS 电容； 所述M0S管M39的栅极连接电平信号Vcn+，所述M0S管M3(l的栅极连接电平信号Vcn-，M0S管M39和M0S管M3(i源极与所述M0S管M34的漏极相连，所述M0S管M34连接偏置电压Vbn为所述第二差分放大器电路提供尾电流； 所述M0S管M35、所述M0S管M36、所述M0S管M37以及所述M0S管M38构成负载，源极同时连接VDD，所述M0S管M35和所述M0S管M36的漏极与所述M0S管M39的漏极连接，所述M0S管M37和所述M0S管M38的漏极与所述M0S管M3(i的漏极连接，并且所述M0S管M36和所述M0S管M38的栅漏短接构成二极管负载，所述M0S管M35和所述M0S管M37的栅极分别连接至所述M0S管M3(i和所述M0S管M39的漏极，构成交叉耦合正反馈电路； 所述M0S管M3(i的漏极和所述M0S管M39的漏极均分别通过一个CS电容接地构成共模提取电路，将占空比误差放大积分，输出给所述RC滤波电路。
7.如权利要求6所述的占空比校正电路，其特征在于，所述RC滤波电路包括:两个低通滤波电路，将所述第二差分放电器电路的输出信号转换成差分控制电压1+和V。-，反馈给所述占空比调节电路，调整输入信号的共模电压，实现占空比调节。
8.如权利要求1所述的占空比校正电路，其特征在于，还包括:第二级CML转CMOS电路； 所述第二级CML转CMOS电路接收所述第一级CML转CMOS电路的输出信号out3a和out3b,进行整形微调，输出信号outa和outb。
【文档编号】H03K3/017GK104270122SQ201410473096
【公开日】2015年1月7日 申请日期:2014年9月16日 优先权日:2014年9月16日
【发明者】邱玉松, 张锋 申请人:中国科学院微电子研究所