一种基于触发器的时钟同步输出电路的制作方法

本实用新型涉及时钟同步输出领域，尤其涉及一种基于触发器控制的时钟同步输出电路。

背景技术：

在涉及控制两路信号同步输出的应用领域，尤其是在基于相位检波技术的测量应用中，需要产生两路同步同相输出的信号；而选用复杂的集成化的双路同步输出控制器太过昂贵，因此本专利提供了一种基于触发器的控制两路独立信号发生器的同步同相输出电路。

技术实现要素：

为了克服上述现有技术的不足，本实用新型提出了一种基于触发器的时钟同步输出电路。

本实用新型所采用的技术方案是：

一种基于触发器的时钟同步输出电路，包括主控制器、晶振单元、触发器单元和两个信号发送器单元；所述主控制器的输出端连接触发器单元的输入端，所述主控制器的输出端输出同步触发信号；所述触发器单元的输出端连接两个信号发送器单元，所述触发器单元输出同步输出信号；所述晶振单元的输出端分别连接两个信号发送器单元和触发器单元的输入端，所述晶振单元输出同步时钟信号。

进一步的，所述晶振单元包括晶振、第一电阻和第二电阻，所述晶振的第一引脚通过第一电阻接3.3V电压，通过第二电阻接地；所述晶振的接地端接地，所述晶振的电源端连接3.3V电压；所述晶振的输出端分别连接触发器单元和两个信号发生器单元，所述晶振的输出端输出同步时钟信号。

进一步的，所述触发器单元包括触发器、第三电阻、第四电阻、第五电阻、电容和第六电阻；所述触发器的时钟信号输入端通过第三电阻与晶振的输出端相连，所述触发器的触发信号输入端通过第四电阻连接主控制器的输出端；所述触发器的接地端接地；所述触发器的信号输出端连接信号发送器单元，所述触发器的信号输出端输出同步输出信号；所述触发器的第六引脚通过第五电阻接3.3V电压，通过电容接地；所述触发器的第七引脚通过第六电阻接3.3V电压。

进一步的，所述信号发生器单元包括信号发生器、第七电阻、第八电阻和第九电阻；所述信号发生器的第八引脚通过第七电阻连接触发器的信号输出端；所述信号发生器的第六引脚通过第八电阻连接晶振的输出端；所述信号发生器的第十二引脚通过第九电阻接地；所述信号发生器的接地端接地；所述信号发生器的电源端连接3.3V电压；所述信号发生器的输出端输出同步同相输出信号。

进一步的，所述主控制器为MSP430F247。

进一步的，所述晶振为TXC40M7Q。

进一步的，所述触发器为：74LVC1G74。

进一步的，所述信号发生器为AD9850。

与现有技术相比，本实用新型的有益效果是：

(1)本实用新型实现了控制两路信号同步输出，在基于相位检波技术的测量应用中，能够提供两路同步同相输出的信号；

(2)本实用新型的电路简单，稳定性高，实用性强，造价低，能保证应用的需求。

附图说明

图1是本实用新型的整体结构图；

图2是晶振单元和触发器单元连接电路图；

图3是信号发生器单元的电路图；

其中，1.主控制器，2.晶振单元，3.触发器单元，4.信号发生器单元。

具体实施方式

下面结合附图对本实用新型进一步说明。

如图1所示，一种基于触发器的时钟同步输出电路，包括主控制器1、晶振单元2、触发器单元3和两个信号发送器单元4；所述主控制器1的输出端连接触发器单元3的输入端；所述触发器单元3的输出端连接两个信号发送器单元4；所述晶振单元2的输出端分别连接两个信号发送器单元4和触发器单元3的输入端；所述主控制器1为MSP430F247；

上电工作以后，晶振单元2开始工作，持续输出方波同步时钟信号FQ，分别输入到信号发生器单元4和触发器单元3；

主控制器1产生一个同步触发信号REF-CLK到触发器单元3，触发器单元3的输出端会在时钟上升沿产生一个同步输出信号FQ-S，同时该同步输出信号FQ-S输入到两个信号发生器单元4中，作为信号发生器单元4的输入信号；

两个信号发生器单元4接收到同步信号作为信号发生器的输入信号，基于晶振电路给出的时钟信号，在其上升或者下降沿，分别同步输出同步同相输出信号W-CLK，提供给需要同步同相信号的应用电路中。

如图2所述，所述晶振单元2包括晶振OSC1、第一电阻R1和第二电阻R2，所述晶振OSC1的第一引脚通过第一电阻接3.3V电压，通过第二电阻接地；所述晶振OSC1为TXC40M7Q；所述晶振OSC1的接地端接地，所述晶振OSC1的电源端连接3.3V电压；所述晶振OSC1的输出端分别连接触发器单元3和两个信号发生器单元4，所述晶振的输出端输出同步时钟信号FQ。

当晶振单元2中晶振OSC1的电源端供电以后，晶振OSC1的输出端会输出一个连续的方波信号，作为触发器单元3和信号发生器单元4的同步时钟信号REF-CLK。

如图2所述，所述触发器单元3包括触发器U2、第三电阻R3、第四电阻R4、第五电阻R5、电容C1和第六电阻R6；所述触发器U2为：74LVC1G74；所述触发器U2的时钟信号输入端通过第三电阻R23B与晶振的输出端相连，所述触发器U2的触发信号输入端通过第四电阻R4连接主控制器的输出端；所述触发器U2的接地端接地；所述触发器U2的信号输出端连接信号发送器单元，所述触发器U2的信号输出端输出同步输出信号FQ-S；所述触发器U2的第六引脚通过第五电阻R5接3.3V电压，通过电容C1接地；所述触发器U2的第七引脚通过第六电阻R6接3.3V电压。

当触发器单元3上电以后，接收到来自晶振单元4的同步时钟信号REF-CLK，以及来自主控制器的同步触发信号FQ，触发器U2的信号输出端会在同步时钟信号REF-CLK上升沿输出一个同步输出信号FQ-S，同步信号FQ-S输入到两个信号发生器单元4中。

如图3所述，所述信号发生器单元4包括信号发生器U1、第七电阻R7、第八电阻R8和第九电阻R9；所述信号发生器U1的第八引脚通过第七电阻R7连接触发器的信号输出端；所述信号发生器U1为AD9850；所述信号发生器U1的第六引脚通过第八电阻R8连接晶振的输出端；所述信号发生器U1的第十二引脚通过第九电阻R9接地；所述信号发生器U1的接地端接地；所述信号发生器U1的电源端连接3.3V电压；所述信号发生器U1的输出端输出同步同相输出信号W-CLK。

所述信号发生器单元4接收到来自触发器单元3的同步输出信号FQ-S作为信号发生器U1的输入信号，连接晶振单元2输出的同步时钟信号REF-CLK，在其上升或者下降沿，两个信号发生器单元输出同步同相输出信号W-CLK；这样通过触发器U2的边缘触发效果，保证了两个信号发生器U1在同一个时钟边缘开始输出信号波形，保证了输出信号的同步并且同相位。

上述虽然结合附图对本实用新型的具体实施方式进行了描述，但并非对本实用新型保护范围的限制，所属领域技术人员应该明白，在本实用新型的技术方案的基础上，本领域技术人员不需要付出创造性劳动即可做出的各种修改或变形仍在本实用新型的保护范围以内。